JPS5948114U - ソ−スフオロワ回路 - Google Patents
ソ−スフオロワ回路Info
- Publication number
- JPS5948114U JPS5948114U JP16057181U JP16057181U JPS5948114U JP S5948114 U JPS5948114 U JP S5948114U JP 16057181 U JP16057181 U JP 16057181U JP 16057181 U JP16057181 U JP 16057181U JP S5948114 U JPS5948114 U JP S5948114U
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- JP
- Japan
- Prior art keywords
- source
- constant current
- field effect
- effect transistor
- reference potential
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来のソースフォロワ回路の構成図、第２図は
この考案のソースフォロワ回路を示す構成図、第３図は
この考案のソースフォロワ回路吉次段ＦＥＴ回路との接
続状態を示すパワーアンプ回路の構成図である。 ＶＧ・・・信号源、ＢＣ，ＢＥ、 Ｂ□、Ｂ２・・・電
源、Ｑ□〜Ｑ６・・・ＦＥＴ、 Ｒ３，Ｒ□〜Ｒ４・・
・抵抗、Ｔ、Ｔ□〜Ｔ３・・・端子。
この考案のソースフォロワ回路を示す構成図、第３図は
この考案のソースフォロワ回路吉次段ＦＥＴ回路との接
続状態を示すパワーアンプ回路の構成図である。 ＶＧ・・・信号源、ＢＣ，ＢＥ、 Ｂ□、Ｂ２・・・電
源、Ｑ□〜Ｑ６・・・ＦＥＴ、 Ｒ３，Ｒ□〜Ｒ４・・
・抵抗、Ｔ、Ｔ□〜Ｔ３・・・端子。
Claims (1)
- 電界効果トランジスタのソースを一定値の抵抗を介して
基準電位点に接続するとともに、ドレインを第１の電源
に接続し、かつ前記ソースを定電流回路を介して前記第
１の電源とは逆極性の第２の電源に接続し、前記定電流
回路により前記抵抗に前記基準電位点から前記定電流回
路へ向かう直−流バイアス電流を流し、前記ソースを次
段電界効果トランジスタのゲートに直結し、かつ前記基
準電位点を前記次段電界効果トランジスタのソースに直
流的に接続するように構成したことを特徴とするソース
フォロワ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16057181U JPS5948114U (ja) | 1981-10-28 | 1981-10-28 | ソ−スフオロワ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16057181U JPS5948114U (ja) | 1981-10-28 | 1981-10-28 | ソ−スフオロワ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5948114U true JPS5948114U (ja) | 1984-03-30 |
Family
ID=30353134
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16057181U Pending JPS5948114U (ja) | 1981-10-28 | 1981-10-28 | ソ−スフオロワ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5948114U (ja) |
-
1981
- 1981-10-28 JP JP16057181U patent/JPS5948114U/ja active Pending
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