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JPS59218493A - 図形表示情報記憶方法 - Google Patents

図形表示情報記憶方法

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Publication number
JPS59218493A
JPS59218493A JP58093665A JP9366583A JPS59218493A JP S59218493 A JPS59218493 A JP S59218493A JP 58093665 A JP58093665 A JP 58093665A JP 9366583 A JP9366583 A JP 9366583A JP S59218493 A JPS59218493 A JP S59218493A
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JP
Japan
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graphic display
address
graphic
memory
area
Prior art date
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Application number
JP58093665A
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English (en)
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JPH0325792B2 (ja
Inventor
大上 勝也
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sharp Corp
Original Assignee
Sharp Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
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Publication date
Application filed by Sharp Corp filed Critical Sharp Corp
Priority to JP58093665A priority Critical patent/JPS59218493A/ja
Priority to US06/563,508 priority patent/US4700182A/en
Priority to DE3347644A priority patent/DE3347644A1/de
Priority to BR8401306A priority patent/BR8401306A/pt
Publication of JPS59218493A publication Critical patent/JPS59218493A/ja
Publication of JPH0325792B2 publication Critical patent/JPH0325792B2/ja
Granted legal-status Critical Current

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    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G5/00Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
    • G09G5/36Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of a graphic pattern, e.g. using an all-points-addressable [APA] memory
    • G09G5/39Control of the bit-mapped memory
    • G09G5/393Arrangements for updating the contents of the bit-mapped memory

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Controls And Circuits For Display Device (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〈発明の技術分野〉 本発明は、図形表示情報処理装置に係り、特には検索が
容易で、かつ、メモリ容量の低減化が図れ、しかも編集
が容易な図形表示情報記憶方式に関する。
〈従来技術及びその問題点〉 最近、グラフィックディスプレイを利用して割算機と対
話しながら設計を行うCAD技法や、割算機を利用して
生産設計を行うCAM技法が開発され、複雑で大型図面
の作成が可能となってきた。
従来、かかる図形を主とするグラフィック・ディスプレ
イ情報処理装置に於ては、追加、削除。
変更などの情報の編集を容易にするだめ図形表示情報を
その最小構成単位を表わすセグメント(図形表示要素)
として定義づけ、これらを例えば1セグメントを256
バイトとして固定長でデータメモリに記憶する方法が採
られてきた。
しかしながら、固定長で図形表示情報をデータメモリに
記憶する方法は、データメモリ領域が無駄に浪費されて
メモリの有効利用が図れず、そのだめメモリ容量の増大
に繋がる欠点があった。
〈本発明の目的ン 本発明は、上記従来の欠点を除去する為になされたもの
で、特にデータメモリの所定領域(エリア)に図形表示
要素もしくは図形表示要素群を可変長で分割記憶させる
ことによって、検索が容易で、かつ、メモリ容量の低減
化が図れる図形表示情報記憶方式を提供することを目的
とする。
まだ、他の目的は、データメモリに、図形表示要素もし
くは図形表示要素群に関連した追加アドレスを記憶する
領域を設け、この追加アドレスに基づいて追加すべき追
加図形表示要素もしくは追加図形表示要素群を選択指定
することによって、可変長で記憶する図形表示情報の編
集を容易にすることができる図形表示情報記憶方式を提
供するものである。
〈実施例の説明〉 第1図は図形表示情報処理装置の一例のブロック図を示
し、lはデータバス7に接続される中央処理ユニッ) 
(CPLI)であり、このCPLIIは予めプログラム
データを記憶するプログラム・メモリ2のプログラムデ
ータに基づいて制御される。3はデータメモリであり、
同じくデータバス7に接続され、CPIJ lの制御の
もとに種々の図形表示情報を記憶する。このデータメモ
リは、そのほか各種バッファ、状態フラグ等を有してい
る。4〜6はグラフィック・ディスプレイ装置を構成す
るもので、グラフインク・ディスプレイ・コントロール
・ユニット(GDC)4 (GDCとして例えばtJ 
P D 7220 (日本電気社製)を使用できる)と
、ラスク走査されるCRTディスプレイの画面の表示ド
ツトに対応した記憶ドツト領域をもつドツトマツプメモ
リ5と、CRTディスプレイ6とから構成される。上記
GDC4には、データメモリ3に記憶された図形表示情
報が供給され、GDC4によりこの図形表示情報を図形
ドツト表示パターンに展開してドツトマツプメモリ5に
記憶させる。
GDC4は、C’RTディスプレイ6のラスク走査に同
期してドツトマツプメモリ5から図形ドyト表、示パタ
ーンを読出し、輝度信号としてCRTディスプレイ6に
供給し、図形表示情報を表示する。
図示していないが、データバス7には、このほか図形表
示情報入力装置、キーボード等の各種入出力端末装置が
インターフェースを介して接続される。上記図形表示情
報は、例えばタブレット入力装置から図形の種類或いは
ユーザー・プログラムを指示することによって発生でき
る。
上記データメモリ3のメモリ構成は本発明の実施例によ
れば第2図のように構成される。第2図はデータメモリ
のメモリ構成及びそのメモリのアドレス構成を示してい
る。ここで、メモリ30は、図形(picture )
テーブル300、セグメント(segment)テーブ
ル301及び図形表示要素もしくは図形表示要素群を記
憶するメモI7302(以下要素r primitiv
e J  メモリという)とを含む。
まだ別に、メモリ30は、このメモリをアクセスするだ
めのアドレス部80を備える。上記図形テーブル300
は、1つの表示画面に対して図形番号単位に分類され、
CPtJ Iから指定されて各々異なる図形番号を記憶
するエリアと、前段に記憶された図形番号のアドレス値
を記憶するラストアドレスエリアと次段に設定された図
形番号の記憶位置を示すNEXTアドレスエリア、及び
図形番号に対応するセグメントテーブル301の先頭ア
ドレスを記憶するセグメントアドレスエリアとを有腰図
形番号ごとに固定長で分割記憶して構成する。
それゆえ、図形テーブル300は、図形番号に対応する
セグメントテーブル301のスタートアドレスを指定で
きる。上記図形テーブル300ば、別にこのテーブルを
アクセスするだめのアドレスバッファ81を有する。ア
ドレスバッファはアドレスポインタ(APic)とスタ
ックポインタ(SPie)とから構成される。一方、セ
グメントテーブル301は、要素メモリ3020図形要
素もしくは図形要素群のスタートアドレスを指定するだ
めに設ける。このセグメントテーブルは、CPU 1か
ら設定したセグメント番号を記憶するエリアと、前段に
記憶されたセグメントデータのアドレス値を記憶するラ
ストアドレスエリアと、次段のアドレス値を記憶するN
EXTアドレスエリアと、セグメント番号に対応する要
素メモリ302の先頭アドレスを記憶する要素メモリア
ドレスエリアと、1つのセグメントに対して、例えば拡
大縮少率、回転角、座標中心点などの変形パラメータを
記憶する図形変形表示情報記憶エリアとをセグメント番
号ごとに固定長で分割して記憶する。それゆえ、セグメ
ントテーブル301の要素メモリアドレスによって要素
メモリ3020図形表示要素もしくは図形表示要素群の
スタートアドレスを指定する。
そして上記セグメントテーブル301は、別にこのテー
ブルをアクセスするだめのアドレスバッファ82を有す
る。さらに、本発明に於ては、図形表示要素もしくは図
形表示要素群を要素メモリ302に可変長で記憶させる
ことを特徴としている。従って、この要素メモリエリア
には、例えば第3図に示すように属性データおよび座標
データが可変長で少ないメモリ容量で記憶される。また
、このエリアの最後(まだは最初でもよい)にはEND
コードエリアAが形成される。このように、可変長で記
憶させることは固定長で記憶さぜる場合に比し、メモリ
容量を極めて少なくすることができる反面編集(追加な
ど)が困難となる。そのため、本発明によれば、かかる
困難を解消するだめ、追加ポインタBが設けられる。こ
の追加ポインタBは、追加される図形表示要素もしくは
図形表示要素群のスタートアドレス値を記憶する。それ
ゆえ、このスタートアドレス値によって、追加スタート
アドレス値の対応する要素メモリエリアに記憶された追
加図形表示要素もしくは要素群をアドレス選択して指定
することができる。上記要素メモリ302は、別にこの
メモリをアクセスするだめのアドレスバッファ83を備
えている。このように、データメモリ3は図形テーブル
a OO,セグメントテーブル301及び要素メモIJ
 302を有するが、そのほか、各処理状態を記憶する
だめのフラッグA−E、Xl、X2を有している(図示
せず)。
第3図には、要素メモリー302の所定メモリれる図形
表示情報の一例が示されている。図は、1つの図形番号
に対する図形表示情報を表わしており、コードの最後を
エンドコードで区切る。図形表示情報は、図形の種類を
表わす、例えば4バイト毎の属性コード(イ〜チ)と基
本図形の座標データ(ワ、ヌ)とで構成される。ここで
、(イ)〜0)は、1つの図形表示要素(セグメント)
を表わし、以後、複数のセグメントがある場合は後続し
て記憶できる。この場合、(イ)、(ハ)、(ホ)及び
(ト)はそれぞれ属性コマンドを表わし、(ロ)、に)
、(へ)及び(力はその種類を表わしている。また(口
)は座標コマンドを表わし、その後に座標データレ)を
もつ。なお、各コマンドの内容を示せば次の通りである
a・・属性コマンド    F・・・枠コードP・・座
標コマンド    E・・・枠色コードH・・・塗つぶ
しコード   R・・・長方形コードG・・塗つぶし色
コード それゆえ、(イ)のコードゝゝaH“は塗つぶし図形の
属性を表わし、(ロ)のゝゝ0002〃は斜線の塗りつ
ぶしを意味する。又(ハ)のゝゝa G LJは塗つぶ
しの色の属性を表わし、″”0001〃は赤色を表わす
。(ホ)のゝaF“は枠線の属性を表わし、(へ)のゝ
ゝooog“はその種類で連続線を意味する。また(ト
)の”aE“は枠線色の属性を表わし、(力のv′00
o2〃はその種類で緑色を意味する。また(1力のPR
“は基本図形の長方形の座標コードを表わし、(ヌ)の
XI、yl 及びX2+y2uCRTデイスプレイの座
標値を表わしている。かかる要素メモリ302に記憶さ
れる図形表示情報はグラフインク・ディスプレイ・コン
トロール・ユニット4に供給され、そして図形ドツト表
示パターンに展開されて第4図に示す如きCRTディス
プレイの画面上に表示される。第4図に於て、60はC
RTディスプレイ表示画面、61は図形表示情報によっ
て表わされる図形の一例である。以上の各コード列は予
めCPTJ’lとGDC4との間で取決められて表わさ
れる。
次に、本発明による図形情報記憶方式の動作説明を第5
図及び第6図(イ)〜(ホ)のフローチャートに従って
行う。CPUIは、予め決められたプログラムメモリ2
のプログラムに従ってcPUがら各コマンドを出力し、
又データメモリ3がらデータを発生させることによって
第5図のフローチャートを実行する。
(a)  新しい図形表示情報を表示する場合CPLI
は図形表示情報コマンドをジャッジしくno)、データ
メモリ内のフラグAをセットし、他のフラグB−Eをリ
セットする。続いて図形番号が供給されるとステップn
15より第6図(イ)へと進行する。第6図(イ)にお
いてアドレスバッファ81のスタックポインタ5Pic
は図形テーブル300の記憶可能なエリアの先頭ロケー
ション位置を示しており、このアドレス値をアドレスポ
インタAPic に転送すると共に、この値を一時的に
別のバッファに保持する(m+)。さらにAPicのア
ドレス値に基づいて図形テーブル300の対応ロケーシ
ョン位置に供給された図形番号を記憶する。
続いて、APicのアドレス値を20ケ一シヨン分増加
し、対応のロケーションがNullコード、すなわち連
続エリアの新しいエリアがジャッジされる。後述するが
図形テーブル300の連続スるエリアにおいて途中消去
されると、このエリアには次の記憶エリアのアドレス値
(Next )が記憶されている。Nullコードであ
ると、ステップm5に進行してAPicが示すアドレス
値に2upl、たロケーションアドレス値、すなわち次
段エリアの晶頭アドレスがNextアドレス値として記
憶され、その値を5Picに転送する。ステップm4に
おいて、Nullコードでなければ、その値を読出し5
Picに転送する(mB)。上述のステップで、5Pi
cには次段のアドレス値が記憶され、メモリ領域に供給
された図形番号が記憶される。続いてAPicを10ケ
ーンヨン増加してSSegφのアドレス値、すなわちセ
グメントテーブル301の記憶予定エリアの先頭アドレ
スが対応セグメントアドレスとして記憶される。更に5
PicをAr1aに転送し、続いてAPicをlu p
 L、先のステップm1で一時記憶したアドレス値を次
段エリアでのラストアドレスとして記憶する(m6〜m
+o)。
(b)  続いて、cpuはセグメント番号、図形変形
情報の供給に先立ってセグメント開始コマンドを供給す
る。第5図において、このコマンドによりステップn3
よりフラグBがセットされ、他のフラグA、C,D、E
  がリセットされる(n3〜n5)。
続いて、セグメント番号が供給され、ステップn15よ
り第6図(ロ)に進行する。第6図(ロ)において、ス
テップklからに2に進行して、SSegφのアドレス
値、すなわちセグメントテーブルの記憶予定エリアの先
頭アドレスがASegに転送されると共に、別のバッフ
ァにその値を一時記憶する。更に供給されたセグメント
番号が記憶される。更にASegを2upして第6図(
イ)ステップm4と同様にNullコードであるか判定
する。Nullコードであると、セグメントテーブルの
連続エリアの新しいエリアであり、nロケ−737分増
加した次段のエリアの先頭アドレスを記憶すると共にS
Seglに転送する(k6)。Nullコードでなけれ
ば、この値をSSegIに転送する。続いてASegを
lupして要素メモリ302の記憶予定エリアの先頭ア
ドレスを要素メモリアドレスとして記憶する( k7 
、kB )0  続いて、ASegをIupt、てAS
egをSSegφに転送し、更に次段エリアの先頭アド
レスを記憶しているSSeg IをASegに転送して
、ASegをlupする。つ捷り、次段のラストアドレ
スロケーションを示す(kg〜に12)。更に上記ステ
ップに2にて記憶したアドレス値を書込む。
次に、CPtJは変形パラメータが順次供給され、ステ
ップに+5〜k19にてセグメントテーブルに記憶され
る。次にCPLJは第3図に示す図形表示データが供給
され、ステップに20 、 k21〜に25にて要素メ
モリ302の対応エリアに記憶される。以上の動作にて
図形が登録されて完了すると、セグメント完了コマンド
が発生し、第5図ステップn6.n7.nBにてフラグ
Cがセットされて他のフラグA、B、D、Eがリセット
される。更に第6図(ハ)に進行し、要素メモリの最後
のロケーションにNullコードを記憶する。このロケ
ーションには、図形表示データを追加する場合に追加図
形表示データを記憶するエリアの先頭アドレス値が記憶
される。
このようにして登録した図形表示情報はセグメントテー
ブル301に基づいて図形要素メモリ302を順次読出
してGDC4に供給し、図形ドツト表示パターンに展開
してドツトマツプメモリ5に記憶し、CRTに表示され
る。
(c)  すでに登録した図形の消去、変更について消
去する場合、消去コマンドが供給され、第5図のステッ
プn9.nlO,n+1にてフラグDがセットされ、他
のフラグがリセットされる。続いて、消去すべきセグメ
ント番号が供給され、第6図(ロ)に進行する。まず、
最初に消去すべきセグメント番号を含んでいる図形番号
が供給され、図形テーブル300をサーチして対応めエ
リアを選択し、セグメントテーブル301のアドレス値
ASegに転送スる(S+)。続いてASegに対応す
るセグメントテーブルをサーチし、消去セグメントをサ
ーチし、そのアドレス値がASegに設定される(S2
)。
更に、その設定したセグメント番号のロケーションにN
ullコードを記憶するO ASeg−+SSeg l
で消去したロケーションアドレス値を556g+に記憶
しておく。続いて、ASeg 2up (Next ア
ドレス−)、を行い、読出しだアドレス値がSSegφ
と等しいか判定する。すなわち、SSegφと等しいな
らば、このSSegφには、一連のエリアの新しいエリ
アを示しており、消去セグメントには最も新しい登録図
形であることが判る。これによってステップS7に進行
してNullコードを記憶する。つまり、消去セグメン
トのNextアドレスが消去される(S7)。続いて、
SSegl (消去セグメントの先頭アドレス)を次に
登録するエリアとする。上記消去したセグメントが一連
のテーブルの途中のエリアであれば、ステップS5で不
一致となり、ステップS9に進行する。読出しだNex
tアドレス値を一時記憶してASegをldownする
(S9,510)。すなわち、ASegに消去セグメン
トの前段のアドレス値を記憶するロケーションアドレス
が記憶され、更にASegを2upする(Sll。
512)。すなわち、Nextアドレスロケーションを
示す。このロケーションにステップS9で記憶したアド
レス値を記憶する。すなわち消去セグメントエリアを飛
ばして次のセグメントエリアのア、ドレス値がNext
アドレス値として記憶される0続いて、ステップ514
より820を実行して消去セグメントの次段のセグメン
トの領域におけるラストアドレスロケーションに、消去
セグメントエリアを飛ばしだ前4段セグメントの先頭ア
ドレスが記憶される。続いて、ステップ521−530
を実行して、現在性しいセグメントの登録エリアとなっ
ているエリアの前に消去セグメントエリアを新しく登録
するセグメントエリアとする。従って、消去セグメント
のラストアドレスデ−ンヨンには現在の新しい登録エリ
アに記憶しているラストアドレスデータが記憶される。
又消去セグメントエリアのNextアドレスロケーショ
ンには上記新しい登録エリアのアドレス値が記憶される
。このよ・うにセグメントテーブルを消去することによ
って実質的に要素メモリを読出すことができず、図形は
消去される。
次に、要素メモリ302中のデータ変更について説明す
る。
データを変更する場合は、変更コマンドが供給され、1
第5図のステップn 12 ’+ n 13 、n 1
4にてフラグEをセット、フラグA、B、C,Dをリセ
ットする。
続いて、変更する図形の図形番号、セグメント番号が供
給され、第6図(ホ)が実行される。第6図(ホ)にお
いてフラグBがセットされ、他のフラグがリセットされ
る(Ll)。以降、先の説明と同様に図形テーブル30
0から対応図形番号のエリアがサーチされ、更にセグメ
ントテーブル301より対応のセグメント番号のエリア
がサーチされる(t2〜t7)。変更の種類が図形表示
データの追加であれば、ステップt8からt12に進行
し、図形表示データの変更であれば、ステップt8  
よすL9 へ進行し、フラグXlがセットされる。更に
、新しい図形表示データを記憶すAロケーションを示し
ている5Priφを5Psi Iに転送し、APriす
なわち上記動作によって選択された対応の要素メモリ8
02のエリアの先頭アドレスを5Priφに記憶する。
続いて、CPUから変更する属性データが供給され、先
にフラグBがセットしているので、第6図(ロ)に進行
してステップに20よりに27に進行する。1にのステ
ップに27〜ks+で要素メモリの中の属性データがサ
ーチされる。そのロケーション位置が5Priφに設定
され、更にフラグX2がセットされ、XIがリセットさ
れる。続いて、CPUからは変更すべき種別コードが供
給され、ステップに20よりに2+に進行してこのコー
ドが書き込まれる。その後、5Pril→5Priφを
行い、この5Priφに新しい図形表示データを記憶エ
リアに設定する。又、図形表示データを追加する場合は
、第6図(ホ)のステップt8よりt12に進行して要
素メモリの対応エリアの最後のENDコードをサーチし
、次のロケーションにNullコードが記憶されている
ロケーションに新しいエリアのアドレス値5Priφを
記憶する。以降CPUから追加図形表示データは第6図
(ロ)のに20.に21に進行して順次追加記憶される
。このように任意に変更追加できる。
上述の実施例ではCRTディスプレイについて述べだが
、プリンタに応用できることはもちろんである。
〈本発PAp効果〉 以上説明したように本発明によれば、データメモリの所
定領域に図形表示要素もしくは図形表示要素群を可変長
で分割記憶させることによって、検索が容易で、メモリ
容量の低減化が図れる。壕だ、図形表示要素もしくは図
形表示要素群に関連して追加アドレス記憶領域を設けれ
ば、この追加アドレスによって追加図形表示情報を選択
できるので編集が容易となる。
【図面の簡単な説明】
第1図は図形表示情報処理装置の一例のブロック図、第
2図はデータメモリの構成及びそのアドレス構成図、第
3図は可変長で記憶される図形表示情報の一例を示す図
、第4図はCRTディスプレイ表示画面の一例を示す図
、第5〜6図は動作説明に供するフローチャート図であ
る。 3.30:データメモリ 5ニドyトマツプメモリ 3
00:図形テーブル 301:セグメントテーブル 3
02:要素メモリ 代理人 弁理士 福 士 愛 彦(他2名)(イ) 第6図 第6図(ホ)

Claims (2)

    【特許請求の範囲】
  1. (1)データメモリに記憶される図形表示情報を図形ド
    ツト表示パターンに展開してドツトマツプメモリに書込
    むように成した図形表示情報処理装置に於て、 前記データメモリの所定領域に図形表示要素もしくは図
    形表示要素群を可変長で分割記憶する手段と、前記図形
    表示要素もしくは図形表示要素群をアドレス選択する手
    段とを具備したことを特徴とする図形表示情報記憶方式
  2. (2)データメモリは、図形表示要素もしくは図形表示
    要素群に関連した追加アドレス記憶領域を有し、該追加
    アドレスによって追加図形表示要素もしくは追加図形表
    示要素群を選択するようにしたことを特徴とする特許請
    求の範囲第1項に記載の図形表示情報記憶方式。
JP58093665A 1983-05-25 1983-05-25 図形表示情報記憶方法 Granted JPS59218493A (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP58093665A JPS59218493A (ja) 1983-05-25 1983-05-25 図形表示情報記憶方法
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Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58093665A JPS59218493A (ja) 1983-05-25 1983-05-25 図形表示情報記憶方法

Publications (2)

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JPS59218493A true JPS59218493A (ja) 1984-12-08
JPH0325792B2 JPH0325792B2 (ja) 1991-04-08

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ID=14088689

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58093665A Granted JPS59218493A (ja) 1983-05-25 1983-05-25 図形表示情報記憶方法

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Country Link
US (1) US4700182A (ja)
JP (1) JPS59218493A (ja)
BR (1) BR8401306A (ja)
DE (1) DE3347644A1 (ja)

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