JPS5915130U - 制御装置 - Google Patents
制御装置Info
- Publication number
- JPS5915130U JPS5915130U JP10956782U JP10956782U JPS5915130U JP S5915130 U JPS5915130 U JP S5915130U JP 10956782 U JP10956782 U JP 10956782U JP 10956782 U JP10956782 U JP 10956782U JP S5915130 U JPS5915130 U JP S5915130U
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- microcomputer
- predetermined level
- drive device
- detection circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Control Of Vending Devices And Auxiliary Devices For Vending Devices (AREA)
- Power Sources (AREA)
- Control By Computers (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本発明に依る制御回路を示し、第２図は動作を
示す電圧波形図である。 １・・・マイクロコンピュータ、２・・・モータ、３・
・・ソレノイド、４・・・積分回路、５・・・第１電圧
検出回路、６・・・第２電圧検出回路。
示す電圧波形図である。 １・・・マイクロコンピュータ、２・・・モータ、３・
・・ソレノイド、４・・・積分回路、５・・・第１電圧
検出回路、６・・・第２電圧検出回路。
Claims (1)
- 同一の電源ラインにマイクロコンピュータ及び該マイク
ロコンピュータに制御される駆動装置を接続した機器に
於いて、電源投入により徐々に電圧が上昇する積分回路
と、該積分回路の電圧が第１の所定レベルに達すると前
記マイクロコンピュータへのリセット信号を解除する第
１電圧検出回路と、前記積分回路の電圧が前記第１の所
定レベルより高い第２の所定レベルに達すると、前記駆
動装置への給電を許容する第２電圧検出回路とから成る
リセット回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10956782U JPS5915130U (ja) | 1982-07-19 | 1982-07-19 | 制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10956782U JPS5915130U (ja) | 1982-07-19 | 1982-07-19 | 制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5915130U true JPS5915130U (ja) | 1984-01-30 |
| JPH0215146Y2 JPH0215146Y2 (ja) | 1990-04-24 |
Family
ID=30255175
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10956782U Granted JPS5915130U (ja) | 1982-07-19 | 1982-07-19 | 制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5915130U (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5569826A (en) * | 1978-11-20 | 1980-05-26 | Ricoh Co Ltd | Sequential control method for power closing |
| JPS55149879A (en) * | 1978-09-05 | 1980-11-21 | Motorola Inc | Fet voltage level detection circuit |
| JPS5771027A (en) * | 1980-10-21 | 1982-05-01 | Fujitsu Ten Ltd | Resetting circuit of microprocessor |
-
1982
- 1982-07-19 JP JP10956782U patent/JPS5915130U/ja active Granted
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55149879A (en) * | 1978-09-05 | 1980-11-21 | Motorola Inc | Fet voltage level detection circuit |
| JPS5569826A (en) * | 1978-11-20 | 1980-05-26 | Ricoh Co Ltd | Sequential control method for power closing |
| JPS5771027A (en) * | 1980-10-21 | 1982-05-01 | Fujitsu Ten Ltd | Resetting circuit of microprocessor |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0215146Y2 (ja) | 1990-04-24 |
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