JPS5897969A - ビデオカメラの制御信号発生回路 - Google Patents
ビデオカメラの制御信号発生回路Info
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- JPS5897969A JPS5897969A JP56196125A JP19612581A JPS5897969A JP S5897969 A JPS5897969 A JP S5897969A JP 56196125 A JP56196125 A JP 56196125A JP 19612581 A JP19612581 A JP 19612581A JP S5897969 A JPS5897969 A JP S5897969A
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- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 3
- 238000000034 method Methods 0.000 abstract 1
- 238000001514 detection method Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 238000009825 accumulation Methods 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000000284 extract Substances 0.000 description 1
- 238000005375 photometry Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N23/00—Cameras or camera modules comprising electronic image sensors; Control thereof
- H04N23/70—Circuitry for compensating brightness variation in the scene
- H04N23/75—Circuitry for compensating brightness variation in the scene by influencing optical camera components
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、例えばディジタルビデオカメラに対して適
用される制御信号発生回路に関する。
用される制御信号発生回路に関する。
従来のビデオカメラのオートアイリス調整は、第１図に
示す構成によって行なわれていた。同図において、１は
例えばＣＣＤからなる撮像素子、２がアイリス装置であ
り、撮像素子１からの出力がアンプ３及びＡＧＣ回路４
を介して出力端子５に導かれる。アイリス装置２は、モ
ータなどによって構成され、アイリスコントロール信号
に応じたアイリスが自動的に設定されるようになされて
いる。これと共に、ＡＧＣ回路４の出力がゲート回路６
を介してピーク検波回路７に供給され、このピーク検波
回路Ｔの出力によつ【アイリス装置２とＡＧＣ回路４と
が制御される。ゲート回路６に対してゲートパルス発生
器８から第２図に示すように、／フィールド（／Ｖ）期
間のｉ程度のゲートオフの期間を生じさせるゲートパル
スが供給される。
示す構成によって行なわれていた。同図において、１は
例えばＣＣＤからなる撮像素子、２がアイリス装置であ
り、撮像素子１からの出力がアンプ３及びＡＧＣ回路４
を介して出力端子５に導かれる。アイリス装置２は、モ
ータなどによって構成され、アイリスコントロール信号
に応じたアイリスが自動的に設定されるようになされて
いる。これと共に、ＡＧＣ回路４の出力がゲート回路６
を介してピーク検波回路７に供給され、このピーク検波
回路Ｔの出力によつ【アイリス装置２とＡＧＣ回路４と
が制御される。ゲート回路６に対してゲートパルス発生
器８から第２図に示すように、／フィールド（／Ｖ）期
間のｉ程度のゲートオフの期間を生じさせるゲートパル
スが供給される。
上述のアイリスコントロールと同様のことは、ディジタ
ルビデオカメラに対しても適用でき、第２図に示すゲー
トパルスに相当するデータとカメラ出力とを乗算し、そ
の出力のビーク値或いは平均値を求め、これによってア
イリス装置なコントロールすれば良い。しかし、そのた
めには、７画面分のデータを加算する必要があり、その
加算結果のビット数が多くなり、ハードウェアが大規模
になる欠点がある。また、マイコンで処理できれば、回
路規模を小さくできるが、マイコンのデータ処理のスピ
ードがビデオデ−タの伝送レイ）Ｋ比べて遅いので、上
述のようなゲート及びピーク検出（又は平均値検出）の
処理は不可能である。
ルビデオカメラに対しても適用でき、第２図に示すゲー
トパルスに相当するデータとカメラ出力とを乗算し、そ
の出力のビーク値或いは平均値を求め、これによってア
イリス装置なコントロールすれば良い。しかし、そのた
めには、７画面分のデータを加算する必要があり、その
加算結果のビット数が多くなり、ハードウェアが大規模
になる欠点がある。また、マイコンで処理できれば、回
路規模を小さくできるが、マイコンのデータ処理のスピ
ードがビデオデ−タの伝送レイ）Ｋ比べて遅いので、上
述のようなゲート及びピーク検出（又は平均値検出）の
処理は不可能である。
この発明は、ディジタルビデオカメラの出力をマイコン
のような小規模なハードウェアで処理することによって
アイリスコントロールや、ゲインコントロールのための
制御信号を発生することができるようにしたものである
。
のような小規模なハードウェアで処理することによって
アイリスコントロールや、ゲインコントロールのための
制御信号を発生することができるようにしたものである
。
以下、この発明の一実施例について説明する。
この例では、第３図に示すように、撮儂される二次元画
儂を９Ａ〜９Ｈの９個のブロックに分割し、この各ブロ
ック毎に含まれるビデオデータな加算し、このブロック
毎のデータをマイコンに送って処理している。
儂を９Ａ〜９Ｈの９個のブロックに分割し、この各ブロ
ック毎に含まれるビデオデータな加算し、このブロック
毎のデータをマイコンに送って処理している。
第９図は、この発明の一実施例の構成を示し、撮儂素子
１の出力はＡ／Ｄコンバータ１０によって、例えば／サ
ンプルｇビットのビデオデータに変換され、加算器１１
に供給される。この加算器１１の出力が／サンプル分の
遅延量の遅延回路１２と水平方向の分割数と等しい個数
のレジスタ１３Ａ、１３Ｂ、１３０とに供給される。こ
の遅延回路１２の出力が加算器１１に供給されると共に
、レジスタ１３Ａ、１３Ｂ、１３Ｃの出力がゲー）１４
Ａ、１４Ｂ、１４Ｃを介して加算器１１及びラッチ１５
に供給される。このレジスタ１３Ａは、ブロック９Ａ、
９Ｄ、９Ｇの夫々の中に含まれるデータの加算出力を発
生するためのもので、レジスタ１３Ｂは、ブロック９Ｂ
、９Ｅ、９Ｈに関連するもので、レジスタ１３Ｃは、ブ
ロック９Ｃ，９Ｆ、９Ｉに関連するものである。また、
１６はデコーダな示し、水平方向のカウンタ１７と垂直
方向のカウンタ１８との各出力が供給される。そして、
デコーダ１６から、遅延回路１２に対するクリアパルス
、レジスタ１３Ａ、１３Ｂ、１３Ｃに対する制御パルス
、ゲート１４Ａ、１４Ｂ、１４０に対するゲートパルス
、ラッチ１５に対するラッチパルスが発生する。
１の出力はＡ／Ｄコンバータ１０によって、例えば／サ
ンプルｇビットのビデオデータに変換され、加算器１１
に供給される。この加算器１１の出力が／サンプル分の
遅延量の遅延回路１２と水平方向の分割数と等しい個数
のレジスタ１３Ａ、１３Ｂ、１３０とに供給される。こ
の遅延回路１２の出力が加算器１１に供給されると共に
、レジスタ１３Ａ、１３Ｂ、１３Ｃの出力がゲー）１４
Ａ、１４Ｂ、１４Ｃを介して加算器１１及びラッチ１５
に供給される。このレジスタ１３Ａは、ブロック９Ａ、
９Ｄ、９Ｇの夫々の中に含まれるデータの加算出力を発
生するためのもので、レジスタ１３Ｂは、ブロック９Ｂ
、９Ｅ、９Ｈに関連するもので、レジスタ１３Ｃは、ブ
ロック９Ｃ，９Ｆ、９Ｉに関連するものである。また、
１６はデコーダな示し、水平方向のカウンタ１７と垂直
方向のカウンタ１８との各出力が供給される。そして、
デコーダ１６から、遅延回路１２に対するクリアパルス
、レジスタ１３Ａ、１３Ｂ、１３Ｃに対する制御パルス
、ゲート１４Ａ、１４Ｂ、１４０に対するゲートパルス
、ラッチ１５に対するラッチパルスが発生する。
ラッチ１５から得られる各ブロック毎の加算出力即ち平
均値データがマイコン１９に供給され、所定のプログラ
ムに従ったデータ処理が行なわれる。ブロック９Ａ〜９
Ｈの各々の平均値データなりａ〜Ｄｉとすると、マイコ
ン１９では、これらの平均値データに対して係数Ｋｌ〜
に−を乗じて加算することでアイリスコントロール信号
を発生する。つまり、（ＫｘＤａ＋に意Ｄｂ＋ＫｓＤｃ
＋・・−・・・・・・・・十に・Ｄｉ ）の演算処理を
行なう。
均値データがマイコン１９に供給され、所定のプログラ
ムに従ったデータ処理が行なわれる。ブロック９Ａ〜９
Ｈの各々の平均値データなりａ〜Ｄｉとすると、マイコ
ン１９では、これらの平均値データに対して係数Ｋｌ〜
に−を乗じて加算することでアイリスコントロール信号
を発生する。つまり、（ＫｘＤａ＋に意Ｄｂ＋ＫｓＤｃ
＋・・−・・・・・・・・十に・Ｄｉ ）の演算処理を
行なう。
ここで係数Ｋｓ 、 Ｋｚ、 Ｋｓを０とすれば、画面
の上部の−のデータが無関係とされる。また、中央のブ
ロック９Ｅと対応する係数に６のみを１とし、その他の
係数を全て０とすれば、中央測光な行なうことになる。
の上部の−のデータが無関係とされる。また、中央のブ
ロック９Ｅと対応する係数に６のみを１とし、その他の
係数を全て０とすれば、中央測光な行なうことになる。
どのような処理なマイコン１９が行なうかは、プログラ
ムにより定まる。このマイコン１９から発生したコント
ロール信号がアイリス装置２に供給され、コントロール
信号のレベルに応じたアイリスの値に調整される。
ムにより定まる。このマイコン１９から発生したコント
ロール信号がアイリス装置２に供給され、コントロール
信号のレベルに応じたアイリスの値に調整される。
上述のブロック毎の平均値データの形成について詳述す
る。Ａ／Ｄコンバーター０から、水平走査に従って第１
ライン、第２ライン・・・・・・・・・・・・・・・と
順次ビデオデータが現れると、加算器１１によって累算
が行なわれる。そして、ブロック９Ａの第１ラインのデ
ータの累算されたものがレジスタ１３Ａにセットされ、
次に遅延回路１２がクリアされてから、同様の動作によ
ってブロック９Ｂの第１ラインのデータの累算されたも
のがレジスタ１３Ｂにセットされ、更にブロック９Ｃの
第１ラインのデータの累算されたものがレジスタ１３Ｃ
にセットされる。第コラインのデータが発生する場合、
ゲート１４Ａがオンにされ、レジスタ１３Ａに貯えられ
ているデータが加算器１１に供給され、ブロック９Ａの
中の第１ラインの累算データに対して第コラインのデー
タが更に累算される。他のブロック９ Ｂ。
る。Ａ／Ｄコンバーター０から、水平走査に従って第１
ライン、第２ライン・・・・・・・・・・・・・・・と
順次ビデオデータが現れると、加算器１１によって累算
が行なわれる。そして、ブロック９Ａの第１ラインのデ
ータの累算されたものがレジスタ１３Ａにセットされ、
次に遅延回路１２がクリアされてから、同様の動作によ
ってブロック９Ｂの第１ラインのデータの累算されたも
のがレジスタ１３Ｂにセットされ、更にブロック９Ｃの
第１ラインのデータの累算されたものがレジスタ１３Ｃ
にセットされる。第コラインのデータが発生する場合、
ゲート１４Ａがオンにされ、レジスタ１３Ａに貯えられ
ているデータが加算器１１に供給され、ブロック９Ａの
中の第１ラインの累算データに対して第コラインのデー
タが更に累算される。他のブロック９ Ｂ。
９Ｃにおける動作も同様であって、この動作が繰り返さ
れることによって、所定のタイミングにおいて、遅延回
路１２の出力にブロック９人の全てのデータの累算され
たものが現れ、これがラッチ１５に取り込まれ、マイコ
ン１９に送出される。また、ブロック９Ｂ、９Ｃの夫々
の全てのデータの累算されたものも、遅延回路１２の出
力に所定のタイミングで発生することになり、ラッチ１
５を介してマイコン１９に送られる。以上のブロック９
人、９Ｂ、９Ｃに関する動作が終了すると、これと同様
の動作がブロック９Ｄ、９Ｂ、、９Ｆに関して行なわれ
、その次にブロック９Ｇ、９Ｈ，９Ｉに関して同様の動
作がなされる。
れることによって、所定のタイミングにおいて、遅延回
路１２の出力にブロック９人の全てのデータの累算され
たものが現れ、これがラッチ１５に取り込まれ、マイコ
ン１９に送出される。また、ブロック９Ｂ、９Ｃの夫々
の全てのデータの累算されたものも、遅延回路１２の出
力に所定のタイミングで発生することになり、ラッチ１
５を介してマイコン１９に送られる。以上のブロック９
人、９Ｂ、９Ｃに関する動作が終了すると、これと同様
の動作がブロック９Ｄ、９Ｂ、、９Ｆに関して行なわれ
、その次にブロック９Ｇ、９Ｈ，９Ｉに関して同様の動
作がなされる。
なお、上述の一実施例と異なり、各ブロック毎に最大値
のデータを検出し、これをマイコンに送るようにしても
良い。
のデータを検出し、これをマイコンに送るようにしても
良い。
上述のように、この発明では、画面を複数ブロックに分
割し、各ブロック単位の平均値又は最大値を形成し、こ
れをマイコン等により演算すビので、データレートが下
がり、ノ・−ドウエアが簡単になると共に、マイコンな
用いて処理することが可能となる。
割し、各ブロック単位の平均値又は最大値を形成し、こ
れをマイコン等により演算すビので、データレートが下
がり、ノ・−ドウエアが簡単になると共に、マイコンな
用いて処理することが可能となる。
なお、この発明は、ホワイトバランスの調整などで、画
面の中央部のデータのみを取り出すゲインコントロール
に対して適用しても良い。
面の中央部のデータのみを取り出すゲインコントロール
に対して適用しても良い。
第７図は従来のビデオカメラの制御信号発生の説明に用
いるプｑツク図、第コ図はそのゲートパルスの波形図、
第３図はこの発明の一実施例の画面分割を示す路線図、
第１図はこの発明の一実施例のブロック図である。 １・・・・・・・・・撮像素子、２・・・・・・・・・
アイリス装置。 ９Ａ〜９Ｉ・・・・・・・・・ブロック、１１・・・・
・・・・・加算器。 １３Ａ、１３Ｂ、１３Ｃ・・・・・・・・・レジスタ、
１９・・・・・・…マイコン。 代理人杉浦正知 第１図 第２図 第３図 第４図
いるプｑツク図、第コ図はそのゲートパルスの波形図、
第３図はこの発明の一実施例の画面分割を示す路線図、
第１図はこの発明の一実施例のブロック図である。 １・・・・・・・・・撮像素子、２・・・・・・・・・
アイリス装置。 ９Ａ〜９Ｉ・・・・・・・・・ブロック、１１・・・・
・・・・・加算器。 １３Ａ、１３Ｂ、１３Ｃ・・・・・・・・・レジスタ、
１９・・・・・・…マイコン。 代理人杉浦正知 第１図 第２図 第３図 第４図
Claims (1)
- 撮影される２次元画ａｔ複数のブロックに分割し、この
分割された各プ四ツク毎のデータ処理を行ない、この各
プ冒ツク毎の処理されたデータを演算回路に供給し、こ
の演算−路の出力によってアイリスコントロール又はカ
メラ出力のゲインコントロールを行な５ようＫしたビデ
オカメラの制御信号発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56196125A JPS5897969A (ja) | 1981-12-05 | 1981-12-05 | ビデオカメラの制御信号発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56196125A JPS5897969A (ja) | 1981-12-05 | 1981-12-05 | ビデオカメラの制御信号発生回路 |
Related Child Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2299601A Division JP2611041B2 (ja) | 1990-11-05 | 1990-11-05 | ビデオカメラ |
| JP2299600A Division JP2611040B2 (ja) | 1990-11-05 | 1990-11-05 | ビデオカメラ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5897969A true JPS5897969A (ja) | 1983-06-10 |
| JPH0442868B2 JPH0442868B2 (ja) | 1992-07-14 |
Family
ID=16352653
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56196125A Granted JPS5897969A (ja) | 1981-12-05 | 1981-12-05 | ビデオカメラの制御信号発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5897969A (ja) |
Cited By (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60191A (ja) * | 1983-06-15 | 1985-01-05 | Canon Inc | カラ−テレビジヨンカメラの色温度補償装置 |
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| JPS6160082A (ja) * | 1984-08-31 | 1986-03-27 | Sony Corp | 撮像装置 |
| JPS6157759U (ja) * | 1984-09-19 | 1986-04-18 | ||
| JPS6162472U (ja) * | 1984-09-28 | 1986-04-26 | ||
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| JPS63173471A (ja) * | 1986-12-22 | 1988-07-18 | ブロードキヤスト・テレビジヨン・システムス・ゲゼルシヤフト・ミツト・ベシユレンクテル・ハフツング | テレビカメラの自動的露出制御方法及び装置 |
| JPH01218178A (ja) * | 1988-02-25 | 1989-08-31 | Sanyo Electric Co Ltd | 撮像装置 |
| JPH02233067A (ja) * | 1989-03-07 | 1990-09-14 | Sony Corp | テレビジョン受像機 |
| US8245679B2 (en) | 2008-10-22 | 2012-08-21 | Denso Corporation | Variable valve timing apparatus |
Citations (1)
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|---|---|---|---|---|
| JPS5689729A (en) * | 1979-12-21 | 1981-07-21 | Fuji Photo Film Co Ltd | Picture information input device |
-
1981
- 1981-12-05 JP JP56196125A patent/JPS5897969A/ja active Granted
Patent Citations (1)
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| JPH0576829B2 (ja) * | 1984-08-31 | 1993-10-25 | Sony Corp | |
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| JPH042537Y2 (ja) * | 1984-09-28 | 1992-01-28 | ||
| JPS6162472U (ja) * | 1984-09-28 | 1986-04-26 | ||
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| JPS62198278A (ja) * | 1986-02-26 | 1987-09-01 | Asahi Optical Co Ltd | 電子カメラ用測光回路 |
| JPH0575227B2 (ja) * | 1986-02-26 | 1993-10-20 | Asahi Optical Co Ltd | |
| JPS63173471A (ja) * | 1986-12-22 | 1988-07-18 | ブロードキヤスト・テレビジヨン・システムス・ゲゼルシヤフト・ミツト・ベシユレンクテル・ハフツング | テレビカメラの自動的露出制御方法及び装置 |
| JPH01218178A (ja) * | 1988-02-25 | 1989-08-31 | Sanyo Electric Co Ltd | 撮像装置 |
| JPH02233067A (ja) * | 1989-03-07 | 1990-09-14 | Sony Corp | テレビジョン受像機 |
| US8245679B2 (en) | 2008-10-22 | 2012-08-21 | Denso Corporation | Variable valve timing apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0442868B2 (ja) | 1992-07-14 |
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