JPS58141629U - 発振回路 - Google Patents
発振回路Info
- Publication number
- JPS58141629U JPS58141629U JP3783782U JP3783782U JPS58141629U JP S58141629 U JPS58141629 U JP S58141629U JP 3783782 U JP3783782 U JP 3783782U JP 3783782 U JP3783782 U JP 3783782U JP S58141629 U JPS58141629 U JP S58141629U
- Authority
- JP
- Japan
- Prior art keywords
- flop
- flip
- output
- input terminal
- oscillation circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案発振回路の回路構成図であり、第２図は
第１図の発振回路におけるタイムチャート示す。 ＯＳＣ・・・・・・基準信号源、ＦＦ１・・・・・・第
１のフリップ・フロップ、ＦＦ２・・・・・・第２のフ
リップ・フロップ。
第１図の発振回路におけるタイムチャート示す。 ＯＳＣ・・・・・・基準信号源、ＦＦ１・・・・・・第
１のフリップ・フロップ、ＦＦ２・・・・・・第２のフ
リップ・フロップ。
Claims (1)
- 【実用新案登録請求の範囲】 基準信号源Ｏ８Ｃの出力を第１のフリップ・フロップＦ
Ｆ１の入力端子Ｃ１と第２のフリップ・フロップＦＦ２
の入力端子Ｃ２に接続し、前記第１のフリップ・フロッ
プＦＦ１の出力Ｑ１を前記第２のフリップ・フロップＦ
Ｆ２の入力端子Ｄ２と接続し、前記第２のフリップ・フ
ロップＦＦ２の出力Ｑ２を前記第１のフリップ・フロッ
プＦＦ□の入力端子Ｄ１と接続し、さらに前記第１のフ
リップ・フロップＦＦ工の出力Ｑ□もしくはＱｌあるい
は第２のフリップ・フロップＦＦ２の出力Ｑ２もしくは
Ｑ２から外部出力信号を ° 。 とり出すように構成したことを特徴とする発振回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3783782U JPS58141629U (ja) | 1982-03-19 | 1982-03-19 | 発振回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3783782U JPS58141629U (ja) | 1982-03-19 | 1982-03-19 | 発振回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58141629U true JPS58141629U (ja) | 1983-09-24 |
Family
ID=30049204
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3783782U Pending JPS58141629U (ja) | 1982-03-19 | 1982-03-19 | 発振回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58141629U (ja) |
-
1982
- 1982-03-19 JP JP3783782U patent/JPS58141629U/ja active Pending
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