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JPH07321120A - シリコンウェーハの熱処理方法 - Google Patents

シリコンウェーハの熱処理方法

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Publication number
JPH07321120A
JPH07321120A JP13506694A JP13506694A JPH07321120A JP H07321120 A JPH07321120 A JP H07321120A JP 13506694 A JP13506694 A JP 13506694A JP 13506694 A JP13506694 A JP 13506694A JP H07321120 A JPH07321120 A JP H07321120A
Authority
JP
Japan
Prior art keywords
heat treatment
temperature
silicon wafer
dzig
wafer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP13506694A
Other languages
English (en)
Inventor
Shiro Yoshino
史朗 芳野
Seiichi Shimura
誠一 志村
Atsushi Sato
佐藤　　淳
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sumco Techxiv Corp
Original Assignee
Komatsu Electronic Metals Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Komatsu Electronic Metals Co Ltd filed Critical Komatsu Electronic Metals Co Ltd
Priority to JP13506694A priority Critical patent/JPH07321120A/ja
Publication of JPH07321120A publication Critical patent/JPH07321120A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】 【目的】 イントリンシックゲッタリング構造を付与す
る熱処理（以下ＤＺＩＧ処理という）を施したシリコン
ウェーハの製造に当たり、ＣＺ法によるシリコン単結晶
育成時の熱履歴に依存する微小欠陥のＤＺ層への残留
や、欠陥密度およびＤＺ層の厚さのばらつきを低減す
る。 【構成】 ＤＺＩＧ処理の前に、ランプアニール装置を
用いて図１に示す急速熱処理を行う。すなわち、３５０
°Ｃに加熱したランプアニール装置にシリコンウェーハ
を投入し、５０°Ｃ／ｓｅｃ以上の昇温速度で９５０〜
１２００°Ｃに昇温させ、前記温度範囲を１〜６０ｓｅ
ｃ保持する。これにより、前記ＤＺＩＧ処理の初期に成
長して顕在化する微小欠陥の形成を抑制することができ
る。従って、ＤＺ層に残留する微小欠陥密度が低くなる
とともに、前記急速熱処理によってシリコン単結晶育成
時の低温熱履歴が消去されるため、微小欠陥密度やＤＺ
層の厚さのばらつきも低減する。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、シリコンウェーハの熱
処理方法に関する。
【０００２】
【従来の技術】チョクラルスキー法（以下ＣＺ法とい
う）を用いて成長させたシリコン単結晶を切断、研磨し
て得られたウェーハの表層に無欠陥領域（以下ＤＺ層と
いう）を形成するため、所定の熱処理を施して、前記ウ
ェーハをイントリンシックゲッタリング構造（以下ＩＧ
構造という）にする技術が従来から用いられている。前
記ＩＧ構造は、シリコンウェーハの表面から数十μｍ以
上の深さの部分にゲッタリング源となる高密度のバルク
微小欠陥（以下ＢＭＤという）を形成するもので、この
ＢＭＤはウェーハの表層に存在する不純物の捕獲拠点と
して利用される。
【０００３】シリコンウェーハにＩＧ構造を付与する熱
処理（以下ＤＺＩＧ処理という）として、たとえば特公
昭６２−１６５３９に示されているように、５００〜９
００°Ｃに加熱した炉内にシリコンウェーハを投入し、
５〜１４°Ｃ／ｍｉｎの昇温速度で９５０〜１３００°
Ｃまで昇温させる方法が知られている。また、特公平３
−１９６９９で開示された熱処理方法は、１０°Ｃ／ｍ
ｉｎ以上の昇温速度で１０００〜１４００°Ｃまで昇温
させるものである。一般には、９５０〜１３００°Ｃ程
度の高温熱処理と４００〜８００°Ｃ程度の中・低温熱
処理とを組み合わせた方法が用いられている。
【０００４】
【発明が解決しようとする課題】上記ＤＺＩＧ処理にお
けるシリコンウェーハの炉内への投入は通常７００°Ｃ
程度で行われ、この温度から９５０〜１４００°Ｃの高
温域まで昇温させていく。ところが、ウェーハによって
はＣＺ法による単結晶育成中に発生した酸素析出核が前
記昇温過程で成長し、ＤＺ層となるべき部分に欠陥が残
留してデバイス特性を悪化させることがある。また、Ｃ
Ｚ法を用いて育成されたシリコン単結晶はインゴットの
軸方向に沿ってそれぞれ異なる熱履歴を受けているが、
従来のＤＺＩＧ処理方法では前記熱履歴をそのまま受け
継いでしまうことがある。その結果、ＢＭＤ密度やＤＺ
層の厚さがインゴットの長さ方向でばらつく。
【０００５】上記問題は、特願平６−４４９５８に示さ
れているように、ウェーハ投入時の炉内温度から高温域
までの昇温速度を９〜１２°Ｃ／ｍｉｎに引き上げるこ
とによって解決することができる。しかしながら、シリ
コンウェーハが８インチ以上に大径化すると、前記昇温
速度が速いためにウェーハにそりやスリップが発生する
という新たな問題が起こるおそれがある。
【０００６】本発明は上記の問題点に着目してなされた
もので、８インチ以上の大径ウェーハを含むシリコンウ
ェーハにＤＺＩＧ処理を施す際に、ウェーハ投入後の昇
温速度を適切な範囲に抑えることによってそりやスリッ
プの発生を未然に防止するとともに、ＣＺ法によるシリ
コン単結晶育成時の熱履歴に依存する欠陥がＤＺ層に残
留せず、ＢＭＤ密度やＤＺ層の厚さのばらつきを低減す
ることができるようなシリコンウェーハの熱処理方法を
提供することを目的としている。
【０００７】
【課題を解決するための手段】上記目的を達成するた
め、本発明に係るシリコンウェーハの熱処理方法は、シ
リコンウェーハにイントリンシックゲッタリング構造を
付与するための熱処理に先立ち、熱放射アニール装置を
用いて急速熱処理を行うことを特徴とし、前記急速熱処
理は、ランプアニール装置にシリコンウェーハを投入
後、５０°Ｃ／ｓｅｃ以上の昇温速度で９５０〜１２０
０°Ｃに昇温させ、前記温度範囲を１〜６０ｓｅｃ保持
する構成とした。
【０００８】
【作用】ａｓ−ｇｒｏｗｎウェーハ中に存在する潜在核
のうち、ＤＺＩＧ処理の初期（ウェーハ投入から高温域
に昇温する期間）に成長して顕在化するＢＭＤと、ＤＺ
ＩＧ処理の初期では収縮し、後期（低温域に保持する期
間）に析出核となり、その後の熱処理によって顕在化す
るＢＭＤとがある。初期に成長して顕在化するＢＭＤの
存在比率が高いと、ＤＺ層に残留する欠陥密度が高くな
り、ＢＭＤ密度そのものもシリコン単結晶育成時の熱履
歴に依存してばらつく。これに対して本発明によれば、
シリコンウェーハにＤＺＩＧ処理を行う前に急速熱処理
を行う構成としたので、前記ＤＺＩＧ処理の初期に成長
して顕在化するＢＭＤの形成を抑制することができる。
従って、ＤＺ層に残留するＢＭＤ密度が低くなるととも
に、前記急速熱処理によってシリコン単結晶育成時の低
温熱履歴が消去されるため、ＢＭＤ密度やＤＺ層の厚さ
のばらつきも低減する。また、本発明の急速熱処理条件
ではウェーハにそりやスリップが発生することはない。
【０００９】
【実施例】以下に、本発明に係るシリコンウェーハの熱
処理方法の実施例について、図面を参照して説明する。
昇降温プロファイルの一例を示すと図１の通りで、シリ
コンウェーハに対するＤＺＩＧ処理に先立って行う急速
熱処理に適用されるものである。すなわち、常圧のＮ2
雰囲気で３５０°Ｃに加熱したランプアニール装置にシ
リコンウェーハを投入し、雰囲気ガスをＯ2 に切り換え
た上、ランプ出力２０％で５ｓｅｃ間昇温させる。次
に、ランプ出力を１００％に上げ、７５°Ｃ／ｓｅｃの
ランプレートでＴ°Ｃまで昇温させ、この温度を保持し
たままｔｓｅｃの短時間アニールを行う。その後、ラン
プ出力を５％に落とし、２０°Ｃ／ｓｅｃの割合で炉内
温度を下げ、更にランプ出力を０％にして５００°Ｃま
で下げる。ここで雰囲気ガスをＮ2 に切り換えた上、ウ
ェーハを取り出す。
【００１０】上記昇降温プロファイルにおいて、ランプ
レートは５０°Ｃ／ｓｅｃ以上であればよい。この昇温
速度は非常に速いが、熱源として波長０．１〜４μｍの
ランプを用いているため、ウェーハは均一に加熱され、
そりやスリップ発生が起こらない。また、温度Ｔは９５
０〜１２００°Ｃ、好ましくは１０００°Ｃとする。こ
の場合、温度Ｔが９５０°Ｃ未満では効果がなく、１２
００°Ｃを超えるとスリップなどの問題が起こる。前記
温度Ｔの保持時間ｔは１〜６０ｓｅｃとする。保持時間
ｔが６０ｓｅｃを超えてもよいが、効果は変わらない。
なお、３５０°Ｃに加熱したランプアニール装置にシリ
コンウェーハを投入後、５０°Ｃ／ｓｅｃ以上のランプ
レートでＴ°Ｃまで直線的に昇温させ、ｔｓｅｃ保持し
た後ランプ出力を直ちに０％として５００°Ｃまで直線
的に降温させてもよい。
【００１１】本発明による熱処理を行うことによってど
のような効果が上がるかを確認するため、次の実験を行
った。 （１）ランプアニール装置を用いる急速熱処理（Ｒａｐ
ｉｄ ＴｈｅｒｍａｌＰｒｏｃｅｓｓｉｎｇ、以下ＲＴ
Ｐという）において、熱処理温度（図１のＴ）を７００
°Ｃおよび１０００°Ｃの２水準、前記温度の保持時間
（図１のｔ）を１０ｓｅｃおよび３０ｓｅｃの２水準と
し、計４水準の熱処理をそれぞれのシリコンウェーハに
施した。 （２）上記各シリコンウェーハに、図２に示すようなＤ
ＺＩＧ処理を施した。すなわち、各シリコンウェーハを
７００°Ｃの炉内に投入して１５ｍｉｎ保持し、昇温速
度を６°Ｃ／ｍｉｎとして７００°Ｃから１１７５°Ｃ
まで昇温させ、１１７５°Ｃで５時間保持した。その
後、３°Ｃ／ｍｉｎの割合で７００°Ｃまで下げ、４時
間保持した。雰囲気ガスは、前記ウェーハの炉内投入か
ら１１７５°Ｃに昇温して所定時間が経過するまでの間
はＮ2 とＯ2 との混合ガスとし、その後はＮ2 のみとし
た。 （３）次に、各シリコンウェーハにドライＯ2 雰囲気中
で、１０００°Ｃ、１６時間の熱処理を施した。 なお、上記４水準のＲＴＰウェーハと比較するため、Ｒ
ＴＰを行わないシリコンウェーハに上記（２）のＤＺＩ
Ｇ処理と（３）の熱処理とを施したものを用意した。
【００１２】これらのシリコンウェーハを切断し、断面
を鏡面研磨した後、表面から１０μｍおよび１００μｍ
におけるＢＭＤ密度を赤外トモグラフで観察したとこ
ろ、図３に示す結果が得られた。 （１）ＲＴＰ未処理ウェーハおよびＲＴＰ時の熱処理温
度を７００°Ｃ、保持時間を１０ｓｅｃまたは３０ｓｅ
ｃとしたウェーハでは、表面からの深さ１０μｍ、すな
わちＤＺ層のＢＭＤ密度が２〜３×１０7 個／ｃｍ3 で
あるのに対し、前記熱処理温度を１０００°Ｃ、保持時
間を１０ｓｅｃまたは３０ｓｅｃとしたウェーハのＢＭ
Ｄ密度は約１桁低い２〜３×１０6 個／ｃｍ3 であり、
ａｓ−ｇｒｏｗｎレベルにほぼ等しい密度となった。 （２）ウェーハ表面から１００μｍの深さでは、ＲＴＰ
未処理ウェーハおよびＲＴＰ時の熱処理温度を７００°
ＣとしたウェーハのＢＭＤ密度が２〜５×１０8個／ｃ
ｍ3 であるのに対し、前記熱処理温度を１０００°Ｃと
したウェーハでは１〜３×１０7 個／ｃｍ3 と低密度で
あった。
【００１３】ＲＴＰを行うことによって、ウェーハ表面
から１００μｍの深さのＢＭＤ、すなわちゲッタリング
源となるＢＭＤも低密度となる。しかし、ＤＺＩＧ処理
の後半における７００°Ｃでの保持時間を延長すること
により、前記ＢＭＤを所定の密度に高めることができ
る。
【００１４】次に、ＤＺ層の厚さについて光学顕微鏡に
よる観察の結果、図４に示す結果が得られた。図中の○
印はＤＺ層表面から１個目のＢＭＤまでの距離（以下Ｄ
Ｚ−１という）、△印はＤＺ層表面から３個目のＢＭＤ
までの距離（以下ＤＺ−３という）をそれぞれ示してい
る。 （１）ＲＴＰ未処理ウェーハおよびＲＴＰ時の熱処理温
度を７００°Ｃ、保持時間を１０ｓｅｃまたは３０ｓｅ
ｃとしたウェーハでは、ＤＺ−１が２０〜３５μｍ、Ｄ
Ｚ−３が４８〜５２μｍであった。 （２）前記熱処理温度を１０００°Ｃ、保持時間を１０
ｓｅｃまたは３０ｓｅｃとしたウェーハでは、ＤＺ−１
が７２〜９０μｍ、ＤＺ−３が１３３〜１５６μｍとな
り、ＤＺ層の厚さが増すとともに、ばらつきが小さくな
った。また、ＤＺ−１とＤＺ−３との差も大きくなっ
た。
【００１５】
【発明の効果】以上説明したように本発明によれば、シ
リコンウェーハにＤＺＩＧ処理を行う前に１０００°Ｃ
前後の急速熱処理を行うことにしたので、ＤＺＩＧ処理
の初期に成長して顕在化するＢＭＤの形成を抑制するこ
とができ、ＤＺ層に残留するＢＭＤ密度が低くなるとと
もに、前記急速熱処理によってシリコン単結晶育成時の
低温熱履歴が消去されるため、ＢＭＤ密度やＤＺ層の厚
さのばらつきも低減する。また、本発明の急速熱処理条
件ではウェーハにそりやスリップが発生することはな
い。従って、本発明による熱処理方法を適用すれば、８
インチ以上の大径ウェーハに起こり得るスリップなどを
防止することができるようなＤＺＩＧ処理、すなわち昇
温速度の低いＤＺＩＧ処理を行っても、ＤＺ層に残留す
るＢＭＤ密度が低く、かつＢＭＤ密度やＤＺ層の厚さの
ばらつきの小さい高品質のＤＺＩＧ処理ウェーハを容易
に製造することが可能となる。
【図面の簡単な説明】
【図１】シリコンウェーハに対するＤＺＩＧ処理に先立
って行う急速熱処理における昇降温プロファイルの一例
を示す図である。
【図２】ＤＺＩＧ処理における昇降温プロファイルの一
例を示す図である。
【図３】ＤＺＩＧ処理後のシリコンウェーハにおけるＢ
ＭＤ密度を、急速熱処理時の条件別に示す図である。
【図４】ＤＺＩＧ処理後のシリコンウェーハにおけるＤ
Ｚ層の厚さを、急速熱処理時の条件別に示す図である。

Claims (2)

    【特許請求の範囲】
  1. 【請求項１】 シリコンウェーハにイントリンシックゲ
    ッタリング構造を付与するための熱処理に先立ち、熱放
    射アニール装置を用いて急速熱処理を行うことを特徴と
    するシリコンウェーハの熱処理方法。
  2. 【請求項２】 前記急速熱処理は、ランプアニール装置
    にシリコンウェーハを投入後、５０°Ｃ／ｓｅｃ以上の
    昇温速度で９５０〜１２００°Ｃに昇温させ、前記温度
    範囲を１〜６０ｓｅｃ保持するものであることを特徴と
    する請求項１のシリコンウェーハの熱処理方法。
JP13506694A 1994-05-25 1994-05-25 シリコンウェーハの熱処理方法 Pending JPH07321120A (ja)

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