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JPH05343518A - Cell for automatic layout - Google Patents

Cell for automatic layout

Info

Publication number
JPH05343518A
JPH05343518A JP4176145A JP17614592A JPH05343518A JP H05343518 A JPH05343518 A JP H05343518A JP 4176145 A JP4176145 A JP 4176145A JP 17614592 A JP17614592 A JP 17614592A JP H05343518 A JPH05343518 A JP H05343518A
Authority
JP
Japan
Prior art keywords
cell
wiring
primitive
power supply
ground
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP4176145A
Other languages
Japanese (ja)
Other versions
JP2751742B2 (en
Inventor
Takeshi Matsumoto
健 松本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP4176145A priority Critical patent/JP2751742B2/en
Publication of JPH05343518A publication Critical patent/JPH05343518A/en
Application granted granted Critical
Publication of JP2751742B2 publication Critical patent/JP2751742B2/en
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

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  • Semiconductor Integrated Circuits (AREA)
  • Design And Manufacture Of Integrated Circuits (AREA)

Abstract

PURPOSE:To restrain a drop, in the integration density of the cell, which is caused when a part as a wiring bottleneck is produced in the central part in an automatic layout. CONSTITUTION:The cell is realized in the following manner: primitive cells in which the thickness of power-supply wirings 1 and ground wiring 2 having the same function and the size of cells are different are prepared; the small primitive cells are arranged in the central part of a layout block; and the large primitive cells are arranged in the peripheral part.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、半導体集積回路のマス
クパタン設計に関し、特にスタンダードセル型半導体集
積回路の自動レイアウト用セルに関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a mask pattern design of a semiconductor integrated circuit, and more particularly to an automatic layout cell of a standard cell type semiconductor integrated circuit.

【0002】[0002]

【従来の技術】従来、スタンダード型半導体集積回路の
自動レイアウト用のプリミティブセルは、セルの外形が
一定で、セル内部に含まれる電源,グランド配線の巾も
一定であった。
2. Description of the Related Art Conventionally, in a primitive cell for automatic layout of a standard type semiconductor integrated circuit, the outer shape of the cell is constant, and the widths of power supply and ground wirings contained in the cell are also constant.

【0003】図4は、従来の半導体集積回路ブロックの
自動レイアウトの結果である。配線領域3は、セル領域
3間の配線を行うため一般的に中央部に配線が密集して
おり、配線領域3の高さは、その密集した部分によって
決定される。また、セル領域3の高さは一定である。ま
た、セル領域3の両端に電源配線1及びグランド配線2
が設けられている。
FIG. 4 shows the result of a conventional automatic layout of a semiconductor integrated circuit block. In the wiring region 3, wirings are generally densely formed in the central portion for wiring between the cell regions 3, and the height of the wiring region 3 is determined by the dense portion. Further, the height of the cell region 3 is constant. Further, the power supply wiring 1 and the ground wiring 2 are provided at both ends of the cell region 3.
Is provided.

【0004】[0004]

【発明が解決しようとする課題】以上述べたような、自
動レイアウト用のプリミティブセルは、セルの外形が一
定で、セル内部に含まれる電源配線,グランド配線の巾
が一定であった。また、電源及びグランドはセル領域の
両端から提供される。
In the primitive cell for automatic layout as described above, the outer shape of the cell is constant, and the widths of the power supply wiring and the ground wiring included in the cell are constant. In addition, power and ground are provided from both ends of the cell area.

【0005】今、同一セル列上に並べるセルのうち両端
部は、内側のセルに電源,グランドを供給する必要があ
るため、電源配線及びグランド配線は太くする必要があ
る。しかし、中央部のセルにおいては、他のセルに電
源,グランドを供給する必要性が低いため、電源配線及
びグランド配線は細くても良いにもかかわらず、両端と
同じ太さになっている。
Now, at both ends of the cells arranged on the same cell row, it is necessary to supply power and ground to the inner cells, so that the power supply wiring and the ground wiring need to be thick. However, in the central cell, since it is less necessary to supply power and ground to other cells, the power supply line and the ground line have the same thickness as both ends although the power supply line and the ground line may be thin.

【0006】したがって、結果的に場所、特に中央部に
よっては、電源配線及びグランド配線が必要以上太くな
っていることとなり、半導体集積回路ブロックの高さ方
向が大きくなる。
Therefore, as a result, the power supply wiring and the ground wiring are thicker than necessary depending on the location, especially the central portion, and the height direction of the semiconductor integrated circuit block becomes large.

【0007】このようにして面積が増えると、半導体集
積回路のコストアップになるという問題点があった。
When the area is increased in this way, there is a problem that the cost of the semiconductor integrated circuit is increased.

【0008】本発明の目的は、集積度を向上させた自動
レイアウト用セルを提供することにある。
It is an object of the present invention to provide an automatic layout cell with improved integration.

【0009】[0009]

【課題を解決するための手段】前記目的を達成するた
め、本発明に係る自動レイアウト用セルは、複数のプリ
ミティブセルを組合せてなるスタンダードセル型半導体
集積回路の自動レイアウト用セルであって、プリミティ
ブセルは、電源配線及びグランド配線を有し、該電源及
びグランド配線の太さは、前記プリミティブセル配置位
置により決まる前記電源配線及びグランド配線の最小電
流容量に応じて設定したものである。
In order to achieve the above object, an automatic layout cell according to the present invention is an automatic layout cell of a standard cell type semiconductor integrated circuit, which is a combination of a plurality of primitive cells. The cell has a power supply line and a ground line, and the thickness of the power supply line and the ground line is set according to the minimum current capacity of the power supply line and the ground line determined by the placement position of the primitive cell.

【0010】[0010]

【作用】プリミティブセル内の電源及びグランド配線の
太さをプリミティブセル配置時に決まる前記電源及びグ
ランド配線の最小電流容量に応じて変化させる。
The thickness of the power supply line and the ground line in the primitive cell is changed according to the minimum current capacity of the power supply line and the ground line determined when the primitive cell is arranged.

【0011】[0011]

【実施例】次に本発明について、図面を用いて説明す
る。
DESCRIPTION OF THE PREFERRED EMBODIMENTS Next, the present invention will be described with reference to the drawings.

【0012】(実施例1)図1は、本発明の自動レイア
ウト用セルの実施例1を示すレイアウト図である。
(First Embodiment) FIG. 1 is a layout diagram showing a first embodiment of an automatic layout cell of the present invention.

【0013】図1において、プリミティブセルとして、
同一機能で、電源配線1,グランド配線2の巾が異なる
ものとして、タイプS,タイプM,タイプLの3種類が
容易されており、プリミティブセル内の電源配線1及び
グランド配線2の太さは、プリミティブセルの配置位置
により決まる電源配線1及びグランド配線2の最小電流
容量に応じて設定してある。
In FIG. 1, as a primitive cell,
There are three types of type S, type M, and type L that have the same function but different widths of the power supply wiring 1 and the ground wiring 2. The thicknesses of the power supply wiring 1 and the ground wiring 2 in the primitive cell are Is set according to the minimum current capacity of the power supply wiring 1 and the ground wiring 2 which is determined by the arrangement position of the primitive cell.

【0014】したがって、プリミティブセルの配置され
る位置により、適切なプリミティブセルが選定される。
また、電源配線1及びグランド配線2の巾に応じてプリ
ミティブセルのサイズが異なっている。
Therefore, an appropriate primitive cell is selected according to the position where the primitive cell is arranged.
The size of the primitive cell differs depending on the width of the power supply wiring 1 and the ground wiring 2.

【0015】図2は、本発明の自動レイアウト用プリミ
ティブセルを用いてブロックの自動レイアウトを行った
結果である。電源,グランドは、両端から供給されるた
め、両端付近のセルは、自分より内側にあるセルに対し
て電源,グランドを供給する必要がある。
FIG. 2 shows the result of automatic layout of blocks using the automatic layout primitive cell of the present invention. Since the power and ground are supplied from both ends, the cells near both ends need to supply the power and ground to the cells inside themselves.

【0016】したがって、電源配線及びグランド配線幅
は、内側にあるセルに比べ太いタイプLを使用する。逆
に中央付近のセルは、他者に電源,グランドを供給する
必要がないため、電源,グランド幅が細くなっており、
その分セルサイズが小さくてよいタイプSを使用する。
Therefore, the width of the power supply wiring and the ground wiring is the type L which is thicker than that of the inner cell. On the contrary, the cells near the center do not need to supply power and ground to others, so the power and ground widths are narrow,
The type S whose cell size may be small accordingly is used.

【0017】図2の例では、同一列のセル領域のうち両
端1/6にはタイプLのプリミティブセルを配置し、同
じく中央部1/3にはタイプSのプリミティブセルを配
置し、タイプLとタイプSにはさまれた領域には、タイ
プMのプリミティブセルを配置する。
In the example shown in FIG. 2, type L primitive cells are arranged in both ends 1/6 of the cell region of the same column, and type S primitive cells are arranged in the center 1/3 of the cell regions. Type M primitive cells are arranged in the area sandwiched between type S and.

【0018】ここで、特記すべきことは、プリミティブ
セルサイズとは逆に配線領域4においては、中央部の方
が、両端付近より密集しているという事実である。これ
は、各々のプリミティブセルを最短距離で結線しようと
した場合、配線は両端付近に比べ中央部を通過する率が
高いことに起因する。一般に配線領域4の高さは、中央
部の横方向配線の数により決定されるため、中央部のプ
リミティブセルサイズが、小さくなることにより、確実
にブロックの面積は縮小する。
What should be noted here is the fact that, in contrast to the primitive cell size, in the wiring region 4, the central portion is denser than the vicinity of both ends. This is because when attempting to connect each of the primitive cells with the shortest distance, the wiring has a higher rate of passing through the central portion than near both ends. In general, the height of the wiring region 4 is determined by the number of horizontal wirings in the central portion, so that the size of the primitive cell in the central portion becomes small, so that the area of the block is surely reduced.

【0019】このように、常にプリミティブセルの配置
される座標(両端からの距離)によって、複数個存在す
るプリミティブセルの中から、座標によって決められた
サイズのプリミティブセルを配置し配線することによ
り、集積度の高いレイアウトを実現できる。
As described above, by always arranging and wiring the primitive cells of a size determined by the coordinates from among a plurality of primitive cells existing according to the coordinates (distance from both ends) where the primitive cells are arranged, A highly integrated layout can be realized.

【0020】(実施例2)図3は、本発明の実施例2を
示すレイアウト図である。
(Embodiment 2) FIG. 3 is a layout diagram showing Embodiment 2 of the present invention.

【0021】本実施例では、同一機能で、電源配線1及
びグランド配線2の巾が異なるプリミティブセルが複数
個用意されており、配置される位置により、適切なプリ
ミティブセルが選定される。
In this embodiment, a plurality of primitive cells having the same function and different widths of the power supply wiring 1 and the ground wiring 2 are prepared, and an appropriate primitive cell is selected depending on the arrangement position.

【0022】本実施例は、実施例1と異なりプリミティ
ブセルのサイズは同一であるが、プリミティブセル内に
横方向配線が可能な領域をもっており、結果的には配線
領域を補うことが可能である。
In this embodiment, unlike the first embodiment, the size of the primitive cell is the same, but there is a region in which horizontal wiring is possible in the primitive cell, and as a result, the wiring region can be supplemented. .

【0023】また、実施例1と異なりプリミティブセル
のサイズ自体は変らないため、自動レイアウトツール
が、高さの異なるセルを配置できない場合でも、使用で
きるという利点がある。
Further, unlike the first embodiment, since the size of the primitive cell itself does not change, there is an advantage that the automatic layout tool can be used even when cells having different heights cannot be arranged.

【0024】[0024]

【発明の効果】以上説明したように本発明の自動レイア
ウト用セルは、プリミティブセル内の電源配線及びグラ
ンド配線の太さを配置条件に応じて変化させてあるた
め、特性の劣化を招くことなく、不必要に太い電源配線
及びグランド配線をなくし、半導体集積回路における素
子密度を向上でき、コストアップを防止することができ
る。
As described above, in the automatic layout cell of the present invention, the thickness of the power supply wiring and the ground wiring in the primitive cell is changed according to the arrangement condition, so that the characteristics are not deteriorated. By eliminating unnecessary thick power supply wiring and ground wiring, it is possible to improve the element density in the semiconductor integrated circuit and prevent an increase in cost.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の実施例1を示すレイアウト図である。FIG. 1 is a layout diagram showing a first embodiment of the present invention.

【図2】本発明の実施例1のプリミティブセルを用いて
レイアウトした状態を示す図である。
FIG. 2 is a diagram showing a state of layout using the primitive cell according to the first embodiment of the present invention.

【図3】本発明の実施例2を示すレイアウト図である。FIG. 3 is a layout diagram showing a second embodiment of the present invention.

【図4】従来例のレイアウトした状態を示す図である。FIG. 4 is a diagram showing a layout state of a conventional example.

【符号の説明】[Explanation of symbols]

1 電源配線 2 グランド配線 3 セル領域 4 配線領域 1 power supply wiring 2 ground wiring 3 cell area 4 wiring area

Claims (1)

【特許請求の範囲】[Claims] 【請求項1】 複数のプリミティブセルを組合せてなる
スタンダードセル型半導体集積回路の自動レイアウト用
セルであって、 プリミティブセルは、電源配線及びグランド配線を有
し、 該電源及びグランド配線の太さは、前記プリミティブセ
ル配置位置により決まる前記電源配線及びグランド配線
の最小電流容量に応じて設定したものであることを特徴
とする自動レイアウト用セル。
1. A cell for automatic layout of a standard cell type semiconductor integrated circuit, which is a combination of a plurality of primitive cells, wherein the primitive cell has a power supply wiring and a ground wiring, and the thickness of the power supply and the ground wiring is An automatic layout cell, which is set according to the minimum current capacity of the power supply wiring and the ground wiring determined by the placement position of the primitive cell.
JP4176145A 1992-06-10 1992-06-10 Cell for automatic layout Expired - Lifetime JP2751742B2 (en)

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JPH05343518A true JPH05343518A (en) 1993-12-24
JP2751742B2 JP2751742B2 (en) 1998-05-18

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7786513B2 (en) 2006-03-08 2010-08-31 Panasonic Corporation Semiconductor integrated circuit device and power source wiring method therefor

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7786513B2 (en) 2006-03-08 2010-08-31 Panasonic Corporation Semiconductor integrated circuit device and power source wiring method therefor

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