JPH02153761A - Recording apparatus - Google Patents
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- JPH02153761A JPH02153761A JP30775788A JP30775788A JPH02153761A JP H02153761 A JPH02153761 A JP H02153761A JP 30775788 A JP30775788 A JP 30775788A JP 30775788 A JP30775788 A JP 30775788A JP H02153761 A JPH02153761 A JP H02153761A
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Abstract
Description
【発明の詳細な説明】
[産業上の利用分野〕
本発明はレーザービームプリンタ等の記録装置に関する
ものである。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a recording device such as a laser beam printer.
[従来の技術]
近年レーザービームプリンタは、コンピュータの出力装
置として広く使用されている。特に低密度(例えば30
0dpi)のレーザービームプリンタは低価格、コンパ
クトといったメリットにより急速に普及しつつある。[Prior Art] In recent years, laser beam printers have been widely used as output devices for computers. Especially low density (e.g. 30
0dpi) laser beam printers are rapidly becoming popular due to their advantages such as low cost and compact size.
例えば、300dp iの印字密度で印字を行うレーザ
ビームプリンタでは、第1図に示す如く、ドツトデータ
に基づいて実際に感光ドラム上に印字を行うプリンタエ
ンジン部51と、プリンタエンジン部51に接続され、
外部ホストコンピュータ54から送られるコードデータ
を受け、このコードデータに基づいてドツトデータから
成るページ情報を生成し、プリンタエンジン部51に対
して順次ドツトデータを送出するプリンタコントローラ
52とから構成される。For example, in a laser beam printer that prints at a printing density of 300 dpi, as shown in FIG. ,
The printer controller 52 receives code data sent from an external host computer 54, generates page information consisting of dot data based on the code data, and sequentially sends the dot data to the printer engine section 51.
また、上記ホストコンピュータ54は、数多くの種類が
作成されているアプリケーションソフトを有するフロッ
ピディスク55より、1つのアプリケーションソフトを
ロードし、そのプログラムを起動する0例えば、そのア
プリケーションソフトが文書作成用であればワードプロ
セッサとして機能し、このソフトを用いて、ユーザは数
多くのデータ情報を作成し、保管することができる。Further, the host computer 54 loads one application software from a floppy disk 55 containing many types of application software and starts the program.For example, if the application software is for document creation, It functions as a word processor and allows the user to create and store a large number of data information.
一方、プリンタエンジン部51には、より高品位の印字
を行うことを目的として、印字密度の高密度化や高階調
化が計られ、600dp iやそれ以上のプリンタエン
ジン、又は多値データを扱うプリンタエンジンも近年発
表されている。On the other hand, the printer engine section 51 has a higher printing density and higher gradation in order to perform higher quality printing, and has a printer engine of 600 dpi or more, or a printer engine that handles multi-value data. Printer engines have also been announced in recent years.
[発明が解決しようとしている課題]
しかしながら、上述の高密度プリンタエンジン(600
dpi)に接続するプリンタコントローラ52では、従
来、各印字密度(600dpi)に対応した量のデータ
メモリを必要とした(例えば、600dp iの場合で
あれば、300dp iの4倍のメモリを有する)。[Problem to be solved by the invention] However, the above-mentioned high-density printer engine (600
Conventionally, the printer controller 52 connected to the print density (600 dpi) required an amount of data memory corresponding to each print density (600 dpi) (for example, in the case of 600 dpi, the memory was four times that of 300 dpi). .
また、高密度プリンタ専用のアプリケーションソフトを
作らなければならず、先に述べた数多くのアプリケーシ
ョンソフトを高密度プリンタに対してそのまま使うこと
が出来なかった。In addition, application software had to be created specifically for high-density printers, and the numerous application software mentioned above could not be used as is for high-density printers.
例えば、第2図は、300dp iの印字密度によるア
ルファベットraJのドツト構成を示す図である。For example, FIG. 2 is a diagram showing the dot configuration of the alphabet raJ at a printing density of 300 dpi.
そのままのドツト構成で、600dp iの印字密度で
印字すると、文字の大きさがタテ方向及びヨコ方向共に
1/2の大きさになってしまう。If the dot configuration is used as it is and printed at a print density of 600 dpi, the character size will be reduced to 1/2 in both the vertical and horizontal directions.
そこで、一つのデータ補間方法として、縦方向及び横方
向共に単純にドツト構成を2倍にして、300dpi(
7)ドツト構成を600 d p i ニ適用させる方
法があるが、第3図で示す如く、ドツト構成の変換をし
た場合は、画像の大きさは小さくならずにすむが、30
0dp iで印字した場合と600dp iで印字した
場合とでは、文字の輪郭やギザギザは改善されることは
なく、プリントエンジンの能力(600dpi)を発揮
した美しさにすることができないという欠点があった。Therefore, one data interpolation method is to simply double the dot configuration in both the vertical and horizontal directions to achieve 300 dpi (
7) There is a method of applying the dot configuration to 600 dpi, but as shown in Figure 3, if the dot configuration is converted, the image size does not become smaller, but
When printing at 0dpi and when printing at 600dpi, the outlines and jaggedness of the characters are not improved, and the disadvantage is that the print engine's ability (600dpi) cannot be used to achieve the beauty. Ta.
本発明は、上記従来の欠点に鑑みなされたもので、既存
する数多くの低記録密度用に作成されたアプリケーショ
ンソフトをそのまま使用し、高記録密度での記録を可能
とすると共に、低記録密度として展開された記録データ
を最小のメモリにて高記録密度化した記録データに変換
し、高記録密度で高品位の記録を行うか、選択できる記
録装置を提供することを目的とする。The present invention has been made in view of the above-mentioned drawbacks of the conventional technology, and enables recording at high recording densities by using many existing application software created for low recording densities as is. It is an object of the present invention to provide a recording device that converts expanded recording data into recording data with a high recording density using a minimum memory, and allows a user to select whether to perform high-quality recording at a high recording density.
[問題を解決するための手段]
上記目的を達成するために、本発明の記録装置は以下の
構成を有する。即ち、
第1の記録ドツト密度のドツト情報を受信する第1ドツ
ト情報受信手段と、該第1ドツト情報受信手段からのド
ツト情報を記憶する記憶手段と、該記憶手段に格納され
たドツト情報に基づいて第2の記録ドツト密度の補間ド
ツト情報を生成する第2ドツト情報生成手段と、第2の
記録ドツト密度のドツト情報を受信する第2ドツト情報
受信手段と、前記第1ドツト情報受信手段と第2ドツト
情報受信手段を択一して選択する選択手段とを有する。[Means for Solving the Problem] In order to achieve the above object, the recording device of the present invention has the following configuration. That is, a first dot information receiving means for receiving dot information of a first recording dot density, a storage means for storing dot information from the first dot information receiving means, and a first dot information receiving means for storing dot information stored in the storage means. a second dot information generating means for generating interpolated dot information of a second recording dot density based on the second recording dot density; a second dot information receiving means for receiving the dot information of the second recording dot density; and the first dot information receiving means. and a selection means for selectively selecting the second dot information receiving means.
[作用]
以上の構成において、第1の記録ドツト密度のドツト情
報、又は第2の記録ドツト密度のドツト情報を択一して
受信し、第1の記録ドツト密度のドツト情報であれば、
受信したそのドツト情報を記憶し、その記憶したドツト
情報に基づいて第2の記録ドツト密度の補間ドツト情報
を生成するように動作する。[Operation] In the above configuration, dot information with the first recording dot density or dot information with the second recording dot density is selectively received, and if the dot information with the first recording dot density is received,
It stores the received dot information and operates to generate interpolated dot information of a second recording dot density based on the stored dot information.
[実施例]
以下、添付図面を参照して本発明に係る好適な一実施例
を詳細に説明する。[Embodiment] Hereinafter, a preferred embodiment of the present invention will be described in detail with reference to the accompanying drawings.
く装置の説明〉
第4A図は、本発明に係る第一の実施例を示すブロック
構成図である。図示するように、本実施例の回路は、第
1図に示すようなプリンタコントローラ52とプリンタ
エンジン部51との間に挿入されるデータ変換回路であ
り、プリンタエンジン部51の一部として構成された状
態を示している(もちろん、プリンタコントローラの一
部としても良い)、また、プリンタコントローラ52は
、300dpiのドツトデータを送出し、プリンタエン
ジン部51は、600dpiのドツトデータを受信した
場合のデータ変換回路の一例として示す、尚、プリンタ
エンジン部51は周知の如く画像信号(ドツト情報)に
基づいて、レーザビームを変調するレーザドライバ、ビ
ームを走査するためのスキャナ、感光ドラム等から成る
。Description of Device> FIG. 4A is a block configuration diagram showing a first embodiment of the present invention. As shown in the figure, the circuit of this embodiment is a data conversion circuit inserted between the printer controller 52 and the printer engine section 51 as shown in FIG. In addition, the printer controller 52 sends out 300 dpi dot data, and the printer engine unit 51 sends out 600 dpi dot data. The printer engine section 51 shown as an example of a conversion circuit is, as is well known, comprised of a laser driver for modulating a laser beam, a scanner for scanning the beam, a photosensitive drum, etc. based on an image signal (dot information).
プリンタコントローラ52は水平同期信号発生回路4に
より出力される水平同期信号HSYNCに応じて、30
0dp iの画像信号VDOと画像クロックVCLKと
をプリンタエンジン51に対して送出する。尚、水平同
期信号発生回路4は、主走査方向の同期信号である周知
のビームデイテクト信号BDに基づいて水平同期信号を
送出する回路である。The printer controller 52 responds to the horizontal synchronization signal HSYNC output by the horizontal synchronization signal generation circuit 4
The image signal VDO of 0 dpi and the image clock VCLK are sent to the printer engine 51. The horizontal synchronization signal generation circuit 4 is a circuit that sends out a horizontal synchronization signal based on a well-known beam detect signal BD, which is a synchronization signal in the main scanning direction.
一方、プリンタエンジン51は、詳細は後述するデータ
変換回路が300dp iの画像信号■DOと画像クロ
ック■CLKとから、600dpiに変換したレーザ駆
動信号LDを、600dpiのプリンタエンジン51に
て印字を行うものである。On the other hand, the printer engine 51 prints a laser drive signal LD which is converted to 600 dpi from the 300 dpi image signal DO and the image clock CLK by a data conversion circuit which will be described in detail later. It is something.
く補間の説明〉
次に、上述のデータ変換回路について、第4A図を参照
して更に詳細に説明する。Description of Interpolation> Next, the above data conversion circuit will be described in more detail with reference to FIG. 4A.
1は画像クロックVCLKの周波数を逓倍して周波数を
2倍に変換したクロックVCLK’を得る周波数逓倍回
路である。5は発振回路であり、画像クロックVCLK
の4倍の周波数のクロックLCLKを発生させる。11
,12.13は切換回路であり、クロックVCLK’又
はLCLKを各々択一して、各ラインメモリ6〜8の書
き込みクロック又は読み出しクロックとして供給する。Reference numeral 1 denotes a frequency multiplier circuit that multiplies the frequency of the image clock VCLK to obtain a clock VCLK' whose frequency is doubled. 5 is an oscillation circuit, and the image clock VCLK
A clock LCLK having a frequency four times that of the clock LCLK is generated. 11
, 12 and 13 are switching circuits which select the clock VCLK' or LCLK and supply it as a write clock or a read clock to each line memory 6 to 8.
2はデマルチプレクサであり、画像信号VDOを各ライ
ンメモリ6〜8に択一して供給する機能を有する。4は
ビームデイテクト信号(以下BD倍信号をカウントし、
BD倍信号2つ入力する度に1つの水平同期信号HSY
NCを出力する。A demultiplexer 2 has a function of selectively supplying the image signal VDO to each of the line memories 6 to 8. 4 is a beam detect signal (hereinafter, BD double signal is counted,
One horizontal synchronization signal HSY every time two BD double signals are input
Output NC.
3はデバイス制御回路であり、デマルチプレクサ2、及
び各切換回路11〜13と、後述する各データセレクタ
14〜16をBD倍信号基づき、1ライン毎の書き込み
又は読み込みを制御する。Reference numeral 3 denotes a device control circuit, which controls the demultiplexer 2, each switching circuit 11 to 13, and each data selector 14 to 16, which will be described later, to write or read each line based on the BD double signal.
このデバイス制御回路3により、各ラインメモリ6〜8
のいずれか一つのラインメモリに画像信号VDOがクロ
ックVCLK’にて書き込まれると共に、他の二つのラ
インメモリからは、クロックLCLKに基づいて、画像
信号が読み出される。This device control circuit 3 controls each line memory 6 to 8.
The image signal VDO is written into one of the line memories using the clock VCLK', and the image signal is read from the other two line memories based on the clock LCLK.
この動作は順次行われ、ラインメモリ6への書き込み時
には、ラインメモリ7とラインメモリ8は読み出し動作
を行い、次のタイミングではラインメモリ7が書き込み
動作を、ラインメモリ6と8が読み出し動作を行う。同
様に、次のタイミングではラインメモリ8が古き込み動
作を、ラインメモリ6と7が読み出し動作を行い、上述
した制御が繰り返される。This operation is performed sequentially; when writing to line memory 6, line memory 7 and line memory 8 perform a read operation, and at the next timing, line memory 7 performs a write operation, and line memories 6 and 8 perform a read operation. . Similarly, at the next timing, the line memory 8 performs the old read operation, the line memories 6 and 7 perform the read operation, and the above-described control is repeated.
尚、各ラインメモリ6〜8は、300dpiの主走査方
向のデータの2倍のメモリ容量、即ち、600dp i
の主走査方向のデータメモリ容量を有する。そして、各
ラインメモリ6〜8から読み出される画像信号を、それ
ぞれDI、D2.D3として、以下説明する。Note that each line memory 6 to 8 has a memory capacity twice as large as the data in the main scanning direction of 300 dpi, that is, 600 dpi
data memory capacity in the main scanning direction. Then, the image signals read from each line memory 6 to 8 are input to DI, D2. This will be explained below as D3.
14及び15はデータセレクタ1.2で、上述した各ラ
インメモリ6〜8の読み出し信号D1゜D2.D3のう
ち、読み出し動作中の2つの信号を各々選択する。例え
ば、ラインメモリ6が書き込み動作で、ラインメモリ7
.8が読み出し動作時には、データセレクタ14はライ
ンメモリ7の読み出しデータD2を選択し、DSL信号
を比較判別回路10に出力する。また、データセレクタ
15はラインメモリ8の読み出しデータD3を選択し、
DS2信号を比較判別回路10に出力する。そして、D
SL信号とDS2信号を入力した比較判別回路10は、
各々のデータを比較して、その結果に応じた出力信号Q
をラインメモリ9に出力する。14 and 15 are data selectors 1.2, which receive read signals D1, D2, . Of D3, two signals during a read operation are selected. For example, when line memory 6 is in a write operation, line memory 7
.. 8 is in a read operation, the data selector 14 selects the read data D2 of the line memory 7 and outputs a DSL signal to the comparison/discrimination circuit 10. Further, the data selector 15 selects the read data D3 of the line memory 8,
The DS2 signal is output to the comparison/discrimination circuit 10. And D
The comparison/discrimination circuit 10 inputting the SL signal and the DS2 signal is
Compare each data and output signal Q according to the result
is output to the line memory 9.
尚、この出力信号を記憶するラインメモリ9のメモリ容
量は、上述した各ラインメモリ6〜8と同量の容量を有
する。そして、このラインメモリ9の書き込み及び読み
出し用のクロックには、LCLKが用いられる。また、
各ラインメモリ6〜8及びラインメモリ9の書き込み、
読み出し動作の制御とデータセレクタ14.15の選択
制御は、デバイス制御回路3によって実行される。Note that the memory capacity of the line memory 9 that stores this output signal is the same as that of each of the line memories 6 to 8 described above. LCLK is used as a clock for writing and reading from this line memory 9. Also,
Writing to each line memory 6 to 8 and line memory 9,
Control of the read operation and selection control of the data selectors 14 and 15 are executed by the device control circuit 3.
次に、データセレクタ16は、各ラインメモリ6〜8か
ら読み出される各信号D1〜D3、及びラインメモリ9
から読み出される信号D4の中からいずれかの信号を選
択し、レーザ駆動信号LDとして出力する。そして、そ
の選択制御も同様にデバイス制御回路3によって行われ
る。Next, the data selector 16 selects each signal D1 to D3 read from each line memory 6 to 8 and the line memory 9
One of the signals D4 read from the signal D4 is selected and outputted as the laser drive signal LD. The selection control is similarly performed by the device control circuit 3.
次に、上述した比較判別回路lOの一例を第5図で示す
構成図を参照して、以下に説明する。Next, an example of the comparison/discrimination circuit 1O mentioned above will be explained below with reference to the configuration diagram shown in FIG.
図示するように、入力信号DSI及びDS2は各々7ビ
ツトのシフトレジスタ17.18に入力される。各々の
シフトレジスタのシフト出力A。As shown, input signals DSI and DS2 are each input to 7-bit shift registers 17 and 18. Shift output A of each shift register.
B、C,D、E、D、G、及びa、b、c、d。B, C, D, E, D, G, and a, b, c, d.
e、f、gは論理回路19に入力される。ここで注目す
る画素(第6図参照)を以下に示す論理式に従い、出力
信号Qが設定される。e, f, and g are input to the logic circuit 19. The output signal Q is set for the pixel of interest (see FIG. 6) according to the following logical formula.
Q= (B+F)bcdef
+ (b+f)BCDEF
+ (C十E)cde
+(c+e)CDE
+Dd
+ABCDEFG
+abcdefg
上述した論理式を実現するものとして、第7図に示すよ
うな論理回路があり、その出力信号Qによりレーザ駆動
信号LDを生成する。Q= (B+F)bcdef + (b+f)BCDEF + (C1E)cde + (c+e)CDE +Dd +ABCDEFG +abcdefg There is a logic circuit as shown in Fig. 7 that realizes the above logical formula, and its output A laser drive signal LD is generated using the signal Q.
尚、第7図で示す31〜35はオア回路、36〜46は
アンド回路である。Note that 31 to 35 shown in FIG. 7 are OR circuits, and 36 to 46 are AND circuits.
第8図は、本実施例における方法により印字した結果を
示した図であり、図から分かるように、アルファベット
raJのギザギザの部分が第3図に比べて改善されてい
る。FIG. 8 is a diagram showing the results of printing according to the method of this embodiment. As can be seen from the diagram, the jagged portion of the alphabet raJ has been improved compared to FIG. 3.
尚、第4B図は、本実施例におけるデータ変換回路のタ
イミングチャートである。Incidentally, FIG. 4B is a timing chart of the data conversion circuit in this embodiment.
以上説明したように本実施例によれば、アプリケーショ
ンソフトをそのまま使用することが可能であり、また、
最小のメモリ容量で高印字密度の印字を可能にする。As explained above, according to this embodiment, it is possible to use the application software as is, and
Enables high-density printing with minimum memory capacity.
く選択手段の説明〉
次に、上述したデータ変換回路に印字密度選択手段を付
加し、プリントコントローラ52からのコマンド情報に
より印字密度を切換える一例を、第9図を参照して以下
に説明する。Description of Selection Means Next, an example in which a print density selection means is added to the data conversion circuit described above and the print density is switched according to command information from the print controller 52 will be described below with reference to FIG.
尚、第4A図で示すデータ変換回路と同符号が付しであ
るものは同一機能を有する。Components with the same reference numerals as the data conversion circuit shown in FIG. 4A have the same functions.
第9図において、21はCPUであり、不図示の入出力
ボートにより、レーザビームプリンタのプリンタエンジ
ン51のデバイス制御、例えば、感光ドラムモータの回
転停止の制御、及び印字のプロセス動作の制御を行うと
共に、スイッチ22の設定状態を読み取る機能と、プリ
ンタコントローラとシリアル通信により、コマンドを受
信する機能と、切換回路23.24を切換える機能と、
デバイス制御回路3を制御する機能とを有する。In FIG. 9, 21 is a CPU, which controls the device of the printer engine 51 of the laser beam printer, for example, controls the rotation stop of the photosensitive drum motor, and controls the printing process operation by an input/output board (not shown). In addition, it has a function of reading the setting state of the switch 22, a function of receiving commands through serial communication with the printer controller, and a function of switching the switching circuits 23 and 24.
It has a function of controlling the device control circuit 3.
また、ROMは、CPU21の各制御プログラム(第1
1図で示すフローチャート)を格納し、RAMは、CP
U21が各制御を行う場合の各種テーブル及び作業領域
としてのメモリである。The ROM also stores each control program (the first one) of the CPU 21.
(Flowchart shown in Figure 1) is stored in the RAM, and the CP
This is a memory serving as various tables and a work area when U21 performs various controls.
尚、スイッチ22は、通常“b”端子側に設定されてい
る。CPU21は、電源投入直後、切換回路23及び切
換回路24を“a“端子側に接続する。即ち、この状態
では、第4A図で示す回路と同じ機能を成し、300d
piのプリンタコントローラ52からの画像データを受
信可能状態にあり、上述したように300dpiの画像
データを補間して、600dp iの印字を行う。Note that the switch 22 is normally set to the "b" terminal side. Immediately after the power is turned on, the CPU 21 connects the switching circuit 23 and the switching circuit 24 to the "a" terminal side. That is, in this state, it performs the same function as the circuit shown in FIG. 4A, and
It is in a state where it can receive image data from the printer controller 52 of Pi, and as described above, it interpolates the 300 dpi image data and performs 600 dpi printing.
一方、CPU21がプリントコントローラ52からシリ
アル通信線によりモード切換コマンドを受信すると、C
PU21は切換回路23及び切換回路24を“b”端子
側に切換え、デバイス制御回路3に対して600dpi
での画像データ入力指示を出力する。そして、画像クロ
ックVCLKがそのまま入力され、水平同期信号HSY
NCもBD信号がそのまま出力される。また、デバイス
制御回路3は、ラインメモリ6、及び7をダブルバッフ
ァメモリとして制御する。即ち、第n番目の主走査方向
データを受信する場合には、デマルチプレクサ2に60
0dp iの画像信号VDOをラインメモリ6に書き込
みを行うように指示し、同時に、データセレクタ16に
ラインメモリ7の出力D2を選択する指示を行うと共に
、切換回路12に読み出しクロックとして、LCLKを
選択するように指示し、ラインメモリ7から読み出され
たデータなレーザ駆動信号LDとして出力するようにデ
ータセレクタ16を制御する。On the other hand, when the CPU 21 receives a mode switching command from the print controller 52 via the serial communication line, the
The PU21 switches the switching circuit 23 and the switching circuit 24 to the "b" terminal side, and outputs 600 dpi to the device control circuit 3.
Outputs image data input instructions. Then, the image clock VCLK is input as is, and the horizontal synchronization signal HSY
The NC also outputs the BD signal as it is. Further, the device control circuit 3 controls the line memories 6 and 7 as double buffer memories. That is, when receiving the n-th main scanning direction data, the demultiplexer 2
Instructs to write the 0dp i image signal VDO into the line memory 6, simultaneously instructs the data selector 16 to select the output D2 of the line memory 7, and at the same time instructs the switching circuit 12 to select LCLK as the read clock. and controls the data selector 16 to output the data read from the line memory 7 as the laser drive signal LD.
次に、第n+1番目の主走査方向データを受信する場合
も同様に、デマルチプレクサ2に対してVDOをライン
メモリ7に導くと共に、VCLKをラインメモリ7の書
き込みクロックに選択し、ラインメモリ7にデータの書
き込み指示を行い、同時に、データセレクタ3に対して
ラインメモリ6の出力Dlを選択する指示を行うと共に
、切換回路11に読み出しクロックとして、LCLKを
選択させ、ラインメモリ6からの読み出しデータなレー
ザ駆動信号LDとして出力するように制御する。そして
、第n+2番目の主走査方向データを受信する場合には
、第n番目と同様に動作し、以下、同じ動作がくり返さ
れる。Next, when receiving the (n+1)th main scanning direction data, similarly, the demultiplexer 2 guides VDO to the line memory 7, selects VCLK as the write clock of the line memory 7, and writes the data to the line memory 7. A data write instruction is given, and at the same time, an instruction is given to the data selector 3 to select the output Dl of the line memory 6, and the switching circuit 11 is made to select LCLK as the read clock, so that the read data from the line memory 6 is It is controlled to be output as a laser drive signal LD. Then, when receiving the (n+2)th main scanning direction data, the same operation as the nth data is performed, and the same operation is repeated thereafter.
以上説明したように、電源投入後に、プリンタコントロ
ーラからコマンドを入力しない場合は、300dpiの
画像データを受信するプリンタとして動作し、プリンタ
コントローラからコマンドを入力すると、600dpi
の画像データを受信するプリンタとして動作する。それ
ゆえ、従来の300dpiのプリンタコントローラと、
今後、開発されていくであろう新たな600dp iの
プリンタコントローラの両方を、そのまま接続すること
ができる。そして、電源投入直後に、プリンタエンジン
に対して、コマンドを送出するだけで600dpiのプ
リンタエンジンとして動作させることが可能である。As explained above, after the power is turned on, if no command is input from the printer controller, the printer operates as a printer that receives 300 dpi image data, and when a command is input from the printer controller, it operates as a printer that receives 600 dpi image data.
operates as a printer that receives image data. Therefore, a conventional 300dpi printer controller,
New 600 dpi printer controllers that will be developed in the future can be connected as is. Immediately after the power is turned on, it is possible to operate the printer engine as a 600 dpi printer engine simply by sending a command to the printer engine.
また、スイッチ22を“a”端子側に設定すると、プリ
ンタコントローラからのコマンドを入力しなくても、6
00dpiの画像信号を受信するプリンタとして機能さ
せることも可能である。Also, if the switch 22 is set to the "a" terminal side, the 6
It is also possible to function as a printer that receives an image signal of 00 dpi.
以上説明したCPU21の制御を示した図が第11図の
フローチャートである。FIG. 11 is a flowchart showing the control of the CPU 21 explained above.
次に、上述した印字密度選択手段の他の実施例を第10
図を参照して、以下に説明する。Next, another embodiment of the above-mentioned printing density selection means will be described as a 10th embodiment.
This will be explained below with reference to the figures.
尚、第9図と同符号が付しであるものは、同一の機能で
あることを示す。Components with the same reference numerals as those in FIG. 9 indicate the same functions.
第1O図で示すように、31は周波数判別回路であり、
入力した画像クロックVCLKの周波数を判別し、30
0dp i用の画像クロックか、又は600dpi用の
画像クロックかを判別する。As shown in FIG. 1O, 31 is a frequency discrimination circuit;
Determine the frequency of the input image clock VCLK, and
It is determined whether the image clock is for 0dpi or 600dpi.
ここでの判別は、600dpi用の画像クロックの周波
数が300dpi用の画像クロックの4倍の周波数であ
ることを利用する。周波数判別回路31は周波数の判別
に応じて上述したCPU21と同様に、切換回路23.
24と、デバイス制御回路3を制御して、300dp
iの画像クロックを入力した場合には、300dp i
の画像信号として処理を行い、又600dp iの画像
クロックを入力した場合には、600dp iの画像信
号を受信して印字する。The determination here uses the fact that the frequency of the image clock for 600 dpi is four times the frequency of the image clock for 300 dpi. Similar to the CPU 21 described above, the frequency discrimination circuit 31 switches the switching circuit 23 .
24 and the device control circuit 3 to control the 300dp
If the image clock of i is input, 300dp i
If a 600 dpi image clock is input, the 600 dpi image signal is received and printed.
上述した実施例では、300dp iと600dpiの
記録密度を説明したが、400dp iと800dp
iの組み合わせであっても良い。In the above-mentioned embodiment, recording densities of 300 dpi and 600 dpi were explained, but recording densities of 400 dpi and 800 dpi
It may be a combination of i.
[発明の効果]
以上説明したように本発明によれば、特別なアプリケー
ションソフトを用いることなく、ドツト密度の変換を選
択して行うことができる。[Effects of the Invention] As explained above, according to the present invention, dot density conversion can be selectively performed without using special application software.
第1図はレーザービームプリンタのシステムを説明する
ための図、
第2図は従来例でのドツト構成を示す図、第3図はドツ
ト変換をした例を示す図、第4A図は本実施例における
データ変換回路の構成を示す図、
第4B図は第4A図に示した回路のタイミングチャート
を示す図、
第5図は本実施例における比較判別回路10の詳細回路
を示す図、
第6図は本実施例における注目画素とビットの関係を示
す図、
第7図は本実施例における論理回路の一構成例を示す図
、
第8図は第4A図によって得られるドツト構成を示す図
、
第9図は本実施例での選択手段を示す図、第10図は他
の構成での選択手段を示す図、第11図は本実施例での
処理手順を示すフローチャートである。
図中、1・・・周波数逓倍回路、2・・・デマルチプレ
クサ、3・・・デバイス制御回路、4・・・水平同期信
号発生回路、5・・・発振回路、6〜8.9・・・ライ
ンメモリ、14〜16・・・データセレクタ、10・・
・比較判別回路、11〜13,23.24・・・切換回
路、21・・・CPU、22・・・スイッチ、31・・
・周波数判別回路である。
第2
第
図
第
図
第
11図Figure 1 is a diagram for explaining the system of a laser beam printer, Figure 2 is a diagram showing a dot configuration in a conventional example, Figure 3 is a diagram showing an example of dot conversion, and Figure 4A is a diagram of this embodiment. 4B is a diagram showing a timing chart of the circuit shown in FIG. 4A, FIG. 5 is a diagram showing a detailed circuit of the comparison/discrimination circuit 10 in this embodiment, and FIG. 7 is a diagram showing the relationship between the pixel of interest and the bit in this example, FIG. 7 is a diagram showing an example of the configuration of a logic circuit in this example, FIG. 8 is a diagram showing the dot configuration obtained from FIG. 4A, FIG. 9 is a diagram showing the selection means in this embodiment, FIG. 10 is a diagram showing the selection means in another configuration, and FIG. 11 is a flowchart showing the processing procedure in this embodiment. In the figure, 1... Frequency multiplier circuit, 2... Demultiplexer, 3... Device control circuit, 4... Horizontal synchronization signal generation circuit, 5... Oscillation circuit, 6-8.9...・Line memory, 14-16...Data selector, 10...
・Comparison/discrimination circuit, 11 to 13, 23.24...Switching circuit, 21...CPU, 22...Switch, 31...
・It is a frequency discrimination circuit. 2 Figure 11
Claims (1)
ト情報受信手段と、 該第1ドット情報受信手段からのドット情報を記憶する
記憶手段と、 該記憶手段に格納されたドット情報に基づいて第2の記
録ドット密度の補間ドット情報を生成する第2ドット情
報生成手段と、 第2の記録ドット密度のドット情報を受信する第2ドッ
ト情報受信手段と、 前記第1ドット情報受信手段と第2ドット情報受信手段
を択一して選択する選択手段とを有することを特徴とす
る記録装置。[Scope of Claims] First dot information receiving means for receiving dot information of a first recording dot density; storage means for storing dot information from the first dot information receiving means; and dot information stored in the storage means. a second dot information generating means for generating interpolated dot information of a second recording dot density based on the dot information of the second recording dot density; a second dot information receiving means for receiving the dot information of the second recording dot density; 1. A recording apparatus comprising a selection means for selectively selecting between a dot information receiving means and a second dot information receiving means.
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30775788A JPH02153761A (en) | 1988-12-07 | 1988-12-07 | Recording apparatus |
DE68927540T DE68927540T2 (en) | 1988-08-25 | 1989-08-23 | Data processing equipment |
EP89308556A EP0356224B1 (en) | 1988-08-25 | 1989-08-23 | Data processing apparatus |
US08/022,406 US5754188A (en) | 1988-08-25 | 1993-02-24 | Data processing apparatus |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30775788A JPH02153761A (en) | 1988-12-07 | 1988-12-07 | Recording apparatus |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02153761A true JPH02153761A (en) | 1990-06-13 |
Family
ID=17972908
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP30775788A Pending JPH02153761A (en) | 1988-08-25 | 1988-12-07 | Recording apparatus |
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Country | Link |
---|---|
JP (1) | JPH02153761A (en) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57135177A (en) * | 1981-02-17 | 1982-08-20 | Nippon Telegr & Teleph Corp <Ntt> | Dot matrix printer |
JPS6312019A (en) * | 1986-07-02 | 1988-01-19 | Graphtec Corp | Video printer |
-
1988
- 1988-12-07 JP JP30775788A patent/JPH02153761A/en active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57135177A (en) * | 1981-02-17 | 1982-08-20 | Nippon Telegr & Teleph Corp <Ntt> | Dot matrix printer |
JPS6312019A (en) * | 1986-07-02 | 1988-01-19 | Graphtec Corp | Video printer |
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