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JPH0170417U - - Google Patents

Info

Publication number
JPH0170417U
JPH0170417U JP1987165985U JP16598587U JPH0170417U JP H0170417 U JPH0170417 U JP H0170417U JP 1987165985 U JP1987165985 U JP 1987165985U JP 16598587 U JP16598587 U JP 16598587U JP H0170417 U JPH0170417 U JP H0170417U
Authority
JP
Japan
Prior art keywords
electronic volume
analog signal
volume circuit
incorporated
gate array
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1987165985U
Other languages
English (en)
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed filed Critical
Priority to JP1987165985U priority Critical patent/JPH0170417U/ja
Priority to US07/262,649 priority patent/US5010577A/en
Priority to DE3855571T priority patent/DE3855571T2/de
Priority to CA000581679A priority patent/CA1292788C/en
Publication of JPH0170417U publication Critical patent/JPH0170417U/ja
Pending legal-status Critical Current

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Classifications

    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03G—CONTROL OF AMPLIFICATION
    • H03G3/00—Gain control in amplifiers or frequency changers
    • H03G3/001—Digital control of analog signals
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03G—CONTROL OF AMPLIFICATION
    • H03G3/00—Gain control in amplifiers or frequency changers

Landscapes

  • Control Of Amplification And Gain Control (AREA)
  • Amplifiers (AREA)

Description

【図面の簡単な説明】
第１図は本考案の一実施例に係る電子ボリユー
ム回路の構成を示すブロツク図、第２図はこの電
子ボリユーム回路の原理を説明するための図、第
３図および第４図は従来の電子ボリユーム回路の
構成を示すブロツク図である。 １……入力端子、３……ローパスフイルタ、４
……出力端子、５……ボリユーム制御回路、６…
…ボリユーム制御データ発生回路、７……クロツ
ク発生源、８……分周カウンタ、９……比較回路
、１１……オープンドレイン方式のトライステー
トバツフア。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 入力端子から入力されたアナログ信号を所
    定のデユーテイ比によるＯＮ／ＯＦＦのスイツチ
    ングを行い、出力端子から出力されるアナログ信
    号の信号レベルを制御する電子ボリユーム回路に
    おいて、前記アナログ信号のＯＮ／ＯＦＦのスイ
    ツチングが、ゲートアレイＬＳＩに組み込み可能
    な素子によりなされていることを特徴とする電子
    ボリユーム回路。 (2) ゲートアレイＬＳＩに組み込み可能な素子
    が、オープンドレイン方式のトライステートバツ
    フアである実用新案登録請求の範囲第１項記載の
    電子ボリユーム回路。
JP1987165985U 1987-10-29 1987-10-29 Pending JPH0170417U (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP1987165985U JPH0170417U (ja) 1987-10-29 1987-10-29
US07/262,649 US5010577A (en) 1987-10-29 1988-10-26 Electronic volume device
DE3855571T DE3855571T2 (de) 1987-10-29 1988-10-28 Verstärkungsregelungsanlage
CA000581679A CA1292788C (en) 1987-10-29 1988-10-28 Electronic volume device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1987165985U JPH0170417U (ja) 1987-10-29 1987-10-29

Publications (1)

Publication Number Publication Date
JPH0170417U true JPH0170417U (ja) 1989-05-10

Family

ID=15822735

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1987165985U Pending JPH0170417U (ja) 1987-10-29 1987-10-29

Country Status (4)

Country Link
US (1) US5010577A (ja)
JP (1) JPH0170417U (ja)
CA (1) CA1292788C (ja)
DE (1) DE3855571T2 (ja)

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Also Published As

Publication number Publication date
US5010577A (en) 1991-04-23
DE3855571T2 (de) 1997-02-27
DE3855571D1 (de) 1996-10-31
CA1292788C (en) 1991-12-03

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