JP4478038B2 - 半導体装置及びその製造方法 - Google Patents
半導体装置及びその製造方法 Download PDFInfo
- Publication number
- JP4478038B2 JP4478038B2 JP2005027756A JP2005027756A JP4478038B2 JP 4478038 B2 JP4478038 B2 JP 4478038B2 JP 2005027756 A JP2005027756 A JP 2005027756A JP 2005027756 A JP2005027756 A JP 2005027756A JP 4478038 B2 JP4478038 B2 JP 4478038B2
- Authority
- JP
- Japan
- Prior art keywords
- film
- insulating film
- interlayer insulating
- wiring
- layer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
Images
Classifications
-
- C—CHEMISTRY; METALLURGY
- C02—TREATMENT OF WATER, WASTE WATER, SEWAGE, OR SLUDGE
- C02F—TREATMENT OF WATER, WASTE WATER, SEWAGE, OR SLUDGE
- C02F11/00—Treatment of sludge; Devices therefor
- C02F11/12—Treatment of sludge; Devices therefor by de-watering, drying or thickening
- C02F11/121—Treatment of sludge; Devices therefor by de-watering, drying or thickening by mechanical de-watering
- C02F11/126—Treatment of sludge; Devices therefor by de-watering, drying or thickening by mechanical de-watering using drum filters
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76843—Barrier, adhesion or liner layers formed in openings in a dielectric
- H01L21/76844—Bottomless liners
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76829—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers
- H01L21/76831—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing characterised by the formation of thin functional dielectric layers, e.g. dielectric etch-stop, barrier, capping or liner layers in via holes or trenches, e.g. non-conductive sidewall liners
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76843—Barrier, adhesion or liner layers formed in openings in a dielectric
- H01L21/76849—Barrier, adhesion or liner layers formed in openings in a dielectric the layer being positioned on top of the main fill metal
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76853—Barrier, adhesion or liner layers characterized by particular after-treatment steps
- H01L21/76855—After-treatment introducing at least one additional element into the layer
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76853—Barrier, adhesion or liner layers characterized by particular after-treatment steps
- H01L21/76855—After-treatment introducing at least one additional element into the layer
- H01L21/76856—After-treatment introducing at least one additional element into the layer by treatment in plasmas or gaseous environments, e.g. nitriding a refractory metal liner
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76867—Barrier, adhesion or liner layers characterized by methods of formation other than PVD, CVD or deposition from a liquids
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76838—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
- H01L21/76841—Barrier, adhesion or liner layers
- H01L21/76871—Layers specifically deposited to enhance or enable the nucleation of further layers, i.e. seed layers
- H01L21/76873—Layers specifically deposited to enhance or enable the nucleation of further layers, i.e. seed layers for electroplating
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
- H01L23/532—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body characterised by the materials
- H01L23/53204—Conductive materials
- H01L23/53209—Conductive materials based on metals, e.g. alloys, metal silicides
- H01L23/53228—Conductive materials based on metals, e.g. alloys, metal silicides the principal metal being copper
- H01L23/53238—Additional layers associated with copper layers, e.g. adhesion, barrier, cladding layers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Manufacturing & Machinery (AREA)
- Mechanical Engineering (AREA)
- Plasma & Fusion (AREA)
- Life Sciences & Earth Sciences (AREA)
- Hydrology & Water Resources (AREA)
- Environmental & Geological Engineering (AREA)
- Water Supply & Treatment (AREA)
- Chemical & Material Sciences (AREA)
- Organic Chemistry (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Description
半導体基板上に配設され且つ開口部を有する少なくとも酸素(O)を含む層間絶縁膜と、
前記開口部内に埋め込まれたCuを主成分とする配線本体層と、
前記開口部内で前記層間絶縁膜と前記配線本体層との間に介在するバリア膜とを具備し、
前記バリア膜はMnと前記層間絶縁膜の構成元素のうち少なくとも酸素(O)を含む元素との化合物からなることを特徴とする。
半導体基板上に配設された少なくとも酸素(O)を含む層間絶縁膜に開口部を形成する工程と、
前記開口部の内面をMnを含む補助膜で被覆する工程と、
前記補助膜で被覆する工程の後、配線本体層の材料となるCuを主成分とする主膜を、前記開口部内を埋め込むように形成する工程と、
前記主膜を埋め込む工程の前または後に熱処理を行うことにより、前記補助膜中の前記Mnを前記補助膜に対面する前記層間絶縁膜の表面に拡散させ、前記Mnと前記層間絶縁膜の構成元素のうち少なくとも酸素(O)を含む元素との化合物からなるバリア膜を、前記開口部内で前記層間絶縁膜上に形成する工程と、
を具備する。
半導体基板上に配設された少なくとも酸素(O)を含む層間絶縁膜に開口部を形成する工程と、
配線本体層の材料となるCuを主成分とする主膜を、前記開口部内を埋め込むように形成する工程と、
前記主膜を埋め込む工程の後、前記主膜上にMnを含む補助膜を形成する工程と、
前記補助膜を形成する工程の後に熱処理を行うことにより、前記補助膜中の前記Mnを前記主膜に対面する前記層間絶縁膜の表面に拡散させ、前記Mnと前記層間絶縁膜の構成元素のうち少なくとも酸素(O)を含む元素との化合物からなるバリア膜を、前記開口部内で前記層間絶縁膜上に形成する工程と、
を具備する。
図1(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、CuとMnとの合金からなる膜(所定の金属元素αを含む補助膜)13を形成する。合金膜13は、例えばスパッタ法により厚さ5〜100nmに形成する。合金膜13におけるMnの含有量は、原子%にして0.05〜20%である。合金膜13は、後述するCu主膜を電解メッキする際のシード層として機能する。
図2(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、CuとMnとの合金からなる膜(所定の金属元素αを含む補助膜)13を形成する。合金膜13は、例えばスパッタ法により厚さ5〜100nmに形成する。合金膜13におけるMnの含有量は、原子%にして0.05〜20%である。
図3(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、Cu膜17とMn膜18とをこの順で形成する。Cu膜17とMn膜18とは、所定の金属元素αを含む多層構造の補助膜を構成する。Cu膜17及びMn膜18は、例えばスパッタ法により、夫々厚さ5〜100nm、5〜100nmに形成する。
図4(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、Cu膜17とMn膜18とをこの順で形成する。Cu膜17とMn膜18とは、所定の金属元素αを含む多層構造の補助膜を構成する。Cu膜17及びMn膜18は、例えばスパッタ法により、夫々厚さ5〜100nm、5〜100nmに形成する。
図5(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、Mn膜18とCu膜17とをこの順で形成する。Mn膜18とCu膜17とは、所定の金属元素αを含む多層構造の補助膜を構成する。Mn膜18及びCu膜17は、例えばスパッタ法により、夫々厚さ5〜100nm、5〜100nmに形成する。
図6(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、Mn膜(所定の金属元素αを含む補助膜)18を形成する。Mn膜18は、例えばスパッタ法により、厚さ5〜100nmに形成する。
図7(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、CuとMnとの合金からなる膜(所定の金属元素αを含む補助膜)13を形成する。合金膜13は、例えばスパッタ法により厚さ5〜100nmに形成する。合金膜13におけるMnの含有量は、原子%にして0.05〜20%である。
図8(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、CuとMnとの合金からなる膜(所定の金属元素αを含む補助膜)13を形成する。合金膜13は、例えばスパッタ法により厚さ5〜100nmに形成する。合金膜13におけるMnの含有量は、原子%にして0.05〜20%である。
図9(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、CuとMnとの合金からなる膜(所定の金属元素αを含む補助膜)13を形成する。合金膜13は、例えばスパッタ法により厚さ5〜100nmに形成する。合金膜13におけるMnの含有量は、原子%にして0.05〜20%である。
図10(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、CuとMnとの合金からなる膜(所定の金属元素αを含む補助膜)13を形成する。合金膜13は、例えばスパッタ法により厚さ5〜100nmに形成する。合金膜13におけるMnの含有量は、原子%にして0.05〜20%である。
図11(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、Cu膜17を形成する。Cu膜17は、例えばスパッタ法により、厚さ5〜100nmに形成する。Cu膜17は、後述するCu主膜を電解メッキする際のシード層として機能する。
図12(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、Cu膜17を形成する。Cu膜17は、例えばスパッタ法により、厚さ5〜100nmに形成する。
図13(a)に示すように、まず、SiO2からなる層間絶縁膜11に配線溝(開口部)12を形成する。次に、この溝12の内面を被覆するように、層間絶縁膜11上に、Cu膜17を形成する。Cu膜17は、例えばスパッタ法により、厚さ5〜100nmに形成する。
これ以降は図示しないが、CMPなどにより配線溝12外のCu主膜16を、絶縁膜19及び上側絶縁膜20と共に、研磨除去することにより、Cu層16aからなる低抵抗の配線本体層を配線溝12内に残置する。
図14は、各種のCu合金における熱処理温度に対する比抵抗の変化を示す特性図である。図14において、横軸は熱処理温度T(℃)、縦軸は合金の比抵抗R(μΩcm)を示す。Ni、Mg、或いはAlとCuとの合金では、熱処理温度が350℃を超えると比抵抗が大きくなる。これに対して、MnとCuとの合金では、比抵抗は熱処理温度の上昇と共に減少し、純銅のそれと等しくなる。これは、合金元素としてのMnはCu膜中には固溶せず界面に移動するために、比抵抗が純銅の値まで減少することを意味する。従って、合金元素としてMnを用いることにより、従来よりも低抵抗の配線を実現することができる。
図16(a)〜(f)は、本発明の第14の実施形態に係る半導体装置の製造方法を工程順に示す断面図である。この実施形態は、第1の実施形態をデュアルダマシン配線構造に適用したものである。
図18は、本発明の第15の実施形態に係る半導体装置を示す断面図である。本実施形態は、第1の実施形態をシングルダマシン配線構造に適用したものである。この装置の基本的な製造方法は、第14の実施形態と概ね同じであるが、次のような点で異なる。
図19(a)〜(c)は、本発明の第16の実施形態に係る半導体装置の製造方法を工程順に示す断面図である。この実施形態は、第10の実施形態をデュアルダマシン配線構造に適用したものである。
図20(a)〜(e)は、本発明の第17の実施形態に係る半導体装置の製造方法を工程順に示す断面図である。この実施形態は、第7の実施形態をデュアルダマシン配線構造に適用したものである。
図22(a)〜(e)は、本発明の第18の実施形態に係る半導体装置の製造方法を工程順に示す断面図である。この実施形態は、第17の実施形態を変形したものである。
図24(a)〜(f)は、本発明の第19の実施形態に係る半導体装置の製造方法を工程順に示す断面図である。この実施形態は、第17の実施形態を更に変形したものである。
上述の実施形態では、配線本体層の材料としてCuを使用した場合が例示される。しかし、配線本体層は、Cuを主成分(即ち、50%以上)とする材料、例えば、一般的に配線材料として使用されているCu合金からなる場合も、上述と同様な効果が得られる。
Claims (17)
- 半導体基板上に配設され且つ開口部を有する少なくとも酸素(O)を含む層間絶縁膜と、
前記開口部内に埋め込まれたCuを主成分とする配線本体層と、
前記開口部内で前記層間絶縁膜と前記配線本体層との間に介在するバリア膜とを具備し、
前記バリア膜はMnと前記層間絶縁膜の構成元素のうち少なくとも酸素(O)を含む元素との化合物からなることを特徴とする半導体装置。 - 前記開口部は前記層間絶縁膜より下に配設された導電層に至るように形成され、前記バリア膜は前記導電層と前記配線本体層との間に介在しない請求項1に記載の半導体装置。
- 前記バリア膜は前記配線本体層の上側表面を更に覆い、前記バリア膜はMnの酸化物からなることを特徴とする請求項1に記載の半導体装置。
- 前記層間絶縁膜は、シリコン(Si)、炭素(C)、フッ素(F)からなる群から選択された少なくとも1つの元素と、酸素(O)とにより構成され、前記バリア膜は、MnxOy、MnxSiyOz、MnxCyOz、及びMnxFyOzからなる群から選択された少なくとも1つの物質からなることを特徴とする請求項1または2に記載の半導体装置。
- 前記導電層は下側配線層であり、前記半導体装置は前記下側配線層と前記層間絶縁膜との間に介在する下側絶縁膜を更に具備し、前記開口部は前記下側絶縁膜を貫通する請求項2に記載の半導体装置。
- 前記下側絶縁膜は酸素を含有し、その酸素濃度が前記層間絶縁膜側よりも前記下側配線層側のほうが低くなるように設定される請求項5に記載の半導体装置。
- 前記下側絶縁膜は、SiC、SiCN、及びSiNからなる群から選択された材料を主成分とする請求項5または6に記載の半導体装置。
- 前記導電層は下側配線層であり、前記半導体装置は前記下側配線層と前記層間絶縁膜との間に介在する高融点金属層を更に具備する請求項2に記載の半導体装置。
- 前記層間絶縁膜は多孔質な低誘電率膜であり、前記装置は前記層間絶縁膜と前記バリア膜との間に介在する、前記層間絶縁膜よりも原子密度が高く、且つ少なくとも酸素(O)を含む被覆膜を更に具備し、前記バリア膜は、Mnと前記被覆膜の構成元素である酸素(O)との化合物とからなることを特徴とする請求項1に記載の半導体装置。
- 半導体基板上に配設された少なくとも酸素(O)を含む層間絶縁膜に開口部を形成する工程と、
前記開口部の内面をMnを含む補助膜で被覆する工程と、
前記補助膜で被覆する工程の後、配線本体層の材料となるCuを主成分とする主膜を、前記開口部内を埋め込むように形成する工程と、
前記主膜を埋め込む工程の前または後に熱処理を行うことにより、前記補助膜中の前記Mnを前記補助膜に対面する前記層間絶縁膜の表面に拡散させ、前記Mnと前記層間絶縁膜の構成元素のうち少なくとも酸素(O)を含む元素との化合物からなるバリア膜を、前記開口部内で前記層間絶縁膜上に形成する工程と、
を具備する半導体装置の製造方法。 - 前記主膜を埋め込む工程の後、前記主膜の上側表面を少なくとも酸素(O)を含む上側絶縁膜で被覆し、その後に前記熱処理を行うことにより、前記補助膜中の前記Mnを前記主膜の前記上側表面にも拡散させ、前記Mnと前記上側絶縁膜の構成元素のうち少なくとも酸素(O)を含む化合物からなる反応生成物膜を前記上側表面上に形成する請求項10に記載の半導体装置の製造方法。
- 前記主膜を埋め込む工程の後、酸素を含む雰囲気内で前記熱処理を行うことにより、前記補助膜中の前記Mnを前記主膜の上側表面にも拡散させ、前記Mnの酸化物からなる反応生成物膜を前記上側表面上に形成する請求項10に記載の半導体装置の製造方法。
- 半導体基板上に配設された少なくとも酸素(O)を含む層間絶縁膜に開口部を形成する工程と、
配線本体層の材料となるCuを主成分とする主膜を、前記開口部内を埋め込むように形成する工程と、
前記主膜を埋め込む工程の後、前記主膜上にMnを含む補助膜を形成する工程と、
前記補助膜を形成する工程の後に熱処理を行うことにより、前記補助膜中の前記Mnを前記主膜に対面する前記層間絶縁膜の表面に拡散させ、前記Mnと前記層間絶縁膜の構成元素のうち少なくとも酸素(O)を含む元素との化合物からなるバリア膜を、前記開口部内で前記層間絶縁膜上に形成する工程と、
を具備する半導体装置の製造方法。 - 前記補助膜を少なくとも酸素(O)を含む上側絶縁膜で被覆し、その後に前記熱処理を行うことにより、前記Mnと前記上側絶縁膜の構成元素のうち少なくとも酸素(O)を含む化合物からなる反応生成物膜を前記主膜の上側表面上に形成する請求項13に記載の半導体装置の製造方法。
- 前記熱処理を、酸素を含む雰囲気内で行うことにより、前記Mnの酸化物からなる反応生成物膜を前記主膜の上側表面上に形成する請求項13に記載の半導体装置の製造方法。
- 前記半導体基板上に配設された下側配線層上に、高融点金属層と前記層間絶縁膜とを順次形成する工程を更に具備し、前記開口部は前記高融点金属層を貫通するように形成される請求項10または13に記載の半導体装置の製造方法。
- 前記層間絶縁膜は多孔質な低誘電率膜であり、前記方法は、前記補助膜及び前記主膜を形成する前に、前記開口部の内面を前記層間絶縁膜よりも原子密度が高く、且つ少なくとも酸素(O)を含む被覆膜で被覆する工程を更に具備し、前記バリア膜は、Mnと前記被覆膜の構成元素である酸素(O)との化合物とからなることを特徴とする請求項10または13に記載の半導体装置の製造方法。
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005027756A JP4478038B2 (ja) | 2004-02-27 | 2005-02-03 | 半導体装置及びその製造方法 |
KR1020050015478A KR100693960B1 (ko) | 2004-02-27 | 2005-02-24 | 반도체 장치 |
TW094105650A TWI264046B (en) | 2004-02-27 | 2005-02-24 | Semiconductor device and its manufacturing method |
US11/063,876 US7304384B2 (en) | 2004-02-27 | 2005-02-24 | Semiconductor device with a barrier film which contains manganese |
US11/877,243 US7943517B2 (en) | 2004-02-27 | 2007-10-23 | Semiconductor device with a barrier film |
US13/087,026 US8133813B2 (en) | 2004-02-27 | 2011-04-14 | Semiconductor device with a barrier film |
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004053458 | 2004-02-27 | ||
JP2005027756A JP4478038B2 (ja) | 2004-02-27 | 2005-02-03 | 半導体装置及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2005277390A JP2005277390A (ja) | 2005-10-06 |
JP4478038B2 true JP4478038B2 (ja) | 2010-06-09 |
Family
ID=35053381
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005027756A Expired - Lifetime JP4478038B2 (ja) | 2004-02-27 | 2005-02-03 | 半導体装置及びその製造方法 |
Country Status (4)
Country | Link |
---|---|
US (3) | US7304384B2 (ja) |
JP (1) | JP4478038B2 (ja) |
KR (1) | KR100693960B1 (ja) |
TW (1) | TWI264046B (ja) |
Families Citing this family (142)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4478038B2 (ja) | 2004-02-27 | 2010-06-09 | 株式会社半導体理工学研究センター | 半導体装置及びその製造方法 |
JP4764606B2 (ja) | 2004-03-04 | 2011-09-07 | ルネサスエレクトロニクス株式会社 | 半導体装置およびその製造方法 |
JP4851740B2 (ja) * | 2005-06-30 | 2012-01-11 | 株式会社東芝 | 半導体装置およびその製造方法 |
JP4679270B2 (ja) | 2005-06-30 | 2011-04-27 | 株式会社東芝 | 半導体装置およびその製造方法 |
JP2007012996A (ja) * | 2005-07-01 | 2007-01-18 | Toshiba Corp | 半導体装置 |
JP4197694B2 (ja) * | 2005-08-10 | 2008-12-17 | 株式会社東芝 | 半導体装置およびその製造方法 |
JP4523535B2 (ja) * | 2005-08-30 | 2010-08-11 | 富士通株式会社 | 半導体装置の製造方法 |
JP4236201B2 (ja) * | 2005-08-30 | 2009-03-11 | 富士通マイクロエレクトロニクス株式会社 | 半導体装置の製造方法 |
JP4282646B2 (ja) | 2005-09-09 | 2009-06-24 | 株式会社東芝 | 半導体装置の製造方法 |
JP2007109736A (ja) * | 2005-10-11 | 2007-04-26 | Nec Electronics Corp | 半導体装置およびその製造方法 |
JP4946008B2 (ja) * | 2005-11-15 | 2012-06-06 | ソニー株式会社 | 半導体装置および半導体装置の製造方法 |
JP4529880B2 (ja) | 2005-11-21 | 2010-08-25 | ソニー株式会社 | 半導体装置および半導体装置の製造方法 |
JP2007149813A (ja) * | 2005-11-25 | 2007-06-14 | Sony Corp | 半導体装置の製造方法 |
KR100702797B1 (ko) * | 2005-12-09 | 2007-04-03 | 동부일렉트로닉스 주식회사 | 반도체소자의 구리배선막 형성방법 |
JP2007173511A (ja) * | 2005-12-22 | 2007-07-05 | Sony Corp | 半導体装置の製造方法 |
KR100720529B1 (ko) * | 2005-12-29 | 2007-05-22 | 동부일렉트로닉스 주식회사 | 반도체 소자의 금속배선 및 그의 형성방법 |
US7863183B2 (en) * | 2006-01-18 | 2011-01-04 | International Business Machines Corporation | Method for fabricating last level copper-to-C4 connection with interfacial cap structure |
JP5076482B2 (ja) | 2006-01-20 | 2012-11-21 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法 |
JP2007220738A (ja) * | 2006-02-14 | 2007-08-30 | Sony Corp | 半導体装置の製造方法 |
US8188599B2 (en) | 2006-02-28 | 2012-05-29 | Advanced Interconnect Materials, Llc | Semiconductor device, its manufacturing method, and sputtering target material for use in the method |
US8372745B2 (en) | 2006-02-28 | 2013-02-12 | Advanced Interconnect Materials, Llc | Semiconductor device, its manufacturing method, and sputtering target material for use in the method |
EP1845554A3 (en) * | 2006-04-10 | 2011-07-13 | Imec | A method to create super secondary grain growth in narrow trenches |
JP2008013848A (ja) * | 2006-06-08 | 2008-01-24 | Tokyo Electron Ltd | 成膜装置及び成膜方法 |
JP5145225B2 (ja) * | 2006-07-14 | 2013-02-13 | 株式会社アルバック | 半導体装置の製造方法 |
JP4910560B2 (ja) * | 2006-08-11 | 2012-04-04 | ソニー株式会社 | 半導体装置およびその製造方法 |
JP2008047719A (ja) * | 2006-08-17 | 2008-02-28 | Sony Corp | 半導体装置の製造方法 |
JP4740071B2 (ja) * | 2006-08-31 | 2011-08-03 | 株式会社東芝 | 半導体装置 |
JP4321570B2 (ja) * | 2006-09-06 | 2009-08-26 | ソニー株式会社 | 半導体装置の製造方法 |
JP2008091645A (ja) * | 2006-10-02 | 2008-04-17 | Tokyo Electron Ltd | 半導体製造装置、半導体装置の製造方法及び記憶媒体 |
JP4955008B2 (ja) * | 2006-10-03 | 2012-06-20 | Jx日鉱日石金属株式会社 | Cu−Mn合金スパッタリングターゲット及び半導体配線 |
JP4740083B2 (ja) * | 2006-10-05 | 2011-08-03 | 株式会社東芝 | 半導体装置、およびその製造方法 |
JP5076452B2 (ja) * | 2006-11-13 | 2012-11-21 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法 |
JP2008135569A (ja) * | 2006-11-28 | 2008-06-12 | Rohm Co Ltd | 半導体装置の製造方法および半導体装置 |
JP5010265B2 (ja) | 2006-12-18 | 2012-08-29 | 株式会社東芝 | 半導体装置の製造方法 |
JP5103914B2 (ja) | 2007-01-31 | 2012-12-19 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法及び半導体装置 |
DE102007004860B4 (de) * | 2007-01-31 | 2008-11-06 | Advanced Micro Devices, Inc., Sunnyvale | Verfahren zur Herstellung einer Kupfer-basierten Metallisierungsschicht mit einer leitenden Deckschicht durch ein verbessertes Integrationsschema |
JP4110192B1 (ja) | 2007-02-23 | 2008-07-02 | キヤノン株式会社 | 光電変換装置及び光電変換装置を用いた撮像システム |
JP4324617B2 (ja) | 2007-02-26 | 2009-09-02 | 東京エレクトロン株式会社 | スパッタ成膜方法及びスパッタ成膜装置 |
WO2008126206A1 (ja) | 2007-03-27 | 2008-10-23 | Fujitsu Microelectronics Limited | 半導体装置の製造方法 |
JP4453845B2 (ja) * | 2007-04-10 | 2010-04-21 | 国立大学法人東北大学 | 液晶表示装置及びその製造方法 |
US7633164B2 (en) | 2007-04-10 | 2009-12-15 | Tohoku University | Liquid crystal display device and manufacturing method therefor |
JP5089244B2 (ja) | 2007-05-22 | 2012-12-05 | ローム株式会社 | 半導体装置 |
JP2008300568A (ja) * | 2007-05-30 | 2008-12-11 | Tokyo Electron Ltd | 半導体装置の製造方法、半導体製造装置及び記憶媒体 |
JP5196467B2 (ja) * | 2007-05-30 | 2013-05-15 | 東京エレクトロン株式会社 | 半導体装置の製造方法、半導体製造装置及び記憶媒体 |
JP2009016782A (ja) | 2007-06-04 | 2009-01-22 | Tokyo Electron Ltd | 成膜方法及び成膜装置 |
JP2009004518A (ja) * | 2007-06-20 | 2009-01-08 | Kobe Steel Ltd | 薄膜トランジスタ基板、および表示デバイス |
TW200910431A (en) | 2007-06-22 | 2009-03-01 | Rohm Co Ltd | Semiconductor device and method for manufacturing the same |
JP5288734B2 (ja) * | 2007-06-22 | 2013-09-11 | ローム株式会社 | 半導体装置およびその製造方法 |
EP2162906B1 (en) * | 2007-06-29 | 2013-10-02 | Imec | A method for producing a copper contact |
JP2009076881A (ja) * | 2007-08-30 | 2009-04-09 | Tokyo Electron Ltd | 処理ガス供給システム及び処理装置 |
JPWO2009038168A1 (ja) * | 2007-09-21 | 2011-01-06 | 東京エレクトロン株式会社 | 成膜装置および成膜方法 |
US7884475B2 (en) * | 2007-10-16 | 2011-02-08 | International Business Machines Corporation | Conductor structure including manganese oxide capping layer |
US20090117731A1 (en) * | 2007-11-01 | 2009-05-07 | Taiwan Semiconductor Manufacturing Co., Ltd. | Semiconductor interconnection structure and method for making the same |
US8168532B2 (en) * | 2007-11-14 | 2012-05-01 | Fujitsu Limited | Method of manufacturing a multilayer interconnection structure in a semiconductor device |
JP2009135139A (ja) | 2007-11-28 | 2009-06-18 | Toshiba Corp | 半導体装置及びその製造方法 |
JP2009141058A (ja) * | 2007-12-05 | 2009-06-25 | Fujitsu Microelectronics Ltd | 半導体装置およびその製造方法 |
JP2009147137A (ja) | 2007-12-14 | 2009-07-02 | Toshiba Corp | 半導体装置およびその製造方法 |
JP5264187B2 (ja) * | 2008-01-08 | 2013-08-14 | パナソニック株式会社 | 半導体装置及びその製造方法 |
JP5366235B2 (ja) | 2008-01-28 | 2013-12-11 | 東京エレクトロン株式会社 | 半導体装置の製造方法、半導体製造装置及び記憶媒体 |
JP5141761B2 (ja) | 2008-02-27 | 2013-02-13 | 富士通セミコンダクター株式会社 | 半導体装置及びその製造方法 |
JP5343369B2 (ja) | 2008-03-03 | 2013-11-13 | 東京エレクトロン株式会社 | 半導体装置の製造方法、半導体製造装置及び記憶媒体 |
JP5820267B2 (ja) * | 2008-03-21 | 2015-11-24 | プレジデント アンド フェローズ オブ ハーバード カレッジ | 配線用セルフアライン(自己整合)バリア層 |
JP4423379B2 (ja) | 2008-03-25 | 2010-03-03 | 合同会社先端配線材料研究所 | 銅配線、半導体装置および銅配線の形成方法 |
JP5441345B2 (ja) * | 2008-03-27 | 2014-03-12 | 富士フイルム株式会社 | 研磨液、及び研磨方法 |
JP5343417B2 (ja) | 2008-06-25 | 2013-11-13 | 富士通セミコンダクター株式会社 | 半導体装置およびその製造方法 |
JP5417754B2 (ja) | 2008-07-11 | 2014-02-19 | 東京エレクトロン株式会社 | 成膜方法及び処理システム |
JP2010050359A (ja) * | 2008-08-22 | 2010-03-04 | Rohm Co Ltd | 半導体装置の製造方法 |
JP2010080606A (ja) * | 2008-09-25 | 2010-04-08 | Rohm Co Ltd | 半導体装置の製造方法 |
US8039390B2 (en) | 2008-08-05 | 2011-10-18 | Rohm Co., Ltd. | Method of manufacturing semiconductor device |
JP2010073736A (ja) * | 2008-09-16 | 2010-04-02 | Rohm Co Ltd | 半導体装置の製造方法 |
US8110504B2 (en) | 2008-08-05 | 2012-02-07 | Rohm Co., Ltd. | Method of manufacturing semiconductor device |
JP5353109B2 (ja) * | 2008-08-15 | 2013-11-27 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法 |
US8258626B2 (en) | 2008-09-16 | 2012-09-04 | Advanced Interconnect Materials, Llc | Copper interconnection, method for forming copper interconnection structure, and semiconductor device |
KR102149626B1 (ko) | 2008-11-07 | 2020-08-28 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치의 제작 방법 |
JP4415100B1 (ja) | 2008-12-19 | 2010-02-17 | 国立大学法人東北大学 | 銅配線、半導体装置および銅配線形成方法 |
JP4441658B1 (ja) | 2008-12-19 | 2010-03-31 | 国立大学法人東北大学 | 銅配線形成方法、銅配線および半導体装置 |
US8013444B2 (en) | 2008-12-24 | 2011-09-06 | Intel Corporation | Solder joints with enhanced electromigration resistance |
JP2010171362A (ja) * | 2008-12-26 | 2010-08-05 | Fujifilm Corp | 半導体デバイス用洗浄剤及びそれを用いた半導体デバイスの製造方法 |
JP2010171398A (ja) * | 2008-12-26 | 2010-08-05 | Toshiba Corp | 半導体装置の製造方法 |
JP2010171063A (ja) * | 2009-01-20 | 2010-08-05 | Kobe Steel Ltd | 半導体配線の製造方法 |
JP2010177393A (ja) * | 2009-01-29 | 2010-08-12 | Sony Corp | 半導体記憶装置およびその製造方法 |
KR101558428B1 (ko) | 2009-03-03 | 2015-10-20 | 삼성전자주식회사 | 반도체 장치의 형성 방법 |
JP5411535B2 (ja) * | 2009-03-11 | 2014-02-12 | 東京エレクトロン株式会社 | 半導体装置の製造方法 |
JP5530118B2 (ja) * | 2009-04-08 | 2014-06-25 | 東京エレクトロン株式会社 | 酸化マンガン膜の形成方法、半導体装置の製造方法および半導体装置 |
JP5190415B2 (ja) | 2009-06-04 | 2013-04-24 | パナソニック株式会社 | 半導体装置 |
JP5487748B2 (ja) | 2009-06-16 | 2014-05-07 | 東京エレクトロン株式会社 | バリヤ層、成膜方法及び処理システム |
JP5522979B2 (ja) | 2009-06-16 | 2014-06-18 | 国立大学法人東北大学 | 成膜方法及び処理システム |
US8168528B2 (en) * | 2009-06-18 | 2012-05-01 | Kabushiki Kaisha Toshiba | Restoration method using metal for better CD controllability and Cu filing |
JP5466889B2 (ja) * | 2009-06-18 | 2014-04-09 | 東京エレクトロン株式会社 | 多層配線の形成方法 |
US8134234B2 (en) * | 2009-06-18 | 2012-03-13 | Kabushiki Kaisha Toshiba | Application of Mn for damage restoration after etchback |
JP5359642B2 (ja) | 2009-07-22 | 2013-12-04 | 東京エレクトロン株式会社 | 成膜方法 |
JP5481989B2 (ja) * | 2009-07-22 | 2014-04-23 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法 |
JP5616605B2 (ja) * | 2009-10-16 | 2014-10-29 | 株式会社アルバック | 銅薄膜の形成方法 |
KR101730203B1 (ko) | 2009-10-23 | 2017-04-25 | 프레지던트 앤드 펠로우즈 오브 하바드 칼리지 | 상호 접속부를 위한 자기―정렬 배리어 및 캡핑 층 |
KR102037048B1 (ko) | 2009-11-13 | 2019-10-29 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치 및 그 제작 방법 |
JP5560696B2 (ja) | 2009-12-21 | 2014-07-30 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法 |
JP5440221B2 (ja) * | 2010-02-02 | 2014-03-12 | 日本電気株式会社 | 半導体装置の積層構造体の製造方法 |
US8377823B2 (en) * | 2010-02-17 | 2013-02-19 | Renesas Electronics Corporation | Semiconductor device including porous layer covered by poreseal layer |
JP2011216862A (ja) | 2010-03-16 | 2011-10-27 | Tokyo Electron Ltd | 成膜方法及び成膜装置 |
KR20130055607A (ko) | 2010-04-23 | 2013-05-28 | 가부시키가이샤 한도오따이 에네루기 켄큐쇼 | 반도체 장치의 제작 방법 |
US8377822B2 (en) | 2010-05-21 | 2013-02-19 | Kabushiki Kaisha Toshiba | Semiconductor device and manufacturing method thereof |
US20110290308A1 (en) * | 2010-05-28 | 2011-12-01 | General Electric Company | Monolithically integrated solar modules and methods of manufacture |
JP5429078B2 (ja) | 2010-06-28 | 2014-02-26 | 東京エレクトロン株式会社 | 成膜方法及び処理システム |
WO2012002573A1 (ja) * | 2010-07-02 | 2012-01-05 | 合同会社先端配線材料研究所 | 半導体装置 |
US8492289B2 (en) * | 2010-09-15 | 2013-07-23 | International Business Machines Corporation | Barrier layer formation for metal interconnects through enhanced impurity diffusion |
US9064875B2 (en) | 2010-09-29 | 2015-06-23 | Infineon Technologies Ag | Semiconductor structure and method for making same |
US8461683B2 (en) * | 2011-04-01 | 2013-06-11 | Intel Corporation | Self-forming, self-aligned barriers for back-end interconnects and methods of making same |
JP2013080779A (ja) * | 2011-10-03 | 2013-05-02 | Ulvac Japan Ltd | 半導体装置の製造方法、半導体装置 |
DE102012110060A1 (de) * | 2011-11-21 | 2013-05-23 | Infineon Technologies Ag | Halbleiterstruktur und Verfahren zu deren Herstellung |
WO2013125449A1 (ja) | 2012-02-22 | 2013-08-29 | 東京エレクトロン株式会社 | 半導体装置の製造方法、記憶媒体及び半導体装置 |
US8836124B2 (en) | 2012-03-08 | 2014-09-16 | International Business Machines Corporation | Fuse and integrated conductor |
JP5475820B2 (ja) * | 2012-03-23 | 2014-04-16 | 株式会社東芝 | 半導体装置の製造方法 |
KR20150005533A (ko) | 2012-04-11 | 2015-01-14 | 도쿄엘렉트론가부시키가이샤 | 반도체 장치의 제조 방법, 반도체 장치, 반도체 제조 장치 |
JP5554364B2 (ja) * | 2012-04-12 | 2014-07-23 | Jx日鉱日石金属株式会社 | 半導体用銅合金配線及びスパッタリングターゲット並びに半導体用銅合金配線の形成方法 |
US9076661B2 (en) | 2012-04-13 | 2015-07-07 | Applied Materials, Inc. | Methods for manganese nitride integration |
US9048294B2 (en) * | 2012-04-13 | 2015-06-02 | Applied Materials, Inc. | Methods for depositing manganese and manganese nitrides |
US8969197B2 (en) | 2012-05-18 | 2015-03-03 | International Business Machines Corporation | Copper interconnect structure and its formation |
US9054109B2 (en) * | 2012-05-29 | 2015-06-09 | International Business Machines Corporation | Corrosion/etching protection in integration circuit fabrications |
TW201403782A (zh) * | 2012-07-04 | 2014-01-16 | Ind Tech Res Inst | 基底穿孔的製造方法、矽穿孔結構及其電容控制方法 |
US9281263B2 (en) | 2012-07-17 | 2016-03-08 | Taiwan Semiconductor Manufacturing Co., Ltd. | Interconnect structure including a continuous conductive body |
US8735278B2 (en) * | 2012-07-17 | 2014-05-27 | Taiwan Semiconductor Manufactring Co., Ltd. | Copper etch scheme for copper interconnect structure |
WO2014013941A1 (ja) * | 2012-07-18 | 2014-01-23 | 東京エレクトロン株式会社 | 半導体装置の製造方法 |
US8765602B2 (en) | 2012-08-30 | 2014-07-01 | International Business Machines Corporation | Doping of copper wiring structures in back end of line processing |
JP5374779B1 (ja) * | 2013-02-12 | 2013-12-25 | 国立大学法人東北大学 | 太陽電池及び、この太陽電池における酸化物層の形成方法、積層酸化物層の形成方法 |
US9190321B2 (en) | 2013-04-08 | 2015-11-17 | International Business Machines Corporation | Self-forming embedded diffusion barriers |
TWI609095B (zh) * | 2013-05-30 | 2017-12-21 | 應用材料股份有限公司 | 用於氮化錳整合之方法 |
JP2015079901A (ja) * | 2013-10-18 | 2015-04-23 | 株式会社東芝 | 半導体装置及び半導体装置の製造方法 |
US20150155313A1 (en) | 2013-11-29 | 2015-06-04 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device |
JP5735093B1 (ja) | 2013-12-24 | 2015-06-17 | 株式会社マテリアル・コンセプト | 太陽電池及びその製造方法 |
JP5694503B2 (ja) * | 2013-12-27 | 2015-04-01 | Jx日鉱日石金属株式会社 | 自己拡散抑制機能を有するシード層及び自己拡散抑制機能を備えたシード層の形成方法 |
US9263389B2 (en) | 2014-05-14 | 2016-02-16 | International Business Machines Corporation | Enhancing barrier in air gap technology |
US9613906B2 (en) * | 2014-06-23 | 2017-04-04 | GlobalFoundries, Inc. | Integrated circuits including modified liners and methods for fabricating the same |
US9455182B2 (en) | 2014-08-22 | 2016-09-27 | International Business Machines Corporation | Interconnect structure with capping layer and barrier layer |
US9425093B2 (en) * | 2014-12-05 | 2016-08-23 | Tokyo Electron Limited | Copper wiring forming method, film forming system, and storage medium |
JP6484490B2 (ja) * | 2015-04-10 | 2019-03-13 | ルネサスエレクトロニクス株式会社 | 半導体装置およびその製造方法 |
US9842805B2 (en) | 2015-09-24 | 2017-12-12 | International Business Machines Corporation | Drive-in Mn before copper plating |
US10229851B2 (en) | 2016-08-30 | 2019-03-12 | International Business Machines Corporation | Self-forming barrier for use in air gap formation |
US10204829B1 (en) | 2018-01-12 | 2019-02-12 | International Business Machines Corporation | Low-resistivity metallic interconnect structures with self-forming diffusion barrier layers |
US10840325B2 (en) | 2018-04-11 | 2020-11-17 | International Business Machines Corporation | Low resistance metal-insulator-metal capacitor electrode |
US11133216B2 (en) | 2018-06-01 | 2021-09-28 | International Business Machines Corporation | Interconnect structure |
JP7652560B2 (ja) | 2020-12-16 | 2025-03-27 | キオクシア株式会社 | 半導体記憶装置、半導体装置およびその製造方法 |
JP7589431B2 (ja) | 2021-02-08 | 2024-11-26 | マクダーミッド エンソン インコーポレイテッド | 拡散バリア形成のための方法及び湿式化学組成物 |
Family Cites Families (28)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0262035A (ja) | 1988-08-29 | 1990-03-01 | Nippon Telegr & Teleph Corp <Ntt> | 半導体装置 |
US5130274A (en) | 1991-04-05 | 1992-07-14 | International Business Machines Corporation | Copper alloy metallurgies for VLSI interconnection structures |
JPH0547760A (ja) | 1991-08-12 | 1993-02-26 | Hitachi Ltd | 半導体集積回路装置、その製造方法およびその製造に用いるスパツタターゲツト |
KR960004095B1 (en) | 1993-02-17 | 1996-03-26 | Hyundai Electronics Ind | Manufacturing method of metal plug in contact-hole |
JP3294041B2 (ja) | 1994-02-21 | 2002-06-17 | 株式会社東芝 | 半導体装置 |
JPH08115914A (ja) | 1994-10-14 | 1996-05-07 | Hitachi Ltd | 半導体装置 |
US6387805B2 (en) | 1997-05-08 | 2002-05-14 | Applied Materials, Inc. | Copper alloy seed layer for copper metallization |
JPH1187349A (ja) | 1997-07-16 | 1999-03-30 | Mitsubishi Electric Corp | 半導体装置の製造方法及び半導体装置 |
JP2944589B2 (ja) | 1997-09-09 | 1999-09-06 | 埼玉日本電気株式会社 | Cob実装基板及び該基板へのicチップ実装方法 |
JPH11186273A (ja) | 1997-12-19 | 1999-07-09 | Ricoh Co Ltd | 半導体装置及びその製造方法 |
JP3177968B2 (ja) | 1998-12-04 | 2001-06-18 | 日本電気株式会社 | 半導体装置及びその製造方法 |
JP4155372B2 (ja) | 1999-03-08 | 2008-09-24 | 株式会社トリケミカル研究所 | 配線膜形成方法 |
JP2001044156A (ja) | 1999-07-26 | 2001-02-16 | Nec Corp | 半導体装置の製造方法及び化学研磨装置 |
JP2001053023A (ja) | 1999-08-11 | 2001-02-23 | Tokyo Electron Ltd | 半導体装置の製造方法及び製造装置 |
CN1425196A (zh) | 1999-11-24 | 2003-06-18 | 霍尼韦尔国际公司 | 导电互连 |
JP2002026568A (ja) | 2000-07-10 | 2002-01-25 | Kumagai Gumi Co Ltd | シート材 |
US6900321B2 (en) * | 2000-11-07 | 2005-05-31 | Symyx Technologies, Inc. | Substituted pyridyl amine complexes, and catalysts |
US20020081845A1 (en) * | 2000-12-27 | 2002-06-27 | Novellus Systems, Inc. | Method for the formation of diffusion barrier |
JP2003142579A (ja) | 2001-11-07 | 2003-05-16 | Hitachi Ltd | 半導体装置の製造方法および半導体装置 |
US6664185B1 (en) * | 2002-04-25 | 2003-12-16 | Advanced Micro Devices, Inc. | Self-aligned barrier formed with an alloy having at least two dopant elements for minimized resistance of interconnect |
US7008872B2 (en) * | 2002-05-03 | 2006-03-07 | Intel Corporation | Use of conductive electrolessly deposited etch stop layers, liner layers and via plugs in interconnect structures |
US6706629B1 (en) * | 2003-01-07 | 2004-03-16 | Taiwan Semiconductor Manufacturing Company | Barrier-free copper interconnect |
US7271103B2 (en) * | 2003-10-17 | 2007-09-18 | Taiwan Semiconductor Manufacturing Co., Ltd. | Surface treated low-k dielectric as diffusion barrier for copper metallization |
US7078336B2 (en) * | 2003-11-19 | 2006-07-18 | Taiwan Semiconductor Manufacturing Co., Ltd. | Method and system for fabricating a copper barrier layer with low dielectric constant and leakage current |
US6998343B1 (en) * | 2003-11-24 | 2006-02-14 | Lsi Logic Corporation | Method for creating barrier layers for copper diffusion |
JP4478038B2 (ja) | 2004-02-27 | 2010-06-09 | 株式会社半導体理工学研究センター | 半導体装置及びその製造方法 |
JP2009135139A (ja) | 2007-11-28 | 2009-06-18 | Toshiba Corp | 半導体装置及びその製造方法 |
JP2009147137A (ja) | 2007-12-14 | 2009-07-02 | Toshiba Corp | 半導体装置およびその製造方法 |
-
2005
- 2005-02-03 JP JP2005027756A patent/JP4478038B2/ja not_active Expired - Lifetime
- 2005-02-24 TW TW094105650A patent/TWI264046B/zh active
- 2005-02-24 KR KR1020050015478A patent/KR100693960B1/ko active IP Right Grant
- 2005-02-24 US US11/063,876 patent/US7304384B2/en not_active Expired - Lifetime
-
2007
- 2007-10-23 US US11/877,243 patent/US7943517B2/en active Active
-
2011
- 2011-04-14 US US13/087,026 patent/US8133813B2/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
KR20060042167A (ko) | 2006-05-12 |
US20080057704A1 (en) | 2008-03-06 |
US20110189849A1 (en) | 2011-08-04 |
US7304384B2 (en) | 2007-12-04 |
JP2005277390A (ja) | 2005-10-06 |
TW200534333A (en) | 2005-10-16 |
US8133813B2 (en) | 2012-03-13 |
US7943517B2 (en) | 2011-05-17 |
KR100693960B1 (ko) | 2007-03-12 |
US20050218519A1 (en) | 2005-10-06 |
TWI264046B (en) | 2006-10-11 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4478038B2 (ja) | 半導体装置及びその製造方法 | |
JP4832807B2 (ja) | 半導体装置 | |
US7651943B2 (en) | Forming diffusion barriers by annealing copper alloy layers | |
JP4819501B2 (ja) | 配線構造およびその製造方法 | |
JP3057054B2 (ja) | 銅線の多層相互接続を形成する方法 | |
JP4741965B2 (ja) | 半導体装置およびその製造方法 | |
JP5089244B2 (ja) | 半導体装置 | |
US20080280151A1 (en) | Copper diffusion barrier | |
JP2007027259A (ja) | 半導体装置の製造方法及び半導体装置 | |
US10431542B2 (en) | Low resistance seed enhancement spacers for voidless interconnect structures | |
US20100151672A1 (en) | Methods of forming metal interconnection structures | |
CN102246293A (zh) | 具有改进的电介质线路到过孔的抗电迁移性界面层的互连结构及其制造方法 | |
KR100426904B1 (ko) | 전극간의 접속 구조 및 그 제조 방법 | |
JP2009147137A (ja) | 半導体装置およびその製造方法 | |
JP2009026989A (ja) | 半導体装置及び半導体装置の製造方法 | |
TWI423412B (zh) | 半導體裝置 | |
JP2007059660A (ja) | 半導体装置の製造方法および半導体装置 | |
CN100380627C (zh) | 半导体器件及其制造方法 | |
US8536704B2 (en) | Semiconductor device and method for fabricating the same | |
JP2008071850A (ja) | 半導体装置の製造方法 | |
JP2007335578A (ja) | 半導体装置及びその製造方法 | |
JP4786680B2 (ja) | 半導体装置の製造方法 | |
JP3959389B2 (ja) | 半導体装置 | |
US20040155349A1 (en) | Semiconductor device and method of fabricating the same | |
KR100613391B1 (ko) | 반도체 소자의 금속 증착 방법 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20080206 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20080520 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20080722 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20090224 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20090420 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20090929 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20091112 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20100302 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20100312 |
|
R150 | Certificate of patent or registration of utility model |
Ref document number: 4478038 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130319 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140319 Year of fee payment: 4 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313113 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |