JP3257259B2 - データ抽出装置 - Google Patents
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- 238000013075 data extraction Methods 0.000 title claims description 11
- 238000005070 sampling Methods 0.000 claims description 21
- 230000001360 synchronised effect Effects 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 12
- 238000000034 method Methods 0.000 description 4
- 238000001514 detection method Methods 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N7/00—Television systems
- H04N7/025—Systems for the transmission of digital non-picture data, e.g. of text during the active part of a television frame
- H04N7/035—Circuits for the digital non-picture data signal, e.g. for slicing of the data signal, for regeneration of the data-clock signal, for error detection or correction of the data signal
-
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04N7/00—Television systems
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
- H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
- H03L7/095—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal using a lock detector
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- Engineering & Computer Science (AREA)
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Description
【０００１】
【産業上の利用分野】この発明は、Ｖブランキング区間
に挿入されている各種データを抽出するデータ抽出装置
である。
に挿入されている各種データを抽出するデータ抽出装置
である。
【０００２】
【従来の技術】テレビジョン信号のＶブランキング区間
には、文字放送用の信号やアスペクト比等の映像付加情
報のＩＤ信号等が挿入されている。これらの信号をデコ
ードすることにより、ユーザは各種のサービスを受けら
れるようになっている。Ｖブランキング区間に挿入され
ているこれらのデータは、その種類により挿入されてい
るライン番号が異なる。各サービスに対応したデータを
デコードするために、ユーザは、サービスの種類に対応
した数のデコーダを用意しなければならない。
には、文字放送用の信号やアスペクト比等の映像付加情
報のＩＤ信号等が挿入されている。これらの信号をデコ
ードすることにより、ユーザは各種のサービスを受けら
れるようになっている。Ｖブランキング区間に挿入され
ているこれらのデータは、その種類により挿入されてい
るライン番号が異なる。各サービスに対応したデータを
デコードするために、ユーザは、サービスの種類に対応
した数のデコーダを用意しなければならない。
【０００３】この問題を解決するために、汎用デコーダ
が知られている。この汎用デコーダでは、Ｖブランキン
グ区間の異なるラインに挿入されている各種のデータを
デコードすることができる。図５は、Ｖブランキング区
間の波形図及びロックフラグの波形図である。図５Ａに
示されるようなテレビジョン信号のＶブランキング区間
内にデータＡが挿入されている。データＡは、デコーダ
内のメモリに取り込まれる。また、Ｖブランキング区間
が終了したら、デコードしたデータが読み出され、コン
トローラで所定の処理が行われる。データをメモリに取
り込む場合、ＰＬＬ回路がロックしていなければ、デー
タＡを正しくサンプリングすることができない。このた
め、ＰＬＬ回路のロック状態を確認するために、ロック
フラグが参照される。ロックフラグの波形が図５Ｂに示
される。ロックフラグは、ＰＬＬ回路で形成されたサン
プリングクロックが正しいものであるか否かを示すフラ
グである。ここで、ロックフラグは、単に現在のＰＬＬ
回路のロック状態を表すものとする。また、ロックして
いる時にはそのレベルがＨレベル、ロックしていない時
にはそのレベルがＬレベルとされる。
が知られている。この汎用デコーダでは、Ｖブランキン
グ区間の異なるラインに挿入されている各種のデータを
デコードすることができる。図５は、Ｖブランキング区
間の波形図及びロックフラグの波形図である。図５Ａに
示されるようなテレビジョン信号のＶブランキング区間
内にデータＡが挿入されている。データＡは、デコーダ
内のメモリに取り込まれる。また、Ｖブランキング区間
が終了したら、デコードしたデータが読み出され、コン
トローラで所定の処理が行われる。データをメモリに取
り込む場合、ＰＬＬ回路がロックしていなければ、デー
タＡを正しくサンプリングすることができない。このた
め、ＰＬＬ回路のロック状態を確認するために、ロック
フラグが参照される。ロックフラグの波形が図５Ｂに示
される。ロックフラグは、ＰＬＬ回路で形成されたサン
プリングクロックが正しいものであるか否かを示すフラ
グである。ここで、ロックフラグは、単に現在のＰＬＬ
回路のロック状態を表すものとする。また、ロックして
いる時にはそのレベルがＨレベル、ロックしていない時
にはそのレベルがＬレベルとされる。
【０００４】
【発明が解決しようとする課題】実際のデータ処理は、
Ｖブランキング区間終了後に行われる。また、ロックフ
ラグの参照は、Ｖブランキング区間以降になされる。こ
のため、ロックフラグを参照した時点でのＰＬＬのロッ
ク状態がわかるだけであり、Ｖブランキング区間中のロ
ック状態を知ることはできない。例えば、図５Ａにおい
て、データＡをサンプリングした時にＰＰＬ回路がアン
ロック状態であって、ロックフラグ参照の前にＰＬＬ回
路がロック状態になった場合には、データＡが正しくサ
ンプリングされていないのにもかかわらず、データ処理
が行われてしまう。
Ｖブランキング区間終了後に行われる。また、ロックフ
ラグの参照は、Ｖブランキング区間以降になされる。こ
のため、ロックフラグを参照した時点でのＰＬＬのロッ
ク状態がわかるだけであり、Ｖブランキング区間中のロ
ック状態を知ることはできない。例えば、図５Ａにおい
て、データＡをサンプリングした時にＰＰＬ回路がアン
ロック状態であって、ロックフラグ参照の前にＰＬＬ回
路がロック状態になった場合には、データＡが正しくサ
ンプリングされていないのにもかかわらず、データ処理
が行われてしまう。
【０００５】このようなデータ処理を防止するために、
Ｖブランキング区間中に常にロックフラグを参照し続け
るか、それぞれのデータ毎にその時にＰＬＬがかかって
いたか否かを判定するためのフラグが必要となる。しか
し、このような方法では、処理が複雑になってしまう。
Ｖブランキング区間中に常にロックフラグを参照し続け
るか、それぞれのデータ毎にその時にＰＬＬがかかって
いたか否かを判定するためのフラグが必要となる。しか
し、このような方法では、処理が複雑になってしまう。
【０００６】従って、この発明の目的は、正しいサンプ
リングクロックでサンプリングされたデータのみをデコ
ードすることのできるデータ抽出装置を提供することに
ある。
リングクロックでサンプリングされたデータのみをデコ
ードすることのできるデータ抽出装置を提供することに
ある。
【０００７】
【課題を解決するための手段】この発明は、ビデオ信号
の所定区間に重畳されたデータを抽出するデータ抽出装
置であって、ビデオ信号中の同期信号にロックしたサン
プリングクロックを生成すると共に、上記サンプリング
クロックが上記同期信号に正しくロックしているか否か
を示すフラグを生成するＰＬＬ回路と、上記サンプリン
グクロックでサンプリングされた上記データを格納する
メモリとからなり、フラグの状態に基づいて、サンプリ
ングされたデータを有効または無効とするデータ抽出装
置である。
の所定区間に重畳されたデータを抽出するデータ抽出装
置であって、ビデオ信号中の同期信号にロックしたサン
プリングクロックを生成すると共に、上記サンプリング
クロックが上記同期信号に正しくロックしているか否か
を示すフラグを生成するＰＬＬ回路と、上記サンプリン
グクロックでサンプリングされた上記データを格納する
メモリとからなり、フラグの状態に基づいて、サンプリ
ングされたデータを有効または無効とするデータ抽出装
置である。
【０００８】
【作用】ＰＰＬ回路５で、ビデオ信号中の同期信号にロ
ックしたサンプリングクロックを生成すると共に、ＰＬ
Ｌ回路５のロック状態を示すロックフラグを生成する。
Ｖブランキング区間のデータは、このサンプリングクロ
ックでサンプリングされ、メモリ７に格納される。コン
トローラ２は、ロックフラグの状態を検出する。ロック
フラグがＨレベルの時にメモリ７に格納されたデータが
有効とされ、Ｌレベルの時に無効とされる。
ックしたサンプリングクロックを生成すると共に、ＰＬ
Ｌ回路５のロック状態を示すロックフラグを生成する。
Ｖブランキング区間のデータは、このサンプリングクロ
ックでサンプリングされ、メモリ７に格納される。コン
トローラ２は、ロックフラグの状態を検出する。ロック
フラグがＨレベルの時にメモリ７に格納されたデータが
有効とされ、Ｌレベルの時に無効とされる。
【０００９】
【実施例】以下、この発明によるデータ抽出装置に関し
て図面を参照して説明する。図１は、データ抽出装置の
ブロック図である。データ抽出装置は、Ｖブランキング
汎用デコーダ１及びコントローラ２からなる。Ｖブラン
キング汎用デコーダ１のシンクセパレータ３及びサンプ
リング回路４にビデオデータが供給される。シンクセパ
レータ３では、ビデオデータ中のＨシンク及Ｖシンクが
分離される。このＨシンク及びＶシンクは、ＰＬＬ回路
５に供給される。一方、コントローラ２により、サンプ
リングクロック周波数やライン番号等のパラメータ設定
が行われる。パラメータ設定値は、レジスタ６に供給さ
れる。
て図面を参照して説明する。図１は、データ抽出装置の
ブロック図である。データ抽出装置は、Ｖブランキング
汎用デコーダ１及びコントローラ２からなる。Ｖブラン
キング汎用デコーダ１のシンクセパレータ３及びサンプ
リング回路４にビデオデータが供給される。シンクセパ
レータ３では、ビデオデータ中のＨシンク及Ｖシンクが
分離される。このＨシンク及びＶシンクは、ＰＬＬ回路
５に供給される。一方、コントローラ２により、サンプ
リングクロック周波数やライン番号等のパラメータ設定
が行われる。パラメータ設定値は、レジスタ６に供給さ
れる。
【００１０】Ｈシンク及びＶシンクが供給されたＰＬＬ
回路５に対して、レジスタ６からパラメータ設定値が供
給される。ＰＬＬ回路５は、このパラメータ設定値にし
たがって、シンクにロックしたサンプリングクロックを
生成する。サンプリングクロックは、サンプリング回路
４に供給される。また、サンプリング回路４には、レジ
スタ６からパラメータ設定値が供給される。サンプリン
グ回路４では、サンプリングクロック及びパラメータ設
定値に基づいて、パラメータで指定されたラインのデー
タを指定されたビット数サンプリングする。サンプリン
グ回路４でサンプリングされたデータは、メモリ７に格
納される。格納されたデータは、コントローラ２により
読み出される。
回路５に対して、レジスタ６からパラメータ設定値が供
給される。ＰＬＬ回路５は、このパラメータ設定値にし
たがって、シンクにロックしたサンプリングクロックを
生成する。サンプリングクロックは、サンプリング回路
４に供給される。また、サンプリング回路４には、レジ
スタ６からパラメータ設定値が供給される。サンプリン
グ回路４では、サンプリングクロック及びパラメータ設
定値に基づいて、パラメータで指定されたラインのデー
タを指定されたビット数サンプリングする。サンプリン
グ回路４でサンプリングされたデータは、メモリ７に格
納される。格納されたデータは、コントローラ２により
読み出される。
【００１１】ＰＬＬ回路５はロックしている時に、レジ
スタ６にロック状態を示すＨレベルのロックフラグを出
力する。Ｈレベルのロックフラグの場合には、メモリ７
に格納されたデータが有効とされる。また、このロック
フラグは、レジスタ６からコントローラ２に出力され
る。これにより、コントローラ２は、メモリ７から読み
出したＶブランキング区間のデータが正しいクロックで
サンプリングされたことを確認することができる。な
お、ＰＬＬ回路５がシンクにロックしていない時には正
しいサンプリングクロックが生成されない。従って、Ｐ
ＬＬ回路５からは、Ｌレベルのロックフラグがレジスタ
６に出力される。Ｌレベルのロックフラグの場合には、
メモリ７に格納されたデータが無効とされる。Ｖブラン
キング区間が終了すると、Ｖブランキング終了データが
Ｖブランキング汎用デコーダ１からコントローラ２に供
給される。
スタ６にロック状態を示すＨレベルのロックフラグを出
力する。Ｈレベルのロックフラグの場合には、メモリ７
に格納されたデータが有効とされる。また、このロック
フラグは、レジスタ６からコントローラ２に出力され
る。これにより、コントローラ２は、メモリ７から読み
出したＶブランキング区間のデータが正しいクロックで
サンプリングされたことを確認することができる。な
お、ＰＬＬ回路５がシンクにロックしていない時には正
しいサンプリングクロックが生成されない。従って、Ｐ
ＬＬ回路５からは、Ｌレベルのロックフラグがレジスタ
６に出力される。Ｌレベルのロックフラグの場合には、
メモリ７に格納されたデータが無効とされる。Ｖブラン
キング区間が終了すると、Ｖブランキング終了データが
Ｖブランキング汎用デコーダ１からコントローラ２に供
給される。
【００１２】図２は、ＰＬＬ回路５からレジスタ６にロ
ックフラグを出力するためのロック状態検出回路のブロ
ック図である。この回路は、アンドゲート１３、ノット
ゲート１４及びＤフリップフロップ１５からなる。アン
ドゲート１３の一方の入力端子１１からは、ロック状態
を示すロックステータスフラグが入力される。これと共
に、ロックステータスフラグは、ノットゲート１４に供
給される。アンドゲート１３の他方の入力端子１２から
は、ビデオデータ中のＶシンクが入力される。アンドゲ
ート１３の反転出力は、Ｄフリップフロップ１５のセッ
ト端子Ｓｅｔに供給される。一方、ノットゲート１４の
出力は、Ｄフリップフロップ１５のリセット端子Ｒｅｓ
ｅｔに供給される。Ｄフリップフロップ１５のＤ出力端
子から、ロックフラグがレジスタ（図示せず）に出力さ
れる。
ックフラグを出力するためのロック状態検出回路のブロ
ック図である。この回路は、アンドゲート１３、ノット
ゲート１４及びＤフリップフロップ１５からなる。アン
ドゲート１３の一方の入力端子１１からは、ロック状態
を示すロックステータスフラグが入力される。これと共
に、ロックステータスフラグは、ノットゲート１４に供
給される。アンドゲート１３の他方の入力端子１２から
は、ビデオデータ中のＶシンクが入力される。アンドゲ
ート１３の反転出力は、Ｄフリップフロップ１５のセッ
ト端子Ｓｅｔに供給される。一方、ノットゲート１４の
出力は、Ｄフリップフロップ１５のリセット端子Ｒｅｓ
ｅｔに供給される。Ｄフリップフロップ１５のＤ出力端
子から、ロックフラグがレジスタ（図示せず）に出力さ
れる。
【００１３】図３は、この発明によるデータ抽出装置に
より得られるロックフラグの波形図である。なお、この
ロックフラグの波形を説明するために、Ｖブランキング
区間の波形図及びＰＬＬ回路のロック状態を示す波形図
が記されている。図３Ａに示すようなＶブランキング区
間のＶシンクに対してＰＬＬ回路が図３Ｂに示すように
ロックしている場合には、ロックフラグがＶシンクの開
始点でＨレベルとされる。Ｖブランキング区間におい
て、ＰＬＬ回路のロックがはずれると、これに同期し
て、ロックフラグがＬレベルとなる。これにより、Ｄフ
リップフロップのＤ端子から出力されるデータは、Ｌレ
ベルとなる。
より得られるロックフラグの波形図である。なお、この
ロックフラグの波形を説明するために、Ｖブランキング
区間の波形図及びＰＬＬ回路のロック状態を示す波形図
が記されている。図３Ａに示すようなＶブランキング区
間のＶシンクに対してＰＬＬ回路が図３Ｂに示すように
ロックしている場合には、ロックフラグがＶシンクの開
始点でＨレベルとされる。Ｖブランキング区間におい
て、ＰＬＬ回路のロックがはずれると、これに同期し
て、ロックフラグがＬレベルとなる。これにより、Ｄフ
リップフロップのＤ端子から出力されるデータは、Ｌレ
ベルとなる。
【００１４】即ち、Ｖブランキング区間中にＰＬＬがは
ずれた場合、ロックフラグがＬレベルに保持されたまま
となるので、Ｖブランキング区間終了後にロックフラグ
を参照しても、ＰＬＬがＶブランキング区間中にはずれ
たということを認識することができる。また、Ｖブラン
キング区間終了後、ロックフラグを参照した時点で、ロ
ックフラグがＨレベルであれば、Ｖブランキング区間で
常にＰＬＬがかかっていたことが保証される。従って、
ＰＬＬがロックした状態で、正しくサンプリングされた
データのみを処理することができる。
ずれた場合、ロックフラグがＬレベルに保持されたまま
となるので、Ｖブランキング区間終了後にロックフラグ
を参照しても、ＰＬＬがＶブランキング区間中にはずれ
たということを認識することができる。また、Ｖブラン
キング区間終了後、ロックフラグを参照した時点で、ロ
ックフラグがＨレベルであれば、Ｖブランキング区間で
常にＰＬＬがかかっていたことが保証される。従って、
ＰＬＬがロックした状態で、正しくサンプリングされた
データのみを処理することができる。
【００１５】図４は、データ抽出装置のＶブランキング
区間終了後の動作に関するフローチャートである。コン
トローラ２によりＶブランキング区間が終了したか否か
がステップ２１で判断される。Ｖブランキング区間が終
了していないならば、ＰＬＬ回路５からレジスタ６に供
給されるロックフラグがＨレベルに設定された後（ステ
ップ２５）、ステップ２１に戻る。一方、ステップ２２
でＶブランキング区間が終了したと判断されたならば、
ステップ２２に進む。ステップ２２では、ＰＬＬ回路５
がロックしているか否か（ロックフラグがＨレベルであ
るか否か）が判断される。ロックフラグがＨレベルでな
いならば、Ｖブランキング区間にＰＬＬのロックがはず
れたことになるので、処理は終了する。一方、ステップ
２２において、ロックフラグがＨレベルであると判断さ
れたならば、メモリ７に書き込まれたデータが読み出さ
れ（ステップ２３）、所定のデータ処理が行われる（ス
テップ２４）。
区間終了後の動作に関するフローチャートである。コン
トローラ２によりＶブランキング区間が終了したか否か
がステップ２１で判断される。Ｖブランキング区間が終
了していないならば、ＰＬＬ回路５からレジスタ６に供
給されるロックフラグがＨレベルに設定された後（ステ
ップ２５）、ステップ２１に戻る。一方、ステップ２２
でＶブランキング区間が終了したと判断されたならば、
ステップ２２に進む。ステップ２２では、ＰＬＬ回路５
がロックしているか否か（ロックフラグがＨレベルであ
るか否か）が判断される。ロックフラグがＨレベルでな
いならば、Ｖブランキング区間にＰＬＬのロックがはず
れたことになるので、処理は終了する。一方、ステップ
２２において、ロックフラグがＨレベルであると判断さ
れたならば、メモリ７に書き込まれたデータが読み出さ
れ（ステップ２３）、所定のデータ処理が行われる（ス
テップ２４）。
【００１６】
【発明の効果】この発明に依れば、Ｖブランキング区間
中にＰＬＬがはずれた場合、ロックフラグがＬレベルの
ままとされるので、Ｖブランキング区間終了後にロック
フラグを参照しても、データが正しいサンプリングクロ
ックでサンプリングされなかったことを知ることができ
る。また、Ｖブランキング区間終了後にロックフラグを
参照して、Ｈレベルだった場合には、Ｖブランキング区
間で常にＰＬＬがロックされていたことを保証すること
ができる。従って、ＰＬＬがかかった状態で、正しくサ
ンプリングされたデータのみを処理することができる。
中にＰＬＬがはずれた場合、ロックフラグがＬレベルの
ままとされるので、Ｖブランキング区間終了後にロック
フラグを参照しても、データが正しいサンプリングクロ
ックでサンプリングされなかったことを知ることができ
る。また、Ｖブランキング区間終了後にロックフラグを
参照して、Ｈレベルだった場合には、Ｖブランキング区
間で常にＰＬＬがロックされていたことを保証すること
ができる。従って、ＰＬＬがかかった状態で、正しくサ
ンプリングされたデータのみを処理することができる。
【図１】この発明によるデータ抽出装置のブロック図で
ある。
ある。
【図２】ロック状態検出回路のブロック図である。
【図３】データ抽出装置により得られるロックフラグの
波形図である。
波形図である。
【図４】データ抽出装置のＶブランキング区間後の動作
に関するフローチャートである。
に関するフローチャートである。
【図５】従来の技術の説明に用いるＶブランキング区間
の波形図及びロックフラグの波形図である。
の波形図及びロックフラグの波形図である。
５ ＰＬＬ回路 ７ メモリ １５ Ｄフリップフロップ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 土屋 聡 東京都品川区北品川６丁目７番35号 ソ ニー株式会社内 (56)参考文献 特開 平３−32182（ＪＰ，Ａ) 特開 昭59−194586（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H04N 7/00 - 7/088
Claims (2)
- 【請求項１】 ビデオ信号のＶブランキング区間に重畳
されたデータを抽出するデータ抽出装置であって、 上記ビデオ信号中の同期信号にロックしたサンプリング
クロックを生成すると共に、上記サンプリングクロック
が上記同期信号に正しくロックしているか否かを示すフ
ラグを生成するＰＬＬ回路と、 上記サンプルクロックでサンプリングされた上記データ
を格納するメモリと、Ｖブランキング区間中、上記サン
プリングクロックが上記同期信号に正しくロックしてな
いことを上記フラグが示す場合に、垂直同期信号の開始
時点まで上記正しくロックしていないことを示すフラグ
の状態を保つ状態保持手段とからなり、 上記状態保持手段に保持された上記フラグの状態に基づ
いて、サンプリング終了後上記サンプリングされたデー
タを有効または無効とするデータ抽出装置。 - 【請求項２】 上記ＰＬＬ回路が同期信号に同期してい
る場合に、ビデオ信号の垂直同期信号に基づいて上記保
持手段が保持した上記正しくロックしてないことを示す
上記フラグの状態を初期化することを特徴とする請求項
１に記載のデータ抽出装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17351794A JP3257259B2 (ja) | 1994-07-01 | 1994-07-01 | データ抽出装置 |
| US08/497,441 US5598219A (en) | 1994-07-01 | 1995-06-30 | Data extracting apparatus for validating data multiplexed in a video signal |
| KR1019950019432A KR100368188B1 (ko) | 1994-07-01 | 1995-07-01 | 데이타추출장치 |
| EP95304648A EP0690620A3 (en) | 1994-07-01 | 1995-07-03 | Data extracting apparatus |
| CA002153214A CA2153214C (en) | 1994-07-01 | 1995-07-04 | Data extracting apparatus for validating data multiplexed in a video signal |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17351794A JP3257259B2 (ja) | 1994-07-01 | 1994-07-01 | データ抽出装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0818931A JPH0818931A (ja) | 1996-01-19 |
| JP3257259B2 true JP3257259B2 (ja) | 2002-02-18 |
Family
ID=15961999
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17351794A Expired - Fee Related JP3257259B2 (ja) | 1994-07-01 | 1994-07-01 | データ抽出装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5598219A (ja) |
| EP (1) | EP0690620A3 (ja) |
| JP (1) | JP3257259B2 (ja) |
| KR (1) | KR100368188B1 (ja) |
| CA (1) | CA2153214C (ja) |
Families Citing this family (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH1013796A (ja) * | 1996-06-25 | 1998-01-16 | Mitsubishi Electric Corp | 文字多重データサンプリング回路 |
| US5812207A (en) * | 1996-12-20 | 1998-09-22 | Intel Corporation | Method and apparatus for supporting variable oversampling ratios when decoding vertical blanking interval data |
| JP2000197016A (ja) * | 1998-12-24 | 2000-07-14 | Toshiba Ave Co Ltd | データ抽出回路 |
| JP2000286703A (ja) * | 1999-03-30 | 2000-10-13 | Fujitsu Ltd | リセット回路及びｐｌｌ周波数シンセサイザ |
| JP2000298447A (ja) * | 1999-04-12 | 2000-10-24 | Nec Shizuoka Ltd | 画素同期回路 |
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