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JP2800500B2 - バースト送信出力制御回路 - Google Patents

バースト送信出力制御回路

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JP2800500B2
JP2800500B2 JP3253354A JP25335491A JP2800500B2 JP 2800500 B2 JP2800500 B2 JP 2800500B2 JP 3253354 A JP3253354 A JP 3253354A JP 25335491 A JP25335491 A JP 25335491A JP 2800500 B2 JP2800500 B2 JP 2800500B2
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JP
Japan
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burst
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裕昭 小杉
孝之 松本
貴志 榎
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Panasonic Corp
Panasonic Holdings Corp
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Panasonic Corp
Matsushita Electric Industrial Co Ltd
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Publication date
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    • H03—ELECTRONIC CIRCUITRY
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    • H03G3/00—Gain control in amplifiers or frequency changers
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    • H03G3/30—Automatic control in amplifiers having semiconductor devices
    • H03G3/3036—Automatic control in amplifiers having semiconductor devices in high-frequency amplifiers or in frequency-changers
    • H03G3/3042—Automatic control in amplifiers having semiconductor devices in high-frequency amplifiers or in frequency-changers in modulators, frequency-changers, transmitters or power amplifiers
    • H03G3/3047—Automatic control in amplifiers having semiconductor devices in high-frequency amplifiers or in frequency-changers in modulators, frequency-changers, transmitters or power amplifiers for intermittent signals, e.g. burst signals
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L27/00—Modulated-carrier systems
    • H04L27/32—Carrier systems characterised by combinations of two or more of the types covered by groups H04L27/02, H04L27/10, H04L27/18 or H04L27/26
    • H04L27/34—Amplitude- and phase-modulated carrier systems, e.g. quadrature-amplitude modulated carrier systems
    • H04L27/36—Modulator circuits; Transmitter circuits

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Transmitters (AREA)

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、振幅変動のある変調方
式を用いたディジタル自動車電話などのＴＤＭＡ無線機
の送信部に用いるバースト送信出力制御回路に関するも
のである。
【０００２】
【従来の技術】以下、従来のバースト送信出力制御回路
の一例について図面を参照しながら説明する。（図７）
は従来のバースト送信出力制御回路のブロック図を示す
ものであり、７１は入力レベル制御回路、７２は線形の
入出力特性を持つ増幅器、７３は制御信号発生回路、７
４はバイアス制御回路、７５は変調信号端子、７６は送
信出力端子、７７はバーストスイッチイング信号端子で
ある。
【０００３】以上のように構成された従来の送信出力制
御回路においては、バーストスイッチング制御端子７７
からのバーストスイッチング信号に同期してバイアス制
御回路７４が増幅器７２のバイアス電圧を制御すると共
に、バーストスイッチング信号に応じて制御信号発生回
路７３で発生するバースト制御信号に従って増幅器７２
への入力レベルを入力レベル制御回路７１で制御するこ
とによりバースト送信出力が得られる。
【０００４】
【発明が解決しようとする課題】しかしながら上記のよ
うな構成では、フィードフォワード制御で送信出力を制
御しているために温度特性などで増幅器の利得などが変
動した場合に送信出力レベルが変動するという問題を有
していた。
【０００５】本発明はかかる点に鑑み、サンプルホール
ド回路を持ったフィードバック制御により送信出力をバ
ースト状に制御することにより、素子のばらつきや温度
特性変動に強いバースト送信出力制御回路を提供するこ
とを目的とする。
【０００６】
【課題を解決するための手段】この目的を達成するため
に本発明は、送信出力の一部を包絡線検波し、その検波
信号とバースト制御信号を誤差検出回路で比較し、その
誤差信号をサンプルホールド信号に従ってサンプルホー
ルドするサンプルホールド回路を通して電力増幅器の利
得制御端子を制御する構成を用いる。
【０００７】
【作用】本発明は上記した構成により、素子のばらつき
や温度特性変動に対しても出力レベルの安定なバースト
状の送信出力を発生することができる。
【０００８】
【実施例】以下本発明の実施例について、図面を参照し
ながら説明する。
【０００９】（図１）、（図２）は本発明の第１の実施
例におけるバースト送信出力制御回路のブロック図及び
各信号のタイミングを示すタイミングチャートである。
（図１）において、１は変調信号を増幅する電力増幅
器、２は送信出力の一部を取り出す出力モニタ回路、３
はモニタ信号を包絡線検波する検波回路、４は検波信号
とバースト制御信号を比較して誤差電圧を発生する誤差
検出回路、５はサンプルホールド回路、６は変調信号端
子、７は送信出力端子、８はバースト制御信号端子、９
は電力増幅器１の利得制御端子、１０はサンプルホール
ド信号端子である。
【００１０】以上のように構成された第１の実施例のバ
ースト送信出力制御回路において、以下その動作を説明
する。
【００１１】（図２）のバースト立ち上げ区間での動作
をまず説明する。この時、変調信号端子６から出力され
る変調信号は振幅変動のない信号である。変調信号は、
電力増幅器１で増幅され出力モニタ回路２を介して送信
出力として送信出力端子７に接続されると共に、出力モ
ニタ回路２で送信出力の一部がモニタ信号として取り出
される。このモニタ信号は、検波回路３で包絡線検波さ
れ検波信号として出力される。この検波信号とバースト
制御信号端子８から出力されるバースト制御信号は誤差
検出回路４で比較されその誤差電圧が出力される。この
誤差電圧はサンプルホールド回路５の入力となるが、こ
の時サンプルホールド信号端子１０から出力されるサン
プルホールド信号はサンプル信号であるため、誤差電圧
はそのまま電力増幅器１の利得制御端子９に接続されフ
ィードバックループが形成される。一方、バースト制御
信号は滑らかに立ち上がる信号であるため、送信出力は
バースト制御信号に従ってフィードバック制御され滑ら
かに出力が立ち上がる。そして送信出力が立ち上がった
時にサンプルホールド信号をサンプル信号からホールド
信号に切り換えることにより、サンプルホールド回路は
その時の誤差電圧をホールドしフィードバックループが
切り放される。
【００１２】次に（図２）のバースト送信区間での動作
を説明する。この時、サンプルホールド信号はホールド
信号であるため利得制御端子９の電圧は一定に保たれる
ため、電力増幅器１の利得は一定であり、送信出力の平
均電力はバースト制御信号の立ち上がり後電圧に従って
常に安定な値をとる。バースト送信区間終了後サンプル
ホールド信号はサンプル信号となり、再びフィードバッ
クループが形成される。
【００１３】次に（図２）のバースト立ち下げ区間での
動作を説明する。この時、バースト立ち上げ区間と逆の
動作をすることにより送信出力は滑らかに立ち下がる。
【００１４】以上のようにこの実施例によればサンプル
ホールド回路によって出力制御フィードバックループを
入り切りすることにより、振幅変動のある変調方式にお
いてもバースト出力時の平均電力が安定であるととも
に、立ち上がり立ち下がりが滑らかで周波数領域での不
要な広がりを持たないバースト送信出力信号を実現でき
る。
【００１５】（図３）は、本発明の第２の実施例におけ
るバースト送信出力制御回路のブロック図である。な
お、（図３）において（図１）における装置及び信号等
と同一ないし均等のものは前記と同一符号を以て示し、
重複した説明を省略する。（図３）において、１１は第
２のバースト制御信号端子、１２は電力増幅器１の第２
の利得制御端子である。
【００１６】以上のように構成された第２の実施例のバ
ースト送信出力制御回路において、以下その動作を説明
する。
【００１７】第２のバースト制御信号端子１１から出力
されるバースト制御信号ｂによって電力増幅器１の第２
の利得制御端子１２を制御する。このバースト制御信号
ｂは第１のバースト制御信号端子８から出力されるバー
スト制御信号ａと同様にバースト立ち上げ区間に滑らか
に立ち上がり、バースト立ち下げ区間に滑らかに立ち下
がる。この制御によって送信出力の立ち上がり立ち下が
り波形のダイナミックレンジを大きくすることができる
とともに、より精密な制御が可能となる。さらに送信出
力レベルに応じてバースト制御信号ｂによる制御量を変
えることにより、送信出力レベルが変わった場合にもバ
ースト制御信号ａによるフィードバック制御を安定に動
作させることができる。
【００１８】（図４）、（図５）は、本発明の第３の実
施例におけるバースト送信出力制御回路のブロック図及
び各信号のタイミングを示すタイミングチャートであ
る。なお、（図４）、（図５）において（図１）、（図
２）における装置及び信号等と同一ないし均等のものは
前記と同一符号を以て示し、重複した説明を省略する。
（図４）において、１３はサンプルホールド回路５と電
力増幅器１の利得制御端子９の間に挿入された乗算器、
１４はバースト立ち下げ制御信号端子である。
【００１９】以上のように構成された第３の実施例のバ
ースト送信出力制御回路において、以下その動作を説明
する。
【００２０】（図５）のバースト立ち上げ区間及びバー
スト送信区間での動作をまず説明する。この時、バース
ト立ち下げ制御信号端子１４から出力されるバースト立
ち下げ制御信号は＋１であり他の信号は（図２）と同様
である。乗算器１３でこのバースト立ち下げ制御信号と
サンプルホールド回路５の出力は乗算されるが、バース
ト立ち下げ制御信号が＋１であるのでサンプルホールド
回路５の出力はそのまま出力される。即ちここでの動作
は（図２）と同様である。
【００２１】次に（図５）のバースト立ち下げ区間での
動作を説明する。この時、サンプルホールド信号はホー
ルド信号のまま維持される。よって、サンプルホールド
回路の出力はバースト送信区間と同じ電圧のままであ
る。一方、バースト立ち下げ制御信号は滑らかに立ち下
がる。乗算器１３では、この両者の信号が乗算されるた
めその出力は滑らかに立ち下がる信号となり、この出力
信号で電力増幅器１の利得制御端子９を制御することに
より結果として送信出力が滑らかに立ち下がる。この制
御により、サンプルホールド信号がホールド信号からサ
ンプル信号に切り換えた時に発生するリンギングを考慮
する必要がなく安定に立ち下げ動作を行うことが可能と
なる。
【００２２】（図６）は、本発明の第４の実施例におけ
るバースト送信出力制御回路の乗算器のブロック図であ
る。なお、（図６）において前記（図４）における装置
及び信号等と同一ないし均等のものは前記と同一符号を
以て示し、重複した説明を省略する。（図６）におい
て、１５はディジタル的に乗算動作を行うためのＤ／Ａ
コンバータ、１６はＤ／Ａコンバータ１５の出力の高調
波歪を除去するためのポストフィルタ、１７はＤ／Ａコ
ンバータ１５の基準電圧端子である。
【００２３】以上のように構成された第４の実施例のバ
ースト送信出力制御回路において、以下その動作を説明
する。
【００２４】Ｄ／Ａコンバータ１５の基準電圧端子１７
を入力端子とし、ディジタル信号のバースト立ち下げ制
御信号でＤ／Ａコンバータ１５を制御することによりデ
ィジタル的に乗算動作を行うことが出来る。さらにＤ／
Ａコンバータ１５の出力にポストフィルタ１６を設ける
ことにより、高調波歪のない乗算出力が得られる。この
構成によりアナログ乗算器では得られない安定な乗算動
作が実現でき、結果として非常に安定なバースト送信出
力立ち下げが可能となる。
【００２５】
【発明の効果】以上のように本発明は、送信出力の一部
を包絡線検波し、その検波信号とバースト制御信号を誤
差検出回路で比較し、その誤差信号をサンプルホールド
信号に従ってサンプルホールドするサンプルホールド回
路を通して電力増幅器の利得制御端子を制御するように
構成することにより、素子のばらつきや温度特性変動に
対しても出力レベルの安定なバースト状の送信出力を発
生することができる。
【図面の簡単な説明】
【図１】本発明の第１の実施例に係るバースト送信出力
制御回路のブロック図である。
【図２】本発明の第１の実施例に係るバースト送信出力
制御回路のタイミングチャートである。
【図３】本発明の第２の実施例に係るバースト送信出力
制御回路のブロック図である。
【図４】本発明の第３の実施例に係るバースト送信出力
制御回路のブロック図である。
【図５】本発明の第３の実施例に係るバースト送信出力
制御回路のタイミングチャートである。
【図６】本発明の第４の実施例に係るバースト送信出力
制御回路の乗算器のブロック図である。
【図７】従来のバースト送信出力制御回路のブロック図
である。
【符号の説明】 １ 電力増幅器 ２ 出力モニタ回路 ３ 検波回路 ４ 誤差検出回路 ５ サンプルホールド回路 ６ 変調信号端子 ７ 送信出力端子 ８ バースト制御信号端子 ９ 利得制御端子 １０ サンプルホールド信号端子 １１ 第２のバースト制御信号端子 １２ 第２の利得制御端子 １３ 乗算器 １４ バースト立ち下げ制御信号端子 １５ Ｄ／Ａコンバータ １６ ポストフィルタ ７１ 入力レベル制御回路 ７２ 増幅器 ７３ 制御信号発生回路 ７４ バイアス制御回路 ７５ 変調信号端子 ７６ 送信出力端子 ７７ バーストスイッチング信号端子
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭51−36812（ＪＰ，Ａ) 特開 昭51−27009（ＪＰ，Ａ) (58)調査した分野(Int.Cl.6，ＤＢ名) H04B 1/04

Claims (4)

    (57)【特許請求の範囲】
  1. 【請求項１】 バースト状に変調される変調信号を入力
    とし、少なくとも１つの利得制御端子を有する電力増幅
    器と、前記電力増幅器からの出力を送信出力として出力
    すると共に、その一部をモニタ出力として取り出す出力
    モニタ回路と、前記モニタ出力を包絡線検波して検波信
    号として出力する検波回路と、バースト制御信号と前記
    検波信号を比較して誤差電圧を出力する誤差検出回路
    と、サンプルホールド信号に従って前記誤差電圧をサン
    プルホールドするサンプルホールド回路と、前記サンプ
    ルホールド回路の出力を制御電圧として前記電力増幅器
    の利得制御端子に加える構成とし、 バースト立上げ区間では、前記サンプルホールド信号は
    サンプル信号で、前記バースト制御信号は滑らかに立上
    がる信号であり、バースト送信区間では、前記サンプル
    ホールド信号はホールド信号で、前記バースト制御信号
    はバースト立上げ区間で滑らかに立上がった後の値を保
    持し、バースト立下げ区間では、前記サンプルホールド
    信号はサンプル信号で、前記バースト制御信号は滑らか
    に立下がる信号である ことを特徴とするバースト送信出
    力制御回路。
  2. 【請求項２】 請求項１記載の利得制御端子とは別に設
    けられた電力増幅器の他の利得制御端子に、バースト制
    御信号を制御電圧として加える構成を付加し、 前記バー
    スト制御信号は、バースト立上げ区間では、滑らかに立
    上がる信号であり、バースト送信区間では、バースト立
    上げ区間で滑らかに立上がった後の値を保持し、バース
    ト立下げ区間では、滑らかに立下がる信号であり、 前記バースト送信区間で保持される値は、送信出力レベ
    ルに応じて変える ことを特徴とする請求項１記載のバー
    スト送信出力制御回路。
  3. 【請求項３】 サンプルホールド回路と電力増幅器の利
    得制御端子の間に乗算器を設け、バースト立下げ制御信
    号と前記サンプルホールド回路の出力を前記乗算器で乗
    算する構成を付加し、 バースト立上げ区間及びバースト送信区間では、前記バ
    ースト立下げ制御信号は＋１の値を保持し、バースト立
    下げ区間では、サンプルホールド信号をホールド信号と
    し、サンプルホールド回路をホールド状態のままで、前
    記バースト立下げ制御信号を滑らかに立下がる信号とす
    る ことを特徴とする請求項１または請求項２記載のバー
    スト送信出力制御回路。
  4. 【請求項４】 乗算器をＤ／Ａコンバータとポストフィ
    ルタで構成し、サンプルホールド回路の出力を前記Ｄ／
    Ａコンバータの基準電圧とし、ディジタル信号のバース
    ト立下げ制御信号で前記Ｄ／Ａコンバータを制御するこ
    とを特徴とする請求項３記載のバースト送信出力制御回
    路。
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