JP2010267895A - 部品内蔵配線基板の製造方法 - Google Patents
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- 238000004519 manufacturing process Methods 0.000 title claims abstract description 30
- 239000012792 core layer Substances 0.000 claims abstract description 101
- 229920005989 resin Polymers 0.000 claims abstract description 73
- 239000011347 resin Substances 0.000 claims abstract description 73
- 239000010410 layer Substances 0.000 claims abstract description 72
- 238000000034 method Methods 0.000 claims abstract description 46
- 238000007789 sealing Methods 0.000 claims abstract description 40
- 238000010030 laminating Methods 0.000 claims abstract description 16
- 238000009832 plasma treatment Methods 0.000 claims abstract description 5
- 238000010438 heat treatment Methods 0.000 claims description 16
- 239000002184 metal Substances 0.000 claims description 14
- 229910052751 metal Inorganic materials 0.000 claims description 14
- 229920001187 thermosetting polymer Polymers 0.000 claims description 14
- 238000003825 pressing Methods 0.000 claims description 8
- 239000002344 surface layer Substances 0.000 claims description 6
- 238000005304 joining Methods 0.000 claims description 4
- 238000004140 cleaning Methods 0.000 abstract description 19
- 230000007547 defect Effects 0.000 abstract description 2
- 229910000679 solder Inorganic materials 0.000 description 71
- 239000007789 gas Substances 0.000 description 24
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 10
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 8
- 239000011889 copper foil Substances 0.000 description 7
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 5
- 229910052786 argon Inorganic materials 0.000 description 5
- 230000004907 flux Effects 0.000 description 5
- 238000005476 soldering Methods 0.000 description 5
- 239000000758 substrate Substances 0.000 description 5
- 239000012190 activator Substances 0.000 description 4
- 239000011229 interlayer Substances 0.000 description 4
- MYMOFIZGZYHOMD-UHFFFAOYSA-N Dioxygen Chemical compound O=O MYMOFIZGZYHOMD-UHFFFAOYSA-N 0.000 description 3
- 238000004380 ashing Methods 0.000 description 3
- 239000002585 base Substances 0.000 description 3
- 239000012459 cleaning agent Substances 0.000 description 3
- 229910001882 dioxygen Inorganic materials 0.000 description 3
- 239000002253 acid Substances 0.000 description 2
- 239000003990 capacitor Substances 0.000 description 2
- 239000003822 epoxy resin Substances 0.000 description 2
- 229920000647 polyepoxide Polymers 0.000 description 2
- 239000004065 semiconductor Substances 0.000 description 2
- 239000003513 alkali Substances 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 229910052802 copper Inorganic materials 0.000 description 1
- 239000010949 copper Substances 0.000 description 1
- 238000001723 curing Methods 0.000 description 1
- 239000003989 dielectric material Substances 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 238000010348 incorporation Methods 0.000 description 1
- JEIPFZHSYJVQDO-UHFFFAOYSA-N iron(III) oxide Inorganic materials O=[Fe]O[Fe]=O JEIPFZHSYJVQDO-UHFFFAOYSA-N 0.000 description 1
- 238000003475 lamination Methods 0.000 description 1
- 239000007788 liquid Substances 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 238000002156 mixing Methods 0.000 description 1
- 231100000989 no adverse effect Toxicity 0.000 description 1
- 150000007524 organic acids Chemical class 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 238000001020 plasma etching Methods 0.000 description 1
- 238000007747 plating Methods 0.000 description 1
- 230000002265 prevention Effects 0.000 description 1
- 239000006104 solid solution Substances 0.000 description 1
- 239000000243 solution Substances 0.000 description 1
- 230000008016 vaporization Effects 0.000 description 1
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
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- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
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- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
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- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/16227—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a bond pad of the item
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
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- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
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Abstract
【解決手段】複数の配線層を積層して構成されコア層1にバンプ付きの電子部品7が実装された部品内蔵配線基板の製造において、部品搭載後のコア層1において電子部品7との隙間に樹脂を注入して硬化させて封止する樹脂封止工程後において、電子部品7が実装された実装面側をプラズマ処理することによって実装面側に形成された配線回路3の表面3bに生成した酸化膜3cを除去する方法を採用する。これにより、フリップチップ実装後のウェット洗浄を排することができ、ウエット洗浄に起因するバンプの接合性低下などの不良を防止して実装品質を確保することができる。
【選択図】図2
Description
部品内蔵配線基板の製造方法であって、前記コア層に前記電子部品を搭載して、前記コア層の少なくとも一方の面に形成された配線回路を構成する接続用の電極に前記バンプを接合する部品搭載工程と、前記部品搭載後の前記コア層において、前記電子部品との隙間に樹脂を注入して硬化させ、前記隙間を封止して前記バンプを周囲から補強する封止樹脂部を形成する樹脂封止工程と、前記樹脂封止工程後の前記コア層において、前記バンプ付きの電子部品が実装された実装面側をプラズマ処理することにより、前記実装面側に形成された金属膜の表面に生成した酸化膜を除去するプラズマ処理工程と、前記プラズマ処理工程後のコア層において、前記電子部品を周囲から囲んで固定する部品固定層を形成するためのプリプレグおよび前記部品固定層の表面に形成される表面層を少なくとも含む配線層を前記コア層と貼り合わせて積層する積層工程と、前記積層工程において形成された積層体を加熱加圧することにより、前記部品固定層を形成するとともに前記コア層と前記配線層とを固着させるプレス工程とを含む。
まず部品内蔵配線基板の製造方法について図1、図2を参照して説明する。図1、図2、図3は、コア層を含む複数の配線層を積層して構成され、コア層にバンプ付きの電子部品が実装された部品内蔵配線基板を製造する方法を、工程順に示すものである。ここでは、バンプとして半田を材質として形成された半田バンプを用いる例を示している。図1(a)において、コア層1は絶縁性の樹脂基板2の上面2a、下面2bにそれぞれ金属膜である銅箔よりなる配線回路3および配線回路5を形成した構成となっている。配線回路3の一部は、電子部品の半田バンプを接続するための電極3aとなっている。すなわち電極3aは、コア層1の少なくとも一方の面(上面2a)に形成された配線回路3を構成する形態となっている。
さらにこれらの表面にはプラズマのエッチング作用により微細なアンカーパターンが形成されていることから、良好な密着性が確保される。
を目的として有機膜が被覆された状態のものを用いる場合にあっても本発明を適用することができる。このような場合には、図5に示すようなプラズマ処理装置11Aを用いて、プラズマ処理を2段階で行うようにする。すなわち、図5(a)において、プラズマ処理装置11Aは、図2(a)に示すプラズマ処理装置11において、単一ガス種のプラズマ発生用ガスを供給するガス供給部20を、それぞれ異なるガス種のプラズマ発生用ガスを供給する第1ガス供給部20A、第2ガス供給部20Bに置き換え、切替弁21によってガス種の切替を可能とした構成となっている。第1ガス供給部20Aは、プラズマ処理装置11に示すガス供給部20と同様に、アルゴンガスや水素ガスなど、配線回路3の表面3bに生成された酸化膜3cを除去するためのプラズマ発生用ガスを供給する。第2ガス供給部20Bは、酸素ガスなど、配線回路3に形成された有機膜をアッシングによって除去するためのプラズマ発生用ガスを供給する。
本実施の形態2は、実施の形態1において半田接合後に樹脂を供給して封止樹脂部9を形成するプロセスに変えて、電子部品7の搭載前にコア層1に予め樹脂を塗布しておくいわゆる「樹脂先塗り」の工法を採用した形態となっている。
、この半田接合における加熱によって熱硬化性樹脂9Aを熱硬化させ、電子部品7とコア層1との隙間を熱硬化性樹脂9Aが硬化した封止樹脂部9A*によって封止する(半田接合・樹脂封止工程)。
2 樹脂基板
3 配線回路(金属膜)
3a 電極
4 ソルダレジスト
6 半田バンプ
6* 半田部
7 電子部品
9 封止樹脂部
22、24、27 プリプレグ
23、26 配線層
25、28 銅箔
25a、28a 配線回路
29 積層体
30 層間配線部
31 部品内蔵配線基板
Claims (2)
- コア層を含む複数の配線層を積層して構成され前記コア層にバンプ付きの電子部品が実装された部品内蔵配線基板を製造する部品内蔵配線基板の製造方法であって、
前記コア層に前記電子部品を搭載して、前記コア層の少なくとも一方の面に形成された配線回路を構成する接続用の電極に前記バンプを接合する部品搭載工程と、前記部品搭載後の前記コア層において、前記電子部品との隙間に樹脂を注入して硬化させ、前記隙間を封止して前記バンプを周囲から補強する封止樹脂部を形成する樹脂封止工程と、前記樹脂封止工程後の前記コア層において、前記バンプ付きの電子部品が実装された実装面側をプラズマ処理することにより、前記実装面側に形成された金属膜の表面に生成した酸化膜を除去するプラズマ処理工程と、前記プラズマ処理工程後のコア層において、前記電子部品を周囲から囲んで固定する部品固定層を形成するためのプリプレグおよび前記部品固定層の表面に形成される表面層を少なくとも含む配線層を前記コア層と貼り合わせて積層する積層工程と、前記積層工程において形成された積層体を加熱加圧することにより、前記部品固定層を形成するとともに前記コア層と前記配線層とを固着させるプレス工程とを含むことを特徴とする部品内蔵配線基板の製造方法。 - コア層を含む複数の配線層を積層して構成され前記コア層にバンプ付きの電子部品が実装された部品内蔵配線基板を製造する部品内蔵配線基板の製造方法であって、
前記コア層の少なくとも一方の面に形成された配線回路を構成する接続用の電極を覆って、酸化膜を除去する活性作用を有する熱硬化性樹脂を供給する樹脂供給工程と、前記樹脂供給工程後の前記コア層に前記電子部品を搭載して、前記配線回路を構成する接続用の電極に前記バンプを着地させる部品搭載工程と、前記バンプと前記電極とを接合するとともに、前記電子部品とコア層との隙間を前記熱硬化性樹脂が硬化した樹脂によって封止する接合・樹脂封止工程と、前記接合・樹脂封止工程後の前記コア層において、前記バンプ付きの電子部品が実装された実装面側をプラズマ処理することにより、前記実装面側に形成された金属膜の表面に生成した酸化膜を除去するプラズマ処理工程と、前記プラズマ処理工程後のコア層において、前記電子部品を周囲から囲んで固定する部品固定層を形成するためのプリプレグおよび前記部品固定層の表面に形成される表面層を少なくとも含む配線層を前記コア層と貼り合わせて積層する積層工程と、前記積層工程において形成された積層体を加熱加圧することにより、前記部品固定層を形成するとともに前記コア層と前記配線層とを固着させるプレス工程とを含むことを特徴とする部品内蔵配線基板の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009119507A JP2010267895A (ja) | 2009-05-18 | 2009-05-18 | 部品内蔵配線基板の製造方法 |
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Family Applications (1)
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Date | Code | Title | Description |
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A621 | Written request for application examination |
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A977 | Report on retrieval |
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A131 | Notification of reasons for refusal |
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A521 | Written amendment |
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RD01 | Notification of change of attorney |
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