JP2002325028A - 周波数走査形受信機 - Google Patents
周波数走査形受信機Info
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- JP2002325028A JP2002325028A JP2001129062A JP2001129062A JP2002325028A JP 2002325028 A JP2002325028 A JP 2002325028A JP 2001129062 A JP2001129062 A JP 2001129062A JP 2001129062 A JP2001129062 A JP 2001129062A JP 2002325028 A JP2002325028 A JP 2002325028A
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- H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
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- H04B1/16—Circuits
- H04B1/26—Circuits for superheterodyne receivers
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- H03—ELECTRONIC CIRCUITRY
- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D7/00—Transference of modulation from one carrier to another, e.g. frequency-changing
- H03D7/16—Multiple-frequency-changing
- H03D7/161—Multiple-frequency-changing all the frequency changers being connected in cascade
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
- H03J7/00—Automatic frequency control; Automatic scanning over a band of frequencies
- H03J7/02—Automatic frequency control
- H03J7/04—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant
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- H03J7/20—Automatic scanning over a band of frequencies where the scanning is accomplished by varying the electrical characteristics of a non-mechanically adjustable element
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- Engineering & Computer Science (AREA)
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- Signal Processing (AREA)
- Power Engineering (AREA)
- Superheterodyne Receivers (AREA)
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
Abstract
(57)【要約】
【課題】 第１局発のＰＬＬの周波数の設定に時間を要
さず、簡単な回路構成で、受信周波数の設定ができる方
式を確立することを課題とする。 【解決手段】 第１局発ＬＯ１のＰＬＬの基準周波数を
高く設定した場合に第２ＩＦ以下に周波数誤差がでる場
合には、周波数弁別器ＤＳＣＲの出力を用いて第２局発
ＬＯ２または第３局発の周波数を適切な周波数のものに
制御回路が切り換えて、上記周波数誤差を零となるよう
に制御する。
さず、簡単な回路構成で、受信周波数の設定ができる方
式を確立することを課題とする。 【解決手段】 第１局発ＬＯ１のＰＬＬの基準周波数を
高く設定した場合に第２ＩＦ以下に周波数誤差がでる場
合には、周波数弁別器ＤＳＣＲの出力を用いて第２局発
ＬＯ２または第３局発の周波数を適切な周波数のものに
制御回路が切り換えて、上記周波数誤差を零となるよう
に制御する。
Description
【０００１】
【発明の属する技術分野】本発明はＶＨＦ帯やＵＨＦ帯
等で用いられる周波数走査形受信機に係り、特に周波数
変換用局部搬送波の周波数設定方式の改良に関する。
等で用いられる周波数走査形受信機に係り、特に周波数
変換用局部搬送波の周波数設定方式の改良に関する。
【０００２】
【従来の技術】ＶＨＦ帯で使用される電波は、通常、１
５KHz間隔に、ＵＨＦ帯では１２．５KHz間隔になるよう
割り当てられている。しかし、１５KHz間隔といって
も、その帯域のすべてに渉って万遍なく１５KHz間隔で
割り当てられているのではなく、１５KHz間隔で割り当
てられた幾つかの電波からなるグループがあり、そこか
ら２０KHz×Ｎ離れてまた１５KHz間隔で割り当てられた
電波のグループがある、というような１５KHzの倍数関
係でない電波のグループが随所にある。１２．５KHz間
隔の周波数帯についても、事情は同様である。しかも電
波の不足から、ＶＨＦ帯の１５KHz間隔は７．５KHz間隔
に、ＵＨＦ帯の１２．５KHz間隔は６．２５KHz間隔に移
行しつゝある。
５KHz間隔に、ＵＨＦ帯では１２．５KHz間隔になるよう
割り当てられている。しかし、１５KHz間隔といって
も、その帯域のすべてに渉って万遍なく１５KHz間隔で
割り当てられているのではなく、１５KHz間隔で割り当
てられた幾つかの電波からなるグループがあり、そこか
ら２０KHz×Ｎ離れてまた１５KHz間隔で割り当てられた
電波のグループがある、というような１５KHzの倍数関
係でない電波のグループが随所にある。１２．５KHz間
隔の周波数帯についても、事情は同様である。しかも電
波の不足から、ＶＨＦ帯の１５KHz間隔は７．５KHz間隔
に、ＵＨＦ帯の１２．５KHz間隔は６．２５KHz間隔に移
行しつゝある。
【０００３】このような広帯域の間隔の電波をカバーす
るためのいわゆる全波走査形受信機では、選局（同調）
のために位相同期ループ・ＰＬＬ（Phase Locked Loo
p）で制御された第１局発（第１局部発振器）を用いる
のが常套手段である。これは、そのＰＬＬを構成する分
周器の分周比を制御することによって、基準発振器（水
晶発振器）の基準発振周波数の整数倍の周波数信号を出
力できるので、安定した走査形の第１局発が構成でき
る。
るためのいわゆる全波走査形受信機では、選局（同調）
のために位相同期ループ・ＰＬＬ（Phase Locked Loo
p）で制御された第１局発（第１局部発振器）を用いる
のが常套手段である。これは、そのＰＬＬを構成する分
周器の分周比を制御することによって、基準発振器（水
晶発振器）の基準発振周波数の整数倍の周波数信号を出
力できるので、安定した走査形の第１局発が構成でき
る。
【０００４】
【発明が解決しようとする課題】しかし、これを現実に
適用した場合、つぎのような不都合が生じる。すなわ
ち、上記構成の受信機では基準周波数（参照周波数とも
いう）の整数倍の周波数信号しか出力できないことか
ら、第１局発の基準周波数は全受信周波数（正しくは第
１局発としての周波数であるが、受信周波数についても
同様）の最大公約数に設定する必要があるが、現在、上
述のような雑多な周波数間隔の配列になっているので、
基準周波数は２．５KHzとか３．１２５KHzとかの極めて
低い周波数に選定せざるを得なくなる。基準周波数を低
くすると、この周波数に見合ってＰＬＬのループフィル
タのカットオフ周波数も下げざるを得なくなるから、必
然的にＰＬＬの応答は遅くなり、選局時の受信周波数の
セッティングに時間がかかってしまうことになる。
適用した場合、つぎのような不都合が生じる。すなわ
ち、上記構成の受信機では基準周波数（参照周波数とも
いう）の整数倍の周波数信号しか出力できないことか
ら、第１局発の基準周波数は全受信周波数（正しくは第
１局発としての周波数であるが、受信周波数についても
同様）の最大公約数に設定する必要があるが、現在、上
述のような雑多な周波数間隔の配列になっているので、
基準周波数は２．５KHzとか３．１２５KHzとかの極めて
低い周波数に選定せざるを得なくなる。基準周波数を低
くすると、この周波数に見合ってＰＬＬのループフィル
タのカットオフ周波数も下げざるを得なくなるから、必
然的にＰＬＬの応答は遅くなり、選局時の受信周波数の
セッティングに時間がかかってしまうことになる。
【０００５】そこで、本発明の課題はＰＬＬの基準周波
数の設定に時間を要さず、出来る限り簡単な回路構成
で、選局時の受信周波数の設定ができる周波数走査形受
信機を提供することにある。
数の設定に時間を要さず、出来る限り簡単な回路構成
で、選局時の受信周波数の設定ができる周波数走査形受
信機を提供することにある。
【０００６】
【課題を解決するための手段】本発明は上記課題を達成
するため、位相同期ループを用いる第１局部発振器、第
２局部発振器、第Ｎ局部発振器（Ｎは正の整数）及び周
波数弁別器等を有する周波数走査形受信機において、選
局時に上記周波数弁別器の出力に応じた誤差周波数を判
別して第２又は第Ｎ局部発振器の出力する局部搬送波の
周波数を切り換えて上記出力が零となるように制御する
制御手段を備えたことを要旨とする。
するため、位相同期ループを用いる第１局部発振器、第
２局部発振器、第Ｎ局部発振器（Ｎは正の整数）及び周
波数弁別器等を有する周波数走査形受信機において、選
局時に上記周波数弁別器の出力に応じた誤差周波数を判
別して第２又は第Ｎ局部発振器の出力する局部搬送波の
周波数を切り換えて上記出力が零となるように制御する
制御手段を備えたことを要旨とする。
【０００７】本発明において、前記制御手段は、メモリ
ーと、上記メモリーに前記位相同期ループの周波数設定
データを与えて、該メモリーから出力により第２又は第
Ｎ局部発振器の局部搬送波の周波数を設定する設定手段
と、前記誤差周波数に応じて上記メモリーの設定データ
を更新する手段とで構成してもよい。
ーと、上記メモリーに前記位相同期ループの周波数設定
データを与えて、該メモリーから出力により第２又は第
Ｎ局部発振器の局部搬送波の周波数を設定する設定手段
と、前記誤差周波数に応じて上記メモリーの設定データ
を更新する手段とで構成してもよい。
【０００８】
【発明の実施の形態】ＰＬＬの基準周波数は、上記セッ
ティング時間の点からは出来るだけ高い周波数の方がよ
いが、高く選ぶと出力搬送波の周波数間隔が広がるか
ら、それだけ周波数誤差を持った第１ＩＦ（第１中間周
波）信号の数（誤差の種類）が増え、低く選ぶとその逆
で、誤差の種類は少なくなるが前述のセッティング時間
の問題が出てくる。そこでいま、基準周波数を７．５KH
zもしくは６．２５KHz程度として、実際に使用されてい
る電波を選局して受信したとすると、誤差周波数の種類
は３〜５種類程度である。この第１ＩＦ信号にたいし
て、第２局発の周波数を誤差周波数に対応してこれを零
とするように選択すれば、第２ＩＦでは正しい周波数と
なる。誤差周波数が幾らになっているかは、周波数弁別
器を設けその出力を見れば容易に分かる。したがってま
ず第２局発を正規の周波数に設定して受信し、周波数弁
別器の出力電圧の大きさから、誤差周波数を判別して複
数個設けた第２局発用水晶振動子の中より適切なものを
選択して上記出力電圧を零となるようにすればよい。こ
のような構成ならば、回路規模の増加はそう大きくなく
て済む。
ティング時間の点からは出来るだけ高い周波数の方がよ
いが、高く選ぶと出力搬送波の周波数間隔が広がるか
ら、それだけ周波数誤差を持った第１ＩＦ（第１中間周
波）信号の数（誤差の種類）が増え、低く選ぶとその逆
で、誤差の種類は少なくなるが前述のセッティング時間
の問題が出てくる。そこでいま、基準周波数を７．５KH
zもしくは６．２５KHz程度として、実際に使用されてい
る電波を選局して受信したとすると、誤差周波数の種類
は３〜５種類程度である。この第１ＩＦ信号にたいし
て、第２局発の周波数を誤差周波数に対応してこれを零
とするように選択すれば、第２ＩＦでは正しい周波数と
なる。誤差周波数が幾らになっているかは、周波数弁別
器を設けその出力を見れば容易に分かる。したがってま
ず第２局発を正規の周波数に設定して受信し、周波数弁
別器の出力電圧の大きさから、誤差周波数を判別して複
数個設けた第２局発用水晶振動子の中より適切なものを
選択して上記出力電圧を零となるようにすればよい。こ
のような構成ならば、回路規模の増加はそう大きくなく
て済む。
【０００９】以上のような構成によって、性能、動作と
も十分な受信機を構成することができるが、この構成に
さらにつぎのような回路を付加すれば、一層の動作の高
速化が可能となる。それは、周波数弁別器の出力で判定
した使用すべき第２局発周波数を、第１局発周波数（Ｐ
ＬＬの周波数設定データで可）とともに、書き替え可能
なＲＯＭ（Read Only Memory）又はＥＥＰＲＯＭ（Elec
trically Erasable Programmable Read Only Memory）
等のメモリーに設定しておくことである。選局に際して
は、通常はこのＲＯＭの出力で第２局発を設定し、必要
に応じて周波数弁別器の出力を用いてＲＯＭの内容（第
２局発の設定周波数）を更新すればよい。これは電波の
周波数が、そう頻繁には変更されないからこの構成が可
能であって、この構成によって、周波数弁別器、判定回
路、切り替え回路等の応答時間分だけ早くなる。なお、
第２局発として数個の水晶振動子を切り換える代わり
に、ＶＣＯ（Voltage Controlled Oscillator）を用
い、これを周波数弁別器の出力で制御することによって
ＡＦＣ（Automatic Frequency Control）を構成するこ
とも考えられる。
も十分な受信機を構成することができるが、この構成に
さらにつぎのような回路を付加すれば、一層の動作の高
速化が可能となる。それは、周波数弁別器の出力で判定
した使用すべき第２局発周波数を、第１局発周波数（Ｐ
ＬＬの周波数設定データで可）とともに、書き替え可能
なＲＯＭ（Read Only Memory）又はＥＥＰＲＯＭ（Elec
trically Erasable Programmable Read Only Memory）
等のメモリーに設定しておくことである。選局に際して
は、通常はこのＲＯＭの出力で第２局発を設定し、必要
に応じて周波数弁別器の出力を用いてＲＯＭの内容（第
２局発の設定周波数）を更新すればよい。これは電波の
周波数が、そう頻繁には変更されないからこの構成が可
能であって、この構成によって、周波数弁別器、判定回
路、切り替え回路等の応答時間分だけ早くなる。なお、
第２局発として数個の水晶振動子を切り換える代わり
に、ＶＣＯ（Voltage Controlled Oscillator）を用
い、これを周波数弁別器の出力で制御することによって
ＡＦＣ（Automatic Frequency Control）を構成するこ
とも考えられる。
【００１０】
【実施例】以下図面を用いて本発明の周波数走査形受信
機の一実施例について説明する。図１はこの実施例の回
路構成図である。図１において、１は高周波信号の入力
端子、ＲＦは高周波増幅器、ＦＣ１は第１周波数変換
器、ＬＯ１は第１局部発振器（第１局発）、ＲＥＦは基
準信号発生器、２は周波数設定信号入力端子、ＩＦ１は
第１中間周波増幅器（第１ＩＦ増幅器）、ＦＣ２は第２
周波数変換器、ＬＯ２は第２局部発振器（第２局発）、
３は第２局発の切り換え信号入力端子、ＩＦ２は第２中
間周波増幅器（第２ＩＦ増幅器）、ＤＳＣＲは周波数弁
別器、ＤＥＣは判定回路、ＣＯＬは制御回路、４は復調
信号出力端子である。
機の一実施例について説明する。図１はこの実施例の回
路構成図である。図１において、１は高周波信号の入力
端子、ＲＦは高周波増幅器、ＦＣ１は第１周波数変換
器、ＬＯ１は第１局部発振器（第１局発）、ＲＥＦは基
準信号発生器、２は周波数設定信号入力端子、ＩＦ１は
第１中間周波増幅器（第１ＩＦ増幅器）、ＦＣ２は第２
周波数変換器、ＬＯ２は第２局部発振器（第２局発）、
３は第２局発の切り換え信号入力端子、ＩＦ２は第２中
間周波増幅器（第２ＩＦ増幅器）、ＤＳＣＲは周波数弁
別器、ＤＥＣは判定回路、ＣＯＬは制御回路、４は復調
信号出力端子である。
【００１１】選局（同調）時に入力端子１に与えられた
高周波信号は高周波増幅器ＲＦを通じて第１周波数変換
器ＦＣ１に加えられ、第１局発ＬＯ１よりの局部搬送波
により第１ＩＦに周波数変換される。第１局発ＬＯ１は
前述したＰＬＬで制御され、基準信号発生器ＲＥＦより
加えられる基準周波数（例えば７．５KHz）の整数倍の
周波数の第１局部搬送波を出力するものである。基準周
波数の何倍にするかは端子２より加えられる設定信号に
より、ＰＬＬ内の分周器の分周比を制御することで行わ
れる。第１中間周波数（第１ＩＦ）に変換された信号は
第１ＩＦ増幅器ＩＦ１を通じて第２周波数変換器ＦＣ２
に加えられ、ここで第２局発ＬＯ２よりの第２局部搬送
波により第２ＩＦ信号となる。この信号は第２ＩＦ増幅
器ＩＦ２を通じて周波数弁別器ＤＳＣＲに加えられて復
調される。
高周波信号は高周波増幅器ＲＦを通じて第１周波数変換
器ＦＣ１に加えられ、第１局発ＬＯ１よりの局部搬送波
により第１ＩＦに周波数変換される。第１局発ＬＯ１は
前述したＰＬＬで制御され、基準信号発生器ＲＥＦより
加えられる基準周波数（例えば７．５KHz）の整数倍の
周波数の第１局部搬送波を出力するものである。基準周
波数の何倍にするかは端子２より加えられる設定信号に
より、ＰＬＬ内の分周器の分周比を制御することで行わ
れる。第１中間周波数（第１ＩＦ）に変換された信号は
第１ＩＦ増幅器ＩＦ１を通じて第２周波数変換器ＦＣ２
に加えられ、ここで第２局発ＬＯ２よりの第２局部搬送
波により第２ＩＦ信号となる。この信号は第２ＩＦ増幅
器ＩＦ２を通じて周波数弁別器ＤＳＣＲに加えられて復
調される。
【００１２】第２局発ＬＯ２は、最初は正規の周波数の
第２局部搬送波が出力されるよう制御されているので、
７．５KHz（今の場合）の整数倍の周波数の電波を受信
した場合、周波数誤差は無いから、周波数弁別器ＤＳＣ
Ｒの出力はゼロである。しかし、前述のように、７．５
KHzの整数倍の周波数から＋２．５KHzあるいは−２．５
KHz等だけズレた周波数の電波があるから、選局時にこ
れら電波を受信した時は、周波数弁別器ＤＳＣＲはこの
ズレに対応して正または負の出力を生じる。したがって
判定回路ＤＥＣはこの周波数誤差を判別して制御回路Ｃ
ＯＬが第２局発ＬＯ２の周波数を適切な周波数のものに
切り換えて上記周波数誤差（ＤＳＣＲ出力）を零とする
ように制御する。
第２局部搬送波が出力されるよう制御されているので、
７．５KHz（今の場合）の整数倍の周波数の電波を受信
した場合、周波数誤差は無いから、周波数弁別器ＤＳＣ
Ｒの出力はゼロである。しかし、前述のように、７．５
KHzの整数倍の周波数から＋２．５KHzあるいは−２．５
KHz等だけズレた周波数の電波があるから、選局時にこ
れら電波を受信した時は、周波数弁別器ＤＳＣＲはこの
ズレに対応して正または負の出力を生じる。したがって
判定回路ＤＥＣはこの周波数誤差を判別して制御回路Ｃ
ＯＬが第２局発ＬＯ２の周波数を適切な周波数のものに
切り換えて上記周波数誤差（ＤＳＣＲ出力）を零とする
ように制御する。
【００１３】図２は、本発明の他の実施例で前述のよう
に、図１の回路にメモリーＭＥＭを追加して、選局の度
に第２局発ＬＯ２を設定し直さなくてもよいようにした
ものである。すなわち、通常は、端子２よりＰＬＬの周
波数設定データが与えられると、書き換え可能メモリー
ＭＥＭはこれをアドレス入力として、予め設定してある
周波数の第２局部搬送波を出力し、これによって制御回
路ＣＯＬは第２局発ＬＯ２の周波数を適切なものに設定
する。したがって第１局発ＬＯ１のＰＬＬの設定データ
が与えられると、メモリーＭＥＭを通じて直ちに第２局
発ＬＯ２の周波数は設定されるから、時間的には第１局
発ＬＯ１よりも第２局発ＬＯ２の方が早く設定される。
そして、必要に応じてメモリーＭＥＭの内容は判定回路
ＤＥＣの出力によって更新される。端子５は第２局発Ｌ
Ｏ２の周波数の設定を判定回路ＤＥＣの出力で行わせる
か、あるいはメモリーＭＥＭの出力で行わせるかの制
御、およびメモリー内容を更新するか否かを制御する制
御信号の入力端子である。
に、図１の回路にメモリーＭＥＭを追加して、選局の度
に第２局発ＬＯ２を設定し直さなくてもよいようにした
ものである。すなわち、通常は、端子２よりＰＬＬの周
波数設定データが与えられると、書き換え可能メモリー
ＭＥＭはこれをアドレス入力として、予め設定してある
周波数の第２局部搬送波を出力し、これによって制御回
路ＣＯＬは第２局発ＬＯ２の周波数を適切なものに設定
する。したがって第１局発ＬＯ１のＰＬＬの設定データ
が与えられると、メモリーＭＥＭを通じて直ちに第２局
発ＬＯ２の周波数は設定されるから、時間的には第１局
発ＬＯ１よりも第２局発ＬＯ２の方が早く設定される。
そして、必要に応じてメモリーＭＥＭの内容は判定回路
ＤＥＣの出力によって更新される。端子５は第２局発Ｌ
Ｏ２の周波数の設定を判定回路ＤＥＣの出力で行わせる
か、あるいはメモリーＭＥＭの出力で行わせるかの制
御、およびメモリー内容を更新するか否かを制御する制
御信号の入力端子である。
【００１４】以上、ＰＬＬの基準周波数の整数倍以外の
周波数については、すべて第２局発ＬＯ２で対応するよ
う説明したが、第３局発がある場合には第３局発で対応
するようにしてもよいことは云うまでもない。
周波数については、すべて第２局発ＬＯ２で対応するよ
う説明したが、第３局発がある場合には第３局発で対応
するようにしてもよいことは云うまでもない。
【００１５】
【発明の効果】以上、詳細に説明したように、ＰＬＬに
よる第１局部発振器を用いた周波数走査形受信機でＶＨ
ＦやＵＨＦの電波を受信し選局する場合、第１局部発振
器のＰＬＬの基準周波数は、カバー範囲内の全ての周波
数にたいして最大公約数になるように選ぶ必要がある。
これにたいし、実際の電波は全て等間隔には割り当てら
れていないから、基準周波数は必然的に低い周波数に選
定せざるを得ず、その結果ＰＬＬの設定に時間を要して
いた。しかし、本発明によれば、受信電波の周波数が等
間隔で割り当てられているものとしてＰＬＬを設計でき
るから、ＰＬＬの基準周波数を高い周波数に設定でき、
ＰＬＬの設定時間を早くすることができる。
よる第１局部発振器を用いた周波数走査形受信機でＶＨ
ＦやＵＨＦの電波を受信し選局する場合、第１局部発振
器のＰＬＬの基準周波数は、カバー範囲内の全ての周波
数にたいして最大公約数になるように選ぶ必要がある。
これにたいし、実際の電波は全て等間隔には割り当てら
れていないから、基準周波数は必然的に低い周波数に選
定せざるを得ず、その結果ＰＬＬの設定に時間を要して
いた。しかし、本発明によれば、受信電波の周波数が等
間隔で割り当てられているものとしてＰＬＬを設計でき
るから、ＰＬＬの基準周波数を高い周波数に設定でき、
ＰＬＬの設定時間を早くすることができる。
【図１】本発明の一実施例を示す回路構成図である。
【図２】本発明の他の実施例を示す回路構成図である。
【符号の説明】 １ 高周波信号入力端子 ２ 周波数設定信号入力端子 ３ 第２局発切り換え信号入力端子 ４ 復調信号出力端子 ５ メモリーの更新・非更新切り換え信号入力端子 ＲＦ 高周波増幅器 ＦＣ１ 第１周波数変換器 ＬＯ１ 第１局部発振器 ＲＥＦ 基準信号発生器 ＩＦ１ 第１中間周波増幅器 ＦＣ２ 第２周波数変換器 ＬＯ２ 第２局部発振器 ＩＦ２ 第２中間周波増幅器 ＤＳＣＲ 周波数弁別器 ＤＥＣ 判定回路 ＭＥＭ メモリー ＣＯＬ 制御回路
───────────────────────────────────────────────────── フロントページの続き (72)発明者 横山 信明 東京都港区三田３−12−17 株式会社ゼネ ラルリサーチオブエレクトロニックス内 Ｆターム(参考） 5J103 AA11 CA08 DA05 DA38 DA46 HA04 5K020 AA02 BB09 DD26 GG04 GG11 KK04
Claims (2)
- 【請求項１】 位相同期ループを用いる第１局部発振
器、第２局部発振器、第Ｎ局部発振器（Ｎは正の整数）
及び周波数弁別器等を有する周波数走査形受信機におい
て、 選局時に上記周波数弁別器の出力に応じた誤差周波数を
判別して第２又は第Ｎ局部発振器の出力する局部搬送波
の周波数を切り換えて上記出力が零となるように制御す
る制御手段を備えたことを特徴とする周波数走査形受信
機。 - 【請求項２】 前記制御手段は、メモリーと、 上記メモリーに前記位相同期ループの周波数設定データ
を与えて、該メモリーから出力により第２又は第Ｎ局部
発振器の局部搬送波の周波数を設定する設定手段と、 前記誤差周波数に応じて上記メモリーの設定データを更
新する手段と、を備えたことを特徴とする周波数走査形
受信機。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2001129062A JP2002325028A (ja) | 2001-04-26 | 2001-04-26 | 周波数走査形受信機 |
| US10/127,216 US6968165B2 (en) | 2001-04-26 | 2002-04-22 | Frequency scanning receiver permitting quick PPL setting |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
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