JP2002042295A - 長範囲双方向低電力通信装置 - Google Patents
長範囲双方向低電力通信装置Info
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Classifications
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- B60—VEHICLES IN GENERAL
- B60R—VEHICLES, VEHICLE FITTINGS, OR VEHICLE PARTS, NOT OTHERWISE PROVIDED FOR
- B60R25/00—Fittings or systems for preventing or indicating unauthorised use or theft of vehicles
- B60R25/20—Means to switch the anti-theft system on or off
- B60R25/24—Means to switch the anti-theft system on or off using electronic identifiers containing a code not memorised by the user
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B60—VEHICLES IN GENERAL
- B60R—VEHICLES, VEHICLE FITTINGS, OR VEHICLE PARTS, NOT OTHERWISE PROVIDED FOR
- B60R25/00—Fittings or systems for preventing or indicating unauthorised use or theft of vehicles
- B60R25/01—Fittings or systems for preventing or indicating unauthorised use or theft of vehicles operating on vehicle systems or fittings, e.g. on doors, seats or windscreens
- B60R25/04—Fittings or systems for preventing or indicating unauthorised use or theft of vehicles operating on vehicle systems or fittings, e.g. on doors, seats or windscreens operating on the propulsion system, e.g. engine or drive motor
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B60—VEHICLES IN GENERAL
- B60R—VEHICLES, VEHICLE FITTINGS, OR VEHICLE PARTS, NOT OTHERWISE PROVIDED FOR
- B60R25/00—Fittings or systems for preventing or indicating unauthorised use or theft of vehicles
- B60R25/20—Means to switch the anti-theft system on or off
- B60R25/209—Remote starting of engine
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- G—PHYSICS
- G07—CHECKING-DEVICES
- G07C—TIME OR ATTENDANCE REGISTERS; REGISTERING OR INDICATING THE WORKING OF MACHINES; GENERATING RANDOM NUMBERS; VOTING OR LOTTERY APPARATUS; ARRANGEMENTS, SYSTEMS OR APPARATUS FOR CHECKING NOT PROVIDED FOR ELSEWHERE
- G07C9/00—Individual registration on entry or exit
- G07C9/00174—Electronically operated locks; Circuits therefor; Nonmechanical keys therefor, e.g. passive or active electrical keys or other data carriers without mechanical keys
- G07C9/00309—Electronically operated locks; Circuits therefor; Nonmechanical keys therefor, e.g. passive or active electrical keys or other data carriers without mechanical keys operated with bidirectional data transmission between data carrier and locks
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04W—WIRELESS COMMUNICATION NETWORKS
- H04W52/00—Power management, e.g. Transmission Power Control [TPC] or power classes
- H04W52/02—Power saving arrangements
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- H04W52/0225—Power saving arrangements in terminal devices using monitoring of external events, e.g. the presence of a signal
- H04W52/0229—Power saving arrangements in terminal devices using monitoring of external events, e.g. the presence of a signal where the received signal is a wanted signal
-
- G—PHYSICS
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- G07C2009/00373—Electronically operated locks; Circuits therefor; Nonmechanical keys therefor, e.g. passive or active electrical keys or other data carriers without mechanical keys operated with bidirectional data transmission between data carrier and locks in combination with a wake-up circuit whereby the wake-up circuit is situated in the lock
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D30/00—Reducing energy consumption in communication networks
- Y02D30/70—Reducing energy consumption in communication networks in wireless communication networks
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- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
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Abstract
(57)【要約】
【課題】 高性能ウエークアップ検出器を有する長範
囲、低電力、双方向通信装置１００を提供する。 【解決手段】 信号の送受信用アンテナ１１４と、アン
テナに結合されたアナログ部分１１８と、アナログ部分
に結合されたデジタル部分１２０を含む。アナログ部分
は中間周波数ダウンコンバータ、デジタル同相Ｉ出力、
デジタル直交位相Ｑ出力を含み、好適にはデジタルＩ、
Ｑ出力を生成する１ビットアナログ/デジタル・コンバ
ータを使用する。デジタル部分は、ＩとＱ出力を発生さ
せるＩ／Ｑデローテータ、大きさ出力を含むウエークア
ップ検出器、大きさ出力に結合された閾値比較回路を含
み、一つの実現において内積/外積回路、ＩとＱのアキ
ュームレータ、内相関器、外相関器を含み得る。
囲、低電力、双方向通信装置１００を提供する。 【解決手段】 信号の送受信用アンテナ１１４と、アン
テナに結合されたアナログ部分１１８と、アナログ部分
に結合されたデジタル部分１２０を含む。アナログ部分
は中間周波数ダウンコンバータ、デジタル同相Ｉ出力、
デジタル直交位相Ｑ出力を含み、好適にはデジタルＩ、
Ｑ出力を生成する１ビットアナログ/デジタル・コンバ
ータを使用する。デジタル部分は、ＩとＱ出力を発生さ
せるＩ／Ｑデローテータ、大きさ出力を含むウエークア
ップ検出器、大きさ出力に結合された閾値比較回路を含
み、一つの実現において内積/外積回路、ＩとＱのアキ
ュームレータ、内相関器、外相関器を含み得る。
Description
【０００１】［マイクロフィッシュの付録］この明細書
は1マイクロフィッシュが全５４のフレーム数からなる
マイクロフィッシュ付録を含む。
は1マイクロフィッシュが全５４のフレーム数からなる
マイクロフィッシュ付録を含む。
【０００２】
【発明の属する技術分野】本発明は通信装置に関する。
特に本発明は例えば車、トラックおよび他の車両用の、
無鍵リモート・エントリ・システムにおいて、低電力で
比較的長距離にわたり通信するために使用され得る双方
向通信の実現に関する。
特に本発明は例えば車、トラックおよび他の車両用の、
無鍵リモート・エントリ・システムにおいて、低電力で
比較的長距離にわたり通信するために使用され得る双方
向通信の実現に関する。
【０００３】
【従来の技術】自動車産業は長年、無鍵リモート・エン
トリ装置「ＲＫＥ」のために、ＴＲＷの自動車電子グルー
プを含む電子設計者の技術に変わった。毎日の体験に共
通のＲＫＥは、ＲＫＥから車両へコマンド信号を送信す
るためのエレクトロニクスを組み込んでいる小さなプラ
スチックの格納装置（ポケット中または、キーチェーン
上で適合するのに充分に小さい）としてしばしば設計さ
れている。ＲＫＥは、一組の制御ボタンを含み、該ボタ
ンは作動時にＲＫＥがコマンド信号を車両に送信させ
る。ＲＫＥが送るコマンド信号は押される制御ボタンに
依存し、例えばドアのロックからアラームの起動にまで
及ぶタスクを実行するために車両に指示を与え得る。し
かし過去においては、ＲＫＥはいくつかの重要な方法に
おいて制限されていた。
トリ装置「ＲＫＥ」のために、ＴＲＷの自動車電子グルー
プを含む電子設計者の技術に変わった。毎日の体験に共
通のＲＫＥは、ＲＫＥから車両へコマンド信号を送信す
るためのエレクトロニクスを組み込んでいる小さなプラ
スチックの格納装置（ポケット中または、キーチェーン
上で適合するのに充分に小さい）としてしばしば設計さ
れている。ＲＫＥは、一組の制御ボタンを含み、該ボタ
ンは作動時にＲＫＥがコマンド信号を車両に送信させ
る。ＲＫＥが送るコマンド信号は押される制御ボタンに
依存し、例えばドアのロックからアラームの起動にまで
及ぶタスクを実行するために車両に指示を与え得る。し
かし過去においては、ＲＫＥはいくつかの重要な方法に
おいて制限されていた。
【０００４】第１の重要な制限は以前のＲＫＥが単方向
のみに動作することであった。換言すると、過去のＲＫ
ＥはＲＫＥから車両への送信のみ可能であったので車両
から何らのフィードバックを得ることが出来なかった。
例として、ＲＫＥは以前に送信されたＲＫＥ制御信号に
応答してドアがロックされたと指示する車両からの送信
を受信することは出来なかった。従って過去において
は、ＲＫＥの使用者は、ドア・ロックのコマンド信号に
応答して車両が実際にドアをロックしたか否かを決定す
るため、典型的には不完全な聴覚に頼らざるをえなかっ
た。雑音のある環境または可聴の機械的なロック音の聞
き取りが可能な範囲を越えている場合においてＲＫＥを
作動させることは、ＲＫＥの使用者は車両が実際にドア
をロックしたかを確信することが出来なかったことを意
味した。
のみに動作することであった。換言すると、過去のＲＫ
ＥはＲＫＥから車両への送信のみ可能であったので車両
から何らのフィードバックを得ることが出来なかった。
例として、ＲＫＥは以前に送信されたＲＫＥ制御信号に
応答してドアがロックされたと指示する車両からの送信
を受信することは出来なかった。従って過去において
は、ＲＫＥの使用者は、ドア・ロックのコマンド信号に
応答して車両が実際にドアをロックしたか否かを決定す
るため、典型的には不完全な聴覚に頼らざるをえなかっ
た。雑音のある環境または可聴の機械的なロック音の聞
き取りが可能な範囲を越えている場合においてＲＫＥを
作動させることは、ＲＫＥの使用者は車両が実際にドア
をロックしたかを確信することが出来なかったことを意
味した。
【０００５】さらに双方向通信の欠如は、以前のＲＫＥ
は、ユーザが車両にその状態を問い合わせるためにＲＫ
Ｅを作動できるメカニズムを提供することが出来なかっ
たことを意味した。結果として、例えば車両が壊された
かを決定するために車両の状態をチェックすることが出
来なかった（例えば窓がうち砕かれたかを決定するため
のセンサをチェックすることによって）。さらなる例と
して、ＲＫＥはドアがロックされ、トランクがロックさ
れ、または内部のライトが点灯されているかを決定する
ために車両に問い合わせることが出来なかった。
は、ユーザが車両にその状態を問い合わせるためにＲＫ
Ｅを作動できるメカニズムを提供することが出来なかっ
たことを意味した。結果として、例えば車両が壊された
かを決定するために車両の状態をチェックすることが出
来なかった（例えば窓がうち砕かれたかを決定するため
のセンサをチェックすることによって）。さらなる例と
して、ＲＫＥはドアがロックされ、トランクがロックさ
れ、または内部のライトが点灯されているかを決定する
ために車両に問い合わせることが出来なかった。
【０００６】以前のＲＫＥの第２の重要な制限は、それ
らの比較的短い範囲にある。従って、RKEによって送ら
れたコマンド信号が車両によって受信されるであろう特
定の範囲を越えてRKEは何ら確実に使用出来なかった。
よって、例えば聴覚の不完全さと組み合わさって、ドア
・ロックのコマンド信号に反応して車がドアをロックし
たかを決定することがいつも可能ではなかった。さらに
以前のRKEが車両の状態を問い合わせることが可能であ
ったとしても、RKEに固有である範囲の制限が多くの例
において問い合わせの有効性を制限した。
らの比較的短い範囲にある。従って、RKEによって送ら
れたコマンド信号が車両によって受信されるであろう特
定の範囲を越えてRKEは何ら確実に使用出来なかった。
よって、例えば聴覚の不完全さと組み合わさって、ドア
・ロックのコマンド信号に反応して車がドアをロックし
たかを決定することがいつも可能ではなかった。さらに
以前のRKEが車両の状態を問い合わせることが可能であ
ったとしても、RKEに固有である範囲の制限が多くの例
において問い合わせの有効性を制限した。
【０００７】例えば、車が壊されたかを決定するために
車の状態を問い合わせることは、好適には車両から出来
る限り離れた所から達成されるであろう。実際の侵入者
がまだ車の中にいるか否かを決定するための関連した問
い合わせは、同じように車両から出来る限り離れた所か
ら達成されるであろう。別の例として、いくつかの場合
においては、以前のＲＫＥによって提供された比較的短
い範囲より遠い距離から車両のエンジン制御または環境
制御がなされることが好適であるであろう。それからよ
り遠い作動範囲はユーザが車両に到着する前に、エンジ
ンを暖めることを可能にしまたは、車両に快適な環境セ
ッティングを達成することを可能とする。
車の状態を問い合わせることは、好適には車両から出来
る限り離れた所から達成されるであろう。実際の侵入者
がまだ車の中にいるか否かを決定するための関連した問
い合わせは、同じように車両から出来る限り離れた所か
ら達成されるであろう。別の例として、いくつかの場合
においては、以前のＲＫＥによって提供された比較的短
い範囲より遠い距離から車両のエンジン制御または環境
制御がなされることが好適であるであろう。それからよ
り遠い作動範囲はユーザが車両に到着する前に、エンジ
ンを暖めることを可能にしまたは、車両に快適な環境セ
ッティングを達成することを可能とする。
【０００８】産業界においては、無鍵リモート・エント
リを含む応用を有する、手持ちサイズの遠距離双方向通
信装置に対する必要性が長く存在している。
リを含む応用を有する、手持ちサイズの遠距離双方向通
信装置に対する必要性が長く存在している。
【０００９】
【発明が解決しようとする課題】双方向通信装置を提供
することが本発明の目的である。拡張範囲を有する双方
向通信装置を提供することは本発明の別の目的である。
することが本発明の目的である。拡張範囲を有する双方
向通信装置を提供することは本発明の別の目的である。
【００１０】ウエークアップ検出器を含む双方向通信装
置を提供することは本発明のさらなる目的である。必要
とされるまでマイクロプロセッサをスリープモードに維
持し得ることによって、双方向通信装置を含む通信シス
テムを実現するために要求される電力を減少させること
は本発明の別の目的である。
置を提供することは本発明のさらなる目的である。必要
とされるまでマイクロプロセッサをスリープモードに維
持し得ることによって、双方向通信装置を含む通信シス
テムを実現するために要求される電力を減少させること
は本発明の別の目的である。
【００１１】本発明の別の目的は、更なる処理のために
信号サンプルを記憶するためのスナップショット・レコ
ーダを含む双方向通信装置を提供することである。本発
明の別の目的は、周波数、位相、時間分解能をベースと
したマイクロプロセッサを有する双方向通信装置を含む
通信システムを提供することである。
信号サンプルを記憶するためのスナップショット・レコ
ーダを含む双方向通信装置を提供することである。本発
明の別の目的は、周波数、位相、時間分解能をベースと
したマイクロプロセッサを有する双方向通信装置を含む
通信システムを提供することである。
【００１２】双方向通信装置を使用した通信システムに
おいて、復調、ビット検出、解読をベースとしたマイク
ロプロセッサを提供することは本発明のさらなる目的で
ある。
おいて、復調、ビット検出、解読をベースとしたマイク
ロプロセッサを提供することは本発明のさらなる目的で
ある。
【００１３】
【課題を解決するための手段】上述した一つまたはそれ
以上の目的は本通信装置により全体に又は一部に満たさ
れる。装置は信号を送信および受信するためのアンテ
ナ、アンテナに結合されたアナログ部分、アナログ部分
に結合されたデジタル部分を含む。特に、アナログ部分
は中間周波数ダウンコンバータ、デジタル同相出力、デ
ジタル直交位相出力を含む。デジタル部分は、Ｉ出力と
Ｑ出力を発生させるＩ／Ｑデローテータ（derotater)、
大きさ出力を含むウエークアップ検出器、大きさ出力に
結合された閾値比較回路を含む。閾値比較回路は、大き
さ出力に反映されるようなウエークアップ信号受信条件
を示す閾値を記憶する。
以上の目的は本通信装置により全体に又は一部に満たさ
れる。装置は信号を送信および受信するためのアンテ
ナ、アンテナに結合されたアナログ部分、アナログ部分
に結合されたデジタル部分を含む。特に、アナログ部分
は中間周波数ダウンコンバータ、デジタル同相出力、デ
ジタル直交位相出力を含む。デジタル部分は、Ｉ出力と
Ｑ出力を発生させるＩ／Ｑデローテータ（derotater)、
大きさ出力を含むウエークアップ検出器、大きさ出力に
結合された閾値比較回路を含む。閾値比較回路は、大き
さ出力に反映されるようなウエークアップ信号受信条件
を示す閾値を記憶する。
【００１４】さらにウエークアップ検出器は、例えば大
きさ出力と閾値比較回路の間にアキュムレータと移動平
均回路を使用し得る。大きさ出力は、二つの入力のうち
の大きな方と二つの入力のうちの小さい方の半分との加
算により形成された大きさ近似を好適に出力する大きさ
回路を使用することによって典型的には生成される。二
つの入力は、例えば、デローテートされたＩ／Ｑデー
タ、Ｉ／Ｑデータの内積／外積、又は相関された内積／
外積であり得る。通信装置の一つ実現において、デジタ
ル部分はＩ出力およびＱ出力に結合された内積／外積回
路、内積／外積のためのＩとＱのアキュムレータを含
む。内積および外積のための相関器が、さらに含まれ得
る（特に変調されたウエークアップ信号が望まれる場
合）。
きさ出力と閾値比較回路の間にアキュムレータと移動平
均回路を使用し得る。大きさ出力は、二つの入力のうち
の大きな方と二つの入力のうちの小さい方の半分との加
算により形成された大きさ近似を好適に出力する大きさ
回路を使用することによって典型的には生成される。二
つの入力は、例えば、デローテートされたＩ／Ｑデー
タ、Ｉ／Ｑデータの内積／外積、又は相関された内積／
外積であり得る。通信装置の一つ実現において、デジタ
ル部分はＩ出力およびＱ出力に結合された内積／外積回
路、内積／外積のためのＩとＱのアキュムレータを含
む。内積および外積のための相関器が、さらに含まれ得
る（特に変調されたウエークアップ信号が望まれる場
合）。
【００１５】好適にはスナップショット・メモリが提供
され、ＩアキュムレータおよびＱアキュムレータに結合
される。以下でより詳細に説明されるように、入力ウエ
ークアップ信号の周波数は記憶されたサンプルの後続処
理によって決定され得る。より大きなスナップショット
・レコーダがさらに含まれ、デローテータによって生成
されたＩ出力およびＱ出力を記憶するために使用され
る。それから記憶されたＩとＱ出力は周波数および情報
内容を決定するために続いて処理され得る。
され、ＩアキュムレータおよびＱアキュムレータに結合
される。以下でより詳細に説明されるように、入力ウエ
ークアップ信号の周波数は記憶されたサンプルの後続処
理によって決定され得る。より大きなスナップショット
・レコーダがさらに含まれ、デローテータによって生成
されたＩ出力およびＱ出力を記憶するために使用され
る。それから記憶されたＩとＱ出力は周波数および情報
内容を決定するために続いて処理され得る。
【００１６】アナログ部分は典型的にはデジタル同相出
力を発生させるために中間周波数ダウンコンバータに結
合された同相アナログ／デジタル変換器を使用する。同
様に、直交位相アナログ／デジタル変換器は中間周波数
ダウンコンバータに結合され、デジタル直交位相出力を
生成する。アナログ／デジタル変換器は好適には１ビッ
トのアナログ／デジタル変換器である。
力を発生させるために中間周波数ダウンコンバータに結
合された同相アナログ／デジタル変換器を使用する。同
様に、直交位相アナログ／デジタル変換器は中間周波数
ダウンコンバータに結合され、デジタル直交位相出力を
生成する。アナログ／デジタル変換器は好適には１ビッ
トのアナログ／デジタル変換器である。
【００１７】
【発明の実施の形態】ここで図１について言及すると、
図示されるように単一の特定用途向け集積回路（ＡＳＩ
Ｃ）において実現される長距離双方向通信装置１０２
（「ＢＣＤ１０２」）、水晶発振器１０４、ＤＣ／ＤＣコ
ンバータ１０６およびマイクロプロセッサ１０８を含む
通信システム１００を示している。水晶発振器１０４
は、アナログ信号を処理しデジタル制御のための内部ク
ロックを発生させるためにＢＣＤ１０２により使用され
るクロック周波数を提供する。ＢＣＤ１０２は、一つの
実施形態においては＋１２ＶのＤＣ入力を＋３ＶのＤＣ
出力へ減少させるＤＣ／ＤＣコンバータ１０６から電力
を受け取る。
図示されるように単一の特定用途向け集積回路（ＡＳＩ
Ｃ）において実現される長距離双方向通信装置１０２
（「ＢＣＤ１０２」）、水晶発振器１０４、ＤＣ／ＤＣコ
ンバータ１０６およびマイクロプロセッサ１０８を含む
通信システム１００を示している。水晶発振器１０４
は、アナログ信号を処理しデジタル制御のための内部ク
ロックを発生させるためにＢＣＤ１０２により使用され
るクロック周波数を提供する。ＢＣＤ１０２は、一つの
実施形態においては＋１２ＶのＤＣ入力を＋３ＶのＤＣ
出力へ減少させるＤＣ／ＤＣコンバータ１０６から電力
を受け取る。
【００１８】マイクロプロセッサ１０８は、以下で詳細
に説明されるであろう処理のために、ＢＣＤ１０２に結
合されている。マイクロプロセッサ１０８は、例えばコ
ーディング／デコーディング・チップ１１０を含む、サ
ポート回路にさらに結合され得る。コーディング／デコ
ーディング・チップ１１０は信号エラーのコーディング
とデコーディング、暗号化と解読およびそれと同様のよ
うな、計算上の集中オペレーションを実行し得る。代替
的にコーディング／デコーディング・チップ１１０を省
くことができ、必要な機能はメモリ１２２に記憶された
ソフトウエアにおいて実現され、マイクロプロセッサ１
０８によって実行される。マイクロプロセッサ１０８は
外部メモリ、Ｉ／Ｏ装置および同様のものと通信するた
めに使用され得る汎用目的データバス１１２をサポート
する。最後に送信および受信アンテナ１１４が含まれ、
ＢＣＤ１０２に結合される。
に説明されるであろう処理のために、ＢＣＤ１０２に結
合されている。マイクロプロセッサ１０８は、例えばコ
ーディング／デコーディング・チップ１１０を含む、サ
ポート回路にさらに結合され得る。コーディング／デコ
ーディング・チップ１１０は信号エラーのコーディング
とデコーディング、暗号化と解読およびそれと同様のよ
うな、計算上の集中オペレーションを実行し得る。代替
的にコーディング／デコーディング・チップ１１０を省
くことができ、必要な機能はメモリ１２２に記憶された
ソフトウエアにおいて実現され、マイクロプロセッサ１
０８によって実行される。マイクロプロセッサ１０８は
外部メモリ、Ｉ／Ｏ装置および同様のものと通信するた
めに使用され得る汎用目的データバス１１２をサポート
する。最後に送信および受信アンテナ１１４が含まれ、
ＢＣＤ１０２に結合される。
【００１９】ＢＣＤ１０２は例えば単一の特定用途向け
集積回路（ＡＳＩＣ）において実現され得る。代替的に
はアナログ部分とデジタル部分（以下で述べられる）は
別々のＡＳＩＣに分離されることが出来、または両部分
は別々の回路とともに実現されることができる。以下で
より詳細に述べるように、ＢＣＤ１０２は入力通信が検
出された時にマイクロプロセッサ１０８に知らせ得る。
集積回路（ＡＳＩＣ）において実現され得る。代替的に
はアナログ部分とデジタル部分（以下で述べられる）は
別々のＡＳＩＣに分離されることが出来、または両部分
は別々の回路とともに実現されることができる。以下で
より詳細に述べるように、ＢＣＤ１０２は入力通信が検
出された時にマイクロプロセッサ１０８に知らせ得る。
【００２０】図１において示される通信システム１００
は例えば、車両内へ集積され得る。データバス１１２
は、ドア・ロック、トランク・ロック、セキュリティ・
システム、および同様のものを含む車両内のエレクトロ
ニクスの周りにルートされた汎用目的データバスに結合
され得る。同様に関連したＲＫＥは、信号を車両へ送信
し、車両から信号を受信するためにその独自の通信シス
テム１００を組み込むことが出来る。ＲＫＥ内のデータ
バス１１２は、例えば、ドアのロック／アンロック作
動、アラームの作動、エンジンのスタートを含む様々な
タスクを実行するために車両に指示を与えるための実現
可能なボタンを提供するスイッチ・マトリクスに結合さ
れ得る。
は例えば、車両内へ集積され得る。データバス１１２
は、ドア・ロック、トランク・ロック、セキュリティ・
システム、および同様のものを含む車両内のエレクトロ
ニクスの周りにルートされた汎用目的データバスに結合
され得る。同様に関連したＲＫＥは、信号を車両へ送信
し、車両から信号を受信するためにその独自の通信シス
テム１００を組み込むことが出来る。ＲＫＥ内のデータ
バス１１２は、例えば、ドアのロック／アンロック作
動、アラームの作動、エンジンのスタートを含む様々な
タスクを実行するために車両に指示を与えるための実現
可能なボタンを提供するスイッチ・マトリクスに結合さ
れ得る。
【００２１】再び図１について言及すると、ＢＣＤ１０
２は多くの個別信号処理ブロック（以下で詳細に述べら
れている）を含む。信号処理ブロックは一般的にＲＦ／
ＩＦ（アナログ）処理ファンクション１１６、１１８と
デジタル処理ファンクション１２０との間で一般的に区
分される。送信方向用ＲＦ／ＩＦ処理ファンクション１
１８中には、Ｉ／Ｑアップコンバージョンおよび送信機
ゲインが含まれる。受信方向用ＲＦ／ＩＦ処理ファンク
ション１１６は受信機ゲイン、Ｉ／Ｑダウンコンバージ
ョン、ベースバンド・ゲイン、アナログ／デジタル変換
を含む。デジタル処理ファンクション１２０は数値制御
発振器（ＮＣＯ）駆動のデジタルＩ／Ｑデローテータ、
ウエークアップ・ディテクタ、スナップショット・レコ
ーダを含む。
２は多くの個別信号処理ブロック（以下で詳細に述べら
れている）を含む。信号処理ブロックは一般的にＲＦ／
ＩＦ（アナログ）処理ファンクション１１６、１１８と
デジタル処理ファンクション１２０との間で一般的に区
分される。送信方向用ＲＦ／ＩＦ処理ファンクション１
１８中には、Ｉ／Ｑアップコンバージョンおよび送信機
ゲインが含まれる。受信方向用ＲＦ／ＩＦ処理ファンク
ション１１６は受信機ゲイン、Ｉ／Ｑダウンコンバージ
ョン、ベースバンド・ゲイン、アナログ／デジタル変換
を含む。デジタル処理ファンクション１２０は数値制御
発振器（ＮＣＯ）駆動のデジタルＩ／Ｑデローテータ、
ウエークアップ・ディテクタ、スナップショット・レコ
ーダを含む。
【００２２】ここで図２について言及すると、図はアナ
ログ部分におけるＲＦ／ＩＦ処理ファンクション１１
６、１１８の詳細な図２００を示す。図２においてＲＦ
／ＩＦ処理ファンクションは６個のブロック：送信／受
信ブロック２０２、アナログＩ／Ｑダウンコンバータ・
ブロック２０４、アナログＩ／Ｑアップコンバータ・ブ
ロック２０６、Ｉアナログ／デジタル・コンバータ・ブ
ロック２０８、Ｑアナログ／デジタル・コンバータ・ブ
ロック２１０、周波数ソース・ブロック２１２に分割さ
れる。各ブロックは以下で詳細に述べられる。
ログ部分におけるＲＦ／ＩＦ処理ファンクション１１
６、１１８の詳細な図２００を示す。図２においてＲＦ
／ＩＦ処理ファンクションは６個のブロック：送信／受
信ブロック２０２、アナログＩ／Ｑダウンコンバータ・
ブロック２０４、アナログＩ／Ｑアップコンバータ・ブ
ロック２０６、Ｉアナログ／デジタル・コンバータ・ブ
ロック２０８、Ｑアナログ／デジタル・コンバータ・ブ
ロック２１０、周波数ソース・ブロック２１２に分割さ
れる。各ブロックは以下で詳細に述べられる。
【００２３】送信／受信ブロック２０２はアンテナ１１
４、送信／受信スイッチ２１４、受信増幅器２１６、送
信増幅器２１８を含む。アンテナ１１４はＢＣＤ１０２
によって発生されまたは処理される電磁信号を捕らえま
たは送信する。典型的な送信および受信周波数は３００
―５００ＭＨｚの範囲にある。送信／受信スイッチ２１
４はＢＣＤ１０２がアンテナ１１４を駆動するか、アン
テナ１１４によって捕らえられた信号を読み取るかを制
御する。送信／受信スイッチ２１４は例えば、アナログ
・マルチプレクサまたは他のスイッチング素子（例え
ば、リレー）として実現され得る。代替的に、出力ディ
セーブル制御を有するバッファが送信パスを受信パスか
ら隔離するために使用され得る。受信増幅器２１６は、
アンテナ１１４によって捕らえられた信号をアナログＩ
／Ｑダウンコンバータ・ブロック２０４における更なる
処理のためにブーストするために作動し、一方で送信増
幅器２１８はＩ／Ｑアップコンバータ・ブロック２０６
によって発生されアンテナ１１４に提供される信号をブ
ーストするために作動する。
４、送信／受信スイッチ２１４、受信増幅器２１６、送
信増幅器２１８を含む。アンテナ１１４はＢＣＤ１０２
によって発生されまたは処理される電磁信号を捕らえま
たは送信する。典型的な送信および受信周波数は３００
―５００ＭＨｚの範囲にある。送信／受信スイッチ２１
４はＢＣＤ１０２がアンテナ１１４を駆動するか、アン
テナ１１４によって捕らえられた信号を読み取るかを制
御する。送信／受信スイッチ２１４は例えば、アナログ
・マルチプレクサまたは他のスイッチング素子（例え
ば、リレー）として実現され得る。代替的に、出力ディ
セーブル制御を有するバッファが送信パスを受信パスか
ら隔離するために使用され得る。受信増幅器２１６は、
アンテナ１１４によって捕らえられた信号をアナログＩ
／Ｑダウンコンバータ・ブロック２０４における更なる
処理のためにブーストするために作動し、一方で送信増
幅器２１８はＩ／Ｑアップコンバータ・ブロック２０６
によって発生されアンテナ１１４に提供される信号をブ
ーストするために作動する。
【００２４】送信増幅器２１８は製造公差、ＦＣＣ制限
および同様のものに基づき、その出力を変化するために
マイクロプロセッサ１０８によってインテリジェントに
制御され得る。例えば、製造の間、通信装置１００のサ
ンプル・ロットはテスト可能であり、適切な電力レベル
コードがマイクロプロセッサ１０８に結合されたメモリ
１２２に供給される。それから各通信装置１００は好適
なレベルで送信増幅器２１８を動作し得る。
および同様のものに基づき、その出力を変化するために
マイクロプロセッサ１０８によってインテリジェントに
制御され得る。例えば、製造の間、通信装置１００のサ
ンプル・ロットはテスト可能であり、適切な電力レベル
コードがマイクロプロセッサ１０８に結合されたメモリ
１２２に供給される。それから各通信装置１００は好適
なレベルで送信増幅器２１８を動作し得る。
【００２５】Ｉ／Ｑダウンコンバータ・ブロック２０４
は信号スプリッタ２２０と、ダウンコンバータＩミキサ
発信器入力２２４とダウンコンバータＩミキサ信号入力
２２６とアナログダウンコンバートされたＩ出力２２８
を有するダウン・コンバータＩミキサ２２２を有する。
Ｉ／Ｑダウンコンバータ・ブロック２０４はさらにダウ
ンコンバータＱミキサ発振器入力２３２とダウンコンバ
ータＱミキサ信号入力２３４とアナログダウンコンバー
トされたＱ出力２３６を有するダウンコンバータＱミキ
サ２３０をさらに含む。発振器の位相シフタ２３８はさ
らに提供される。
は信号スプリッタ２２０と、ダウンコンバータＩミキサ
発信器入力２２４とダウンコンバータＩミキサ信号入力
２２６とアナログダウンコンバートされたＩ出力２２８
を有するダウン・コンバータＩミキサ２２２を有する。
Ｉ／Ｑダウンコンバータ・ブロック２０４はさらにダウ
ンコンバータＱミキサ発振器入力２３２とダウンコンバ
ータＱミキサ信号入力２３４とアナログダウンコンバー
トされたＱ出力２３６を有するダウンコンバータＱミキ
サ２３０をさらに含む。発振器の位相シフタ２３８はさ
らに提供される。
【００２６】Ｉ／Ｑアップコンバータ・ブロック２０６
の構造は、Ｉ／Ｑダウンコンバータ・ブロック２０４の
構造と同じである。アップコンバータ・ブロック２０６
は信号加算器２４０、アップコンバータＩミキサ発振器
入力２４４とアップコンバータＩミキサ信号入力２４６
とアナログアップコンバートされたＩ出力２４８を有す
るアップコンバータＩミキサ２４２を有する。Ｉ／Ｑア
ップコンバータ・ブロック２０６はさらにアップコンバ
ータＱミキサ発振器入力２５２とアップコンバータＱミ
キサ信号入力２５４とアナログ・アップコンバートされ
たＱ出力２５６を有するアップコンバータＱミキサ２５
０をさらに含んでいる。発振器の位相シフタ２５８はさ
らに提供される。
の構造は、Ｉ／Ｑダウンコンバータ・ブロック２０４の
構造と同じである。アップコンバータ・ブロック２０６
は信号加算器２４０、アップコンバータＩミキサ発振器
入力２４４とアップコンバータＩミキサ信号入力２４６
とアナログアップコンバートされたＩ出力２４８を有す
るアップコンバータＩミキサ２４２を有する。Ｉ／Ｑア
ップコンバータ・ブロック２０６はさらにアップコンバ
ータＱミキサ発振器入力２５２とアップコンバータＱミ
キサ信号入力２５４とアナログ・アップコンバートされ
たＱ出力２５６を有するアップコンバータＱミキサ２５
０をさらに含んでいる。発振器の位相シフタ２５８はさ
らに提供される。
【００２７】アナログＩローパス・フィルタ２７０は、
アナログ・ダウンコンバートされたＩ出力をＩアナログ
／デジタル・コンバータ・ブロック２０８に接続する。
Ｉアナログ／デジタル・コンバータ・ブロック２０８は
それ自身加算器２７２、増幅器２７４、デジタルＩ出力
２７８を発生させるＩアナログ／デジタル・コンバータ
２７６を含む。同様に、アナログＱローパス・フィルタ
２８０はアナログ・ダウンコンバートされたＱ出力をＱ
アナログ／デジタル・コンバータ・ブロック２１０に接
続する。Ｑアナログ／デジタル・コンバータ・ブロック
２１０は加算器２８２、増幅器２８４、デジタルＱ出力
２８８を発生させるアナログ／デジタル・コンバータ２
８６を含む。
アナログ・ダウンコンバートされたＩ出力をＩアナログ
／デジタル・コンバータ・ブロック２０８に接続する。
Ｉアナログ／デジタル・コンバータ・ブロック２０８は
それ自身加算器２７２、増幅器２７４、デジタルＩ出力
２７８を発生させるＩアナログ／デジタル・コンバータ
２７６を含む。同様に、アナログＱローパス・フィルタ
２８０はアナログ・ダウンコンバートされたＱ出力をＱ
アナログ／デジタル・コンバータ・ブロック２１０に接
続する。Ｑアナログ／デジタル・コンバータ・ブロック
２１０は加算器２８２、増幅器２８４、デジタルＱ出力
２８８を発生させるアナログ／デジタル・コンバータ２
８６を含む。
【００２８】周波数ソース・ブロック２１２は、水晶発
振器１０４、周波数マルチプレクサを含んでいる。周波
数マルチプレクサは、位相検出器２９０、増幅器２９
２、電圧制御発振器（ＶＣＯ）２９４を含んでいる位相
ロックループを使用する。分周器２９６はＶＣＯ２９４
と位相検出器２９０との間のループを閉じる。動作にお
いては、水晶発振器１０４は、例えば１２．５ＭＨｚな
どの比較的低い周波数の出力信号を発生させる。位相検
出器２９０は、水晶発振器１０４の出力と分周器２９６
によって選択される分周されたＶＣＯ２９４のダウン出
力との周波数差または位相差を表す差信号を発生する。
この例として、除算は３２にセットされているが、他の
整数および非整数値をさらに使用し得る。差信号は増幅
されてＶＣＯへ印加されその出力を制御する。周波数ソ
ース・ブロック２１２において図示された周波数マルチ
プレクサは、水晶発振器１０４より３２倍大きな周波数
（即ち４００ＭＨｚ）を有する出力信号を発生させる。
振器１０４、周波数マルチプレクサを含んでいる。周波
数マルチプレクサは、位相検出器２９０、増幅器２９
２、電圧制御発振器（ＶＣＯ）２９４を含んでいる位相
ロックループを使用する。分周器２９６はＶＣＯ２９４
と位相検出器２９０との間のループを閉じる。動作にお
いては、水晶発振器１０４は、例えば１２．５ＭＨｚな
どの比較的低い周波数の出力信号を発生させる。位相検
出器２９０は、水晶発振器１０４の出力と分周器２９６
によって選択される分周されたＶＣＯ２９４のダウン出
力との周波数差または位相差を表す差信号を発生する。
この例として、除算は３２にセットされているが、他の
整数および非整数値をさらに使用し得る。差信号は増幅
されてＶＣＯへ印加されその出力を制御する。周波数ソ
ース・ブロック２１２において図示された周波数マルチ
プレクサは、水晶発振器１０４より３２倍大きな周波数
（即ち４００ＭＨｚ）を有する出力信号を発生させる。
【００２９】次に、図２に示されたＲＦ／ＩＦ処理の構
成要素の動作は送信方向および受信方向について以下で
詳細に述べられるであろう。受信方向においては、送信
／受信スイッチ２１４はアンテナ１１４によって捕らえ
られた受信信号が増幅器２１６を通って流れ、スプリッ
タ２２０に到達することを可能とする。スプリッタ２２
０は受信された信号の同一コピーをダウンコンバータＩ
ミキサ２２２およびダウンコンバータＱミキサ２３０に
結合する。ダウンコンバータＩミキサ発振器入力は、Ｖ
ＣＯ２９４の出力を受信し、一方でダウンコンバータＱ
ミキサ発振器入力は（発振器位相シフタ２３８によっ
て）９０度シフトされたＶＣＯ２９４の出力を受信す
る。
成要素の動作は送信方向および受信方向について以下で
詳細に述べられるであろう。受信方向においては、送信
／受信スイッチ２１４はアンテナ１１４によって捕らえ
られた受信信号が増幅器２１６を通って流れ、スプリッ
タ２２０に到達することを可能とする。スプリッタ２２
０は受信された信号の同一コピーをダウンコンバータＩ
ミキサ２２２およびダウンコンバータＱミキサ２３０に
結合する。ダウンコンバータＩミキサ発振器入力は、Ｖ
ＣＯ２９４の出力を受信し、一方でダウンコンバータＱ
ミキサ発振器入力は（発振器位相シフタ２３８によっ
て）９０度シフトされたＶＣＯ２９４の出力を受信す
る。
【００３０】従って受信信号の周波数内容は、ミキサ２
２２と２３０によって差周波数（受信信号の周波数―Ｖ
ＣＯ２９４周波数）および和周波数（受信信号の周波数
とＶＣＯ２９４周波数の加算の周波数）にシフトされ
る。このようにミキサ２２２および２３０は受信信号の
Ｉ、Ｑ成分を生成し、Ｉ、Ｑのローパス・フィルタ２７
０、２８０によってフィルタされた時、中間周波数でア
ナログ・ダウンコンバートされたＩ、Ｑの信号を発生さ
せる。例えば受信信号の周波数内容が３９９．９ＭＨｚ
周辺に中心を有し、ＶＣＯ２９４の出力が４００ＭＨｚ
の場合には、差周波数は１００ＫＨｚ（中間周波数）で
あり、和周波数は７９９．９ＭＨｚである。Ｉ、Ｑロー
パス・フィルタ２７０、２８０は和周波数を取り除く。
処理の構成要素におけるＤＣオフセットをダウンコンバ
ートされた受信信号と干渉することを防止するために、
中間周波数は好適にはＤＣから少しの量だけ（例えば１
００―２００ＫＨｚまたはそれ以上）オフセットされ
る。ＩとＱのローパス・フィルタ２７０、２８０は随意
に、パスバンドが中間周波数周辺に中心を有し、送信信
号と受信信号の帯域幅に対応した帯域幅を有するバンド
パス・フィルタに置き換えることが可能である。バンド
パス・フィルタを使用することは信号内のＤＣオフセッ
トを直ちに除去する利点を提供する。
２２と２３０によって差周波数（受信信号の周波数―Ｖ
ＣＯ２９４周波数）および和周波数（受信信号の周波数
とＶＣＯ２９４周波数の加算の周波数）にシフトされ
る。このようにミキサ２２２および２３０は受信信号の
Ｉ、Ｑ成分を生成し、Ｉ、Ｑのローパス・フィルタ２７
０、２８０によってフィルタされた時、中間周波数でア
ナログ・ダウンコンバートされたＩ、Ｑの信号を発生さ
せる。例えば受信信号の周波数内容が３９９．９ＭＨｚ
周辺に中心を有し、ＶＣＯ２９４の出力が４００ＭＨｚ
の場合には、差周波数は１００ＫＨｚ（中間周波数）で
あり、和周波数は７９９．９ＭＨｚである。Ｉ、Ｑロー
パス・フィルタ２７０、２８０は和周波数を取り除く。
処理の構成要素におけるＤＣオフセットをダウンコンバ
ートされた受信信号と干渉することを防止するために、
中間周波数は好適にはＤＣから少しの量だけ（例えば１
００―２００ＫＨｚまたはそれ以上）オフセットされ
る。ＩとＱのローパス・フィルタ２７０、２８０は随意
に、パスバンドが中間周波数周辺に中心を有し、送信信
号と受信信号の帯域幅に対応した帯域幅を有するバンド
パス・フィルタに置き換えることが可能である。バンド
パス・フィルタを使用することは信号内のＤＣオフセッ
トを直ちに除去する利点を提供する。
【００３１】ＩとＱのローパス・フィルタ２７０、２８
０のダウンコンバートされたＩとＱの出力は、ＤＣオフ
セットを除去するために、加算器２７２および２８２に
よって調整され（以下に、図３に関連してより詳細に説
明される）、増幅器２７４、２８４によって増幅され、
ＩとＱのアナログ／デジタル・コンバータ２７６、２８
６によってデジタルＩとＱ出力２７８、２８８上にデジ
タル表現へ変換される。ＩとＱアナログ／デジタル・コ
ンバータは好適には１ビットのアナログ／デジタル・コ
ンバータであるが、マルチビットのコンバータもまた適
している（以下で述べるように）。
０のダウンコンバートされたＩとＱの出力は、ＤＣオフ
セットを除去するために、加算器２７２および２８２に
よって調整され（以下に、図３に関連してより詳細に説
明される）、増幅器２７４、２８４によって増幅され、
ＩとＱのアナログ／デジタル・コンバータ２７６、２８
６によってデジタルＩとＱ出力２７８、２８８上にデジ
タル表現へ変換される。ＩとＱアナログ／デジタル・コ
ンバータは好適には１ビットのアナログ／デジタル・コ
ンバータであるが、マルチビットのコンバータもまた適
している（以下で述べるように）。
【００３２】送信方向においては、ＢＣＤ１０２は、例
えばＢＰＳＫまたはＱＰＳＫのような、マイクロプロセ
ッサ１０８によって使用される変調スキームに従って、
発生されたＩとＱ成分上で動作する。アップコンバータ
ＩとＱのミキサ２４２、２５０は送信されるべき信号の
二つの成分を生成する。アップコンバータＩミキサ信号
入力は（第１にアナログ形式へに変換された）Ｉ成分を
受け取り、（アップコンバータＩ発振器入力２４４に結
合された）ＶＣＯ２９４出力と結合して、送信されるべ
き信号の一つの成分を生成する。アップコンバータＱミ
キサ信号入力は、（第１にアナログ形式へに変換され
た）Ｑ成分を受け取り、シフタ２５８によって９０度シ
フトされ且つアップコンバータＱ発振器入力２５２に結
合されたＶＣＯ２９４出力と結合して、送信されるべき
信号の第二の成分を生成する。二つの成分は加算器２４
０によって加算され、増幅器２１８によってブーストさ
れ、アンテナ１１４を通って駆動される。
えばＢＰＳＫまたはＱＰＳＫのような、マイクロプロセ
ッサ１０８によって使用される変調スキームに従って、
発生されたＩとＱ成分上で動作する。アップコンバータ
ＩとＱのミキサ２４２、２５０は送信されるべき信号の
二つの成分を生成する。アップコンバータＩミキサ信号
入力は（第１にアナログ形式へに変換された）Ｉ成分を
受け取り、（アップコンバータＩ発振器入力２４４に結
合された）ＶＣＯ２９４出力と結合して、送信されるべ
き信号の一つの成分を生成する。アップコンバータＱミ
キサ信号入力は、（第１にアナログ形式へに変換され
た）Ｑ成分を受け取り、シフタ２５８によって９０度シ
フトされ且つアップコンバータＱ発振器入力２５２に結
合されたＶＣＯ２９４出力と結合して、送信されるべき
信号の第二の成分を生成する。二つの成分は加算器２４
０によって加算され、増幅器２１８によってブーストさ
れ、アンテナ１１４を通って駆動される。
【００３３】周波数シンセサイザー３７０（以下で述べ
られる）とＶＣＯ２９４出力の組み合わせは、受信のた
めに使用される周波数とは異なる送信のために使用され
る周波数を生成するように調整され得る。例として、Ｖ
ＣＯ２９４の周波数は、受信の間、期待された受信信号
の中心周波数（例えば３９９．９ＭＨｚであり得る）よ
り約１００ＫＨｚ大きな値に設定され得る。送信の間、
ＶＣＯ２９４および周波数シンセサイザー３７０は、代
わりに３９９．９ＭＨｚの中心周波数を生成するように
設定され得る。それから４００ＭＨｚの発振器を使用し
ている受信器は送信信号から１００ＫＨｚの中間周波数
を生成し得る。
られる）とＶＣＯ２９４出力の組み合わせは、受信のた
めに使用される周波数とは異なる送信のために使用され
る周波数を生成するように調整され得る。例として、Ｖ
ＣＯ２９４の周波数は、受信の間、期待された受信信号
の中心周波数（例えば３９９．９ＭＨｚであり得る）よ
り約１００ＫＨｚ大きな値に設定され得る。送信の間、
ＶＣＯ２９４および周波数シンセサイザー３７０は、代
わりに３９９．９ＭＨｚの中心周波数を生成するように
設定され得る。それから４００ＭＨｚの発振器を使用し
ている受信器は送信信号から１００ＫＨｚの中間周波数
を生成し得る。
【００３４】ここで、図３について言及すると、ＢＣＤ
１０２のデジタル部分１２０の詳細なブロック図３００
が示されている。デジタル部分１２０はＩとＱのオフセ
ット補正器３０２、３０４、デジタルＩ／Ｑダウンコン
バータ３０６、ＩとＱのデジタル・アキュムレータ３０
８、３１０を含む。デジタル部分１２０はさらに、ウエ
ークアップ検出器３１２、スナップショット・レコーダ
３１４、状態マシーン３１６を含む。さらにデジタル周
波数シンセサイザー３７０が示されている。
１０２のデジタル部分１２０の詳細なブロック図３００
が示されている。デジタル部分１２０はＩとＱのオフセ
ット補正器３０２、３０４、デジタルＩ／Ｑダウンコン
バータ３０６、ＩとＱのデジタル・アキュムレータ３０
８、３１０を含む。デジタル部分１２０はさらに、ウエ
ークアップ検出器３１２、スナップショット・レコーダ
３１４、状態マシーン３１６を含む。さらにデジタル周
波数シンセサイザー３７０が示されている。
【００３５】ＩとＱオフセット補正器３０２、３０４は
デジタルのＩとＱの出力２７８、２８８におけるＤＣ成
分（図２に示された任意の回路によって生成された）を
除去するように設計されている。Ｉオフセット補正器３
０２はレジスタ３１８、加算器３２０、デジタル／アナ
ログ・コンバータ３２２で構成されたアキュムレータを
使用する。レジスタ３１８は、例えば、Ｉアナログ／デ
ジタル・コンバータ２７６が１の値を生成した場合にカ
ウント・アップし、Ｉアナログ／デジタル・コンバータ
２７６が０の値を生成した場合にカウント・ダウンする
ことが出来る。受信信号のＩとＱ成分が現実に周期的で
あることが期待されているので（即ちサインおよびコサ
イン成分）、デジタルＩ出力２７８はＤＣオフセットが
何ら存在しない時、０へ累算することが期待されている
（即ち等しい数の１と０の値）。このように任意のＤＣ
オフセットはレジスタ３１８において累算し、デジタル
／アナログ・コンバータ３２２によってアナログ・オフ
セット補正へ変換され、加算器２７２（図２）によって
ローパス・フィルタ２７０のダウンコンバートされたＩ
出力から減算される。
デジタルのＩとＱの出力２７８、２８８におけるＤＣ成
分（図２に示された任意の回路によって生成された）を
除去するように設計されている。Ｉオフセット補正器３
０２はレジスタ３１８、加算器３２０、デジタル／アナ
ログ・コンバータ３２２で構成されたアキュムレータを
使用する。レジスタ３１８は、例えば、Ｉアナログ／デ
ジタル・コンバータ２７６が１の値を生成した場合にカ
ウント・アップし、Ｉアナログ／デジタル・コンバータ
２７６が０の値を生成した場合にカウント・ダウンする
ことが出来る。受信信号のＩとＱ成分が現実に周期的で
あることが期待されているので（即ちサインおよびコサ
イン成分）、デジタルＩ出力２７８はＤＣオフセットが
何ら存在しない時、０へ累算することが期待されている
（即ち等しい数の１と０の値）。このように任意のＤＣ
オフセットはレジスタ３１８において累算し、デジタル
／アナログ・コンバータ３２２によってアナログ・オフ
セット補正へ変換され、加算器２７２（図２）によって
ローパス・フィルタ２７０のダウンコンバートされたＩ
出力から減算される。
【００３６】Ｑオフセット補正器３０４はレジスタ３２
４、加算器３２６、デジタル／アナログ・コンバータ３
２８を含む。Ｑオフセット補正器はＩオフセット補正器
３０２に関する上記と実質的に同じ方法で動作する。こ
のようにＱオフセット補正器３０４は加算器２８２を使
用しているローパス・フィルタ２８０のダウンコンバー
トされたＱ出力からＤＣオフセットを除去する。レジス
タ３１８、３２４は例えば１０ビット幅であり得る。
４、加算器３２６、デジタル／アナログ・コンバータ３
２８を含む。Ｑオフセット補正器はＩオフセット補正器
３０２に関する上記と実質的に同じ方法で動作する。こ
のようにＱオフセット補正器３０４は加算器２８２を使
用しているローパス・フィルタ２８０のダウンコンバー
トされたＱ出力からＤＣオフセットを除去する。レジス
タ３１８、３２４は例えば１０ビット幅であり得る。
【００３７】代替的な実施形態においては、ＩとＱオフ
セット補正器３０２、３０４はＩとＱデジタル出力２７
８、２８８に結合されたデジタル／アナログ・コンバー
タに置き換え出来る。それからデジタル／アナログ・コ
ンバータの出力はアナログ積分器（例えばオペアンプか
ら形成される）に接続され得る。アナログ積分器の出力
は、ＩとＱ信号におけるＤＣオフセットを除去するため
に加算器２７２、２８２に順に接続される。
セット補正器３０２、３０４はＩとＱデジタル出力２７
８、２８８に結合されたデジタル／アナログ・コンバー
タに置き換え出来る。それからデジタル／アナログ・コ
ンバータの出力はアナログ積分器（例えばオペアンプか
ら形成される）に接続され得る。アナログ積分器の出力
は、ＩとＱ信号におけるＤＣオフセットを除去するため
に加算器２７２、２８２に順に接続される。
【００３８】上述したように、ＩとＱのアナログ／デジ
タル・コンバータ２７６、２７８は好適には１ビットの
コンバータである。以下の議論は好適な実現に関連して
進行するが、例えばマルチビットのアナログ／デジタル
・コンバータを使用するために変更可能である。マルチ
ビット・コンバータが使用された場合には、入力信号が
コンバータにとって適切な範囲に維持されるように、好
適には自動ゲイン制御回路が含まれる。受信プロセスの
次のステップにおいては、デジタルＩ／Ｑダウンコンバ
ータ３０６はデジタルＩ、Ｑ出力２７８、２８８から中
間周波数を除去する。デジタルＩ／Ｑダウンコンバータ
３０６は１６×２のルックアップ・テーブル３３０と、
レジスタ３３２（例えば２０ビットの幅であり得る）と
加算器３３４で構成される数値制御発振器（ＮＣＯ）を
含む。ダウンコンバータ３０６はデジタルＩ出力２７８
とＱ出力２８８が特定の中間周波数（例えば１００ＫＨ
ｚ）で運ばれるという想定のもとで動作する。特定の中
間周波数は時の経過、温度、信号パスの条件で変化し得
るので、マイクロプロセッサ１０８は、実際の中間周波
数を決定するアルゴリズムに応答して累算値を調整する
ことによってＮＣＯを同調する。
タル・コンバータ２７６、２７８は好適には１ビットの
コンバータである。以下の議論は好適な実現に関連して
進行するが、例えばマルチビットのアナログ／デジタル
・コンバータを使用するために変更可能である。マルチ
ビット・コンバータが使用された場合には、入力信号が
コンバータにとって適切な範囲に維持されるように、好
適には自動ゲイン制御回路が含まれる。受信プロセスの
次のステップにおいては、デジタルＩ／Ｑダウンコンバ
ータ３０６はデジタルＩ、Ｑ出力２７８、２８８から中
間周波数を除去する。デジタルＩ／Ｑダウンコンバータ
３０６は１６×２のルックアップ・テーブル３３０と、
レジスタ３３２（例えば２０ビットの幅であり得る）と
加算器３３４で構成される数値制御発振器（ＮＣＯ）を
含む。ダウンコンバータ３０６はデジタルＩ出力２７８
とＱ出力２８８が特定の中間周波数（例えば１００ＫＨ
ｚ）で運ばれるという想定のもとで動作する。特定の中
間周波数は時の経過、温度、信号パスの条件で変化し得
るので、マイクロプロセッサ１０８は、実際の中間周波
数を決定するアルゴリズムに応答して累算値を調整する
ことによってＮＣＯを同調する。
【００３９】レジスタ３３２の二つの最上位ビットは１
６×２のルックアップ・テーブル３３０への入力として
提供される。レジスタ３３２は一定の周波数でクロック
されるので、それは一定の周波数で（加算器３３４を使
用して）値を累積しおよびロールオーバする。値に加え
られる各クロックパルスを変化させることによって、レ
ジスタ３３２はより頻繁に、または頻繁でなくロールオ
ーバするために同調されることが出来る。従ってレジス
タ３３２の最上位ビット（ＭＳＢ）はプログラム可能な
周波数出力を提供し、最上位ｎビットは周波数出力の位
相角表現を提供する。
６×２のルックアップ・テーブル３３０への入力として
提供される。レジスタ３３２は一定の周波数でクロック
されるので、それは一定の周波数で（加算器３３４を使
用して）値を累積しおよびロールオーバする。値に加え
られる各クロックパルスを変化させることによって、レ
ジスタ３３２はより頻繁に、または頻繁でなくロールオ
ーバするために同調されることが出来る。従ってレジス
タ３３２の最上位ビット（ＭＳＢ）はプログラム可能な
周波数出力を提供し、最上位ｎビットは周波数出力の位
相角表現を提供する。
【００４０】１６×２のルックアップテーブルに提供さ
れる二つのＭＳＢは選択された中間周波数のために、４
個の可能位相角範囲（象限）の一つを提供する。従って
二つのＭＳＢは、各4個の象限の通ってデジタルＩとＱ
の値を搬送する所望中間周波数に従う。１６×２のルッ
クアップテーブル３３０はＭＳＢによって指示された象
限とサンプルされたＩとＱの信号値（使用される変調技
術に従って、各ビットパターンのための各象限において
一定の既知の値を取るであろう）に従って索引されるこ
とが可能である。
れる二つのＭＳＢは選択された中間周波数のために、４
個の可能位相角範囲（象限）の一つを提供する。従って
二つのＭＳＢは、各4個の象限の通ってデジタルＩとＱ
の値を搬送する所望中間周波数に従う。１６×２のルッ
クアップテーブル３３０はＭＳＢによって指示された象
限とサンプルされたＩとＱの信号値（使用される変調技
術に従って、各ビットパターンのための各象限において
一定の既知の値を取るであろう）に従って索引されるこ
とが可能である。
【００４１】例えば直交位相偏移キーイング（ＱＰＳ
Ｋ）においては、ＩＱ値はペアのビットを表現するため
に割り当てられる。従って、００は４５度の位相角を使
用し、０１は−４５度の位相角を使用し、１０は１３５
度の位相角を使用し、１１は−１３５度の位相角を使用
し得る。例えば送信された００信号値は、ほぼ０．７×
Ａ Ｃｏｓ（ｗｔ）−０．７×Ａ Ｓｉｎ（ｗｔ）また
はＩ Ｃｏｓ（ｗｔ）−Ｑ Ｓｉｎ（ｗｔ）の形をと
り、ここでＡは一定値で、ｗｔは搬送周波数である。従
って、例え００が常に送信されても、ＩとＱの値はＳｉ
ｎとＣｏｓの項が各４象限を通るに従い正および負の値
に変化するであろう。ＮＣＯはＳｉｎとＣｏｓの項を原
因とする変化を補償するために中間周波数ｗｔに合わせ
られる。
Ｋ）においては、ＩＱ値はペアのビットを表現するため
に割り当てられる。従って、００は４５度の位相角を使
用し、０１は−４５度の位相角を使用し、１０は１３５
度の位相角を使用し、１１は−１３５度の位相角を使用
し得る。例えば送信された００信号値は、ほぼ０．７×
Ａ Ｃｏｓ（ｗｔ）−０．７×Ａ Ｓｉｎ（ｗｔ）また
はＩ Ｃｏｓ（ｗｔ）−Ｑ Ｓｉｎ（ｗｔ）の形をと
り、ここでＡは一定値で、ｗｔは搬送周波数である。従
って、例え００が常に送信されても、ＩとＱの値はＳｉ
ｎとＣｏｓの項が各４象限を通るに従い正および負の値
に変化するであろう。ＮＣＯはＳｉｎとＣｏｓの項を原
因とする変化を補償するために中間周波数ｗｔに合わせ
られる。
【００４２】以下のテーブル１はルックアップ・テーブ
ル３３０の好適な内容を提供する。
ル３３０の好適な内容を提供する。
【００４３】
【表１】
【００４４】デジタルＩとＱのアキュムレータ３０８と
３１０は１６×２のルックアップテーブル３３０に従
う。デジタルＩアキュムレータ３０８はレジスタ３３６
と加算器３３８を含む。従ってレジスタ３３６は１６×
２ルックアップテーブル３３０によって生成されたＩの
値を累算する。同じように、デジタルＱアキュムレータ
３１０はレジスタ３４０、加算器３４２を含み、Ｑの値
を累算する。例としてデジタルＩとＱアキュムレータ３
０８、３１０はそれぞれ４５の値を累算でき、従って受
信信号に存在するＩ値とＱ値を平均またはローパス・フ
ィルタリングする。４５の値が累算された後、レジスタ
３３６と３４０のＩ値とＱ値はウエークアップ検出器３
１２へ引き渡される。
３１０は１６×２のルックアップテーブル３３０に従
う。デジタルＩアキュムレータ３０８はレジスタ３３６
と加算器３３８を含む。従ってレジスタ３３６は１６×
２ルックアップテーブル３３０によって生成されたＩの
値を累算する。同じように、デジタルＱアキュムレータ
３１０はレジスタ３４０、加算器３４２を含み、Ｑの値
を累算する。例としてデジタルＩとＱアキュムレータ３
０８、３１０はそれぞれ４５の値を累算でき、従って受
信信号に存在するＩ値とＱ値を平均またはローパス・フ
ィルタリングする。４５の値が累算された後、レジスタ
３３６と３４０のＩ値とＱ値はウエークアップ検出器３
１２へ引き渡される。
【００４５】ウエークアップ検出器３１２はＩとＱの絶
対値回路３４４および３４６、大きさ近似回路３４８、
アキュムレータ（レジスタ３５０と加算器３５２により
形成される）を含む。さらに、閾値レジスタ３５４およ
び加算器３５６が提供される。ＩとＱの絶対値回路３４
４および３４６は、正のＩ、Ｑレジスタ３３６、３４０
の大きさ（以下では便宜上ＲＩおよびＲＱとして言及さ
れる）のみが大きさ近似回路３４８へ引き渡されること
を確かにする。
対値回路３４４および３４６、大きさ近似回路３４８、
アキュムレータ（レジスタ３５０と加算器３５２により
形成される）を含む。さらに、閾値レジスタ３５４およ
び加算器３５６が提供される。ＩとＱの絶対値回路３４
４および３４６は、正のＩ、Ｑレジスタ３３６、３４０
の大きさ（以下では便宜上ＲＩおよびＲＱとして言及さ
れる）のみが大きさ近似回路３４８へ引き渡されること
を確かにする。
【００４６】代替的に、ＩとＱの絶対値回路３４４、３
４６は省くことが出来、内積兼外積計算回路３５８、内
積と外積値のアキュムレータ３６０、３６２と置き換え
が可能である。計算回路３５８は連続的なＩおよびＱの
サンプルの内積（Ａ）をＡ＝Ｉ（ｎ）×Ｉ（ｎ−１）＋
Ｑ（ｎ）×Ｑ（ｎ−１）として計算し、外積（Ｂ）をＢ
＝Ｉ（ｎ）×Ｑ（ｎ−１）−Ｉ（ｎ−１）×Ｑ（ｎ）と
して計算する。ＡおよびＢの値はアキュムレータ３６
０、３６２内にそれぞれ累算され、スナップショットＲ
ＡＭ３６４にさらに保存される。スナップショットＲＡ
Ｍ３６４に保存されたＡおよびＢの値のさらなる処理は
例えば受信された信号搬送波の周波数の決定を含み得
る。周波数はＮ個のＡおよびＢ値にわたってＡＴＡＮ２
（Ａ，Ｂ）をを加算し、加算値をＮで割ることにより近
似され得る。
４６は省くことが出来、内積兼外積計算回路３５８、内
積と外積値のアキュムレータ３６０、３６２と置き換え
が可能である。計算回路３５８は連続的なＩおよびＱの
サンプルの内積（Ａ）をＡ＝Ｉ（ｎ）×Ｉ（ｎ−１）＋
Ｑ（ｎ）×Ｑ（ｎ−１）として計算し、外積（Ｂ）をＢ
＝Ｉ（ｎ）×Ｑ（ｎ−１）−Ｉ（ｎ−１）×Ｑ（ｎ）と
して計算する。ＡおよびＢの値はアキュムレータ３６
０、３６２内にそれぞれ累算され、スナップショットＲ
ＡＭ３６４にさらに保存される。スナップショットＲＡ
Ｍ３６４に保存されたＡおよびＢの値のさらなる処理は
例えば受信された信号搬送波の周波数の決定を含み得
る。周波数はＮ個のＡおよびＢ値にわたってＡＴＡＮ２
（Ａ，Ｂ）をを加算し、加算値をＮで割ることにより近
似され得る。
【００４７】大きさ近似回路３４８はＲＩとＲＱの大き
さ（Ｍ）（絶対値回路３４４および３４６が使用された
場合）またはＡおよびＢの大きさ（内積兼外積計算回路
３５８が使用された場合）に対する近似を計算する。古
典的な大きさの公式はＭ＝ＳＱＲＴ（ＲＩ×ＲＩ＋ＲＱ
×ＲＱ）（またはＭ＝ＳＱＲＴ（Ａ×Ａ＋Ｂ×Ｂ））で
ある。好適な近似はＭ＝ＬＡＲＧＥＲ（ＲＩ，ＲＱ）＋
１／２（ＳＭＡＬＬＥＲ（ＲＩ，ＲＱ））または（Ｍ＝
ＬＡＲＧＥＲ（Ａ，Ｂ）＋１／２（ＳＭＡＬＬＥＲ
（Ａ，Ｂ））である。従って、ＲＩがＲＱより大きい
（またはＡがＢより大きい場合）場合には、Ｍ＝ＲＩ＋
１／２×ＲＱ（またはＭ＝Ａ＋１／２×Ｂ）となる。
さ（Ｍ）（絶対値回路３４４および３４６が使用された
場合）またはＡおよびＢの大きさ（内積兼外積計算回路
３５８が使用された場合）に対する近似を計算する。古
典的な大きさの公式はＭ＝ＳＱＲＴ（ＲＩ×ＲＩ＋ＲＱ
×ＲＱ）（またはＭ＝ＳＱＲＴ（Ａ×Ａ＋Ｂ×Ｂ））で
ある。好適な近似はＭ＝ＬＡＲＧＥＲ（ＲＩ，ＲＱ）＋
１／２（ＳＭＡＬＬＥＲ（ＲＩ，ＲＱ））または（Ｍ＝
ＬＡＲＧＥＲ（Ａ，Ｂ）＋１／２（ＳＭＡＬＬＥＲ
（Ａ，Ｂ））である。従って、ＲＩがＲＱより大きい
（またはＡがＢより大きい場合）場合には、Ｍ＝ＲＩ＋
１／２×ＲＱ（またはＭ＝Ａ＋１／２×Ｂ）となる。
【００４８】Ｍの値は加算器３５２を使用してレジスタ
３５０に累積される。レジスタ３５０の値が閾値レジス
タ３５４に記憶された値を越えた場合（加算器３５６に
よって決定される場合）、意味のある信号が受信されて
いる（「検出閾値」を越えている）という有意の可能性
が存在する。従って状態マシーン３１６は閾値を越えて
いると知らされ、マイクロプロセッサ１０８はスリープ
・モードにある場合にはウエークアップされ得る。好適
には、送信機は任意の変調された情報の前にまず純粋な
サイン波またはコサイン波の搬送波をＢＣＤ１０２へ送
る。純粋な搬送波はレジスタ３５０の値が累算されて検
出器の閾値を越えるであろう可能性を増加させる。検出
閾値それ自身は、任意の特別応用のために誤り検出およ
び紛失メッセージの許容率を提供するためにレジスタ３
５４を使って設定される。
３５０に累積される。レジスタ３５０の値が閾値レジス
タ３５４に記憶された値を越えた場合（加算器３５６に
よって決定される場合）、意味のある信号が受信されて
いる（「検出閾値」を越えている）という有意の可能性
が存在する。従って状態マシーン３１６は閾値を越えて
いると知らされ、マイクロプロセッサ１０８はスリープ
・モードにある場合にはウエークアップされ得る。好適
には、送信機は任意の変調された情報の前にまず純粋な
サイン波またはコサイン波の搬送波をＢＣＤ１０２へ送
る。純粋な搬送波はレジスタ３５０の値が累算されて検
出器の閾値を越えるであろう可能性を増加させる。検出
閾値それ自身は、任意の特別応用のために誤り検出およ
び紛失メッセージの許容率を提供するためにレジスタ３
５４を使って設定される。
【００４９】好適な実施形態においては、大きさ近似回
路３４８の出力はアキュムレータ３６６に結合され、該
アキュムレータは順に移動平均計算器３６８に結合され
る。アキュムレータ３６６は好適には実行している全１
００の値を保持し、全１００個の累算値のトータルを移
動平均計算器３６８に引き渡す。移動平均計算器３６８
は好適にはアキュムレータ３６６によって引き渡された
最後の１０個の累算値の移動平均を決定する。移動平均
計算器３６８の出力はいつ検出閾値を越えたかを決定す
るために比較される。
路３４８の出力はアキュムレータ３６６に結合され、該
アキュムレータは順に移動平均計算器３６８に結合され
る。アキュムレータ３６６は好適には実行している全１
００の値を保持し、全１００個の累算値のトータルを移
動平均計算器３６８に引き渡す。移動平均計算器３６８
は好適にはアキュムレータ３６６によって引き渡された
最後の１０個の累算値の移動平均を決定する。移動平均
計算器３６８の出力はいつ検出閾値を越えたかを決定す
るために比較される。
【００５０】デジタルＩとＱのアキュムレータ３０８、
３１０における議論で上述したように、関連したレジス
タ３３６、３４０は好適には、レジスタの値を後続処理
に渡す前に４５のサンプルを累算する。さらに、二つの
二次のデジタルＩおよびＱアキュムレータ（図示されて
いない）はアキュムレータ３０８、３１０と同じ構造
（すなわちレジスタおよび加算器）を使用して提供され
得る。好適には、二次のデジタルＩおよびＱアキュムレ
ータは０にリセットされる前に１５のサンプルを累算す
る。ＩとＱサンプルの各１５のサンプル累算の後に、累
積された値はスナップショット・レコーダ３１４に記憶
される。
３１０における議論で上述したように、関連したレジス
タ３３６、３４０は好適には、レジスタの値を後続処理
に渡す前に４５のサンプルを累算する。さらに、二つの
二次のデジタルＩおよびＱアキュムレータ（図示されて
いない）はアキュムレータ３０８、３１０と同じ構造
（すなわちレジスタおよび加算器）を使用して提供され
得る。好適には、二次のデジタルＩおよびＱアキュムレ
ータは０にリセットされる前に１５のサンプルを累算す
る。ＩとＱサンプルの各１５のサンプル累算の後に、累
積された値はスナップショット・レコーダ３１４に記憶
される。
【００５１】本発明の一つの実施形態において、ＩとＱ
のアナログ／デジタル・コンバータ２７６、２８６は
１．５ＭＨｚでサンプルし、スナップショット・レコー
ダは２０００のＩと２０００のＱの値を記憶する。従っ
てスナップショット・レコーダ３１４は１００ＫＨｚレ
ート（１、５００、００／１５）でＩに対する新たな値
およびＱに対する新たな値を記憶し、２０ｍｓに値する
受信信号を記憶する（累積されたＩとＱのサンプルによ
って表現されるように）。送信された信号バースト（一
つの実施形態において）は約１０ｍｓ長と予想されるの
で、スナップショット・レコーダ３１４は、受信信号が
その初めまたは終わりに検出されたかに関係なくマイク
ロプロセッサ１０８に受信信号を回復することを可能と
するに充分なデータを記憶する。さらにデジタルＩ／Ｑ
復調器３０６内のＮＣＯは同様に１．５ＭＨｚでクロッ
クされ、デジタルＩ／Ｑダウンコンバータ・レジスタ３
３２の二つのＭＳＢは１００ＫＨｚ周波数信号の四つの
象限位相角を表現する。
のアナログ／デジタル・コンバータ２７６、２８６は
１．５ＭＨｚでサンプルし、スナップショット・レコー
ダは２０００のＩと２０００のＱの値を記憶する。従っ
てスナップショット・レコーダ３１４は１００ＫＨｚレ
ート（１、５００、００／１５）でＩに対する新たな値
およびＱに対する新たな値を記憶し、２０ｍｓに値する
受信信号を記憶する（累積されたＩとＱのサンプルによ
って表現されるように）。送信された信号バースト（一
つの実施形態において）は約１０ｍｓ長と予想されるの
で、スナップショット・レコーダ３１４は、受信信号が
その初めまたは終わりに検出されたかに関係なくマイク
ロプロセッサ１０８に受信信号を回復することを可能と
するに充分なデータを記憶する。さらにデジタルＩ／Ｑ
復調器３０６内のＮＣＯは同様に１．５ＭＨｚでクロッ
クされ、デジタルＩ／Ｑダウンコンバータ・レジスタ３
３２の二つのＭＳＢは１００ＫＨｚ周波数信号の四つの
象限位相角を表現する。
【００５２】代替的な実施形態においては、通信装置１
００を作動することから純トーン妨害を防止するために
ＦＭまたはＦＳＫ信号がウエークアップ信号として使用
され得る（上記のように仮定された持続波（ＣＷ）ウエ
ークアップ信号とは対照的に）。例えば、特定の周波数
に中心を有するＦＳＫ信号はウエークアップ信号を提供
するためにプラスまたはマイナス６ＫＨｚで変化され得
る。ＦＳＫウエークアップ信号（二つの周波数間で交番
している）と共に、ウエークアップ信号を検出するため
に図４に示されたような相関器が使用され得る。図４に
示された相関器４００は−−０＋＋−−０＋＋パターン
に割り当てられる１０個のタップ４０２を使用し（好適
にはそれぞれ１ミリ秒のサンプル時間を表現する）、こ
こで−はＦＳＫ信号の第１の周波数を示し、＋は第２の
周波数を示し、０は遷移中のノイズからの寄与を除去す
るために零にされた二つ周波数の間の遷移を示す。
００を作動することから純トーン妨害を防止するために
ＦＭまたはＦＳＫ信号がウエークアップ信号として使用
され得る（上記のように仮定された持続波（ＣＷ）ウエ
ークアップ信号とは対照的に）。例えば、特定の周波数
に中心を有するＦＳＫ信号はウエークアップ信号を提供
するためにプラスまたはマイナス６ＫＨｚで変化され得
る。ＦＳＫウエークアップ信号（二つの周波数間で交番
している）と共に、ウエークアップ信号を検出するため
に図４に示されたような相関器が使用され得る。図４に
示された相関器４００は−−０＋＋−−０＋＋パターン
に割り当てられる１０個のタップ４０２を使用し（好適
にはそれぞれ１ミリ秒のサンプル時間を表現する）、こ
こで−はＦＳＫ信号の第１の周波数を示し、＋は第２の
周波数を示し、０は遷移中のノイズからの寄与を除去す
るために零にされた二つ周波数の間の遷移を示す。
【００５３】図４に示されたように、内積と外積用に別
々の相関器が使用可能である。外相関器４０４は、アキ
ュムレータ４０６（好適には１ミリ秒のサンプルを提供
するしている）に続く。それから外相関器４０４の出力
４０８は大きさ近似回路３４８に接続され得る。同様に
内相関器４１０はアキュムレータ４１２に続き得る。そ
れから内相関器４１０の出力４１４（絶対値回路４１６
によって動作された後）は、大きさ近似回路３４８へ提
供され得る。
々の相関器が使用可能である。外相関器４０４は、アキ
ュムレータ４０６（好適には１ミリ秒のサンプルを提供
するしている）に続く。それから外相関器４０４の出力
４０８は大きさ近似回路３４８に接続され得る。同様に
内相関器４１０はアキュムレータ４１２に続き得る。そ
れから内相関器４１０の出力４１４（絶対値回路４１６
によって動作された後）は、大きさ近似回路３４８へ提
供され得る。
【００５４】さらにＦＳＫウエークアップ信号検出の別
の代替として、計算回路３５８の外積出力は発振のため
に調べられ得る。適切な検出器は図５に示されており、
ＮＣＯ５０２、ミキサ５０４、５０６、アキュムレータ
５０８、５１０を含む。さらに移動平均回路５１２、５
１４、絶対値回路５２０，５２２、Ｉ／Ｑ大きさ回路５
１６、閾値検出回路５１８が示されている。動作におい
ては、計算回路３５８の外積出力は二つのミキサ５０
４、５０６に提供される。ＮＣＯ５０２はウエークアッ
プ信号のＦＳＫ変調を原因とする出力積信号の期待周波
数変化に合致するようにセットされる。
の代替として、計算回路３５８の外積出力は発振のため
に調べられ得る。適切な検出器は図５に示されており、
ＮＣＯ５０２、ミキサ５０４、５０６、アキュムレータ
５０８、５１０を含む。さらに移動平均回路５１２、５
１４、絶対値回路５２０，５２２、Ｉ／Ｑ大きさ回路５
１６、閾値検出回路５１８が示されている。動作におい
ては、計算回路３５８の外積出力は二つのミキサ５０
４、５０６に提供される。ＮＣＯ５０２はウエークアッ
プ信号のＦＳＫ変調を原因とする出力積信号の期待周波
数変化に合致するようにセットされる。
【００５５】アキュムレータ５０８、５１０および移動
平均回路５１２，５１４は結果として生じたＩおよびＱ
の要素を累積および平均し、その絶対値（絶対値回路５
２０、５２２を使用して）を大きさ回路５１６に提供す
る。大きさ回路５１６は大きさ近似回路３５８に関して
上述したように動作する。大きさ回路５１６の出力は、
実際に受信信号がウエークアップ閾値を越えているかを
決定するために閾値検出器５１８によって閾値と比較さ
れる。
平均回路５１２，５１４は結果として生じたＩおよびＱ
の要素を累積および平均し、その絶対値（絶対値回路５
２０、５２２を使用して）を大きさ回路５１６に提供す
る。大きさ回路５１６は大きさ近似回路３５８に関して
上述したように動作する。大きさ回路５１６の出力は、
実際に受信信号がウエークアップ閾値を越えているかを
決定するために閾値検出器５１８によって閾値と比較さ
れる。
【００５６】上述したように、一度受信信号が検出閾値
を越えた場合には、マイクロプロセッサ１０８はスナッ
プショット・レコーダ３１４に記憶されたＩとＱの累積
値を処理するためにウエークアップされ得る。最初に、
マイクロプロセッサ１０８はスナップショット・レコー
ダ３１４に記憶された信号の周波数を決定する（例え
ば、上述されたようにＡＴＡＮ２（Ａ，Ｂ）を計算しお
よび平均をとることによって）。それからマイクロプロ
セッサは次のバースト（予め規定された信号環境におい
て、固定された時間、例えば９０ｍｓの後に起きる）を
捕らえるためにスナップショット・レコーダ３１４を制
御する。
を越えた場合には、マイクロプロセッサ１０８はスナッ
プショット・レコーダ３１４に記憶されたＩとＱの累積
値を処理するためにウエークアップされ得る。最初に、
マイクロプロセッサ１０８はスナップショット・レコー
ダ３１４に記憶された信号の周波数を決定する（例え
ば、上述されたようにＡＴＡＮ２（Ａ，Ｂ）を計算しお
よび平均をとることによって）。それからマイクロプロ
セッサは次のバースト（予め規定された信号環境におい
て、固定された時間、例えば９０ｍｓの後に起きる）を
捕らえるためにスナップショット・レコーダ３１４を制
御する。
【００５７】また図３について言及すると、ルックアッ
プ・テーブル３７２、デジタル／アナログ・コンバータ
３７４、３７６、ローパス・フィルタ３７８、３８０を
含む周波数シンセサイザ３７０が示されている。動作に
おいては、ルックアップ・テーブル３７２は（例えば）
ＮＣＯ３３２から８ビットを受け取り、応答してデジタ
ル化されたサインとコサインの値を例えば６ビットの分
解能で出力する。サインとコサインの値はアナログに変
換され、ローパス・フィルタされる。結果として生じた
信号はアップコンバージョンおよびデータ送信処理の部
分としてミキサ入力２４６、２５４へ提供される。従っ
て、パラメータ（例えば周波数シフトコード、周波数訂
正コード）をメモリ１２２に記憶することによって、送
信周波数を所望値にシフトし、随意に公称水晶１０４の
エラー（つまり製造公差およびそれと同様なもの）を補
償するために、ＮＣＯ３３２は使用されうる。
プ・テーブル３７２、デジタル／アナログ・コンバータ
３７４、３７６、ローパス・フィルタ３７８、３８０を
含む周波数シンセサイザ３７０が示されている。動作に
おいては、ルックアップ・テーブル３７２は（例えば）
ＮＣＯ３３２から８ビットを受け取り、応答してデジタ
ル化されたサインとコサインの値を例えば６ビットの分
解能で出力する。サインとコサインの値はアナログに変
換され、ローパス・フィルタされる。結果として生じた
信号はアップコンバージョンおよびデータ送信処理の部
分としてミキサ入力２４６、２５４へ提供される。従っ
て、パラメータ（例えば周波数シフトコード、周波数訂
正コード）をメモリ１２２に記憶することによって、送
信周波数を所望値にシフトし、随意に公称水晶１０４の
エラー（つまり製造公差およびそれと同様なもの）を補
償するために、ＮＣＯ３３２は使用されうる。
【００５８】さらに通信装置１００は異なる速度で通信
するための能力を随意に含み得る。このように、例え
ば、通信装置１００は、受信機から高速度の応答を得る
ために実質的な情報により後続される相対的に高速ウエ
ークアップ信号（例えば毎秒１０キロバイト）を最初に
送信する。高速度で信頼性ある通信にとって、通信装置
１００が受信機からあまりに離れている場合、受信機は
送信信号を正確にデコードせず一般的には応答を送らな
いであろう。それから通信装置１００は相対的により低
速度で再び送信する（例えば毎秒１キロバイト）。典型
的には、通信装置１００における信号サンプリングはデ
ータ速度のいくつかの倍数で起きる（例えばデータ速度
の１０倍）。従って双方の送信速度のためにスナップシ
ョット・レコーダ３１４を適応する場合、メモリの大き
さは増加することが出来、また同じメモリの大きさを維
持しつつデータ速度の倍数を減少することが出来る。代
替的には同じメモリの大きさを維持しつつ、サンプルあ
たり記憶ビット数は減少し得る。
するための能力を随意に含み得る。このように、例え
ば、通信装置１００は、受信機から高速度の応答を得る
ために実質的な情報により後続される相対的に高速ウエ
ークアップ信号（例えば毎秒１０キロバイト）を最初に
送信する。高速度で信頼性ある通信にとって、通信装置
１００が受信機からあまりに離れている場合、受信機は
送信信号を正確にデコードせず一般的には応答を送らな
いであろう。それから通信装置１００は相対的により低
速度で再び送信する（例えば毎秒１キロバイト）。典型
的には、通信装置１００における信号サンプリングはデ
ータ速度のいくつかの倍数で起きる（例えばデータ速度
の１０倍）。従って双方の送信速度のためにスナップシ
ョット・レコーダ３１４を適応する場合、メモリの大き
さは増加することが出来、また同じメモリの大きさを維
持しつつデータ速度の倍数を減少することが出来る。代
替的には同じメモリの大きさを維持しつつ、サンプルあ
たり記憶ビット数は減少し得る。
【００５９】ここで図６について述べると、図は上述さ
れたウエークアップ検出を網羅している高レベルの流れ
図６００を説明している。ステップ６０２で、通信装置
は入力信号を受信する。ステップ６０４で結果として受
信された信号はダウンコンバートされ、ステップ６０６
でデローテートされる。ステップ６０８で、ウエークア
ップ状態決定の用意のためにデローテートされたＩ／Ｑ
値が累積される。
れたウエークアップ検出を網羅している高レベルの流れ
図６００を説明している。ステップ６０２で、通信装置
は入力信号を受信する。ステップ６０４で結果として受
信された信号はダウンコンバートされ、ステップ６０６
でデローテートされる。ステップ６０８で、ウエークア
ップ状態決定の用意のためにデローテートされたＩ／Ｑ
値が累積される。
【００６０】ステップ６１０で、例えば、デローテート
されたＩ／Ｑの値の内積と外積が形成される。図３にお
いて上述したように内積と外積は持続波ウエークアップ
信号を検出するために使用可能で、または内積と外積の
相関（ステップ６１２）に関連して変調されたウエーク
アップ信号を検出するために使用可能である。ステップ
６１４では、ウエークアップ信号の存在を示す大きさ出
力が生成される。大きさ出力は、例えばデローテートさ
れたＩ／Ｑの値、内積および外積、または相関された内
積および外積の値から形成され得る。大きさの累積（ス
テップ６１６）と大きさの移動平均の随意的形成（ステ
ップ６１８）の後に、通信装置は所定閾値に対して比較
をし、ウエークアップ信号が実際に受け取られたかを決
定し得る。
されたＩ／Ｑの値の内積と外積が形成される。図３にお
いて上述したように内積と外積は持続波ウエークアップ
信号を検出するために使用可能で、または内積と外積の
相関（ステップ６１２）に関連して変調されたウエーク
アップ信号を検出するために使用可能である。ステップ
６１４では、ウエークアップ信号の存在を示す大きさ出
力が生成される。大きさ出力は、例えばデローテートさ
れたＩ／Ｑの値、内積および外積、または相関された内
積および外積の値から形成され得る。大きさの累積（ス
テップ６１６）と大きさの移動平均の随意的形成（ステ
ップ６１８）の後に、通信装置は所定閾値に対して比較
をし、ウエークアップ信号が実際に受け取られたかを決
定し得る。
【００６１】ソース・コード付録に提示された以下のア
ルゴリズムは、プロセッサ１０８によって引き受けられ
た信号処理の実現を提供する。アルゴリズムは情報ビッ
トの復調および検出（ランダムＢＰＳＫビットを含んで
いるバーストのため）と同様に、周波数および到達時間
の推定（ＣＷバーストまたはＢＰＳＫタイミング参照パ
ターンを含んでいるバーストのために）を含む。
ルゴリズムは、プロセッサ１０８によって引き受けられ
た信号処理の実現を提供する。アルゴリズムは情報ビッ
トの復調および検出（ランダムＢＰＳＫビットを含んで
いるバーストのため）と同様に、周波数および到達時間
の推定（ＣＷバーストまたはＢＰＳＫタイミング参照パ
ターンを含んでいるバーストのために）を含む。
【００６２】アルゴリズムはマスキャド（Ｍａｔｈｃａ
ｄ）・プログラム言語（ファイル名が．ｍｃｄで終わっ
ている）およびＣ（ファイル名が．ｃで終わっている）
で書かれたソフトウエア・ルーチンとして提示される。
ルーチンは以下のように名前が付けられ記述される。
ｄ）・プログラム言語（ファイル名が．ｍｃｄで終わっ
ている）およびＣ（ファイル名が．ｃで終わっている）
で書かれたソフトウエア・ルーチンとして提示される。
ルーチンは以下のように名前が付けられ記述される。
【００６３】
【表２】
【００６４】このように本双方向通信装置は、高性能ウ
エークアップ検出器を有する長範囲、低電力通信装置を
提供する。ウエークアップ検出器は通信装置が電力を節
約することを可能としさらに、ウエークアップ信号それ
自身と同様、ウエークアップ信号送信後の実質的な通信
信号を信頼性よく受信し、デコードし、処理する。スナ
ップショット・メモリは特定の実施形態においては、実
質的な通信信号と同様、ウエークアップ信号のための記
憶装置を提供する。関連したマイクロプロセッサはスナ
ップショット・メモリの内容を調べ、例えば、粗いまた
は細密な周波数の推定を実行し、または有用なデータを
デコードし、引き出すことができる。
エークアップ検出器を有する長範囲、低電力通信装置を
提供する。ウエークアップ検出器は通信装置が電力を節
約することを可能としさらに、ウエークアップ信号それ
自身と同様、ウエークアップ信号送信後の実質的な通信
信号を信頼性よく受信し、デコードし、処理する。スナ
ップショット・メモリは特定の実施形態においては、実
質的な通信信号と同様、ウエークアップ信号のための記
憶装置を提供する。関連したマイクロプロセッサはスナ
ップショット・メモリの内容を調べ、例えば、粗いまた
は細密な周波数の推定を実行し、または有用なデータを
デコードし、引き出すことができる。
【００６５】本発明の特定の構成要素、実施形態、応用
は示され、記述されているが、一方で、特に前述の教示
の観点において、当業者によって変更がなされ得るので
本発明はそれには限定されないということが理解され
る。従ってそれらの変更をカバーし、本発明の趣旨およ
び範囲にある特性を組み込むことは、添付された請求項
によって熟考される。
は示され、記述されているが、一方で、特に前述の教示
の観点において、当業者によって変更がなされ得るので
本発明はそれには限定されないということが理解され
る。従ってそれらの変更をカバーし、本発明の趣旨およ
び範囲にある特性を組み込むことは、添付された請求項
によって熟考される。
【図１】長範囲双方向通信装置のブロック図を示してい
る。
る。
【図２】受信機と送信機の信号処理を含む、長範囲双方
向通信装置の無線周波数と中間周波数部分の概略表示を
説明している。
向通信装置の無線周波数と中間周波数部分の概略表示を
説明している。
【図３】長範囲双方向通信装置のデジタル処理部分を示
すブロック図を示している。
すブロック図を示している。
【図４】ＦＳＫウエークアップ信号を検出するために使
用される相関器回路の例を示している。
用される相関器回路の例を示している。
【図５】ＦＳＫウエークアップ信号検出器の別の例を示
している。
している。
【図６】通信装置をウエークアップするための方法の高
レベル流れ図を示している。
レベル流れ図を示している。
１００ 長範囲低電力通信装置 １０２ 長範囲双方向通信装置（ＢＣＤ） １０６ ＤＣ／ＤＣコンバータ １０８ マイクロプロセッサ １１０ コーディング／デコーディング・チップ １１４ 送受信用アンテナ １１６ ＲＦ／ＩＦ処理ファンクション １１８ ＲＦ／ＩＦ処理ファンクション １２０ デジタル処理ファンクション １２２ メモリ ２００ アナログ部分 ２０２ 送受信ブロック ２０４ アナログＩ／Ｑダウンコンバータ・ブロック ２０６ アナログＩ／Ｑアップコンバータ・ブロック ２０８ Ｉアナログ／デジタル・コンバータ・ブロック ２１０ Ｑアナログ／デジタル・コンバータ・ブロック ２１２ 周波数ソースブロック ２１４ 送信／受信スイッチ ２２０ 信号スプリッタ ２２２ ダウンコンバータＩミキサ ２３０ ダウンコンバータＱミキサ ２３８ 発振器位相シフタ ２５８ 発振器位相シフタ ２７６ Ｉアナログ／デジタルコンバータ ２７８ Ｑアナログ／デジタルコンバータ ２８６ アナログ／デジタル・コンバータ ２９０ 位相検出器 ２９４ 電圧制御発振器（ＶＣＯ） ２９６ 除算器 ３００ デジタル部分 ３０２ ＩとＱのオフセット補正器 ３０４ ＩとＱのオフセット補正器 ３０６ デジタルＩ／Ｑダウンコンバータ ３０８ デジタルＩアキュムレータ ３１０ デジタルＱアキュムレータ ３１２ ウエークアップ検出器 ３１４ スナップショット・レコーダ ３１６ 状態マシーン ３３０ １６×２ルックアップ・テーブル ３４４ Ｉ絶対値回路 ３４６ Ｑ絶対値回路 ３４８ 大きさ近似回路 ３５４ 閾値レジスタ ３５８ 内積兼外積計算回路 ３６０ 内積用アキュームレータ ３６２ 外積用アキュームレータ ３６４ スナップショットＲＡＭ ３６６ アキュムレータ ３６８ 移動平均計算器 ３７０ 周波数シンセサイザー ３７２ ルックアップ・テーブル ４００ 相関器 ４０４ 外相関器 ４０６ アキュムレータ ４１０ 内相関器 ４１２ アキュムレータ ４１６ 絶対値回路 ５０８ アキュムレータ ５１０ アキュムレータ ５１２ 移動平均回路 ５１４ 移動平均回路 ５１６ Ｉ／Ｑ大きさ回路 ５１８ 閾値検出回路
───────────────────────────────────────────────────── フロントページの続き (72)発明者 バーリー・アール・アレン アメリカ合衆国カリフォルニア州90277, リダンド・ビーチ，アベニュー・ビー 631 (72)発明者 バーリー・ダンブリッジ アメリカ合衆国カリフォルニア州90505, トーランス，コートニー・ウェイ 3614 (72)発明者 ジョージ・ダブリュー・マクアイヴァー アメリカ合衆国カリフォルニア州90277, リダンド・ビーチ，ノース・ポーリナ・ア ベニュー 801 Ｆターム(参考） 5H180 AA01 BB04 BB06 BB08 5K004 AA05 FA05 FG04 5K011 BA10 DA03 DA15 JA01 KA03 KA18
Claims (18)
- 【請求項１】 信号を送信し受信するためのアンテナ
と、 前記アンテナに結合された送信回路および受信回路を含
み、前記アンテナに結合されたアナログ部分と、 前記受信回路は中間周波数ダウンコンバータ、デジタル
同相出力、デジタル直交位相出力を含み、 前記デジタル同相出力および前記デジタル直交位相出力
に結合され、Ｉ出力およびQ出力を含むＩ／Ｑデローテ
ータと、大きさ出力を含む大きさ回路と前記大きさ出力
に結合された閾値比較回路を含むウエークアップ検出器
とを含むデジタル部分と、 前記閾値比較回路は、前記大きさ出力とウエークアップ
信号受信条件を示す閾値を比較する、を含む通信装置。 - 【請求項2】 前記ウエークアップ検出器は前記大きさ
出力および前記閾値比較回路に結合されたアキュムレー
タをさらに含むことを特徴とする、請求項１に記載の通
信装置。 - 【請求項3】 前記ウエークアップ検出器は前記アキュ
ムレータと前記閾値比較回路との間に移動平均回路をさ
らに含むことを特徴とする、請求項２に記載の通信装
置。 - 【請求項４】 前記デジタル部分は、 前記Ｉ出力と前記Ｑ出力に結合された内積回路および外
積回路と、 前記内積/外積回路と前記大きさ回路との間に結合され
たＩアキュムレータと、 前記内積/外積回路と前記大きさ回路との間に結合され
たQアキュムレータと、をさらに含む、請求項１に記載
の通信装置。 - 【請求項５】 前記デジタル部分は、 前記Ｉ出力および前記Q出力に結合された内積/外積回路
と、 前記内積/外積回路と前記大きさ回路の間に結合された
内相関器と、 前記大きさ回路に結合された絶対値回路に結合された外
相関器と、をさらに含む、請求項1に記載の通信装置。 - 【請求項６】 前記内積、外積回路と前記外相関器との
間に結合されたＩアキュムレータと、前記内積、外積回
路と前記内相関器との間に結合されたＱアキュムレータ
をさらに含む、請求項５に記載の通信装置。 - 【請求項７】 前記大きさ出力が同相値と直交値のうち
のより大きい値と、前記同相値と前記直交値のうちのよ
り小さな値の半分の加算示す値を搬送することを特徴と
する、請求項１に記載の通信装置。 - 【請求項８】 前記アナログ部分はさらに、前記中間周
波数ダウンコンバータと前記デジタル同相出力に結合さ
れた同相アナログ/デジタルコンバータと、前記中間周
波数ダウンコンバータと前記デジタル直交位相出力に結
合された直交位相アナログ/デジタルコンバータを含む
ことを特徴とする、請求項１に記載の通信装置。 - 【請求項９】 前記アンテナに結合された送信増幅器
と、 前記送信増幅器に結合され、I入力とQ入力とを含むアッ
プコンバータと、 前記Ｉ入力と前記Q入力に結合された周波数シンセサイ
ザと、 前記周波数シンセサイザに結合された数値制御発振器
と、を含むことを特徴とする、請求項１に記載の通信装
置。 - 【請求項１0】 前記送信増幅器に結合されたマイクロ
プロセッサと、 前記マイクロプロセッサに結合され、送信増幅器の電力
レベルコードを含むメモリと、をさらに含む、請求項９
に記載の通信装置。 - 【請求項１1】 前記送信増幅器に結合されたマイクロ
プロセッサと、 前記マイクロプロセッサに結合され、前記数値制御発振
器のための周波数シフトコードを含むメモリと、をさら
に含む、請求項９に記載の通信装置。 - 【請求項１2】 前記メモリが前記数値制御発振器のた
めの周波数訂正コードをさらに含むことを特徴とする、
請求項１１に記載の通信装置。 - 【請求項１3】 受信信号を発生させるためにアンテナ
で入力信号を受信するステップと、 デジタルＩ出力とデジタルＱ出力と発生させるために前
記受信信号をダウンコンバートするステップと、 デローテートされたＩ出力とQ出力を発生させるために
前記デジタルＩ出力と前記デジタルQ出力をデローテー
トするステップと、 前記デローテートされたＩ出力とQ出力と関連した大き
さ出力を発生させるステップと、 累積された前記大きさが所定の閾値を越える時を決定す
るステップと、を含む、持続波または変調されたウエー
クアップ信号を使用する通信装置を作動する方法。 - 【請求項１4】 大きさ出力を発生させるステップは、
二つの入力値のうちのより大きな値と二つの前記入力値
のうちの小さな値の半分の加算に相当する大きさ出力を
発生させるステップを含むことを特徴とする、請求項１
３に記載の方法。 - 【請求項１5】 前記発生させるステップの前に、前記
デローテートされたＩとＱ出力を累算するステップをさ
らに含む、請求項1３に記載の方法。 - 【請求項１6】 前記デローテートされたＩとＱ出力の
外積および内積を形成するステップとを含み、大きさ出
力を発生させるステップが前記内積と外積のうちのより
大きな値と、前記内積と外積の値のより小さな値の半分
の加算に相当する大きさ出力を発生させるステップを含
むことを特徴とする、請求項１３に記載の方法。 - 【請求項１7】 前記デローテートされたＩとＱ出力の
内積と外積を形成するステップと、 前記発生させるステップの前に相関された内積と相関さ
れた外積を発生させるステップと、をさらに含む、請求
項１３に記載の方法。 - 【請求項１8】 前記発生させるステップの前に、前記
相関された内積の絶対値を形成するステップをさらに含
むことを特徴とする、請求項１７に記載の方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US58521200A | 2000-06-01 | 2000-06-01 | |
| US09/585212 | 2000-06-01 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2002042295A true JP2002042295A (ja) | 2002-02-08 |
| JP3703733B2 JP3703733B2 (ja) | 2005-10-05 |
Family
ID=24340474
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2001120548A Expired - Fee Related JP3703733B2 (ja) | 2000-06-01 | 2001-04-19 | 長範囲双方向低電力通信装置 |
Country Status (4)
| Country | Link |
|---|---|
| EP (1) | EP1164708B1 (ja) |
| JP (1) | JP3703733B2 (ja) |
| KR (1) | KR20010109475A (ja) |
| DE (1) | DE60112843T2 (ja) |
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-
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- 2001-04-19 JP JP2001120548A patent/JP3703733B2/ja not_active Expired - Fee Related
- 2001-05-16 DE DE60112843T patent/DE60112843T2/de not_active Expired - Fee Related
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|---|---|---|---|---|
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