DE2441170C2 - Verfahren zur Herstellung einer Halbleiteranordnung - Google Patents
Verfahren zur Herstellung einer HalbleiteranordnungInfo
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Description
a) auf die Oberfläche des Siliciumkörpers wird eine Oxidationsmaske aufgebracht, deren Fenster
dem Muster der zu bildenden versenkten Siliciumoxidschicht entsprechen,
b) durch die Fenster der Oxidationsmaske hindurch wkd der Siliciumkörper in denjenigen
Bereichen ausgehöhlt, in denen die versenkte Siliciumoxidschicht zu bilden ist,
c) der Siliciumkörper wird einer Oxidationsbehandlung
unterworfen, dadurch gekennzeichnet,
daß zwischen den Verfahrensschritten b) und c) die Seitenwände der ausgehöhlten Bereiche (6) des Siliciumkörpers (3) mit
einer gegen Oxidation schützenden Maskierungsschicht (16) abgedeckt werden.
2. Verfahren nach Anspruch 1, dadurch gekennzeichnet, daß die Maskierungsschicht (16) vom Boden
(7) der ausgehöhlten Bereiche (6) bis zu der Oxidationsmaske (5) reicht.
3. Verfahren nach Anspruch 1 oder 2, bei dem die Aushöhlung durch Ätzung unter Verwendung der
Oxidationsmaske als Ätzmaske gebildet wird, wobei die Oxidationsmaske lateral unterätzt wird dergestalt,
daß ihr Rand über den Rand der Aushöhlung hinausragt, dadurch gekennzeichnet, daß das Material
der Maskierungsschicht (16) zunächst sowohl auf der Oxidationsmaske (5) als auch an den Seitenwänden
und dem Boden der Aushöhlung (6) aufgebracht wird, daß das so aufgebrachte Material der Maskierungsschicht
(16) dann mit einem strahlungsempfindlichen Positivlack (19) überzogen wird, der in der
Aushöhlung (6) bis zum Rand der Oxidationsmaske (5) reicht, daß der Positivlack (19) dann mit einer
Strahlung belichtet wird, wobei der Positivlack (19) an den Seitenwänden der Aushöhlung (6) du,"ch den
Rand der Oxidationsmaske (5) gegen Belichtung abgeschirmt wird, daß anschließend der belichtete Teil
des Positivlacks (19) entfernt wird und daß das Material der Maskierungsschicht (16) dann überall dort
weggeätzt wird, wo es nicht mehr mit dem Positivlack (19) überzogen ist, wobei der verbleibende Teil
des Positivlacks (19) als Ätzmaske dient.
4. Verfahren nach Anspruch 3, dadurch gekennzeichnet, daß vor dem Aufbringen des Positivlacks
(19) auf das Material der Maskierungsschicht (16) eine dünne strahlungsundurchlässige Schicht (18)
aufgebracht wird, die den Positivlack (19) an den Seitenwänden der Aushöhlung zusätzlich gegen die
Belichtung abschirmt.
5. Verfahren nach Anspruch 4, dadurch gekennzeichnet,
daß die dünne strahlungsundurchlässige Schicht (18) aus Metall besteht.
6. Verfahren nach einem der vorangehenden Ansprüche, dadurch gekennzeichnet, daß das Material
der Maskierungsschicht (16) während des Verfahrensschritts c) in ein isolierendes Oxid umgewandelt
wird, daß auf der Halbleiteranordnung belassen
wird.
7. Verfahren nach Anspruch 6, dadurch gekennzeichnet, daß die Maskierungsschicht (16) so dünn
hergestellt wird, daß ihr Materia! während des Verfahrensschritts c) vollständig in das isolierende Oxid
umgewandelt wird.
8. Verfahren nach einem der vorangehenden Ansprüche, dadurch gekennzeichnet, daß die Maskierungsschicht
(16) Siliciumnitrid enthält.
9. Verfahren nach einem der vorangehenden Ansprüche, dadurch gekennzeichnet, daß die versenkte
Siliciumoxidschicht (8) bis zu einer Dicke gebildet wird, die der doppelten Tiefe der Aushöhlung (6)
entspricht, so daß eine nahezu ebene Oberfläche der Halbleiteranordnung erzielt wird.
Die Erfindung betrifft ein Verfahren zu Herstellung einer Halbleiteranordnung entsprechend dem Oberbegriff
des Patentanspruchs 1..
Ein Verfahren dieser Art ist aus der DE-OS 21 33 978 bekannt.
Ein solches Verfahren kann bei der Herstellung verschiedener Halbleiteranordnungen, z. B. diskreter Transistoren
cder integrierte Schaltungen, verwendet werden. In den GB-PS 12 08 576 - 12 08 578 und 12 35 177
— 12 35 179 sind Verfahren zur Herstellung einer HaIbleiteranordnung
beschrieben, bei denen eine Oberfläche eines aus Silicium bestehenden Teiles eines Körpers einer
Oxidationsbehandlung unterworfen wird, während die genannte Oberfläche selektiv gegen Oxidation
durch eine darauf aufgebrachte Maskierungsschicht maskiert ist. An der Stelle des nicht maskierten Teiles
der genannten Oberfläche wächst ein Oxid des Süiciums in dem Silicium an zur Bildung einer Siliciumoxidschicht,
die wenigstens über einen Teil ihrer Dicke in den Teil des Siliciumkörpers versenkt ist. Eine derartige örtliche
Oxidation von Silicium ist unter der abgekürzten Bezeichnung >» LOCOS« bekannt und ist in einem Aufsatz
von Appels und Kooi und anderen mit dem Titel »Local oxidation of silicon and its application in semiconductor
device technology« in Philips Research Reports, 25, Nr. 2(April 1970), Seiten 118-132 beschrieben.
Die Maskierungsschicht besteht z. B. aus Siliciumnitrid oder aus Siliciumnitrid auf einer dünnen Siliciumoxidschicht
(mit einer Dicke von einigen Zehn nm).
Wie in der GB-PS 12 08 577 beschrieben ist, kann die Siliciumoxidschicht über mehr als die Hälfte ihrer Dicke in das Silicium versenkt werden, wenn der nicht maskierte Teil der Oberfläche nicht nur einer Oxidationsbehandlung sondern auch noch einer Materialentfernungsbehandlung unterworfen wird. Es ist bekannt, eine Aushöhlung in der Oberfläche an der Stelle zu bilden, an der die versenkte Siliciumoxidschicht gebildet werden muß. Eine derartige Aushöhlung kann dadurch gebildet werden, daß vor der Oxidation Silicium von dem genannten nicht maskierten Teil der Oberfläche abgeätzt wird. Die Aushöhlung kann auch dadurch gebildet werden, daß der nicht maskierte Teil oxidiert und das gebildete Siliciumoxid weggeätzt wird, wonach dann die genannte Siliciumoxidschicht dadurch gebildet wird, daß aufs neue oxidiert wird.
Wie in der GB-PS 12 08 577 beschrieben ist, kann die Siliciumoxidschicht über mehr als die Hälfte ihrer Dicke in das Silicium versenkt werden, wenn der nicht maskierte Teil der Oberfläche nicht nur einer Oxidationsbehandlung sondern auch noch einer Materialentfernungsbehandlung unterworfen wird. Es ist bekannt, eine Aushöhlung in der Oberfläche an der Stelle zu bilden, an der die versenkte Siliciumoxidschicht gebildet werden muß. Eine derartige Aushöhlung kann dadurch gebildet werden, daß vor der Oxidation Silicium von dem genannten nicht maskierten Teil der Oberfläche abgeätzt wird. Die Aushöhlung kann auch dadurch gebildet werden, daß der nicht maskierte Teil oxidiert und das gebildete Siliciumoxid weggeätzt wird, wonach dann die genannte Siliciumoxidschicht dadurch gebildet wird, daß aufs neue oxidiert wird.
h5 Die Tiefe einer derartigen Aushöhlung kann entsprechend
der gewünschten Dicke der Oxidschicht gewählt werden, so daß die Oxidschicht über praktisch ihre ganze
Dicke in den Teilen des Siliciumkörpers versenkt ist.
Siliciumoxid weist ein spezifisches Volumen auf, das etwa gleich dem Zweifachen des spezifischen Volumens
der, Siliciums ist, aus dem dieses Siliciumoxid durch Oxidation
erhalten ist. so daß eine Aushöh/ung mit einer Tiefe von etwa 1 μιτι erforderlich ist, um eine 2 μΐη dicke
Oxidschicht völlig zu versenken. Auf diese Weise kann eine praktisch ebene Oberfläche aus Siliciumoxid und
Silicium in der hergestellten Halbleiteranordnung erhalten werden. Die nach der Oxidation erhaltene Oberfläche
ist aber nicht völlig eben, weil am Rande der Oxidschicht,
der an die genannte Maskierungsschicht grenzt, eine kleine Erhöhung gebildet werden wird. Diese kleine
Erhöhung wird wegen der Form ihres Querschnittes auch als »Vogelkopf« bezeichnet; die Erhöhung wird
infolge des größeren spezifischen Volumens von Siliciumoxid bei der an den Seitenwänden der Aushöhlung
erfolgenden lateralen Oxidation gebildet Diese Erscheinung wurde bereits von Appels und Paffen in »Philips
Research Reports«, Heft 26, Nr. 3, (Juni 1971), Seiten 157—165 beschrieben. Wenn die gegen Oxidation
maskierende Schicht eine zusammengesetzte Schicht aus Siliciumnitrid auf Siliciumoxid ist, wird neben dem
»Vogelkopf« ein Oxid-»Schnabel« gebildet. Das Vorhandensein dieses Schnabels läßt sich durch eine zusätzliche
Zufuhr von Sauerstoff erklären, die seitlich durch die dünne Oxidschicht der zusammengesetzten Maskierungsschicht
hin erfolgt.
Der Erfindung liegt die Aufgabe zugrunde, ein Verfahren der eingangs genannten Art so auszugestalten,
daß die Größe des Vogelkopfes herabgesetzt wird.
Diese Aufgabe wird erfindungsgemäß durch die im Patentanspruch 1 gekennzeichnete Erfindung gelöst.
Weitere Ausgestaltungen der Erfindung ergeben sich aus den Unteransprüchen.
Durch das Verfahren nach der Erfindung kann die Größe entstehender Oxid-»Vogelköpfe« erheblich herabgesetzt
oder ihre Bildung sogar verhindert werden. Man kann in der Maskierungsschicht ein ähnliches Material
verwenden wie in der Oxidationsmaske.
Vorzugsweise wird die Maskierungsschicht derart angebracht, daß sie sich der Oxidationsmaske anschließt,
so daß laterale Oxidation über die ganze Seitenwand der Aushöhlung gehemmt wird.
Unter Verwendung der Oxidationsmaske als Ätzmaskierungsschicht kann die Aushöhlung auf einfache Weise
durch eine Ätzbehandlung gebildet werden, während der eine seitliche Ätzung an der Seitenwand der Aushöhlung
unter dem Rande der Oxidationsmaske stattfindet, so daß der genannte Rand seitlich über der genannten
Aushöhlung hervorragt.
Ein derartiger hervorragender Oxidationsmaskenrand kann zusammen mit einem strahlungsempfindlichen
Positivlack zur Bildung der Maskierungsschicht auf den Seitenwänden der Aushöhlung verwendet werden,
ohne daß eine äußere Maske in bezug auf das Muster der Oxidationsmaske und auf die bereits angebrachte
Aushöhlung ausgerichtet zu werden braucht. In diesem Zusammenhang sei auf die GB-PS 13 11 509 verwiesen,
in der ein Verfahren zum Ätzen einer Oberfläche unter Verwendung einer Maske beschrieben ist, die eo
einen Teil der Oberfläche gegen das Ätzmittel maskiert, wobei die zu ätzende Oberfläche mit dieser Maske in
Form einer Ät/.maskierungsschichi versehen wird, die
für Strahlung undurchlässig ist, die in einem nächsten Schrill des Verfahrens zur Belichtung eines Photolackes b5
verwendet wird. Dabei wird eine Behandlung entweder während des Anbringcns eier Maske oder in einem darauffolgenden
Schritt durchgeführt, mit deren Hilfe eine Aussparung zwischen einem Rand der Maskierungsschicht
und dem unterliegenden Teil der Oberfläche gebildet wird, wonach die Maskierungsschicht und der
nicht maskierte Teil der Oberfläche mit einem positiven Photolack überzogen wird, der bis in die genannte Aussparung
unter dem Rande der Maskierungsschicht vordringt. Wenn die genannte Strahlung auf die Oberfläche
gerichtet wird, um den Photolack zu belichten, wird der Photolack in der genannten Aussparung gegen die Einwirkung
der Strahlung durch den Rand der Maskierungsschicht abgeschirmt. Der belichtete Teil des Photolacks
wird dann entfernt, damit der zu ätzende Teil der Oberfläche freigelegt wird, wonach der freigelegte
Teil der Oberfläche geätzt wird.
Unter einem strahlungsempfindlichen Positivlack ist hitr ein strahlungsempfindlicher Lack zu verstehen, von
dem eine Schicht erhalten werden kann, von der, nachdem sie der betreffenden Strahlung, für die der Lack
empfindlich ist, ausgesetzt worden ist, die bestrahlten Teile besser als die unbestrahlten Teile in bestimmten
Längsmitteln löslich sind. Es sind mehrere strahlungsempfindliche Positivlacke, insbesondere Photolacke
käuflich erhältlich.
Nach der Bildung der Aussparung kann die Maskierungsschicht auf folgende Weise gebildet werden:
Eine Scnicht des Materials der Maskierungsschicht wird auf der Oxidationsmaske sowie in der Aushöhlung,
einschließlich der Seitenwände der Aushöhlung, angebracht; das Material der Maskierungsschicht wird mit
einem strahlungsempfindlichen Positivlack überzogen, wobei dieser Lack auch bis unterhalb des hervorragenden
Randes der Oxidationsmaske vordringt. Die Strahlung wird auf die Oberfläche des strahlungsempfindlichen
Positivlackes gerichtet, um diesen Lack zu belichten, wobei der Lack auf den Seitenwänden der Aushöhlung
unterhalb des genannten hervorragenden Randes gegen Belichtung abgeschirmt wird; der bestrahlte Lack
wird entfernt und das Material der Maskierungsschicht wird an den Stellen, an denen diese Schicht nicht mit
dem Lack überzogen ist, weggeätzt, wobei der verbleibende Lack, der sich auf dem Teil des Materials der
Maskierungsschicht auf den Seitenwänden der Aushöhlung befindet, als Ätzmaske dient.
Wenn die Oxidationsmaske aus einem Material, wie Siliciumnitrid, besteht, kann die Maskierungsschicht ungenügend
undurchlässig sein, um an sich einen als strahlungsempfindlicher Lack verwendeten Photolack unter
ihrem hervorragenden Rand gegen die anzuwendende Strahlung abzuschirmen. Vorzugsweise wird in diesem
Falle eine dünne undurchsichtige Schicht, z. B. aus einem Metall, wie Aluminium oder Chrom, vor dem Anbringen
des Photolacks auf der Oxidationsmaske und in der Aussparung niedergeschlagen, so daß während der
Bestrahlung die undurchsichtige auf der Oxidationsmaske befindliche Schicht dafür sorgt, daß der Photolack
auf der Seitenwand der Aussparung gegen die Bestrahlung abgeschirmt wird.
Die Maskierungsschicht kann aus einem Material bestehen, das in der hergestellten Halbleiteranordnung
beibehalten werden kann. Diese Schicht kann aber auch aus einem Material bestehen, das während der Oxidationsbehandlung
in ein, 7. B. isolierendes, Oxid umgewandelt wird, das in der hergestellten Halbleiteranordnung
beibehalten wird. Vorzugsweise wird zu diesem Zweck in der Maskierungsschicht Siliciumnitrid verwendet.
Die Maskierungsschicht kann so dünn sein, daß wahrend der Oxidationsbehandlung die ganze Schicht in
ein isolierendes Oxid umgewandelt wird. Dabei kann
gegen Ende der Oxidationsbehandlung ein wenig unterliegendes Silicium an den Seitenwänden der Aushöhlung
oxidiert werden. Auf diese Weise kann der Siliciumteil, der von der ersten Oxidationsmaske maskiert
war, seitlich von in situ gebildetem Siliciumoxid begrenzt werden.
Die Erfindung wird nachstehend beispielsweise an Hand der Zeichnung näher erläutert. Es zeigen
F i g. 1 und 2 Querschnitte durch einen Teil eines SiIiciumkörpers
während der ersten Stufe der Herstellung einer Halbleiteranordnung unter Verwendung von LO-COS-Techniken;
F i g. 3 und 4 Querschnitte durch einen dem Teil nach Fig. 1 und 2 entsprechenden Teil nach einem üblichen
LOCOS-Oxidationsschritt, wobei angewachsene »Vogelköpfe« und »Schnäbel« aus Oxid dargestellt sind;
F i g. 5 bis 8 Querschnitte durch einen Teil des Halbleiterkörpers
nach F i g. 2 während darauffolgender Bearbeitungsschritte unter Anwendung des Verfahrens
nach der Erfindung;
F i g. 9 einen Querschnitt durch einen Teil der Körpers nach den F i g. 1,2,5,6,7 und 8 nach Oxidation, und
Fig. 10 einen Querschnitt durch einen Bipolartransistor,
der durch ein Verfahren erhalten worden ist, von dem die F i g. 1,2 und 5 bis 9 verschiedene Stufen zeigen.
Bei dem nun zu beschriebenden LOCOS-Verfahren wird eine Siliciumnitridschicht t auf einer Hauptoberfläche
2 eines einkristallinen Siliciumkörpers 3 niedergeschlagen. Das Siliciumnitrid kann aus einem strömenden
Gas, das z. B. Silan und Ammoniak enthält, niedergeschlagen
werden, während der Siliciumkörper auf einer Temperatur von z. B. etwa 8000C gehalten wird. Die
Dicke der Schicht kann z. B. 0,15 μπι sein. In F i g. 1 ist
nur ein Teil des Körpers 3 und der Schicht 1 dargestellt.
Dann wird eine Oxidschicht 4 auf der Nitridschicht 1, z. B. durch thermische Oxidation des Nitrids oder durch
Niederschlagen, gebildet. Im Falle niedergeschlagenen Oxids kann die Schicht 4 eine Dicke von z. B. 0,2 μπι
aufweisen. Durch Anwendung einer photolithographischen Ätztechnik wird die Oxidschicht 4 selektiv entfernt,
wodurch eine Oxidmaske auf der Schicht 1 erhalten wird, um ein gewünschtes Muster in der Siliciumnitridschicht
zu definieren. Unter Verwendung dieser Oxidmaske als Ätzmaske wird die Nitridschicht 1 durch
Ätzen in Phosphorsäure selektiv entfernt Das verbleibende Nitrid dient dann als Ätz- und Oxidationsmaske 5
beim örtlichen Ätzen und Oxidieren des Teiles 3 des Siliciumkörpers.
Fig. 2 zeigt eine derartige Maske 5 in Form einer isolierten Insel.
In der Oberfläche 2 des Teiles 3 des Siliciumkörpers wird nun durch Wegätzen des freigelegten Siliciums eine
Aushöhlung in Form einer Nut 6 gebildet. Die Tiefe der Nut 6 wird in Übereinstimmung mit der Dicke des in
situ zu bildenden versenkten Oxids und mit dem gewünschten Oberflächenprofil des Siliciums und des
Oxids gewählt Um das in situ gewachsene Oxid völlig zu versenken, ist eine Nuttiefe gleich etwa der Hälfte
der Oxiddicke erforderlich.
Das erhaltene Profil der Siliciumoberfläche 2, 7 und
die Oxidationsmaske 5 sind in F i g. 2 dargestellt Statt das freigelegte Silicium zur Bildung dieser vertieften
Oberfläche zu ätzen, könnte das freigelegte Silicium auch oxidiert werden, um eine Oxidschicht teilweise in
die Oberfläche zu versenken, wonach diese Oxidschicht weggeätzt werden kann, um dieselbe Oberflächenstruktur
2,7 wie nach F i g. 2 zu erhalten. Dieses andere Verfahren umfaßt jedoch einen zusätzlichen Oxidationsschritt.
Bei einem üblichen LOCOS-Verfahren wird die vertiefte
Siliciumoberfläche 2, 7 nach F i g. 2 anschließend einer Oxidationsbehandlung unterworfen, z. B. dadurch,
daß sie feuchtem Sauerstoff bei einer Temperatur von 1000"C ausgesetzt wird. Die Oxidationsmaske 5 maskiert
den verbleibenden Teil 2 der ursprünglichen Silieiumoberfläche gegen Oxidation, während das Siliciumoxid
in dem unmaskierten vertieften Teil 7 zur Bildung einer in den Teil 3 des Siliciumkörpers versenkten Siliciumoxidschicht
8 anwächst. Die erhaltene Struktur ist in F i g. 3 dargestellt. Die Oxidschicht 8 umgibt seitlich einen
mesaförmigen Oberflächenteil 10 des Teiles 3. Die ursprüngliche, vertiefte Oberfläche 2, 7 ist mit gestricheiten
Linien angegeben. Es sei bemerkt, daß sich am Rande der Oxidschicht 8 ein kleiner Buckel 9 befindet,
der den Rand der Nitridmaskierungsschicht 5 heraufdrückt. In einem praktischen Beispiel, bei dem eine derartige
2 μηι dicke Oxidschicht 8 gebildet war, wurde eine Buckelhöhe von 0,8 μπι über der Siliciumoberfläche
2 gemessen. Im allgemeinen wird eine derartige Buckelhöhe während der darauffolgenden Ätzbehandiung,
z. B. beim Freilegen von Kontaktfenstern für die Halbleiteranordnung, etwas herabgesetzt.
F i g. 4 zeigt eine etwas andere Struktur, die erhalten wird, wenn die Oxidationsmaske 5 aus Siliciumnitrid auf
einer dünnen Siliciumoxidschicht 11 angebracht ist. In diesem Falle hat sich außer einem kleinen Buckel 9 am
Runde der versenkten Oxidschicht 8 ein gewachsener Siliciumoxidschnabel 12 gebildet. Die Buckel 9 werden
als »Vogelköpfe« und der Schnabel 12 wird als »Vogelschnabel« bezeichnet; der Grund dafür geht aus dem
Querschnitt durch das Oxid nach F i g. 4 hervor. Im allgemeinen werden die Buckel 9 durch die Volumenvergrößerung
während der lateralen Oxidation von den Seitenwänden der Nut 6 her erhalten, infolge der Tatsache,
daß das gebildete Siliciumoxid ein größeres spezifisches Volumen als das ursprüngliche Silicium aufweist.
Der Schnabel 12 wird durch beschleunigte laterale Oxidation entlang der Oxidschicht 11 unter der Nitridschicht
5 wegen der Diffusion von Sauerstoff über das Oxid erhalten.
Bei dem im folgenden beschriebenen LOCOS-Verfahren nach der Erfindung werden aber Maßnahmen
getroffen, um die Oxidation von Silicium an der Seitenwand der Nut 6 in bezug auf die am Boden der Nut 6
herabzusetzen.
F i g. 5 zeigt in vergrößertem Maßstab den Teil der im
Block 15 der F i g. 2 dargestellten Struktur, der erhalten
so wird, nachdem eine weitere Siliciumnitridschicht 16 auf der Oxidationsmaske 5 und auf der ganzen freigelegten
Siliciumoberfläche der Nut 6 angebracht worden ist. Auf dieser Nitridschicht 16 ist eine Oxidschicht 17 angebracht
Wie nachstehend beschrieben wird, wird ein Teil dieser Oxidschicht 17 danach als Ätzmaske während
einer Ätzbehandlung zur Entfernung der zweiten Nitridschicht 16 verwendet, ausgenommen an der Stelle,
an der diese sich auf der Seitenwand der Nut 6 unter dem hervorragenden Rand der Oxidationsschicht 5 befindet
Um dies zu erreichen werden die folgenden Schritte durchgeführt
Wie in F i g. 6 dargestellt ist, wird ein Metall, z. B.
Aluminium oder Chrom, im Vakuum zur Bildung einer dünnen Schicht 18 auf der Oberfläche der Schicht 16,17
niedergeschlagen. Die ganze erhaltene Oberfläche wird auf übliche Weise mit einer Schicht aus einem üblichen
Positivlack 19 überzogen, die bis unterhalb des hervorragenden Randes vordringt. Dann wird Ultraviolett-
strahlung auf die Oberfläche der Photolackschicht 19
gerichtet, die auf diese Weise der Strahlung ausgesetzt wird, ausgenommen an der Stelle, an der sie unter dem
genannten hervorragenden Rand abgeschirmt wird. Um dafür zu sorgen, daß die Ultraviolettstrahlung nicht bis
zu dem Lack auf den Seitenwänden der Nut unter dem hervorragenden Rand vordringt, ist die dünne Schicht
18 zur Bildung einer undurchscheinenden Schicht auf den Nitrid- und Oxidschichten 5, 4, 16 und 17 angebracht.
Der belichtete Photolack wird danach durch Lösen in einem üblichen Lösungsmittel entfernt und die so
belichtete undurchscheinende Schicht 18 wird durch Ätzen entfernt.
F i g. 7 zeigt die erhaltene Struktur.
Unter Verwendung des verbleibenden Photolacks 19 als Ätzmaske wird die Oxidschicht 17, an der Stelle, an
der sie belichtet ist, anschließend durch Ätzen entfernt, so daß die Schicht 17 nur an der Seitenwand der Nut 6
unter dem hervorragenden Rand zurückbleibt. Nach der Entfernung des verbleibenden Photolacks und unter
Verwendung der verbleibenden Oxidschicht 17 als Ätzmaske wird dann die zweite Nitridschicht 16 an der
Stelle, an der sie belichtet ist, durch Ätzen in heißer Phosphorsäure entfernt, so daß die Schicht 16 nur auf
den Seitenwänden der Nut 6 unter dem hervorragenden Rand zurückbleibt. Fig.8 zeigt die erhaltene Struktur.
Dadurch ist eine Maskierungsschicht 16 aus Siliciumnitrid auf den Seitenwänden der Nut 6 erhalten worden,
die sich der Oxidationsmaske 5 anschließt und den Boden der Nut 6 für die Oxidationsbehandlung frei läßt.
Die profilierte Siliciumoberfläche 2, 7 wird dann einer Oxidationsbehandlung unterworfen, z. B. dadurch, daß
sie feuchtem Sauerstoff bei einer Temperatur von 10000C ausgesetzt wird. Während der Oxidation bildet
sich Siliciumoxid an der Stelle, an der die Siliciumoberfläche auf dem Boden der Nut 6 freigelegt wird, wobei
eine Silciumoxidschicht 8 gebildet wird, die in den Teil 3 des Siliciumkörpers versenkt ist und einen mesaförmigen
Siliciumteil 10 lateral umschließt. Der verbleibende Oberflächenteil 2 auf diesem mesaförmigen Teil 10 wird
gegen die Oxidation durch die Nitridschicht 5 maskiert, wobei nur ein Teil der Dicke der Schicht 5 durch die
Oxidation in Siliciumoxid umgewandelt wird. Die Oxidation an der Seitenwand der Nut 6 wird durch die
Nitridschicht 16 gehemmt. Die Dicke dieser Nitridschicht 16 kann derart gewählt werden, daß die ganze
Schicht 16 gegen Ende der Oxidationsbehandlung in Siliciumoxid umgewandelt ist. Dabei kann gegen Ende
der Oxidationsbehandlung die angrenzende Siliciumseitenwand der Nut 6 oxidiert werden, so daß der Rand der
Schicht S neben dem Süieium-Mesateil 10 mit dem gewachsenen
Oxid der Schicht 8 homogen ist
Die Oxidationsgeschwindigkeit von Siliciumnitrid hängt von der Dichte der gebildeten Nitridschicht ab,
aber ist im allgemeinen etwa V30 bis V50 der Oxidationsgeschwindigkeit von Silicium. Es hat sich herausgestellt,
daß während des Anwachsens einer 2 μηη dicken Oxidschicht
durch Umwandlung des unmaskierten Siliciums etwa 70 bis 80 nm Siliciumnitrid, das aus Silan und Ammoniak
gebildet wird, oxidiert wird. Daher ist es beim Anwachsen der Schicht 8 zu einer Dicke von etwa 2 μίτι
zu bevorzugen, daß die zweite Nitridschicht 16 eine Dicke zwischen 70 und 80 nm aufweist Um eine derartige
Dicke auf den Seitenwänden der Nut 6 unter dem hervorragenden Rand der Schicht 5 zu erhalten, hat es
sich als notwendig erwiesen, Siliciumnitrid derart niederzuschlagen, daß eine größere Dicke auf dem Boden
der Nut 6 erhalten wird (siehe F i g. 5).
Die nach der Oxidationsbehandlung erhaltene Siliciumoxidschicht
ist schematisch in Fig. 9 dargestellt. Es sei bemerkt, daß eine erhebliche Herabsetzung der Höhe
des in der Oxidschicht 8 gebildeten Buckels an seiner Grenze mit dem Silicium-Mesateil 10 erreicht wird. Eine
noch flachere Oxid-Siliciumoberfläche wird auf diese
Weise im Vergleich zu der Oberfläche nach den F i g. 3 und 4 erhalten. Die ursprüngliche profilierte Oberfläche
2,7 ist in F i g. 9 mit gestrichelten Linien angedeutet.
Eine derartige flachere LOCOS-Oxidschicht 8 kann bei diskreten Halbleiteranordnungen, z. B. Bipolar- und
Feldeffekttransistoren, sowie für Schaltungselemente, wie Bipolartransistoren, Feldeffektanordnungen und
Dioden in integrierten Schaltungen, verwendet werden.
In integrierten Schaltungen kann eine derartige Schicht
8 zur Bildung von Isolierwänden zwischen Schaitungselementgebieten verwendet werden; z. B. kann die
Schicht 8 durch eine Halbleiterschicht vom einen Leitungstyp hin bis zu einem Substrat vom entgegengesetzten
Leitungstyp oder bis zu einem isolierenden Substrat, z. B. aus Saphir, oder bis zu einer vergrabenen
Schicht vom entgegengesetzten Leitungstyp versenkt werden.
F ig. 10 zeigt beispielsweise eine derartige Schicht 8, die in eine η-leitenden epitaktische Schicht 20 auf einem
η-leitenden Substrat 21 mit einer höheren spezifischen Leitfähigkeit versenkt ist Nach der Oxidationsbehandlung
zur Bildung der Schicht 8 werden ein p-leitendes Basisgebiet 22 und ein n-Emittergebiet 23 in dem Silicium-Mesateil
10 gebildet, derart, daß diese Gebiete an den Rand der versenkten gewachsenen Schicht 8 grenzen.
Die η-leitende Schicht 20 und das Substrat 21 bilden das Kollektorgebiet des Bipolartransistors. Danach
werden Kontaktfenster in einer dünneren Siliciumoxidschicht freigelegt, die auf der Siliciumoberfläche gebildet
ist, während Emitter- und Basis-Metallkontaktschichten 25 und 24 zur Kontaktierung der Emitter- und
Basisgebiete 23 bzw. 22 angebracht werden. Diese Kontaktschichten 24 und 25 erstrecken sich über den Rand
der Oxidschicht 8 und befinden sich größtenteils auf der Oxidschicht 8. Wegen ihres flacheren Randes kann die
Oxidschicht 8 sehr dick sein, wobei die Kapazität zwischen den Kontaktschichten 24 und 25 und der n-leitenden
epitaktischen Schicht 20 ohne Gefahr vor der BiI-dung schwacher Stellen in der Metallisierung der
Schichten 24 und 25 herabgesetzt werden, welche schwachen Stellen durch einen breiten oder hohen Bukkel
am Rande der Schichte auftreten könnten.
Eine mesaförmige Siliciumoxidschicht 8 kann dadurch gebildet werden, daß die Nut 6 vor der Oxidation bis zu
einem tieferen Niveau geätzt wird, so daß die dann gebildete Oxidschicht die Nut 6 nicht völlig ausfüüt Die
Herabsetzung der Höhe der »Vogelköpfe« könnte auch in diesem Falle in einer derartigen Mesa-LOCOS-Struktür,
z. B. für eine Mikrowellendiode, noch vorteilhaft sein.
Statt die Oxidationsmaske 5 direkt auf der Siliciumoberfläche anzubringen, kann diese auf einer dünnen
Oxidschicht auf der Siliciumoberfläche angebracht werden. In diesem Falle kann gegebenenfalls die Maskierungsschicht
16 derart angebracht werden, daß sie sich der Oxidationsmaske 5 anschließt um sowohl die Größe
eines »Vogelschnabels« sowie eines »Vogelkopfes« herabzusetzen.
Hierzu 3 Blatt Zeichnungen
Claims (1)
1. Verfahren zum Herstellen einer Halbleiteranordnung, bei dem in einem Teilbereich eines Siliciumkörpers
von dessen Oberfläche her eine zumindest teilweise versenkte Siliciumoxidschicht gebildet
wird, wobei folgende Verfahrensschritte angewandt werden:
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Legal Events
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D2 | Grant after examination | ||
8364 | No opposition during term of opposition | ||
8339 | Ceased/non-payment of the annual fee |