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CN1290085A - 掩蔽传输信道产生的差错的声码器数据设置的方法和系统 - Google Patents

掩蔽传输信道产生的差错的声码器数据设置的方法和系统 Download PDF

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CN1290085A CN00124186A CN00124186A CN1290085A CN 1290085 A CN1290085 A CN 1290085A CN 00124186 A CN00124186 A CN 00124186A CN 00124186 A CN00124186 A CN 00124186A CN 1290085 A CN1290085 A CN 1290085A
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Abstract

一种方法和系统,利用该方法和系统,表示声码语音的参数数据被组合成用于传输的数据包,以便减小传输信道产生的差错对数据包的影响。构造一种数据包,其中参数数据的某些感觉最有效比特位于该数据包的首端。交替该数据包中跟在位于数据包首端的感觉最有效比特后面的感觉最有效的其它参数数据比特。奇偶检验码根据在该数据包中的感觉最有效比特被计算,并也被交替在该数据包跟在位于数据包首端的感觉最有效比特的后面。

Description

掩蔽传输信道产生的差错的声码器数据设置的方法和系统
本申请是同一申请人于1993年1月27日提交的题为“用于掩蔽传输信道产生的差错的声码器数据设置的方法和系统”的第93102375．0号中国专利申请的分案申请。
本发明涉及用于传输的数据安排方式，更确切地说，本发明涉及一种新颖的和改进的方法和系统，用于把可变速率声码器产生的数据打成数据包用于传输，和用于将所接收的可变声码器数据包拆包以重建语音。
在数字通信领域，使用各种各样的用于传输的数字数据的安排方式。数据比特一般被安排成数据包经通信媒体来传送。在通过声码器产生数据的情况中，为了传送还要对数据进行安排。
通常，在用于经通信信道传输的数据包的制备中，正向纠错编码的一些形式可以被使用，以保护数据免于传输信道产生的差错。一旦信道差错确实出现在纠错编码的数据中，在多数情况下，这种差错是可以被检到和纠正的。
虽然纠错技术确实提供了一种有价值的减小信道差错的方法，但是单靠这些方法不可能充分地提供所必须的保护水平。在数据包部分比其它数据部分重要的多的情况下，需要进一步提供防止信道差错的数据形式。上述情况中的一个例子是数据包包含有声码器数据，其中某些参数在语音数据的重建中具有很重要的意义。
因此本发明的一个发明目的是在数字信息通信中提供进一步的保护措施，使信息比较重要的部分不受信道产生的差错的影响。
本发明涉及一种新颖的和改进的方法和装置，用于把代表声码式语音的声码器输出数据安排成适于传输的数据包，并从接收的数据包中提取输入给声码器用于重建语音的数据。
在码分多址(CDMA)通信中，如在全数字通信系统中，当经传输媒体进行通信时，传输信道的情况可能会在数字数据中产生差错。仅使用功率控制技术的纠错编码技术能够减小信道差错。然而这些技术中的每一种都具有局限性，它们不能使系统的性能达到最佳。
例如，在CDMA系统中，增加发射机功率能够减小对信道差错的敏感性。然而，增加发射机的功率对系统的容量产生了一种不利影响。在CDMA系统中，每个用户的信号是作为对其它用户的信号的干扰出现的。在系统中对整个噪声也有一个限制，即CDMA接收机的信号处理增益仍然能够从该噪声中提取它所需要的信号。由用户产生的全部信道干扰是用户数量和发射的功率的函数。当用户的发射机功率增加时，用户接收机所需的信噪比得到了改善。然而这种特定的用户的信号功率的增加，对于不需要接收的用户接收机来说起到了增加干扰的作用，由于较大地依赖于处理增益来提取这些可导致性能降低的用户信号，这样就降低了信噪比。因此，虽然增加发射机功率能够减少对信道产生的差错的敏感性，但系统容量因素限制了它的使用。
本发明提供了一种数据格式方案，它通过掩蔽某些CDMA传输信道差错来改进数据的可靠性。在速度可变声码器中，语音通常以最高速率编码，以实现最高音质的语音重建。然而语音和背景噪声的间歇期间是不重要的，可以低速对其进行编码。在以最高编码速率编码的数据中，特别重要的是对该数据提供一种高水平的保护措施，以确保能够在接收解码时使用可靠的数据。在以最高编码速度编码的数据中，代表编码语音的某些参数数据，特别是这些参数数据的某些位具有比其它数据重要的多的意义。本发明认识到发CDMA信道差错对发送数据的影响，并提供了一种数据格式，这种数据格式减小了信道差错对较重要的数据部分的影响，并提供了一种数据格式，这种数据格式减小了信道差错对较重要的数据部分的影响。
本发明公开了一种方法和系统，利用该方法和系统，某些参数数据和某些参数数据比特被安排用于掩蔽信道差错。根据本发明，可以意识到，在一个传输数据包中先传的数据对CDMA信道差错是不敏感的。当上述的差错发生时，它们通常以一短脉冲群的形式出现，对于最佳的全速度帧速率，典型的是8或小于8比特的长度。当接收机对接收的声码器数据的帧不能正确地作出一个速率判决时，另一种差错情况会发生。然而在这种情况下，声码器可以得到一个随机比特的数据包。本发明提供了一种用于在这两种情况之间进行区别的方案。
在本发明中，数据包被安排带有某些很感知的声码器参数数据的有效比特，所述的参数数据位于数据包的起始，而很感知的声码器参数数据的有效比特的余项被交插在整个数据包的其余部分。纠错比特由很感知的声码器参数数据的有效比特计算得出，并且也被交插在整个数据包中。按照一个高的概率，单独的纠错码可以允许对一接收的数据包进行区别是短脉冲串差错的一种，还是整个帧中多种差错的一种。以这种方式，具有一些差错的数据包能够被成功地使用，具有某些感知的声码器参数数据的有效比特被校正。然而，带有许多差错的数据包能够被识别并被忽略掉。
本发明的特性，目的和优点由下面结合附图的详细描述将会变的更加清楚，在附图中，同样的参考号在整个附图中用作相同的标识。其中：
图1是一个典型的声码系统的方框图；
图2a-2d是表示对于各种声码器输出数据帧速率的声码器输出参数比特分布的一系列图表；
图3a-3e是表示作为在声码器和微处理器之间传送的数据包的安排的一系列图表；
图4示出了一个电路的方框图，该电路用于把声码器数据组装成多个数据包从声码器传送给微处理器，和用于在声码器把以微处理器接收的数据包分解成适于声码器在重建语音帧数据中使用的形式：和
图5a-5h表示在适于各种传输模式和声码器帧速度的传输数据包之内，数据包安排的一系列图表。
参考附图，图1以方框图的形式示出了一个声码系统10的典型构成。应该认识到，图1仅示出了一种实际的构成，例如在一个移动电台中。对于在一移动电话交换局周围中的上述构成和在一蜂窝移动通信系统中的蜂窝基地台，图1的部件可以按如下描述被实际地分开。
对于语音的数字通信，声音例如语音和／或背景噪声通过公知技术被取样和数字化。例如在图1中，声音通过话筒12被转变成模拟信号，然后该模拟信号经编码译码器14被转变成数字信号。编码译码器14利用标准8比特／μ律格式典型地执行一种模拟到数字的转换处理。作为一种可供选择的方案，模拟信号可以以一种统一的脉冲编码调制(PCM)格式直接地转变成数字形式。在一个典型实例中，编码译码器14使用了一个8KHz取样，并以该取样速率提供一个8比特样本输出，以便实现64千比特／秒数据速率。
8比特样本以编码译码器14输出声码器16，在那里执行一个μ律／统一编码转换处理。在声码器16中，取样被安排成输入数据帧，其中每一帧都包括一个预定数量的样本。在声码器16的一个最佳构成中，每一帧都包括以8KHz，取样速率取样的160上样本或20毫秒的语音。应该很清楚，其他的取样速度和帧的大小也可以使用。根据此处描述的本发明，由声码器16用形成一个相应数据包的组合参数数据对语音样本的每一帧编码。声码器16最好按照速率可变声码器构造，它以一个取决于言语率和系统工作情况的速率对语音样本的每一帧进行编码。然后，声码器数据包被输出给微处理器18用于传输格式化。微处理器18提供一个传输的格式化数据的输出给用于调制和传输的收发射机(未示出)。
在接收端，传输的格式化数据包由收发射机接收和解调，然后提供给微处理机18。在微处理器18中，传输格式化被除去，对每一语音帧所提取的数据包被输出给声码器16。声码器16根据每一个数据包重建相应于语音帧的样本。这些重建的语音帧样本输出给编码译码器14，在那里按照常规被译码并转换成模拟形式。然后，模拟语音样本被输出给扬声器20转换成声音信号。
声码器16的一个最佳构成利用了激活码线性预测(CELP)编码技术的形式，以便在编码语音数据中提供一个可变速度。线性预测码(LPC)分析按照恒定的取样数来执行，音调与代码簿搜索按照取决于传输速率的可变取样数来执行。这种类型的速率可变声码器在还没有被批准的，申请号为07／713，661，申请日为1991年6月11日，并已转让给本发明受让人的美国专利申请中进行了详细的描述。声码器16可以在应用专用集成电路(ASIC)或数字信号处理器中实现。
在刚刚提到的速率可变声码器中，语音分析帧的长度是20毫秒，这意味着被提取的参数以每秒50次的一个脉冲串输出。而且，数据输出的速率粗略地从8千比特／秒变到4千比特／秒，到2千比特／秒和到1千比特／秒。
声码器与微处理器之间按全速率，也称速率1的数据传输是以8．55万千比特／秒的速率进行的。对于全速率数据，作为每一帧的参数被编码，并用160个比特表示。全速率数据帧还包括一个11比特的奇偶检验，这样，一个全速率帧包括总共171比特。在全速率数据帧中，声码器与微处理器之间没有奇偶校验比特的传输速率应是8千比特／秒。
声码器与微处理器之间按半速率(也称1／2速率)的数据传输是以4千比特／秒的速率进行的，具有每帧使用80比特的编码参数。声码器与微处理器之间按四分之一速率(也称1／4速率)的数据传输是以2千比特／秒的速率进行的，具有每帧使用40比特的编码参数。声码器与微处理器之间按八分之一速率(也称1／8速率)的数据传输是以稍小于1千比特／秒的速率进行的，具有每帧使用16比特的编码参数。
在设置有声码器16的通信系统中，还需要发送信号或其它非声码器数据。在除了声码器数据所有信令或其它非声码器数据要被发送的情况下，这种情况称作一个空白帧，作为帧的声码器数据不需要传送到用于传输的微处理器。
根据数据传输速率执行搜索，以便按每一语音帧的不同子帧多次地计算音调滤波器和代码簿激活参数。按照全速率，每一语音帧，仅有一个LPC计算结果。对于每一帧由于只能选择一个唯一的速率，所以，在相应于所选速率的各种大小的子帧中音调和代码簿搜索是按如下描述进行的。
按全速率，有四个音调(pitch)子帧和用于每个音调子帧的两个代码簿子帧。按全速率每40个样本长(5毫秒)有四次音调更新，每个音调子帧具有一个。此外，按全速率每20个样本卡(2．5毫秒)，有8次代码簿更新，八个代码簿子帧中每个子帧具有一个。
按半速率，有两个音调子帧和用于每个音调子帧的两个代码簿子帧。音调被更新两次，一次是当代码簿被更新四次时对两个音调子帧中的每一子帧进行更新，另一次是在四个代码簿子帧的每一子帧中进行。按四分之一速率，有一个音调子帧和用于单个音调子帧的两个代码簿子帧。当代码簿被更新两次，即两个代码簿子帧的每个子帧被更新一次时，音调子帧被更新一次。按八分之一速率，音调不被确定，代码簿在语音帧仅被更新一次。
虽然LPC系数在每帧仅计算一次，但它们，以线谱对(LSP)表示，利用从在前帧获得的合成LSP频率，被线性地插入六次，以近似具有集中在每个子帧中心位置的汉明窗口的LPC分析的结果。例外的情况是，按全速率，对于代码簿子帧，LPC系数并不被插入。
此外，在低速率情况下，很少执行音调和代码簿搜索，也很少分配比特给LPC系统的传输。在各种速率下被分配的比特数量在图2a-2d中示出。其中的每一幅图都表示分配给每160语音样本帧的声码器编码数据比特的数量。在图2a-2d中，各个LPC方框中的数值是按相应速率用于对短项LPC系数进行编码的比特数值。在最佳实施例中，用于按全、半、四分之一和八分之一速率对LPC系数进行编码的比特数值分别是40、20、10和10。
为了实现速率可变编码，LPC系数首先被转换成线谱对(LSP)，并且合成的LSP频率被单独地使用DPCM(差分脉冲编码调制)编码器编码。LPC的阶是10，即有10个LSP频率和10个独立的DPCM编码器。对于DPCM编码器，按全、半、四分之一和八分之一速率的典型比特分配分别是4、2、1和1。在声码器中，LSP频率被转变回LPC滤波器系数，以便在音调和代码簿搜索中使用。
相对于音调搜索，按全速率，如图2a所示，音调校正被计算四次，每四分之一语音帧进行一次。对于按全速率的每个音调更新，使用10个比特对新音调参数进行编码。对于其它速率，如图2b-2d所示，音调更新按不等的次数进行。当速率降低时，音调更新的次数也减少。图2b示出了相对于半速率的音调更新，它被计算两次，每半个语音帧计算一次。类似地，图2c示出了相对于四分之一速率的音调更新，它在每个完整的语音帧计算一次。如按全速率那样，对于每个半速率和四分之一速率音调更新，使用10个比特对新音调参数进行编码。然而对于八分之一速率，如图2d所示，由于当很少或没有语音出现时，这一速率被用于对帧进行编码，所以不进行音调更新的计算，并且不存在音调冗余。对于每10比特的音调更新，7比特表示音调迟延，3比特表示音调增益。音调迟延被限制在17和143之间。音调增益在0和2之间线性地量化而用3比特值表示。
相对于代码簿搜索，按全速率，如图2a所示，代码簿更新被计算八次，每八分之一语音帧进行一次。对于按全速率的每个代码簿更新，使用10个比特对新代码簿参数进行编码。对于其它速率如图2b-2d所示，代码簿更新按不等的次数进行。然而，当速率降低时，代码簿更新的次数也减少。图2b示出了相对于半速率的代码簿更新，它被计算四次，每四分之一语音帧计算一次。如按全速率那样，对于每个半速率和四分之一速率音调更新，使用10个比特对新代码簿参数进行编码。最后，图2d示出了相对八分之一速率的代码簿更新，它在每个完整的语音帧计算一次。应该注意到，按八分之一速率，6个比特被发送，2比特代表代码簿增益，而其它4比特是随机比特。关于代码簿更新比特分配的进一步讨论，在下面将进一步详细地描述。
代码簿更新所分配的比特表示对音调预测余量矢量量化所需的数据比特。对于全、半和四分之一速率，每个代码簿更新包括7比特代码簿指数加3比特代码簿增益，总共10比特。使用在对数域工作的差分脉冲编码调制(DPCM)编码器对代码簿增益进行编码。对于八分之一速率，虽然可以使用类似的比特安排，但最好使用另外的方案。按八分之一速率代码簿增益由2比特表示，而4个随机产生的比特随被接收的数据被用作一个取代代码簿的伪随机数字发生器的种源。应该很清楚，在可选择的方案中，代码簿数据可以被输出，而不采用伪随机数字发生器逼近。
下面的表Ⅰ是一个表格，它示出了各种参数和比特分配，它们是相对于每一语音帧由声码器产生的，并也由声码器在重建语音帧的语音样本中使用。
表Ⅰ
    代码     速率
1 1／2 1／4 1／8
LSP1 4  2  1  1
LSP2 4  2  1  1
LSP3 4  2  1  1
LSP4 4  2  1  1
LSP5 4  2  1  1
LSP6 4  2  1  1
LSP7 4  2  1  1
LSP8 4  2  1  1
LSP9 4  2  1  1
LSP10  4  2  1  1
PLAG1  7  7  7  -
PLAG2  7  7  -  -
PLAG3  7  -  -  -
PLAG4 7  -  -  -
PGAIN1  3  3  3  -
PGAIN2  3  3  -  -
PGAIN3  3  -  -  -
PGAIN4  3  -  -  -
代码     速率
 1 1／2 1／4 1／8
 CBINDEX1  7  7  7    -
 CBINDEX2  7  7  7    -
 CBINDEX3  7  7  -    -
 CBINDEX4  7  7  -    -
 CBINDEX5  7  -  -    -
 CBINDEX6  7  -  -    -
 CBINDEX7  7  -  -    -
 CBINDEX8  7  -  -    -
 CBGAIN1  3  3  3    2
 CBGAIN2  3  3  3    -
 CBGAIN3  3  3  -    -
 CBGAIN4  3  3  -    -
 CBGAIN5  3  -  -    -
 CBGAIN6  3  -  -    -
 CBGAIN7  3  -  -    -
 CBGAIN8  3  -  -    -
 CBSEED  -  -  -    4
 PCB  11  - -     -
表Ⅱ描述了在表Ⅰ以及在表Ⅲ-Ⅳ中涉及的每种参数：
表Ⅱ
 LSPi 线谱对频率
PLAGi 第i音调子帧的音调迟延
PGAINi 第i音调子帧的音调增益
CBINDEXi 第i代码簿子帧的代码簿阶
CBGAINi 第i代码簿子帧的代码簿增益
CBSEED 八分之一速率数据包的随机种源
PCB 在全速率数据包中用于检测和纠错的奇偶检验比特
如这里过一会要讨论的，并特别地参考表Ⅲ-Ⅳ，一指定参数的最不重要的比特被称作参数(0)，比较重要的比特被分别称作参数(1)、参数(2)、等等。例如，在一个全速率帧中，按二进制的形式LSP1=1011，最重要的比特LSP1(3)=1，次最重要的比特LSP1(2)=0，不太重要的比特LSP1(1)=1，不重要的比特LSP1(0)=1。
器16把相应于每个语时帧计算出的参数比特安排成供输出给微处理器18的数据包。在移动台设备中，声码器系统10的所有部件被典型地设置在该单元中。然而，在一个MTSO／蜂窝基地台设备中，微处理器18可以设置在带有声码器16的MTSO中，或设置在带有适当传输接口的蜂窝基地台中。
响应由微处理器18向声码器16或声码器16的发端提出的数据包请求，微处理器18可以接收一个声码器数据包。现有技术中的许多不同的方案都可以被使用，以实现从微处理器向声码器数据包的传输，这一点应该是很清楚的。为了向微处理器18传送，数据在声码器16中的一种独特的安排方式被进行组合，这种安排方式具有优于通常数据格式的优点。
在一个典型的设备中，声码器16经一个8并联端口与微处理器18进行通信，而声码器以被动方式操纵它的并联端口。在一个典型的微处理器18与声码器16之间的通信协议下，总是由微处理器18开始传送数据。在这种通信方案中，由微处理器18送给声码器16的数据包被称作指令包，而从声码器16送给微处理器18的数据包被称作响应包。指令在命令包中由微处理器发出，并由声码器16按两级承认。首先，声码器16指示由微处理器18提供的指令包是否以良好的波形被接收。如果是，则表明它理解了上述的指令，然后通过把指令传回微处理器18执行指令的功能。
数据包在微处理器18和声码器16之间典型地以22个字节块被传送，在一块中的每个字节包括8个数据比特。从声码器16向微处理器18用于发送的，和从微处理器18向声码器16用于对接收的传输数据译码的一块中的数据包的传送是一样的。图3a-3e示出了相应于全、二分之一、四分之一、八分之一速率和空白帧的每个声码语音帧数据包的结构。在图3a-3e中，用图解形式表示数据块，编号1的字节被最先传送，在每个字节中编号7和0的比特分别是各自字节中被传送的第一和最后一个比特。由于在该典型的实施例中使用的是一个不变的传输块，虽然实际的数据包比特数据根据该数据包的速率变化，但是，一个字节直至全部字节的一些比特都包括有不需要的比特。图3a-3e表明了这一事实，它通过使在方块中的字节比特位置带有荫影和不带荫影或被忽略来分别表示使用的比特和不使用的比特，图3e适用于这样的情况，即在某些次传输中，微处理器提供给该帧非声码器数据，例如信令数据或其它用户数据。在接收端一个空白帧被传送给声码器。在没有声码器数据出现的这个空白帧中，如果该数据从微处理器传送给声码器，则它将被忽略。
图4以典型的方框图形式示出了有关的电路，用于把相应于每个语音帧的参数数据组织成用于传输给微处理器的数据包。在图4中，示出了具有声码器发动机30的声码器16，该声码器发动机30，如在上面提及的未被批准的专利申请中所描述，计算参数数据。声码器30还从接收的参数数据中计算语音样本的相应帧。声码器16进一步包括输出帧缓冲器32、装填逻辑电路34、输出数据包缓冲器36、奇偶检验比特逻辑电路38和微处理器接口逻辑电路40。
声码器发动机30为每一语音帧计算参数，并提供一个相应于参数数据比特的输出帧给输出帧缓冲器32，在那里进行暂时存储。对于全速率数据的奇偶检验比特的计算，参数数据也可以被直接提供给奇偶检验比特逻辑电路38。对于每个语音帧，声码器发动机30还为被声码的语音帧提供一个所选速率的输出指示。速率数据被典型地提供给装填逻辑电路34、奇偶检验比特逻辑电路38，并经微处理器接口逻辑40提供给微处理器18。
作为一种选择，对于每个语音帧或只是响应一个全速率帧的速率数据指示，帧参数数据可以从缓冲器提供给奇偶检验比特逻辑电路38。在这种结构中，速率指出也可以提供给缓冲器32，缓冲器32对一全速率指示作出响应，提供参数数据给奇偶检验比特逻辑电路38。
奇偶检验比特逻辑电路38对一个全速率指示作出响应，依据全速率数据的18个感觉最有效比特，求出11个奇偶检验比特。感觉有效比特组的被指定的比特已经被确定，如果在这些比特的一个中出现差错，则上述被指定的比特对被译码的语音中语音质量产生很不利的影响。奇偶检验比特被加到全速率数据包中，以对18个感觉最有效比特提供纠错。在一个典型和最佳实施例中，由奇偶检验比特逻辑电路38产生的差错保护是以一个产生10个奇偶比特的循环码为基础的，以形成一个(28，18)码，这里，循环码是一个缩短的BCH码。术语(n，k)表示码字是n个比特长，并具有k个信息比特，利用这种码的28个比特求出一个单独的奇偶检验比特，以便形成一个最终(29，18)码。
18个感觉最有效比特按下列等式(1)组合成一个GF(2)，两元素的加罗瓦(Galois)域中的输入多项式：
n(x)=LSP1[3]x17+LSP2[3]x16+LSP3[3]x15+LSP4[3]x14+LSP5[3]x13+LSP6[3]x12+LSP7[3]x11+LSP8[3]x10+LSP9[3]x9+LSP10[3]x8+CBGAIN1[1]x7+CBGAIN2[1]x6+CBGAIN3[1]x5+CBGAIN4[1]x4+CBGAIN5[1]x3+CBGAIN6[1]x2+CBGAIN7[1]x1+CBGAIN8[1]x0                        (1)
这里，LSPi[3]是LSP码i的最有效位(MSB)，CBGAINi[1]是CBGAIN码i的次MSB，xi表示在该多项式中相应于参数比特的一个比特的位置。实际上，a(x)由全部10个LSP码的MSB和CBGAIN码的次MSP所组成。
最初的10个奇偶检验比特是使用循环码，利用下列生成多项式：
gpc(x)=x10+x9+x8+x6+x5+x3+1  (2)产生的。
项r(x)将根据输入多项式与生成多项式的二进制除法的余项来确定，即
a(x)x10／gpc(x)=q(x)zr(x)／gpc(x)    (3)
其中，a(x)x10是a(x)的10个位位移，q(x)是除法的商，r(x)是除法的余项。商q(x)不被使用而r(x)的比特将根据下列等式(4)指定：
r(x)= PCB[10]x9+ PCB[9]x8+ PCB[8]x7+ PCB[7]x6+PCB[6]x5+ PCB[5]x4+ PCB[4]x3+ PCB[3]x2+PCB[2]x1+ PCB[1]x0                         (4)
应该注意到，PCB[1]到PCB[10]在传输前被倒置，并且第11个保护比特在PCB[0]之前被确定。PCB[0]应该是a(x)中18个保护比特和r(x)中10个奇偶检验比特上的一个奇偶比特。如果全部28比特的异或结果是“0”，则PCB[0]将是逻辑“0”；如果其异或结果是“1”，则PCB[0]将是逻辑“1”。即：
PCB[0]=LSP1[3]_LSP2[3]_LSP3[3]_LSP4[3]_LSP5[3]_LSP6[3]_LSP7[3]_LSP8[3]_LSP9[3]_LSP10[3]_CBGAIN1[1]_CBGAIN2[1]_CBGAIN3[1]_CBGAIN4[1]CBGAIN5[1]_CBGAIN6[1]_CBGAIN7[1]_CBGAIN8[1]_PCB[10]_PCB[9]_PCB[8]_PCB[7]_PCB[6]_PCB[5]_PCB[4]_PCB[3]_PCB[2]_PCB[1]                      (5)
其中_表示运算对象的异或。
逻辑电路38可以使用通常的处理／逻辑部件实现。逻辑电路38执行的乘法和除法大体上与普遍多项式的乘法和除法一样，只是其系数被限制为是二进制，并且执行的是不带进位和借位的模2运算。
逻辑电路38把奇偶检验比特的输出提供给缓冲器32用于暂存。如前所述的在表Ⅰ中表示的参数比特与相应于全速率帧的奇偶检验比特一起从声码器发动机30提供给缓冲器32。然后，这些帧比特被装填用于传输。
装填逻辑电路34接收相应于每帧的速率指示，并响应地址缓冲器32，如果合适，按一指定顺序输出参数比特和奇偶检验比特。如参考图3所讨论的，从缓冲器32输出的比特被提供给包缓冲器36，用于最终传送给微处理器18。在一个可供选择的方案中，比特可以按这里讨论的一种安排方式从缓冲器32直接输出给微处理器18，这一点应该是很清楚的。缓冲器32和缓冲器36可以做成一个单独的存贮器也应该是很清楚的。在任何一种构成中，对于每种速率，均按照后面表Ⅲ-Ⅳ的设备对比特进行安排。
通常，声码器16按照一相应于语音帧的分析的顺序提供参数数据的输出给微处理器18，如参考图2a-2b所讨论的。以语音取样的整个帧为基础的LSP数据紧接着数据包的开始被提供。在该帧内来自语音样本的第一音调子帧的音调数据被随后提供。然后，音调数据后面跟着来自语音样本的代码簿子帧的代码簿数据，所说的语音样本与语音样本的第一音调子帧的语音样本相对应。如果多于一个的语音样本的代码簿子帧与语音样本的音调子帧相对应，那么提供相应于第一代码簿子帧的代码簿数据，随后跟着下一个代码簿子帧的代码簿数据。相应于音调子帧的代码簿子帧的代码簿数据被输出以后，如果给出编码速率，则提供相应于语音样本的下一音调子帧的音调数据。然后，按照前面讨论的输出这个下一音调子帧的代码簿数据。对于语音样本帧，如果有较多的半调子帧和相应的语音样本的代码簿子帧，且相对于该语音样本产生音调和代码簿数据，则音调数据首先被输出，随后跟着相应的代码簿数据。对于剩下的语音取样帧的音调和代码簿数据重复这一输出处理过程。通常，对于音调子帧音调增益值在数据包中放在音调迟延值的前面。同样地，对于代码簿子帧，代码簿指数值在数据包中放在代码簿增益值的前面。对于与这种一般典型的参数数据排序的实现的不一致之处，在表Ⅲ-Ⅳ中给出了详细说明。因此，除了在参数数据的排序中的某些新颖方面，各种其它排序方案可以容易地实现，关于这一点应该是很清楚的。
参考表Ⅲ，全速率帧数据的171个比特被组装成一个主要业务包。在该主要业务包中，比特170是第一主要业务比特，比特0是最后一比特。如在表Ⅸ中可以看到的，10个4-比特LSP码的最有效比特和次最有效比特被放置在所述包的首端。该数据包的这些最初的20比特是一组感觉最有效比特中的比特。在该数据包中，跟在这最初20个感觉最有效比特后面的是LSP码的不太有效比特。在数据包中跟在LSP码的不太有效比特后面的是剩下的参数码，其中不包括8个代码簿增益码的最有效比特和奇偶检验比特。8个代码簿增益码的最有效比特和奇偶检验比特也可以被看作是一组感觉最有效比特中的比特。在数据包中，插在LSP码的不太有效比特和随后的参数数据之内的每个第八比特是这些剩下的感觉最有效比特。
之所以这样在数据包中交错比特，是因为差错是平均为8比特长的短脉冲串。在把重要比特平均交错整个数据包的条件下，一个单独的短脉冲串将只伤害被交错比特中的一个。由于奇偶检验比特被用来以类似数据包的全速率对单一差错进行校正，所以这种交错意味着可以以8比特短脉冲串的长度对重要比特中的差错进行校正。
如前面所提到的，在最佳排序方案中，提供有由每个音调子帧和相应的代码簿子帧产生的数据，如在图2中所表示。由第一音调子帧产生的数据后面分别跟有由相应于第一和第二代码簿子帧产生的数据，对于随后的音调子帧数据和相应的代码簿子帧数据的排序，在其余的编码语音帧中自始至终是相同。
                          表Ⅲ
比特     代码 比特     代码 比特     代码 比特     代码
170 LSP1[2] 146 LSP3[1] 122 PLAG1[4] 98 CBGAIN2[2]
169 LSP1[3] l45 LSP3[0] 121 PLAG1[3] 97 CBGAIN2[0]
168 LSP2[2] 144 LSP4[1] 120 PLAG1[2] 96 PGAIN2[2]
167 LSP2[3] 143 CBGAIN1[1] 119 CBGAIN4[1] 95 CBGAIN7[1]
166 LSP3[2] 142 LSP4[0] 118 PLAG1[1] 94 PGAIN2[1]
165 LSP3[3] 141 LSP5[1] 117 PLAG1[0] 93 PGAIN2[0]
164 LSP4[2] 140 LSP5[0] 116 CBINDEX1[6] 92 PLAG2[6]
163 LSP4[3] 139 LSF6[1] 115 CBINDEX1[5] 91 PLAG2[5]
162 LSP5[2] 138 LSP6[0] 114 CBINDEX1[4] 90 PLAG2[4]
161 LSP5[3] 137 LSP7[1] 113 CBINDEX1[3] 89 PLAG2[3]
160 LSP6[2] 136 LSP7[0] 112 CBINDEX1[2] 88 PLAG2[2]
159 LSP6[3] 135 CBGAIN2[2] 111 CBGAIN5[1] 87 CBGAIN8[1]
158 LSP7[2] 134 LSP8[1] 110 CBINDEX1[1] 86 PLAG2[1]
157 LSP7[3] 133 LSP8[0] 109 CBINDEX1[0] 85 PLAG2[0]
156 LSP8[2] 132 LSP9[1] 108 CBGAIN1[2] 84 CBINDEX3[6]
155 LSP8[3] 131 LSP9[0] 107 CBGAIN1[0] 83 CBINDEX3[5]
154 LSP9[2] 130 LSP10[1] 106 CBINDEX2[6] 82 CBINDEX3[4]
153 LSP9[3] 129 LSP10[0] 105 CBINDEX2[5] 81 CBINDEX3[3]
152 LSP10[2] 128 PGAIN1[2] 104 CBINDEX2[4] 80 CBINDEX3[2]
151 LSP10[3] 127 CBGAIN3[1] 103 CBGAIN6[1] 79 PCB[10]
150 LSP1[1] 126 PGAIN1[1] 102 CBINDEX2[3] 78 CBINDEX3[1]
149 LSP1[0] 125 PGAIN1[0] 101 CBINDEX2[2] 77 CBINDEX3[0]
148 LSP2[1] 124 PLAG1[6] 100 CBINDEX2[1] 76 CBGAIN3[2]
147 LSP2[0] 123 PLAG1[5] 99 CBINDEX2[0] 75 CBGAIN3[0]
                           表Ⅲ(续)
比特 代码 比特     代码 比特     代码 比特     代码
74 CBINDEX4[6] 55 PCB[7] 36 CBINDEX6[1] 17 CBINDEX7[3]
73 CBINDEX4[5] 54 PLAG3[1] 35 CBINDEX6[0] 16 CBINDEX7[2]
72 CBINDEX4[4] 53 PLAG3[0] 34 CBGAIN6[2] 15 PCB[2]
71 PCB[9] 52 CBINDEX5[6] 33 CBGAIN6[0] 14 CBINDEX7[1]
70 CBINDEX4[3] 51 CBINDEX5[5] 32 PGAIN4[2] 13 CBINDEX7[0]
69 CBINDEX4[2] 50 CBINDEX5[4] 31 PCB[4] 12 CBGAIN7[2]
68 CBINDEX4[1] 49 CBINDEX5[3] 30 PGAIN4[1] 11 CBGAIN7[0]
67 CBINDEX4[0] 48 CBINDEX5[2] 29 PGAIN4[0] 10 CBINDEX8[6]
66 CBGAIN4[2] 47 PCB[6] 28 PLAG4[6] 9 CBINDEX8[5]
65 CBGAIN4[0] 46 CBINDEX5[1] 27 PLAG4[5] 8 CBINDEX8[4]
64 PGAIN3[2] 45 CBINDEX5[0] 26 PLAG4[4] 7 PCB[1]
63 PCB[8] 44 CBGAIN5[2] 25 PLAG4[3] 6 CBINDEX8[3]
62 PGAIN3[1] 43 CBGAIN5[0] 24 PLAG4[2] 5 CBINDEX8[2]
61 PGAIN3[0] 42 CBINDEX6[6] 23 PCB[3] 4 CBINDEX8[1]
60 PLAG3[6] 41 CBINDEX6[5] 22 PLAG4[1] 3 CBINDEX8[0]
59 PLAG3[5] 40 CBINDEX6[4] 21 PLAG4[0] 2 CBGAIN8[2]
58 PLAG3[4] 39 PCB[5] 20 CBINDEX7[6] 1 CBGAIN8[0]
57 PLAG3[3] 38 CBINDEX6[3] 19 CBINDEX7[5] 0 PCB[0]
56 PLAG3[2] 37 CBINDEX6[2] 18 CBINDEX7[4]
然后，全速率主要业务包由微处理器18安排成一个传输包，该传输包还包括一个信号比特、帧质量指示符比特和帧末端比特(编码器尾比特)。帧质量指示符比特实质上是循环冗余码校验(CRC)比特，它是通过一个跟在微处理器18后面的CRC和尾比特发生器电路(未示出)根据全速率主要业务包比特产生。参考图5a，对于全速率，该传输包由192个比特组成，其中第一位是一个信令比特。信令比特后面跟着171比特的主要业务包，然后跟着12个CRC比特。在传输包中跟在CRC比特后面的是8个尾比特，它们都是零。为了传输，该传输包按传输帧编码，一个传输帧横跨20ms的时间范围，以便于实现9．6千比特／秒的数据速率。
80比特的半速率帧数据也被组装成一个主要业务包，如在表Ⅳ中所示。在该数据包中，比特79是第一主要业务比特，比特0仍是最后一比特。如在表Ⅳ中所能看到的，为了便利和统一起见，10个2比特LSP码的比特被放在数据包的首端。如按全速率那样，跟在这最初20比特后面的是剩下的有效参数码，还有某些交替的代码簿增益比特。
                          表Ⅳ
比特     代码 比特     代码 比特     代码 比特     代码
79 LSP1[1] 59 PGAIN1[2]  39 CBINDEX2[6]  19 CBINDEX3[6]
78 LSP1[0] 58 PGAIN1[1]  38 CBINDEX2[5]  18 CBINDEX3[5]
77 LSP2[1] 57 PGAIN1[0]  37 CBINDEX2[4]  17 CBINDEX3[4]
76 LSP2[0] 56 PLAG1[6]  36 CBINDEX2[3]  16 CBINDEX3[3]
75 LSP3[1] 55 PLAG1[5]  35 CBINDEX2[2]  15 CBINDEX3[2]
74 LSP3[0] 54 PLAG1[4]  34 CBINDEX2[1]  14 CBINDEX3[3]
73 LSP4[1] 53 PLAG1[3]  33 CBINDEX2[0]  13 CBINDEX3[0]
72 LSP4[0] 52 PLAG1[2]  32 CBGAIN2[2]  12 CBGAIN3[2]
71 LSP5[1] 51 PLAG1[1]  31 CBGAIN2[1]  11 CBGAIN3[1]
70 LSP5[0] 50 PLAG1[0]  30 CBGAIN2[0]  10 CBGAIN3[0]
69 LSP6[1] 49 CBINDEX1[6]  29 PGAIN2[2]  9 CBINDEX4[6]
68 LSP6[0] 48 CBINDEX1[5]  28 PGAIN2[1]  8 CBINDEX4[5]
67 LSP7[1] 47 CBINDEX1[4]  27 PGAIN2[0]  7 CBINDEX4[4]
66 LSP7[0] 46 CBINDEX1[3]  26 PLAG2[6]  6 CBINDEX4[3]
65 LSP8[1] 45 CBINDEX1[2]  25 PLAG2[5]  5 CBINDEX4[2]
64 LSP8[0] 44 CBINDEXl[1]  24 PLAG2[4]  4 CBINDEX4[1]
63 LSP9[1] 43 CBINDEX1[0]  23 PLAG2[3]  3 CBINDEX4[0]
62 LSP9[0] 42 CBGAIN1[2]  22 PLAG2[2]  2 CBGAIN4[2]
61 LSP10[1] 41 CBGAIN1[1]  21 PLAG2[1]  1 CBGAIN4[1]
60 LSP10[0] 40 CBGAIN1[0]  20 PLAG2[0]  0 CBGAIN4[0]
然后，半速率主要业务包由微处理器18安排成一个传输包，该传输包还包括一个帧质量指示符比特和编码器尾比特。帧质量指示符比特仍是由CRC电路根据半速率主要业务包比特产生的循环冗余校验(CRC)比特。参考图5f，对于半速率，该传输包由96比特组成，从主要业务包的80个比特开始。主要业务包的比特后面跟随着8个CRC比特，然而跟着8个尾比特。为了传输，该传输包仍按传输帧编码，一个传输帧横跨20ms的时间范围，以便实现4．8千比特／秒的有效数据速率。
应该可以理解的是，在传输包中，半速率数据可以同其它数据例如信令数据、信令业务，(图5b)或从除了声码器、次要业务，(图5c)以外的源获得的数据一起以9．6千比特／秒的数据速率传送。应该可以进一步理解的是，全速率声码器数据可以是空白的，不产生，及其它插入该传输包的数据，如在图5d-5e所示出的。
四分之一速率帧数据的40比特被组装成一个主要业务包，如在表Ⅴ中所示。比特39是该主要业务包中的第一主要业务比特，比特0仍是最后比特。如在表Ⅴ中所能看到的，10个1比特LSP码的单个比特被放置在该数据包的首端。跟在这最初10比特后面的是剩下的参数码的比特，还有某些交替的代码簿增益比特。
                          表Ⅴ
比特     代码 比特     代码 比特     代码 比特     代码
39 LSP1[0] 29 PGAIN1[2] 19 CBINDEX1[6] 9 CBINDEX2[6]
38 LSP2[0] 28 PGAIN1[1] 18 CBINDEX1[5] 8 CBINDEX2[5]
37 LSP3[0] 27 PGAIN1[0] 17 CBINDEX1[4] 7 CBINDEX2[4]
36 LSP4[0] 26 PLAG1[6] 16 CBINDEX1[3] 6 CBINDEX2[3]
35 LSP5[0] 25 PLAG1[5] 15 CBINDEX1[2] 5 CBINDEX2[2]
34 LSP6[0] 24 PLAG1[4] 14 CBINDEX1[1] 4 CBINDEX2[1]
33 LSP7[0] 23 PLAG1[3] 13 CBINDEX1[0] 3 CBINDEX2[0]
32 LSP8[0] 22 PLAG1[2] 12 CBGAIN1[2] 2 CBGAIN2[2]
31 LSP9[0] 21 PLAG1[1] 11 CBGAIN1[1] 1 CBGAIN2[1]
30 LSP10[0] 20 PLAG1[0] 10 CBGAIN1[0] 0 CBGAIN2[0]
然后，四分之一速率主要业务包由微处理器18安排成一个传输包，该传输包还包括唯一的8个编码器尾比特。参考图5g，对于四分之一速率，这时该传输包由48比特组成，由主要业务包的40比特开始，以8个尾比特结束。为了传输，该传输包仍按传输帧编码，一个传输帧横跨20ms的时间范围，以便实现2．4千比特／秒的有效数据速率。
八分之一速率帧数据的16比特被组装成一个主要业务包，如表Ⅵ所示。比特15是该主要业务包中的第一主要业务比特，比特0仍是最后比特。如在表Ⅵ中所能看到的，10个1比特LSP码的单一比特被放置在该数据包的首端，该数据包中带有交替的代码簿种源。这些比特后面跟的是剩下的参数码的比特。
                            表Ⅵ
比特     代码 比特     代码 比特     代码 比特     代码
 15  CBSEED[3] 11 CBSEED[2] 7 CBSEED[1] 3 CBSEED[0]
 14  LSP1[0] 10 LSP4[0] 6 LSP7[0] 2 LSP10[0]
 13  LSP2[0] 9 LSP5[0] 5 LSP8[0] 1 CBGAIN1[1]
 12  LSP3[0] 8 LSP6[0] 4 LSP9[0] 0 CBGAIN1[0]
然后，八分之一速率主要业务包由微处理器18安排成一个传输包，该传输包还包括唯一的8个编码器尾比特。参考图5h，对于八分之一速率，这时该传输包由24比特组成，由主要业务包的16比特开始，以8个尾比特结尾。为了传输，该传输包仍按传输帧编码，一个传输帧横跨20ms的时间范围，以便实现1．2千比特／秒的有效数据速率。
再参考图3，响应来自微处理器18的一个数据输出指令，主要业务包由声码器16发出。响应这一指令，由微处理器接口逻辑电路40处理，逻辑电路40把一个传送指令提供给缓冲器36。缓冲器36响应该传送指令，近字节输出已格式化的数据包给微处理器18，如附图3所述。
在图1的声码系统中被接收的声码语音帧也被重建成语音帧样本。在接收端，微处理器18与声码器16之间的数据通信是属于传输式的数据通信。在这种操作模式中，声码器16接收和拆开来自微处理器18的数据包，以便解码和语音样本的重建。为了声码器解码的目的，微处理器18还确定数据包的速率，并提供一个确定速率的指示给声码器16。
微处理器18还确定被接收数据的质量。如果被接收数据坏到使用纠错技术不能校正的程度(不满足帧质量)时，一个以速率指示形式的删除指示就被送到声码器16。在这种情况下，虽然微处理器18可以发送数据包给声码器16，但这些值并不在声码处理中使用。因此，如果微处理器18根据CRC的检验确定数据包是一个在接收的传输包数据中具有一已测差错的全速率数据包，则该数据包是一个可能具有比特差错的全速率数据包的指示就被提供给声码器16。由于CRC是由数据包比特算出的，所以，出现在数据包比特内的一个或多个差错将会被检测到。在声码器16中，不可靠的数据包比特如果可以校正，则将被校正，并且校正后的数据包将由声码器使用。
对于被接收的传输包，其另外一种可能性是它包含除声码器数据之外的数据，如信令或次要业务数据。例如，在传输中声码器数据与其它数字数据共用传输帧(图6b-6c)，或是单独的非声码器数据(图6d-6e)。在这种情况下，传输包中的状态数据表示该包的类型是只包括声码器数据，或包括其它数据的传输包，例如是一种声码器和非声码器数据的结合，或只包括非声码器数据的传输包。一个脉冲串格式的比特进一步表明该数据包是否是一种声码器数据。当接收到该传输包，并检测到其仅包括非声码器数据时，一个空白帧指示由微处理器18提供给声码器16。虽然数据可以由微处理器18传送到声码器16，但是声码器16并不使用这些数据，而是使用其内部存贮的数据，以校正该声码器的状态。
参考图1和4，在这两种情况中，声码器16响应来自微处理器18的一个数据输入指令，经微处理器接口逻辑电路40处理后提供一个传送指令给缓冲器36。如参考图3所讨论的，缓冲器36响应该传送指令，按字节从微处理器18接收格式化的数据包。逻辑电路40还在声码器16和微处理器18之间传送速率指示。
被传送的数据包输入给缓冲器42暂存。在与数据包传送的协调中，数据包被确定速率的速率指示经逻辑电路40提供给拆开逻辑电路44。通常，拆开逻辑电路44响应该速率指示，用于控制包数据从缓冲器42向帧缓冲器46的输出。被拆开的参数数据然后被存在缓冲器46中，以便提供给声码器发动机30。除了相应的被拆开的参数数据外，声码器发动机30从微处理器18接收速率指示，以便按其指示的速率进行解码。在一个可供选择的结构中，缓冲器46可以被删，该数据在逻辑电路44的控制下可以从缓冲器42直接地提供给声码器发动机30，这一点是很清楚的。
对所有速率的数据包而言，在全速率声码器数据包的拆开中，逻辑电路44调整用于存在缓冲器46中的从缓冲器42输出的数据。对于参数数据，其中的参数比特按组装过程被拆开，比特部分被重新结合，以形成一个相应完整的比特值。例如，对于一个全速率声码器数据包，每个LSP码的最有效和次最有效比特与LSP码的相应的不太有效比特相结合。这样，被重建的10个LSP码与存贮在缓冲器46中的4比特值是一样的。此外，在数据包内的交替参数数据按照相应的参数数据进行分组。例如，对于一个全速率声码器数据包奇偶检验比特象存贮在缓冲器46中一样被分组在一起。按照输入给声码器的样本帧和子帧，参数数据可被进一步的编排。应该认识到，许多其它的方案都可以被容易地用于对输入给声码器的参数数据进行编排。
在一个全速率数据包的拆开中，缓冲器42根据来自逻辑电路44的信号，提供一个参数数据的输出给缓冲器46。在该数据包中，其数据比特被分开的参数被编排成完整的参数比特值。例如前面提到的，每个LSP参数的最有效和次最有效数据比特与该LSP参数的次无效和无效比特相结合，以形成一个相应的4比特值。也可以利用分析子帧，或任何其它编排方案对参数值进行编排，以提供一种类似的参数数据的组合。在逻辑电路44的控制下，被安排和组合的参数值被存贮在缓冲器46内。
一旦参数数据被拆开，则如对逻辑电路38所讨论的那样计算奇偶检验比特，并与接收的奇偶检验比特进行比较。奇偶检验比特逻辑电路48在逻辑电路44的指令下，从缓冲器46接收合适的比特，以便计算数据包的奇偶检验。如后面要讨论的，为了计算和比较的目的，逻辑电路48能够对全速率指示和具有大概误差的全速率进行响应。而且，被接收的奇偶检验比特也从缓冲器46输出给逻辑电路48，用于与算出的奇偶检验比特进行比较。在一个可供选择的构成中，被接收的奇偶检验比特，或用于计算比较奇偶检验比特的参数比特可以直接从微处理器18的数据包输出中提取，如同输入给缓冲器42一样。然而在另一可供选择的构成中，被接收的奇偶检验比特或用于计算比特奇偶的参数比特可以从缓冲器42的输出中提取。
对于全速率帧，如果在与算出的奇偶检验比特比较的所接收奇偶检验通过指示从逻辑电路48提供给逻辑电路44和声码器发动机30。逻辑电路44在响应该输出指令，输出参数数据给声码器发动机30，在声码器发动机30中用于重建语音帧样本。
然而，如果逻辑电路48在奇偶检验比特中检测到一个差错，则逻辑电路48产生一个不满足帧质量指示，并也提供给逻辑电路44和声码器发动机30。响应该不足满帧质量指示，逻辑电路44可以提供一个输出指令给缓冲器46，缓冲器46输出数据给声码器发动机30。在这种情况下，声码器发动机30还响应由逻辑电路48提供的不满足帧质量指示，不去过问接收的数据。在一个可供选择的构成中，数据可以不从缓冲器46输出给声码器发动机30。声码器发动机30工作，用以根据声码器的先前状态重建语音取样帧。
即使微处理器18提供一个具有大概误差(也称作大概全速率)的全速率指示给逻辑电路40，数据包也要被传送缓冲器42。当对于全速率包用CRC检测到差错时。微处理器18将产生一个大概全速率指示，虽然传输包具有由检测器提供的表示良好数据包的帧质量度量。帧质量度量被使用在微处理器18中，以确定被接收帧的符号差错率，低符号差错率表示接收的数据帧可能是包括良好的数据。
在由逻辑电路44把缓冲器42中的数据包拆开以便传送给缓冲器46之前，首先执行奇偶检验比特的检验。如对全速率数据包所作的一样，逻辑电路48为接收的数据包计算奇偶检验比特，并将这些奇偶检验比特与该数据包自己的所接收的奇偶检验比特进行比较。
如果逻辑电路48检测到一个单一差错，则使用公知的奇偶检验比特校正技术，用提供给缓冲器42的已校正比特代替错误的比特来对该差错进行校正。逻辑电路48还提供一个大概全速率奇偶检验通过指示给逻辑电路44和声码器发动机30。处于响应状态的逻辑电路44控制参数比特的重新编排和在缓冲器46中的存贮。逻辑电路44还提供一个输出指令给缓冲器46，缓冲器46响应该输出指令，输出参数数据给声码器发动机30，在那里用来重建语音帧样本。
然而，如果由逻辑电路48根据奇偶检验比特检测到一个以上的差错，则逻辑电路48将产生一个不满足帧质量指示，它也被提供给逻辑电路44和声码器发动机30。响应该不满足帧质量指示，逻辑电路44不对数据包进行拆开，因为声码器发动机30将不使用这些数据。缓冲器42中的数据可以被输出到缓冲器46，当被传送给声码器发动机30时，缓冲器46对数据不作处理。响应不满足帧质量指示，声码器发动机30对接收的数据仍不过问。如前所述，声码器发动机30工作，用以根据声码器的先前状态重建语音样本帧。
对于二分之一、四分之一和八分之一速率，微处理器18的速率指示经逻辑电路40提供给逻辑电路44和声码器发动机30。微处理器18还提供数据包给缓冲器42。如象从缓冲器42向缓冲器46传送一样，逻辑电路44控制分别相应于二分之一、四分之一和八分之一速率的80、40和16比特的拆开。然而，对于八分之一速率，如果该数据包包括全部逻辑“1”(如由检测逻辑电路50检测的)，则逻辑电路50将产生一个不满足帧质量指示，并提供给逻辑电路44和声码器发动机30。对于具有按奇偶检验比特检测到的多个差错的大概全速率情况，逻辑电路44和声码器发动机30起着如上面刚刚讨论过的作用。
有时，当传输包CRC校验失败，并且根据解码器帧质量确定是一个高符号差错率时，微处理器18将产生不满足帧质量指示作为一个差错率确定指示。该不满足帧质量指示经逻辑电路40提供给逻辑电路44和声码器发动机30，对于具有按奇偶检验比特检测到多个差错的大概全速率情况，逻辑电路44和声码器发动机30起着如上面讨论过的作用。
此外，有时被接收的传输包可能包含除声码器数据以外的数据。传输包可以全部是其它数据，或具有声码器数据和其它数据在一起，如上面参考图6b-6e所描述的。微处理器18根据包含在该数据包中的信号比特对这种类型的传输数据包进行安排。如果不是整个传输包的数据部分包括了作为信号比特或次要业务的完整数据(图6d-6e)，则一个空白指示由微处理器18经逻辑40提供给逻辑44，声码器发动机30和存储器52。存储器52用于存贮来自缓冲器42的先前的数据输出。逻辑电路44命令存储器52提供数据给缓冲器46，以代替来自缓冲器42的输出。尤其是，数据的先前帧的最后音调子帧的音调延迟和音调增益与先前帧的LSP频率数据一起从存贮器52提供给缓冲器46。这种数据然后从存贮器52提供给声码器发动机30。在一可供选择的方案中，这种特定的数据可以由存贮器52直接提供给声码器发动机30。然而在另一可供选择的方案中，存贮器52中的全部数据可以提供给缓冲器46。根据先前的帧数据，声码器发动机30产生被消除了语音样本的当前帧。
根据上面的描述应该很清楚，可以设计各种实施方案来实现参数数据的组装和拆开。以上描述的部件的许多功能可以以各种形式来实现，例如以一个处理器，或性质不同的逻辑和存贮部件，或是上述二者的结合来实现。应该可以理解的是，相对于最高速率编码数据描述的这种附加防护可以容易地提供给较低速率的数据。
根据前面对最佳实施例的描述，本领域的任何技术人员都能制造或使用本发明。对于本领域的技术熟练的人员来说，对上述实施例的各种改进都将是显而易见的，并且本发明限定的一般原理也可以应用到其它实施例中，而无需创造性。这样，本发明并不规定限制在这里所示的实施例上，而是限定在与这里所公开的原理和新颖的特征相一致的最宽的范围内。

Claims (15)

1．在一个声码系统中，该系统中接收的可变速率数据帧包括声码语音参数数据，帧数据根据一预定格式被进行格式化，参数数据被解码成相应的语言样本帧，一个用于对每个接收的参数数据帧内的参数数据进行重新组合的系统包括：
输入装置，用于接收和存贮数据帧，和用于根据一控制信号以一预定顺序提供所述数据的输出；和
拆开装置，用于接收相应于每一接收的数据帧的帧速率指示，并响应它而提供所述的控制信号。
2．根据权利要求1的系统，其特征在于，最高速率数据帧包括一个参数数据组的每个参数数据的一部分，该部分以一预定的顺序置于数据包的首端，其后跟随有上述一个参数数据组的每个参数数据的另一部分，其它参数数据组跟在上述一个参数数据组的后面，在所述数据包内具有从所述数据包内的参数数据中算出的奇偶数据，所述的系统进一步包括：
奇偶检验装置，用于接收在被接收的最高速率参数数据帧中的奇偶数据，根据在所述被接收的最高速率帧中的参数数据计算奇偶数据，把所述计算出的奇偶数据与所述被接收的最高速率帧奇偶数据进行比较，当所述计算出的奇偶数据与所述被接收的奇偶数据一致时，提供一个指示；和
其中所述输入装置响应所述的控制信号和所述的指示，提供一个所述参数数据的输出，该输出包括被重新组装的所述一个参数数据组的每个参数数据的所述部分和另外部分的一个相应部分。
3．根据权利要求2的系统，其特征在于，所述最高速率参数数据帧进一步具有另一参数数据组的每个参数数据的一部分，该部分被交替在一个参数数据组的参数数据的另一部分内，所述的输入装置进一步响应所述的控制信号，为所述另一参数数据组的参数数据的每部分的输出提供所述另一参数数据组的每个所述参数数据的相应剩余部分。
4．根据权利要求2的系统，其特征在于：
所述拆开装置和所述奇偶检验装置进一步接收相应于所述最高速率参数数据帧的大概全速率指示，所述的大概全速率表明在所述的参数数据和奇偶数据中至少存在一个差错；
所述奇偶检验装置进一步根据所述计算求得的奇偶数据与在所述接收的最高速率参数数据帧中的所述奇偶数据的比较结果，在所述接收的最高速率参数数据帧中，至少检测在所述参数数据和所述奇偶数据之一中的一个差错，如果在所述的最高速率参数数据帧中的所述参数数据和奇偶数据的某些数据中出现差错，则对所述检测到的差错进行校正；和
其中所述的输入装置响应所述的控制信号和所述的指示，当所述检测到的差错出现在所述奇偶数据的某些数据中时，提供一个所述的参数数据输出，和当所述检测到的差错出现在所述参数数据的某些数据中时，提供一个被校正的参数数据输出，所述的输出参数数据和被校正的参数数据包括被重新组装的所述一个参数数据组的每个参数数据的所述部分和另外部分的一个相应部分。
5．一种声码器，包括：
声码器发动机装置，用以接收语音样本帧并根据预定的语音模式提供表示所述语音样本帧的语音参数数据；以及
排序装置，用以接收所述语音参数数据并提供语音参数数据包，其中，在所述数据包的第一部分提供所述语音参数的最重要部分，紧接着的所述数据包的第二部分内专门提供所述语音参数数据的其余部分，其中，所述语音参数数据的其余部分根据至少一种预定格式交插在所述数据包的整个第二部分。
6．根据权利要求5的声码器，其特征在于，所述声码器发动机装置包括：
提供线性预测码数据的装置；
提供音调数据的装置；以及
提供代码簿数据的装置。
7．根据权利要求6的声码器，其特征在于进一步包括将所述线性预测码数据转换为线谱对数据的装置。
8．根据权利要求7的声码器，其特征在于，所述排序装置首先在所述数据包内提供所述线谱对数据。
9．根据权利要求5的声码器，其特征在于，所述声码器发动机装置以所选数据速率提供所述参数数据，并提供表示所选数据速率的数据速率信号，其中，所述排序装置响应于所述数据速率信号。
10．在一个通信系统中，记录数据帧的数据以在传送数据包的前半部提供所述数据的更重要部分，并在与所述传送数据包的前半部不同的后半部专门提供所述数据的其余部分，其中，所述其余数据部分唯一交插于所述传送数据包的整个后半部，一个用以记录所述数据帧的子系统包括：
控制装置，根据与所述传送数据包有关的帧速率提供一控制信号，所述控制信号指示对所述传送数据包的拆包顺序；以及
输入装置，根据所述控制信号接收所述传送数据包并由所述传送数据包提供重新排序的数据。
11．根据权利要求10的子系统，其特征在于，所述传送数据包进一步包括至少一个奇偶比特，所述子系统进一步包括一奇偶检验装置，用以接收所述传送数据包并根据预定的奇偶格式确定至少一个检验比特，比较所述至少一个检验比特与所述至少一个奇偶比特，并提供一个信号指示所述至少一个奇偶比特和至少一个检验比特的相等。
12．在一个通信系统中，按照语音模型对语音样本帧进行编码以提供参数数据帧，其中，所述参数数据帧被重新排序，以在传送数据包的前半部提供所述参数数据的更重要部分，而在不同于所述传送数据包的前半部的传送数据包的后半部专门提供所述参数数据的其余部分，且所述其余数据部分唯一交插于所述传送数据包的整个后半部，一个根据所述传送数据包提供对所述语音数据的评估的系统包括：
排序装置，用以接收所述传送数据包，并根据所述传送数据包提供对所述参数数据重建的评估，根据与所述传送数据包有关的帧速率将对所述参数数据重建的评估进行排序；以及
声码器装置，接收对所述参数数据重建的评估，并根据所述语音模型对所述重建评估的参数数据进行译码，以对所述语音样本帧提供评估。
13．根据权利要求12的系统，其特征在于，所述传送数据包包括按所选数据速率的参数数据，其中，所选数据速率从多个数据速率中选出，所述声码器装置进一步根据所述数据速率对所述参数数据译码。
14．在一个声码系统中，一种用以将语音参数数据格式化为数据包进行传送的方法，所述方法包括如下步骤：
根据输入的语音样本帧产生所述语音参数数据，其中，所述语音参数数据的一部分数据比之所述语音参数数据的其它数据具有更大的相对重要性；
在数据包的起始包部分提供所述一部分数据的一部分，所述数据包的起始包部分唯一包括所述一部分数据的一部分；
在紧接所述起始包部分的所述数据包的其余包部分唯一提供交插的数据，所述交插数据通过交插所述一部分数据的其余部分与所述其它数据而形成。
15．根据权利要求14的方法，其特征在于进一步包括如下步骤：
根据所述一部分数据计算纠错码；以及
唯一地在所述交插的数据内交插所述纠错码。
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