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CN114093321B - 像素驱动电路、驱动方法、显示面板及显示装置 - Google Patents

像素驱动电路、驱动方法、显示面板及显示装置 Download PDF

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CN114093321B CN202111450630.5A CN202111450630A CN114093321B CN 114093321 B CN114093321 B CN 114093321B CN 202111450630 A CN202111450630 A CN 202111450630A CN 114093321 B CN114093321 B CN 114093321B
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Abstract

本发明公开了一种像素驱动电路、驱动方法、显示面板及显示装置，像素驱动电路中，驱动模块的第一端用于输入第一电源输出的信号，第一发光控制模块连接于驱动模块的第二端和发光模块的第一端之间，发光模块的第二端连接第二电源；第一存储模块的第一端连接驱动模块的控制端，第一存储模块的第二端连接第二存储模块的第一端，第二存储模块的第二端连接发光模块的第一端；阈值侦测模块连接第一存储模块的第二端与驱动模块的第二端，可控制第一存储模块存储驱动模块的阈值电压；数据写入模块连接驱动模块的第二端；初始化模块连接驱动模块的控制端和发光模块的第一端。本发明提供的技术方案，可增强对阈值电压的补偿，降低显示面板的亮度偏差。

Description

像素驱动电路、驱动方法、显示面板及显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种像素驱动电路、驱动方法、显示面板及显示装置。
背景技术
有机发光二极管(Organic Light-Emitting Diode，OLED)显示器中的像素驱动电路通过经由驱动晶体管控制流过OLED的驱动电流来实现显示功能。该驱动电流的大小与包括阈值电压在内的驱动晶体管的特征参数相关。
在目前的驱动晶体管的驱动过程中，在数据电压写入期间将阈值电压施加到驱动晶体管的栅极，以实现对阈值电压的补偿。但是现有的驱动晶体管，尤其是采用铟镓锌氧化物(Indium Gallium Zinc Oxide，IGZO)作为沟道层材料的驱动晶体管，存在不同的数据电压下，补偿的阈值电压不同，使得驱动晶体管输送的电流具有一定的差异，导致显示面板显示亮度具有一定的偏差。
发明内容
本发明实施例提供了一种像素驱动电路、驱动方法、显示面板及显示装置，以降低显示面板的亮度偏差。
第一方面，本发明实施例提供了一种像素电路，包括：数据写入模块，驱动模块、第一存储模块、第二存储模块、阈值侦测模块、第一发光控制模块、初始化模块和发光模块；
所述驱动模块的第一端用于输入第一电源输出的信号，所述第一发光控制模块连接于所述驱动模块的第二端和所述发光模块的第一端之间，所述发光模块的第二端连接第二电源；所述驱动模块用于为发光模块提供发光驱动信号；
所述第一存储模块的第一端连接所述驱动模块的控制端，所述第一存储模块的第二端连接所述第二存储模块的第一端，所述第二存储模块的第二端连接所述发光模块的第一端；
所述阈值侦测模块连接于所述第一存储模块的第二端与所述驱动模块的第二端之间，用于控制所述第一存储模块存储所述驱动模块的阈值电压；
所述数据写入模块连接所述驱动模块的第二端，用于向所述驱动模块传输数据电压；
所述初始化模块连接所述驱动模块的控制端和所述发光模块的第一端，用于向所述驱动模块的控制端和所述发光模块的第一端传输对应的初始化电压。
第二方面，本发明实施例还提供一种像素电路的驱动方法，应用本发明人任意实施例提供的像素电路，包括：
在初始化阶段，控制所述初始化模块传输对应的初始化电压至所述驱动模块的控制端和所述发光模块的第一端；
在阈值补偿阶段，控制所述阈值侦测模块导通，所述第一存储模块存储所述驱动模块的阈值电压；
在数据写入阶段，控制所述数据写入模块将数据电压写入所述驱动模块的第二端；所述第二存储模块存储所述数据电压；
在发光阶段，控制所述第一发光控制模块导通，所述驱动模块输出驱动电流驱动所述发光模块发光。
第三方面，本发明实施例还提供了一种显示面板，包括本发明任意实施例提供的像素电路。
第四方面，本发明实施例还提供了一种显示装置，包括本发明任意实施例提供的显示面板。
本发明中，驱动模块连接第一电源，且通过第一发光控制模块连接发光模块的第一端，发光模块的第二端连接第二电源，实现驱动模块为发光模块提供发光驱动信号，初始化模块用于向驱动模块的控制端和发光模块的第一端提供对应的初始化电压，第一存储模块与驱动模块的控制端连接，并通过阈值侦测模块与驱动模块的第二端连接，可在数据电压写入之前存储驱动模块的阈值电压，数据写入模块连接驱动模块的第二端，用于向驱动模块传输数据电压，第二存储模块分别连接第一存储单元模块和发光模块的第一端，用于存储驱动模块的数据电压，本实施例中第一存储模块能够在数据电压写入驱动模块之前对阈值电压进行存储，从而提前对驱动模块进行阈值电压的补偿，并在数据电压写入时持续通过第一存储模块对阈值电压进行补偿，有效延长对阈值电压的补偿时长，提高补偿效果，有效避免不同像素之间阈值电压补偿程度不同的问题，防止驱动模块输送至发光模块的电流出现差异，提高整个显示面板显示亮度的均一性，降低亮度偏差。
附图说明
图1为现有技术中IGZO作为沟道层的N型驱动晶体管补偿的阈值电压-数据电压的曲线图；
图2为现有技术中LTPS作为沟道层的P型驱动晶体管补偿的阈值电压-数据电压的曲线图；
图3为本发明实施例提供的一种像素电路的结构示意图；
图4为本发明实施例提供的另一种像素电路的结构示意图；
图5为图4中像素电路在一帧周期中的一种工作时序示意图；
图6为本发明实施例提供的初始化阶段的像素电路示意图；
图7为本发明实施例提供的阈值补偿阶段的像素电路示意图；
图8为本发明实施例提供的数据写入阶段的像素电路示意图；
图9为本发明实施例提供的发光阶段的像素电路示意图；
图10为图4中像素电路在一帧周期中的另一种工作时序示意图；
图11为本发明实施例提供的另一种像素电路的结构示意图；
图12为本发明实施例提供的一种像素电路的驱动方法的流程示意图；
图13为本发明实施例提供的一种显示面板的结构示意图；
图14为本发明实施例提供的一种显示装置的结构示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。
可知，当采用铟镓锌氧化物(Indium Gallium Zinc Oxide，IGZO)作为沟道层材料的N型驱动晶体管形成像素电路时，存在N型驱动晶体管驱动能力不足的问题，具体的，在实现本发明实施例的方案的过程中，发明人对IGZO作为沟道层的N型驱动晶体管，以及LTPS作为沟道层的P型驱动晶体管的栅极输入相同的栅极信号时，IGZO作为沟道层的N型驱动晶体管的导通电流较小。此外，如图1所示，图1为现有技术中IGZO作为沟道层的N型驱动晶体管补偿的阈值电压-数据电压的曲线图，图2为现有技术中LTPS作为沟道层的P型驱动晶体管补偿的阈值电压-数据电压的曲线图，参考图1，图1示出了扫描频率为120Hz和60Hz时补偿的阈值电压-数据电压曲线，并可得出，无论是120Hz还是60Hz，不同数据电压对应的补偿的阈值电压不同，并且扫描频率越高，不同数据电压对应的补偿的阈值电压的差异越大，导致显示亮度偏差较大，说明IGZO作为沟道层的N型驱动晶体管阈值补偿较慢，在较短时间内阈值电压补偿不完全，图2中示出了扫描频率为60Hz时补偿的阈值电压-数据电压曲线，不同数据电压对应的补偿的阈值电压大致相同，显示均一性好，说明LTPS作为沟道层的P型驱动晶体管阈值补偿较快。由此可知，IGZO作为沟道层的N型驱动晶体管，驱动能力不足，但是因其可实现高分辨率面板且成本较低，具有广阔的前景，为解决IGZO作为沟道层的N型驱动晶体管导致的亮度偏差，提供以下方案。
本发明实施例提供了一种像素电路，包括：数据写入模块，驱动模块、第一存储模块、第二存储模块、阈值侦测模块、第一发光控制模块、初始化模块和发光模块；
驱动模块的第一端用于输入第一电源输出的信号，第一发光控制模块连接于驱动模块的第二端和发光模块的第一端之间，发光模块的第二端连接第二电源；驱动模块用于为发光模块提供发光驱动信号；
第一存储模块的第一端连接驱动模块的控制端，第一存储模块的第二端连接第二存储模块的第一端，第二存储模块的第二端连接发光模块的第一端；
阈值侦测模块连接于第一存储模块的第二端与驱动模块的第二端之间，用于控制第一存储模块存储驱动模块的阈值电压；
数据写入模块连接驱动模块的第二端，用于向驱动模块传输数据电压；
初始化模块连接驱动模块的控制端和发光模块的第一端，用于向驱动模块的控制端和发光模块的第一端传输对应的初始化电压。
本发明实施例中，驱动模块连接第一电源，且通过第一发光控制模块连接发光模块的第一端，发光模块的第二端连接第二电源，实现驱动模块为发光模块提供发光驱动信号，初始化模块用于向驱动模块的控制端和发光模块的第一端提供对应的初始化电压，第一存储模块与驱动模块的控制端连接，并通过阈值侦测模块与驱动模块的第二端连接，可在数据电压写入之前存储驱动模块的阈值电压，数据写入模块连接驱动模块的第二端，用于向驱动模块传输数据电压，第二存储模块分别连接第一存储单元模块和发光模块的第一端，用于存储驱动模块的数据电压，本实施例中第一存储模块能够在数据电压写入驱动模块之前对阈值电压进行存储，从而提前对驱动模块进行阈值电压的补偿，并在数据电压写入时持续通过第一存储模块对阈值电压进行补偿，有效延长对阈值电压的补偿时长，提高补偿效果，有效避免不同像素之间阈值电压补偿程度不同的问题，防止驱动模块输送至发光模块的电流出现差异，提高整个显示面板显示亮度的均一性，降低亮度偏差。
以上是本发明的核心思想，下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述。基于本发明中的实施例，本领域普通技术人员在没有做出创造性劳动前提下，所获得的所有其他实施例，都属于本发明保护的范围。
图3为本发明实施例提供的一种像素电路的结构示意图，如图3所示，像素电路包括：数据写入模块11，驱动模块12、第一存储模块13、第二存储模块14、阈值侦测模块15、第一发光控制模块16、初始化模块17和发光模块18。其中，驱动模块12的第一端用于输入第一电源PVDD输出的信号，第一发光控制模块16连接驱动模块12的第二端和发光模块18的第一端之间，发光模块18的第二端连接第二电源PVEE，也即，第一电源PVDD输出的信号依次经过驱动模块12和第一发光控制模块16到达发光模块18的第一端，使得驱动模块12为发光模块18提供发光驱动信号。
第一存储模块13的第一端连接驱动模块12的控制端，第一存储模块13的第二端通过阈值侦测模块15连接驱动模块12的第二端，使得第一存储模块13能够存储驱动模块12的阈值电压Vth，第二存储模块14的第一端连接第一存储模块13的第二端，第二存储模块14的第二端连接发光模块18的第一端，数据写入模块11连接驱动模块12的第二端，能够向驱动模块12传输数据电压Data，并且通过第二存储模块14对数据电压进行存储，最终使得驱动模块12的控制端的电压达到Vth+Data，使得驱动模块12输出至发光模块17的电流仅跟数据电压Data的大下有关，避免像素电路输出电流存在偏差，提高显示面板显示效果。需要注意的是，第一存储模块13存储的阈值电压Vth与数据电压Data无关，可在数据电压Data写入阶段之前，进行阈值电压Vth的补偿，即使IGZO作为沟道层的N型驱动晶体管的补偿速度较慢，也能够通过拉长补偿时间对N型驱动晶体管补偿完全，有效避免各个像素的驱动模块12补偿的阈值电压不同，避免显示面板显示存在偏差。
此外，初始化模块17能够分别连接驱动模块12的控制端和发光模块18的第一端，从而在像素电路的初始化阶段对驱动模块12的控制端输入对应的初始化电压，并对发光模块18的第一端输入对应的初始化电压。
继续参考图3，可选的，初始化模块可以包括：第一初始化模块171和第二初始化模块172；第一初始化模块171连接于第一电源PVDD和第一存储模块13的第一端之间，用于为第一存储模块13提供第一初始化电压；第二初始化模块172连接于参考电压VAR和发光模块18的第一端之间，用于为发光模块18以及驱动模块12的第二端提供第二初始化电压。
为防止前一帧扫描周期中驱动模块12的控制端的电压影响当前帧扫描周期的第一存储模块13的第一端的电压，本实施例提供了第一初始化模块171，第一初始化模块171能够在当前扫描周期的初始时刻对第一存储模块13的第一端，以及驱动模块12的控制端，提供第一初始化电压，本实施例中，第一初始化电压为第一电源PVDD输出的电压。同理，为了防止前一帧扫描周期中发光模块18的第一端残留电压使得发光模块18存在漏流，影响当前帧扫描周期发光模块18的显示亮度，本实施例提供了第二初始化模块172，第二初始化模块172连接于参考电压VAR和发光模块18的第一端，用于为发光模块18的第一端以及驱动模块12的第二端提供第二初始化电压，第二初始化电压为参考电压VAR输出的信号。上述第一初始化模块171和第二初始化模块172的设置，能够避免当前帧扫描周期的发光模块18受到前一帧扫描周期的影响，进一步提高显示面板的显示均一性。
继续参考图3，可选的，驱动模块12的第一端可直接连接第一电源PVDD。
可选的，数据写入模块11的控制端可连接第一扫描线S1；第二初始化模块172的控制端连接第二扫描线S2；第一发光控制模块16的控制端连接发光控制信号线EMIT；第一初始化模块171的控制端连接第三扫描线Sn1；阈值侦测模块15的控制端连接第四扫描线Sn2。
针对本实施例中的像素电路，显示面板还设置有与其对应的栅极驱动电路，多级栅极驱动电路依次设置，每级栅极驱动电路对应一行像素电路，每级栅极驱动电路均能够输出第一扫描线S1、第二扫描线S2、第三扫描线Sn1和第四扫描线Sn2。数据写入模块11可由第一扫描线S1控制导通和关断，第二初始化模块172可由第二扫描线S2控制导通和关断，第一发光控制模块16则由发光控制信号线EMIT控制导通和关断，第一初始化模块171可由第三扫描线Sn1控制导通和关断，阈值侦测模块15由第四扫描线Sn2控制导通和关断。其中，第一扫描线S1、第二扫描线S2、第三扫描线Sn1和第四扫描线Sn2输出的信号独立设置，互不影响，从而能够为像素电路提供高效、多样的工作时序。
图4为本发明实施例提供的另一种像素电路的结构示意图，可选的，驱动模块12包括第一晶体管M1；第一初始化模块171包括第二晶体管M2；第一发光控制模块16包括第三晶体管M3；数据写入模块11包括第四晶体管M4；第二初始化模块172包括第五晶体管M5；阈值侦测模块15包括第六晶体管M6；第一存储模块13包括第一电容C1；第二存储模块包括第二电容C2；第一晶体管M1的控制端分别与第二晶体管M2的第二端和第一电容C1的第一端电连接；第一晶体管M1的第一端用于输入第一电源PVDD输出的信号；第一晶体管M1的第二端分别连接第六晶体管M6的第二端、第三晶体管M3的第一端和第四晶体管M4的第二端；第二晶体管M2的第一端用于输入第一电源PVDD输出的信号；第二晶体管M2的控制端连接第三扫描线Sn1；第一电容C1的第二端与第六晶体管M6的第一端电连接；第六晶体管M6的控制端连接第四扫描线Sn2；第四晶体管M4的第一端连接数据信号线；第四晶体管M4的控制端连接第一扫描线S1；第三晶体管M3的第二端连接发光模块18的第一端；第三晶体管M3的控制端连接发光控制信号线EMIT；第五晶体管M5的第一端连接参考电压VAR信号线；第五晶体管M5的第二端连接发光模块18的第一端；第五晶体管M5的控制端连接第二扫描线S2；第二电容C2的第一端连接第一电容C1的第二端电连接；第二电容C2的第二端连接发光模块18的第一端。
图4示出了像素电路的具体结构图，可知，像素电路包括第一晶体管M1、第二晶体管M2、第三晶体管M3、第四晶体管M4、第五晶体管M5、第六晶体管M6、第一电容C1和第二电容C2，上述器件构成7T2C的像素电路，第一晶体管M1为驱动管，用于为发光模块18提供发光驱动信号，第一晶体管M1的第一端连接第一电源PVDD，第一晶体管M1的第二端通过第三晶体管M3连接至发光模块18的第一端，第二晶体管M2的第一端连接第一电源PVDD，第二晶体管M2的第二端分别连接第一电容C1的第一端和第一晶体管M1的控制端，第一电容C1的第二端通过第六晶体管M6连接第一晶体管M1的第二端，第二电容C2的第一端连接第一电容C1的第二端，第二电容C2的第二端连接发光模块18的第一端。第四晶体管M4连接于数据信号线和第一晶体管M1的第二端之间，第五晶体管M5连接于参考电压信号线和发光模块18的第一端之间。并且，第二晶体管M2的控制端由第三扫描线Sn1控制，第六晶体管M6的控制端由第四扫描线Sn2控制，第四晶体管M4由第一扫描线S1控制，第五晶体管M5由第二扫描线S2控制。上述像素电路使用两个存储电容：第一电容C1和第二电容C2，第一电容C1能够单独对第一晶体管M1的阈值电压进行补偿，第二电容C2用于对数据信号Data进行补偿，则在数据信号写入第一晶体管M1的第二端之前，第一电容C1即可对第一晶体管M1的阈值电压进行补偿，并在数据写入第一晶体管M1的第二端之后继续对第一晶体管M1的阈值电压进行补偿，延长第一电容C1对阈值电压的补偿时间，保证对第一晶体管M1的阈值电压补偿效果，从而有效降低显示面板的亮度偏差。
可选的，继续参考图4，第一晶体管M1、第二晶体管M2和第六晶体管M6为N型晶体管；第四晶体管M4、第五晶体管M5和第三晶体管M3为P型晶体管。在显示面板制作工艺中，一般N型晶体管将IGZO作为沟道层，一般P型晶体管将LTPS作为沟道层，本实施例中因为N型晶体管能够实现高分辨率显示且成本较低，将第一晶体管M1、第二晶体管M2和第六晶体管M6为N型晶体管，并且通过第一电容C1和第二电容C2解决了N型晶体管阈值补偿速度慢的问题，有效实现均一性强的像素电路，此外，为了加强像素电路数据写入、发光控制以及发光模块初始化的速度，将第四晶体管M4、第五晶体管M5和第三晶体管M3设置为P型晶体管。
如图5所示，图5为图4中像素电路在一帧周期中的一种工作时序示意图，在上述实施例的基础上，在一帧周期内，第一扫描线S1上传输的信号的脉冲、发光控制信号线EMIT上传输的信号的脉冲、第三扫描线Sn1上传输的信号的脉冲以及第四扫描线Sn2上传输的信号的脉冲均在第二扫描线S2传输的信号的脉冲的时间区间内。在一帧周期内，第一扫描线S1、发光控制信号线EMIT、第三扫描线Sn1以及第四扫描线Sn2的脉冲信号位于第二扫描线S2的脉冲信号的时间区间内，从而保证在第一晶体管M1输出发光驱动信号至发光模块18之前，第二扫描线S2保持输出第二初始化电压至发光模块18，保持发光模块18的第一端处于复位电压，防止第一扫描线S1、发光控制信号线EMIT、第三扫描线Sn1以及第四扫描线Sn2在控制过程中对发光模块18的第一端的电压产生影响，使得发光模块18的发光亮度仅与数据信号相关，提高发光模块18显示的准确性，防止显示面板显示偏色。
将像素电路的驱动过程分为四个：初始化阶段、阈值补偿阶段、数据写入阶段和发光阶段，图6为本发明实施例提供的初始化阶段的像素电路示意图，图7为本发明实施例提供的阈值补偿阶段的像素电路示意图，图8为本发明实施例提供的数据写入阶段的像素电路示意图，图9为本发明实施例提供的发光阶段的像素电路示意图。参考图5至图9，可选的，第一扫描线S1、第二扫描线S2、第三扫描线Sn1和第四扫描线Sn2被配置为实现如下驱动：
在初始化阶段t1，第一晶体管M1、第二晶体管M2、第三晶体管M3、第五晶体管M5和第六晶体管M6导通；第四晶体管M4关断；在阈值补偿阶段t2，第一晶体管M1、第二晶体管M2、第五晶体管M5和第六晶体管M6导通；第三晶体管M3和第四晶体管M4关断；在数据写入阶段t3，第一晶体管M1、第四晶体管M4、第五晶体管M5和第六晶体管M6导通；第二晶体管M2和第三晶体管M3关断；在发光阶段t4，第一晶体管M1和第三晶体管M3导通；第二晶体管M2、第四晶体管M4、第五晶体管M5和第六晶体管M6导通关断。
具体的，需要注意的是，图6至图9中，关断的晶体管通过“×”符号进行标注，如图6所示，在初始化阶段t1，第一晶体管M1导通，第一晶体管M1的第一端电位Vd＝PVDD(第一电源输出电压)，第二晶体管M2导通，第一晶体管M1的控制端电位Vg＝PVDD，同时第一电容C1的第一端电位为PVDD，第三晶体管M3、第五晶体管M5和第六晶体管M6导通，第四晶体管M4关断，第一晶体管M1的第二端电位Vs＝VAR(参考电压的电压值)，发光模块18的第一端电位同样为参考电压，由此可知，第一晶体管M1的控制端与第二端之间的电位Vgs＝PVDD-VAR。
在阈值补偿阶段t2，第三晶体管M3由导通变为关断，则发光模块18的第一端电位保持为参考电压，则第一电容C1、第一晶体管M1和第六晶体管M6形成放电回路，第一电容C1逐渐放电直至第一晶体管M2的控制端与第二端之间的电位Vgs＝Vth(阈值电压)，此时，第一晶体管M1的控制端电位Vg＝PVDD，则第一晶体管M2的第二端电位Vs＝PVDD-Vth，此外，第一电容C1的第一端电位为PVDD，第一电容C1两端的电位差Vc1＝Vth，则在阈值补偿阶段t2，第一电容C1即能够对第一晶体管M1的阈值电压进行存储，从而对第一晶体管M1进行补偿。
在数据写入阶段t3，第二晶体管M2由导通变为关断，第四晶体管M4由关断变为导通，则数据电压Data写入第一晶体管M1的第二端，第一晶体管M1的第二端电位Vs＝Data，第一晶体管M1的第一端电位Vd＝PVDD，因为第一晶体管M2的控制端与第二端之间的电位Vgs＝Vth，则第一晶体管M1的控制端电位Vg＝Data+Vth，此时，第一电容C1两端的电位差Vc1＝Vth，第二电容C1两端的电位差Vc2＝Data-VAR。则在数据写入阶段t3，第一电容C1继续对第一晶体管M1的阈值电压进行补偿，第二电容C2用于存储Vc2，从而保证第二电容C2的第一端对Data进行存储。
在发光阶段t4，第三晶体管M3由关断变为导通，第六晶体管M6由导通变为关断，第四晶体管M4由导通变为关断，第五晶体管M5由导通变为关断，因为第一电容C1和第二电容C2的两端电压差不变，则第一电容C1两端的电位差Vc1＝Vth，第二电容C1两端的电位差Vc2＝Data-VAR，第一晶体管M1的第一端电位Vd＝PVDD，第一晶体管M1的第二端电位Vs＝PVEE(第二电源输出电压)+Voled(发光模块电压差)，第一晶体管M1的控制端电位Vg＝Vs+Vc2+Vc1＝Data+Vth+PVEE+Voled-VAR，则第一晶体管M2的控制端与第二端之间的电位Vgs＝Data+Vth-VAR。
对于上述依次设置的初始化阶段、阈值补偿阶段、数据写入阶段和发光阶段，在阈值补偿阶段和数据写入阶段通过第一电容对第一晶体管的阈值电压进行补偿，可通过第一晶体管对应的阈值电压补偿时间，对阈值补偿阶段的时长进行调整，使得第一晶体管的控制端获取充足的充电时间，相对于仅在数据写入阶段进行阈值电压补偿，本实施例可有效延长补偿时间，提高第一晶体管的阈值电压补偿效果。当第一晶体管为IGZO作为沟道层的N型驱动晶体管时，也能够实现良好的阈值电压补偿效果，避免显示面板偏色。
可选的，继续参考图5，在数据写入阶段t3，第六晶体管M6导通后关断；第四晶体管M4导通后关断。在数据写入阶段t3，当在第一电容补偿阈值电压并在第二电容存储数据电压完毕后，第六晶体管M6和第四晶体管M4自动关断，使得电容的补偿过程与后续发光阶段之间存在一定的时间间隔，避免电容的补偿过程产生波动，进一步提高补偿效果。
可选的，第四晶体管M4的关断迟于第六晶体管M6的关断。在数据写入阶段t3，第六晶体管M6和第四晶体管M4导通后关断时，第四晶体管M4的关断迟于第六晶体管M6的关断，则在第一电容C1存有阈值电压Vth时，保持第六晶体管M6导通使得第四晶体管M4将数据电压Data写入第一晶体管M1的第二端，从而保证第一晶体管M1的控制端电位Vg＝Data+Vth，当第四晶体管M4关断不再写入数据电压Data时，再关断第六晶体管M6，保证像素电路具有良好的补偿效果，避免第一晶体管M1(驱动晶体管)因补偿的阈值电压不同导致输送的电流存在差异，提高显示面板均一性。
图10为图4中像素电路在一帧周期中的另一种工作时序示意图，可选的，在发光阶段t4，第三晶体管M3的导通迟于第五晶体管M5的关断。在发光阶段t4，需要先关断第五晶体管M5，阻断参考电压对发光模块的复位，再导通第三晶体管M3，以通过第一晶体管M1驱动发光模块发光，有效避免参考电压对发光阶段产生干扰，提高显示效果。
图11为本发明实施例提供的另一种像素电路的结构示意图，可选的，像素电路还可以包括：第二发光控制模块19；第二发光控制模块19连接于第一电源PVDD和驱动模块12的第一端之间。在第一晶体管M1的控制端的补偿过程中，可能存在无法补偿到第一晶体管M1完全关闭的情况，则第一电源PVDD会始终给到第一晶体管M1漏电流，本实施例增加第二发光控制模块19，通过第二发光控制模块19关断第一电源PVDD和驱动模块12之间的连接，使得第一晶体管M1没有漏电流流过，有效避免第一晶体管M1因无法完全关闭对显示造成的影响。
可选的，第二发光控制模块19的控制端连接发光控制信号线EMIT。第二发光控制模块19和第一发光控制模块16均由发光控制信号线EMIT控制，则第二发光控制模块19的工作时序与第一发光控制模块16一致，在第一发光控制模块16连接第一晶体管M1和发光模块18时，第二发光控制模块19连接第一电源PVDD和第一晶体管M1。
继续参考图11，可选的，第二发光控制模块19可以包括：第七晶体管M7；第七晶体管M7的第一端与第一电源PVDD电连接；第七晶体管M7的第二端分别与第一初始化模块171和驱动模块12电连接；第七晶体管M7的控制端连接发光控制信号线EMIT。
基于同一构思，本发明实施例还提供一种像素电路的驱动方法,适用于本发明任意实施例提供的像素电路。图12为本发明实施例提供的一种像素电路的驱动方法的流程示意图，如图12所示，本实施例的方法包括如下步骤：
步骤S101、在初始化阶段，控制初始化模块传输对应的初始化电压至驱动模块的控制端和发光模块的第一端。
步骤S102、在阈值补偿阶段，控制阈值侦测模块导通，第一存储模块存储驱动模块的阈值电压。
步骤S103、在数据写入阶段，控制数据写入模块将数据电压写入驱动模块的第二端；第二存储模块存储数据电压。
步骤S104、在发光阶段，控制第一发光控制模块导通，驱动模块输出驱动电流驱动发光模块发光。
本发明实施例中，在初始化阶段，控制初始化模块分别对驱动模块的控制端和发光模块的第一端进行复位，在阈值补偿阶段，通过第一存储模块对驱动模块的阈值电压进行补偿，在数据写入阶段，第一存储模块对驱动模块的阈值电压进行补偿，第二存储模块对数据电压进行存储，本实施例中第一存储模块能够在数据电压写入驱动模块之前对阈值电压进行存储，从而提前对驱动模块进行阈值电压的补偿，并在数据电压写入时持续通过第一存储模块对阈值电压进行补偿，有效延长对阈值电压的补偿时长，提高补偿效果，有效避免不同像素之间阈值电压补偿程度不同的问题，使得驱动模块阈值补偿充足，从而驱动模块在发光阶段显示亮度无偏差。
在上述实施例的基础上，参考图5至图9，初始化模块包括：第一初始化模块和第二初始化模块；驱动模块包括第一晶体管M1；第一初始化模块包括第二晶体管M2；第一发光控制模块包括第三晶体管M3；数据写入模块包括第四晶体管M4；第二初始化模块包括第五晶体管M5；阈值侦测模块包括第六晶体管M6；第一存储模块包括第一电容C1；第二存储模块包括第二电容C2；
像素电路的驱动方法包括：
在初始化阶段，第一扫描信号控制第四晶体管M4关断，第二扫描信号控制第五晶体管M5导通，发光控制信号控制第三晶体管M3导通，第三扫描信号控制第二晶体管M2导通，第四扫描信号控制第六晶体管M6导通，则第一晶体管M1的栅极获取第一初始化电压，发光模块的第一端获取第二初始化电压，第一晶体管M1导通；
在阈值补偿阶段，第一扫描信号控制第四晶体管M4关断，第二扫描信号控制第五晶体管M5导通，发光控制信号控制第三晶体管M3关断，第三扫描信号控制第二晶体管M2导通，第四扫描信号控制第六晶体管M6导通，则第一晶体管M1导通，第一晶体管M1的控制端和第二端之间的电压差为阈值电压；第一电容C1存储阈值电压；
在数据写入阶段，第一扫描信号控制第四晶体管M4导通，第二扫描信号控制第五晶体管M5导通，发光控制信号控制第三晶体管M3关断，第三扫描信号控制第二晶体管M2关断，第四扫描信号控制第六晶体管M6导通，则第一晶体管M1导通，第一晶体管M1的第二端写入数据电压；第二电容C2对数据电压进行存储；
在发光阶段，第一扫描信号控制第四晶体管M4关断，第二扫描信号控制第五晶体管M5关断，发光控制信号控制第三晶体管M3导通，第三扫描信号控制第二晶体管M2关断，第四扫描信号控制第六晶体管M6关断，第一晶体管M1通过第三晶体管M3输出驱动电流至发光模块。
本发明实施例还提供一种显示面板。图13为本发明实施例提供的一种显示面板的结构示意图，如图13所示，本发明实施例提供的显示面板包括本发明任意实施例的像素电路1。本实施例中显示面板包括本发明任意实施例提供的像素电路的技术特征，具备相应技术特征所具有的有益效果，此处不再赘述。
本发明实施例还提供一种显示装置。图14为本发明实施例提供的一种显示装置的结构示意图，如图14所示，本发明实施例提供的显示装置包括本发明任意实施例的显示面板2。显示装置可以为如图14中所示的手机，也可以为电脑、电视机、智能穿戴设备等，本实施例对此不作特殊限定。
注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。

Claims (18)

1.一种像素电路，其特征在于，包括：数据写入模块，驱动模块、第一存储模块、第二存储模块、阈值侦测模块、第一发光控制模块、初始化模块和发光模块；
所述驱动模块的第一端用于输入第一电源输出的信号，所述第一发光控制模块连接于所述驱动模块的第二端和所述发光模块的第一端之间，所述发光模块的第二端连接第二电源；所述驱动模块用于为发光模块提供发光驱动信号；
所述第一存储模块的第一端连接所述驱动模块的控制端，所述第一存储模块的第二端连接所述第二存储模块的第一端，所述第二存储模块的第二端连接所述发光模块的第一端；
所述阈值侦测模块连接于所述第一存储模块的第二端与所述驱动模块的第二端之间，用于控制所述第一存储模块存储所述驱动模块的阈值电压；
所述数据写入模块连接所述驱动模块的第二端，用于向所述驱动模块传输数据电压；
所述初始化模块连接所述驱动模块的控制端和所述发光模块的第一端，用于向所述驱动模块的控制端和所述发光模块的第一端传输对应的初始化电压。
2.根据权利要求1所述的像素电路，其特征在于，所述初始化模块包括：第一初始化模块和第二初始化模块；
所述第一初始化模块连接于第一电源和所述第一存储模块的第一端之间，用于为所述第一存储模块提供第一初始化电压；
所述第二初始化模块连接于参考电压和所述发光模块的第一端之间，用于为所述发光模块以及所述驱动模块的第二端提供第二初始化电压。
3.根据权利要求1所述的像素电路，其特征在于，所述驱动模块的第一端直接连接所述第一电源。
4.根据权利要求2所述的像素电路，其特征在于，所述数据写入模块的控制端连接第一扫描线；所述第二初始化模块的控制端连接第二扫描线；所述第一发光控制模块的控制端连接发光控制信号线；
所述第一初始化模块的控制端连接第三扫描线；所述阈值侦测模块的控制端连接第四扫描线。
5.根据权利要求4所述的像素电路，其特征在于，在一帧周期内，所述第一扫描线上传输的信号的脉冲、所述发光控制信号线上传输的信号的脉冲、所述第三扫描线上传输的信号的脉冲以及第四扫描线上传输的信号的脉冲均在所述第二扫描线传输的信号的脉冲的时间区间内。
6.根据权利要求2所述的像素电路，其特征在于，所述驱动模块包括第一晶体管；所述第一初始化模块包括第二晶体管；所述第一发光控制模块包括第三晶体管；所述数据写入模块包括第四晶体管；所述第二初始化模块包括第五晶体管；所述阈值侦测模块包括第六晶体管；所述第一存储模块包括第一电容；所述第二存储模块包括第二电容；
所述第一晶体管的控制端分别与所述第二晶体管的第二端和所述第一电容的第一端电连接；所述第一晶体管的第一端用于输入第一电源输出的信号；所述第一晶体管的第二端分别连接所述第六晶体管的第二端、第三晶体管的第一端和第四晶体管的第二端；
所述第二晶体管的第一端用于输入第一电源输出的信号；所述第二晶体管的控制端连接第三扫描线；所述第一电容的第二端与所述第六晶体管的第一端电连接；所述第六晶体管的控制端连接第四扫描线；
所述第四晶体管的第一端连接数据信号线；所述第四晶体管的控制端连接第一扫描线；所述第三晶体管的第二端连接所述发光模块的第一端；所述第三晶体管的控制端连接发光控制信号线；所述第五晶体管的第一端连接参考电压；所述第五晶体管的第二端连接所述发光模块的第一端；所述第五晶体管的控制端连接第二扫描线；
所述第二电容的第一端连接所述第一电容的第二端电连接；所述第二电容的第二端连接所述发光模块的第一端。
7.根据权利要求6所述的像素电路，其特征在于，所述第一晶体管、所述第二晶体管和所述第六晶体管为N型晶体管；所述第四晶体管、所述第五晶体管和所述第三晶体管为P型晶体管。
8.根据权利要求6所述的像素电路，其特征在于，所述第一扫描线、所述第二扫描线、所述第三扫描线和所述第四扫描线被配置为实现如下驱动：
在初始化阶段，所述第一晶体管、所述第二晶体管、所述第三晶体管、所述第五晶体管和所述第六晶体管导通；所述第四晶体管关断；
在阈值补偿阶段，所述第一晶体管、所述第二晶体管、所述第五晶体管和所述第六晶体管导通；所述第三晶体管和所述第四晶体管关断；
在数据写入阶段，所述第一晶体管、所述第四晶体管、所述第五晶体管和所述第六晶体管导通；所述第二晶体管和所述第三晶体管关断；
在发光阶段，所述第一晶体管和所述第三晶体管导通；所述第二晶体管、所述第四晶体管、所述第五晶体管和所述第六晶体管导通关断。
9.根据权利要求8所述的像素电路，其特征在于，在所述数据写入阶段，所述第六晶体管导通后关断；所述第四晶体管导通后关断。
10.根据权利要求9所述的像素电路，其特征在于，所述第四晶体管的关断迟于所述第六晶体管的关断。
11.根据权利要求8所述的像素电路，其特征在于，在所述发光阶段，所述第三晶体管的导通迟于所述第五晶体管的关断。
12.根据权利要求2所述的像素电路，其特征在于，还包括：第二发光控制模块；
所述第二发光控制模块连接于所述第一电源和所述驱动模块的第一端之间。
13.根据权利要求12所述的像素电路，其特征在于，所述第二发光控制模块的控制端连接发光控制信号线。
14.根据权利要求12所述的像素电路，其特征在于，所述第二发光控制模块包括：第七晶体管；
所述第七晶体管的第一端与所述第一电源电连接；所述第七晶体管的第二端分别与所述第一初始化模块和所述驱动模块电连接；所述第七晶体管的控制端连接发光控制信号线。
15.一种像素电路的驱动方法，其特征在于，应用上述权利要求1-14任一项所述的像素电路，包括：
在初始化阶段，控制所述初始化模块传输对应的初始化电压至所述驱动模块的控制端和所述发光模块的第一端；
在阈值补偿阶段，控制所述阈值侦测模块导通，所述第一存储模块存储所述驱动模块的阈值电压；
在数据写入阶段，控制所述数据写入模块将数据电压写入所述驱动模块的第二端；所述第二存储模块存储所述数据电压；
在发光阶段，控制所述第一发光控制模块导通，所述驱动模块输出驱动电流驱动所述发光模块发光。
16.根据权利要求15所述的像素电路的驱动方法，其特征在于，所述初始化模块包括：第一初始化模块和第二初始化模块；所述驱动模块包括第一晶体管；所述第一初始化模块包括第二晶体管；所述第一发光控制模块包括第三晶体管；所述数据写入模块包括第四晶体管；所述第二初始化模块包括第五晶体管；所述阈值侦测模块包括第六晶体管；所述第一存储模块包括第一电容；所述第二存储模块包括第二电容；
所述像素电路的驱动方法包括：
在初始化阶段，第一扫描信号控制第四晶体管关断，第二扫描信号控制第五晶体管导通，发光控制信号控制所述第三晶体管导通，第三扫描信号控制所述第二晶体管导通，第四扫描信号控制所述第六晶体管导通，则所述第一晶体管的控制端获取第一初始化电压，所述发光模块的第一端获取第二初始化电压，所述第一晶体管导通；
在阈值补偿阶段，第一扫描信号控制第四晶体管关断，第二扫描信号控制第五晶体管导通，所述发光控制信号控制所述第三晶体管关断，所述第三扫描信号控制所述第二晶体管导通，所述第四扫描信号控制所述第六晶体管导通，则所述第一晶体管导通，所述第一晶体管的控制端和所述第二端之间的电压差为阈值电压；所述第一电容存储所述阈值电压；
在数据写入阶段，第一扫描信号控制第四晶体管导通，第二扫描信号控制第五晶体管导通，所述发光控制信号控制所述第三晶体管关断，所述第三扫描信号控制所述第二晶体管关断，所述第四扫描信号控制所述第六晶体管导通，则所述第一晶体管导通，所述第一晶体管的第二端写入数据电压；所述第二电容对所述数据电压进行存储；
在发光阶段，第一扫描信号控制第四晶体管关断，第二扫描信号控制第五晶体管关断，所述发光控制信号控制所述第三晶体管导通，所述第三扫描信号控制所述第二晶体管关断，所述第四扫描信号控制所述第六晶体管关断，所述第一晶体管通过所述第三晶体管输出驱动电流至所述发光模块。
17.一种显示面板，其特征在于，包括上述权利要求1-14任一项所述的像素电路。
18.一种显示装置，其特征在于，包括上述权利要求17所述的显示面板。
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