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CN111724738B - 显示面板的驱动电路 - Google Patents

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CN111724738B
CN111724738B CN202010198288.3A CN202010198288A CN111724738B CN 111724738 B CN111724738 B CN 111724738B CN 202010198288 A CN202010198288 A CN 202010198288A CN 111724738 B CN111724738 B CN 111724738B
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Abstract

本发明公开了一种显示面板之驱动电路包含一扫描驱动电路、一数据驱动电路及一控制电路。扫描驱动电路耦接显示面板之复数扫描线，并提供一扫描讯号至复数扫描线之一扫描线。数据驱动电路耦接显示面板之复数数据线，并提供至少一数据讯号与一放电准位至复数数据线之至少一数据线。扫描驱动电路扫描该扫描线，数据驱动电路提供数据讯号至数据线后而提供放电准位至数据线让数据线之准位为放电准位前，扫描驱动电路控制未扫描之至少一扫描线处于一第一阻抗状态，并于数据线之准位为放电准位期间，扫描驱动电路控制未扫描之至少一扫描线处于一第二阻抗状态。

Description

显示面板的驱动电路
技术领域
本申请涉及一种显示面板的驱动电路，尤其涉及一种可避免显示面板之显示画面异常且可达到省电效果的驱动电路。
背景技术
在被动式有机发光二极管显示器中，当扫描驱动电路对显示面板之其中一行扫描线结束扫描前，数据驱动电路可对位于被扫描之扫描线已被驱动之像素(显示单元)进行放电。为了让位于未被扫描之扫描线之像素的寄生电容所储存的电荷不被放电而可节省电源，扫描驱动电路控制未被扫描之扫描线处于一高阻抗状态(Hi-Z state)。然而，处于高阻抗状态之扫描线的电压准位会受到数据驱动电路对已被驱动之像素进行释放电荷之影响而被往下耦合，即电压准位下降，当扫描驱动电路扫描下一行扫描线且数据驱动电路提供电能至位于已被扫描之扫描线而欲驱动之像素时，才会使处于高阻抗状态之未被扫描之扫描线的电压准位往上耦合，即电压准位上升。
然而，此种驱动方式有可能会使画面产生异常，因为于每行扫描线完成扫描前，数据驱动电路对已被驱动之像素放电后，无法确定处于高阻抗状态之未扫描之扫描线的电压准位下降至多少电压准位，有可能导致位于未被扫描之扫描线原本应该要禁能(不点亮)的像素致能(点亮)而显示，进而导致显示画面产生异常的现象。具体来说，若驱动(点亮)位于目前已被扫描之扫描线之像素的数量较多，当对该些已被驱动之像素放电时，即会导致处于高阻抗状态之未扫描之扫描线的电压准位大幅降低；而扫描下一行扫描线期间，数据驱动电路驱动之像素的数量相对较少时，会使处于高阻抗之扫描线的电压准位无法拉升至安全的临界电压准位，如此即会造成原本应该要禁能的像素致能，而导致显示画面异常，即影响显示质量。尤其现今驱动方式，扫描驱动电路依序扫描显示器的复数扫描线，例如，由上往下依序扫描该复数扫描线，或者由下往上依序扫描该复数扫描线，而完全没有考虑扫描每一行扫描线时，数据驱动电路驱动像素的数量。
发明内容
因此，本申请的主要目的即在于提供一种显示面板之驱动电路，能解决先前技术之问题，且达到省电的功效。
本申请公开一种显示面板之驱动电路，包含一扫描驱动电路、一数据驱动电路及一控制电路。扫描驱动电路耦接于显示面板之复数扫描线，并提供一扫描讯号至复数扫描线之一扫描线，而扫描该扫描线。数据驱动电路耦接于显示面板之复数数据线，并提供至少一数据讯号与一放电准位至复数数据线之至少一数据线。控制电路耦接于扫描驱动电路及数据驱动电路，并控制扫描驱动电路与数据驱动电路。扫描驱动电路扫描该扫描线，且数据驱动电路提供该至少一数据讯号至该至少一数据线后而提供放电准位至该至少一数据线让该至少一数据线之准位为放电准位前，扫描驱动电路控制未扫描之至少一扫描线处于一第一阻抗状态，并于该至少一数据线之准位为放电准位期间，扫描驱动电路控制未扫描之该至少一扫描线处于一第二阻抗状态，第二阻抗状态之阻抗等于或小于第一阻抗状态之阻抗，第一阻抗状态之阻抗为高阻抗。
本申请公开另一种显示面板之驱动电路，包含一扫描驱动电路、一数据驱动电路以及一控制电路。扫描驱动电路耦接于显示面板之复数扫描线，并提供一扫描讯号至该复数扫描线之一扫描线，而扫描该扫描线。数据驱动电路耦接于显示面板之复数数据线，并提供至少一数据讯号与一放电准位至该复数数据线之至少一数据线。控制电路耦接于扫描驱动电路及数据驱动电路，并控制扫描驱动电路与数据驱动电路。扫描驱动电路扫描该扫描线，且数据驱动电路提供该至少一数据讯号至该至少一数据线后而提供放电准位至该至少一数据线让该至少一数据线之准位为放电准位前，扫描驱动电路控制未扫描之至少一扫描线处于一高阻抗状态，并于扫描驱动电路扫描下一扫描线且数据驱动电路提供该至少一数据讯号至该复数数据线之至少一数据线期间，扫描驱动电路控制未扫描之该至少一扫描线之电压准位为一禁能准位。
本申请公开一种显示面板之驱动电路，包含一扫描驱动电路、一数据驱动电路以及一控制电路。扫描驱动电路耦接于显示面板之复数扫描线，并扫描该复数扫描线。数据驱动电路耦接于显示面板之复数数据线，并对应每一扫描线提供至少一数据讯号至该复数数据线之至少一数据线，而驱动显示面板之至少一像素。控制电路耦接于扫描驱动电路及数据驱动电路，并控制扫描驱动电路与数据驱动电路，且依据数据驱动电路对应每一扫描线驱动像素的一驱动数量决定扫描驱动电路扫描该复数扫描线的扫描顺序。
附图说明
图1是本申请的第一实施例之一驱动电路的电路方块示意图。
图2是本申请的第一实施例之未扫描之扫描线之准位的变化示意图。
图3是本申请的第一实施例之切换电路的电路示意图。
图4是本申请的第二实施例之一驱动电路的电路方块示意图。
图5是本申请的第二实施例之未扫描之扫描线之准位的变化示意图。
图6是本申请的第一实施例与第二实施例之未扫描之扫描线之状态的变化示意图。
图7是本申请的第三实施例之一驱动电路的电路方块示意图。
图8是本申请的第三实施例之一扫描顺序示意图。
图9是本申请的第三实施例之一扫描顺序示意图。
图10是本申请的第三实施例之一扫描顺序示意图。
图11是本申请的第三实施例之一扫描顺序示意图。
图12是本申请的第三实施例之一扫描顺序示意图。
图13是本申请的第三实施例之一扫描顺序示意图。
其中，附图标记说明如下：
1 显示面板
11 扫描线
12 数据线
13 像素
2、3、4 驱动电路
20 电源产生器
21 扫描驱动电路
210 切换电路
211 第一开关
213 可变电阻
215 第二开关
217 第三开关
22 数据驱动电路
221 电流源
223 开关
23 储存单元
24 控制电路
241 控制单元
243 解析电路
CC 电流驱动阶段
DC 放电阶段
Z 阻抗端
HIZ 高阻抗端
OUT 输出端
PC 预充电阶段
VDIS 放电准位
VOFF 禁能电压
VON 致能准位
VPRE 预充电电压
Z1 第一阻抗
Z2 第二阻抗
具体实施方式
在说明书及权利要求当中使用了某些词汇指称特定的组件，然，所属本申请技术领域中具有通常知识者应可理解，制造商可能会用不同的名词称呼同一个组件，而且，本说明书及权利要求并不以名称的差异作为区分组件的方式，而是以组件在整体技术上的差异作为区分的准则。在通篇说明书及权利要求当中所提及的「包含」为一开放式用语，故应解释成「包含但不限定于」。再者，「耦接」一词在此包含任何直接及间接的连接手段。因此，若文中描述一第一装置耦接一第二装置，则代表第一装置可直接连接第二装置，或可通过其他装置或其他连接手段间接地连接至第二装置。
请参阅图1，图1为本申请的第一实施例之一驱动电路2之电路方块图标意图。驱动电路2用于驱动一显示面板1，显示面板1包含复数扫描线11、复数数据线12及复数像素13。该复数扫描线11横向排列且相间隔，该复数数据线12纵向排列且与该复数扫描线11交错并相间隔。每一像素13设置于对应之扫描线11与数据线12的交会处并耦接于扫描线11及数据线12，且每一像素13包含一有机发光二极管(Organic Light-Emitting Diode，OLED)，并具有耦合电容等寄生电容。于本申请之一实施例中，有机发光二极管之阳极耦接数据线12，阴极则耦接扫描线11，耦合电容位于每一扫描线11与每一数据线12之间。当然，在其他实施例中，像素13也可为其他类型显示单元，不以此为限。
驱动电路2包含一电源产生器20、一扫描驱动电路21、一数据驱动电路22、一储存单元23以及一控制电路24。电源产生器20耦接于扫描驱动电路21与数据驱动电路22，以提供扫描驱动电路21及数据驱动电路22所需之电源，例如电压或者电流。扫描驱动电路21耦接于该复数扫描线11，并用于提供一扫描讯号至对应的扫描线11，以扫描对应的扫描线11。于此实施例中，扫描讯号为一禁能电压VOFF或者为一致能准位VON，禁能电压VOFF相对于致能准位VON为高电压，而致能准位VON可为接地端准位。当扫描讯号为致能准位VON时则扫描扫描线11，若扫描讯号为禁能电压VOFF则未扫描扫描线11。
此外，扫描驱动电路21更具有复数阻抗端Z，该复数阻抗端Z分别对应该复数扫描线11。当扫描线11耦接阻抗端Z时，其让扫描线11处于不同阻抗状态，而变换扫描线11之阻抗。在本实施例中，如图6所示，阻抗端Z之阻抗状态包括一第一阻抗状态与一第二阻抗状态，第一阻抗状态具有阻抗值较高的第一阻抗Z1，而第二阻抗状态具有一阻抗值较低的第二阻抗Z2。扫描驱动电路21包含复数切换电路210，该复数切换电路210对应该复数扫描线11，以提供禁能电压VOFF或者致能准位VON至对应的扫描线11，或者让扫描线11耦接于阻抗端Z。
请参阅图3，其是本申请的第一实施例之切换电路210的电路示意图。如图所示，切换电路210包含一第一开关211、一可变电阻213、一第二开关215与一第三开关217。第一开关211耦接于禁能电压VOFF与可变电阻213之一第一端之间，可变电阻213之一第二端耦接于一输出端OUT。第二开关215耦接于禁能电压VOFF与输出端OUT之间。第三开关217耦接于致能准位VON与输出端OUT之间。于本申请之一实施例中，扫描驱动电路21依据一时序讯号控制第一开关211、第二开关215与第三开关217，或者可由其他电路控制开关211、215、217。
承接上述，当第一开关211与第二开关215截止而第三开关217导通时，输出端OUT之准位即为致能准位VON，其相当于扫描驱动电路21经由切换电路210提供致能准位VON至扫描线11，以扫描扫描线11。当第一开关211与第三开关217截止而第二开关215导通时，禁能电压VOFF传输至输出端OUT，其相当于扫描驱动电路21经由切换电路210提供禁能电压VOFF至扫描线11，而不扫描扫描线11，即关闭位于未扫描之扫描线的像素13。当第一开关211、第二开关215与第三开关217皆截止时，输出端OUT为开路状态，即输出端OUT处于高阻抗状态(Hi-Z state)，而输出端OUT之阻抗为高阻抗，于此实施例中为第一阻抗Z1。输出端OUT处于高阻抗状态下，其相当于扫描驱动电路21经由切换电路210让扫描线11耦接于阻抗端Z而处于高阻抗状态。当第二开关215与第三开关217截止而第一开关211导通时，可变电阻213经由第一开关211连接于禁能电压VOFF，输出端OUT会处于第二阻抗状态，而具有第二阻抗Z2，第二阻抗Z2决定于可变电阻213当下之电阻值，其相当于扫描驱动电路21经由切换电路210让扫描线11耦接于阻抗端Z而处于第二阻抗状态。
复参阅图1，数据驱动电路22耦接于该复数数据线12，并可提供复数数据讯号至对应的数据线12，且数据驱动电路22具有复数电流源221，以产生该复数数据讯号。于本申请之一实施例中，每一电流源221可为一电流镜，能够镜射电源产生器20所输出至数据驱动电路22的电流。复数开关223分别位于该复数电流源221与该复数数据线12之间，且该复数电流源221经该复数开关223以提供电流至该复数像素13，驱使该复数像素13能发亮。上述电流源221之电流即为数据讯号用于驱动该复数像素13。因此，该数据驱动电路22依据一显示数据控制该复数开关223，而提供电流至欲驱动之像素13。于本申请之一实施例中，显示数据可储存于储存单元23，而数据驱动电路22耦接于储存单元23，以接收显示数据，或者由电子装置之一主机(Host)直接传输显示数据至数据驱动电路22。
此外，于扫描驱动电路21扫描每一行扫描线11期间，数据驱动电路22还可提供一预充电电压VPRE或一放电准位VDIS至该复数数据线12，也就是可提供预充电电压VPRE或放电准位VDIS至部分像素13。数据驱动电路22于驱动部分像素13之前，可先进入一预充电阶段PC(precharge phase)，以对欲驱动之像素13进行预充电，再进入一电流驱动阶段CC(constant current phase)，即提供电流至欲驱动之像素13，之后进入一放电阶段DC(discharge phase)，即提供放电准位VDIS至已驱动之像素13，以对已驱动之像素13进行放电。于本申请之一实施例中，放电准位VDIS可为接地端的准位。同于上述，该复数开关223也位于预充电电压VPRE与该复数数据线13之间，以及位于放电准位VDIS与该复数数据线13之间，因此数据驱动电路22会依据显示数据控制开关223，以提供预充电电压VPRE或放电准位VDIS至部份像素13。须说明的是，每一电流源221对应一数据线12，因此每一电流源221能驱动对应之数据线12上的像素13。于本申请之一实施例中，一电流源221并非只能对应一数据线12，而可一电流源221对应复数数据线12，而可减少电流源221之数量，但电流源221与每一数据线12之间仍设有开关223。
储存单元23可存有显示数据，显示数据包括数据驱动电路22对应每一扫描线11欲驱动之像素13与不驱动之像素13的信息，所以依据显示数据可得知数据驱动电路22对应每一扫描线11欲驱动像素13的驱动数量。
搭配参阅图2与图6，控制电路24耦接于扫描驱动电路21、数据驱动电路22及储存单元23，并具有一控制单元241及一解析电路243。控制单元241耦接扫描驱动电路21与数据驱动电路22，以提供一时序讯号至扫描驱动电路21与数据驱动电路22，扫描驱动电路21与数据驱动电路22分别依据时序讯号进行运作，例如扫描驱动电路21依据时序讯号扫描该复数扫描线11，而数据驱动电路22依据时序讯号依序进入预充电阶段PC、电流驱动阶段CC及放电阶段DC。
解析电路243可依据显示数据来判断数据驱动电路22对应被扫描之扫描线11而欲驱动像素13的一第一驱动数量与数据驱动电路22对应被扫描之下一扫描线11而欲驱动像素13的一第二驱动数量，解析电路243依据第一驱动数量与第二驱动数量之差异决定第二阻抗Z2之阻抗值，即解析电路243产生一调整讯号至扫描驱动电路21，以调整可变电阻213之电阻值，亦即当第一驱动数量大于第二驱动数量时，第二阻抗Z2之阻抗值小于第一阻抗Z1之阻抗值。更进一步地，当第一驱动数量大于第二驱动数量，且差异值越大时，第二阻抗Z2之阻抗值越小于第一阻抗Z1之阻抗值。换言之，当第一驱动数量大于第二驱动数量且差异值越大时，其表示处于高阻抗状态之未扫描之扫描线11的电压准位会于放电阶段DC被往下拉至相对较低的电压准位，因此，当第一驱动数量与第二驱动数量差异较大时，所需提供的第二阻抗Z2之阻抗值会相对较小，如此可使未扫描之扫描线11之电压准位于后续阶段可以尽快稳定至禁能电压VOFF附近。
具体而言，控制电路24之控制单元241控制扫描驱动电路21扫描该复数扫描线11，且控制数据驱动电路22于电流驱动阶段CC提供该复数数据讯号分别至对应的数据线12，以驱动对应的像素13，之后在数据驱动电路22提供放电准位VDIS至对应的数据线12，且让对应的数据线12之准位为放电准位VDIS前(即进入放电阶段DC前)，扫描驱动电路21控制未扫描之扫描线11处于第一阻抗状态，即让未扫描之扫描线11耦接于阻抗端Z，而驱使未扫描之扫描线11处于高阻抗状态，以可让未被扫描之扫描线11上之像素13的寄生电容所储存的电荷不会在放电阶段DC被放电而可节省电源。此外，于对应之数据线12之准位为放电准位VDIS期间，扫描驱动电路21进一步控制未扫描之扫描线11处于第二阻抗状态，亦即扫描驱动电路21控制切换电路210让未扫描之扫描线11之阻抗值为第二阻抗Z2，此可让未扫描之扫描线11之电压准位被往上拉升，并且让未扫描之扫描线11持续处于第二阻抗状态至扫描驱动电路21扫描下一扫描线11且数据驱动电路22提供预充电电压VPRE至对应之数据线12的期间(即预充电阶段PC)，甚至持续到电流驱动阶段CC，如此可让未扫描之扫描线11之电压准位稳定至禁能电压VOFF之禁能准位附近。另外，为了避免放电阶段之时间太短让未扫描之扫描线11之电压准位未被往上拉升至预定准位，可依据放电阶段之时间长度设定未扫描之扫描线11处于第二阻抗状态之起始时间。特别要说明的是，在本实施例中，第二阻抗Z2之阻抗值小于第一阻抗Z1之阻抗值；而当第一驱动数量等于第二驱动数量或第一驱动数量与第二驱动数量差异不大时，第二阻抗Z2之阻抗值可等于第一阻抗Z1之阻抗值。
更进一步地，为了确保未扫描之扫描线11之电压准位稳定至禁能电压VOFF之禁能准位附近，可于扫描驱动电路21扫描下一扫描线11且进入电流驱动阶段CC，扫描驱动电路21提供禁能电压VOFF至未扫描之扫描线11。如此一来，于扫描驱动电路21扫描下一扫描线11且数据驱动电路22提供数据讯号至对应之数据线12期间，扫描驱动电路21可控制未扫描之扫描线11的电压准位为禁能准位。其中，禁能准位不同于未扫描之扫描线11处于第二阻抗状态的电压准位，更进一步来说，禁能准位不低于数据驱动电路22提供至像素13之电源的电压减去像素13导通的门坎电压。由上述可知，本实施例通过让未扫描之扫描线11处于第二阻抗状态而提升未扫描之扫描线11之电压准位，可确保未扫描之扫描线11之电压准位可维持禁能准位附近，进而让未扫描之扫描线11上的像素13能够关闭，使显示面板1的显示画面能够正常。另外，藉由让未扫描之扫描线11处于具高阻抗之第一阻抗状态，可锁住像素13储存于寄生电容的电荷，以同时达到省电的功效。
以上所述的实施例用于说明本申请的概念，本领域技术人员可据此进行修改及变更，并不局限于此。例如，参阅图4，图4为本申请的第二实施例之一驱动电路3之电路方块图。本申请的第二实施例与上述的第一实施例类似，因此相同组件以相同符号表示。在第二实施例中，控制电路24可不具有解析电路，因此，搭配参阅图5与图6，于放电阶段DC前，扫描驱动电路21可直接控制未扫描之扫描线11处于一高阻抗状态，如此不会使位于未扫描之扫描线11上的像素13之寄生电容的电荷被释放。再者，扫描驱动电路21可于放电阶段DC、或者于扫描下一扫描线11之期间的预充电阶段PC或电流驱动阶段CC提供禁能电压VOFF至未扫描之扫描线11，使未扫描之扫描线11之电压准位为禁能准位。
在第二实施例中，控制电路24也可具有解析电路(未绘示)，因此，控制电路24可依据第一驱动数量(被扫描)与第二驱动数量(下一扫描)之差异决定扫描驱动电路21控制未扫描之扫描线11之电压准位为禁能准位的一起始时间，其中，起始时间可位于放电阶段DC或者位于扫描下一扫描线11之期间的预充电阶段PC，以进行微调，也可以于扫描下一扫描线11之期间的电流驱动阶段CC。需注意的是，当第一驱动数量大于第二驱动数量，且差异愈大时，扫描驱动电路21控制未扫描之扫描线11之电压准位为禁能准位的起始时间愈早，亦即愈早开始提升未扫描之扫描线11之电压准位，可进而优化显示质量。此外，于此实施例中，未扫描之扫描线11处于高阻抗状态之阻抗HIZ为可调整，其可依据第一驱动数量与第二驱动数量间之差异而决定，例如采用图3所示之可变电阻213调整高阻抗状态之阻抗HIZ。另外，上述之第一实施例与第二实施例并非仅能运用在第一驱动数量大于第二驱动数量之情形，也可运用在第一驱动数量小于第二驱动数量之情形，也可达到省电下还能维持显示质量。
参阅图7，图7是本申请的第三实施例之一驱动电路4的电路方块示意图。本申请的第三实施例与上述的第一实施例类似，因此相同组件以相同符号表示。在第三实施例中，控制电路24另具有一解析电路243。控制电路24的解析电路243可依据显示数据得知数据驱动电路22对应每一扫描线11驱动(点亮)像素13的一驱动数量，而决定扫描驱动电路21扫描复数扫描线11的扫描顺序。详细来说，解析电路243可依据一显示数据判断每一扫描线11的驱动数量，并且依据复数驱动数量之间的较小差异决定扫描顺序，于本申请之一实施例中，依据最小差异决定扫描顺序为较佳方式，如此可使显示画面更不容易产生异常，也可达到更加的省电效果。
具体而言，如图8所示，假设扫描线11(COM)共有16行COM0～COM15，且每行扫描线11上的像素13共有128个，则扫描顺序可由数量值较小之驱动数量(SEG)对应之扫描线11优先扫描，亦即由驱动数量较小之扫描线11往驱动数量较大之扫描线11进行扫描；反之，如图9所示，扫描顺序亦可由数量值较大之驱动数量对应之扫描线11优先扫描，亦即由驱动数量较大之扫描线11往驱动数量较小之扫描线11进行扫描。又，如图10所示，扫描顺序亦可由驱动数量较小之扫描线11往驱动数量较大之扫描线11扫描，而再由驱动数量较大之扫描线11往驱动数量较小之扫描线11进行扫描；或者，如图11所示，扫描顺序亦可由驱动数量较大之扫描线11往驱动数量较小之扫描线11扫描，而再由驱动数量较小之扫描线11往驱动数量较大之扫描线11进行扫描，如此可使前后之驱动数量差异更小，确保显示画面更不容易产生异常。
更进一步来说，如图12所示，控制电路24可依据复数驱动数量对复数扫描线11分组，在本实施例中，是以4条扫描线11为一组，且各组扫描线11的扫描顺序是由数量值较小之驱动数量对应之扫描线11优先扫描。又或者，各组扫描线11的扫描顺序是由数量值较大之驱动数量对应之扫描线11优先扫描。当然也可如图13所示，扫描顺序相邻的各组之间，也可由多到少，再由少到多的驱动数量来进行扫描，不以此为限。
综上所述，本申请通过提升未扫描之扫描线之电压准位的方式，可确保未扫描之扫描线的电压准位可稳定至禁能准位，在达到省电下还让显示面板的显示画面能够正常。此外，复数扫描线之扫描顺序系依据驱动数量之间的差异来决定，如此可使显示画面更不容易产生异常。
以上所述仅为本发明的优选实施例而已，并不用于限制本发明，对于本领域的技术人员来说，本发明可以有各种更改和变化。凡在本发明的精神和原则之内，所作的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。

Claims (19)

1.一种显示面板之驱动电路，其特征在于，包含：
一扫描驱动电路，耦接于该显示面板之复数扫描线，并提供一扫描讯号至该复数扫描线之一扫描线，而扫描该扫描线；
一数据驱动电路，耦接于该显示面板之复数数据线，并提供至少一数据讯号与一放电准位至该复数数据线之至少一数据线；以及
一控制电路，耦接于该扫描驱动电路及该数据驱动电路，并控制该扫描驱动电路与该数据驱动电路；
其中，该扫描驱动电路扫描该扫描线，且该数据驱动电路提供该至少一数据讯号至该至少一数据线后而提供该放电准位至该至少一数据线让该至少一数据线之准位为该放电准位前，该扫描驱动电路控制未扫描之至少一扫描线处于一第一阻抗状态，并于该至少一数据线之准位为该放电准位期间，该扫描驱动电路控制未扫描之该至少一扫描线处于一第二阻抗状态，该第二阻抗状态之阻抗等于或小于该第一阻抗状态之阻抗，该第一阻抗状态之阻抗为高阻抗。
2.如权利要求1所述之驱动电路，其特征在于，该显示面板具有复数像素，该控制电路依据一显示数据判断该数据驱动电路对应被扫描之该扫描线而驱动至少一像素的一第一驱动数量与该数据驱动电路对应被扫描之下一扫描线而驱动该至少一像素的一第二驱动数量，且依据该第一驱动数量与该第二驱动数量之差异决定该第二阻抗状态之阻抗。
3.如权利要求2所述之驱动电路，其特征在于，该第一驱动数量大于该第二驱动数量时，该第二阻抗状态之阻抗小于该第一阻抗状态之阻抗。
4.如权利要求3所述之驱动电路，其特征在于，该第一驱动数量大于该第二驱动数量，且差异越大时，该第二阻抗状态之阻抗越小于该第一阻抗状态之阻抗。
5.如权利要求1所述之驱动电路，其特征在于，该扫描驱动电路控制未扫描之该至少一扫描线处于该第二阻抗状态至少到该扫描驱动电路扫描下一扫描线且该数据驱动电路提供一预充电电压至该复数数据线之至少一数据线的期间。
6.如权利要求1所述之驱动电路，其特征在于，于该扫描驱动电路扫描下一扫描线且该数据驱动电路提供该至少一数据讯号至该复数数据线之至少一数据线期间，该扫描驱动电路控制未扫描之该至少一扫描线之电压准位为一禁能准位，该禁能准位不同于未扫描之该至少一扫描线处于该第二阻抗状态的准位。
7.一种显示面板之驱动电路，其特征在于，包含：
一扫描驱动电路，耦接于该显示面板之复数扫描线，并提供一扫描讯号至该复数扫描线之一扫描线，而扫描该扫描线；
一数据驱动电路，耦接于该显示面板之复数数据线，并提供至少一数据讯号与一放电准位至该复数数据线之至少一数据线；以及
一控制电路，耦接于该扫描驱动电路及该数据驱动电路，并控制该扫描驱动电路与该数据驱动电路；
其中，该扫描驱动电路扫描该扫描线，且该数据驱动电路提供该至少一数据讯号至该至少一数据线后而提供该放电准位至该至少一数据线让该至少一数据线之准位为该放电准位前，该扫描驱动电路控制未扫描之至少一扫描线处于一高阻抗状态，并于该扫描驱动电路扫描下一扫描线且该数据驱动电路提供该至少一数据讯号至该复数数据线之至少一数据线期间，该扫描驱动电路控制未扫描之该至少一扫描线之电压准位为一禁能准位。
8.如权利要求7所述之驱动电路，其特征在于，于该至少一数据线之准位为该放电准位期间，该扫描驱动电路控制未扫描之该至少一扫描线之电压准位为该禁能准位。
9.如权利要求7所述之驱动电路，其特征在于，该扫描驱动电路扫描该下一扫描线且该数据驱动电路提供一预充电电压至该至少一数据线期间，该扫描驱动电路控制未扫描之该至少一扫描线之电压准位为该禁能准位。
10.如权利要求7所述之驱动电路，其特征在于，该显示面板具有复数像素，该控制电路依据一显示数据判断该数据驱动电路对应被扫描之该扫描线而驱动至少一像素的一第一驱动数量与该数据驱动电路对应被扫描之该下一扫描线而驱动该至少一像素的一第二驱动数量，且依据该第一驱动数量与该第二驱动数量之差异决定该扫描驱动电路控制未扫描之该至少一扫描线之电压准位为该禁能准位的一起始时间。
11.如权利要求10所述之驱动电路，该起始时间位于该至少一数据线之准位为该放电准位的期间或者位于该扫描驱动电路扫描该下一扫描线且该数据驱动电路提供一预充电电压至该至少一数据线期间。
12.如权利要求10所述之驱动电路，其特征在于，该第一驱动数量大于该第二驱动数量，且差异越大时，该扫描驱动电路控制未扫描之该至少一扫描线之电压准位为该禁能准位的该起始时间越早。
13.一种显示面板之驱动电路，其特征在于，包含：
一扫描驱动电路，耦接于该显示面板之复数扫描线，并扫描该复数扫描线；一数据驱动电路，耦接于该显示面板之复数数据线，并对应每一扫描线提供至少一数据讯号至该复数数据线之至少一数据线，而驱动该显示面板之至少一像素；以及
一控制电路，耦接于该扫描驱动电路及该数据驱动电路，并控制该扫描驱动电路与该数据驱动电路，且依据该数据驱动电路对应每一扫描线驱动像素的一驱动数量决定该扫描驱动电路扫描该复数扫描线的扫描顺序。
14.如权利要求13所述之驱动电路，其特征在于，该控制电路依据一显示数据判断该数据驱动电路对应每一扫描线驱动像素的该驱动数量。
15.如权利要求13所述之驱动电路，其特征在于，该控制电路依据该数据驱动电路对应该复数扫描线的复数驱动数量之间的最小差异决定该扫描顺序。
16.如权利要求13所述之驱动电路，其特征在于，该扫描顺序是由数量值较小之该驱动数量对应之该扫描线优先扫描。
17.如权利要求13所述之驱动电路，其特征在于，该扫描顺序是由数量值较大之该驱动数量对应之该扫描线优先扫描。
18.如权利要求13所述之驱动电路，其特征在于，该控制电路依据该数据驱动电路对应该复数扫描线的复数驱动数量对该复数扫描线分组，且各组扫描线的扫描顺序是由数量值较小之该驱动数量对应之该扫描线优先扫描。
19.如权利要求13所述之驱动电路，其特征在于，该控制电路依据该数据驱动电路对应该复数扫描线的复数驱动数量对该复数扫描线分组，且各组扫描线的扫描顺序是由数量值较大之该驱动数量对应之该扫描线优先扫描。
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