CN109584784A - 一种显示面板的驱动电路、驱动方法及显示装置 - Google Patents
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Abstract
本申请属于显示技术领域,提供了一种显示面板的驱动电路、驱动方法及显示装置,第一扫描线提供的第一扫描信号对第一开关单元进行控制,第二扫描线提供的第二扫描信号对第二开关单元和第四开关单元进行控制,第三扫描线提供的第三扫描信号对第三开关单元进行控制,从而控制电源线提供的电源信号和数据线提供的数据电压信号的导通或关断,以对第一电容单元和第二电容单元进行充电,从而使得流过发光单元的电流不受驱动单元的阈值电压的影响,避免了发光单元出现显示不均的问题。
Description
技术领域
本申请属于显示技术领域,尤其涉及一种显示面板的驱动电路、驱动方法及显示装置。
背景技术
随着显示技术的不断发展,液晶面板、显示器等显示设备不断向着高分辨率、大屏化、低功耗、低成本的方向发展。液晶面板包括成行和成列的像素单元,在液晶面板工作时,栅极驱动信号控制像素单元中的薄膜晶体管(Thin Film Transistor,TFT)的开启和关闭,从而完成液晶面板的行扫描,实现液晶面板显示图像的功能,为了提升显示效果,通常对显示面板采用主动阵列LED驱动电路进行驱动。
然而,由于薄膜晶体管在长时间的栅极应力(gate stress)下会因为阈值电压的漂移而使得薄膜晶体管的电流发生漂移,从而导致微发光二极管出现显示不均的问题。
申请内容
本申请实施例提供一种显示面板的驱动电路、驱动方法及显示装置,旨在解决由于薄膜晶体管在长时间的栅极应力下会因为阈值电压的漂移而使得薄膜晶体管的电流发生漂移,从而导致微发光二极管出现显示不均的问题。
本申请实施例提供了一种显示面板的驱动电路,包括:
第一开关单元,所述第一开关单元的输入端与数据线连接,所述第一开关单元的控制端与第一扫描线连接,设置为根据所述第一扫描线输入的第一扫描信号控制所述数据线提供的数据电压信号的导通和关断;
第一电容单元,所述第一电容单元的第一端与电源线连接,设置为接收所述电源线提供的电源信号;
第二电容单元,所述第二电容单元的第一端、所述第一开关单元的输出端以及所述第一电容单元的第二端共接;
第二开关单元,所述第二开关单元的输入端与所述第一开关单元的输出端连接,所述第二开关单元的控制端与第二扫描线连接,所述第二扫描线设置为提供第二扫描信号;
第三开关单元,所述第三开关单元的控制端与第三扫描线连接,所述第三扫描线设置为提供第三扫描信号;
第四开关单元,所述第四开关单元的输入端与所述第二电容单元的第二端连接,所述第四开关单元的控制端与所述第二扫描线连接,所述第四开关单元的输出端与所述第三开关单元的输入端连接;
第五开关单元,所述第五开关单元的输入端与所述电源线连接,所述第五开关单元的控制端与所述第二电容单元的第二端连接,所述第五开关单元的输出端与所述第三开关单元的输入端连接;
发光单元,所述发光单元的第一端、所述第二开关单元的输出端以及所述第三开关单元的输出端共接,所述发光单元的第二端与公共电极连接。
可选的,所述第一开关单元、所述第二开关单元、所述第三开关单元、所述第四开关单元以及所述第五开关单元为电子开关管。
可选的,所述电子开关管为N型薄膜晶体场效应管;
所述N型薄膜晶体场效应管的漏极为所述电子开关管的输入端,所述N型薄膜晶体场效应管的源极为所述电子开关管的输出端,所述N型薄膜晶体场效应管的栅极为所述电子开关管的控制端。
可选的,所述第一电容单元包括第一电容,所述第一电容的第一端作为所述第一电容单元的第一端,所述第一电容的第二端作为所述第一电容单元的第二端。
可选的,所述第二电容单元包括第二电容,所述第二电容的第一端作为所述第二电容单元的第一端,所述第二电容的第二端作为所述第二电容单元的第二端。
可选的,所述发光单元包括微发光二极管,所述微发光二极管的阳极为所述发光单元的第一端,所述微发光二极管的阴极为所述发光单元的第二端。
可选的,所述电子开关管为多晶硅薄膜晶体管、非晶硅薄膜晶体管、氧化锌基薄膜晶体管或有机薄膜晶体管中的任意一项。
本申请实施例还提供了一种上述任一项驱动电路的驱动方法,所述驱动方法包括:
在初始化阶段,将所述第一扫描信号、所述第二扫描信号以及所述第三扫描信号设置为高电平,将所述数据电压信号设置为第一数据电压;
在阈值电压补偿阶段,将所述第一扫描信号和所述第二扫描信号设置为高电平,将所述第三扫描信号设置为低电平,将所述数据电压信号设置为第一数据电压;
在充电阶段,将所述第一扫描信号设置为高电平,将所述第二扫描信号和所述第三扫描信号设置为低电平,将所述数据电压信号设置为第二数据电压;
在发光阶段,将所述第一扫描信号和所述第二扫描信号设置为低电平,将所述第三扫描信号设置为高电平,将所述数据电压信号设置为第一数据电压。
可选的,在所述初始化阶段,所述第一数据电压大于所述电源信号的电压。
本申请的另一实施例还提供一种显示装置,包括:
显示面板;以及
控制单元,其中,所述控制单元包括如上述任一项实施例所述的驱动电路。
本申请实施例提供了一种显示面板的驱动电路、驱动方法及显示装置,第一扫描线提供的第一扫描信号对第一开关单元进行控制,第二扫描线提供的第二扫描信号对第二开关单元和第四开关单元进行控制,第三扫描线提供的第三扫描信号对第三开关单元进行控制,从而控制电源线提供的电源信号和数据线提供的数据电压信号的导通或关断,以对第一电容单元和第二电容单元进行充电,从而使得流过发光单元的电流不受驱动单元的阈值电压的影响,避免了发光单元出现显示不均的问题。
附图说明
为了更清楚地说明本申请实施例中的技术方案,下面将对实施例描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图是本申请的一些实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据这些附图获得其他的附图。
图1为本申请的一个实施例提供的显示面板的驱动电路的结构示意图;
图2为本申请的另一个实施例提供的显示面板的驱动电路的结构示意图;
图3为本申请的一个实施例提供的驱动方法的流程示意图;
图4为本申请一个实施例提供的驱动方法的驱动时序示意图;
图5为本申请的一个实施例提供的显示装置的结构示意图。
具体实施方式
为了使本技术领域的人员更好地理解本申请方案,下面将结合本申请实施例中的附图,对本申请实施例中的技术方案进行清楚地描述,显然,所描述的实施例是本申请一部分的实施例,而不是全部的实施例。基于本申请中的实施例,本领域普通技术人员在没有做出创造性劳动前提下所获得的所有其他实施例,都应当属于本申请保护的范围。
本申请的说明书和权利要求书及上述附图中的术语“包括”以及它们任何变形,意图在于覆盖不排他的包含。例如包含一系列步骤或单元的过程、方法或系统、产品或设备没有限定于已列出的步骤或单元,而是可选地还包括没有列出的步骤或单元,或可选地还包括对于这些过程、方法、产品或设备固有的其它步骤或单元。此外,术语“第一”、“第二”和“第三”等是设置为区别不同对象,而非设置为描述特定顺序。
图1为本申请的一个实施例提供的显示面板的驱动电路的结构示意图。如图1所示,本实施例中的显示面板的驱动电路包括:
第一开关单元10,所述第一开关单元10的输入端与数据线连接,所述第一开关单元10的控制端与第一扫描线连接,设置为根据所述第一扫描线输入的第一扫描信号控制所述数据线提供的数据电压信号的导通和关断;
第一电容单元101,所述第一电容单元101的第一端与电源线连接,设置为接收所述电源线提供的电源信号;
第二电容单元102,所述第二电容单元102的第一端、所述第一开关单元10的输出端以及所述第一电容单元102的第二端共接;
第二开关单元20,所述第二开关单元20的输入端与所述第一开关单元10的输出端连接,所述第二开关单元10的控制端与第二扫描线连接,所述第二扫描线设置为提供第二扫描信号;
第三开关单元30,所述第三开关单元30的控制端与第三扫描线连接,所述第三扫描线设置为提供第三扫描信号;
第四开关单元40,所述第四开关单元40的输入端与所述第二电容单元102的第二端连接,所述第四开关单元40的控制端与所述第二扫描线连接,所述第四开关单元40的输出端与所述第三开关单元30的输入端连接;
第五开关单元50,所述第五开关单元50的输入端与所述电源线连接,所述第五开关单元50的控制端与所述第二电容单元102的第二端连接,所述第五开关单元50的输出端与所述第三开关单元30的输入端连接;
发光单元103,所述发光单元103的第一端、所述第二开关单元20的输出端以及所述第三开关单元30的输出端共接,所述发光单元103的第二端与公共电极连接。
在一个实施例中,所述第一开关单元10、所述第二开关单元20、所述第三开关单元30、所述第四开关单元40以及所述第五开关单元50为电子开关管。
在一个实施例中,所述电子开关管为N型薄膜晶体场效应管;
所述N型薄膜晶体场效应管的漏极为所述电子开关管的输入端,所述N型薄膜晶体场效应管的源极为所述电子开关管的输出端,所述N型薄膜晶体场效应管的栅极为所述电子开关管的控制端。
图2为本申请的另一个实施例提供的显示面板的驱动电路的结构示意图。参见图2,在一个实施例中,所述第一电容单元101包括第一电容C1,所述第一电容C1的第一端作为所述第一电容单元101的第一端,所述第一电容C1的第二端作为所述第一电容单元101的第二端。
在一个实施例中,第一电容单元101还可以为多个电容的串联或者并联,例如,多个串联的电容的第一端作为第一电容单元101的第一端,多个串联的电容的第二端作为第一电容单元101的第二端。
参见图2,在一个实施例中,所述第二电容单元102包括第二电容,所述第二电容C2的第一端作为所述第二电容单元102的第一端,所述第二电容C2的第二端作为所述第二电容单元102的第二端。
在一个实施例中,第二电容单元102还可以为多个电容的串联或者并联,例如,多个串联的电容的第一端作为第二电容单元102的第一端,多个串联的电容的第二端作为第二电容单元102的第二端。
参见图2,在一个实施例中,所述发光单元103包括微发光二极管uLED,所述微发光二极管uLED的阳极为所述发光单元103的第一端,所述微发光二极管uLED的阴极为所述发光单元103的第二端。
参见图2,在一个实施例中,第一开关单元10包括第一薄膜晶体管M1,第一薄膜晶体管M1的漏极为第一开关单元10的输入端,第一薄膜晶体管M1的源极为第一开关单元10的输出端,第一薄膜晶体管M1的栅极为第一开关单元10的控制端。
参见图2,在一个实施例中,第二开关单元20包括第二薄膜晶体管M2,第二薄膜晶体管M2的漏极为第二开关单元20的输入端,第二薄膜晶体管M2的源极为第二开关单元20的输出端,第二薄膜晶体管M2的栅极为第二开关单元20的控制端。
参见图2,在一个实施例中,第三开关单元30包括第三薄膜晶体管M3,第三薄膜晶体管M3的漏极为第三开关单元30的输入端,第三薄膜晶体管M3的源极为第三开关单元30的输出端,第三薄膜晶体管M3的栅极为第三开关单元30的控制端。
参见图2,在一个实施例中,第四开关单元40包括第四薄膜晶体管M4,第四薄膜晶体管M4的漏极为第四开关单元40的输入端,第四薄膜晶体管M4的源极为第四开关单元40的输出端,第四薄膜晶体管M4的栅极为第四开关单元40的控制端。
参见图2,在一个实施例中,第五开关单元50包括第五薄膜晶体管M5,第五薄膜晶体管M5的漏极为第五开关单元50的输入端,第五薄膜晶体管M5的源极为第五开关单元50的输出端,第五薄膜晶体管M5的栅极为第四开关单元40的控制端。
在一个实施例中,将第一开关单元10的输出端设为节点o,将第五开关单元的控制端设为节点m,将发光单元103的第一端设为节点n。
在一个实施例中,公共电极VSS设置一个预设的电压信号,该电压信号设置为提高驱动电路的稳定性。
在一个实施例中,公共电极VSS可以直接接地。
参见图2,本申请的另一实施例提供了一种显示面板的驱动电路,包括:
第一薄膜晶体管M1,所述第一薄膜晶体管M1的漏极与数据线连接,所述
第一薄膜晶体管M1的栅极与第一扫描线连接,设置为根据所述第一扫描线输入的第一扫描信号控制所述数据线提供的数据电压信号的导通和关断;
第一电容C1,所述第一电容C1的第一端与电源线连接,设置为接收所述电源线提供的电源信号;
第二电容C2,所述第二电容C2的第一端、所述第一薄膜晶体管M1的源极以及所述第一电容C1的第二端共接;
第二薄膜晶体管M2,所述第二薄膜晶体管M2的漏极与所述第一薄膜晶体管M1的源极连接,所述第二薄膜晶体管M2的栅极与第二扫描线连接,所述第二扫描线设置为提供第二扫描信号;
第三薄膜晶体管M3,所述第三薄膜晶体管M3的栅极与第三扫描线连接,所述第三扫描线设置为提供第三扫描信号;
第四薄膜晶体管M4,所述第四薄膜晶体管M4的漏极与所述第二电容C2的第二端连接,所述第四薄膜晶体管M4的栅极与所述第二扫描线连接,所述
第四薄膜晶体管M4的源极与所述第三薄膜晶体管M3的漏极连接;
第五薄膜晶体管M5,所述第五薄膜晶体管M5的漏极与所述电源线连接,所述第五薄膜晶体管M5的栅极与所述第二电容C2的第二端连接,所述第五薄膜晶体管M5的源极与所述第三薄膜晶体管M3的漏极连接;
微发光二极管uLED,所述微发光二极管uLED的正极、所述第二薄膜晶体管M2的源极以及所述第三薄膜晶体管M3的源极共接,所述微发光二极管uLED的阴极与公共电极VSS接地。
在一个实施例中,将第一薄膜晶体管的源极设为节点o,将第五薄膜晶体管的栅极设为节点m,将微发光二极管uLED的正极设为节点n。
在一个实施例中,公共电极VSS设置一个预设的电压信号,该电压信号设置为提高驱动电路的稳定性。
在一个实施例中,公共电极VSS可以直接接地。
图3为本申请的一个实施例提供的一种上述任一项实施例的驱动电路的驱动方法的流程示意图。如图3所示,本实施例中的驱动方法包括:
在初始化阶段,将所述第一扫描信号、所述第二扫描信号以及所述第三扫描信号设置为高电平,将所述数据电压信号设置为第一数据电压;
在阈值电压补偿阶段,将所述第一扫描信号和所述第二扫描信号设置为高电平,将所述第三扫描信号设置为低电平,将所述数据电压信号设置为第一数据电压;
在充电阶段,将所述第一扫描信号设置为高电平,将所述第二扫描信号和所述第三扫描信号设置为低电平,将所述数据电压信号设置为第二数据电压;
在发光阶段,将所述第一扫描信号和所述第二扫描信号设置为低电平,将所述第三扫描信号设置为高电平,将所述数据电压信号设置为第一数据电压。
在一个实施例中,在所述初始化阶段,所述第一数据电压大于所述电源信号的电压。
图4为本申请一个实施例提供的驱动方法的驱动时序示意图。如图4所示,在对驱动电路的驱动过程中,整个驱动过程分为四个阶段,包括初始化阶段T1、阈值电压补偿阶段T2、充电阶段T3以及发光阶段T4。
具体的,一帧时间T=(T1+T2+T3+T4)·t,t为扫描线的数目,也就是一帧画面扫描的次数,若扫描频率为60HZ,则一帧时间T=1/60=16.7ms,若扫描频率为120HZ,则一帧时间T=1/120=8.33ms,例如,对于高解析度(High Definition,HD)1366*768,有768条gate线,t=768,对应的T1+T2+T3+T4=21.7μs(60HZ情况,也可以为120HZ,120HZ对应扫描t=10.85μs),对于全高清(Full High Definition,FHD)解析度,t=1080,对应的T1+T2+T3+T4=15.4μs,对于4K解析度,即4096×2160的像素分辨率,t=2160,对应的T1+T2+T3+T4=7.7μs。
在初始化阶段T1,第一扫描信号Gate1、第二扫描信号Gate2以及第三扫描信号Gate3均为高电平VGH,第一薄膜晶体管M1、第二薄膜晶体管M2、第三薄膜晶体管M3以及第四薄膜晶体管M4同时打开,此时,节点m、节点n以及节点o相当于短接在一起,由于第一薄膜晶体管M1处于导通状态,数据电压信号被设为第一数据电压Vref,因此,节点m、节点n以及节点o的电压Vm=Vn=Vo=Vref。
在一个实施例中,第一数据电压Vref小于电源信号的电压VDD。
在阈值电压补偿阶段T2,第一扫描信号Gate1和第二扫描信号Gate2为高电平VGH,第三扫描信号Gate3为低电平VGL,此时,第三薄膜晶体管M3关断,由于第二扫描信号Gate2为高电平VGH,第四薄膜晶体管m4导通,因此,第五薄膜晶体管M5的栅极和漏极被短接在一起,此时,第五薄膜晶体管M5可以作为一个二极管,具有单向导流的作用,而节点m的电压Vm=VDD-Vth_5,其中,Vth_5为第五薄膜晶体管M5的阈值电压,由此,第五薄膜晶体管M5的阈值电压记录在第二电容C2的第二端,由于第一薄膜晶体管M1处于导通状态,所以第二电容C2得第一端得电压Vo=Vref。
在充电阶段T3,第二扫描信号Gate2从高电平VGH变为低电平VGL,此时,第二薄膜晶体管M2和第四薄膜晶体管M4同时关断,数据电压信号设为高电平Data High,此时,数据电压信号从第一数据电压Vref变为第二数据电压Vdata,在第二电容的耦合作用下,节点m处的电压为:
Vm=VDD-|Vth_5|-(Vref-Vdata);
其中,VDD为电源信号的电压,Vth_5为第五薄膜晶体管M5的阈值电压,Vref为第一数据电压,Vdata为第二数据电压。
在发光阶段T4,第二数据电压Vdata写入后,第一扫描信号Gate1变为低电平VGL,第二扫描信号Gate2维持低电平VGL不变,此时,第一薄膜晶体管M1、第二薄膜晶体管M2以及第四薄膜晶体管M4均处于关断状态,第三扫描信号Gate3为高电平VGH,此时第三薄膜晶体管M3作为驱动开关管,流过微发光二极管uLED的电流IuLED为:
其中,VData为第二数据电压,Vref为第一数据电压,k为半导体层迁移率相关的一个常数,k=u·Cox·W/L,u为半导体层的电子迁移率,Cox为薄膜晶体管器件的金属绝缘半导体(metal-insulator-semiconductor,MIS)结构的单位面积电容,W/L为TFT沟道的宽长比。
由以上公式可知,流过第三薄膜晶体管M3的电流是与第三薄膜晶体管M3的阈值电压Vth不相关的公式,此时,第三薄膜晶体管M3作为驱动开关管,因此,驱动开关管的阈值电压漂移对微发光二极管uLED的驱动电流IuLED无较大影响,从而可以得到高质量的显示图像。
图5为本申请的一个实施例提供的一种显示装置的结构示意图。如图5所示,本实施例中的显示装置60,包括:
显示面板60;以及
控制单元61,其中,控制单元61包括如上述任一项的驱动电路610。
在一个实施例中,显示装置60可以为设置有上述驱动电路610的任意类型的显示装置,例如液晶显示装置(Liquid Crystal Display,LCD)、有机电激光显示(OrganicElectroluminesence Display,OLED)显示装置、量子点发光二极管(Quantum Dot LightEmitting Diodes,QLED)显示装置或曲面显示装置等。
在一个实施例中,显示面板62包括由多行像素和多列像素组成的像素阵列。
在一个实施例中,控制单元61,可以通过通用集成电路,例如中央处理器(CentralProcessing Unit,CPU),或通过专用集成电路(Application Specific IntegratedCircuit,ASIC)来实现。
本申请实施例提供了一种显示面板的驱动电路、驱动方法及显示装置,第一扫描线提供的第一扫描信号对第一开关单元进行控制,第二扫描线提供的第二扫描信号对第二开关单元和第四开关单元进行控制,第三扫描线提供的第三扫描信号对第三开关单元进行控制,从而控制电源线提供的电源信号和数据线提供的数据电压信号的导通或关断,以对第一电容单元和第二电容单元进行充电,从而使得流过发光单元的电流不受驱动单元的阈值电压的影响,避免了发光单元出现显示不均的问题。
本领域普通技术人员可以理解实现上述实施例方法中的全部或部分流程,是可以通过计算机程序来指令相关的硬件来完成,所述的程序可存储于一计算机可读取存储介质中,该程序在执行时,可包括如上述各方法的实施例的流程。其中,所述的存储介质可为磁碟、光盘、只读存储记忆体(Read-Only Memory,ROM)或随机存储记忆体(Random AccessMemory,RAM)等。
以上所述仅为本申请的可选的实施例而已,并不用以限制本申请,凡在本申请的精神和原则之内所作的任何修改、等同替换和改进等,均应包含在本申请的保护范围之内。
Claims (10)
1.一种显示面板的驱动电路,其特征在于,包括:
第一开关单元,所述第一开关单元的输入端与数据线连接,所述第一开关单元的控制端与第一扫描线连接,设置为根据所述第一扫描线输入的第一扫描信号控制所述数据线提供的数据电压信号的导通和关断;
第一电容单元,所述第一电容单元的第一端与电源线连接,设置为接收所述电源线提供的电源信号;
第二电容单元,所述第二电容单元的第一端、所述第一开关单元的输出端以及所述第一电容单元的第二端共接;
第二开关单元,所述第二开关单元的输入端与所述第一开关单元的输出端连接,所述第二开关单元的控制端与第二扫描线连接,所述第二扫描线设置为提供第二扫描信号;
第三开关单元,所述第三开关单元的控制端与第三扫描线连接,所述第三扫描线设置为提供第三扫描信号;
第四开关单元,所述第四开关单元的输入端与所述第二电容单元的第二端连接,所述第四开关单元的控制端与所述第二扫描线连接,所述第四开关单元的输出端与所述第三开关单元的输入端连接;
第五开关单元,所述第五开关单元的输入端与所述电源线连接,所述第五开关单元的控制端与所述第二电容单元的第二端连接,所述第五开关单元的输出端与所述第三开关单元的输入端连接;
发光单元,所述发光单元的第一端、所述第二开关单元的输出端以及所述第三开关单元的输出端共接,所述发光单元的第二端与公共电极连接。
2.如权利要求1所述的显示面板的驱动电路,其特征在于,所述第一开关单元、所述第二开关单元、所述第三开关单元、所述第四开关单元以及所述第五开关单元为电子开关管。
3.如权利要求2所述的显示面板的驱动电路,其特征在于,所述电子开关管为N型薄膜晶体场效应管;
所述N型薄膜晶体场效应管的漏极为所述电子开关管的输入端,所述N型薄膜晶体场效应管的源极为所述电子开关管的输出端,所述N型薄膜晶体场效应管的栅极为所述电子开关管的控制端。
4.如权利要求1所述的显示面板的驱动电路,其特征在于,所述第一电容单元包括第一电容,所述第一电容的第一端作为所述第一电容单元的第一端,所述第一电容的第二端作为所述第一电容单元的第二端。
5.如权利要求1所述的显示面板的驱动电路,其特征在于,所述第二电容单元包括第二电容,所述第二电容的第一端作为所述第二电容单元的第一端,所述第二电容的第二端作为所述第二电容单元的第二端。
6.如权利要求1所述的显示面板的驱动电路,其特征在于,所述发光单元包括微发光二极管,所述微发光二极管的阳极为所述发光单元的第一端,所述微发光二极管的阴极为所述发光单元的第二端。
7.如权利要求2所述的显示面板的驱动电路,其特征在于,所述电子开关管为多晶硅薄膜晶体管、非晶硅薄膜晶体管、氧化锌基薄膜晶体管或有机薄膜晶体管中的任意一项。
8.一种如权利要求1-7中任一项所述的驱动电路的驱动方法,其特征在于,所述方法包括:
在初始化阶段,将所述第一扫描信号、所述第二扫描信号以及所述第三扫描信号设置为高电平,将所述数据电压信号设置为第一数据电压;
在阈值电压补偿阶段,将所述第一扫描信号和所述第二扫描信号设置为高电平,将所述第三扫描信号设置为低电平,将所述数据电压信号设置为第一数据电压;
在充电阶段,将所述第一扫描信号设置为高电平,将所述第二扫描信号和所述第三扫描信号设置为低电平,将所述数据电压信号设置为第二数据电压;
在发光阶段,将所述第一扫描信号和所述第二扫描信号设置为低电平,将所述第三扫描信号设置为高电平,将所述数据电压信号设置为第一数据电压。
9.如权利要求8所述的驱动方法,其特征在于,在所述初始化阶段,所述第一数据电压大于所述电源信号的电压。
10.一种显示装置,其特征在于,包括:
显示面板;以及
控制单元,其中,所述控制单元包括如权利要求1~7任一项所述的驱动电路。
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