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CN108519791A - 高速任意波形产生电路 - Google Patents

高速任意波形产生电路 Download PDF

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CN108519791A
CN108519791A CN201810367185.8A CN201810367185A CN108519791A CN 108519791 A CN108519791 A CN 108519791A CN 201810367185 A CN201810367185 A CN 201810367185A CN 108519791 A CN108519791 A CN 108519791A
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CN
China
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wave
module
standard wave
amplitude
monocycle
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Application number
CN201810367185.8A
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English (en)
Inventor
周毅刚
王江涛
鲍柳勇
陈必新
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Harbin Institute of Technology Shenzhen
Original Assignee
Harbin Institute of Technology Shenzhen
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Publication date
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    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/02Digital function generators
    • G06F1/022Waveform generators, i.e. devices for generating periodical functions of time, e.g. direct digital synthesizers

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  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)

Abstract

高速任意波形产生电路,涉及电子及测量领域。解决了现有技术中信号源发生器生成的激励源无法满足频率较高、波形复杂的问题。本发明中FPGA,用于接收上位机发送的单周期标准波的波形数据,并根据单周期标准波的波形数据,获得该标准波中所有点的数据信息,所有点的数据信息包括每个点所对应的幅值信息和每个点所对应的位置信息;时钟模块,根据接收的FPGA发出的控制信号,生成延时信号;数模转换模块,用于根据接收单周期标准波中每个点所对应的幅值信息、位置信息以及接收的延时信号,对单周期标准波进行延时和叠加,形成多周期标准波;输出缓冲及滤波模块,用于对接收的多周期标准波进行缓冲及滤波后,输出合成波。主要生成任意波。

Description

高速任意波形产生电路
技术领域
本发明涉及电子及测量领域。
背景技术
信号源是能按照用户需求产生各种规则的或非规则的信号,同时能对信号的幅度、相位、频率等指标进行调节的设备,是电子及测量领域中常用的设备,常用来模拟各种信号,或用于恢复现场采集的信号。信号源有各种术语和名称,在各类信号源产品中,更多的是采用函数和波形发生器这一名称。
信号发生器通常能产生低频到几GHz的高保真的正弦信号,并且能提供衰减、调制和扫频等各种功能,但产生其他复杂信号比较困难;而函数发生器则是一个较低频率范围的仪器,虽然能够提供正弦、方波、脉冲、三角波和锯齿波等复杂波形,但不能产生较高频率的波形信号。随着电子设备变得越来越复杂,需要频率更高波、形更复杂的信号来做激励源,信号发生器和函数发生器不能满足实际需要,因此,亟需提供一种能够得到任意波形的信号发生器,该种发生器可获得更为复杂、频率更高的波形。
发明内容
本发明是为了解决现有技术中信号源发生器生成的激励源无法满足频率较高、波形复杂的问题,本发明提供了一种高速任意波形产生电路。
高速任意波形产生电路,包括FPGA、时钟模块、数模转换模块和输出缓冲及滤波模块;
FPGA,用于接收上位机发送的单周期标准波的波形数据,并根据单周期标准波的波形数据,获得该标准波中所有点的数据信息,所有点的数据信息包括每个点所对应的幅值信息和每个点所对应的位置信息;
时钟模块,根据接收的FPGA发出的控制信号,生成延时信号;
数模转换模块,用于根据接收单周期标准波中每个点所对应的幅值信息、位置信息以及接收的延时信号,对单周期标准波进行延时和叠加,形成多周期标准波;
输出缓冲及滤波模块,用于对接收的多周期标准波进行缓冲及滤波后,输出合成波。
优选的是,所述的FPGA包括系统控制模块和波形读取模块;
系统控制模块,用于接收上位机发送的单周期标准波的波形数据,并将接收的单周期标准波的波形数据发送至波形读取模块;
波形读取模块,用于读取系统控制模块输出的单周期标准波的波形数据中每个点所对应的幅值信息和位置信息,并将每个点所对应的幅值信息和位置信息发送至数模转换模块;
所述波形读取模块、数模转换模块和输出缓冲及滤波模块构成了一个合成波的合成通路。
优选的是,所述FPGA还包括一个幅度控制模块;
幅度控制模块,用于根据系统控制模块发出的幅值控制信号,实现对数模转换模块输出的多周期标准波的幅值进行调节。
优选的是,所述的高速任意波形产生电路,还包括另一个合成通路和另一个幅度控制模块;
另一个幅度控制模块,用于根据系统控制模块发出的幅值控制信号对另一个合成通路中的数模转换模块输出的多周期标准波的幅值进行调节;
另一个合成通路中的数模转换模块,用于接收时钟模块输出的时钟信号。
本发明带来的有益效果是,本发明采用直接数字波形合成实现任意波形的合成,将需要输出的任意波形的一个周期内的波形数据存储在上位机,上位机通过USB接口将该波形数据传输到FPGA,FPGA对所有的波形数据进行读取,将数据转换成对应波形,这样通过对波形的逐点采样恢复原始信号。本发明所述高速任意波形产生电路可以产生频率较高的多种信号,如:正弦波、方波、脉冲等常规波形以及手绘任意波形,且正弦波的最高频率达到了400MHz。
本发明所述的高速任意波形产生电路输出波形的频率,可通过控制FPGA的接收数据的频率实现,且高速任意波形产生电路波形输出频率的调节范围宽,且正弦波的最高频率达到了400MHz。
本发明所述的高速任意波形产生电路可根据接收的相应的单周期标准波的波形数据,输出相应的合成波波形,满足了对任意复杂的波形的生成。
本发明所述高速任意波形产生电路主要技术指标:
采样率:1Gsps(单路);
垂直分辨率:14bit;
波形种类:正弦波、方波等常规波形,脉冲波形及手绘任意波形;
输出频率:正弦波最高频率400MHz。
附图说明
图1为本发明所述高速任意波形产生电路的原理示意图。
具体实施方式
具体实施方式一:参见图1说明本实施方式,本实施方式所述高速任意波形产生电路,包括FPGA1、时钟模块4、数模转换模块2和输出缓冲及滤波模块3;
FPGA1,用于接收上位机发送的单周期标准波的波形数据,并根据单周期标准波的波形数据,获得该标准波中所有点的数据信息,所有点的数据信息包括每个点所对应的幅值信息和每个点所对应的位置信息;
时钟模块4,根据接收的FPGA1发出的控制信号,生成延时信号;
数模转换模块2,用于根据接收单周期标准波中每个点所对应的幅值信息、位置信息以及接收的延时信号,对单周期标准波进行延时和叠加,形成多周期标准波;
输出缓冲及滤波模块3,用于对接收的多周期标准波进行缓冲及滤波后,输出合成波。
本实施方式,本发明采用直接数字波形合成实现任意波形的合成,将需要输出的任意波形的一个周期内的波形数据存储在上位机,上位机通过USB接口将该波形数据传输到FPGA,FPGA对所有的波形数据进行读取,将数据转换成对应波形,这样通过对波形的逐点采样恢复原始信号。
本发明所述的高速任意波形产生电路输出波形的频率,可通过控制FPGA的接收数据的频率实现,且高速任意波形产生电路波形输出频率的调节范围宽,且正弦波的最高频率达到了400MHz。
本发明所述的高速任意波形产生电路可根据接收的相应的单周期标准波的波形数据,输出相应的合成波波形。
具体实施方式二:参见图1说明本实施方式,本实施方式与具体实施方式一所述的高速任意波形产生电路的区别在于,所述的FPGA1包括系统控制模块1-1和波形读取模块1-2;
系统控制模块1-1,用于接收上位机发送的单周期标准波的波形数据,并将接收的单周期标准波的波形数据发送至波形读取模块1-2;
波形读取模块1-2,用于读取系统控制模块1-1输出的单周期标准波的波形数据中每个点所对应的幅值信息和位置信息,并将每个点所对应的幅值信息和位置信息发送至数模转换模块2;
所述波形读取模块1-2、数模转换模块2和输出缓冲及滤波模块3构成了一个合成波的合成通路5。
本实施方式,合成通路5根据接收的单周期标准波的波形数据实现了任意波的合成。
具体实施方式三:参见图1说明本实施方式,本实施方式与具体实施方式二所述的高速任意波形产生电路的区别在于,所述FPGA1还包括一个幅度控制模块1-3;
幅度控制模块1-3,用于根据系统控制模块1-1发出的幅值控制信号,实现对数模转换模块2输出的多周期标准波的幅值进行调节。
本实施方式,幅度控制模块1-3的设置方式,可调节多周期标准波的幅值,避免在由数据转化为波形的过程中,合成的波形失真。
具体实施方式四:参见图1说明本实施方式,本实施方式与具体实施方式二所述的高速任意波形产生电路的区别在于,还包括另一个合成通路5和另一个幅度控制模块1-3;
另一个幅度控制模块1-3,用于根据系统控制模块1-1发出的幅值控制信号对另一个合成通路5中的数模转换模块2输出的多周期标准波的幅值进行调节;
另一个合成通路5中的数模转换模块2,用于接收时钟模块4输出的时钟信号。
本实施方式,本发明包括两路合成通路5,其中,两路合成通路5可处理相同或不同的波形数据。
本发明可实现两路1Gsps任意波形发生器,采用FPGA芯片实现对两路合成的控制,同时通过USB接口与上位机通信,利用计算机良好的用户界面实现更灵活的控制。

Claims (4)

1.高速任意波形产生电路,其特征在于,包括FPGA(1)、时钟模块(4)、数模转换模块(2)和输出缓冲及滤波模块(3);
FPGA(1),用于接收上位机发送的单周期标准波的波形数据,并根据单周期标准波的波形数据,获得该标准波中所有点的数据信息,所有点的数据信息包括每个点所对应的幅值信息和每个点所对应的位置信息;
时钟模块(4),根据接收的FPGA(1)发出的控制信号,生成延时信号;
数模转换模块(2),用于根据接收单周期标准波中每个点所对应的幅值信息、位置信息以及接收的延时信号,对单周期标准波进行延时和叠加,形成多周期标准波;
输出缓冲及滤波模块(3),用于对接收的多周期标准波进行缓冲及滤波后,输出合成波。
2.根据权利要求1所述的高速任意波形产生电路,其特征在于,所述的FPGA(1)包括系统控制模块(1-1)和波形读取模块(1-2);
系统控制模块(1-1),用于接收上位机发送的单周期标准波的波形数据,并将接收的单周期标准波的波形数据发送至波形读取模块(1-2);
波形读取模块(1-2),用于读取系统控制模块(1-1)输出的单周期标准波的波形数据中每个点所对应的幅值信息和位置信息,并将每个点所对应的幅值信息和位置信息发送至数模转换模块(2);
所述波形读取模块(1-2)、数模转换模块(2)和输出缓冲及滤波模块(3)构成了一个合成波的合成通路(5)。
3.根据权利要求2所述的高速任意波形产生电路,其特征在于,所述FPGA(1)还包括一个幅度控制模块(1-3);
幅度控制模块(1-3),用于根据系统控制模块(1-1)发出的幅值控制信号,实现对数模转换模块(2)输出的多周期标准波的幅值进行调节。
4.根据权利要求2所述的高速任意波形产生电路,其特征在于,还包括另一个合成通路(5)和另一个幅度控制模块(1-3);
另一个幅度控制模块(1-3),用于根据系统控制模块(1-1)发出的幅值控制信号对另一个合成通路(5)中的数模转换模块(2)输出的多周期标准波的幅值进行调节;
另一个合成通路(5)中的数模转换模块(2),用于接收时钟模块(4)输出的时钟信号。
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