TWM560998U - 應用於高頻訊號傳輸的銅箔以及線路板組件 - Google Patents
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Abstract
本創作公開一種應用於高頻訊號傳輸的銅箔以及線路板組件。銅箔包括一生箔層、一位於所述生箔層上的粗化處理層以及一位於所述粗化處理層上的表面處理層,其中,所述表面處理層的厚度與所述生箔層的厚度比值是介於1.0×10-5至3.0×10-4之間。藉此,由於銅箔內的非銅的金屬元素的含量降低,所以本創作可以在不繼續降低表面粗糙度的情況下,進一步降低利用銅箔所製成之線路板組件在高頻訊號下的訊號損失(Insertion Loss)。
Description
本創作涉及一種銅箔以及線路板組件,特別是涉及一種應用於高頻訊號傳輸的銅箔以及線路板組件。
現有應用於印刷電路基板的銅箔,會通過電鍍在陰極輪上形成原箔,再經過後段處理製成而形成最終的產品。後段處理包括對原箔的粗糙面執行粗化處理,以在原箔的粗糙面形成多個銅瘤,從而增加銅箔與電路基板之間的接著強度,也就是增加銅箔的剝離強度。
近年來,電子產品的數據處理速度以及通訊速度趨向高頻高速化。目前大部分的研究都指向在傳遞高頻訊號時,銅箔表面的形狀對傳輸損耗有很大的影響。也就是說,表面粗糙度大的銅箔,訊號的傳播距離較長,會導致訊號衰減或延遲。另一方面,隨著傳輸的頻率越高,傳送訊號流於電路表面的集膚效應更顯著(skin effect),也就是導體內的電流會集中在導體的表面。因此,粗度越大則訊號損失越高。
因此,目前業界都致力於降低銅箔的表面粗糙度,以降低傳輸損耗,而符合高頻訊號傳輸的需求。然而,由於目前製程上的限制,已難以再進一步降低銅箔的表面粗糙度。除此之外,銅箔的表面粗糙度過低雖然可減少高頻訊號傳輸損耗,但又會使銅箔和電路基板之間的接合強度降低,從而導致銅箔容易從電路基板剝離並降低印刷電路板的信賴度。
本創作所要解決的技術問題在於,針對現有技術的不足提供一種應用於高頻訊號傳輸且低電阻的銅箔以及線路板組件。
本創作所採用的其中一技術方案是,提供一種應用於高頻訊號傳輸的銅箔,其包括一生箔層、一位於所述生箔層上的粗化處理層以及一位於所述粗化處理層上的表面處理層,其中,所述表面處理層的厚度與所述生箔層的厚度比值是介於1.0×10-5至3.0×10-4之間。
本創作所採用的另外一技術方案是,提供一種線路板組件,其包括一基板、至少一位於基板上的線路層以及一連接於基板與線路層之間的黏著層,其中,線路層是上述應用於高頻訊號傳輸的銅箔。
本創作所採用的另外再一技術方案是,提供一種線路板組件,其包括一基板以及至少一位於基板上的線路層,其中,線路層是上述應用於高頻訊號傳輸的銅箔。
本創作的有益效果在於,通過使表面處理層的厚度與生箔層的厚度比值介於1.0×10-5至3.0×10-4之間、提高銅箔的純度、以及控制生箔晶粒尺寸以減少晶粒界面,來達到銅箔阻抗的降低。藉此,本創作實施例所提供的銅箔可以在不繼續降低表面粗糙度的情況下,增加銅箔的導電度。因此,當本創作實施例的銅箔應用於傳輸高頻訊號的線路板組件中時,可具有較低的電性損耗。另外,由於銅箔的表面粗糙度仍維持在一定值,因此銅箔與基板之間的結合強度不會因為降低電性損耗而被犧牲。
為使能更進一步瞭解本創作的特徵及技術內容,請參閱以下有關本創作的詳細說明與附圖,然而所提供的附圖僅提供參考與說明用,並非用來對本創作加以限制。
1‧‧‧銅箔
10‧‧‧生箔層
10a‧‧‧光滑面
10b‧‧‧粗糙面
11‧‧‧粗化處理層
110‧‧‧銅瘤
12‧‧‧表面處理層
S1‧‧‧壓合面
P1、P2‧‧‧線路板組件
2‧‧‧基板
1’‧‧‧線路層
3‧‧‧黏著層
T‧‧‧總厚度
t‧‧‧粗化處理層厚度
圖1為本創作實施例的銅箔的局部剖面示意圖。
圖2為圖1的銅箔在區域II的局部放大示意圖。
圖3 顯示本創作實施例的線路板組件的剖面示意圖。
圖4 顯示本創作另一實施例的線路板組件的剖面示意圖。
以下是通過特定的具體實施例來說明本創作所公開有關“應用於高頻訊號傳輸的銅箔以及線路板組件”的實施方式。本創作實施例所提供的應用於高頻訊號傳輸的銅箔可應用於硬式印刷電路板(printed circuit board,PCB)或軟性印刷電路板(FPC)。前述的高頻訊號通常是指頻率為8GHz以上的高頻訊號。
請參照圖1及圖2。圖1顯示本創作實施例的銅箔的局部剖面示意圖。圖2為圖1的銅箔在區域II的局部放大圖。本創作實施例的銅箔1包括一生箔層10、一位於生箔層10上的粗化處理層11以及一位於粗化處理層11上的表面處理層12。
須說明的是,生箔層10是通過電鍍製程而形成,且生箔層10具有一光滑面10a及與光滑面10a相對的粗糙面10b。光滑面10a通常是指在電鍍過程中,生箔層10接觸陰極輪(未圖示)的一面,粗糙面10b則是生箔層10和電解液接觸的表面。
本創作實施例中,生箔層10的銅晶粒尺寸是介於0.1至10μm之間。須說明的是,銅箔1的純度越高,導電度越好,也有助於降低高頻訊號傳輸時的損耗。但是,要得到高純度的銅箔1的製程難度以及成本卻非常高。
在本創作實施例中,也藉由優化生箔層10的微結構,也就是控制生箔層10的銅晶粒尺寸,來進一步降低銅箔1的阻抗。詳細而言,生箔層10中的晶粒界面(grain boundary)會阻礙或阻擾電子傳遞。因此,生箔層10的晶粒界面越少,銅箔1的電性表面會越好。由於晶粒界面的多寡和晶粒尺寸成負相關,當晶粒尺寸越大,晶粒界面越少。因此,本創作實施例中,生箔層10的晶粒尺寸控制在0.1至10μm之間,較佳是在2至5μm之間,也可以進一步提高銅箔1阻抗值,而有助於降低高頻訊號傳輸損耗。
在完成生箔層10的製程之後,對生箔層的粗糙面10b進行粗化表面處理,而在粗糙面10b上形成粗化處理層11。前述的粗化表面處理包括多次粗化處理及固化處理。粗化處理與固化處理是指將生箔層10置入具有銅離子與硫酸根離子的電解液中進行電鍍,以使銅原子沉積在生箔層10的粗糙面10b上,而形成多個銅瘤。
在本創作實施例中,粗化處理層11為無砷的粗化處理層。也就是說,在執行粗化處理以及固化處理時所使用的電解液中,使用完全不含砷元素的添加劑。在一實施例中,粗化處理層11的厚度t大約是介於0.1至2μm之間。
如圖2所示,經過粗化處理與固化處理之後的粗化處理層11包括多個銅瘤110。每一個銅瘤110是沿著與粗糙面10b不平行的長軸方向延伸。
另外,銅瘤的形狀可以通過控制電解液的組成,如:銅離子的濃度、硫酸濃度或是添加劑組成,或者是電流密度的大小來調整。舉例而言,可以將銅離子的濃度降低,並控制電流密度以及粗化處理的時間,以使銅在結晶時,在大致垂直於生箔層10的粗糙面10b的方向成長,而限制銅在水平方向成長。據此,可以使位於生箔層10的粗糙面10b的粗化處理層11的銅瘤110的長軸會大致是平行生箔層10的厚度方向。
須說明的是,由於砷的電阻較高,若銅箔中的砷含量過高,也會增加銅箔的阻抗值。因此,本創作實施例的銅箔1的粗化處理層11為無砷的粗化處理層,可以進一步降低銅箔1的阻抗值,而有利於應用在高頻訊號傳輸。
請再參照圖1。銅箔1在經過粗化及固化處理之後,還可以進行其他後續處理,從而在粗化處理層11上形成表面處理層12,以調整銅箔1的抗熱性或抗腐蝕性。前述的表面處理例如是耐熱及抗化學處理、鉻酸鹽(chromate)處理、矽烷(silane)耦合處理及其組
合之一,可由本領域技術人員根據實際需求選擇。
因此,構成表面處理層12的材料為金屬元素或者是合金。在一實施例中,構成表面處理層12的材料可以選自由鋅、鉻、鎳及其組合所組成的群組。
雖然表面處理層12可保護銅層(生箔層10以及粗化處理層11)不被氧化,並可在蝕刻銅箔1以形成線路的製程中,保護銅層不被酸鹼藥水腐蝕。然而,構成表面處理層12的材料的電阻值都比銅還高,而使銅箔1的阻抗增加。因此,表面處理層12的厚度需控制在一定範圍,以使銅箔1的阻抗夠低而可減少傳輸損耗,但又能保護銅層不被氧化或腐蝕。
由於表面處理層12的厚度和非銅金屬元素的含量成正相關,因此,可以通過控制表面處理層12的厚度,來控制非銅金屬元素(如:鋅、鉻、鎳)的含量。在本創作實施例中,表面處理層12的厚度與生箔層10的厚度比值是介於1.0×10-5至3.0×10-4之間,以降低銅箔1的阻抗。在一實施例中,銅箔1的總厚度T是介於6至400μm之間,而表面處理層12的厚度是介於10至50Å。
在一實施例中,構成所述表面處理層的材料包括鋅、鉻及鎳,且在銅箔1中的鋅含量為50~175ppm,鎳含量為20~155ppm,且鉻含量為20~70ppm。在一實施例中,銅箔1中的鋅含量、鎳含量以及鉻含量的總和不超過400ppm。
須說明的是,若是銅箔1所包含的非銅元素,如:砷、鋅、鉻、鎳等,的總含量越高,會影響銅箔1的阻抗值。本創作實施例的銅箔1的粗化處理層11不含砷元素,且表面處理層12的厚度與銅箔1的總厚度比值偏低,可使銅箔1中所包含的非銅元素的總含量降低。據此,本創作實施例的銅箔1可具有較低的阻抗。當本創作實施例的銅箔1應用在傳輸高頻訊號時,可具有較低的傳輸損耗。
也就是說,相較於現有技術中通過降低銅箔1的表面粗糙度
來降低傳輸損耗,本創作實施例是通過調整生箔層10的微結構以及盡可能提高銅箔1的純度,來降低傳輸損耗。因此,本創作實施例的銅箔1的表面粗糙度不用繼續降低,也同樣可以達到降低傳輸阻抗的效果。
請參照圖3。圖3顯示本創作實施例的線路板組件的剖面示意圖。本創作實施例的銅箔可應用於不同的線路板組件P1例如硬性印刷電路板(PCB)、軟性印刷電路板(FPC)及其相似物,但本創作不限於此。
在圖1的實施例中,線路板組件P1包括一基板2、一線路層1’以及連接於基板2與線路層1’之間的黏著層3。線路層可以是直接是上述的銅箔1,或者是上述的銅箔1通過蝕刻所形成的電路。
基板2可以是高頻基板,如:環氧樹脂基板、聚氧二甲苯樹脂基板(PPO)或氟系樹脂基板,或者是由聚醯亞胺、乙烯對苯二甲酸酯、聚碳酸酯、液晶高分子或聚四氟乙烯等材料所構成的基板。
在本實施例中,銅箔1具有一壓合面S1,且壓合面S1的十點平均粗糙度可以介於0.5μm至3μm之間,較佳是介於2μm至3μm之間。當銅箔1和基板20通過黏著層22接合時,是以壓合面S1面向基板20。
請參照圖4,其顯示本創作另一實施例的線路板組件的剖面示意圖。本實施例的線路板組件P2包括基板20及線路層1’。和圖3的實施例相似,線路層1’可以是上述的銅箔1,或者是上述的銅箔1通過蝕刻所形成的電路。
和圖3的實施例不同的是,在本實施例中,基板20可通過熱壓而直接和線路層1’接合,不需額外通過黏著層3與銅箔1接合。在本實施例中,基板20可以是由液晶高分子或者玻纖基板(Pre-preg)等材料構成。因此,在進行壓合時,基板20會直接和壓合面S1貼合。
須說明的是,經過測試,本創作實施例的銅箔1經過200℃
加熱2小時後的電阻值低於0.16ohm-gram/m2。因此,在本創作實施例的線路板組件P1、P2中,由於銅箔1的壓合面S1的表面粗糙度不需要降到2μm以下,即可減少高頻訊號傳輸時的電性損耗。因此,銅箔1和基板2或是黏著層3之間可以具有較高的接合強度,從而可解決先前技術中,為了降低高頻傳輸損耗而可能犧牲銅箔1與基板2之間的接合強度的問題。
此外,須說明的是,雖然研究中發現若銅箔的導電性越高,也就是電阻越低,是判定訊號損失的一項重要因素,但目前卻無人致力於提高銅箔的導電度。因此,本創作的有益效果在於,通過使表面處理層12的厚度與生箔層10的厚度比值介於1.0×10-5至3.0×10-4之間,以提高銅箔1的純度,以及通過控制生箔層10的晶粒尺寸以減少晶界,進而可降低銅箔1的阻抗。
藉此,本創作實施例所提供的銅箔1可以在不繼續降低表面粗糙度的情況下,增加銅箔1的導電度。因此,當本創作實施例的銅箔1應用於傳輸高頻訊號的線路板組件P1、P2中時,可具有較低的電性損耗。換言之,本創作可以在不繼續降低表面粗糙度的情況下,進一步降低利用銅箔1所製成之線路板組件P1、P2在高頻訊號下的訊號損失(Insertion Loss)。另外,由於銅箔1的表面粗糙度仍維持在一定值,因此銅箔1與基板2之間的結合強度不會因為降低電性損耗而被犧牲。
以上所公開的內容僅為本創作的優選可行實施例,並非因此侷限本創作的申請專利範圍,故凡運用本創作說明書及附圖內容所做的等效技術變化,均包含於本創作的申請專利範圍內。
Claims (13)
- 一種應用於高頻訊號傳輸的銅箔,其包括:一生箔層、一位於所述生箔層上的粗化處理層以及一位於所述粗化處理層上的表面處理層,其中,所述表面處理層的厚度與所述生箔層的厚度比值是介於1.0×10-5至3.0×10-4之間。
- 如請求項1所述的應用於高頻訊號傳輸的銅箔,其中,所述生箔層的銅晶粒尺寸是介於0.1至10μm之間。
- 如請求項1所述的應用於高頻訊號傳輸的銅箔,其中,所述粗化處理層的厚度是介於0.1至2μm之間,且所述粗化處理層為無砷的粗化處理層。
- 如請求項1所述的應用於高頻訊號傳輸的銅箔,其中,所述粗化處理層包括多個銅瘤。
- 如請求項1所述的應用於高頻訊號傳輸的銅箔,其中,所述表面處理層的厚度為10~50Å,且構成所述表面處理層的材料選自由鋅、鉻、鎳及其組合所組成的群組。
- 如請求項1所述的應用於高頻訊號傳輸的銅箔,其中,構成所述表面處理層的材料包括鋅、鉻及鎳,且在所述銅箔中的鋅含量為50~175ppm,鎳含量為20~155ppm,且鉻含量為20~70ppm。
- 如請求項6所述的應用於高頻訊號傳輸的銅箔,其中,在所述銅箔中的所述鋅含量、所述鎳含量以及所述鉻含量的總和不超過400ppm。
- 如請求項1所述的應用於高頻訊號傳輸的銅箔,其中,所述銅箔具有一壓合面,所述壓合面的十點平均粗糙度介於0.5至3μm之間。
- 如請求項1所述的應用於高頻訊號傳輸的銅箔,其中,所述銅箔經200℃加熱2小時後的阻抗值低於0.16ohm-gram/m2。
- 一種線路板組件,所述線路板組件包括一基板、至少一位於所述基板上的線路層以及一連接於所述基板與所述線路層之間的黏著層,其中,所述線路層為如請求項1至9其中之一所述的應用於高頻訊號傳輸的銅箔。
- 如請求項10所述的線路板組件,其中,所述線路板組件為硬性印刷電路板或是軟性印刷電路板。
- 如請求項10所述的線路板組件,其中,所述基板為一高頻基板,且所述高頻基板為環氧樹脂基板、聚氧二甲苯樹脂基板或氟系樹脂基板。
- 一種線路板組件,所述線路板組件包括一基板以及至少一位於所述基板上的線路層,其中,所述線路層為如請求項1至9其中之一所述的應用於高頻訊號傳輸的銅箔。
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