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KR940025224A - 중계기 보안 시스템 - Google Patents

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Publication number
KR940025224A
KR940025224A KR1019940006582A KR19940006582A KR940025224A KR 940025224 A KR940025224 A KR 940025224A KR 1019940006582 A KR1019940006582 A KR 1019940006582A KR 19940006582 A KR19940006582 A KR 19940006582A KR 940025224 A KR940025224 A KR 940025224A
Authority
KR
South Korea
Prior art keywords
circuit means
data
splitting
port
detecting
Prior art date
Application number
KR1019940006582A
Other languages
English (en)
Inventor
비제 네이더
로 윌리엄
Original Assignee
레이먼드 프리쯔
어드밴스드 마이크로 디바이시즈, 인코포레이티드
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 레이먼드 프리쯔, 어드밴스드 마이크로 디바이시즈, 인코포레이티드 filed Critical 레이먼드 프리쯔
Publication of KR940025224A publication Critical patent/KR940025224A/ko

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  • Computing Systems (AREA)
  • General Engineering & Computer Science (AREA)
  • Small-Scale Networks (AREA)
  • Data Exchanges In Wide-Area Networks (AREA)
  • Communication Control (AREA)

Abstract

본 발명은 데이타의 비허가된 수신의 방지를 보증하기 위한 보안을 제공하는 네트워크에 사용되도록 제공되는 시스템에 관한 것이다. 시스템은 비허가된 포트가 특정한 데이타를 수신하는 것을 방지하는 잼 시퀸스를 이용한다. 네트워크내에서 사용되는 중계기는 특정 데이타 시퀸스를 검출하는 능력을 가지도록 제공됨으로써 향상된 특성으로 제공한다.

Description

중계기 보안 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 따른 통합 다중포트 중계기 및 하드웨어 구현 관리 정보 베이스장치의 개략적인 블럭도.

Claims (6)

  1. 데이타 스트림의 시작을 표시하는 비트와 데이타를 수신하는 각각의 포트에 관련된 비트를 포함하는 데이타의 송신 및 수신용 다수의 포트를 포함하는 네트워크에 대해 보안을 제공하는 시스템으로, 각각의 포트에 접속된 분열 기능을 인에이블하는 인에이블 수단과, 상기 인에이블 수단에 접속되고, 각각의 포트에 대해서 하나씩 존재하며, 직렬 형식으로 각각 접속되어지는 다수의 분열 회로 수단과, 제1분열 회로 수단 및 마지막 분열 회로 수단사이에 접속되어 시작 비트가 마지막 분열 회로 수단에 도달된 때를 검출하는 검출 회로 수단과, 검출 회로 수단에 응답하여 데이타 비트스트림이 특정 포트에 도달하는 것을 방지하는 데이타의 잼 시퀀스를 제공하는 수단으로 구성된 것을 특징으로 하는 시스템.
  2. 제1항에 있어서, 각각의 분열 회로 수단은 각각 직렬 방식으로 연쇄되어지는 쉬프트 레지스터를 포함하는 것을 특징으로 하는 시스템.
  3. 제2항에 있어서, 각각의 분열 회로 수단은 특정 포트에 제공된 데이타가 분열되었는지의 표시를 제공하는 데이타 비트스트림으로부터의 비트를 수신하기 위한 래치를 포함하는 것을 특징으로 하는 시스템.
  4. 제3항에 있어서, 각각의 래치는 각각의 포트에 부합하는 것을 특징으로 하는 시스템.
  5. 제4항에 있어서, 검출 회로 수단은 시작 비트를 검출하는 검출 수단과, 검출 수단에 접속되어 시작 비트가 1비트 쉬프트 래지스터에 도달했는지를 결정하는 수단과, 마지막 1비트 쉬프트 레지스터에 도달하는 시작 비트에 응답하고 포트가 분열되었는지를 표시하도록 다수의 1비트 쉬프트 레지스터로부터 래치로 비트를 채하는 신호를 지정하는 지정수단을 포함하는 것을 특징으로 하는 시스템.
  6. 제5항에 있어서, 지정 수단은 래치로 데이타를 래치하는 1비트 쉬프트 레지스터로 스트로브 신호를 제공하는 것을 특징으로 하는 시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940006582A 1993-04-26 1994-03-30 중계기 보안 시스템 KR940025224A (ko)

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Application Number Priority Date Filing Date Title
US08/053,797 1993-04-26
US08/053,797 US5353353A (en) 1993-04-26 1993-04-26 Repeater security system

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Publication Number Publication Date
KR940025224A true KR940025224A (ko) 1994-11-19

Family

ID=21986604

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KR1019940006582A KR940025224A (ko) 1993-04-26 1994-03-30 중계기 보안 시스템

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US (1) US5353353A (ko)
EP (1) EP0622923A3 (ko)
JP (1) JPH0715454A (ko)
KR (1) KR940025224A (ko)
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Patent event date: 19940330

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