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KR900019514A - 비디오 신호 처리 장치 - Google Patents

비디오 신호 처리 장치 Download PDF

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KR900019514A
KR900019514A KR1019890005892A KR890005892A KR900019514A KR 900019514 A KR900019514 A KR 900019514A KR 1019890005892 A KR1019890005892 A KR 1019890005892A KR 890005892 A KR890005892 A KR 890005892A KR 900019514 A KR900019514 A KR 900019514A
Authority
KR
South Korea
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signal
video
input
value
input terminal
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Application number
KR1019890005892A
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English (en)
Other versions
KR0129528B1 (ko
Inventor
토마스 프링 러셀
헨리 윌리스 도날드
알랜 해이그 죤
Original Assignee
유진 엠. 휘태커
알 씨 에이 라이센싱 코포레이션
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
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Publication of KR900019514A publication Critical patent/KR900019514A/ko
Application granted granted Critical
Publication of KR0129528B1 publication Critical patent/KR0129528B1/ko

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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00—Details of television systems
    • H04N5/14—Picture signal circuitry for video frequency region
    • H04N5/20—Circuitry for controlling amplitude response
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
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    • H04N9/64—Circuits for processing colour signals
    • H04N9/646—Circuits for processing colour signals for image enhancement, e.g. vertical detail restoration, cross-colour elimination, contour correction, chrominance trapping filters

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  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Picture Signal Circuits (AREA)
  • Stereo-Broadcasting Methods (AREA)
  • Burglar Alarm Systems (AREA)
  • Studio Circuits (AREA)
  • Analogue/Digital Conversion (AREA)
  • Measurement Of Current Or Voltage (AREA)
  • Processing Of Color Television Signals (AREA)

Abstract

내용 없음

Description

비디오 신호 처리 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 포함한 텔레비젼 수상기에서 회로 일부의 블럭 다이어그램.
제3도는 본 발명에 따른 신호 합성 회로의 제1실시예를 나타내는 블럭 다이어그램, 제4도는 본 발명에 따른 신호 합성 회로의 제2실시예를 나타내는 블럭 다이어그램.

Claims (9)

  1. 비디오 신호는 연속 수평 라인 신호를 발생하며, 동기 성분을 포함하는 상기 비디오 신호를 인가하기 위한 비디오 입력 단자와, 상기 비디오 입력 단자에 접속되고 상기 수평 라인 사이에서의 차이에 관계된 다른 신호를 발생하기 위한 제1수단을 구비하는 비디오 신호 처리 장치에 있어서, 상기 비디오 입력 단자 및 상기 제1수단에 접속되고 상기 신호의 합성이 상기 동기 성분에 의해 발생된 진폭 범위에서 신호 진폭을 발생하지 못할때만 상기 비디오 신호를 상기 다른 신호에 합성하기 위한 제2수단을 구비하는 것을 특징으로 하는 비디오 신호 처리 장치.
  2. 제1항에 있어서, 기준 값 소스와 상기 소스 및 상기 비디오 입력 단자에 접속되고 상기 비디오 입력 신호의 진폭 값을 오프세트하며 오프세트 신호를 제공하기 위한 제3수단과 상기 제3수단 및 상기 제1수단에 접속되고 상기 비디오 신호 및 상기 다른 신호의 합성이 상기 동기성분에 의해 발생된 진폭 범위에서 진폭 값을 갖는 합성 신호를 발생하지 못할 때만 상기 다른 신호를 제공하기 위한 제4수단과 상기 비디오 입력 단자 및 상기 제4수단에 접속되고 상기 비디오 입력 신호와 상기 제4수단에 의해 제공된 신호를 합성하기 위한 제5수단을 구비하는 것을 특징으로 하는 비디오 신호 처리 장치.
  3. 제2항에 있어서, 상기 제3수단은 상기 소스에 접속된 피감수 입력 단자와 상기 비디오 입력 단자에 접속된 감수 입력 단자를 갖는 감산기를 구비하는 것을 특징으로 하는 비디오 신호 처리장치.
  4. 제3항에 있어서, 상기 제4수단은 상기 감산기에 접속되고 상기 감산기의 한 극성에 의해 다른 값 출력을 제공하기 위한 극성 변별기와 상기 제1수단 및 상기 극성 변별기에 각각 접속된 제1 및 제2입력포트와 출력 단자를 가지며 상기 제1 및 제2입력포트에 인가된 두 신호 중 어느 것이 더 큰 값을 갖는지를 표시하는 신호를 제공하기 위한 비교기와, 상기 극성 변별기 및 상기 제1수단에 각각 접속된 제1 및 제2입력포트, 상기 비교기의 출력 단자에 접속된 제어 입력 단자 및, 출력 단자를 갖는 멀티플렉서를 구비하는 것을 특징으로 하는 비디오 신호 처리장치.
  5. 제4항에 있어서, 상기 제5수단은 비디오 입력 단자 및 상기 멀티플렉서의 출력 단자에 각각 접속된 제1 및 제2입력과 합성된 신호를 제공하기 위한 출력 단자를 갖는 신호 합성기를 구비하는 것을 특징으로 하는 비디오 신호 처리장치.
  6. 제2항에 있어서, 상기 제4수단은 상기 제3수단에 접속되고 한 극성에서만 오프세트 신호의 진폭 값을 제공하기 위한 극성 변별기와 상기 제1수단 및 상기 극성 변별기에 각각 접속된 제1 및 제2입력포트 및 출력 단자를 가지며 제1 및 제2입력포트에 인가된 두 신호 중 어느 것이 더 큰 값을 갖는지를 표시하는 신호를 제공하기 위한 비교기와 상기 극성 변별기 및 상기 제1수단에 각각 접속된 제1 및 제2입력, 상기 비교기의 출력 단자에 접속된 제어 입력 단자 및 출력 단자를 갖는 멀티플렉서를 구비하는 것을 특징으로 하는 비디오 신호 처리장치.
  7. 제6항에 있어서, 상기 오프세트 신호는 다수의 비트 이진 샘플 데이타 신호이며, 각 샘플은 부호 비트 및 (N-1)값 비트를 표시하는 극성을 포함한 N비트의 N정수를 구비하며, 상기 극성 변별기는 상기 부호 비트를 수신하도록 접속된 한 입력과 상호 배타적인 상기 값 비트의 다른 비트에 접속된 제2입력을 각각 갖는 다수의 (N-1) 두 입력 논리 게이트를 구비하며, 상기 논리 게이트 각각은 제1상태를 갖는 상기 부호 비트에 대해 동일값 출력 신호를 제공하며, 제2상태를 갖는 상기 부호 비트에 인가되는 값 비트에 관련되며 출력 값을 제공하는 것을 특징으로 하는 비디오 신호 처리장치.
  8. 제1항에 있어서, 상기 비디오 신호는 합성 비디오 신호이고 상기 제1수단은 다수의 (둘 포함) 비디오 출력 단자를 가지며 상기 수평 라인의 다른 라인을 표시하는 다수의 비디오 신호를 제공하기 위한 지연 수단과 상기 다수의 비디오 출력 단자에 접속되고 상기 수평 라인 사이에서 다른 신호에 연관된 신호를 발생하도록 상기 다수의 비디오 신호를 스케일 및 합성하기 위한 웨이팅 및 합성 수단과, 상기 웨이팅 및 합성 수단에 접속된 비선형 처리 수단을 특징으로 하는 비디오 신호 처리장치.
  9. ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019890005892A 1988-05-04 1989-05-02 비디오 신호 처리 장치 KR0129528B1 (ko)

Applications Claiming Priority (5)

Application Number Priority Date Filing Date Title
US19031688A 1988-05-04 1988-05-04
US190.316 1988-05-04
US190,316 1988-05-04
US07/290,859 US4882626A (en) 1988-05-04 1988-12-27 Signal combining circuitry
US290,859 1988-12-27

Publications (2)

Publication Number Publication Date
KR900019514A true KR900019514A (ko) 1990-12-24
KR0129528B1 KR0129528B1 (ko) 1998-04-10

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Application Number Title Priority Date Filing Date
KR1019890005892A KR0129528B1 (ko) 1988-05-04 1989-05-02 비디오 신호 처리 장치

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US (1) US4882626A (ko)
EP (1) EP0340656B1 (ko)
JP (1) JP2756697B2 (ko)
KR (1) KR0129528B1 (ko)
CA (1) CA1303212C (ko)
DE (1) DE68919522T2 (ko)
ES (1) ES2067495T3 (ko)

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US4882626A (en) 1989-11-21
CA1303212C (en) 1992-06-09
EP0340656B1 (en) 1994-11-30
EP0340656A3 (en) 1991-06-12
DE68919522T2 (de) 1995-05-24
JP2756697B2 (ja) 1998-05-25
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JPH0219073A (ja) 1990-01-23
DE68919522D1 (de) 1995-01-12
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