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KR880014734A - 증폭기 - Google Patents

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KR880014734A
KR880014734A KR1019880006088A KR880006088A KR880014734A KR 880014734 A KR880014734 A KR 880014734A KR 1019880006088 A KR1019880006088 A KR 1019880006088A KR 880006088 A KR880006088 A KR 880006088A KR 880014734 A KR880014734 A KR 880014734A
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input
input terminal
terminal
amplifier
output
Prior art date
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KR1019880006088A
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KR900008756B1 (en
Inventor
미요이찌 와따나베
시노부 우니다
Original Assignee
시기 모리야
미쓰비시덴기 가부시기가이샤
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Publication date
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Priority claimed from JP62130681A external-priority patent/JPH07105676B2/ja
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    • H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
    • H03F3/45—Differential amplifiers
    • H—ELECTRICITY
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    • H03F—AMPLIFIERS
    • H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
    • H03F3/68—Combinations of amplifiers, e.g. multi-channel amplifiers for stereophonics
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03F—AMPLIFIERS
    • H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
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    • H03F1/083—Modifications of amplifiers to reduce detrimental influences of internal impedances of amplifying elements in transistor amplifiers

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  • Power Engineering (AREA)
  • Amplifiers (AREA)

Abstract

내용 없음

Description

증폭기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제6도는 제1의 개념을 바탕으로 배열된 본 발명의 제1의 실시예에 따른 증폭회로를 도시한 회로도, 제7도는 본 발명의 제2의 실시예에 따른 증폭회로의 회로도, 제8도는 본 발명의 제3의 실시예에 따른 증폭회로를 도시한 회로도.

Claims (11)

  1. DC(직류) 전압성분을 포함하는 입력신호(Vi)를 받기 위한 하나의 신호입력단(4), 하나의 극성의 입력을 받기 위한 제1입력단(1a), 제1의 입력단(1a)의 반대편에서 다른 극성의 입력을 받기 위한 제2의 입력단(1b), 출력단(1c)를 가지며, 상기 제1의 입력단(1a)가 상기 하나의 신호입력단(4)에 접속되어 있는 차동입력 전치증폭기(1), 하나의 극성의 입력을 받기 위한 제1의 입력단(2a), 상기 제1의 입력단(2a)의 반대편에서 다른 극성의 입력을 받기 위한 제2의 입력단(2b), 증폭회로(100, 700)의 제1의 출력신호(Vbo)를 얻는 제1의 출력단(5)를 가지며, 상기 제1의 입력단(2a)가 상기 전치증폭기(1)의 상기 출력단(1)의 출력단(1c)와 제2의 입력단(1b) 사이에 접속된 제1의 저항(24), 제2의 저항(25)와 하나의 콘텐서(23)으로 구성되고, 상기 전치증폭기(1)의 제2의 입력단(1b)와 접지 사이에 접속되며 상기 콘덴서(23)은 접지에 접속되는 직렬회로, 직렬회로의 접속점(22)와 상기 신호입력단(4) 사이에 접속된 제3항의 저항(21), 상기 신호입력단(4)를 거쳐서 상기 입력신호를 받기 위한 제1의 입력단(3a), 제2의 입력단(3b) 및 증폭회로(100, 700)의 제2의 출력 신호를 얻는 제2의 출력단(6)을 가지며, 제2의 증폭기(3)의 상기 제2의 입력단(3b)가 기준전압으로써 제1과 제2의 증폭기(2, 3)에 상기 접속점에서 나타나는 전압을 인가하도록 상기 직렬회로의 접속점에 상기 제1의 증폭기(2)의 상기 제2의 입력단(2b)와 함께 접속되어 있는데 제2의 차동입력 증폭기(3)을 포함하는 증폭회로(100, 700).
  2. 특허청구의 범위 제1항에 있어서, 또 상기 제2의 증폭기(3)의 제1의 입력단(3a)와 상기 입력신호(Vi)를 받기 위해 신호입력단(4)에 접속된 제1의 입력단((16a), 상기 기준전압을 받기 위한 직렬회로의 접속점(22)에 접속된 제2의 입력단(16b), 증폭회로(200)의 제3의 출력신호를 얻는 제3의 출력단(17)을 갖는 제3의 차동입력 증폭기(16)을 포함하는 증폭회로(200).
  3. 특허청구의 범위 제2항에 있어서, 또 상기 전치증폭기(1)의 출력단(1c)에 접속된 제1의 입력단(26a), 직렬회로의 접속점(22)에 접속된 제2의 입력단(26b) 및 증폭회로(400)의 제4의 출력신호를 얻는 제4의 출력단(27)을 갖는 제4의 차동입력 증폭기(26), 상기 제4의 차동입력 증폭기(26)에 병렬로 접속되며 전치 증폭기(1)의 출력단 (1c)에 접속된 제1의 입력단(30a)와 상기 기준 전압을 받기 위해 직렬회로의 접속점(22)에 접속된 제2의 입력단(30b)를 갖는 제5의 차동입력 증폭기(30)을 포함하는 증폭회로(400).
  4. 특허청구의 범위 제1항에 있어서, 또 상기 전치증폭기(1)의 출력단(1c)에 접속된 제1의 입력단(26a), 상기 기준전압을 받기 위한 직렬회로의 접속점(22)에 접속된 제2의 입력단(26b), 증폭회로(300)의 제3의 출력신호를 얻는 제3의 출력단(27)을 갖는 제3의 차동입력 증폭기(26)을 포함하는 증폭회로(300).
  5. 특허청구의 범위 제1항에 있어서, 또 상기 전치증폭기(1)의 출력단(1c)와 상기 제1의 증폭기(2)의 제2의 입력단(1b) 사이에 접속되어 있는 제4의 저항(11)을 포함하는 증폭회로(500).
  6. 특허청구의 범위 제2항에 있어서, 또 상기 전치증폭기(1)의 출력단(1c)와 상기 제1의 증폭기(2)의 제2의 입력단(1b) 사이에 접속되어 있는 제4의 저항(11)을 포함하는 증폭회로(600).
  7. 특허청구의 범위 제4항에 있어서, 또 상기 전치증폭기(1)의 출력단(1c)와 상기 제1의 증폭기(2)의 제2의 입력단(1b) 사이에 접속되어 있는 제4의 저항(11)을 포함하는 증폭회로(700).
  8. DC(직류) 전압성분을 포함하는 입력신호(Vi)를 받기 위한 하나의 신호입력단(4), 하나의 극성의 입력을 받기 위한 제1입력단(1a), 제1의 입력단(1a)의 반대편에 있는 제2의 입력단(1b), 출력단(1c)를 가지며, 상기 제1의 입력단(1a)가 상기 하나의 신호입력단(4)에 접속되어 있는 차동입력 전치증폭기(1), 하나의 극성의 입력을 받기 위한 제1의 입력단(2a), 상기 제1의 입력단(2a)의 반대편에서 다른 극성의 입력을 받기 위한 제2의 입력단(2b), 증폭회로(88, 1100)의 제1의 출력신호(Vbo)를 얻는 제1의 출력단을 가지며, 상기 제1의 입력단(2a)가 상기 전치증폭기(1)의 상기 출력단(1c)에 접속되어 있는 제1의 차동입력증폭기(2), DC(직류) 부귀한 경로를 형성하도록 상기 전치증폭기(1)의 출력단(1c)와 제2의 입력단(1b) 사이에 접속된 제1의 저항(24), 상기 전치증폭기(1)의 제2의 입력단(1b)와 접지 사이에 접속된 하나의 콘덴서(23), 상기 신호입력단(4)와 접속점(22) 사이 및 상기 콘덴서(23)의 하나의 단자와 상기 전치증폭기(1)의 상기 제2의 입력단(1b) 사이에 접속된 제2의 저항(21), 상기 신호입력단(4)를 거쳐서 상기 입력신호를 받기 위한 제1의 입력단(3a), 제2의 입력단(3b) 및 증폭회로(800, 1100)의 제2의 출력 신호를 얻는 제2의 출력단을 가지며, 제2의 증폭기(3)의 상기 제2의 입력단(3b)가 기준전압으로써 제1과 제2의 증폭기(2, 3)에 상기 접속점(22)에서 나타나는 전압을 인가하도록 상기 전치증폭기(1)의 상기 제2의 입력단(1b)와 상기 콘덴서(23)의 하나의 단자 사이에 상기 접속점(22)에 상기 제1의 증폭기(2)의 제2의 입력단(2b)와 함께 접속되어 있는 것을 포함하는 증폭회로(800, 1100).
  9. 특허청구의 범위 제8항에 있어서, 또 상기 제2의 증폭기(3)의 제1의 입력단(3a)와 상기 입력신호(Vi)를 받기 위해 신호입력단(4)에 접속된 제1의 입력단(16a), 상기 기준전압을 받기 위한 상기 접속점(22)에 접속된 제2의 입력단(16b), 증폭회로(900)의 제3의 출력신호를 얻는 제3의 출력단을 갖는 제3의 차동입력 증폭기(16)을 포함하는 증폭회로(900).
  10. 특허청구의 범위 제8항에 있어서, 또 상기 전치증폭기(1)의 출력단(1c)에 접속된 제1의 입력단(26a), 상기 기준전압을 받기 위해 상기 접속점(22)에 접속된 제2의 입력단(26b) 및 증폭회로(1000)의 제4의 출력 신호를 얻는 제4의 출력단을 갖는 제4의 차동입력 증폭기(26)을 포함하는 증폭회로(1000).
  11. 특허청구의 범위 제9항에 있어서, 또 상기 전치증폭기(1)의 출력단(1c)에 접속된 제1의 입력단(26a), 상기 접속점(22)에 접속된 제2의 입력단(26b) 및 증폭회로(1100)의 제4의 출력 신호를 얻는 제4의 출력단을 갖는 제4의 차동입력 증폭기(26), 상기 제4의 차동입력 증폭기(26)에 병렬로 접속되며, 전치증폭기(1)의 출력단(1c)에 접속된 제1의 입력단(30a)와 상기 기준전압을 받기 위해 상기 접속점(22)에 접속된 제2의 입력단(30b)를 갖는 제5의 차동입력 증폭기(30)을 포함하는 증폭회로(1100).
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR8806088A 1987-05-27 1988-05-24 Amplifier KR900008756B1 (en)

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JP62-130681 1987-05-27
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