KR20090066232A - Liquid crystal display - Google Patents
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Abstract
한 쌍의 기판간에 액정층을 유지한 구성의 액정 표시 장치는, 화소의 행 방향으로 연장하는 주사선과, 화소의 열 방향으로 연장하는 신호선과, 화소마다 배치되고 슬릿을 갖는 화소 전극과, 화소 전극과 층간 절연막을 개재하여 대향하는 제1 커먼 전극과, 화소 전극과 동일층에서 슬릿과 평행하게 연장하고 화소 전극에 인접하여 배치된 제2 커먼 전극을 구비한 것을 특징으로 한다.A liquid crystal display device having a liquid crystal layer held between a pair of substrates includes a scan line extending in a row direction of a pixel, a signal line extending in a column direction of a pixel, a pixel electrode disposed in each pixel and having slits, and a pixel electrode. And a first common electrode facing each other via an interlayer insulating film, and a second common electrode extending parallel to the slit in the same layer as the pixel electrode and disposed adjacent to the pixel electrode.
Description
본 출원은 2007년 12월 18일자로 출원된 일본 특허 출원 번호 제2007-326192호에 기초한 것으로, 그 내용은 본원에 참조로서 인용된다.This application is based on the JP Patent application 2007-326192 of an application on December 18, 2007, The content is taken in here as a reference.
본 발명은, 액정 표시 장치에 관한 것으로, 특히 액정 표시 패널을 구성하는 한쪽의 기판에 화소 전극 및 커먼 전극을 구비한 구조의 액정 표시 장치에 관한 것이다.The present invention relates to a liquid crystal display device, and more particularly, to a liquid crystal display device having a structure in which a pixel electrode and a common electrode are provided on one substrate constituting the liquid crystal display panel.
최근, 평면 표시 장치가 활발하게 개발되고 있고, 그 중에서도 액정 표시 장치는 경량, 박형, 저소비 전력 등의 이점으로부터 특히 주목을 받고 있다. 특히, 각 화소에 스위칭 소자를 조립한 액티브 매트릭스형 액정 표시 장치에서는, In-Plane Switching(IPS) 모드나 Fringe Field Switching(FFS) 모드 등의 횡 전계(프린지 전계도 포함함)를 이용한 구조가 주목받고 있다(예를 들면, 일본 특허 공개 제2005-107535호 공보 및 일본 특허 공개 제2006-139295호 공보 참조).In recent years, flat panel display devices have been actively developed, and among them, liquid crystal display devices have attracted particular attention from advantages such as light weight, thinness, and low power consumption. In particular, in an active matrix liquid crystal display device in which switching elements are assembled in each pixel, a structure using a lateral electric field (including a fringe electric field) such as an In-Plane Switching (IPS) mode or a Fringe Field Switching (FFS) mode is noted. (See, for example, Japanese Patent Laid-Open No. 2005-107535 and Japanese Patent Laid-Open No. 2006-139295).
이 IPS 모드나 FFS 모드의 액정 표시 장치는, 어레이 기판에 배치된 화소 전극 및 커먼 전극을 구비하고, 어레이 기판의 주면에 대해서는 거의 평행한 횡 전계에서 액정 분자를 스위칭한다. 또한, 어레이 기판 및 대향 기판의 각각의 외면에 는, 서로 편광축이 직교하도록 배치된 편광판이 배치되어 있다. 이와 같은 편광판의 배치는, 예를 들면 전압 무인가 시에 흑색 화면의 표시를 실현하고, 영상 신호에 대응한 전압을 화소 전극에 인가함으로써 서서히 투과율(변조율)이 증가하여 백색 화면의 표시를 실현한다. 이와 같은 액정 표시 장치에서는, 액정 분자가 기판 주면과 거의 평행한 평면 내에서 회전하기 때문에, 투과광의 입사 방향에 대해 편광 상태가 크게 영향을 미치지 않으므로, 시야각 의존성은 작고, 넓은 시야각 특성을 갖는다고 하는 특징이 있다.The liquid crystal display device in the IPS mode or the FFS mode includes a pixel electrode and a common electrode arranged on the array substrate, and switches the liquid crystal molecules in a transverse electric field substantially parallel to the main surface of the array substrate. Moreover, the polarizing plates arrange | positioned so that a polarization axis may orthogonally cross mutually are arrange | positioned at each outer surface of an array substrate and an opposing board | substrate. Such arrangement of the polarizing plate realizes display of a black screen, for example, when no voltage is applied, and gradually increases transmittance (modulation rate) by applying a voltage corresponding to a video signal to the pixel electrode to realize display of a white screen. . In such a liquid crystal display device, since the liquid crystal molecules rotate in a plane substantially parallel to the main surface of the substrate, the polarization state does not greatly affect the incidence direction of the transmitted light, so that the viewing angle dependency is small and has a wide viewing angle characteristic. There is a characteristic.
특히, FFS 모드의 액정 표시 장치에서는, 화소 전극은 층간 절연막을 개재하여 커먼 전극에 대향하도록 배치되어 있다. 이 화소 전극은 커먼 전극에 대향하는 슬릿을 갖고 있다. 액정 분자는, 이와 같은 슬릿을 통하여 화소 전극과 커먼 전극 사이에 형성되는 전계에 의해 구동된다.In particular, in the liquid crystal display device of the FFS mode, the pixel electrode is disposed to face the common electrode via the interlayer insulating film. This pixel electrode has slits facing the common electrode. The liquid crystal molecules are driven by an electric field formed between the pixel electrode and the common electrode through such slits.
이와 같은 형상의 화소 전극에서, 슬릿이 형성되어 있지 않은 영역, 특히 화소 전극의 주연에서는, 전계가 발생하지 않는다. 이와 같은 전계가 발생하지 않는 영역에서는, 액정 분자는 구동되지 않는다(즉, 액정 분자의 배향은 러빙 방향으로부터 변화하지 않음). 이 때문에, 전압 인가 시에서, 액정층을 투과하는 광의 변조율이 변화하지 않는다. 따라서, 액정 표시 패널의 투과율의 향상, 즉 각 화소의 개구율의 향상이 요망되고 있다.In the pixel electrode of such a shape, an electric field does not generate | occur | produce in the area | region where the slit is not formed, especially the peripheral edge of a pixel electrode. In the region where such an electric field does not occur, the liquid crystal molecules are not driven (that is, the orientation of the liquid crystal molecules does not change from the rubbing direction). For this reason, at the time of voltage application, the modulation rate of the light which permeate | transmits a liquid crystal layer does not change. Therefore, the improvement of the transmittance | permeability of the liquid crystal display panel, ie, the improvement of the aperture ratio of each pixel is desired.
본 발명의 목적은, 투과율을 향상시키고, 표시 품위의 양호한 화상을 표시 가능한 액정 표시 장치를 제공하는 데에 있다.An object of the present invention is to provide a liquid crystal display device capable of improving transmittance and displaying a good image of display quality.
본 발명의 양태에 따르면,According to an aspect of the invention,
한 쌍의 기판간에 액정층을 유지한 구성의 액정 표시 장치로서,A liquid crystal display device having a structure in which a liquid crystal layer is held between a pair of substrates,
화소의 행 방향으로 연장하는 주사선과,A scanning line extending in the row direction of the pixel,
화소의 열 방향으로 연장하는 신호선과,A signal line extending in the column direction of the pixel,
화소마다 배치되고, 슬릿을 갖는 화소 전극과,A pixel electrode disposed for each pixel and having a slit;
상기 화소 전극과 층간 절연막을 개재하여 대향하는 제1 커먼 전극과,A first common electrode facing the pixel electrode via an interlayer insulating film;
상기 화소 전극과 동일층에서, 상기 슬릿과 평행하게 연장하고, 상기 화소 전극에 인접하여 배치된 제2 커먼 전극A second common electrode extending in parallel with the slit and disposed adjacent to the pixel electrode in the same layer as the pixel electrode;
을 구비한 것을 특징으로 하는 액정 표시 장치가 제공된다.There is provided a liquid crystal display device comprising:
본 발명에 따르면, 투과율을 향상시키고, 표시 품위의 양호한 화상을 표시 가능한 액정 표시 장치를 제공할 수 있다.According to the present invention, it is possible to provide a liquid crystal display device capable of improving transmittance and displaying a good image of display quality.
본 발명의 부가적인 목적 및 장점은 다음의 상세한 설명에서 기술될 것이며, 이 상세한 설명으로부터 일부 명확해지거나, 또는 본 발명의 실시에 의해 이해된 것이다. 본 발명의 목적들 및 장점들은 특히 이하에 개시된 수단들과 그 조합에 의해 구현되고, 얻어질 것이다.Additional objects and advantages of the invention will be set forth in the description which follows, and in part will be obvious from the description, or may be understood by practice of the invention. The objects and advantages of the present invention will be realized and attained, in particular, by the means and combinations thereof disclosed below.
본 명세서에 첨부되고, 본 명세서의 일부를 구성하는 첨부 도면은 본 발명의 실시예를 기술하며, 상술된 요약 설명 및 후술하는 상세한 설명과 함께, 본 발명의 원리를 설명하는 역할을 한다.The accompanying drawings, which are incorporated in and constitute a part of this specification, describe embodiments of the invention and, together with the foregoing summary and detailed description, serve to explain the principles of the invention.
이하, 본 발명의 일 실시 형태에 따른 액정 표시 장치에 대해 도면을 참조하여 설명한다. 여기서는, 한쪽의 기판에 화소 전극 및 커먼 전극을 구비하고, 이들 사이에 형성되는 횡 전계(혹은 기판에 거의 평행한 수평 전계)를 주로 이용하여 액정 분자를 스위칭하는 액정 모드로서, FFS 모드의 액정 표시 장치를 예로 설명한다.EMBODIMENT OF THE INVENTION Hereinafter, the liquid crystal display device which concerns on one Embodiment of this invention is demonstrated with reference to drawings. Here, a liquid crystal mode in which a liquid crystal display is provided with a pixel electrode and a common electrode on one substrate and mainly switches liquid crystal molecules using a transverse electric field (or a horizontal electric field substantially parallel to the substrate) formed therebetween. The device will be described as an example.
도 1, 도 2 및 도 3에 도시한 바와 같이, 액정 표시 장치는 액티브 매트릭스 타입의 액정 표시 장치로서, 액정 표시 패널 LPN을 구비하고 있다. 이 액정 표시 패널 LPN은 어레이 기판 AR과, 어레이 기판 AR과 서로 대향하여 배치된 대향 기판 CT와, 이들 어레이 기판 AR과 대향 기판 CT 사이에 유지된 액정층 LQ를 구비하여 구성되어 있다. 이와 같은 액정 표시 장치는, 화상을 표시하는 표시 에리어 DSP를 구비하고 있다. 이 표시 에리어 DSP는, m×n개의 매트릭스 형상으로 배치된 복수의 화소 PX에 의해 구성되어 있다.As shown in FIG. 1, FIG. 2, and FIG. 3, a liquid crystal display device is a liquid crystal display device of an active matrix type, and is equipped with liquid crystal display panel LPN. The liquid crystal display panel LPN includes an array substrate AR, an opposing substrate CT disposed to face the array substrate AR, and a liquid crystal layer LQ held between the array substrate AR and the opposing substrate CT. Such a liquid crystal display device is provided with the display area DSP which displays an image. This display area DSP is comprised by several pixel PX arrange | positioned in m * n matrix form.
어레이 기판 AR은 글래스판이나 석영판 등의 광 투과성을 갖는 절연 기판(20)을 이용하여 형성되어 있다. 도 1 및 도 2에 도시한 바와 같이, 이 어레이 기판 AR은 표시 에리어 DSP에서, 화소 PX마다 배치된 m×n개의 화소 전극 EP, 각 화소 PX의 행 방향 H로 각각 연장된 n개의 주사선 Y(Y1∼Yn), 각 화소 PX의 열 방향 V로 각각 연장된 m개의 신호선 X(X1∼Xm), 각 화소 PX에서 주사선 Y와 신호선 X의 교차부를 포함하는 영역에 배치된 m×n개의 스위칭 소자 W, 화소 전극 EP와 층간 절연막 IL을 개재하여 대향하도록 배치된 제1 커먼 전극 COM1 등을 구비하고 있 다.Array substrate AR is formed using the
어레이 기판 AR은, 또한 표시 에리어 DSP의 주변의 구동 회로 영역 DCT에서, n개의 주사선 Y에 접속된 주사선 드라이버 YD를 구성하는 적어도 일부나, m개의 신호선 X에 접속된 신호선 드라이버 XD를 구성하는 적어도 일부 등을 구비하고 있다. 주사선 드라이버 YD는, 컨트롤러 CNT에 의한 제어에 기초하여 n개의 주사선 Y에 순차적으로 주사 신호(구동 신호)를 공급한다. 또한, 신호선 드라이버 XD는 컨트롤러 CNT에 의한 제어에 기초하여 각 행의 스위칭 소자 W가 주사 신호에 의해 온하는 타이밍에서 m개의 신호선 X에 영상 신호(구동 신호)를 공급한다. 이에 의해, 각 행의 화소 전극 EP는, 대응하는 스위칭 소자 W를 통하여 공급되는 영상 신호에 따른 화소 전위에 각각 설정된다.The array substrate AR is also at least part of the scan line driver YD connected to the n scan lines Y or at least part of the signal line driver XD connected to the m signal lines X in the driving circuit region DCT around the display area DSP. Etc. are provided. The scanning line driver YD sequentially supplies the scanning signals (drive signals) to the n scanning lines Y based on the control by the controller CNT. Further, the signal line driver XD supplies a video signal (driving signal) to the m signal lines X at timings at which the switching elements W in each row are turned on by the scanning signal based on the control by the controller CNT. Thereby, the pixel electrode EP of each row is set to the pixel potential corresponding to the video signal supplied through the corresponding switching element W, respectively.
각 스위칭 소자 W는, 예를 들면 박막 트랜지스터에 의해 구성되어 있다. 스위칭 소자 W의 반도체층은, 예를 들면 폴리실리콘이나 아몰퍼스 실리콘 등에 의해 형성 가능하다. 스위칭 소자 W의 게이트 전극 WG는 주사선 Y에 접속되어 있다(혹은 게이트 전극 WG는 주사선 Y와 일체적으로 형성되어 있다). 스위칭 소자 W의 소스 전극 WS는 신호선 X에 접속됨(혹은 소스 전극 WS는 신호선 X와 일체적으로 형성됨)과 함께, 반도체층의 소스 영역에 컨택트하고 있다. 스위칭 소자 W의 드레인 전극 WD는 화소 전극 EP에 접속됨과 함께, 반도체층의 드레인 영역에 컨택트하고 있다.Each switching element W is comprised by thin film transistors, for example. The semiconductor layer of the switching element W can be formed by polysilicon, amorphous silicon, etc., for example. The gate electrode WG of the switching element W is connected to the scanning line Y (or the gate electrode WG is formed integrally with the scanning line Y). The source electrode WS of the switching element W is connected to the signal line X (or the source electrode WS is formed integrally with the signal line X), and is contacting the source region of the semiconductor layer. The drain electrode WD of the switching element W is connected to the pixel electrode EP and is in contact with the drain region of the semiconductor layer.
제1 커먼 전극 COM1은, 예를 들면 각 화소 PX에 배치되고, 커먼 전위가 공급되는 커먼 배선 C에 전기적으로 접속되어 있다. 이 제1 커먼 전극 COM1은 층간 절 연막 IL에 의해 덮여져 있다. 화소 전극 EP는 층간 절연막 IL 상에서, 제1 커먼 전극 COM1에 대향하도록 배치되어 있다.The 1st common electrode COM1 is arrange | positioned, for example in each pixel PX, and is electrically connected to the common wiring C to which the common potential is supplied. This first common electrode COM1 is covered by the interlayer insulation film IL. The pixel electrode EP is disposed to face the first common electrode COM1 on the interlayer insulating film IL.
또한, 도 2 및 도 3에 도시한 바와 같이, 이 화소 전극 EP는 제1 커먼 전극 COM1과 대향하는 복수의 슬릿 SL을 갖고 있다. 화소 전극 EP 및 제1 커먼 전극 COM1은, 예를 들면 인듐ㆍ주석ㆍ옥사이드(ITO)나 인듐ㆍ아연ㆍ옥사이드(IZO) 등의 광 투과성을 갖는 도전 재료에 의해 형성되어 있다. 어레이 기판 AR의 액정층 LQ에 접촉하는 면은, 배향막(36a)에 의해 덮여져 있다.2 and 3, the pixel electrode EP has a plurality of slits SL facing the first common electrode COM1. The pixel electrode EP and the first common electrode COM1 are formed of a conductive material having light transmittance, such as indium tin oxide (ITO), indium zinc oxide (IZO), or the like. The surface in contact with the liquid crystal layer LQ of the array substrate AR is covered with the
한편, 대향 기판 CT는 글래스판이나 석영판 등의 광 투과성을 갖는 절연 기판(30)을 이용하여 형성되어 있다. 특히, 컬러 표시 타입의 액정 표시 장치에서는, 도 2에 도시한 바와 같이, 대향 기판 CT는 절연 기판(30)의 내면 즉 액정층 LQ에 대향하는 면에, 각 화소 PX를 구획하는 블랙 매트릭스(32), 블랙 매트릭스(32)에 의해 둘러싸여진 각 화소 PX에 배치된 컬러 필터층(34) 등을 구비하고 있다. 또한, 대향 기판 CT는, 외부 전계의 영향을 완화하기 위한 실드 전극이나, 컬러 필터층(34)의 표면의 요철을 평탄화하도록 비교적 두꺼운 막 두께로 배치된 오버 코트층 등을 더 구비하여 구성하여도 된다.On the other hand, the opposing board | substrate CT is formed using the
블랙 매트릭스(32)는 절연 기판(30) 상에서, 어레이 기판 AR에 설치된 주사선 Y나 신호선 X, 스위칭 소자 W 등의 배선부에 대향하도록 배치되어 있다. 컬러 필터층(34)은 절연 기판(30) 상에 배치되고, 서로 다른 복수의 색, 예를 들면 적색, 청색, 녹색 등의 3원색으로 각각 착색된 착색 수지에 의해 형성되어 있다. 적색 착색 수지, 청색 착색 수지, 및 녹색 착색 수지는, 각각 적색 화소, 청색 화소, 및 녹색 화소에 대응하여 배치되어 있다. 대향 기판 CT의 액정층 LQ에 접촉하는 면은, 배향막(36b)에 의해 덮여져 있다.The
이와 같은 대향 기판 CT와 전술한 바와 같은 어레이 기판 AR을 각각의 배향막(36a) 및 배향막(36b)이 대향하도록 배치하였을 때, 양자간에 배치된 도시하지 않은 스페이서에 의해, 소정의 갭이 형성된다. 액정층 LQ는, 이들 어레이 기판 AR의 배향막(36a)과 대향 기판 CT의 배향막(36b) 사이에 형성된 갭에 봉입된 액정 분자 LM을 함유하는 액정 조성물에 의해 구성되어 있다. 액정층 LQ에 함유되는 액정 분자 LM은 배향막(36a) 및 배향막(36b)에 의한 규제력에 의해 배향되어 있다. 즉, 화소 전극 EP와 제1 커먼 전극 COM1 사이에 전위차가 형성되어 있지 않은(즉, 화소 전극 EP와 제1 커먼 전극 COM1 사이에 전계가 형성되어 있지 않은) 무전계 시에는, 액정 분자 LM은, 그 장축 D1이 배향막(36a) 및 배향막(36b)의 러빙 방향 S와 평행한 방위를 향하도록 배향되어 있다.When such an opposing substrate CT and the array substrate AR as described above are arranged so that each of the
또한, 이 액정 표시 장치는 액정 표시 패널 LPN의 한쪽의 외면(즉 어레이 기판 AR의 액정층 LQ와 접촉하는 면과는 반대의 면)에 설치된 광학 소자 OD1을 구비하고, 또한 액정 표시 패널 LPN의 다른 쪽의 외면(즉 대향 기판 CT의 액정층 LQ와 접촉하는 면과 반대인 면)에 설치된 광학 소자 OD2를 구비하고 있다. 이들 광학 소자 OD1 및 OD2는 편광판을 포함하고, 예를 들면 무전계 시에서, 액정 표시 패널 LPN의 투과율이 최저로 되는(즉 흑색 화면을 표시하는) 노멀리 블랙 모드를 실현하고 있다.In addition, the liquid crystal display device includes an optical element OD1 provided on one outer surface of the liquid crystal display panel LPN (that is, the surface opposite to the surface in contact with the liquid crystal layer LQ of the array substrate AR), and the other of the liquid crystal display panel LPN. Optical element OD2 provided in the outer surface (namely, the surface opposite to the surface which contacts liquid crystal layer LQ of opposing board | substrate CT) is provided. These optical elements OD1 and OD2 comprise polarizing plates, for example, and realize the normally black mode in which the transmittance of liquid crystal display panel LPN becomes the lowest (that is, displays a black screen) in the case of an electroless field.
또한, 액정 표시 장치는 액정 표시 패널 LPN에 대해 어레이 기판 AR측에 배 치된 백라이트 유닛 BL을 갖고 있다.The liquid crystal display device also has a backlight unit BL arranged on the array substrate AR side with respect to the liquid crystal display panel LPN.
이와 같은 액정 표시 장치에서, 도 3에 도시한 바와 같이, 화소 전극 EP와 제1 커먼 전극 COM1 사이에 전위차가 형성된 경우(즉, 화소 전극 EP에 커먼 전위와는 서로 다른 전위의 전압이 인가된 전압 인가 시)에는, 화소 전극 EP와 제1 커먼 전극 COM1 사이에 전계 E가 형성된다. 이 때, 액정 분자 LM은, 그 장축 D1이 러빙 방향 S로부터 전계 E와 평행한 방위로 배향하도록 구동된다. 이와 같이, 액정 분자 LM의 장축 D1의 방위가 러빙 방향 S로부터 변화하면, 액정층 LQ를 투과하는 광에 대한 변조율이 변화한다. 이 때문에, 백라이트 유닛 BL로부터 액정 표시 패널 LPN을 투과한 백라이트광의 일부는, 제2 광학 소자 OD2를 투과하고, 백색 화면을 표시한다. 즉, 액정 표시 패널 LPN의 투과율은, 전계 E의 크기에 의존하여 변화한다. 횡 전계를 이용한 액정 모드에서는, 이와 같이 하여 선택적으로 백라이트광을 투과하여, 화상을 표시한다.In such a liquid crystal display, as shown in FIG. 3, when a potential difference is formed between the pixel electrode EP and the first common electrode COM1 (that is, a voltage to which a voltage of a potential different from the common potential is applied to the pixel electrode EP). In the application), an electric field E is formed between the pixel electrode EP and the first common electrode COM1. At this time, the liquid crystal molecule LM is driven such that its long axis D1 is oriented in a direction parallel to the electric field E from the rubbing direction S. FIG. Thus, when the orientation of the long axis D1 of the liquid crystal molecule LM changes from the rubbing direction S, the modulation rate with respect to the light which permeate | transmits the liquid crystal layer LQ changes. For this reason, a part of backlight light which permeate | transmitted liquid crystal display panel LPN from backlight unit BL permeate | transmits 2nd optical element OD2, and displays a white screen. That is, the transmittance of the liquid crystal display panel LPN changes depending on the magnitude of the electric field E. In the liquid crystal mode using the transverse electric field, the backlight is selectively transmitted in this manner to display an image.
특히, 본 실시 형태에서, 액정 표시 장치는 표시 에리어 DSP 내에 배치된 제2 커먼 전극 COM2를 갖고 있다. 이 제2 커먼 전극 COM2는, 화소 전극 EP의 슬릿 SL의 장축 L 혹은 신호선 X와 평행한 방향으로 연장되어 있다. 도 4a에 도시한 예에서는, 슬릿 SL은, 그 장축 L이 열 방향 V와 평행하게 형성되어 있다. 슬릿 SL은, 예를 들면 장방형상으로 형성되어 있다. 슬릿 SL의 긴 변 d는, 장축 L과 평행하다. 복수의 슬릿 SL은, 행 방향 H로 나열되어 있다. 즉, 도 4a에 나타낸 예에서, 제2 커먼 전극 COM2는 슬릿 SL의 장축 L과 평행한 방향, 즉 열 방향 V로 연장하여 배치되어 있다.In particular, in the present embodiment, the liquid crystal display device has a second common electrode COM2 disposed in the display area DSP. The second common electrode COM2 extends in the direction parallel to the major axis L or the signal line X of the slit SL of the pixel electrode EP. In the example shown in FIG. 4A, the major axis L of the slit SL is formed in parallel with the column direction V. FIG. The slit SL is formed in a rectangular shape, for example. The long side d of the slit SL is parallel to the major axis L. The plurality of slits SL are arranged in the row direction H. FIG. That is, in the example shown in FIG. 4A, the second common electrode COM2 is disposed extending in a direction parallel to the major axis L of the slit SL, that is, in the column direction V. As shown in FIG.
또한, 제2 커먼 전극 COM2는 화소 전극 EP와 동일층에서, 화소 전극 EP에 인접하여 배치되어 있다. 이들 화소 전극 EP 및 제2 커먼 전극 COM2는 이격되어 있고, 양자의 측연이 서로 대향하고 있다. 화소 전극 EP와 제2 커먼 전극 COM2 사이에는, 슬릿 SL과 마찬가지로 열 방향 V로 연장된 갭이 형성되어 있다. 즉, 이들 화소 전극 EP 및 제2 커먼 전극 COM2는, 전기적으로 절연되어 있다. 제1 커먼 전극 COM1과 제2 커먼 전극 COM2는, 도시하지 않은 컨택트 홀을 통하여 전기적으로 접속되어 있다. 즉, 제1 커먼 전극 COM1 및 제2 커먼 전극 COM2는 동일 전위이며, 모두 커먼 배선 C에 전기적으로 접속되어 있다.The second common electrode COM2 is disposed adjacent to the pixel electrode EP on the same layer as the pixel electrode EP. These pixel electrodes EP and the second common electrode COM2 are spaced apart, and the side edges of the pixel electrodes EP2 face each other. A gap extending in the column direction V is formed between the pixel electrode EP and the second common electrode COM2 similarly to the slit SL. That is, these pixel electrodes EP and the second common electrode COM2 are electrically insulated. The first common electrode COM1 and the second common electrode COM2 are electrically connected through a contact hole (not shown). That is, the first common electrode COM1 and the second common electrode COM2 have the same potential, and both are electrically connected to the common wiring C.
도 4b에 도시한 바와 같이, 어레이 기판 AR에서, 제1 커먼 전극 COM1은 절연 기판(20) 상에 배치되어 있다. 이 제1 커먼 전극 COM1 및 절연 기판(20)은, 층간 절연막 IL의 제1 절연막 ILa에 의해 덮여져 있다. 신호선 X는, 제1 절연막 ILa 상에 배치되어 있다. 이 신호선 X 및 제1 절연막 ILa는, 층간 절연막 IL의 제2 절연막 ILb에 의해 덮여져 있다. 제2 커먼 전극 COM2는, 화소 전극 EP와 함께, 제2 절연막 ILb 상에 배치되어 있다.As shown in FIG. 4B, in the array substrate AR, the first common electrode COM1 is disposed on the insulating
제1 커먼 전극 COM1과 제2 커먼 전극 COM2는, 전기적으로 접속되어 있으므로, 화소 전극 EP와, 제1 커먼 전극 COM1 및 제2 커먼 전극 COM2 사이에 전위차가 형성되었을 때에, 화소 전극 EP와 제1 커먼 전극 COM1 사이에서는, 슬릿 SL을 통하여, 그 긴 변 d에 대해 직교하는 방향, 즉 행 방향 H에 전계 E가 형성된다. 전압 인가 시에서, 슬릿 SL이 형성되어 있는 영역에서는, 액정 분자 LM은 러빙 방향 S로부터 전계 E와 평행한 방향으로 배향한다. 여기서는, 어레이 기판 AR의 주평면에 서, 러빙 방향 S는 열 방향 V에 교차하는 방향으로 설정되어 있다.Since the first common electrode COM1 and the second common electrode COM2 are electrically connected, when the potential difference is formed between the pixel electrode EP and the first common electrode COM1 and the second common electrode COM2, the pixel electrode EP and the first common electrode are formed. Between the electrodes COM1, the electric field E is formed in the direction orthogonal to the long side d, ie, the row direction H, through the slit SL. At the time of voltage application, in the region where the slit SL is formed, the liquid crystal molecules LM are oriented in the direction parallel to the electric field E from the rubbing direction S. Here, in the main plane of the array substrate AR, the rubbing direction S is set in the direction crossing the column direction V. As shown in FIG.
또한, 전압 인가 시에는, 화소 전극 EP의 주연에서도, 슬릿 SL이 형성되어 있는 영역과 마찬가지로 전계 E가 형성된다. 즉, 도 4c에 도시한 바와 같이, 슬릿 SL이 형성되어 있지 않은 영역, 특히 화소 전극 EP의 열 방향 V에 따른 측연, 즉 신호선 X의 근방 영역에서, 제2 커먼 전극 COM2와 화소 전극 EP 사이의 갭에 전계 E가 형성된다.In addition, at the time of voltage application, the electric field E is formed also in the periphery of the pixel electrode EP similarly to the area | region in which the slit SL is formed. That is, as shown in Fig. 4C, between the second common electrode COM2 and the pixel electrode EP in the region where the slit SL is not formed, especially in the side edge in the column direction V of the pixel electrode EP, that is, in the vicinity of the signal line X. An electric field E is formed in the gap.
이 갭에서는, 화소 전극 EP의 제2 커먼 전극 COM2에 대향하는 측연에 대해 직교하는 방향, 즉 행 방향 H에 전계 E가 형성된다. 이 때문에, 전압 인가 시에서, 화소 전극 EP의 주연에서도, 액정 분자 LM은 러빙 방향 S로부터 전계 E와 평행한 방향으로 배향한다. 이 화소 전극 EP의 주변의 영역에 형성된 전계 E는, 슬릿 SL이 형성된 영역의 전계 E와 평행하다.In this gap, the electric field E is formed in the direction orthogonal to the side edge which opposes the 2nd common electrode COM2 of the pixel electrode EP, ie, the row direction H. As shown in FIG. For this reason, even when the voltage is applied, even in the peripheral edge of the pixel electrode EP, the liquid crystal molecules LM are oriented in the direction parallel to the electric field E from the rubbing direction S. The electric field E formed in the area | region around this pixel electrode EP is parallel to the electric field E of the area | region in which the slit SL was formed.
따라서, 본 실시 형태에서는 화소 전극 EP의 주연, 특히 신호선을 따른 영역을 유효화할 수 있어, 전압 인가 시에서의 액정 표시 패널 LPN의 투과율을 향상시키는 것이 가능하게 된다.Therefore, in the present embodiment, the peripheral edge of the pixel electrode EP, in particular, the area along the signal line can be made effective, so that the transmittance of the liquid crystal display panel LPN at the time of voltage application can be improved.
제2 커먼 전극 COM2는, 열 방향 V에 평행한 장축 L을 갖는 슬릿 SL과 평행하게 연장되어 있고, 신호선 X와 대향하도록 배치하여도 되고, 신호선 X와 화소 전극 EP 사이에(즉, 신호선 X의 바로 위에 겹치지 않도록) 배치하여도 된다. 도 4a 및 도 4b에 도시한 바와 같이, 제2 커먼 전극 COM2는, 제2 절연막 ILb를 개재하여, 신호선 X와 대향하도록 배치되어 있다. 이 경우, 화소간의 무효 영역을 축소할 수 있다. 환언하면, 신호선 X를 사이에 두고 인접하는 화소 전극 EP의 간격을 단축할 수 있다. 따라서, 고정세화가 가능하게 된다.The second common electrode COM2 extends in parallel with the slit SL having a long axis L parallel to the column direction V, and may be disposed to face the signal line X, and may be disposed between the signal line X and the pixel electrode EP (that is, of the signal line X). It may be arranged so as not to overlap directly above. 4A and 4B, the second common electrode COM2 is disposed to face the signal line X via the second insulating film ILb. In this case, the invalid area between the pixels can be reduced. In other words, the distance between adjacent pixel electrodes EP can be shortened with the signal line X therebetween. Therefore, high definition can be achieved.
또한, 신호선 X가 절연 기판(20)과 제1 절연막 ILa 사이에 배치되고, 제2 커먼 전극 COM2가 제2 절연막 ILb 상에 배치되어 있는 경우에는, 제2 커먼 전극 COM2와 신호선 X 사이에는, 제1 절연막 ILa 및 제2 절연막 ILb가 개재된다. 즉, 제2 커먼 전극 COM2와 신호선 X 사이에는, 적어도 1층의 절연막이 개재되어 있으면 된다.In addition, when the signal line X is disposed between the insulating
또한, 제2 커먼 전극 COM2는 화소 전극 EP와 동일 재료에 의해 형성되어 있다. 즉, ITO나 IZO 등의 광 투과성을 갖는 도전 재료를 층간 절연막 IL 상에 성막한 후, 화소 전극 EP를 패터닝할 때와 동시에, 제2 커먼 전극 COM2를 패터닝한다. 이에 의해, 화소 전극 EP 및 제2 커먼 전극 COM2를 동일 공정에 의해 형성할 수 있다. 이에 의해, 제2 커먼 전극 COM2를 패터닝하는 새로운 제조 공정을 추가할 필요가 없기 때문에, 제조 코스트를 억제할 수 있다. 또한, 별도의 제조 공정을 추가하여, 제2 커먼 전극 COM2는 화소 전극 EP와는 서로 다른 공정에 의해 형성하여도 된다. 이 경우, 제2 커먼 전극 COM2는 화소 전극 EP와 서로 다른 재료에 의해 형성되어도 된다.The second common electrode COM2 is formed of the same material as the pixel electrode EP. That is, after forming a conductive material having light transmittance such as ITO or IZO on the interlayer insulating film IL, the second common electrode COM2 is patterned at the same time as the pixel electrode EP is patterned. Thereby, the pixel electrode EP and the 2nd common electrode COM2 can be formed by the same process. Thereby, since it is not necessary to add a new manufacturing process which patterns the 2nd common electrode COM2, manufacturing cost can be suppressed. In addition, another manufacturing process may be added, and the second common electrode COM2 may be formed by a process different from the pixel electrode EP. In this case, the second common electrode COM2 may be formed of a material different from that of the pixel electrode EP.
이 본 실시 형태의 구성에 의한 효과를 비교예와 대비하여 설명한다.The effect by the structure of this embodiment is demonstrated compared with a comparative example.
도 5a에 나타낸 비교예에서는, 화소 전극 EP는 행 방향 H에 대해 2방향으로 기울어지도록 형성된 복수의 슬릿 SL을 갖고 있다. 즉, 슬릿 SL은, 그 장축 L이 행 방향 H에 대해 기울어지도록 형성되어 있다. 슬릿 SL은, 예를 들면 평행사변형 형상으로 형성되어 있다. 슬릿 SL의 긴 변 d는, 장축 L과 평행하다. 또한, 복수 의 슬릿 SL은, 행 방향 H에 직교하는 열 방향 V로 나열되어 있다. 여기서는, 어레이 기판 AR의 주평면에서, 러빙 방향 S는 행 방향 H와 동일한 방향이다.In the comparative example shown in FIG. 5A, the pixel electrode EP has a plurality of slits SL formed to be inclined in two directions with respect to the row direction H. As shown in FIG. That is, the slit SL is formed so that the long axis L may incline with respect to the row direction H. As shown in FIG. The slit SL is formed in parallelogram shape, for example. The long side d of the slit SL is parallel to the major axis L. In addition, the plurality of slits SL are arranged in the column direction V orthogonal to the row direction H. FIG. Here, the rubbing direction S is the same direction as the row direction H in the main plane of the array substrate AR.
화소 전극 EP와 제1 커먼 전극 COM1 사이에 전위차를 형성하면, 슬릿 SL을 통하여, 그 긴 변 d에 대해 직교하는 방향으로 전계 E가 형성된다. 이 전계 E에 의해, 액정 분자 LM은 구동되고, 러빙 방향 S로부터 전계 E와 평행한 방위로 배향한다. 즉, 전압 인가 시에서, 슬릿 SL이 형성되어 있는 영역에서는, 액정 분자 LM은 러빙 방향 S로부터 전계 E와 평행한 방위로 배향한다.When the potential difference is formed between the pixel electrode EP and the first common electrode COM1, the electric field E is formed in the direction orthogonal to the long side d through the slit SL. By this electric field E, the liquid crystal molecule LM is driven and orientated in a direction parallel to the electric field E from the rubbing direction S. That is, at the time of voltage application, in the region where the slit SL is formed, the liquid crystal molecules LM are oriented in the direction parallel to the electric field E from the rubbing direction S.
한편, 슬릿 SL이 형성되어 있지 않은 영역, 특히 화소 전극 EP의 주연에서는 화소 전극 EP와 제1 커먼 전극 COM1 사이에 전위차를 형성하여도, 전계 E는 형성되지 않는다. 도 5b에 도시한 바와 같이, 예를 들면 화소 전극 EP의 신호선 X의 근방 영역 D에서 전계 E는 형성되지 않는다. 이와 같은 영역 D에서, 액정 분자 LM의 배향은 러빙 방향 S로부터 변화하지 않으므로, 액정층 LQ를 투과하는 광에 대한 변조율이 변화하지 않는다. 즉, 영역 D는 무효 영역으로 된다.On the other hand, in the region where the slit SL is not formed, particularly the peripheral edge of the pixel electrode EP, even if a potential difference is formed between the pixel electrode EP and the first common electrode COM1, the electric field E is not formed. As shown in FIG. 5B, for example, the electric field E is not formed in the region D near the signal line X of the pixel electrode EP. In such a region D, since the orientation of the liquid crystal molecules LM does not change from the rubbing direction S, the modulation rate for light passing through the liquid crystal layer LQ does not change. In other words, the area D becomes an invalid area.
이에 대해, 본 실시 형태의 액정 표시 장치는 화소 전극 EP의 슬릿 SL의 장축 L과 평행한 방향으로 연장되고 또한 화소 전극 EP에 인접하도록 배치된 제2 커먼 전극 COM2를 구비하고 있다. 이와 같은 제2 커먼 전극 COM2는, 층간 절연막 IL을 개재하여 화소 전극 EP와 대향하는 제1 커먼 전극 COM1과 전기적으로 접속되어 있다.In contrast, the liquid crystal display device of the present embodiment includes a second common electrode COM2 extending in a direction parallel to the major axis L of the slit SL of the pixel electrode EP and disposed adjacent to the pixel electrode EP. Such a second common electrode COM2 is electrically connected to the first common electrode COM1 facing the pixel electrode EP via the interlayer insulating film IL.
이 때문에, 화소 전극 EP와 제1 커먼 전극 COM1 사이에 전위차를 형성하였을 때에, 슬릿 SL이 형성되어 있지 않은 화소 전극 EP의 주연에서도, 화소 전극 EP와 제2 커먼 전극 COM2 사이에 전계 E가 형성된다. 이와 같은 슬릿이 형성되어 있지 않은 영역에 형성되는 전계 E는, 슬릿 SL을 통하여 화소 전극 EP와 제1 커먼 전극 COM1 사이에 형성되는 전계와 평행하다. 이 때문에, 전압 인가 시에서, 화소 전극 EP의 주연에서의 액정 분자 LM의 배향 방향은, 슬릿 SL이 형성된 영역에서의 액정 분자 LM의 배향 방향과 일치한다.For this reason, when the potential difference is formed between the pixel electrode EP and the first common electrode COM1, an electric field E is formed between the pixel electrode EP and the second common electrode COM2 even in the peripheral edge of the pixel electrode EP in which no slit SL is formed. . The electric field E formed in the region where such a slit is not formed is parallel to the electric field formed between the pixel electrode EP and the first common electrode COM1 via the slit SL. For this reason, at the time of voltage application, the orientation direction of the liquid crystal molecules LM at the periphery of the pixel electrode EP coincides with the orientation direction of the liquid crystal molecules LM in the region where the slit SL is formed.
이와 같이, 화소 전극 EP의 주연을 유효화하는 것이 가능해져, 비교예보다도 무효 영역 D의 폭을 작게 할 수 있다. 이에 의해, 액정 표시 패널 LPN의 개구율, 투과율을 향상시키는 것이 가능하게 된다.In this way, the peripheral edge of the pixel electrode EP can be made effective, and the width of the invalid region D can be made smaller than that of the comparative example. Thereby, it becomes possible to improve the aperture ratio and transmittance of the liquid crystal display panel LPN.
또한, 도 5a에 나타낸 비교예에서, 최대 전압을 인가하였을 때(즉 백색 화면을 표시할 때)의 투과율에 대해, 도 4a 및 도 4b에 나타낸 본 실시 형태에서, 동일 전압을 인가하였을 때의 투과율은 1.2배로 되어, 투과율의 향상을 확인할 수 있었다.In addition, in the comparative example shown in Fig. 5A, the transmittance when the same voltage is applied in the present embodiment shown in Figs. 4A and 4B with respect to the transmittance when the maximum voltage is applied (that is, when displaying a white screen). Became 1.2 times and the improvement of the transmittance | permeability was confirmed.
다음으로, 본 실시 형태의 변형예에 대해서 설명한다.Next, the modification of this embodiment is demonstrated.
이 변형예에서, 액정 표시 장치는, 본 실시 형태와 마찬가지로, 제2 커먼 전극 COM2를 구비하고 있다. 도 6a에 도시한 바와 같이, 화소 전극 EP의 슬릿 SL은, 그 장축 L이 열 방향 V와 평행해지도록 형성되어 있다. 제2 커먼 전극 COM2는, 슬릿 SL의 장축 L과 평행하게 연장되어 있다. 또한, 도 6b에 도시한 바와 같이, 제2 커먼 전극 COM2는, 전술한 실시 형태와 마찬가지로, 화소 전극 EP와 동일층에 형성되어 있다. 제2 커먼 전극 COM2는, 제2 절연막 ILb를 개재하여 신호선 X와 대향하도록 배치되어 있다.In this modification, the liquid crystal display device is equipped with the 2nd common electrode COM2 similarly to this embodiment. As shown in FIG. 6A, the slit SL of the pixel electrode EP is formed such that its major axis L is parallel to the column direction V. FIG. The second common electrode COM2 extends in parallel with the major axis L of the slit SL. As shown in FIG. 6B, the second common electrode COM2 is formed on the same layer as the pixel electrode EP as in the above-described embodiment. The second common electrode COM2 is disposed to face the signal line X via the second insulating film ILb.
또한, 변형예에서는, 도 6a 및 도 6b에 도시한 바와 같이, 제2 커먼 전극 COM2는, 복수의 개구 SP를 갖고 있다. 즉, 개구부 SP는 신호선 X와 대향하도록 형성되어 있다.In addition, in the modification, as shown to FIG. 6A and 6B, the 2nd common electrode COM2 has some opening SP. That is, the opening portion SP is formed to face the signal line X.
개구 SP에서, 신호선 X와 제2 커먼 전극 COM2 사이에 용량이 형성되어 있지 않는다. 즉, 개구 SP를 형성함으로써, 신호선 X와 제2 커먼 전극 COM2 사이에 생기는 용량이 작아진다. 이 때문에, 액정 표시 장치의 소비 전력의 증대를 억제하는 것이 가능하게 된다. 따라서, 이 변형예에서는 전압 인가 시에서의 액정 표시 패널 LPN의 개구율, 투과율을 향상하는 것이 가능하게 됨과 함께, 또한 액정 표시 장치의 소비 전력을 저하하는 것이 가능하게 된다.In the opening SP, no capacitor is formed between the signal line X and the second common electrode COM2. That is, by forming the opening SP, the capacitance generated between the signal line X and the second common electrode COM2 is reduced. For this reason, it becomes possible to suppress the increase of the power consumption of a liquid crystal display device. Therefore, in this modification, it becomes possible to improve the aperture ratio and transmittance of the liquid crystal display panel LPN at the time of voltage application, and also to reduce the power consumption of the liquid crystal display device.
이상 설명한 바와 같이, 이 실시 형태의 액정 표시 장치에 따르면, 투과율을 향상시킬 수 있어, 표시 품위의 양호한 화상을 표시하는 것이 가능하게 된다.As explained above, according to the liquid crystal display device of this embodiment, a transmittance | permeability can be improved and it becomes possible to display the favorable image of a display quality.
또한, 본 발명은, 상기 실시 형태 그것에 한정되는 것이 아니라, 그 실시 단계에서는 그 요지를 일탈하지 않는 범위에서 구성 요소를 변형하여 구체화할 수 있다. 또한, 상기 실시 형태에 개시되어 있는 복수의 구성 요소의 적절한 조합하기에 의해 다양한 발명을 형성할 수 있다. 예를 들면, 실시 형태에 개시되는 전체 구성 요소로부터 몇 개의 구성 요소를 삭제하여도 된다. 또한, 서로 다른 실시 형태에 걸친 구성 요소를 적절하게 조합하여도 된다.In addition, this invention is not limited to the said embodiment, In the implementation stage, a component can be modified and actualized in the range which does not deviate from the summary. In addition, various inventions can be formed by appropriate combination of a plurality of components disclosed in the above embodiments. For example, some components may be deleted from all the components disclosed in the embodiment. Moreover, you may combine suitably the component over different embodiment.
예를 들면, 전술한 실시 형태에서는 화소 전극 EP가 신호선 X와 평행한 슬릿 SL을 갖고, 이 슬릿 SL과 평행한 제2 커먼 전극 COM2를 신호선 X와 평행하게 배치하였지만, 화소 전극 EP가 주사선 Y와 평행한 슬릿 SL을 갖는 구성이면, 이 슬릿 SL과 평행한 제2 커먼 전극 COM2를 주사선 Y와 평행하게 배치하면, 화소 전극 EP의 주사선 Y에 대향하는 주연을 유효화할 수 있어, 전술한 실시 형태와 마찬가지의 효과를 기대할 수 있다.For example, in the above-described embodiment, the pixel electrode EP has a slit SL parallel to the signal line X, and the second common electrode COM2 parallel to the slit SL is disposed in parallel with the signal line X. However, the pixel electrode EP is aligned with the scan line Y. In the configuration having the parallel slit SL, when the second common electrode COM2 parallel to the slit SL is disposed in parallel with the scanning line Y, the peripheral edge facing the scanning line Y of the pixel electrode EP can be made effective, and the embodiment The same effect can be expected.
도 1은, 본 발명의 일 실시 형태에 따른 횡 전계를 이용한 액정 모드의 액정 표시 장치의 구성을 개략적으로 도시하는 도면.BRIEF DESCRIPTION OF THE DRAWINGS The figure which shows roughly the structure of the liquid crystal display device of the liquid crystal mode using the transverse electric field which concerns on one Embodiment of this invention.
도 2는, 도 1에 도시한 액정 표시 장치에 적용되는 어레이 기판의 구조를 개략적으로 도시하는 단면도.FIG. 2 is a cross-sectional view schematically showing the structure of an array substrate applied to the liquid crystal display shown in FIG. 1. FIG.
도 3은, 도 1에 도시한 액정 표시 장치에 적용되는 어레이 기판의 1화소의 구조를 개략적으로 도시하는 평면도.FIG. 3 is a plan view schematically showing the structure of one pixel of an array substrate applied to the liquid crystal display shown in FIG. 1; FIG.
도 4a는 본 실시 형태에서의 어레이 기판의 화소의 구조를 개략적으로 도시하는 평면도.4A is a plan view schematically showing the structure of a pixel of an array substrate in this embodiment;
도 4b는 도 4a에 도시한 어레이 기판을 A-B선에서 절단하였을 때의 어레이 기판의 단면 구조를 개략적으로 도시하는 도면.4B is a diagram schematically showing a cross-sectional structure of the array substrate when the array substrate shown in FIG. 4A is cut at line A-B.
도 4c는 도 4a에 도시한 어레이 기판을 C-D선에서 절단하였을 때의 액정 표시 패널의 단면 구조를 개략적으로 도시하는 도면.FIG. 4C is a diagram schematically showing a cross-sectional structure of a liquid crystal display panel when the array substrate shown in FIG. 4A is cut at the line C-D. FIG.
도 5a는 비교예에서의 어레이 기판의 화소의 구조를 개략적으로 도시하는 평면도.5A is a plan view schematically showing the structure of a pixel of an array substrate in a comparative example.
도 5b는 도 5a에 도시한 어레이 기판을 A-B선에서 절단하였을 때의 액정 표시 패널의 단면 구조를 개략적으로 도시하는 도면.FIG. 5B is a diagram schematically showing a cross-sectional structure of a liquid crystal display panel when the array substrate shown in FIG. 5A is cut at line A-B. FIG.
도 6a는 본 실시 형태의 변형예에서의 어레이 기판의 화소의 구조를 개략적으로 도시하는 평면도.6A is a plan view schematically illustrating the structure of a pixel of an array substrate in a modification of the present embodiment.
도 6b는 도 6a에 도시한 어레이 기판을 A-B선에서 절단하였을 때의 어레이 기판의 단면 구조를 개략적으로 도시하는 도면.FIG. 6B is a diagram schematically showing a cross-sectional structure of the array substrate when the array substrate shown in FIG. 6A is cut at line A-B. FIG.
<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>
20, 30 : 절연 기판20, 30: insulated substrate
32 : 블랙 매트릭스32: black matrix
34 : 컬러 필터층34: color filter layer
36a, 36b : 배향막36a, 36b: alignment film
XD : 신호선 드라이버XD: Signal Line Driver
CNT : 컨트롤러CNT: Controller
YD : 주사선 드라이버YD: Scan Line Driver
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