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KR20070108675A - 플라즈마 디스플레이 패널 - Google Patents

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KR20070108675A
KR20070108675A KR1020060041017A KR20060041017A KR20070108675A KR 20070108675 A KR20070108675 A KR 20070108675A KR 1020060041017 A KR1020060041017 A KR 1020060041017A KR 20060041017 A KR20060041017 A KR 20060041017A KR 20070108675 A KR20070108675 A KR 20070108675A
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KR
South Korea
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electrode
discharge
gap
display panel
plasma display
Prior art date
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Application number
KR1020060041017A
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English (en)
Inventor
이선홍
김도윤
Original Assignee
엘지전자 주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
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Priority to US11/797,715 priority patent/US20070257864A1/en
Priority to PCT/KR2007/002257 priority patent/WO2007129857A1/en
Priority to CN2007800007598A priority patent/CN101331577B/zh
Priority to EP07746410A priority patent/EP2016606A4/en
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Abstract

본 발명은 플라즈마 디스플레이 패널에 관한 것으로서, 제 1 전극과 제 2 전극 간 사이의 갭이 100um 이상인 경우 제 1 전극으로 셋업 신호가 인가되는 동안 제 3 전극으로 소정 신호를 인가함으로써, 리셋 기간동안 제 1 전극과 제 3 전극 사이에 발생되는 대향 방전을 방지하여, 휘점 제거 및 효율이 높아지는 효과가 있다.
투명 전극, 버스 전극, 방전 개시 전압

Description

플라즈마 디스플레이 패널{Plasma Display Panel}
도 1 은 종래 발명에 따른 플라즈마 디스플레이 패널의 일부 구성이 도시된 평면도,
도 2 는 본 발명에 따른 플라즈마 디스플레이 패널의 구성이 도시된 사시도,
도 3a 는 본 발명의 제 1 실시예에 따른 플라즈마 디스플레이 패널의 구성이 도시된 사시도,
도 3b 는 본 발명에 따른 플라즈마 디스플레이 패널의 일부 구성이 도시된 단면도,
도 4a 은 본 발명의 제 2 실시예에 따른 플라즈마 디스플레이 패널의 구성이 도시된 사시도,
도 4b 는 본 발명의 제 2 실시예에 따른 플라즈마 디스플레이 패널의 일부 구성이 도시된 단면도.
도 5 는 본 발명에 따른 플라즈마 디스플레이 패널의 일부 구성이 도시된 평면도,
도 6 는 본 발명에 따른 플라즈마 디스플레이 패널에 인가되는 구동신호가 도시된 타이밍도이다.
<도면의 주요 부분에 관한 부호의 설명>
10: 상부 기판 11: 제 1 전극
11a: 제 1 버스 전극 11b: 제 1 투명 전극
12: 제 2 전극 12a: 제 2 버스 전극
12b: 제 2 투명 전극 20: 하부 기판
21: 제 3 전극 T: 갭(Gap)
본 발명은 플라즈마 디스플레이 패널에 관한 것으로서, 제 1 전극과 제 2 전극 사이의 갭(Gap)이 100um 이상이면, 제 1 전극에 셋업 신호가 인가되는 리셋 기간 동안 제 3 전극으로 소정 신호를 인가하여, 제 1 전극과 제 3 전극 사이의 오방전을 방지하는 플라즈마 디스플레이 패널에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널(Plasma Display Panel, 이하 PDP라 한다)은 기체방전을 통하여 얻어진 플라즈마로부터 방사되는 진공 자외선(VUV)이 형광체를 여기 시킴으로서 발생되는 가시광을 이용하여 영상을 구현하는 디스플레이 장치이다.
현재 가장 널리 채택되고 있는 면 방전형 PDP는 상부 기판에 형성된 제 1 전극, 제 2 전극 및 하부 기판에 형성된 제 3 전극이 상호작용으로 방전셀 내부에서 플라즈마 방전을 일으키면서 화면을 구현하며, 이를 위해 하나의 프레임은 복수의 서브 필드로 분할하고, 각 서브 필드의 방전셀 내부의 상기 제 1 전극 및 상기 제 2 전극의 벽전하의 양을 증가시키고 하강시키는 리셋 기간, 상기 제 1 전극과 상기 제 3 전극 사이에 대향 방전이 일어나는 어드레스 기간, 상기 제 1 전극과 상기 제 2 전극 사이에 면 방전이 일어나는 서스테인 기간으로 구분하여 구동한다.
이때, 리셋 기간 동안 상기 제 1 전극에 점진적으로 상승하는 셋업 신호가 인가되어 상기 제 2 전극과 면방전이 약하게 발생하고, 방전셀 내부에 전하를 축적한다.
도 1 은 리셋 기간 동안 이러한 면 방전을 일으키는 제 1 전극 및 제 2 전극의 배치에 관한 도면이다.
도 1 에 도시된 바와 같이, 상부기판(1)에 형성된 각 제 1 전극(2) 및 제 2 전극(3)은 제 1, 제 2 버스 전극(2a, 3a) 및 제 1 , 제 2 투명 전극(2b, 3b)으로 구성되고, 제 1 투명 전극(2b)과 제 2 투명 전극(2b, 3b)은 소정의 갭(T)을 두고 형성된다.
최근, 제 1 전극(2)과 제 2 전극(3) 간 갭(T)을 충분히 크게 형성하여, 서스테인 방전을 유도하는바, 이는 소비 전력을 낮추고 휘도를 높이기 위한 구조이다.
즉, 충분히 크게 형성되는 갭(T)은 저전압으로 롱갭 방전을 일으켜 휘도를 높임과 아울러 전극 면적을 줄임으로써, 소비 전력을 낮추어 효율을 향상시킬 수 있다.
그러나, 상기와 같은 종래 발명의 플라즈마 디스플레이 패널은 도 1 에 도시된 바와 같이, 제 1 전극과 제 2 전극이 롱갭 방전을 하는 경우의 문제점을 살펴보면 다음과 같다.
리셋 기간 중 제 1 전극으로 셋업 신호가 인가되는 경우, 도시된 바와 같이 제 1 전극 및 제 2 전극이 롱갭을 가지도록 배치되는 경우, 방전 개시 전압이 상승하여 제 1 전극과 제 2 전극 사이의 면방전 보다 제 1 전극과 제 3 전극 사이에 대향 방전이 발생되는 문제점이 있다.
본 발명은 상기한 종래 기술의 문제점을 해결하기 위하여 안출된 것으로서, 제 1 전극과 제 2 전극 사이의 갭(Gap)이 100um 이상의 롱 갭(Long Gap) 인 경우에, 제 1 전극에 셋업 신호를 인가하는 동안 제 3 전극으로 정극성의 소정 신호를 인가함으로써, 리셋 기간 동안 제 1 전극과 제 3 전극 간의 원치않는 오방전을 방지하는 플라즈마 디스플레이 패널을 제공하는데 그 목적이 있다.
상기한 과제를 해결하기 위한 본 발명에 따른 플라즈마 디스플레이 패널은 복수의 제 1 전극 및 제 2 전극이 형성되는 상부 기판과, 복수의 제 3 전극이 형성 되는 하부 기판을 포함하고, 상기 제 1 전극 및 상기 제 2 전극 사이는 100um 이상의 갭(Gap)을 가지며, 상기 제 1 전극에 셋업 신호가 인가되는 동안 제 3 전극으로 소정 신호가 인가되는 것을 특징으로 한다.
이항, 첨부된 도면을 참조하여 본 발명이 실시예를 설명하면 다음과 같다.
도 2 는 본 발명의 제 1 실시예에 따른 플라즈마 디스플레이 패널의 구성이 도시된 사시도이다.
도 2 에 도시된 바와 같이, 플라즈마 디스플레이 패널은 상부 기판(10)과 하부 기판(20)으로 구성된다.
이때, 상부 기판(10)에는 제 1 전극(11) 및 제 2 전극(12)이 형성되고, 제 1 전극(11) 및 제 2 전극(12)에 인접하여 제 1 유전체층(13)이 적층된다. 또한, 제 1 유전체층(13)을 보호하기 위한 유전체 보호층(14)이 포함될 수 있다.
또한, 하부 기판(20)에는 상부 기판(10)에 형성된 제 1 전극(11) 및 제 2 전극(12)과 대향되는 제 3 전극(21) 및 제 2 유전체층(22)이 형성된다.
그리고, 방전셀을 구획하는 격벽(23), 상기 방전셀 내부에는 방전 시 자외선에 의해 여기되어 가시광을 방출하는 형광체(24)가 도포된다.
또한, 상기와 같이 구성된 플라즈마 디스플레이 패널은 제 1 전극(11), 제 2 전극(12) 및 제 3 전극(21)으로 반대 극성을 가지는 전압을 인가하여 방전이 발생될 셀을 선택하고, 제 1 전극(11) 및 제 2 전극(12)으로 전압을 교번적으로 인가하여 방전을 발생시킨다.
따라서, 방전에 의하여 진공 자외선(VUV)이 발생되면, 상기 진공 자외선(VUV)은 상기 방전 공간 내부에 도포 된 형광체(24)를 여기/발광시켜 가시광선이 발생되어 사용자들에게 화면을 통해서 영상을 보여주게 된다.
또한, 제 1 전극(11)은 제 1 버스 전극(11a)과 제 1 투명 전극(11b)으로 형성되며, 제 2 전극(12)은 제 2 버스 전극(12a)과 제 2 투명 전극(12b)로 형성된다.
여기서, 제 1 , 제 2 투명 전극(11b, 12b)은 ITO(Indium Tin Oxide)로 형성되어 우수한 도전성과 높은 투과도를 가진다.
또한, 제 1 , 제 2 투명 전극(11b, 12b) 사이는 최단 거리가 100um 이상으로 이격되어 있으며, 이와 같이 100um 이상으로 이격 된 거리(갭)를 롱갭 이라 하겠다
또한, 제 1 , 제 2 버스 전극(11a, 12a)는 제 1 , 제 2 투명 전극(11b, 12b)의 큰 저항을 보상하기 위해 형성된다.
여기서, 제 1 전극(11) 및 제 2 전극(12)는 각각 제 1, 제 2 버스 전극(11a, 12a) 및 제 1 , 제 2 투명 전극(11b, 12b)으로 구성되어 있지만, 제 1 , 제 2 버스 전극(11a, 12a) 만으로 구성될 수 있으며 이때, 제 1 , 제 2 버스 전극(11a, 12a) 사이의 갭이 100um 이상 인 경우도 롱갭이라 하겠다.
이때, 일반적으로 금속 물질로 제작되는 제 1 , 제 2 버스 전극(11a, 12a)은 방전에 의한 빚은 투과하지 못하고, 외부의 빛에 대해서는 반사를 하는 것으로 알려져 있어 콘트라스트를 나쁘게 하는 문제가 있다. 이러한 문제를 해결하기 위해, 격벽(23)을 중심으로 이웃한 제 1 , 제 2 전극(11, 12)의 제 1 ,제 2 버스 전극(11a, 12a)와 제 1 , 제 2 투명 전극(11b, 12b) 사이에는 상부 기판(10)의 외부 에서 발생하는 외부광을 흡수하여 반사를 줄여주는 광차단의 기능과 상부 기판(10)의 퓨리티 및 콘트라스트를 향상시키는 기능을 하는 블랙 매트릭스(Black Matrix, 미도시)가 배열된다.
도 3a 는 도 2에 도시된 플라즈마 디스플레이 패널의 단면도로써 블랙 매트릭스가 포함된 도이고, 도 3b 는 도 2a 를 간략화한 도이다.
블랙 매트릭스(16)는 일반적으로 제 1 , 제 2 버스 전극(11a, 12a)이 일체화되어 형성되는데 이를 일체형 BM으로 정의한다.
도 4a 은 본 발명의 제 2 실시예에 따른 플라즈마 디스플레이 패널의 구성이 도시된 사시도이고, 도 3b 는 본 발명의 제 2 실시예에 따른 플라즈마 디스플레이 패널의 일부 구성이 도시된 단면도이다.
도 4a 및 도 4b 는 인버스 구조 및 분리형 BM 구조를 도시한 도로써, 도 2, 도 3a 및 도 3b 에서 설명한 부분은 생략하며, 일부 구성요소에 대해서는 같은 도면 부호를 사용하는 바를 상술한다.
도 4a 및 도 4b 에 도시된 바와 같이, 상부 기판(10)에 형성되는 블랙 매트릭스(16)는 제 1 , 제 2 투명 전극(11b, 12b)과 제 1 , 제 2 버스 전극(11a, 12a) 사이에 형성되는 제 1 블랙 매트릭스(16a)와, 격벽(23)과 중첩되는 위치에 형성되는 제 2 블랙 매트릭스(16b)로 구성된다.
이때, 제 1 , 제 2 블랙 매트릭스(16a, 16b)로 분리되어 형성되는 블랙 매트 릭스(16)를 분리형 BM이라 정의하며, 이는 도 2a 및 도 2b 에 도시된 하나의 블랙 매트릭스로 형성되는 일체형 BM과 비교된다.
여기서, 제 1 블랙 매트릭스(16a)는 전극 사이에 층을 이루어 형성되기 때문에 블랙층 또는 블랙 전극층이라고 한다.
상기 분리형 BM은 분리된 제 1, 제 2 블랙 매트릭스(16a, 16b) 사이로 방전에 의해 생성된 빛이 패널 외부로 발산 가능하여 휘도를 증가하게 한다.
도 5 는 제 1 전극(11)과 제 2 전극(12)을 평면도로 간략하게 도시하는 바, 제 1, 제 2 투명 전극(11b,12b)으로 형성되며, 제 1 투명 전극(11b)와 제 2 투명 전극(12b) 사이의 갭(Gap, T)이 100um 이상 이격되어 형성된다.
여기서, 제 1 , 제 2 투명 전극(11b, 12b)는 대향되도록 형성되며, 갭(T)은 제 1, 제 2 투명 전극(11b, 12b)의 최단 거리이다.
물론, 도 5 에 도시된 바와 제 1 전극(11) 및 제 2 전극(12)은 직사각형인 것을 예시하였으나, 이에 한정되지 않고 다른 모양으로 형성될 수 있다.
여기서, 도 6 에 도시된 바, 리셋 기간(R) 동안 제 1 전극(11)에는 점진적으로 상승하는 셋업 신호 및 점진적으로 하강하는 셋다운 신호가 공급된다.
즉, 제 1 전극(11)은 상기 셋업 신호가 인가됨에 따라 방전셀 내부에는 벽전하가 서서히 증가하게 된다.
여기서, 상기 셋업 신호는 초기 그라운드 레벨부터 제 1 전압까지 급격히 상 승하고 유지되며, 상기 제 1 전압부터 제 2 전압까지 점진적으로 상승하고 유지된다. 이때, 상기 셋다운 신호는 상기 제 2 전압에서 급격히 하락 한 후, 점진적으로 하강하는 신호이다.
이때, 제 1 전극(11)은 생성된 벽전하를 축적하며 제 2 전극(12)과 약한 면방전을 일으키게 된다.
여기서, 제 3 전극(21)는 상기 셋업 신호가 인가되는 동안 소정 신호가 인가되어, 제 1 전극(11)과 제 3 전극(21) 사이에 대향 방전이 일어나지 않는다.
즉, 제 3 전극(21)은 제 1 전극(11)에 공급되는 상기 셋업 신호와 같은 정극성의 소정 신호가 인가됨으로써, 벽전하를 밀어내는 현상이 생겨 대향 방전이 일어나지 않는다.
따라서, 제 1 전극(11)은 제 2 전극(12)과 약하게 면방전을 일으켜 방전셀 내부에 벽전하를 증가하게 된다. 그에 따라 제 1 전극(11)과 제 2 전극(12)의 방전 개시 전압이 높아지더라도, 제 1 전극(11)과 제 3 전극(21) 사이의 대향 방전이 일어나지 않는다.
다시 말해, 제 1 전극(11)과 제 2 전극(12) 사이의 갭이 100um 이상이면, 방전 개시 전압도 상승하게 되므로, 제 3 전극(21)으로 상기 소정 신호를 인가하여, 제 1 전극(11)과 제 3 전극(21)은 같은 극성의 전하가 생겨 대향 방전이 일어나지 않게 되고, 제 1 전극(11)과 제 2 전극(12)은 약한 면방전이 안정적으로 된다.
따라서, 제 1 전극(11)과 제 3 전극(21) 사이에 대향 방전에 의한 오방전이 방지된다.
상기와 같이 구성된 플라즈마 디스플레이 패널은 제 1 전극과 제 2 전극 간 사이의 최단 거리 갭이 100um 이상인 경우, 제 1 전극으로 셋업 신호가 인가되는 동안 제 3 전극으로 소정 신호가 인가됨으로써, 제 1 전극과 제 3 전극 사이에 대향 방전으로 인한 오방전을 방지하고, 제 1 전극과 제 2 전극 사이에 면방전이 쉽게 일어나도록 하여 고효율의 방전이 발생되도록 한다.
이상과 같이 본 발명에 따른 플라즈마 디스플레이 패널을 예시된 도면을 참조로 설명하였으나, 본 명세서에 개시된 실시예와 도명에 의해 본 발명은 한정되지 않고, 본 발명의 기술상 보호되는 범위 이내에서 당업자에 의해 응용이 가능하다.
상기와 같이 구성되는 본 발명에 따른 플라즈마 디스플레이 패널은 제 1 전극과 제 2 전극 간 사이의 최단 거리 갭이 100um 인 경우, 제 1 전극에 셋업 신호가 인가되는 동안 제 3 전극으로 소정 신호를 인가함으로써, 제 1 전극과 제 3 전극간의 대향 방전에 의한 오방전을 방지하고, 제 1 전극과 제 2 전극 사이에 면방전이 쉽게 발생되도록 하여 휘점 제거 및 효율을 높이는 효과가 있다.

Claims (6)

  1. 복수의 제 1 전극 및 제 2 전극이 형성되는 상부 기판과, 복수의 제 3 전극이 형성되는 하부 기판을 포함하고,
    상기 제 1 전극 및 상기 제 2 전극 사이는 100um 이상의 갭(Gap)을 가지며, 상기 제 1 전극에 셋업 신호가 인가되는 동안 제 3 전극으로 소정 신호가 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  2. 제 1 항에 있어서,
    상기 갭(Gap)은 상기 제 1 전극과 상기 제 2 전극 사이의 최단 거리인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  3. 제 2 항에 있어서,
    상기 제 1 전극 및 상기 제 2 전극은 각각 투명 전극 및 금속 전극으로 구성되고,
    상기 갭(Gap)은 투명 전극 사이의 거리인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  4. 제 2 에 있어서,
    상기 제 1 전극 및 상기 제 2 전극은 금속 전극으로 구성되고,
    상기 갭(Gap)은 금속 전극 사이의 거리인 것을 특징으로 하는 플라즈마 디스플레이 패널.
  5. 제 1 항에 있어서,
    상기 셋업 신호는 그라운드 레벨부터 제 1 전압까지 급격히 상승하는 제 1 신호와, 상기 제 1 전압부터 제 2 전압까지 점진적으로 상승하는 제 2 신호로 이루어지며,
    상기 소정 신호는 상기 제 2 신호가 인가되는 동안 인가되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  6. 제 1 항에 있어서,
    상기 소정 신호는 정극성 전압 레벨인 것을 특징으로 하는 플라즈마 디스플레이 패널.
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