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KR102637057B1 - 디스플레이 장치 - Google Patents

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KR102637057B1
KR102637057B1 KR1020190117722A KR20190117722A KR102637057B1 KR 102637057 B1 KR102637057 B1 KR 102637057B1 KR 1020190117722 A KR1020190117722 A KR 1020190117722A KR 20190117722 A KR20190117722 A KR 20190117722A KR 102637057 B1 KR102637057 B1 KR 102637057B1
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이정규
임진호
조보은
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엘지디스플레이 주식회사
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Abstract

본 발명의 실시예들은, 디스플레이 장치에 관한 것으로서, 디스플레이 패널의 액티브 영역에 카메라 센서 등이 배치되는 홀 영역이 포함된 구조에서, 홀 영역을 우회하며 배치되는 데이터 라인 중 녹색 서브픽셀을 구동하는 데이터 라인이 배치되는 층을 조절하여 녹색 서브픽셀을 구동하는 데이터 라인의 로드 증가를 방지할 수 있는 구조를 제공한다. 따라서, 홀 영역의 주변에서 홀 영역을 우회하며 배치된 데이터 라인에 의해 구동되는 서브픽셀이 나타내는 휘도 저하를 방지하며, 홀 영역의 주변에서 나타나는 휘도의 균일도를 개선할 수 있다.

Description

디스플레이 장치{DISPLAY DEVICE}
본 발명의 실시예들은, 디스플레이 장치에 관한 것이다.
정보화 사회가 발전함에 따라, 화상을 표시하는 디스플레이 장치에 대한 요구가 증가하고 있으며, 액정 디스플레이 장치, 유기발광 디스플레이 장치 등과 같은 다양한 유형의 디스플레이 장치가 활용된다.
디스플레이 장치는, 다수의 서브픽셀이 배치되며 영상을 표시하는 디스플레이 패널과, 디스플레이 패널에 배치된 서브픽셀을 구동하기 위한 각종 구동 회로를 포함할 수 있다.
또한, 디스플레이 장치는, 영상을 표시하는 기능 이외에 디스플레이 패널에 접근하는 물체를 감지하고 감지 정보를 기반으로 입력 처리를 수행하거나, 디스플레이 패널에 접근한 물체를 촬영하고 촬영된 영상이나 이미지를 디스플레이 패널을 통해 표시하는 기능을 제공할 수 있다.
따라서, 디스플레이 장치는, 요구되는 기능에 따라 근접 센서나 카메라 센서 등과 같은 센서를 포함할 수 있다. 그리고, 이러한 센서는, 일 예로, 디스플레이 패널에서 영상이 표시되지 않는 베젤 영역에 배치될 수 있다.
또는, 경우에 따라, 디스플레이 패널의 베젤 영역의 증가를 방지하기 위하여, 디스플레이 패널에서 영상이 표시되는 액티브 영역 내의 일부 영역에 카메라 센서 등이 위치할 수 있다.
이러한 경우, 디스플레이 구동을 위한 신호 라인과 서브픽셀 등이 배치된 액티브 영역 내에 센서 배치를 위한 영역이 존재함에 따라, 센서 영역으로 인해 디스플레이 구동을 위한 구성의 배치가 어려운 문제점이 존재한다.
또한, 센서 영역의 배치로 인해 센서 영역의 주변에 배치되는 신호 라인과 서브픽셀 등의 구조가 액티브 영역 내의 다른 영역과 다르게 형성될 수 있어, 액티브 영역에 센서를 배치함에 따라 디스플레이 품질이 저하될 수 있는 문제점이 존재한다.
본 발명의 실시예들은, 디스플레이 패널의 액티브 영역에 센서가 배치된 영역을 포함하면서 센서가 배치된 영역의 주변에 배치된 서브픽셀을 구동할 수 있는 신호 라인의 배치 구조를 제공한다.
본 발명의 실시예들은, 액티브 영역에서 센서가 배치된 영역의 주변에 위치하는 서브픽셀에서 표시되는 영상의 균일도를 개선할 수 있는 방안을 제공한다.
일 측면에서, 본 발명의 실시예들은, 다수의 게이트 라인, 다수의 데이터 라인 및 다수의 서브픽셀이 배치된 디스플레이 패널과, 디스플레이 패널의 액티브 영역에 위치하는 적어도 하나의 홀 영역과, 홀 영역의 외곽과 접하며 배치된 경계 영역을 포함하는 디스플레이 장치를 제공한다.
이러한 디스플레이 장치에 포함된 다수의 데이터 라인은, 다수의 서브픽셀 중 제1 컬러 서브픽셀로 데이터 전압을 공급하고 일부분이 경계 영역에 배치된 다수의 제1 데이터 라인과, 다수의 서브픽셀 중 제2 컬러 서브픽셀로 데이터 전압을 공급하고 일부분이 경계 영역에 배치되며 제1 데이터 라인이 배치된 층과 다른 층에 배치된 다수의 제2 데이터 라인을 포함할 수 있다.
그리고, 게이트 라인은 데이터 라인이 배치된 층과 다른 층에 배치될 수 있으며, 제1 데이터 라인과 게이트 라인 사이의 수직 거리보다 제2 데이터 라인과 게이트 라인 사이의 수직 거리가 클 수 있다.
여기서, 제1 데이터 라인은 적색 서브픽셀과 청색 서브픽셀로 데이터 전압을 공급할 수 있고, 제2 데이터 라인은 녹색 서브픽셀로 데이터 전압을 공급할 수 있다.
다른 측면에서, 본 발명의 실시예들은, 액티브 영역에 배치된 적어도 하나의 홀 영역과, 홀 영역의 외곽과 접하며 배치된 경계 영역과, 일부분이 경계 영역에 배치되고 일부분의 적어도 일부는 만곡된 형태인 다수의 데이터 라인을 포함하고, 다수의 데이터 라인 중 인접하게 배치된 두 개의 데이터 라인은 서로 다른 층에 배치된 디스플레이 장치를 제공한다.
본 발명의 실시예들에 의하면, 디스플레이 패널의 액티브 영역에서 카메라 센서 등이 배치되는 홀 영역의 주변에 경계 영역을 배치하고, 디스플레이 구동을 위한 신호 라인이 경계 영역에 배치되도록 함으로써, 홀 영역의 주변에 위치하는 서브픽셀을 구동하는 신호 라인의 배치 구조를 제공할 수 있다.
또한, 홀 영역의 주변에 위치하는 경계 영역에 배치되는 데이터 라인이 구동하는 서브픽셀에 따라 데이터 라인이 배치되는 층을 다르게 함으로써, 경계 영역에 배치되는 데이터 라인의 길이 증가로 인한 로드 증가를 저감시킬 수 있다.
따라서, 홀 영역의 주변에 위치하는 서브픽셀을 구동하는 데이터 라인의 로드 증가로 인한 휘도 저하를 방지하며, 홀 영역의 주변에서 표시되는 영상의 균일도를 개선할 수 있다.
도 1은 본 발명의 실시예들에 따른 디스플레이 장치의 개략적인 구성을 나타낸 도면이다.
도 2는 본 발명의 실시예들에 따른 디스플레이 장치에 포함된 서브픽셀의 회로 구조와 구동 타이밍의 예시를 나타낸 도면이다.
도 3은 본 발명의 실시예들에 따른 디스플레이 장치의 액티브 영역에 홀 영역이 배치된 구조의 예시를 나타낸 도면이다.
도 4는 본 발명의 실시예들에 따른 디스플레이 장치의 액티브 영역에 배치된 홀 영역의 주변에 위치하는 경계 영역에 신호 라인이 배치된 구조의 예시를 나타낸 도면이다.
도 5는 본 발명의 실시예들에 따른 디스플레이 장치의 액티브 영역에 배치된 홀 영역의 주변에 위치하는 경계 영역에 신호 라인이 배치된 구조의 다른 예시를 나타낸 도면이다.
도 6은 본 발명의 실시예들에 따른 디스플레이 장치의 액티브 영역에서 홀 영역의 주변에 위치하는 서브픽셀을 구동하는 데이터 라인의 배치 구조의 예시를 나타낸 도면이다.
도 7은 본 발명의 실시예들에 따른 디스플레이 장치의 액티브 영역에 배치된 홀 영역의 주변에 위치하는 경계 영역에 데이터 라인이 배치된 구조의 또 다른 예시를 나타낸 도면이다.
도 8은 도 7에 도시된 홀 영역의 주변에 위치하는 경계 영역의 외측과 내측에 데이터 라인이 배치된 구조의 예시를 나타낸 도면이다.
도 9는 도 7에 도시된 두 개의 홀 영역 사이에 위치하는 경계 영역에 데이터 라인이 배치된 구조의 예시를 나타낸 도면이다.
도 10과 도 11은 도 7에 도시된 데이터 라인의 배치 구조에 의해 액티브 영역의 휘도 균일도가 개선된 예시를 나타낸 도면이다.
이하, 본 발명의 일부 실시예들을 예시적인 도면을 참조하여 상세하게 설명한다. 각 도면의 구성 요소들에 참조부호를 부가함에 있어서, 동일한 구성 요소들에 대해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 부호를 가질 수 있다. 또한, 본 발명을 설명함에 있어, 관련된 공지 구성 또는 기능에 대한 구체적인 설명이 본 발명의 요지를 흐릴 수 있다고 판단되는 경우에는 그 상세한 설명은 생략할 수 있다. 본 명세서 상에서 언급된 "포함한다", "갖는다", "이루어진다" 등이 사용되는 경우 "~만"이 사용되지 않는 이상 다른 부분이 추가될 수 있다. 구성 요소를 단수로 표현한 경우에 특별한 명시적인 기재 사항이 없는 한 복수를 포함하는 경우를 포함할 수 있다.
또한, 본 발명의 구성 요소를 설명하는 데 있어서, 제1, 제2, A, B, (a), (b) 등의 용어를 사용할 수 있다. 이러한 용어는 그 구성 요소를 다른 구성 요소와 구별하기 위한 것일 뿐, 그 용어에 의해 해당 구성 요소의 본질, 차례, 순서 또는 개수 등이 한정되지 않는다.
구성 요소들의 위치 관계에 대한 설명에 있어서, 둘 이상의 구성 요소가 "연결", "결합" 또는 "접속" 등이 된다고 기재된 경우, 둘 이상의 구성 요소가 직접적으로 "연결", "결합" 또는 "접속" 될 수 있지만, 둘 이상의 구성 요소와 다른 구성 요소가 더 "개재"되어 "연결", "결합" 또는 "접속"될 수도 있다고 이해되어야 할 것이다. 여기서, 다른 구성 요소는 서로 "연결", "결합" 또는 "접속" 되는 둘 이상의 구성 요소 중 하나 이상에 포함될 수도 있다.
구성 요소들의 시간 관계 또는 흐름 관계에 대한 설명에 있어서, 예를 들어, "~후에", "~에 이어서", "~다음에", "~전에" 등으로 시간적 선후 관계 또는 흐름적 선후 관계가 설명되는 경우, "바로" 또는 "직접"이 사용되지 않는 이상 연속적이지 않은 경우도 포함할 수 있다.
한편, 구성 요소에 대한 수치 또는 그 대응 정보(예: 레벨 등)가 언급된 경우, 별도의 명시적 기재가 없더라도, 수치 또는 그 대응 정보는 각종 요인(예: 공정상의 요인, 내부 또는 외부 충격, 노이즈 등)에 의해 발생할 수 있는 오차 범위를 포함하는 것으로 해석될 수 있다.
도 1은 본 발명의 실시예들에 따른 디스플레이 장치(100)의 개략적인 구성을 나타낸 도면이다.
도 1을 참조하면, 본 발명의 실시예들에 따른 디스플레이 장치(100)는, 다수의 서브픽셀(SP)이 배열된 디스플레이 패널(110)과, 디스플레이 패널(110)을 구동하기 위한 게이트 구동 회로(120), 데이터 구동 회로(130) 및 컨트롤러(140) 등을 포함할 수 있다.
디스플레이 패널(110)은, 다수의 서브픽셀(SP)이 배치되며 영상을 표시하는 액티브 영역(A/A)과, 액티브 영역(A/A)의 외측에 위치하며 신호 라인 등이 배치되는 논-액티브 영역(N/A)을 포함할 수 있다.
디스플레이 패널(110)의 액티브 영역(A/A)에는 다수의 게이트 라인(GL)과 다수의 데이터 라인(DL)이 배치되고, 게이트 라인(GL)과 데이터 라인(DL)이 교차하는 영역에 서브픽셀(SP)이 배치될 수 있다.
이러한 서브픽셀(SP)은 각각 발광 소자(ED)를 포함할 수 있으며, 둘 이상의 서브픽셀(SP)이 하나의 픽셀을 구성할 수 있다.
게이트 구동 회로(120)는, 컨트롤러(140)에 의해 제어되며, 디스플레이 패널(110)에 배치된 다수의 게이트 라인(GL)으로 스캔 신호를 순차적으로 출력하여 다수의 서브픽셀(SP)의 구동 타이밍을 제어한다.
게이트 구동 회로(120)는, 하나 이상의 게이트 드라이버 집적 회로(GDIC: Gate Driver Integrated Circuit)를 포함할 수 있으며, 구동 방식에 따라 디스플레이 패널(110)의 일 측에만 위치할 수도 있고 양 측에 위치할 수도 있다.
데이터 구동 회로(130)는, 컨트롤러(140)로부터 영상 데이터를 수신하고, 영상 데이터를 아날로그 형태의 데이터 전압(Vdata)으로 변환한다. 그리고, 게이트 라인(GL)을 통해 스캔 신호가 인가되는 타이밍에 맞춰 데이터 전압(Vdata)을 각각의 데이터 라인(DL)으로 출력하여 각각의 서브픽셀(SP)이 영상 데이터에 따른 밝기를 표현하도록 한다.
데이터 구동 회로(130)는, 하나 이상의 소스 드라이버 집적 회로(SDIC: Source Driver Integrated Circuit)를 포함할 수 있다.
컨트롤러(140)는, 게이트 구동 회로(120)와 데이터 구동 회로(130)로 각종 제어 신호를 공급하며, 게이트 구동 회로(120)와 데이터 구동 회로(130)의 동작을 제어한다.
컨트롤러(140)는, 각 프레임에서 구현하는 타이밍에 따라 게이트 구동 회로(120)가 스캔 신호를 출력하도록 하며, 외부에서 수신한 영상 데이터를 데이터 구동 회로(130)에서 사용하는 데이터 신호 형식에 맞게 변환하여 변환된 영상 데이터를 데이터 구동 회로(130)로 출력한다.
컨트롤러(140)는, 영상 데이터와 함께 수직 동기 신호(Vsync), 수평 동기 신호(Hsync), 입력 데이터 인에이블 신호(DE: Data Enable), 클럭 신호(CLK) 등을 포함하는 각종 타이밍 신호를 외부(예: 호스트 시스템)로부터 수신한다.
컨트롤러(140)는, 외부로부터 수신한 각종 타이밍 신호를 이용하여 각종 제어 신호를 생성하고 게이트 구동 회로(120) 및 데이터 구동 회로(130)로 출력할 수 있다.
일 예로, 컨트롤러(140)는, 게이트 구동 회로(120)를 제어하기 위하여, 게이트 스타트 펄스(GSP: Gate Start Pulse), 게이트 시프트 클럭(GSC: Gate Shift Clock), 게이트 출력 인에이블 신호(GOE: Gate Output Enable) 등을 포함하는 각종 게이트 제어 신호(GCS)를 출력한다.
여기서, 게이트 스타트 펄스(GSP)는 게이트 구동 회로(120)를 구성하는 하나 이상의 게이트 드라이버 집적 회로(GDIC)의 동작 스타트 타이밍을 제어한다. 게이트 시프트 클럭(GSC)은 하나 이상의 게이트 드라이버 집적 회로(GDIC)에 공통으로 입력되는 클럭 신호로서, 스캔 신호의 시프트 타이밍을 제어한다. 게이트 출력 인에이블 신호(GOE)는 하나 이상의 게이트 드라이버 집적 회로(GDIC)의 타이밍 정보를 지정하고 있다.
또한, 컨트롤러(140)는, 데이터 구동 회로(130)를 제어하기 위하여, 소스 스타트 펄스(SSP: Source Start Pulse), 소스 샘플링 클럭(SSC: Source Sampling Clock), 소스 출력 인에이블 신호(SOE: Source Output Enable) 등을 포함하는 각종 데이터 제어 신호(DCS)를 출력한다.
여기서, 소스 스타트 펄스(SSP)는 데이터 구동 회로(130)를 구성하는 하나 이상의 소스 드라이버 집적 회로(SDIC)의 데이터 샘플링 스타트 타이밍을 제어한다. 소스 샘플링 클럭(SSC)은 소스 드라이버 집적 회로(SDIC) 각각에서 데이터의 샘플링 타이밍을 제어하는 클럭 신호이다. 소스 출력 인에이블 신호(SOE)는 데이터 구동 회로(130)의 출력 타이밍을 제어한다.
이러한 디스플레이 장치(100)는, 디스플레이 패널(110), 게이트 구동 회로(120), 데이터 구동 회로(130) 등으로 각종 전압 또는 전류를 공급해주거나, 공급할 각종 전압 또는 전류를 제어하는 전원 관리 집적 회로를 더 포함할 수 있다.
디스플레이 패널(110)에는, 게이트 라인(GL)과 데이터 라인(DL) 이외에 각종 신호나 전압이 공급되는 전압 라인이 배치될 수 있으며, 각각의 서브픽셀(SP)에는 발광 소자(ED)와 이를 구동하기 위한 트랜지스터 등이 배치될 수 있다.
도 2는 본 발명의 실시예들에 따른 디스플레이 장치(100)에 포함된 서브픽셀(SP)의 회로 구조와 구동 타이밍의 예시를 나타낸 도면이다.
도 2를 참조하면, 디스플레이 패널(110)에 배치된 서브픽셀(SP)에 발광 소자(ED)가 배치되고, 발광 소자(ED)에 흐르는 전류 제어를 통해 발광 소자(ED)를 구동하는 구동 트랜지스터(DRT)가 배치될 수 있다.
서브픽셀(SP)에 배치된 발광 소자(ED)는, 유기발광다이오드(OLED)일 수 있으나, 경우에 따라, 발광다이오드(LED)나 마이크로 발광다이오드(μLED) 등일 수도 있다.
그리고, 서브픽셀(SP)에 구동 트랜지스터(DRT) 이외에 적어도 하나 이상의 트랜지스터가 배치될 수 있으며, 구동 트랜지스터(DRT)의 게이트 노드의 전압을 한 프레임 동안 유지시켜주기 위한 스토리지 캐패시터(Cstg) 등이 배치될 수 있다.
도 2는, 구동 트랜지스터(DRT)를 포함한 7개의 트랜지스터와, 1개의 스토리지 캐패시터(Cstg)가 서브픽셀(SP)에 배치된 7T1C 구조를 예시로 나타내나, 본 발명의 실시예들에 따른 디스플레이 장치(100)에 포함된 서브픽셀(SP)의 구조는 이에 한정되지 아니한다. 또한, 도 2는 서브픽셀(SP)이 PMOS 형태의 트랜지스터로 구성된 경우를 예시로 나타내나, 서브픽셀(SP)에 배치된 트랜지스터 중 적어도 일부는 NMOS 형태로 구성될 수도 있다.
발광 소자(ED)는, 구동 트랜지스터(DRT)와 전기적으로 연결된 애노드 전극과, 기저 전압(Vss)이 공급되는 캐소드 전극을 포함할 수 있다.
구동 트랜지스터(DRT)는, 구동 전압(Vdd)이 인가되는 구동 전압 라인(DVL)과 발광 소자(ED) 사이에 전기적으로 연결될 수 있다. 또한, 구동 트랜지스터(DRT)는, 데이터 전압(Vdata)이 인가되는 데이터 라인(DL)과 전기적으로 연결될 수 있다. 그리고, 구동 트랜지스터(DRT)의 게이트 노드는 스토리지 캐패시터(Cstg) 및 초기화 전압 라인(IVL)과 전기적으로 연결될 수 있다.
제1 트랜지스터(T1)는, 스캔 신호 SCAN(N)에 의해 제어되고, 구동 트랜지스터(DRT)의 제1 노드(N1)와 제2 노드(N2) 사이에 전기적으로 연결될 수 있다. 제1 트랜지스터(T1)는, 데이터 전압(Vdata)에 구동 트랜지스터(DRT)의 문턱 전압(Vth)이 보상된 전압이 구동 트랜지스터(DRT)의 게이트 노드에 인가되도록 제어할 수 있다.
제2 트랜지스터(T2)는, 스캔 신호 SCAN(N-1)에 의해 제어되고, 구동 트랜지스터(DRT)의 제1 노드(N1)와 초기화 전압 라인(IVL) 사이에 전기적으로 연결될 수 있다. 제2 트랜지스터(T2)는, 구동 트랜지스터(DRT)의 게이트 노드의 전압을 초기화하기 위해 이용될 수 있다.
제3 트랜지스터(DRT)는, 스캔 신호 SCAN(N)에 의해 제어되고, 구동 트랜지스터(DRT)의 제3 노드(N3)와 데이터 라인(DL) 사이에 전기적으로 연결될 수 있다. 그리고, 제4 트랜지스터(T4)는, 스캔 신호 EM에 의해 제어되고, 구동 트랜지스터(DRT)의 제3 노드(N3)와 구동 전압 라인(DVL) 사이에 전기적으로 연결될 수 있다.
제5 트랜지스터(T5)는, 스캔 신호 EM에 의해 제어되고, 구동 트랜지스터(DRT)의 제2 노드(N2)와 발광 소자(ED) 사이에 전기적으로 연결될 수 있다. 제5 트랜지스터(T5)는, 발광 소자(ED)의 발광 타이밍을 제어할 수 있다.
제6 트랜지스터(T6)는, 스캔 신호 SCAN(N)에 의해 제어되고, 발광 소자(ED)의 애노드 전극과 초기화 전압 라인(IVL) 사이에 전기적으로 연결될 수 있다. 제6 트랜지스터(T6)는, 발광 소자(ED)의 애노드 전극의 전압을 초기화하기 위해 이용될 수 있다.
이러한 서브픽셀(SP)의 구동 방식을 설명하면, 서브픽셀(SP)은 하나의 영상 프레임 기간 동안 초기화 기간, 데이터 기입 기간 및 발광 기간으로 구분되어 구동될 수 있다.
초기화 기간에, 로우 레벨의 스캔 신호 SCAN(N-1)이 서브픽셀(SP)로 공급되어 제2 트랜지스터(T2)가 턴-온 될 수 있다. 제2 트랜지스터(T2)가 턴-온 됨에 따라, 구동 트랜지스터(DRT)의 게이트 노드로 초기화 전압(Vini)이 인가될 수 있다.
초기화가 완료되면, 데이터 기입 기간에 하이 레벨의 스캔 신호 SCAN(N-1)과 로우 레벨의 스캔 신호 SCAN(N)이 서브픽셀(SP)로 공급될 수 있다. 그리고, 제2 트랜지스터(T2)는 턴-오프 되고, 제1 트랜지스터(T1), 제3 트랜지스터(T3) 및 제6 트랜지스터(T6)는 턴-온 될 수 있다.
제1 트랜지스터(T1)가 턴-온 되므로, 구동 트랜지스터(DRT)의 제1 노드(N1)와 제2 노드(N2)는 전기적으로 연결된다.
또한, 제3 트랜지스터(T3)가 턴-온 되므로, 데이터 전압(Vdata)이 구동 트랜지스터(DRT)와 제1 트랜지스터(T1)를 통해 구동 트랜지스터(DRT)의 게이트 노드인 제1 노드(N1)에 인가될 수 있다. 이때, 데이터 전압(Vdata)에 구동 트랜지스터(DRT)의 문턱 전압(Vth)이 반영된 전압이 구동 트랜지스터(DRT)의 게이트 노드에 인가되어, 구동 트랜지스터(DRT)의 문턱 전압(Vth)에 대한 보상이 이루어질 수 있다.
그리고, 데이터 기입 기간에 제6 트랜지스터(T6)가 턴-온 되므로, 발광 소자(ED)의 애노드 전극이 초기화 전압(Vini)에 의해 초기화될 수 있다. 즉, 데이터 기입 기간에 구동 트랜지스터(DRT)의 게이트 노드에 전압 인가와 발광 소자(ED)의 애노드 전극의 초기화가 동시에 수행될 수 있다.
발광 기간에 하이 레벨의 스캔 신호 SCAN(N-1)과 하이 레벨의 스캔 신호 SCAN(N)이 서브픽셀(SP)로 공급되고, 로우 레벨의 스캔 신호 EM이 공급될 수 있다. 따라서, 제1 트랜지스터(T1), 제3 트랜지스터(T3) 및 제6 트랜지스터(T6)는 턴-오프 되고, 제4 트랜지스터(T4)와 제5 트랜지스터(T5)는 턴-온 될 수 있다.
제4 트랜지스터(T4)가 턴-온 됨에 따라, 구동 트랜지스터(DRT)의 제3 노드(N3)에 구동 전압(Vdd)이 공급되며, 구동 트랜지스터(DRT)의 제1 노드(N1)와 제3 노드(N3)에 데이터 전압(Vdata)과 구동 전압(Vdd)에 의한 전압 차이가 형성되며 구동 트랜지스터(DRT)를 통해 데이터 전압(Vdata)에 따른 전류가 흐를 수 있다.
제5 트랜지스터(T5)가 턴-온 됨에 따라, 데이터 전압(Vdata)에 따른 전류가 발광 소자(ED)에 공급되어, 발광 소자(ED)에 데이터 전압(Vdata)에 대응하는 밝기를 나타낼 수 있다.
한편, 본 발명의 실시예들에 따른 디스플레이 장치(100)는, 전술한 서브픽셀(SP)이 배치되는 디스플레이 패널(110)의 액티브 영역(A/A) 내에 카메라 센서 등과 같은 센서가 배치되는 영역을 포함할 수 있다.
일 예로, 디스플레이 패널(110)의 액티브 영역(A/A)의 일부 영역에 서브픽셀(SP)이 배치되지 않을 수 있다. 그리고, 서브픽셀(SP)이 배치되지 않는 영역을 오픈시켜 해당 영역에 카메라 센서 등과 같은 센서가 배치되도록 할 수 있다. 즉, 액티브 영역(A/A) 내에 홀 영역(HA)이 형성되고, 홀 영역(HA)에 센서가 배치될 수 있다.
이러한 경우, 디스플레이 구동을 위한 전극이나 신호 라인 등을 배치하는 과정에서, 해당 영역에는 디스플레이 구동을 위한 구성이 배치되지 않도록 할 수 있다. 즉, 액티브 영역(A/A) 내에 홀 영역(HA)이 형성될 영역을 제외한 영역에만 영상이 표시되도록 전극과 신호 라인 등을 배치할 수 있다.
이와 같이, 액티브 영역(A/A)의 일부 영역에 홀 영역(HA)을 형성하고 홀 영역(HA)에 센서를 배치함에 따라, 센서의 배치로 인해 디스플레이 패널(110)의 논-액티브 영역(N/A)의 폭이 전체적으로 증가하는 것을 방지할 수 있다.
도 3은 본 발명의 실시예들에 따른 디스플레이 장치(100)의 액티브 영역(A/A)에 홀 영역(HA)이 배치된 구조의 예시를 나타낸 도면이다.
도 3을 참조하면, 디스플레이 패널(110)의 액티브 영역(A/A)의 일부 영역은 카메라 센서 등이 배치되는 홀 영역(HA)일 수 있다. 그리고, 홀 영역(HA)의 주변에는 경계 영역(BA)이 배치될 수 있다.
경계 영역(BA)은, 홀 영역(HA)의 외곽과 접하며 홀 영역(HA)과 액티브 영역(A/A)에서 서브픽셀(SP)이 배치된 영역 사이에 위치할 수 있다.
이러한 경계 영역(BA)은, 홀 영역(HA)에 배치되는 카메라 센서 등을 구동하기 위한 신호 라인 등이 배치되는 제1 경계 영역(BA1)과, 홀 영역(HA)의 주변에 배치된 서브픽셀(SP)을 구동하기 위한 신호 라인 등이 배치되는 제2 경계 영역(BA2)을 포함할 수 있다.
여기서, 홀 영역(HA)과 제1 경계 영역(BA1)이 카메라 센서의 배치를 위해 오픈되는 영역일 수 있다. 즉, 홀 영역(HA)과 제1 경계 영역(BA1)이 오픈된 상태에서 카메라 센서의 센서부가 배치된 영역을 홀 영역(HA)으로 보고, 카메라 센서의 베젤부가 배치된 영역을 제1 경계 영역(BA1)으로 볼 수 있다.
홀 영역(HA)의 주변에 위치하는 제2 경계 영역(BA2)은, 액티브 영역(A/A)에 배치된 서브픽셀(SP)을 구동하기 위한 신호 라인 등이 배치되는 영역일 수 있다. 액티브 영역(A/A) 내에 홀 영역(HA)이 위치함에 따라, 홀 영역(HA)의 주변에 위치하는 서브픽셀(SP)과 연결되는 신호 라인은 홀 영역(HA)의 위치에 배치될 수 없다. 따라서, 홀 영역(HA)의 주변에 제2 경계 영역(BA2)이 형성되고, 제2 경계 영역(BA2)에 게이트 라인(GL), 데이터 라인(DL) 등과 같은 디스플레이 구동을 위한 신호 라인이 배치될 수 있다.
이러한 홀 영역(HA)은, 액티브 영역(A/A)에 배치되는 센서의 유형, 수 등에 따라 액티브 영역(A/A)에 단수 개가 배치될 수도 있고, 복수 개가 배치될 수도 있다.
일 예로, 도 3에 도시된 EX 1과 같이, 디스플레이 패널(110)의 액티브 영역(A/A)에 하나의 홀 영역(HA)이 배치될 수 있다. 홀 영역(HA)의 주변에 제1 경계 영역(BA1)과 제2 경계 영역(BA2)이 배치될 수 있다. 그리고, 제2 경계 영역(BA2)의 외측에 서브픽셀(SP) 등이 배치될 수 있다. 즉, 경계 영역(BA)의 외곽은 액티브 영역(A/A)의 외곽과 이격되어 위치할 수 있다.
다른 예로, 도 3에 도시된 EX 2와 같이, 디스플레이 패널(110)의 액티브 영역(A/A)에 두 개의 홀 영역(HA)이 배치될 수 있다. 제1 홀 영역(HA1)과 제2 홀 영역(HA2)은 동일한 형태와 크기를 가질 수도 있고, EX 2와 같이 다른 형태와 크기를 가질 수도 있다.
제1 홀 영역(HA1)의 주변에 제1 홀 영역(HA1)에 배치된 센서를 구동하기 위한 신호 라인 등이 배치되는 제1 경계 영역(BA1)이 위치하고, 제2 홀 영역(HA2)의 주변에 제2 홀 영역(HA2)에 배치된 센서를 구동하기 위한 신호 라인 등이 배치되는 제2 경계 영역(BA2)이 위치할 수 있다.
제1 경계 영역(BA1)의 외측에 제2 경계 영역(BA2)이 위치할 수 있다. 그리고, 액티브 영역(A/A)에서 홀 영역(HA)과 경계 영역(BA)을 제외한 영역에 서브픽셀(SP)이 배치되고 영상을 표시할 수 있다.
따라서, 홀 영역(HA)의 주변에 위치하는 서브픽셀(SP)을 구동하기 위한 신호 라인은 홀 영역(HA)에 배치될 수 없으므로, 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)에 배치되며 경계 영역(BA)의 외측에 위치하는 서브픽셀(SP)과 연결될 수 있다.
도 4는 본 발명의 실시예들에 따른 디스플레이 장치(100)의 액티브 영역(A/A)에 배치된 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)에 신호 라인이 배치된 구조의 예시를 나타낸 도면이다.
도 4를 참조하면, 디스플레이 패널(110)의 액티브 영역(A/A)에 일 방향으로 게이트 라인(GL)이 배치되고, 게이트 라인(GL)과 교차하는 방향으로 데이터 라인(DL)이 배치될 수 있다.
그리고, 액티브 영역(A/A)에 홀 영역(HA)이 위치하는 경우, 게이트 라인(GL)과 데이터 라인(DL)과 같은 신호 라인은 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)을 통과하며 배치될 수 있다.
일 예로, 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)에 스캔 신호가 인가되는 게이트 라인(GL)이 배치될 수 있다. 게이트 라인(GL)은, 경계 영역(BA)에서 홀 영역(HA)의 외곽의 형태에 따라 구부러진 형태로 배치될 수 있다. 그리고, 게이트 라인(GL)은, 경계 영역(BA)에서 경계 영역(BA)의 외측으로 연장되는 부분이 꺾인 형태일 수 있다.
즉, 게이트 라인(GL)은, 경계 영역(BA)에서는 만곡된 형태로 배치되되, 경계 영역(BA)의 외측에서 게이트 라인(GL) 간의 간격을 일정하게 유지하며 서브픽셀(SP)과 연결되기 위해 절곡된 부분을 포함할 수 있다.
또한, 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)에 데이터 전압(Vdata)이 인가되는 데이터 라인(DL)이 배치될 수 있다. 데이터 라인(DL)도 게이트 라인(GL)과 같이 경계 영역(BA)에서 구부러진 형태로 배치될 수 있다. 그리고, 데이터 라인(DL)은, 경계 영역(BA)의 외측으로 연장되는 부분이 꺾인 형태일 수 있다.
이러한 게이트 라인(GL)과 데이터 라인(DL)은, 디스플레이 패널(110)에서 서로 다른 층에 배치될 수 있다.
일 예로, 도 4에 도시된 I-I' 부분의 개략적인 단면 구조의 예시를 참조하면, 기판(SUB) 상에 버퍼층(BUF) 등이 배치되고, 버퍼층(BUF) 상에 게이트 라인(GL)이 배치될 수 있다. 게이트 라인(GL) 상에 절연층(ILD)이 배치되고, 절연층(ILD) 상에 데이터 라인(DL)이 배치될 수 있다. 그리고, 데이터 라인(DL) 상에 보호층(PAS)이 배치될 수 있다.
게이트 라인(GL)과 데이터 라인(DL)이 다른 층에 배치되며, 경계 영역(BA)에서 구부러진 형태로 배치됨에 따라, 홀 영역(HA)의 외부에 위치하는 서브픽셀(SP)에 연결될 수 있다.
이때, 게이트 라인(GL)과 데이터 라인(DL)이 경계 영역(BA)에서 홀 영역(HA)의 외곽의 형태를 따라 배치되므로, 경계 영역(BA)의 외측에 배치되는 신호 라인보다 길어질 수 있다. 그리고, 신호 라인의 길이가 증가함에 따라 신호 라인의 로드가 증가할 수 있으며, 특히, 데이터 전압(Vdata)을 공급하는 데이터 라인(DL)의 로드 증가는 서브픽셀(SP)의 휘도 저하를 야기할 수 있다.
본 발명의 실시예들은, 액티브 영역(A/A) 내에 센서 등이 배치될 수 있는 홀 영역(HA)을 포함하되, 홀 영역(HA)의 주변에서 표시되는 영상의 품질 저하를 방지할 수 있는 방안을 제공한다.
도 5는 본 발명의 실시예들에 따른 디스플레이 장치(100)의 액티브 영역(A/A)에 배치된 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)에 신호 라인이 배치된 구조의 다른 예시를 나타낸 도면이다.
도 5를 참조하면, 디스플레이 패널(110)의 액티브 영역(A/A)에 센서 등이 배치되는 홀 영역(HA)이 위치할 수 있다. 홀 영역(HA)의 주변에는 홀 영역(HA)의 외곽과 접하며 배치되는 경계 영역(BA)이 위치할 수 있다.
홀 영역(HA)의 주변에 위치하는 서브픽셀(SP)을 구동하기 위한 게이트 라인(GL)과 데이터 라인(DL) 등이 경계 영역(BA)에 배치될 수 있다.
일 예로, 스캔 신호가 인가되는 게이트 라인(GL)이 일 방향으로 배치되며, 경계 영역(BA)에서 만곡된 부분과 절곡된 부분을 포함하며 배치될 수 있다. 그리고, 데이터 전압(Vdata)이 공급되는 데이터 라인(DL)이 게이트 라인(GL)과 교차하는 방향으로 배치되며, 경계 영역(BA)에서 만곡된 부분과 절곡된 부분을 포함하며 배치될 수 있다.
여기서, 경계 영역(BA)에 배치되는 데이터 라인(DL) 중 일부 데이터 라인(DL)은 서로 다른 층에 배치될 수 있다.
도 5에 도시된 J-J' 부분의 개략적인 단면 구조의 예시를 참조하면, 게이트 라인(GL) 상에 절연층(ILD)이 배치되고, 절연층(ILD) 상에 제1 데이터 라인(DL1)이 배치될 수 있다. 제1 데이터 라인(DL1) 상에 제1 보호층(PAS1)이 배치되고, 제1 보호층(PAS1) 상에 제2 데이터 라인(DL2)이 배치될 수 있다. 그리고, 제2 데이터 라인(DL2) 상에 제2 보호층(PAS2)이 배치될 수 있다.
여기서, 제1 데이터 라인(DL1)과 제2 데이터 라인(DL2)은 동일한 물질로 이루어질 수 있다.
그리고, 제2 데이터 라인(DL2)이 제1 데이터 라인(DL1)보다 상부에 위치하므로, 제1 데이터 라인(DL1)과 게이트 라인(GL) 사이의 수직 거리 d1보다 제2 데이터 라인(DL2)과 게이트 라인(GL) 사이의 수직 거리 d2가 클 수 있다.
제2 데이터 라인(DL2)이 아래에 위치하는 게이트 라인(GL)과의 거리가 증가함에 따라, 제2 데이터 라인(DL2)과 게이트 라인(GL) 사이에 형성될 수 있는 기생 캐패시터스가 저감되며 제2 데이터 라인(DL2)의 로드가 감소될 수 있다.
즉, 본 발명의 실시예들은, 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)에 배치되는 데이터 라인(DL) 중 일부 데이터 라인(DL)과 다른 층에 배치되는 게이트 라인(GL) 등과 같은 신호 라인 사이의 거리를 증가시켜줌으로써, 데이터 라인(DL)의 길이 증가에 따른 로드 증가를 방지할 수 있다.
따라서, 홀 영역(HA)과 인접한 영역에 배치된 서브픽셀(SP)에서 해당 서브픽셀(SP)로 데이터 전압(Vdata)을 공급하는 데이터 라인(DL)의 로드 증가로 인한 휘도 저하가 발생하는 것을 방지할 수 있다.
또한, 데이터 라인(DL) 중 휘도에 영향성이 큰 서브픽셀(SP)을 구동하는 데이터 라인(DL)의 로드를 저감시켜줌으로써, 홀 영역(HA)의 주변 영역이 나타내는 휘도 개선의 효과를 높여줄 수 있다.
도 6은 본 발명의 실시예들에 따른 디스플레이 장치(100)의 액티브 영역(A/A)에서 홀 영역(HA)의 주변에 위치하는 서브픽셀(SP)을 구동하는 데이터 라인(DL)의 배치 구조의 예시를 나타낸 도면이다.
도 6을 참조하면, 디스플레이 패널(110)의 액티브 영역(A/A)에 적색 서브픽셀(R SP), 녹색 서브픽셀(G SP) 및 청색 서브픽셀(B SP)이 배치될 수 있다. 여기서, 적색 서브픽셀(R SP)과 청색 서브픽셀(B SP)은 제1 데이터 라인(DL1)에 의해 구동되도록 교번하여 배치될 수 있다. 그리고, 녹색 서브픽셀(G SP)은 제2 데이터 라인(DL2)에 의해 구동되도록 동일한 열에 배치될 수 있다.
녹색 서브픽셀(G SP)이 발산하는 광의 피크 파장은 적색 서브픽셀(R SP)이 발산하는 광의 피크 파장보다 작고 청색 서브픽셀(B SP)이 발산하는 광의 피크 파장보다 작을 수 있다. 그리고, 녹색 서브픽셀(G SP)이 발산하는 광의 세기에 의해 휘도가 달라질 수 있다.
따라서, 녹색 서브픽셀(G SP)을 구동하는 제2 데이터 라인(DL2)이 적색 서브픽셀(R SP)과 청색 서브픽셀(B SP)을 구동하는 제1 데이터 라인(DL1)보다 상위 층에 배치되도록 하여 제2 데이터 라인(DL2)의 로드를 감소시키며 해당 데이터 라인(DL)에 의해 구동되는 영역의 휘도를 높여줄 수 있다.
이와 같이, 홀 영역(HA)의 주변에 위치하는 서브픽셀(SP)을 구동하는 신호 라인이 경계 영역(BA)에 배치되며 서브픽셀(SP)과 연결될 수 있는 구조를 갖도록 하되, 일부 신호 라인이 배치되는 층을 조절해줌으로써 로드 증가로 인한 화질 저하를 방지할 수 있다.
또한, 전술한 데이터 라인(DL)의 배치 구조는 디스플레이 패널(110)의 액티브 영역(A/A)에 복수의 홀 영역(HA)이 위치하는 경우에도 적용될 수 있다.
도 7은 본 발명의 실시예들에 따른 디스플레이 장치(100)의 액티브 영역(A/A)에 배치된 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)에 데이터 라인(DL)이 배치된 구조의 또 다른 예시를 나타낸 도면이다.
도 7을 참조하면, 액티브 영역(A/A)에 제1 홀 영역(HA1)과 제2 홀 영역(HA2)이 배치될 수 있다.
제1 홀 영역(HA1)과 제2 홀 영역(HA2)의 주변에는 제1 홀 영역(HA1)의 외곽과 제2 홀 영역(HA2)의 외곽에 접하며 배치되는 경계 영역(BA)이 위치할 수 있다. 이러한 경계 영역(BA)에는, 홀 영역(HA)의 일측(예: 좌측)과 타측(예: 우측)에 위치하는 서브픽셀(SP)에 연결되는 게이트 라인(GL)이 배치될 수 있다.
또한, 경계 영역(BA)에, 홀 영역(HA)의 일측(예: 상측)과 타측(예: 하측)에 위치하는 서브픽셀(SP)에 연결되는 데이터 라인(DL)이 배치될 수 있다.
데이터 라인(DL)은, 경계 영역(BA)에 배치되는 부분의 일부분이 만곡된 형태를 가질 수 있다. 그리고, 데이터 라인(DL)은, 경계 영역(BA)에서 경계 영역(BA)의 외측으로 연장되는 부분의 일부분이 절곡된 형태를 가질 수 있다.
여기서, 적색 서브픽셀(R SP)과 청색 서브픽셀(B SP)을 구동하는 제1 데이터 라인(DL1)과 녹색 서브픽셀(G SP)을 구동하는 제2 데이터 라인(DL2)이 교번하여 배치될 수 있다. 그리고, 제2 데이터 라인(DL2)이 제1 데이터 라인(DL1)보다 상위 층에 배치될 수 있다.
따라서, 제2 데이터 라인(DL2)은, 데이터 라인(DL)의 하위 층에 배치되는 신호 라인과의 거리가 증가하게 된다. 그리고, 데이터 라인(DL)의 하위 층에 배치되는 신호 라인과의 거리가 증가함에 따라, 제2 데이터 라인(DL2)의 로드가 저감될 수 있다.
이를 통해, 경계 영역(BA)에 배치되는 제2 데이터 라인(DL2)의 길이 증가로 인한 로드 증가를 방지하며, 제2 데이터 라인(DL2)에 의해 구동되는 서브픽셀(SP)이 나타내는 휘도 저하를 방지할 수 있다.
그리고, 제1 데이터 라인(DL1)과 제2 데이터 라인(DL2)은, 휘도의 균일도와 배선 배치의 용이함 등을 위해 경계 영역(BA)의 외측이나 홀 영역(HA) 사이의 경계 영역(BA) 등에서 일정한 패턴으로 배치될 수 있다.
도 8은 도 7에 도시된 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)의 외측과 내측에 데이터 라인(DL)이 배치된 구조의 예시를 나타낸 도면이다.
도 8을 참조하면, 제1 홀 영역(HA1)의 좌측에 위치하는 경계 영역(BA)과 경계 영역(BA)의 외측에 위치하는 액티브 영역(A/A)에 배치된 데이터 라인(DL)의 구조의 예시를 나타낸다.
제1 홀 영역(HA1)의 상측에 배치된 서브픽셀(SP)과 하측에 배치된 서브픽셀(SP)에 연결되는 데이터 라인(DL)은, 제1 홀 영역(HA1)을 우회하며 배치될 수 있다. 데이터 라인(DL)의 구부러진 부분의 길이는 제1 홀 영역(HA1)의 외곽과 더 가깝게 배치될수록 클 수 있다. 그리고, 데이터 라인(DL)의 구부러진 부분의 길이는 경계 영역(BA)의 외곽과 더 가깝게 배치될수록 작을 수 있다.
여기서, 경계 영역(BA)에 배치되는 데이터 라인(DL)의 구부러진 부분 사이의 간격은 경계 영역(BA)의 폭으로 인해 좁아지더라도, 경계 영역(BA)의 외측에 배치되는 데이터 라인(DL)의 직선 부분 사이의 간격은 일정할 수 있다.
따라서, 데이터 라인(DL)은, 경계 영역(BA)에서 홀 영역(HA)을 우회하는 구조로 배치되며, 홀 영역(HA)의 상측과 하측에 배치된 서브픽셀(SP)에 연결되어 해당 서브픽셀(SP)을 구동할 수 있다.
그리고, 녹색 서브픽셀(G SP)을 구동하는 제2 데이터 라인(DL2)을 상위 층에 배치함으로써, 녹색 서브픽셀(G SP)로 데이터 전압(Vdata)을 공급하는 제2 데이터 라인(DL2)의 로드를 저감시켜 일부분이 경계 영역(BA)에 배치되는 데이터 라인(DL)에 의해 구동되는 영역의 휘도 감소를 방지할 수 있다.
또한, 배선 배치의 용이함을 위하여, 경계 영역(BA)의 외측에 위치하는 데이터 라인(DL)도 경계 영역(BA)에 배치되는 데이터 라인(DL)과 동일한 패턴으로 배치되도록 할 수 있다. 즉, 경계 영역(BA)의 외측에 위치하는 제1 데이터 라인(DL1)과 제2 데이터 라인(DL2)이 다른 층에 배치되도록 할 수 있다.
따라서, 본 발명의 실시예들에 따른 디스플레이 장치(100)에서 인접하게 배치된 두 개의 데이터 라인(DL)은 서로 다른 층에 배치된 구조를 가질 수 있다.
도 9는 도 7에 도시된 두 개의 홀 영역(HA) 사이에 위치하는 경계 영역(BA)에 데이터 라인(DL)이 배치된 구조의 예시를 나타낸 도면이다.
도 9를 참조하면, 제1 홀 영역(HA1)과 제2 홀 영역(HA2) 사이에 위치하는 경계 영역(BA)에 데이터 라인(DL)이 배치된 구조의 예시를 나타낸다.
제1 홀 영역(HA1)과 제2 홀 영역(HA2) 사이의 영역에서 일부 데이터 라인(DL)은 제1 홀 영역(HA1)의 외곽의 형태를 따라 만곡된 형태를 가지고, 다른 일부 데이터 라인(DL)은 제2 홀 영역(HA2)의 외곽의 형태를 따라 만곡된 형태를 가질 수 있다. 따라서, 제1 홀 영역(HA1)과 제2 홀 영역(HA2) 사이에 위치하는 경계 영역(BA)에는 서로 반대 방향으로 만곡되는 데이터 라인(DL)이 배치될 수 있다.
데이터 라인(DL)은, 제1 홀 영역(HA1)과 제2 홀 영역(HA2) 사이의 경계 영역(BA)에서 만곡된 형태로 배치되며 데이터 라인(DL) 사이의 간격이 좁아질 수 있다. 그리고, 경계 영역(BA)의 외측으로 연장되는 데이터 라인(DL)의 직선 부분은 일정한 간격을 가지며, 경계 영역(BA)의 외측에 위치하는 서브픽셀(SP)과 연결될 수 있다.
여기서, 제1 홀 영역(HA1)과 제2 홀 영역(HA2) 사이의 경계 영역(BA)에서 인접한 두 개의 데이터 라인(DL)이 서로 반대 방향으로 만곡된 형태를 가질 수 있다. 그리고, 제1 데이터 라인(DL1)과 제2 데이터 라인(DL2)이 교번하여 배치되므로, 인접하게 배치되며 서로 반대 방향으로 만곡된 데이터 라인(DL)이 서로 다른 층에 배치될 수 있다.
이와 같이, 본 발명의 실시예들에 따른 디스플레이 장치(100)는, 액티브 영역(A/A) 내에 홀 영역(HA)을 포함하여 센서가 액티브 영역(A/A) 내에 배치될 수 있는 구조를 제공한다. 그리고, 홀 영역(HA)의 외측에 위치하는 경계 영역(BA)에 디스플레이 구동을 위한 신호 라인이 배치되는 구조를 제공함으로써, 홀 영역(HA)의 주변에 위치하는 서브픽셀(SP)을 구동할 수 있는 신호 라인의 구조를 제공한다.
또한, 일부 컬러를 나타내는 서브픽셀(SP)을 구동하는 데이터 라인(DL)이 배치되는 층을 조절하여 해당 데이터 라인(DL)의 로드를 저감시켜줌으로써, 데이터 라인(DL)이 홀 영역(HA)을 우회하며 배치됨에 따른 로드 증가를 저감시키며 홀 영역(HA)의 주변에서 나타나는 휘도의 균일도를 개선할 수 있다.
도 10과 도 11은 도 7에 도시된 데이터 라인(DL)의 배치 구조에 의해 액티브 영역(A/A)의 휘도 균일도가 개선된 예시를 나타낸 도면이다.
도 10을 참조하면, 데이터 라인(DL)으로 데이터 전압(Vdata)을 공급하는 데이터 구동 회로(130)가 액티브 영역(A/A)의 하측에 위치하는 경우를 예시로 나타낸다. 데이터 라인(DL)이 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)에 배치되며 길이가 증가함에 따라 로드가 증가하므로, 데이터 라인(DL)에 의해 구동되는 서브픽셀(SP)이 나타내는 휘도가 낮은 영역이 발생할 수 있다.
즉, 홀 영역(HA) 및 경계 영역(BA) 등이 액티브 영역(A/A)의 외곽과 이격되어 배치된 경우, 홀 영역(HA) 등과 액티브 영역(A/A)의 외곽 사이에 경계 영역(BA)에 배치되는 데이터 라인(DL)에 의해 구동되는 서브픽셀(SP)이 존재할 수 있다.
그리고, 이러한 서브픽셀(SP)을 구동하는 데이터 라인(DL)은 경계 영역(BA)에 배치되며 로드가 증가하므로, 해당 데이터 라인(DL)에 의해 구동되는 서브픽셀(SP)이 배치된 영역이 낮은 휘도를 나타낼 수 있다.
본 발명의 실시예들은, 경계 영역(BA)에 배치되는 데이터 라인(DL) 중 녹색 서브픽셀(G SP)을 구동하는 제2 데이터 라인(DL2)의 로드를 저감시킬 수 있는 층에 위치시킴으로써, 홀 영역(HA)의 주변에 위치하는 영역에서 나타나는 휘도가 저하되는 것을 방지할 수 있다.
또한, 본 발명의 실시예들은, 홀 영역(HA)이 액티브 영역(A/A)의 외곽과 인접하게 배치되는 경우에도, 홀 영역(HA)과 액티브 영역(A/A)의 외곽 사이에 경계 영역(BA)에 배치되는 데이터 라인(DL)에 의해 구동되는 서브픽셀(SP)이 존재하는 경우 적용될 수 있다.
일 예로, 도 11에 도시된 예시와 같이, 홀 영역(HA)의 주변에 위치하는 경계 영역(BA)의 외곽의 일부분이 액티브 영역(A/A)의 외곽과 접하며 배치될 수 있다.
이러한 경우, 경계 영역(BA)의 외곽이 곡선인 부분을 포함하면, 경계 영역(BA)의 외곽과 액티브 영역(A/A)의 외곽 사이에 영상이 표시되는 서브픽셀(SP)이 배치될 수 있다. 그리고, 해당 서브픽셀(SP)을 구동하기 위한 데이터 라인(DL)은 홀 영역(HA)을 우회하며 경계 영역(BA)에 배치될 수 있다.
이때, 녹색 서브픽셀(G SP)을 구동하는 제2 데이터 라인(DL2)을 적색 서브픽셀(R SP), 청색 서브픽셀(B SP)을 구동하는 제1 데이터 라인(DL1)과 다른 층에 배치하며 로드를 저감시켜줌으로써, 해당 영역에서 데이터 라인(DL)의 로드 증가로 인해 발생할 수 있는 휘도 저하를 방지할 수 있다.
전술한 본 발명의 실시예들에 의하면, 디스플레이 패널(110)의 액티브 영역(A/A)의 일부 영역에 홀 영역(HA)을 배치함으로써, 액티브 영역(A/A) 내에 센서가 배치될 수 있는 구조를 제공한다.
그리고, 홀 영역(HA)의 외측에 경계 영역(BA)을 형성하고, 경계 영역(BA)에 디스플레이 구동을 위한 신호 라인이 만곡된 형태로 배치되도록 함으로써, 홀 영역(HA)의 주변에 위치하는 서브픽셀(SP)을 구동할 수 있는 신호 라인의 배치 구조를 제공할 수 있다.
또한, 경계 영역(BA)에 배치되며 경계 영역(BA)의 외측에 위치하는 서브픽셀(SP)을 구동하는 데이터 라인(DL) 중 녹색 서브픽셀(G SP)을 구동하는 데이터 라인(DL)을 다른 데이터 라인(DL)과 다른 층에 배치하는 구조를 제공한다.
따라서, 녹색 서브픽셀(G SP)을 구동하는 데이터 라인(DL)의 로드 증가를 방지함으로써, 해당 데이터 라인(DL)에 의해 구동되는 서브픽셀(SP)의 휘도 저하를 방지하며 홀 영역(HA)의 주변에서 나타나는 휘도의 균일도를 개선할 수 있는 방안을 제공할 수 있다.
이상의 설명은 본 발명의 기술 사상을 예시적으로 설명한 것에 불과한 것으로서, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자라면 본 발명의 본질적인 특성에서 벗어나지 않는 범위에서 다양한 수정 및 변형이 가능할 것이다. 또한, 본 발명에 개시된 실시예들은 본 발명의 기술 사상을 한정하기 위한 것이 아니라 설명하기 위한 것이므로 이러한 실시예에 의하여 본 발명의 기술 사상의 범위가 한정되는 것은 아니다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리 범위에 포함되는 것으로 해석되어야 할 것이다.
100: 디스플레이 장치 110: 디스플레이 패널
120: 게이트 구동 회로 130: 데이터 구동 회로
140: 컨트롤러

Claims (18)

  1. 다수의 게이트 라인, 다수의 데이터 라인 및 다수의 서브픽셀이 배치된 디스플레이 패널;
    상기 디스플레이 패널의 액티브 영역에 위치하는 적어도 하나의 홀 영역; 및
    상기 홀 영역의 외곽과 접하며 배치된 경계 영역을 포함하고,
    상기 다수의 데이터 라인은,
    상기 다수의 서브픽셀 중 제1 컬러 서브픽셀로 데이터 전압을 공급하고, 일부분이 상기 경계 영역에 배치된 다수의 제1 데이터 라인; 및
    상기 다수의 서브픽셀 중 제2 컬러 서브픽셀로 데이터 전압을 공급하고, 일부분이 상기 경계 영역에 배치되며, 상기 제1 데이터 라인이 배치된 층과 다른 층에 배치된 다수의 제2 데이터 라인을 포함하고,
    상기 제2 컬러 서브픽셀은 녹색 서브픽셀이고, 상기 제1 컬러 서브픽셀은 적색 또는 청색 서브픽셀이며,
    상기 녹색 서브픽셀을 구동하는 상기 제2 데이터 라인과 상기 다수의 게이트 라인 간의 수직 거리가 상기 녹색 서브픽셀 이외의 서브픽셀을 구동하는 상기 제1 데이터 라인과 상기 다수의 게이트 라인 간의 수직 거리보다 큰 디스플레이 장치.
  2. 제1항에 있어서,
    상기 게이트 라인은 상기 데이터 라인이 배치된 층과 다른 층에 배치되는 디스플레이 장치.
  3. 제1항에 있어서,
    상기 제1 데이터 라인은 상기 다수의 서브픽셀 중 제3 컬러 서브픽셀로 데이터 전압을 더 공급하고,
    상기 제2 컬러 서브픽셀이 발산하는 광의 피크 파장은 상기 제1 컬러 서브픽셀이 발산하는 광의 피크 파장보다 작고 상기 제3 컬러 서브픽셀이 발산하는 광의 피크 파장보다 큰 디스플레이 장치.
  4. 제1항에 있어서,
    상기 제1 데이터 라인과 상기 제2 데이터 라인은 교번하여 배치된 디스플레이 장치.
  5. 제1항에 있어서,
    상기 제1 데이터 라인과 상기 제2 데이터 라인은 동일한 물질로 이루어진 디스플레이 장치.
  6. 제1항에 있어서,
    상기 경계 영역에 배치된 상기 제1 데이터 라인의 일부분과 상기 제2 데이터 라인의 일부분의 적어도 일부는 만곡된 형태인 디스플레이 장치.
  7. 제1항에 있어서,
    상기 경계 영역에 배치된 상기 제1 데이터 라인의 일부분과 상기 제2 데이터 라인의 일부분의 적어도 일부는 절곡된 형태인 디스플레이 장치.
  8. 제1항에 있어서,
    상기 경계 영역은 상기 액티브 영역의 경계와 이격되어 배치된 디스플레이 장치.
  9. 제1항에 있어서,
    상기 제1 데이터 라인과 상기 제2 데이터 라인 중 적어도 하나는 상기 홀 영역의 일측에 배치된 적어도 하나의 서브픽셀과 상기 홀 영역의 타측에 배치된 적어도 하나의 서브픽셀로 데이터 전압을 공급하는 디스플레이 장치.
  10. 제1항에 있어서,
    상기 다수의 서브픽셀은 상기 홀 영역과 상기 경계 영역을 제외한 영역에 배치된 디스플레이 장치.
  11. 제1항에 있어서,
    상기 적어도 하나의 홀 영역은 제1 홀 영역 및 상기 제1 홀 영역에 인접하게 배치된 제2 홀 영역을 포함하고,
    상기 제1 홀 영역과 상기 제2 홀 영역의 사이에 위치하는 상기 경계 영역에 배치된 데이터 라인 중 적어도 두 개의 데이터 라인은 서로 반대 방향으로 만곡된 형태인 디스플레이 장치.
  12. 제11항에 있어서,
    상기 경계 영역에서 인접하게 배치되고 서로 반대 방향으로 만곡된 두 개의 데이터 라인은 서로 다른 층에 배치된 디스플레이 장치.
  13. 액티브 영역에 배치된 적어도 하나의 홀 영역;
    상기 홀 영역의 외곽과 접하며 배치된 경계 영역; 및
    일부분이 상기 경계 영역에 배치되고, 상기 일부분의 적어도 일부는 만곡된 형태인 다수의 데이터 라인과 다수의 게이트 라인 및 다수의 서브픽셀을 포함하고,
    상기 다수의 데이터 라인 중 인접하게 배치된 두 개의 데이터 라인은 서로 다른 층에 배치되되,
    상기 다수의 서브픽셀 중 녹색 서브픽셀을 구동하는 데이터 라인과 상기 다수의 게이트 라인 간의 수직 거리가 상기 녹색 서브픽셀 이외의 서브픽셀을 구동하는 데이터 라인과 상기 다수의 게이트 라인 간의 수직 거리보다 큰 디스플레이 장치.
  14. 제13항에 있어서,
    상기 다수의 데이터 라인 중 적어도 하나는 상기 경계 영역의 일측에 위치하는 적어도 하나의 서브픽셀에 배치된 회로 소자와 전기적으로 연결되고, 상기 경계 영역의 타측에 위치하는 적어도 하나의 서브픽셀에 배치된 회로 소자와 전기적으로 연결된 디스플레이 장치.
  15. 제13항에 있어서,
    상기 경계 영역은 상기 액티브 영역의 경계와 이격되어 배치된 디스플레이 장치.
  16. 제13항에 있어서,
    상기 데이터 라인이 배치된 층과 다른 층에 배치되고, 일부분이 상기 경계 영역에 배치되며, 상기 일부분의 적어도 일부는 만곡된 형태인 다수의 게이트 라인을 더 포함하고,
    상기 다수의 게이트 라인 중 인접하게 배치된 두 개의 게이트 라인은 동일한 층에 배치된 디스플레이 장치.
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