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KR100966991B1 - 인버터 구동 집적회로 - Google Patents

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KR100966991B1
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Abstract

본 발명은, 펄스폭 변조 오실레이터 신호를 이용하여 서로 동일한 주기를 가지며, 서로 다른 시간대역에 하이 레벨을 갖는 펄스신호인 제1 제어신호 및 제2 제어신호를 발생시키는 제어신호 발생부; 램프에서 피드백되는 신호의 반파정류 신호를 기설정된 기준신호와 비교하여 램프 상태 신호를 출력하는 비교기; 상기 램프 상태 신호와 상기 제2 제어신호를 입력받아 상기 램프 상태 신호가 기 설정된 일정 시간을 초과하여 로우 레벨을 유지하는 경우에는 상기 제2 제어신호가 하이 레벨이 되는 순간으로부터 상기 제2 제어신호가 로우 레벨인 동시에 상기 램프 상태 신호가 하이 레벨이 되는 순간까지 로우 레벨을 유지하는 제1 감지신호를 출력하는 제1 감지부; 및 상기 제1 감지신호와 상기 제1 제어신호를 입력받아 상기 제1 감지신호가 기 설정된 일정 시간을 초과하여 로우 레벨을 유지하는 경우에는 상기 제1 제어신호가 하이 레벨이 되는 순간으로부터 상기 제1 감지신호가 하이 레벨이 되는 순간까지 로우 레벨을 유지하는 제2 감지신호를 출력하는 제2 감지부를 포함하며, 상기 제2 감지신호가 로우 레벨인 경우 램프의 구동을 정지시키는 인버터 구동 집적회로를 제공한다.
인버터(inverter), 오픈램프(open lamp)

Description

인버터 구동 집적회로{Inverter Driver Integrated Circuit}
본 발명은 인버터 구동 집적회로에 관한 것으로서, 보다 상세하게는 백라이트 유닛(Back Light Unit)에서 램프로부터 피드백되는 신호를 감지하여 램프의 오픈, 과전압 등의 상태를 검출할 수 있는 감지부가 집적회로 내에 내장된 인버터 구동 집적회로에 관한 것이다.
LCD(Liquid Crystal Display) TV 등의 디스플레이 장치에 사용되는 BLU(Back Light Unit)의 휘도의 균일성을 보장하기 위한 램프로 다수의 냉음극 형광램프(CCFL: Cold Cathode Fluorescent Lamp)나 발광다이오드(LED:Light Emitting Diode)를 병렬로 구동시킬 수 있다.
냉음극 형광램프는 유리관 내벽에 형광물질이 도포되어 있으며, 관 양단에 전극이 부착돼 있고, 관내에는 수십 Torr의 혼합가스와 정량의 수은이 봉입되어져 있는 것으로서, 높은 휘도와 고연색성, 낮은 소비전력, 긴 수명 등의 장점이 있어 LCD 백라이트 등의 조명 소자로서 유용하게 사용되고 있다.
다수의 램프를 병렬로 연결하여 사용하는 경우, 다수개의 램프 중에 어느 하 나가 먼저 점등되면 등가 병렬저항이 점등된 램프 하나의 저항으로 나타날 수 있다. 이 경우, 점등되지 못한 나머지 램프는 점등을 위한 충분한 전압을 받지 못하게 되어 점등이 되지 않은 상태로 머물러 있게 되고, 각 램프간의 과전류 편차로 인한 휘도 불균형이 문제되고 있다. 따라서 BLU 인버터 구동 집적회로(Integrated Circuit)는 기기를 보호할 수 있는 OVP(Over Voltage Protection), LCC(Limited Current Circuit), 및 OLP(Open Lamp Protection)와 같은 보호 회로 기능이 대단히 중요시되고 있다.
또한, 종래의 BLU 인버터의 소형화 설계 및 원가 경쟁력 확보를 위한 외장 부품의 최소화에 필요한 새로운 개념의 원-칩 인버터 구동 집적회로의 필요성이 대두되고 있다.
상기한 문제점을 해결하기 위해서, 본 발명은 멀티 램프를 구동하는 BLU 인버터에서 기기를 보호하기 위한 피드백 신호의 감지에 필요한 외장형 부품들을 IC 내부로 내장시킨 인버터 구동 집적회로를 제공하는 것을 목적으로 한다.
본 발명은, 펄스폭 변조 오실레이터 신호를 이용하여 서로 동일한 주기를 가지며, 서로 다른 시간대역에 하이 레벨을 갖는 펄스신호인 제1 제어신호 및 제2 제어신호를 발생시키는 제어신호 발생부; 램프에서 피드백되는 신호의 반파정류 신호를 기설정된 기준신호와 비교하여 램프 상태 신호를 출력하는 비교기; 상기 램프 상태 신호와 상기 제2 제어신호를 입력받아 상기 램프 상태 신호가 기 설정된 일정 시간을 초과하여 로우 레벨을 유지하는 경우에는 상기 제2 제어신호가 하이 레벨이 되는 순간으로부터 상기 제2 제어신호가 로우 레벨인 동시에 상기 램프 상태 신호가 하이 레벨이 되는 순간까지 로우 레벨을 유지하는 제1 감지신호를 출력하는 제1 감지부; 및 상기 제1 감지신호와 상기 제1 제어신호를 입력받아 상기 제1 감지신호가 기 설정된 일정 시간을 초과하여 로우 레벨을 유지하는 경우에는 상기 제1 제어신호가 하이 레벨이 되는 순간으로부터 상기 제1 감지신호가 하이 레벨이 되는 순간까지 로우 레벨을 유지하는 제2 감지신호를 출력하는 제2 감지부를 포함하며, 상기 제2 감지신호가 로우 레벨인 경우 램프의 구동을 정지시키는 인버터 구동 집적회로를 제공할 수 있다.
삭제
상기 제어신호 발생부는, 상기 펄스폭 변조 오실레이터의 신호가 클럭 신호로 입력되는 제1 플립플롭과, 상기 펄스폭 변조 오실레이터의 신호가 클럭 신호로 입력되며, 상기 제1 플립플롭의 출력신호를 입력받는 제2 플립플롭과, 상기 제2 플 립플롭의 출력신호를 상기 제1 플립플롭의 입력으로 피드백시키는 NOT 게이트와, 상기 제1 플립플롭의 출력신호와 상기 제2 플립플롭의 출력신호의 반전신호를 입력받아 제1 제어신호를 출력하는 앤드 게이트, 및 상기 제1 플립플롭의 출력신호와 상기 제2 플립플롭의 출력신호를 입력받아 제2 제어신호를 출력하는 앤드 게이트를 포함할 수 있다.
상기 제1 감지부는, 상기 제2 제어신호를 리셋으로 입력받는 SR 래치회로, 및 상기 제2 제어신호의 반전신호와 상기 비교기의 출력신호를 입력받아 상기 SR 래치회로의 세트로 출력하는 앤드 게이트를 포함할 수 있다.
상기 제2 감지부는, 상기 제1 감지부의 출력 신호를 세트로 입력받는 SR 래치회로, 및 상기 제1 감지부의 출력신호에 대한 반전신호와 상기 제1 제어신호를 입력받아 상기 SR 래치회로의 리셋으로 출력하는 앤드 게이트를 포함할 수 있다.
본 발명에 따르면, 램프의 피드백 신호 감지기능을 실현하기 위해 기존의 인버터 구동 집적회로의 외부에 부품으로 구현되었던 것을 집적회로 내부에 내장시킴으로서 인버터의 외장부품을 최소화하여 인버터의 소형화 설계 및 원가 경쟁력 확보가 가능한 인버터 구동 집적회로를 얻을 수 있다.
이하, 도면을 참조하여 본 발명을 상세히 설명하겠다.
도 1은, 본 발명의 일실시 형태에 따른 인버터 구동 집적회로의 회로도이다.
도 1을 참조하면, 본 실시형태에 따른 인버터 구동 집적회로(100)는 제어신호 발생부(110), 비교기(120), 제1 감지부(130), 및 제2 감지부(140)를 포함할 수 있다.
본 실시형태에 따른 인버터 구동 집적회로(100)는 LCD 백라이트 유닛에 사용되는 복수개의 램프에 연결되어 상기 램프에서 피드백되는 신호를 감지하여 램프의 상태를 검출할 수 있는 복수개의 감지회로를 포함할 수 있다.
상기 인버터 구동 집적회로(100)는, 상기 복수개의 램프의 오픈램프, 과전압 등의 상태를 검출한 신호(OLPO1, OLPO2, OLPO3, OLPO4)를 NAND 게이트(101)를 통해 논리곱하여 상기 램프에 대한 구동신호를 제어할 수 있다.
여기에서는, 상기 복수개의 램프 중 하나의 램프에서 피드백되는 신호에 의해 램프의 상태를 검출하는 감지회로를 중심으로 설명하겠다.
상기 제어신호 발생부(110)는 인버터 구동 집적회로(100) 내부에 있는 펄스폭 변조 오실레이터(PWM OSC)의 신호를 이용하여 제1 제어신호(CON1) 및 제2 제어신호(CON2)을 발생시킬 수 있다.
상기 제어신호 발생부(110)로 입력되는 신호는 펄스폭 변조 오실레이터로부 터 출력된 기준 클럭을 기준으로 하여 일정 주기의 온/오프 듀티 비율이 조정된 펄스폭 변조 신호일 수 있다. 상기 제어신호 발생부(110)는 상기 펄스폭 변조 신호를 이용하여 동일한 주기를 갖고, 동일 주기 내에서 서로 구동시간이 다른 펄스 신호인 제1 제어신호(CON1) 및 제2 제어신호(CON2)를 발생시킬 수 있다. 상기 제어신호 발생부의 구체적인 형태는 도 2에서 살펴보겠다.
상기 비교기(120)는, 램프에서 피드백되는 신호의 반파정류 신호를 기설정된 기준신호와 비교하여 램프 상태 신호를 출력할 수 있다. 상기 램프에서 피드백되는 신호에 대한 반파정류 신호는 다이오드 및 저항을 이용한 회로를 사용하여 간단히 얻을 수 있다. 이러한 회로는 상기 인버터 구동 집적회로 내부 또는 외부에 구현될 수 있다. 상기 램프는 냉음극 형광램프(CCFL) 또는 발광 다이오드(LED)일 수 있다.
상기 램프에서 피드백되는 신호는 램프의 상태를 나타낼 수 있다. 예를 들어, 상기 램프가 정상적으로 작동하는 경우에는 교류신호가 피드백될 수 있으며, 상기 램프가 오픈램프(open lamp) 상태라면 피드백되는 신호가 제로(zero)일 수 있다.
상기 비교기(120)에서 출력되는 램프 상태 신호는 상기 램프의 상태를 나타낼 수 있다. 즉, 본 실시형태에서는 상기 램프에서 정상적인 교류신호가 피드백되어 상기 비교기(120)로 입력되는 경우 상기 비교기(120)는 펄스신호를 출력할 수 있다. 상기 비교기(120)로 입력되는 피드백 신호가 제로인 경우에는 상기 비교기(120)에서 출력되는 램프 상태 신호가 로우(low)가 될 수 있다.
상기 제1 감지부(130)는, 상기 비교기에서 출력되는 램프 상태 신호와 상기 제2 제어신호(CON2)를 입력받아 제1 감지신호(OLPT1)를 출력할 수 있다.
상기 제1 감지부(130)는, 상기 제2 제어신호(CON2)를 리셋(R)으로 입력받는 SR 래치회로(131) 및 상기 제2 제어신호(CON2)의 반전신호와 상기 비교기(120)의 출력신호를 입력받아 상기 SR 래치회로의 세트(S)로 출력하는 앤드 게이트(132) 를 포함할 수 있다.
상기 SR 래치회로(131)는, 세트에 하이 신호가 입력된 후에는 리셋에 하이 신호가 입력되기 전까지 하이 신호를 출력하는 특성을 가질 수 있다. 따라서, 본 실시형태에서는, 상기 앤드 게이트(132)에서 하이 신호가 상기 래치의 세트로 입력된 이후에는 상기 제2 제어신호(CON2)가 하이로 될 때까지는 상기 래치회로(131)는 하이 신호를 출력할 수 있다.
상기 제2 감지부(140)는, 상기 제1 감지신호(OLPT1)와 상기 제1 제어신호(CON1)를 입력받아 제2 감지신호(OLPO1)를 출력할 수 있다.
상기 제2 감지부(140)는, 상기 제1 감지부(130)의 출력 신호를 세트(S)로 입력받는 SR 래치회로(141) 및 상기 제1 감지부(130)의 출력신호에 대한 반전신호와 상기 제1 제어신호(CON1)를 입력받아 상기 SR 래치회로의 리셋(R)으로 출력하는 앤드 게이트(142)를 포함할 수 있다.
상기 SR 래치회로(141)의 특성에 의해, 상기 제1 감지신호(OLPT1)이 하이 상태로 된 이후에는 상기 앤드 게이트(142)의 출력신호가 하이 상태가 될 때까지는 상기 래치회로(142)는 하이 신호를 출력할 수 있다.
상기 제어신호 발생부, 비교기, 제1 감지부, 및 제2 감지부는 모두 인버터 구동 집적회로 내에 내장된 형태로 구현될 수 있다. 따라서, 본 실시형태에 따른 인버터 구동 집적회로는 종래에 오픈 램프 등의 감지를 위해 드라이버 집적회로의 외부에 별도의 소자를 사용하여 구현하였던 기능부를 인버터 구동 집적회로 내부에 내장시킬 수 있어 인버터의 소형화를 도모할 수 있다.
도 2는, 본 발명의 일실시 형태에 따른 인버터 구동 집적회로에서 제어신호 발생부의 일실시 형태이다.
도 2를 참조하면, 본 실시형태에 따른 제어신호 발생부(210)는, 제1 플립플롭(flip-flop)(211), 제2 플립플롭(flip-flop)(212), 및 복수개의 논리소자(213, 214, 215)를 포함할 수 있다.
상기 제1 플립플롭(211)은, 펄스폭 변조 오실레이터(PWM OSC)의 신호가 클럭 신호로 입력될 수 있다. 상기 펄스폭 변조 오실레이터의 신호는 소정의 주기를 갖는 펄스신호일 수 있다.
상기 제2 플립플롭(212)은, 펄스폭 변조 오실레이터(PWM OSC)의 신호가 클럭 신호로 입력될 수 있다. 상기 제2 플립플롭(212)으로 상기 제1 플립플롭(211)의 출력신호가 입력될 수 있다.
상기 제2 플립플롭(212)의 출력신호는 NOT 게이트(213)를 통해 상기 제1 플립플롭(211)의 입력으로 피드백될 수 있다.
본 실시형태에서는, 제1 플립플롭(211)과 제2 플립플롭(212)을 상기와 같이 연결함으로써, 상기 제1 플립플롭(211)의 출력신호(Q0)와 상기 제2 플립플롭(212)의 출력신호(Q1)는 상기 펄스폭 변조 오실레이터의 신호의 1주기 만큼 시간적 차이를 가질 수 있다.
제1 앤드 게이트(214)는, 상기 제1 플립플롭의 출력신호(Q0)와 상기 제2 플립플롭의 출력신호(Q1)의 반전신호를 입력받아 논리곱하여 제1 제어신호(CON1)를 출력할 수 있다.
제2 앤드 게이트(215)는, 상기 제1 플립플롭의 출력신호(Q0)와 상기 제2 플립플롭의 출력신호(Q1)를 입력받아 논리곱하여 제2 제어신호(CON2)를 출력할 수 있다.
본 실시형태에서, 상기 제1 제어신호(CON1)와 제2 제어신호(CON2)는 동일한 주기를 가지며, 1 주기 내에서 서로 다른 시간에 하이(high)상태가 인가되는 펄스신호일 수 있다.
도 3의 (a) 내지 (e)는, 각각 도 2에 개시된 제어신호 발생부에서 펄스폭 변조 오실레이터 신호, 제1 플립플롭의 출력신호, 제2 플립플롭의 출력신호, 제1 제어신호 및 제2 제어신호를 나타내는 그래프이다.
이하에서는, 상기 도 2 및 도 3을 참조하여 설명하겠다.
도 3의 (a)를 참조하면 펄스폭 변조 오실레이터 신호는 2 ㎲의 주기(① ~ ②)를 갖고, 상기 1 주기 중 1 ㎲ 동안 하이상태가 인가되는 펄스신호이다.
도 3의 (b)는, 상기 펄스폭 변조 오실레이터 신호가 상기 제1 플립플롭(211)을 거쳐 출력되는 신호(Q0)를 나타내고 있다. 상기 제1 플립플롭(211)의 출력신호(Q0)는 8 ㎲의 주기(① ~ ⑤)를 갖고, 상기 1 주기 중 4 ㎲ 동안 하이상태(① ~ ③)가 인가되는 펄스신호이다.
도 3의 (c)는, 상기 펄스폭 변조 오실레이터 신호가 상기 제2 플립플롭(212)을 거쳐 출력되는 신호(Q1)를 나타내고 있다. 상기 제2 플립플롭(212)의 출력신호(Q1)는 8 ㎲의 주기(① ~ ⑤)를 갖고, 상기 1 주기 중 4 ㎲ 동안 하이상태(② ~ ④)가 인가되는 펄스신호이다. 본 실시형태에서, 상기 제2 플립플롭(212)의 출력신호(Q1)는, 상기 제1 플립플롭(211)의 출력신호(Q0)에 비해 상기 펄스폭 변조 오실레이터 신호의 1 주기만큼 지연된 형태의 신호이다.
도 3의 (d)는, 상기 제1 플립플롭의 출력신호(Q0)와 상기 제2 플립플롭의 출력신호(Q1)의 반전신호를 논리곱(214)하여 출력되는 제1 제어신호(CON1)를 나타내고 있다. 상기 제1 제어신호(CON1)는, 8 ㎲의 주기(① ~ ⑤)를 갖고, 상기 1 주기 중 2 ㎲ 동안 하이상태(① ~ ②)가 인가되는 펄스신호이다.
도 3의 (e)는, 상기 제1 플립플롭의 출력신호(Q0)와 상기 제2 플립플롭의 출력신호(Q1)를 논리곱(215)하여 출력되는 제2 제어신호(CON2)를 나타내고 있다. 상기 제2 제어신호(CON2)는, 8 ㎲의 주기(① ~ ⑤)를 갖고, 상기 1 주기 중 2 ㎲ 동 안 하이상태(② ~ ③)가 인가되는 펄스신호이다.
본 실시형태에서, 상기 제1 제어신호(CON1)와 제2 제어신호(CON2)는, 각각 동일한 주기(8 ㎲)를 가지며, 동일한 1 주기 동안 서로 다른 시간에 하이 상태가 인가되는 펄스신호일 수 있다.
도 4의 (a) 내지 (e)는, 상기 도 1에 개시된 본 발명의 일실시 형태에 따른 인버터 구동 집적회로에서, 제1 제어신호(a), 제2 제어신호(b), 비교기의 출력신호(c), 제1 감지부의 출력신호(d), 및 제2 감지부의 출력신호(e)를 나타내고 있다. 이하에서는 상기 도 1 및 도 4를 참조하여 설명하겠다.
도 4의 (a)는, 상기 제2 감지부(140)에 인가되는 제1 제어신호(CON1)를 나타내고 있다. 상기 제1 제어신호(CON1)는, 8 ㎲의 주기(② ~ ④)를 갖고, 상기 1 주기 중 2 ㎲ 동안 하이상태(② ~ ③)가 인가되는 펄스신호이다.
도 4의 (b)는, 상기 제1 감지부(130)에 인가되는 제2 제어신호(CON2)를 나타내고 있다. 상기 제2 제어신호(CON2)는, 8 ㎲의 주기(② ~ ④)를 갖고, 상기 1 주기 중 2 ㎲ 동안 하이상태가 인가되는 펄스신호이다.
도 4의 (c)는, 상기 비교기(120)를 통과하여 상기 제1 감지부(130)로 입력되는 램프 상태 신호를 나타내고 있다. 본 실시예에서는, 150 ㎲(①)까지는 램프가 정상적으로 작동하여 펄스 신호가 입력되며, 소정시간(⑤와 ⑥사이) 까지는 램프가 오픈램프 상태로 되어 램프 상태 신호가 제로 상태이고, 상기 소정시간 이후에는 다시 램프가 정상적으로 작동하여 펄스 신호가 입력되는 경우의 램프 상태 신호를 나타내고 있다.
도 4의 (d)는, 상기 도 4의 (c)의 램프 상태 신호 및 상기 도 4의 (b)의 제2 제어신호가 입력되어 상기 제1 감지부(130)에서 출력되는 신호를 나타내고 있다.
상기 제1 감지부(130)에서는, 상기 비교기(120)의 출력신호와 상기 제2 제어신호(C0N2)의 반전신호를 논리곱(132)한 신호를 래치회로(131)의 세트로 입력하고, 상기 제2 제어신호(CON2)를 래치회로(131)의 리셋으로 입력하여 제1 감지신호(OLPT)를 출력할 수 있다.
램프가 정상적으로 동작하여 상기 비교기(120)의 출력신호가 정상적인 펄스신호인 경우, 상기 제2 제어신호(CON2)가 하이일 때는 상기 제1 감지신호(OLPT)는 로우가 되고, 상기 제2 제어신호(CON2)가 로우일 때는 상기 제1 감지신호(OLPT)는 하이가 될 수 있다.
램프가 오픈 램프 상태이어서, 상기 비교기(120)의 출력신호가 로우로 되는경우(①), 이후 상기 제2 제어신호(CON2)가 하이상태로 되면 상기 제1 감지신호(OLPT)는 로우 상태로 되어 그 상태를 유지할 수 있다. 이후에 상기 비교기(120)의 출력신호가 정상적인 펄스신호로 되면(⑤) 상기 제2 제어신호(CON2)의 폴링 타임(⑥)이 상기 제1 감지신호(OLPT)의 라이징 타임이 될 수 있다.
도 4의 (e)는, 상기 도 4의 (d)의 제1 감지부 출력신호(OLPT) 및 상기 도 4의 (a)의 제1 제어신호가 입력되어 상기 제2 감지부(140)에서 출력되는 신호를 나타내고 있다.
상기 제2 감지부(140)에서는, 상기 제1 감지부(130)의 출력신호(OLPT)의 반전신호와 상기 제1 제어신호(C0N1)를 논리곱(142)한 신호를 래치회로(141)의 리셋으로 입력하고, 상기 제1 감지부(130)의 출력신호(OLPT)를 래치회로(141)의 세트로 입력하여 제2 감지신호(OLPO)를 출력할 수 있다.
상기 제1 감지신호(OLPT)가 하이로 입력된 후에는, 상기 제1 감지신호(OLPT)가 로우이고 상기 제1 제어신호(CON1)가 하이가 되지 않는 이상 상기 제2 감지신호(OLPO)는 하이 상태를 유지할 수 있다.
상기 제1 감지신호(OLPT)가 로우 상태를 유지하는 경우에는, 상기 제1 제어신호(CON1)가 하이상태(④)로 된 이후에는 상기 제2 감지신호(OLPO)는 로우 상태를 유지한다.
상기 제1 감지신호(OLPT)가 다시 하이 상태로 변하는 때(⑥)에 상기 제2 감지신호(OLPO)도 하이상태가 될 수 있다.
본 실시형태에서, 상기 비교기(120)를 통과하여 제1 감지부(130)로 입력되는 램프 상태 신호에 대한 그래프(c)와 상기 제2 감지부(140)에서 출력되는 신호에 대한 그래프(e)를 비교하면, 상기 램프의 상태가 정상적인 동작을 하여 상기 램프 상태 신호가 펄스파로 입력되는 경우에는 상기 제2 감지부의 출력신호(OLPO)는 하이 상태를 유지할 수 있다.
상기 램프가 오픈램프 상태가 되어 상기 램프 상태 신호가 제로로 변한 경우(①)에도 상기 제2 감지부에서 출력되는 신호는 소정시간(① ~ ④)동안 하이 상태를 유지할 수 있다. 상기 제2 감지부가 하이 상태를 유지하는 시간은 상기 제1 제어신호의 한주기에 해당하는 시간일 수 있다. 상기 제1 제어신호의 한주기에 해당하는 시간은 펄스폭 변조 오실레이터 신호의 4 주기에 해당하는 시간일 수 있다. 이처럼, 본 실시형태에서는 램프에 이상이 발생되더라도 소정시간동안 램프가 정상적으로 동작할 수 있도록 할 수 있다. 상기 소정시간이 지난 후에도 램프의 이상이 감지되면 그 때 상기 제2 감지신호(OLPO)가 로우 상태로 변하게 할 수 있다. 따라서, 본 실시형태에 따른 인버터 구동 집적회로는 램프에 순간적으로 이상이 발생되었다 정상으로 복귀되는 경우에는 램프를 셧다운(Shut-down)시키는 것을 방지할 수 있도록 구현될 수 있어, 불필요한 전력소모를 줄일 수 있고, 램프의 수명을 길게할 수 있다.
상기 램프에 발생된 이상 상태가 치유되어 상기 램프가 정상적으로 동작하게 된 경우에는, 상기 제2 제어신호(CON2)의 폴링타임이 상기 제2 감지신호(OLPO)의 라이징 타임이 되므로, 상기 램프가 정상적으로 작동한 후 비교적 빠른 시간내에 제2 감지신호(OLPO)를 하이 상태로 복구시킬 수 있다.
본 발명은 상술한 실시형태 및 첨부된 도면에 의해 한정되는 것이 아니며, 첨부된 청구범위에 의해 한정하고자 한다. 따라서, 청구범위에 기재된 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 당 기술분야의 통상의 지식을 가진 자에 의해 다양한 형태의 치환, 변형 및 변경이 가능할 것이며, 이 또한 본 발명의 범위에 속한다고 할 것이다.
도 1은, 본 발명의 일실시 형태에 따른 인버터 구동 집적회로의 회로도이다.
도 2는, 본 발명의 인버터 구동 집적회로에 사용되는 제어신호 발생부의 일실시 형태를 나타내는 회로도이다.
도 3의 (a) 내지 (e)는, 각각 도 2에 개시된 제어신호 발생부에서 펄스폭 변조 오실레이터 신호, 제1 플립플롭의 출력신호, 제2 플립플롭의 출력신호, 제1 제어신호 및 제2 제어신호를 나타내는 그래프이다.
도 4의 (a) 내지 (e)는, 본 발명의 일실시 형태에 따른 인버터 구동 집적회로에서, 제1 제어신호, 제2 제어신호, 비교기의 출력신호, 제1 감지부의 출력신호, 및 제2 감지부의 출력신호를 나타내는 그래프이다.
<도면의 주요부분에 대한 부호설명>
110 : 제어신호 발생부 120 : 비교기
130 : 제1 감지부 140 : 제2 감지부

Claims (5)

  1. 펄스폭 변조 오실레이터 신호를 이용하여 서로 동일한 주기를 가지며, 서로 다른 시간대역에 하이 레벨을 갖는 펄스신호인 제1 제어신호 및 제2 제어신호를 발생시키는 제어신호 발생부;
    램프에서 피드백되는 신호의 반파정류 신호를 기설정된 기준신호와 비교하여 램프 상태 신호를 출력하는 비교기;
    상기 램프 상태 신호와 상기 제2 제어신호를 입력받아 상기 램프 상태 신호가 기 설정된 일정 시간을 초과하여 로우 레벨을 유지하는 경우에는 상기 제2 제어신호가 하이 레벨이 되는 순간으로부터 상기 제2 제어신호가 로우 레벨인 동시에 상기 램프 상태 신호가 하이 레벨이 되는 순간까지 로우 레벨을 유지하는 제1 감지신호를 출력하는 제1 감지부; 및
    상기 제1 감지신호와 상기 제1 제어신호를 입력받아 상기 제1 감지신호가 기 설정된 일정 시간을 초과하여 로우 레벨을 유지하는 경우에는 상기 제1 제어신호가 하이 레벨이 되는 순간으로부터 상기 제1 감지신호가 하이 레벨이 되는 순간까지 로우 레벨을 유지하는 제2 감지신호를 출력하는 제2 감지부
    를 포함하며,
    상기 제2 감지신호가 로우 레벨인 경우 램프의 구동을 정지시키는 인버터 구동 집적회로.
  2. 삭제
  3. 제1항에 있어서,
    상기 제어신호 발생부는,
    상기 펄스폭 변조 오실레이터의 신호가 클럭 신호로 입력되는 제1 플립플롭;
    상기 펄스폭 변조 오실레이터의 신호가 클럭 신호로 입력되며, 상기 제1 플립플롭의 출력신호를 입력받는 제2 플립플롭;
    상기 제2 플립플롭의 출력신호를 상기 제1 플립플롭의 입력으로 피드백시키는 NOT 게이트;
    상기 제1 플립플롭의 출력신호와 상기 제2 플립플롭의 출력신호의 반전신호를 입력받아 제1 제어신호를 출력하는 앤드 게이트; 및
    상기 제1 플립플롭의 출력신호와 상기 제2 플립플롭의 출력신호를 입력받아 제2 제어신호를 출력하는 앤드 게이트
    를 포함하는 것을 특징으로 하는 인버터 구동 집적회로.
  4. 제1항에 있어서,
    상기 제1 감지부는,
    상기 제2 제어신호를 리셋으로 입력받는 SR 래치회로; 및
    상기 제2 제어신호의 반전신호와 상기 비교기의 출력신호를 입력받아 상기 SR 래치회로의 세트로 출력하는 앤드 게이트
    를 포함하는 것을 특징으로 하는 인버터 구동 집적회로.
  5. 제1항에 있어서,
    상기 제2 감지부는,
    상기 제1 감지부의 출력 신호를 세트로 입력받는 SR 래치회로; 및
    상기 제1 감지부의 출력신호에 대한 반전신호와 상기 제1 제어신호를 입력받아 상기 SR 래치회로의 리셋으로 출력하는 앤드 게이트
    를 포함하는 것을 특징으로 하는 인버터 구동 집적회로.
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