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KR100726652B1 - 플라즈마 디스플레이 패널의 구동방법 및 장치 - Google Patents

플라즈마 디스플레이 패널의 구동방법 및 장치 Download PDF

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KR100726652B1
KR100726652B1 KR1020050073996A KR20050073996A KR100726652B1 KR 100726652 B1 KR100726652 B1 KR 100726652B1 KR 1020050073996 A KR1020050073996 A KR 1020050073996A KR 20050073996 A KR20050073996 A KR 20050073996A KR 100726652 B1 KR100726652 B1 KR 100726652B1
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Abstract

본 발명은 콘트라스트특성의 저하를 최소화할 수 있는 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 구동장치는 한 프레임기간을 다수의 서브필드들로 시분할하여 플라즈마 디스플레이 패널을 구동하는 장치에 있어서, 상기 다수의 서브필드들 중에서 일부 서브필드의 리셋기간 동안 하강램프파형만 공급하도록 하는 스캔전압구동부를 포함하는 것을 특징으로 한다.
본 발명에 따른 플라즈마 디스플레이 구동방법 및 장치는 일부 서브필드의 리셋기간 중 셋업 구간을 제거함으로써 콘트라스트특성의 저하를 최소화할 수 있으며, 서스테인 기간 후반부에 부극성 램프파 서스테인펄스를 공급하여 전셀을 초기화할 수 있게 된다.

Description

플라즈마 디스플레이 패널의 구동방법 및 장치{METHOD AND APPARATUS FOR DRIVING PLASMA DISPLAY PANEL}
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 전극배치를 개략적으로 나타내는 평면도이다.
도 2는 256 계조를 구현하기 위한 8 비트 디폴트 코드의 서브필드 패턴을 나타내는 도면이다.
도 3은 통상적인 PDP의 구동 파형을 나타내는 파형도이다.
도 4는 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 구동장치를 개략적으로 나타내는 블럭도이다.
도 5는 본 발명의 실시 예에 따른 PDP의 구동파형을 나타내는 파형도이다.
도 6은 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 서브필드 패턴을 나타내는 도면이다.
< 도면의 주요 부분에 대한 부호의 설명 >
31 : 타이밍콘트롤러 32 : 데이터구동부
33 : 스캔구동부 34 : 서스테인구동부
35 : 구동전압 발생부
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 콘트라스트특성의 저하를 최소화할 수 있는 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 한다)은 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 방전할 때 발생하는 자외선을 이용하여 형광체를 여기 발광시킴으로써 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 화질이 향상되고 있다.
도 1을 참조하면, 종래의 3전극 교류 면방전형 PDP의 방전셀은 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과, 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과 직교하는 어드레스전극(X1 내지 Xm)을 포함한다.
스캔전극(Y1 내지 Yn), 서스테인전극(Z) 및 어드레스전극(X1 내지 Xm)의 교차부에는 적색, 녹색 및 청색 중 어느 하나를 표시하기 위한 셀(1)이 형성된다. 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)은 도시하지 않은 상부기판 상에 형성된다. 상부기판에는 도시하지 않는 유전체층과 MgO 보호층이 적층된다. 어드레스전극(X1 내지 Xm)은 도시하지 않은 하부기판 상에 형성된다. 하부기판 상에는 수평으로 인접한 셀들 간에 광학적, 전기적 혼신을 방지하기 위한 격벽이 형성된다. 하부기판과 격벽 표면에는 진공자외선에 의해 여기되어 가시광을 방출하는 형광체가 형성된다. 상부기판과 하부기판 사이의 방전공간에는 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 주입된다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 리셋기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 2와 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 8개의 서브 필드들(SF1 내지 SF8) 각각은 전술한 바와 같이, 초기화기간, 어드레스기간 및 서스테인기간으로 나누어지게 된다. 각 서브필드의 초기화기간과 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간과 그에 할당되는 서스테인펄스의 수는 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 3은 두 개의 서브필드에 공급되는 PDP의 구동파형을 나타낸다.
도 3을 참조하면, PDP는 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나누어 구동된다.
리셋기간의 초기에는 모든 스캔전극들(Y)에 상승 램프파형(Ramp-up)이 인가되며, 서스테인전극(Z)과 어드레스전극(X)에는 0[V]가 인가된다. 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에서 스캔전극(Y)과 어드레스전극(X) 사이와 스캔전극(Y)과 서스테인전극(Z) 사이에는 빛이 거의 발생되지 않는 쓰기 암방전(Dark discharge) 또는 셋업방전이 일어난다. 이러한 셋업방전에 의해 어드레스전극(X)과 서스테인전극(Z) 상에는 정극성(+)의 벽전하가 쌓이게 되며, 스캔전극(Y) 상에는 부극성(-)의 벽전하가 쌓이게 된다.
리셋기간의 후기에는 대략 서스테인전압(Vs)부터 하강하기 시작하는 하강 램프파형(Ramp-dn)이 스캔전극들(Y)에 동시에 인가된다. 이와 동시에, 서스테인전극(Z)에는 정극성의 서스테인전압(Vs)이 인가되고, 어드레스전극(X)에는 0[V]가 인가된다. 이렇게 하강 램프파형(Ramp-dn)이 인가될 때, 스캔전극(Y)과 서스테인전극(Z) 사이에 빛이 거의 발생되지 않는 소거 암방전 또는 셋다운방전이 일어난다. 이러한 셋다운방전에 의해 어드레스방전에 불필요한 과도 벽전하가 소거된다.
어드레스기간에는 부극성 스캔펄스(scan)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 스캔펄스(scan)에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 스캔펄스(scan)와 데이터펄스(data)의 전압차와 초기화기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 서스테인전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다.
서스테인전극(Z)에는 셋다운기간과 어드레스기간 동안에 스캔전극(Y)과의 전 압차를 줄여 스캔전극(Y)과의 오방전이 일어나지 않도록 정극성 직류전압(Zdc)이 공급된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 서스테인방전 즉, 표시방전이 일어나게 된다.
이와 같은 구조를 가지는 종래의 PDP는 리셋기간 동안 셋업 및 셋 다운파형이 공급됨에 따라 방전이 발생하게 되고, 이러한 방전에 의하여 리셋기간에 광이 발생하게 된다. 이러한 리셋기간 동안 발생하는 방전에 의하여 콘트라스트가 매우 열화되는 문제점이 생기게 된다.
따라서, 본 발명의 목적은 콘트라스트특성의 저하를 최소화할 수 있는 PDP의 구동방법 및 장치를 제공함에 있다.
상기 목적을 달성하기 위하여, 본 발명에 따른 플라즈마 디스플레이 구동장치는 한 프레임기간을 다수의 서브필드들로 시분할하여 플라즈마 디스플레이 패널을 구동하는 장치에 있어서, 상기 다수의 서브필드들 중에서 일부 서브필드의 리셋기간 동안 하강램프파형만 공급하도록 하는 스캔전압구동부를 포함한다.
상기 하강램프파형은 기저전압에서 스캔전압까지 하강하는 램프파형인 것을 특징으로 한다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동장치는 셀을 초기화하기 위한 리셋기간, 셀을 어드레싱하기 위한 어드레스기간, 방전을 유지하기 위한 서스테인기간으로 구분되는 다수의 서브필드로 분할되어 구동되는 플라즈마 디스플레이 패널을 구동하는 장치에 있어서, 어드레스전극들에 데이터를 공급하기 위한 데이터구동부; 스캔전극들을 구동하기 위한 스캔구동부; 및 공통전극인 서스테인전극을 구동하기 위한 서스테인구동부를 포함하고 상기 스캔구동부는 상기 리셋기간 동안 일정 기울기를 가지는 제 1 상승램프파형, 제 1 상승램파형보다 크기가 작은 제 2 상승램프파형, 제 1 및 제 2 상승램프파형으로부터 스캔전극에 공급되는 부극성 스캔전압까지 하강하는 제 1 하강램프파형 및 기저전압에서 스캔전압까지 하강하는 제 2 하강램프파형을 공급하는 것을 특징으로 한다.
상기 각 구동부를 제어하기 위한 타이밍콘트롤러; 및 상기 각 구동부에 구동전압을 공급하기 위한 구동전압 발생부를 더 포함하고, 상기 구동전압 발생부는 상기 제 1 및 제 2 상승램프파형과 상기 제 1 및 제 2 하강램프파형을 생성하는 것을 특징으로 한다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 셀을 초기화하기 위한 리셋기간, 셀을 어드레싱하기 위한 어드레스기간 및 방전을 유지하기 위한 서스테인기간으로 구분되는 다수의 서브필드로 분할되어 구동되는 플라즈마 디스플레이 패널을 구동하는 방법에 있어서, 상기 서브필드 중 적어도 하나의 리셋기간 동안 기저전압에서 스캔전극에 공급되는 부극성 스캔전압까지 하강하는 하강램프파형만 공급되는 단계를 포함한다.
이하, 도 4 내지 도 6을 참조하여 본 발명의 바람직한 실시 예들에 대하여 설명하기로 한다.
도 4를 참조하면, 본 발명의 실시 예에 따른 PDP의 구동장치는 PDP의 어드레스전극들(X1 내지 Xm)에 데이터를 공급하기 위한 데이터구동부(32)와, 스캔전극들(Y1 내지 Yn)을 구동하기 위한 스캔구동부(33)와, 공통전극인 서스테인전극(Z)을 구동하기 위한 서스테인구동부(34)와, 각 구동부(32,33,34)를 제어하기 위한 타이밍콘트롤러(31)와, 각 구동부(32,33,34)에 구동전압을 공급하기 위한 구동전압 발생부(35)를 포함한다.
데이터구동부(32)에는 도시하지 않은 역감마보정회로, 오차확산회로 등에 의해 역감마보정 및 오차확산 된 후, 서브필드 맵핑회로에 의해 미리 설정된 서브필드 패턴에 맵핑된 데이터가 공급된다. 이 데이터구동부(32)는 타이밍콘트롤러(31)의 제어 하에 데이터를 샘플링하고 래치한 다음, 그 데이터를 어드레스전극들(X1 내지 Xm)에 공급하게 된다.
스캔구동부(33)는 타이밍 콘트롤러(31)의 제어 하에 리셋 기간 중 셋업 및 셋 다운기간이 모두 존재하는 서브필드에서는 셋 업 및 제 1 하강 램프파형(Ramp-dn1)을 공급하는 반면에, 리셋 기간 중 셋 업 구간이 존재하지 않는 서브필드에서는 전화면을 초기화하기 위하여 제 2 하강 램프파형(Ramp-dn2)을 스캔전극들(Y1 내지 Yn)에 연속으로 공급한 후, 스캔라인을 선택하기 위하여 어드레스기간 동안 부 극성의 스캔펄스(scan)를 스캔전극들(Y1 내지 Yn)에 순차적으로 공급하게 된다. 여기서, 제 1 하강 램프파형(Ramp-dn1)과 제 2 하강램프파형(Ramp-dn2)는 동일한 파형이거나, 기울기가 다른 파형이 될 수 있다.
서스테인구동부(34)는 타이밍 콘트롤러(41)의 제어 하에 리셋기간 동안 정극성의 직류전압을 공급하게 된다. 또한, 서스테인구동부(34)는 어드레스기간 동안 정극성의 직류 바이어스전압을 서스테인전극(Z)에 공급한 후, 서스테인기간 동안 스캔구동부(33)와 교대로 동작하여 서스테인펄스를 서스테인전극(Z)에 공급한다.
타이밍 콘트롤러(31)는 수직/수평 동기신호를 입력받고 각 구동부(32,33,34)에 필요한 타이밍제어신호(CTRX,CTRY,CTRZ)를 발생하고 그 타이밍제어신호(CTRX,CTRY,CTRZ)를 해당 구동부(32,33,34)에 공급함으로써 각 구동부(32,33,34)를 제어하게 된다. 데이터구동부(32)에 공급되는 타이밍제어신호(CTRX)에는 데이터를 샘플링하기 위한 샘플링클럭, 래치제어신호, 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다. 타이밍 콘트롤러(31)로부터 스캔구동부(33)에 인가되는 타이밍제어신호(CTRY)에는 스캔구동부(33) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다. 그리고 타이밍 콘트롤러(31)로부터 서스테인구동부(34)에 인가되는 타이밍제어신호(CTRZ)에는 서스테인구동부(34) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다.
구동전압 발생부(35)는 상승 램프파형의 상한 전압으로 공급되는 제 1 및 제 2 셋업전압(Vsetup1,Vsetup2), 어드레스기간 동안 스캔전극(Y)에 공급되는 스캔바 이어스전압(Vscan-com), 대략 서스테인전압(Vs)부터 하강하기 시작하여 스캔전압(Vscan)하강하는 제 1 하강 램프파형(Ramp-dn1)을 가지는 제 1 셋다운전압(Vsetdown1)과, 0[V]에서 스캔전압(Vscan)까지 하강하는 제 2 하강 램프파형(Ramp-dn2)을 가지는 제 2 셋다운전압(Vsetdown2)과, 스캔펄스의 전압으로 설정되는 스캔전압(Vscan), 서스테인펄스의 서스테인전압(Vs), 데이터전압(Vd) 등을 발생한다. 여기서, 제 1 셋다운전압(Vsetdown1) 및 제 2 셋다운 전압(Vsetdown2)은 0~-100[V] 사이에서 선택될 수 있다. 제 1 셋업전압(Vsetup1)은 통상적인 셋업전압으로서 대략 250~270[V] 내외의 전압이다. 제 2 셋업전압(Vsetup2)은 제 1 셋업전압의 10~30%에 해당하는 크기의 전압을 가진다. 스캔바이어스전압(Vscan-com)은 서스테인전압(Vs)보다 낮은 정극성 전압으로 설정된다. 스캔전압(Vscan)은 -70∼-100[V] 내에서 선택될 수 있다. 서스테인전압(Vs)은 180∼200[V] 내에서 선택될 수 있다. 데이터전압(Vd)은 대략 50∼80[V] 사이에서 선택될 수 있다.
한편, 상기 전압조건은 위와 같이 한정되는 것이 아니라 PDP의 방전특성이나 모델에 따라 달라질 수 있다.
도 5 및 도 6은 본 발명의 실시 예에 따른 PDP의 구동파형을 나타낸다.
도 5 및 도 6을 참조하면, 본 발명의 실시 예에 따른 PDP는 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시킴과 아울러 후반부에 전 셀을 초기화시키기는 서스테인기간으로 나누어 구동된다.
리셋기간에 대하여는 i 번째(단, i는 임의의 양의 정수) 서브필드(SFi)와 j 번째 서브필드(SFj) 및 k 번재 서브플디(SFk)(단, k, j, i는 서로 다른 임의의 양 의 정수)로 나누어 설명하기로 한다. i 번째 서브필드(SFi)와 j 번째 서브필드(SFj) 및 k 번째 서브필드(SFk)는 한 프레임 기간 내에 배치된다.
i 번째 서브필드(SFi)에서 리셋기간의 초기에는 모든 스캔전극들(Y)에 제 1 셋업전압(Vsetup1)까지 상승하는 상승 램프파형(Ramp-up1)이 인가된다. 이와 동시에, 서스테인전극(Z)과 어드레스전극(X)에는 0[V]가 인가된다. 이 상승 램프파형(Ramp-up1)은 스캔전극(Y)과 서스테인전극(Z) 사이의 전압차, 스캔전극(Y)과 어드레스전극(X) 사이의 전압차를 크게 하여 셋업방전을 안정하게 일으킴으로써 스캔전극(Y) 사이에 충분한 양의 부극성 벽전하를 축적시켜 어드레스 구동마진을 높여 휘점 오방전을 줄이게 된다.
j 번째 서브필드(SFj)에서 리셋기간의 초기에는 모든 스캔전극들(Y)에 제 1 셋업전압(Vsetup1)보다 낮은 제 2 셋업전압(Vsetup2)까지 상승하는 상승 램프파형(Ramp-up2)이 인가된다. 이와 동시에, 서스테인전극(Z)과 어드레스전극(X)에는 0[V]가 인가된다. 이 상승 램프파형(Ramp-up2)은 셋업방전을 약하게 일으킴으로써 빛방출을 최소화하여 콘트라스트특성을 향상시키게 된다.
k 번째 서브필드(SFk)에서는 리셋기간의 초기 셋업 구간이 존재하지 않는다.
i 번째 서브필드(SFi)와 j 번째 서브필드(SFj)에서 리셋기간의 후기에는 대략 서스테인전압(Vs)부터 하강하기 시작하여 스캔전압(Vscan)까지 하강하는 제 1 하강 램프파형(Ramp-dn1)이 스캔전극들(Y)에 인가된다. 이와 동시에, 서스테인전극(Z)에는 서스테인전압(Vs)이 인가되고, 어드레스전극(X)에는 0[V]가 인가된다. 이렇게 제 1 하강 램프파형(Ramp-dn1)이 인가될 때, 스캔전극(Y)과 서스테인전극(Z) 사이에 빛이 거의 발생되지 않는 소거 암방전 또는 셋다운방전이 일어난다. 이러한 셋다운방전에 의해 어드레스방전에 불필요한 과도한 벽전하가 소거된다.
k 번째 서브필드(SFk)에서 리셋기간 중 셋 다운 기간에는 0[V]에서 스캔전압(Vscan)까지 하강하는 제 2 하강 램프파형(Ranp-dn2)이 공급됨에 따라 빛이 거의 발생되지 않는 소거 암방전 또는 셋다운 방전이 발생하게 된다.
어드레스기간과 서스테인기간은 i 번째 서브필드(SFi)와 j 번째 서브필드(SFj) 및 k번째 서브필드(SFk)에서 동일하게 구동되며 전술한 도 3의 그 것과 실질적으로 동일하므로 이에 대한 상세한 설명을 생략하기로 한다.
한편, 셋업전압이 높게 설정되는 i 번째 서브필드(SFi)는 프레임기간의 초기에 배치된 적어도 하나 이상의 서브필드로 선택되는 것이 바람직하다.
이와 같은 구조를 가지는 본 발명의 실시 예에 따른 PDP 구동방법은 한 프레임 내에서 k 번째 서브필드(SFk)가 적어도 하나 이상 존재하여 리셋기간 중 셋업구간이 제거됨으로써 전체적으로 리셋기간 동안 발생하는 방전을 억제하고 빛방출을 최소화함으로써 콘트라스트를 극대화할 수 있게 된다. 여기서, i 번째 서브필드(SFi) 및 j 번째 서브필드(SFj)는 벽전하 유지 등을 위하여 한 프레임 내에서 하나 이상 배치될 수 있다.
상술한 바와 같이, 본 발명에 따른 PDP의 구동방법 및 장치는 일부 서브필드의 리셋기간 중 셋업 구간을 제거함으로써 콘트라스트 특성의 저하를 최소화할 수 있으며, 서스테인 기간 후반부에 부극성 램프파 서스테인펄스를 공급하여 전셀을 초기화할 수 있게 된다. 또한, 본 발명에 따른 PDP 구동방법 및 장치는 종래와 비교하여 셋업 구간에 제거됨으로써 시간을 절약할 수 있게 된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (5)

  1. 한 프레임기간을 다수의 서브필드들로 시분할하여 플라즈마 디스플레이 패널을 구동하는 장치에 있어서,
    상기 다수의 서브필드들 중에서 일부 서브필드의 리셋기간 동안 하강램프파형만 공급하도록 하는 스캔전압구동부를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  2. 제 1 항에 있어서,
    상기 하강램프파형은
    기저전압에서 스캔전압까지 하강하는 램프파형인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  3. 셀을 초기화하기 위한 리셋기간, 셀을 어드레싱하기 위한 어드레스기간 및 방전을 유지하기 위한 서스테인기간으로 구분되는 다수의 서브필드로 분할되어 구동되는 플라즈마 디스플레이 패널을 구동하는 장치에 있어서,
    어드레스전극들에 데이터를 공급하기 위한 데이터구동부;
    스캔전극들을 구동하기 위한 스캔구동부; 및
    공통전극인 서스테인전극을 구동하기 위한 서스테인구동부를 포함하고,
    상기 스캔구동부는 상기 리셋기간 동안 일정 기울기를 가지는 제 1 상승램프파형과, 제 1 상승램프파형보다 크기가 작은 제 2 상승램프파형과, 제 1 및 제 2 상승램프파형으로부터 스캔전극에 공급되는 부극성 스캔전압까지 하강하는 제 1 하강램프파형 및 기저전압에서 스캔전압까지 하강하는 제 2 하강램프파형을 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  4. 제 3 항에 있어서,
    상기 각 구동부를 제어하기 위한 타이밍콘트롤러; 및 상기 각 구동부에 구동전압을 공급하기 위한 구동전압 발생부를 더 포함하고,
    상기 구동전압 발생부는
    상기 제 1 및 제 2 상승램프파형과 상기 제 1 및 제 2 하강램프파형을 생성하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  5. 셀을 초기화하기 위한 리셋기간, 셀을 어드레싱하기 위한 어드레스기간, 방전을 유지하기 위한 서스테인기간으로 구분되는 다수의 서브필드로 분할되어 구동되는 플라즈마 디스플레이 패널을 구동하는 방법에 있어서,
    상기 서브필드 중 적어도 하나의 리셋기간 동안 기저전압에서 스캔전극에 공급되는 부극성 스캔전압까지 하강하는 하강램프파형만 공급되는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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