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KR100705815B1 - 플라즈마 디스플레이 패널의 구동장치 및 그 구동방법 - Google Patents

플라즈마 디스플레이 패널의 구동장치 및 그 구동방법 Download PDF

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KR100705815B1
KR100705815B1 KR1020050059437A KR20050059437A KR100705815B1 KR 100705815 B1 KR100705815 B1 KR 100705815B1 KR 1020050059437 A KR1020050059437 A KR 1020050059437A KR 20050059437 A KR20050059437 A KR 20050059437A KR 100705815 B1 KR100705815 B1 KR 100705815B1
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Abstract

본 발명은 플라즈마 디스플레이 패널의 구동장치 및 그 구동방법에 관한 것이다.
본 발명은 리셋기간에 최소기준전압으로부터 소정의 기울기로 상승하는 상승 램프파형과 하강 램프파형을 이용하여 패널 커패시터를 리셋하며 어드레스 및 서스테인기간에 부극성 스캔전압과 서스테인전압을 이용하여 패널 커패시터의 스캔전극을 구동하는 스캔 구동부와, 리셋기간, 어드레스 및 서스테인기간에 부극성 서스테인전압을 이용하여 패널 커패시터의 서스테인전극을 구동하는 서스테인 구동부와, 어드레스전압을 이용하여 어드레스전극을 구동하는 어드레스 구동부를 포함하는 플라즈마 디스플레이 패널의 구동장치를 제공한다.
이에 따라, 높은 전압의 스위치 소자들을 사용하지 않아 구성이 단순하고 저가격화할 수 있으며, 높은 고전압의 셋업전압을 공급하기 위한 바이어스 전압을 사용할 필요가 없어 저전압 구동이 가능한 효과가 있다.

Description

플라즈마 디스플레이 패널의 구동장치 및 그 구동방법{APPARATUS AND METHOD FOR DRIVING PLASMA DISPLAY PANEL}
도 1은 플라즈마 디스플레이 패널에서 216 계조를 구현하기 위한 8 비트 디폴트 코드의 서브필드 패턴을 나타내는 도면.
도 2는 종래 플라즈마 디스플레이 패널의 구동파형을 나타내는 도면.
도 3은 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 구동장치를 나타내는 도면.
도 4은 도 3에 도시된 플라즈마 디스플레이 패널의 구동장치에 의해 생성되는 구동 파형을 나타내는 도면.
< 도면의 주요 부분에 대한 부호의 설명 >
12 : 스캔 구동부 14 : 서스테인 구동부
16 : 어드레스 구동부 18 : 셋업파형 공급부
20 : 셋다운파형 공급부
22 : 스캔기준전압 공급부 25 : 스캔집적회로
26 : 서스테인펄스 공급부
SW1 내지 SW7 : 스위치 R1, R2 : 가변저항
본 발명은 플라즈마 디스플레이 패널의 구동장치 및 그 구동방법에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel)은 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 방전할 때 발생하는 자외선을 이용하여 형광체를 여기 발광시킴으로써 화상을 표시한다. 이러한, PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 화질이 향상되고 있다.
도 1은 플라즈마 디스플레이 패널에서 216 계조를 구현하기 위한 8 비트 디폴트 코드의 서브필드 패턴을 나타내는 도면이다.
도 1을 참조하면, 플라즈마 디스플레이 패널은 화상의 계조를 구현하기 위해 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동한다. 각 서브필드는 전화면을 초기화시키기 위한 리셋기간, 스캔라인을 선택하고 선택된 스캔라인에서 방전셀을 선택하기 위한 어드레스기간 및 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나누어진다. 예를 들어, 216 계조로 화상을 표시하고자 하는 경우에 1/20 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 8개의 서브필드들(SF1 내지 SF8) 각각은 전술한 바와 같이, 리셋기간(RP), 어드레스기간(AP) 및 서스테인기간(SP)으로 나누어진다. 이때, 각 서브필드의 리셋기간(RP)과 어드레스기간(AP)은 각 서브필드마다 동일한 반면에 서스테인 기간과 그에 할당되는 서스테인펄스의 수는 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 2는 종래의 플라즈마 디스플레이 패널의 구동 파형을 나타내는 도면이다.
도 2를 참조하면, 서브필드(SF) 각각은 전화면의 방전셀들을 초기화하기 위한 리셋기간(RP), 방전셀을 선택하기 위한 어드레스기간(AP) 및 선택된 방전셀들의 방전을 유지시키기 위한 서스테인기간(SP)을 포함한다.
리셋기간(RP)에 있어서, 셋업기간(SU)에는 모든 스캔전극들(Y)에 상승 램프파형(PR)이 동시에 인가된다. 이 상승 램프파형(PR)에 의해 전화면의 셀들 내에는 미약한 방전(셋업방전)이 일어나게 되어 셀들 내에 벽전하가 생성된다. 셋다운기간(SD)에는 상승 램프파형(PR)이 인가된 후, 상승 램프파형(PR)의 피크전압보다 낮은 정극성(+)의 서스테인전압(Vs)에서 부극성의 스캔전압(-Vy)까지 소정의 기울기로 하강하는 하강 램프파형(NR)이 스캔전극들(Y)에 동시에 인가된다. 하강 램프파형(NR)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시켜 전화면의 셀들 내에 어드레스방전에 필요한 벽전하를 균일하게 잔류시킨다.
어드레스기간(AP)에는 부극성(-)의 스캔펄스(SCNP)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들에 정극성(+)의 데이터펄스(DP)가 인가된다. 이 스캔펄스(SCNP)와 데이터펄스(DP)의 전압차와 리셋기간(RP)에 생성된 벽전압이 더해지면서 데이터펄스(DP)가 인가되는 셀 내에는 어드레스방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 벽전하가 생성된다.
한편, 셋다운기간(SD)과 어드레스기간(AP) 동안에 서스테인전극들(Z)에는 정극성(+)의 서스테인전압(Vs)이 인가된다.
서스테인기간(SP)에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(SUSP)가 인가된다. 그러면, 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(SUSP)가 더해지면서 매 서스테인펄스(SUSP)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 면방전 형태로 서스테인방전이 일어난다. 여기서, 서스테인펄스들(SUSP)은 서스테인전압(Vs)과 동일한 전압값을 갖는다.
이와 같은 종래의 플라즈마 디스플레이 패널은 스캔전극(Y)에 리셋펄스(PR, NR)를 공급할 때 상승 램프파형(PR)에 의해 높은 정극성의 전압(셋업전압), 예를들어 400V와 하강 램프파형(NR)에 의해 부극성의 스캔전압(-Vy), 예를 들어 -90V를 공급하기 때문에 두 전압 간의 차이를 제어 또는 절연하기 위해 높은 내압을 갖는 스위치 소자를 사용하거나 별도의 스위치 소자를 사용하여야 하였다. 이때, 400V의 높은 정극성 셋업전압을 공급하기 위하여 스위치 소자의 고전압 스위칭 전압을 낮추기 위하여 통상 200V까지 바이어한후 200V 스위칭하는 방법을 사용하였다.
이와 같이 높은 전압의 스위치 소자를 사용함에 따라 가격이 상승하고 저항값이 증가하여 발열의 원인이 되거나 구동시 저항에 의한 전압 저하의 원인이 되어 구동조건을 악회시키는 문제점이 있었다.
또한, 인접한 소자들의 연결부위도 높은 전압으로 인하여 절연시켜야 하므로 구동시 다른 소자의 내압과 관련되어 소자가 파괴되거나 오동작을 초래하는 문제점이 있었다.
따라서, 본 발명의 목적은 높은 전압의 스위치 소자들을 사용하지 않아 구성이 단순하고 저가격화할 수 있으며, 높은 고전압의 셋업전압을 공급하기 위한 바이어스 전압을 사용할 필요가 없어 저전압 구동이 가능한 플라즈마 디스플레이 패널의 구동장치 및 그 구동방법을 제공하는 데 있다.
상기 목적을 달성하기 위하여, 본 발명은 리셋기간에 최소기준전압으로부터 소정의 기울기로 상승하는 상승 램프파형과 하강 램프파형을 이용하여 패널 커패시터를 리셋하며 어드레스 및 서스테인기간에 부극성 스캔전압과 서스테인전압을 이용하여 패널 커패시터의 스캔전극을 구동하는 스캔 구동부와, 리셋기간, 어드레스 및 서스테인기간에 부극성 서스테인전압을 이용하여 패널 커패시터의 서스테인전극을 구동하는 서스테인 구동부와, 어드레스전압을 이용하여 어드레스전극을 구동하는 어드레스 구동부를 포함하는 플라즈마 디스플레이 패널의 구동장치를 제공한다.
이때, 상승 램프파형의 최소기준전압은 그라운드이며, 하강 램프파형은 상승 램프파형의 최소기준전압으로부터 소정의 기울기로 하강할 수 있다.
또한, 상승 램프파형과 하강 램프파형의 기울기가 동일할 수 있다.
또한, 스캔 구동부의 스캔전압의 기준전압은 부극성일 수 있다.
또한, 스캔 구동부의 하강 램프파형은 스캔전압까지 하강할 수 있다.
또한, 스캔 구동부의 스캔전압의 기준전압은 서스테인전압과 동일할 수 있 다.
또한, 스캔 구동부의 상승 램프파형의 피크전압은 0~200V이며, 하강 램프파형의 피크전압은 300~800V일 수 있다.
또다른 측면에서, 본 발명은, 리셋기간에 상승 램프파형과 하강 램프파형을 패널 커패시터의 스캔전극에 공급하며, 하강 램프파형이 공급될 때 부극성 전압을 패널 커패시터의 서스테인전극에 공급하는 리셋단계와, 어드레스기간에 부극성 스캔전압과 서스테인전압을 이용하여 상기 패널 커패시터의 스캔전극에 공급하며, 데이터전압을 어드레스전극에 공급하는 어드레스단계와; 서스테인기간 동안 부극성 서스테인전압을 갖는 서스테인펄스를 패널 커패시터의 스캔전극과 서스테인전극에 교대로 공급하는 서스테인단계를 포함하는 플라즈마 디스플레이 패널의 구동방법를 제공한다.
이때, 상승 램프파형과 하강 램프파형의 기울기가 동일할 수 있다.
또한, 스캔전압의 기준전압은 부극성일 수 있다.
또한, 리셋단계의 하강 램프파형은 스캔전압까지 하강할 수 있다.
또한, 스캔전압의 기준전압은 서스테인전압과 동일할 수 있다.
또한, 상승 램프파형의 피크전압은 0~200V이며, 상기 하강 램프파형의 피크전압은 300~800V일 수 있다.
이하, 도면을 참조하여 본 발명의 일실시예를 상세히 설명한다.
도 3은 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 구동장치를 나타내는 도면이며, 도 4는 도 3에 도시된 플라즈마 디스플레이 패널의 구동장치에 의해 생성되는 구동 파형을 나타내는 도면이다.
도 3 및 도 4를 참조하여 플라즈마 디스플레이 패널의 구동장치 및 각 기간별 구동 파형을 설명한다.
도 3 및 도 4를 참조하면, 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 구동장치(10)는 셋업파형, 셋다운파형, 기저전압(GND) 및 스캔전압, 서스테인펄스를 이용하여 패널 커패시터(Cp1)의 스캔전극(Y)을 구동하는 스캔 구동부(12)와, 기저전압(GND) 및 서스테인펄스를 이용하여 패널 커패시터(Cp1)의 서스테인전극(Z)을 구동하는 서스테인 구동부(14), 데이터전압(Va)을 이용하여 패널 커패시터(Cp2, Cp3)의 어드레스전극(X)을 구동하는 어드레스 구동부(16)를 포함한다.
이때, 도 3의 패널 커패시터(Cp1)는 플라즈마 디스플레이 패널(10)의 스캔전극(Y)과 서스테인전극(Z) 사이에 형성되는 정전용량을 등가적으로 나타낸 것이다. 이러한, 패널 커패시터(Cp1)는 스캔전극(Y) 및 서스테인전극(Z)에 공급된 서스테인펄스에 의해 서스테인 방전을 발생한다. 패널 커패시터(Cp2, Cp3)는 플라즈마 디스플레이 패널(10)의 어드레스전극(X)과 각각 스캔전극(Y) 및 서스테인전극(Z) 사이에 형성되는 정전용량을 등가적으로 나타낸 것이다.
스캔 구동부
스캔 구동부(12)는, 패널 커패시터(Cp1)의 스캔전극(Y)에, 리셋기간(RP) 동안 램프파형으로 정극성 셋업전압(Vset up)까지 상승하는 셋업파형와 램프파형으로 기저전압으로부터 부극성 스캔전압(-Vy)까지 하강하는 셋다운파형를 갖는 리셋펄스 를 공급한다. 이때 상승 램프파형과 하강 램프파형의 기울기는 동일하나 이에 제한되지 않는다.
또한, 스캔 구동부(12)는 패널 커패시터(Cp1)의 스캔전극(Y)에, 어드레스기간(AP) 및 서스테인기간(SP) 동안 부극성 스캔전압과 스캔기준 전압, 교번하는 부극성 서스테인펄스를 공급한다.
이를 위해, 스캔 구동부(12)는 셋업파형 공급부(18)와, 셋다운파형 공급부(20), 스캔기준전압 공급부(22), 스캔전압 공급부(24), 스캔집적회로(25), 서스테인펄스 공급부(26)를 포함한다.
셋업파형 공급부(18)는 제1노드(N1)에 서스테인펄스 공급부(26)와 스캔직접회로(25)와 연결되어 있으며, 다른 한편으로 셋업전압공급원(Vset up)에 연결되어 있다. 셋업파형 공급부(18)는 리셋기간(RP) 동안 패널 커패시터(Cp1)의 스캔전극(Y)에, 기저전압(GND)에서 램프파형으로 소정의 기울기로 정극성 셋업전압(Vset up)까지 상승하는 셋업파형를 공급한다.
셋업파형 공급부(18)는 제1노드(N1)와 정극성의 셋업전압공급원(Vset up) 사이에 접속된 제1스위치(SW1)와 제1스위치(SW1)의 게이트 단자에 접속된 제1가변저항(R1)을 포함한다. 셋업파형 공급부(18)는 리셋기간(RP) 동안 패널 커패시터(Cp1)의 스캔전극(Y)에, 타이밍 콘트롤러(도시하지 않음)로부터 공급되는 스위칭 제어신호에 응답하여 기저전압에서 소정의 기울기로 정극성 셋업전압(Vset up), 예를 들어 200V까지 상승하는 상승 램프파형을 공급한다.
즉, 기저전압에서 타이밍 콘트롤러로부터 공급되는 스위칭 제어신호에 응답 하여 제1스위치(SW1)이 온되면서 제1가변저항(R1)에 의해 소정의 기울기를 갖는 램프파형이 패널 커패시터(Cp1)의 스캔전극(Y)에 공급된다.
이때 램프파형의 최소기준전압은 기저전압(GND)인 것으로 설명하였으나, 셋업파형의 피크전압을 낮출 수 있는 범위의 최소전압일 수 있다. 이와 같이 셋업파형의 최소기준전압을 기저전압 또는 최소전압으로 낮추므로 램프파형의 피크전압을 낮출 수 있다.
셋다운파형 공급부(20)는 제1노드(N1)에 스캔전압 공급부(24)와 서스테인펄스 공급부(26)와 병렬로 접속되어 있으며, 다른 한편으로 부극성 스캔전압공급원(-Vy)에 연결되어 있다. 셋다운파형 공급부(20)는 리셋기간(RP) 동안 셋업파형 공급부(18)의 상승 램프파형에 뒤이어 타이밍 콘트롤러로부터 공급되는 스위칭 제어신호에 응답하여 기저전압에서 부극성의 스캔전압(-Vy), 예를 들어 -300V까지 소정의 기울기로 하강하는 하강 램프파형을 패널 커패시터(Cp1)의 스캔전극(Y)에 공급한다.
위에서, 정극성 셋업전압은 200V, 부극성의 스캔전압(-Vy)는 -300V라 설명하였으나, 이들은 방전셀의 스캔전극(Y)과 서스테인전극(Z) 사이 대항 방전이나 면방전을 유도하기에 충분한 전압차이를 가지면 충분하다. 따라서, 정극성 셋업전압은 0~200V일 경우, 부극성 스캔전압은 -300~-800V일 수 있다.
이러한, 셋다운파형 공급부(20)는 제1노드(N1)와 부극성의 스캔전압공급원(-Vy) 사이에 접속된 제2스위치(SW2)와, 제2스위치(SW2)의 게이트 단자에 접속되어 하강 램프파형의 기저전압로부터 스캔전압(-Vy)까지 소정의 기울기를 제어하는 제2 가변저항(R2)을 포함한다.
스캔기준전압 공급부(22)는 스캔 집적회로(24)와 스캔기준전압원(-Vsc) 사이에 접속되어 있다. 스캔기준전압 공급부(22)는 어드레스기간(AP) 중 소정의 기간 동안 패널 커패시터(Cp1)의 스캔전극(Y)에 스캔기준전압(-Vsc), 예를 들어 200V를 공급한다.
스캔기준전압 공급부(22)는 타이밍 콘트롤러로부터 공급되는 스위칭 제어신호에 응답하여 스캔 집적회로(25)과 스캔기준전압원(-Vsc)과 연결하는 제3스위치(SW3)를 포함하고 있다.
즉, 제3스위치(SW3)는 타이밍 콘트롤러로부터 공급되는 스위칭 제어신호에 응답하여 온됨과 동시에 스캔 집적회로(25)의 제4스위치(SW4)가 온되므로, 스캔기준전압원(-Vsc)을 제2노드(N2)에 전기적으로 접속시키므로 패널 커패시터(Cp1)의 스캔전극(Y)에 스캔기준전압(-Vsc)을 공급한다. 이때, 스캔 집적회로(25)의 제5스위치(SW5)는 제1노드(N2)에 접속된 셋업파형 공급부(18), 셋다운파형 공급부(20), 스캔전압공급부(24), 서스테인펄스 공급부(26)을 패널 커패시터(Cp1)의 스캔전극(Y)에 연결하는 패스역할을 한다.
스캔전압 공급부(24)는 어드레스기간(AP)의 소정의 시간 동안 스캔기준전압(-Vsc)로부터 부극성의 스캔전압(-Vy)을 갖는 스캔펄스(SCNP)를 패널 커패시터(Cp1)의 스캔전극(Y)에 공급한다. 이러한, 스캔전압 공급부(24)는 스캔전압원(-Vy)과 제1노드(N1) 사이에 접속된 제6스위치(SW6)를 포함한다.
제6스위치(SW6)는 타이밍 콘트롤러로부터 공급되는 스위칭 제어신호에 응답 하여 스캔전압원(-Vy)으로부터 공급되는 부극성의 스캔전압(-Vy)을 제1노드(N1)에 전달한다. 이에 따라, 어드레스기간에 제1노드(N1)에는 부극성의 스캔전압(-Vy)이 전달된다.
서스테인펄스 공급부(26)는 서스테인기간(SP) 동안 기저전압 및 부극성 서스테인전압(-Vs), 예를 들어 200V를 갖는 서스테인펄스를 패널 커패시터(Cp1)의 스캔전극(Y)에 공급한다. 이러한, 제1서스테인펄스 공급부(26)는 서스테인전압(Vs)을 공급하는 서스테인전압 공급부(28)와 기저전압을 공급하는 기저전압 공급부(30)로 구성된다.
서스테인전압 공급부(28)는 제1노드(N1)에 접속되어 서스테인기간 동안 기저전압 공급부(30)와 교번적으로 패널 커패시터(Cp1)의 스캔전극(Y)에 서스테인전압(-Vs)을 공급한다. 이러한, 서스테인전압 공급부(28)는 부극성 서스테인전압원(-Vs)과 제1노드(N1) 사이에 접속된 제6스위치(SW6)를 포함한다.
제6스위치(SW6)는 타이밍 콘트롤러로부터 공급되는 스위칭 제어신호에 응답하여 서스테인기간 동안 서스테인전압원(-Vs)을 제1노드(N1)에 전기적으로 접속시킨다.
기저전압 공급부(30)는 제1노드(N1)에 접속되어 서스테인기간에 패널 커패시터(Cp1)의 스캔전극(Y)에 기저전압(GND)을 공급한다. 이러한, 기저전압 공급부(30)는 기저전압원(GND)과 제1노드(N1) 사이에 접속된 제7스위치(SW7)를 포함한다.
제7스위치(SW7)는 타이밍 콘트롤러로부터 공급되는 스위칭 제어신호에 응답하여 기저전압원(GND)을 제1노드(N1)에 전기적으로 접속시킨다. 이에 따라, 서스테 인기간에 제1노드(N1)에는 기저전압(GND)이 전달된다.
이러한, 제7스위치(SW7)는 서스테인기간 동안 제6스위치(SW6)와 교번적으로 동작한다. 이에 따라, 서스테인기간에 제1노드(N1)에는 기저전압(GND) 및 서스테인전압(-Vs)이 교번적으로 전달된다.
스캔 집적회로(25)는 제1노드(N1)와 스캔기준전압 공급원(Vsc) 사이에 푸쉬풀 형태로 접속되는 제4스위치(SW4) 및 제5스위치(SW5)를 포함한다. 여기서, 제4스위치(SW4)와 제5스위치(SW5)의 공통 노드(N2)는 패널 커패시터(Cp)의 스캔전극(Y)에 접속된다. 따라서, 제4스위치(SW4)는 타이밍 제어부의 스위칭 제어신호에 의해 스캔기준전압 공급원(-Vsc)과 제2노드(N2) 사이에 접속되어 스캔전극(Y)에 스캔기준전압(-Vsc)을 공급하고, 제5스위치(SW5)는 제2노드(N2)와 제1노드(N1)에 접속되어 타이밍 제어부의 스위칭 제어신호에 의하여 제1노드(N1)에 접속된 셋업파형 공급부(18) 및 셋다운파형 공급부(20), 스캔전압 공급부(24), 서스테인전압 공급부(28), 기저전압 공급 부(30)를 스캔전극(Y)과 연결한다.
도 2와 비교하여 도 4를 살펴보면, 스캔 구동부(12)는 바이어스전압없이 상승 램프파형의 낮은 셋업전압와, 부극성의 스캔전압, 스캔기준전압, 서스테인전압을 이용하므로, 높은 전압의 스위치 소자들을 사용하지 않아 구성이 단순하고 저가격화할 수 있으며, 높은 고전압의 셋업전압을 공급하기 위한 바이어스 전압을 사용할 필요가 없어 저전압 구동이 가능하다.
서스테인 구동부
다시 도 3 및 도 4를 참조하면, 서스테인 구동부(14)는, 리셋기간(RP) 중 셋다운파형 공급부(20)의 하강 램프파형이 공급될 때, 패널 커패시터(Cp1)의 서스테인전극(Z)에 서스테인전압(-Vs)을 공급한다. 또한, 서스테인 구동부(14)는 서스테인기간(SP)에 패널 커패시터(Cp1)의 서스테인전극(Z)에 기저전압(GND2) 및 부극성 서스테인전압(-Vs)을 교번적으로 공급한다.
스캔 구동부(12)가 부극성 스캔기준전압 및 스캔전압, 서스테인전압을 패널 커패시터(Cp1)의 스캔전극(Y)에 공급하는 것에 대응하여, 서스테인 구동부(14)도 부극성의 서스테인전압을 패널 커패시터(Cp1)의 서스테인전극(Z)에 공급한다.
한편, 위에서 설명한 각각의 스위치들(SW1 내지 SW7)은 바디 다이오드가 내장된 전계효과트랜지스터(Field Effect Transistor; FET)가 사용되는 것이 바람직하나 이에 제한되지 않는다.
어드레스 구동부
어드레스 구동부(16)는 데이터전압(Va)를 패널 커패시터(Cp2, Cp3)의 어드레스전극(X)을 공급한다. 어드레스 구동부(16)는 어드레스 전압공급부를 포함하여 어드레스기간(AP))에 정극성의 어드레스전압(Va)을 갖는 어드레스펄스 또는 데이터펄스를 어드레스전극(X)에 공급하게 된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.
이러한 구성에 따라, 본 발명은 높은 전압의 스위치 소자들을 사용하지 않아 구성이 단순하고 저가격화할 수 있으며, 높은 고전압의 셋업전압을 공급하기 위한 바이어스 전압을 사용할 필요가 없어 저전압 구동이 가능한 효과가 있다.
이에 따라, 비용을 줄임과 아울러 신뢰성을 향상시킬 수 있다.

Claims (14)

  1. 리셋기간에 최소기준전압으로부터 소정의 기울기로 상승하는 상승 램프파형과 하강 램프파형을 이용하여 패널 커패시터를 리셋하며, 어드레스 및 서스테인기간에 부극성 스캔전압과 부극성 서스테인전압을 이용하여 상기 패널 커패시터의 스캔전극을 구동하는 스캔 구동부와;
    리셋기간 중 상기 하강 램프파형이 공급될 때 부극성 전압을 이용하여 서스테인전극을 구동하고, 서스테인기간에 부극성 서스테인전압을 이용하여 상기 패널 커패시터의 서스테인전극을 구동하는 서스테인 구동부와;
    어드레스전압을 이용하여 어드레스전극을 구동하는 어드레스 구동부를 포함하는 플라즈마 디스플레이 패널의 구동장치.
  2. 제 1 항에 있어서,
    상기 상승 램프파형의 최소기준전압은 그라운드이며,
    상기 하강 램프파형은 상기 상승 램프파형의 최소기준전압으로부터 소정의 기울기로 하강하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  3. 제 1 항에 있어서,
    상기 상승 램프파형과 상기 하강 램프파형의 기울기가 동일한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  4. 제 1 항에 있어서,
    상기 스캔 구동부의 스캔전압의 기준전압은 부극성인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  5. 제 4 항에 있어서,
    상기 스캔 구동부의 하강 램프파형은 상기 스캔전압까지 하강하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  6. 제 4 항 또는 제 5 항에 있어서,
    상기 스캔 구동부의 스캔전압의 기준전압은 상기 서스테인전압과 동일한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  7. 제 6 항에 있어서,
    상기 스캔 구동부의 상승 램프파형의 피크전압의 절대값은 0~200V이며, 상기 하강 램프파형의 피크전압의 절대값은 300~800V인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  8. 리셋기간에 최소 기준전압으로부터 소정의 기울기로 상승하는 상승 램프파형과 하강 램프파형을 패널 커패시터의 스캔전극에 공급하며, 상기 하강 램프파형이 공급될 때 부극성 전압을 패널 커패시터의 서스테인전극에 공급하는 리셋단계와;
    어드레스기간에 부극성 스캔전압과 서스테인전압을 이용하여 상기 패널 커패시터의 스캔전극에 공급하며, 데이터전압을 어드레스전극에 공급하는 어드레스단계와;
    서스테인기간 동안 부극성 서스테인전압을 갖는 서스테인펄스를 상기 패널 커패시터의 스캔전극과 서스테인전극에 교대로 공급하는 서스테인단계를 포함하는 플라즈마 디스플레이 패널의 구동방법.
  9. 제 8 항에 있어서,
    상기 상승 램프파형의 최소기준전압은 그라운드이며,
    상기 하강 램프파형은 상기 상승 램프파형의 최소기준전압으로부터 소정의 기울기로 하강하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제 8 항에 있어서,
    상기 상승 램프파형과 상기 하강 램프파형의 기울기가 동일한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  11. 제 9 항에 있어서,
    상기 스캔전압의 기준전압은 부극성인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  12. 제 11 항에 있어서,
    상기 리셋단계의 하강 램프파형은 상기 스캔전압까지 하강하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  13. 제 11 항 또는 제 12 항에 있어서,
    상기 스캔전압의 기준전압은 상기 서스테인전압과 동일한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  14. 제 13 항에 있어서,
    상기 상승 램프파형의 피크전압은 0~200V이며, 상기 하강 램프파형의 피크전압은 300~800V인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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