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KR100324261B1 - 플라즈마 디스플레이 패널 및 그 구동방법 - Google Patents

플라즈마 디스플레이 패널 및 그 구동방법 Download PDF

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KR100324261B1
KR100324261B1 KR1020000003517A KR20000003517A KR100324261B1 KR 100324261 B1 KR100324261 B1 KR 100324261B1 KR 1020000003517 A KR1020000003517 A KR 1020000003517A KR 20000003517 A KR20000003517 A KR 20000003517A KR 100324261 B1 KR100324261 B1 KR 100324261B1
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Abstract

본 발명은 휘도 및 발광효율이 향상된 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 패널에서는 동일 기판 상에서 방전셀의 중앙부에 좁은 간격으로 형성된 제 1 트리거 전극과 제 2 트리거 전극에 저전압의 교류 펄스를 교번적으로 인가하여 서스테인 방전을 개시하고, 이와 동시에 동일 기판 상에서 방전셀 별로 제 1 트리거 전극의 외측에 분리되어 형성된 제 1 방전유지전극과 제 2 트리거 전극의 외측에 분리되어 형성된 제 2 방전유지전극에 고전압의 교류 펄스를 교번적으로 인가하여 서스테인 방전을 유지한다.
본 발명에 의하면, 방전셀 중앙부에 형성된 트리거 전극쌍을 이용하여 서스테인 방전시 방전 개시 전압의 상승을 억제하면서 외곽부에 형성된 방전유지전극쌍 간에 장거리 방전을 일으켜 발광효율 및 휘도를 향상시킬 수 있게 된다.

Description

플라즈마 디스플레이 패널 및 그 구동방법{Plasma Display Panel and Method of Driving the same}
본 발명은 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것으로, 특히 휘도 및 발광효율이 향상된 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 'PDP'라 함)은 가스방전에 의해 발생되는 자외선이 형광체를 여기시킬 때 형광체로부터 가시광선이 발생되는 것을 이용한 표시장치이다. PDP는 지금까지 표시수단의 주종을 이루어왔던 음극선관(Cathode Ray Tube : CRT)에 비해 두께가 얇고 가벼우며, 고선명 대형화면의 구현이 가능하다는 점등의 장점이 있다. PDP는 매트릭스 형태로 배열된 다수의 방전셀들로 구성되며, 하나의 방전셀은 화면의 한 화소를 이루게 된다.
도 1은 종래의 교류 면방전 PDP의 방전셀 구조를 도시한 사시도이다. 도 1을 참조하면, 상판(20)을 구성하는 상부유리기판(24)의 배면에는 교류 구동 신호가 공급되어 서스테인 면방전을 이루는 주사전극(26)과 방전유지전극(27)이 나란하게 형성된다. 주사전극(26) 및 방전유지전극(27)은 ITO(Indium Tin Oxide)로 형성된 투명전극이며, 주사전극(26) 및 방전유지전극(27) 각각의 위에는 교류 신호 공급용 금속 버스전극(30)들이 나란하게 형성된다. 주사전극(26) 및 방전유지전극(27)이 형성된 상부유리기판(24)의 배면에는 상부유전층(28)이 전면에 형성된다. 상부유전층(28)은 방전시 전하를 축적함과 아울러 방전 전류를 제한하는 기능을 갖는다. 상부유전층(28) 상에 전면 도포되는 보호층(31)은 방전시 스퍼터링으로부터 상부유전층(28)을 보호하여 화소셀의 수명을 연장시킴과 아울러 2차 전자의 방출효율을 높여 방전효율을 향상시킨다. 하판(22)을 구성하는 하부유리기판(32) 상에는 어드레스 방전을 위한 데이터전극(34)이 주사전극(26) 및 방전유지전극(27)과 직교하는 방향으로 형성된다. 하부유리기판(32)과 데이터전극(34) 상에는 방전시 벽전하 형성을 위한 하부유전층(36)이 전면 도포된다. 또한 상판(20)과 하판(22) 사이에는 격벽(42)이 수직으로 형성된다. 하부유전층(36) 상에서 데이터전극(34)과 나란한방향으로 형성되는 격벽(42)은 상판(20) 및 하판(22)과 함께 셀의 방전공간(38)을 형성하고, 이웃한 방전셀 간의 전기적, 광학적 상호 간섭을 차단한다. 하부유전층(36)과 격벽(42)의 표면에는 형광체(40)가 도포된다. 방전공간(38) 내에는 He+Xe 또는 Ne+Xe의 혼합가스가 충진된다.
종래의 교류 면방전 PDP의 전체적인 전극 라인 및 방전셀의 배치 구조는 도 2에 도시되는 바와 같다. 데이터전극라인(X)과 주사전극라인(Y) 그리고 방전유지전극라인(Z)이 교차하는 부분마다 방전셀(44)이 위치하게 된다. 데이터전극라인(X)은 기수번째 라인들과 우수번째라인들로 분할되어 상하에서 구동되고 있다.
빛이 방출되는 과정을 간략히 설명하면, 주사전극(26)과 데이터전극(34) 간에 어드레스 방전이 일어나 상/하부 유전층(28,36)에 벽전하가 형성된다. 형성된 벽전하는 면방전에 필요한 방전전압을 낮추는 역할을 한다. 어드레스 방전에 의해 선택된 셀들에서는 주사전극(26)과 방전유지전극(27)에 교번적으로 공급되는 교류 신호에 의해 두 전극(26,27) 간에 서스테인 방전이 일어난다. 이 때 방전공간(38)에서는 방전가스가 여기된 후 천이되는 과정에서 진공 자외선이 발생한다. 발생된 진공 자외선은 형광체(40)를 여기시켜 가시광선을 발생시키게 되고, 이로써 PDP의 화상이 구현되어진다.
교류 면방전 PDP는 ADS(Addressing Display Separated : 이하 'ADS'라 함) 구동방법에 의해 화상을 표시한다. 일반적으로 PDP에서는 화상의 계조를 구현하기 위해 16.67㎳의 한 프레임을 8개 혹은 그 이상의 서브필드로 나누어 구동한다. 도3은 종래의 ADS 구동방법에 있어서 서브필드 별로 PDP의 각 전극 라인에 공급되는 구동 파형을 나타낸 파형도이다. 도 3을 참조하면, 먼저 리셋 기간에는 방전셀들을 초기화하고, 어드레스 방전을 돕기 위해 주사전극라인(Y)에 인가되는 방전 펄스로 방전을 일으켜 각 방전셀들에 프라이밍 하전입자 및 벽전하를 형성시킨다. 어드레스 기간에는 PDP의 각 주사라인별 주사전극라인(Y)들에 주사펄스(-Vs)가 선순차 방식으로 인가되고, 주사펄스에 동기되어 데이터펄스(Vd)가 각 데이터전극라인(X)에 공급된다. 서스테인 기간에는 주사전극라인(Y)과 방전유지전극라인(Z)에 동일한 펄스폭과 전압을 갖는 서스테인 펄스(Vsus)가 교번적으로 인가되어 어드레스 방전에 의해 선택된 방전셀들에서 서스테인 면방전이 일어난다. 실제 PDP에서는 각 서브필드 별로 서스테인 기간에 차이를 두어 화상의 계조를 표현하게 된다.
이와 같이 구동되는 PDP의 휘도는 주사전극(26)과 방전유지전극(27) 간의 서스테인 방전 중에 발생하는 진공 자외선의 양에 비례한다. 종래의 PDP에서는 이 진공 자외선의 발생량을 증가시켜 PDP의 휘도를 향상시키기 위한 방법으로서 방전셀 별로 형성된 주사전극(26)과 방전유지전극(27) 간의 간격을 길게 하는 방법 또는 주사전극(26) 및 방전유지전극(27)의 폭을 넓게 하는 방법을 이용하고 있다. 주사전극(26)과 방전유지전극(27) 간의 간격을 길게 하면, 두 전극(26,27) 간의 방전 경로가 길어져 장거리 방전에 의해 그만큼 방전시 자외선의 발생량이 증가하게 되어 휘도를 향상시킬 수 있게 된다. 하지만 도 1에 도시된 종래의 PDP 구조를 살펴보면, 서스테인 방전을 일으키는 주사전극(26)과 방전유지전극(27)이 서로 좁은간격으로 형성되어 있어, 효율 좋은 장거리 방전을 일으키기가 용이하지 않다. 종래의 PDP에서는 좁은 셀 내에서 주사전극(26)과 방전유지전극(27) 간의 간격을 길게 하는 데에 한계가 있으며, 특히 고정세로 화면을 구성할 경우에는 한 화소를 구성하는 셀의 크기가 축소됨에 따라 장거리 방전을 일으키기가 더욱 어려워진다. 뿐만 아니라, 주사전극(26)과 방전유지전극(27) 간의 간격이 일정 간격 이상이 되면, 두 전극(26,27) 사이의 방전 개시에 필요한 방전개시전압이 급격히 상승하기 때문에 실제적으로 적용시키기에는 어려움이 따른다. 그리하여 종래의 PDP에서는 PDP의 휘도를 향상시키기 위해 주사전극(26)과 방전유지전극(27)의 폭을 넓게 하는 방법이 이용되어 왔다. 주사전극(26)과 방전유지전극(27)의 폭이 넓어지면 그만큼 실제 방전이 일어나는 영역의 체적이 증가하여 자외선의 발생량 및 휘도가 증가하게 된다. 하지만, 이 방법에서는 전극의 폭이 넓어짐에 따라 방전 전류도 함께 증가하기 때문에 방전에 필요한 전력 소모량이 많아지는 단점이 있다. 이에 따라 발광 휘도의 증가율보다 방전 전류의 소모율이 더 커져 오히려 방전효율 및 발광효율 측면에서는 불리한 방법이 되고 있다. 또한 방전 전류의 증대에 따른 수명 저하 등의 신뢰성 문제도 야기되고 있다.
따라서, 본 발명의 목적은 휘도 및 발광효율이 향상된 플라즈마 디스플레이 패널 및 그 구동방법을 제공함에 있다.
도 1은 종래의 교류 면방전 플라즈마 디스플레이 패널의 방전셀 구조를 도시한 사시도.
도 2는 종래의 교류 면방전 플라즈마 디스플레이 패널의 전체적인 전극 라인 및 방전셀의 배치 구조를 나타낸 평면도.
도 3은 종래의 교류 면방전 플라즈마 디스플레이 패널의 구동방법을 나타낸 도면으로서, 서브필드 별로 각 전극 라인에 공급되는 구동 파형을 나타낸 파형도.
도 4는 본 발명의 실시 예에 따른 교류 면방전 플라즈마 디스플레이 패널의 방전셀 구조를 도시한 사시도.
도 5는 본 발명에 따른 교류 면방전 플라즈마 디스플레이 패널의 상판에 형성되는 전극 라인들의 전체적인 배치 구조를 나타낸 평면도.
도 6은 본 발명의 플라즈마 디스플레이 패널에 적용되는 본 발명의 실시 예에 따른 구동 파형도.
도 7은 본 발명의 플라즈마 디스플레이 패널에 적용되는 본 발명의 다른 실시 예에 따른 구동 파형도.
< 도면의 주요 부분에 대한 부호의 설명 >
20,70 : 상판 22,72 : 하판
24,74 : 상부유리기판 26 : 주사전극
27 : 방전유지전극 28,78 : 상부 유전층
30,76 : 버스전극 31,80 : 보호층
32,82 : 하부유리기판 34,86 : 데이터전극
36,84 : 하부 유전층 38,88 : 방전공간
40,90 : 형광체 42,92 : 격벽
44 : 방전셀 46 : 플라즈마 디스플레이 패널
Sy : 제 1 방전유지전극 Ty : 제 1 트리거 전극
Sz : 제 2 방전유지전극 Tz : 제 2 트리거 전극
상기 목적을 달성하기 위하여 본 발명의 플라즈마 디스플레이 패널은 동일 기판 상에서 방전셀 별로 중앙부에 좁은 간격으로 형성되어 교번적으로 인가되는 저전압의 교류 펄스에 의해 서스테인 방전을 개시하는 제 1 트리거 전극 및 제 2 트리거 전극과, 동일 기판 상에서 제 1 및 제 2 트리거 전극과 분리되어 방전셀의 외곽부에 형성되어 교번적으로 인가되는 고전압의 교류 펄스에 의해 서스테인 방전을 유지시키는 제 1 방전유지전극과 제 2 방전유지전극을 구비한다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 동일 기판 상에서 방전셀의 중앙부에 좁은 간격으로 형성된 제 1 트리거 전극과 제 2 트리거 전극에 저전압의 교류 펄스를 교번적으로 인가하여 서스테인 방전을 개시하는 단계와, 제 1 및 제 2 트리거 전극에 저전압 펄스를 공급함과 동시에 동일 기판 상에서 방전셀 별로 제 1 트리거 전극의 외측에 분리되어 형성된 제 1 방전유지전극과 제 2 트리거 전극의 외측에 분리되어 형성된 제 2 방전유지전극에 고전압의 교류 펄스를 교번적으로 인가하여 서스테인 방전을 유지시키는 단계를 포함한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시 예들에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 4 내지 도 7을 참조하여 본 발명의 바람직한 실시 예들에 대하여 설명하기로 한다.
도 4는 본 발명의 실시 예에 따른 교류 면방전 PDP의 방전셀 구조를 도시한 사시도이다. 도 4를 참조하면, 본 발명에 따른 교류 면방전 PDP는 하판(72)에 형성된 데이터전극(86)과 직교하는 방향으로 상판(70)에 형성된 제 1 트리거 전극(Ty) 및 제 2 트리거 전극(Tz)과, 제 1 방전유지전극(Sy) 및 제 2 방전유지전극(Sz)을 구비한다. 종래의 구조에서는 서스테인 방전을 일으키기 위한 주사전극(26)과 방전유지전극(27)이 각각 넓은 폭으로 형성됨과 아울러 상호 좁은 간격으로 상판(20)에 형성되어 있었지만, 본 발명에서는 종래에 주사전극이 형성되어 있던 위치에 제 1 트리거 전극(Ty)과 제 1 방전유지전극(Sy)을 분리하여 형성시킨다. 제 1 트리거 전극(Ty)은 방전셀 중앙부의 내측에 형성되고, 제 1 방전유지전극(Sy)을 방전셀 외곽부에 형성시킨다. 그리고, 종래에 방전유지전극(27)이 형성되어 있던 위치에는 제 2 트리거 전극(Tz)과 제 2 방전유지전극(Sz)을 분리하여 형성시킨다. 제 2 트리거 전극(Tz)을 방전셀 중앙부에서 상대편의 제 1 트리거 전극(Ty)과 좁은 간격을 갖도록 형성시키고, 제 1 방전유지전극(Sy)의 위치에 대응되는 반대편 외곽부에 제 2 방전유지전극(Sz)을 형성시킨다. 본 발명에서 상호 좁은 간격으로 형성된 제 1 및 제 2 트리거 전극(Ty,Tz)은 서스테인 기간 중 비교적 저전압의 교류 펄스를 공급받아 서스테인 방전을 개시하기 위한 전극으로 사용되고, 외곽부에서 상호 넓은 간격으로 형성된 제 1 및 제 2 방전유지전극(Sy,Sz)은 소정 레벨의 교류 펄스를 공급받아 제 1 및 제 2 트리거 전극(Ty,Tz) 간에 방전이 개시된 다음 플라즈마 방전을 유지시키기 위한 전극으로 사용된다. 한편 각 방전셀 내에서 내측에 형성된 제 1 및 제 2 트리거 전극(Ty,Tz)은 그 외곽에 형성된 제 1 및 제 2 방전유지전극(Sy,Sz)에 비해 좁은 폭으로 형성시킨다. 제 1 및 제 2 트리거 전극(Ty,Tz)과 제 1 및 제 2 방전유지전극(Sy,Sz)은 ITO(Indium Tin Oxide)를 이용하여 투명전극으로 형성시킨다. 그리고, ITO의 높은 저항값에 의한 신호 감쇄 현상을 방지하기 위해 제 1 및 제 2 방전유지전극(Sy,Sz) 상의 중앙부에 금속 버스전극(76)을 라인 형태로 형성시킨다. 마찬가지로 제 1 및 제 2 트리거 전극(Ty,Tz) 위에도 도 4에 도시된 바와 같이 금속 버스전극(76)을 형성시킨다. 한편 각 방전셀의 내측 중앙부에 형성되는 제 1 및 제 2 트리거 전극(Ty,Tz)의 폭이 비교적 얇을 경우에는 광학적 간섭이 그리 크지 않으므로 투명전극 대신 금속 버스전극만으로 형성시킬 수도 있다. 트리거 전극(Ty,Tz)과 방전유지전극(Sy,Sz)이 형성된 상부유리기판(74)의 배면에는 상부 유전층(78)을 형성시키는데, 방전 전류를 효율적으로 제한하기 위하여 상부 유전층(78)의 두께를 25㎛ 이상으로 형성시킨다. 그 밖의 다른 구성 및 특징들은 종래의 구조와 동일하다. 즉, 상부 유전층(78)의 배면에는 방전 스퍼터링으로부터 상판(70)을 보호하기 위한 MgO 보호층(80)을 형성시킨다. 하판(72)을 구성하는 하부유리기판(82) 상에는 데이터전극(86) 및 하부 유전층(84)을 형성시킨다. 하부 유전층(84)이 형성된 하판(72) 상에는 데이터전극(86)과 나란한 방향으로 격벽(92)을 형성하고, 격벽(92)과 하부 유전층(84) 상에는 형광체(90)를 도포한다. 한편 격벽(92) 형성시 상하좌우에 인접한 셀들 간의 전기적, 광학적 간섭을 최소화하기 위해 격벽(92)을 격자 형태로 형성할 수도 있다. 상판(70) 및 하판(72) 그리고 격벽(92)에 의해 둘러싸인 방전공간(88) 내에는 He+Xe 또는 Ne+Xe의 혼합가스를 충진한다.
본 발명에서는 내측과 외곽에 상호 분리된 트리거전극들(Ty,Tz)과 방전유지전극들(Sy,Sz)을 둠으로써 외곽에 위치한 방전유지전극쌍(Sy,Sz) 간의 넓은 전극간격을 이용하여 장거리 방전을 통한 자외선의 발생량 및 휘도의 향상을 도모함과 동시에 내측에 좁은 간격으로 형성된 트리거 전극쌍(Ty,Tz)을 이용하여 방전 개시 전압의 상승을 억제한다. 또한 종래에 하나의 전극이 넓게 형성되어 있던 유효 면적 부분에 트리거 전극과 방전유지전극으로 분리하여 형성시킴으로써 전극 면적을 현저히 감소시켜 낮은 방전 전류로 높은 휘도를 얻어낼 수 있도록 한다. 이는 종래의 구조에서 전극 폭을 작게 하여 방전 전류를 제한하는 것과는 휘도 측면에서 큰 차이가 있다. 기존의 구조에서는 전극폭을 줄이면 휘도가 급격히 떨어지는 반면, 본 발명의 구조에서는 전극 면적을 줄여 방전 전류량을 줄임과 동시에 외곽에 형성된 제 1 및 제 2 방전유지전극쌍(Sy,Sz) 간의 장거리 방전에 의해 휘도가 유지되며, 오히려 제 1 및 제 2 방전유지전극(Sy,Sz)의 위치를 조정함으로써 휘도를 종래보다 더 향상시킬 수 있다.
한편, 제 1 및 제 2 트리거 전극(Ty,Tz)과 제 1 및 제 2 방전유지전극(Sy,Sz)의 위치가 상기 언급한 위치에만 한정되는 것은 아니다. 도 5는 본 발명에 따른 PDP의 상판(70)에 형성되는 전극 라인의 전체적인 배치 구조를 나타낸 도면이다. 도 5를 참조하면, 각 방전셀 별로 외곽부에 형성되는 제 1 방전유지전극(Sy)과 제 2 방전유지전극(Sz) 각각은 인접한 두 셀에 의해 공통으로 공유되도록 각 주사라인의 경계부에 형성되어진다. 이에 따라, 제 1 방전유지전극(Sy)과 제 2 방전유지전극(Sz)의 위치가 각 주사라인 별로 상호 뒤바뀔 수 있다. 제 1 및 제 2 방전유지전극(Sy,Sz)을 방전셀 외곽의 경계부에 형성시켜 두 셀이 하나의 방전유지전극을 공유하도록 함으로써 서스테인 방전시 방전 경로를 최대화하는 효과를 얻을 수 있으며, 기존 구조 대비 추가되는 전극의 수를 최소화시킬 수 있게 된다. 특히 고정세 화면을 구성하는 경우에 이러한 전극 구조를 적용시키게 되면, 셀의 크기가 축소되더라도 서스테인 방전을 유지시키는 제 1 및 제 2 방전유지전극(Sy,Sz) 간의 간격은 소정 간격 이상으로 항상 유지되기 때문에 고휘도, 고효율의 실현이 가능하다.
본 발명에 따른 PDP를 구동시키기 위한 구동 방법은 도 6 및 도 7에 도시되는 바와 같다. 도 6은 본 발명의 PDP의 적용되는 본 발명의 실시 예에 따른 구동방법을 나타낸 도면으로서, 한 서브필드 기간동안 각 전극에 공급되는 구동 파형을 도시한 도면이다. 도 6을 참조하면, 본 발명에 따른 PDP의 구동방법에 있어서, 하나의 서브필드는 종래와 마찬가지로 리셋 기간, 어드레스 기간 및 서스테인 기간으로 나뉘어진다. 먼저 리셋 기간과 어드레스 기간에는 트리거 전극들(Ty,Tz)에만 교류 펄스를 인가하여 리셋 방전 및 어드레스 방전을 일으킨다. 리셋 기간에는 각 방전셀의 제 2 트리거 전극(Tz)에 소정 레벨의 펄스를 인가하여 전체적으로 리셋 방전을 일으킨다. 리셋 방전에 의해 각 방전셀들이 초기화되며, 어드레스 방전을 돕기 위한 프라이밍 하전입자들이 형성되게 된다. 그 다음 어드레스 기간에는 각 주사라인 별로 제 1 트리거 전극(Ty)에 주사펄스(-Vs)를 순차적으로 공급함과 아울러 각 주사라인 별로 주사펄스(-Vs)에 동기된 데이터 펄스(Vd)를 데이터전극(86)에 공급한다. 이로써 켜질 셀들에 대한 어드레싱 작업이 수행된다. 어드레싱에 의해 선택된 셀들에서는 그 다음 이어지는 서스테인 기간동안에 서스테인 면방전이 일어난다. 서스테인 기간에는 도 6에 도시된 바와 같이 제 1 및 제 2 트리거전극(Ty,Tz)과 제 1 및 제 2 방전유지전극(Sy,Sz)에 서로 다른 레벨의 교류 펄스를 교번적으로 인가한다. 제 1 트리거 전극(Ty)에 저전압의 Vt의 펄스가 인가될 때 이에 동기시켜 제 1 방전유지전극(Sy)에 Vt보다 높은 레벨의 Vsus 펄스를 인가한다. 그리고, 제 2 트리거 전극(Tz)에 Vt의 펄스가 인가될 때 이에 동기시켜 제 2 방전유지전극(Sz)에 Vsus의 펄스를 인가한다. 먼저 저전압의 교류 펄스(Vt)가 공급되면 방전셀의 중앙부에 좁은 간격으로 형성된 제 1 및 제 2 트리거 전극(Ty,Tz) 간에 1차적으로 방전이 일어난다. 제 1 및 제 2 트리거 전극(Ty,Tz) 간의 간격이 좁기 때문에 저전압으로도 방전을 일으킬 수 있으며, 이는 서스테인 방전을 개시하는 역할을 하게 된다. 제 1 및 제 2 트리거 전극(Ty,Tz) 사이에 방전이 개시되면, 이 때 발생된 하전입자들이 프라이밍(Priming) 효과에 의해 방전셀의 외곽에 형성된 제 1 및 제 2 방전유지전극(Sy,Sz) 간에 2차 방전을 유도하게 된다. 제 1 및 제 2 방전유지전극(Sy,Sz) 간의 간격이 길더라도 제 1 및 제 2 트리거 전극(Ty,Tz) 간의 프라이밍 방전으로 인해 비교적 낮은 레벨의 Vsus 펄스로 장거리 방전을 일으킬 수 있게 된다. 서스테인 기간동안 트리거 전극들(Ty,Tz)과 방전유지전극들(Sy,Sz) 각각에 Vt와 Vsus의 교류 펄스를 교번적으로 공급함으로써 장거리 방전이 연속적으로 일어난다. 한편 본 발명에서는 제 1 및 제 2 트리거 전극(Ty,Tz)의 폭을 외측의 제 1 및 제 2 방전유지전극(Sy,Sz)의 폭보다 좁게 함으로써 상대적으로 트리거 전극(Ty,Tz) 측에 축적되는 벽전하량을 감소시켜 효율 좋은 장거리 방전을 방전유지전극들(Sy,Sz) 간에 발생시킬 수 있다. 이와 같이 본 발명에서는 좁은 간격으로 형성된 트리거 전극들(Ty,Tz)을 이용하여 1차적으로 방전을개시시킴으로써 방전 개시 전압의 상승을 막을 수 있고, 프라이밍 효과에 의해 방전유지전극들(Sy,Sz) 간에 방전 경로가 긴 서스테인 방전을 일으킴으로써 자외선의 발생량을 증가시키고, 휘도를 향상시킬 수 있게 된다. 또한 기존의 하나의 전극이 차지하고 있던 면적에 두 전극을 분리 형성함으로써 전극 면적이 줄어들어 방전 전류의 증가를 억제하면서도 고휘도를 구현할 수 있다. 실험적으로 본 발명의 전극 구조를 적용시켰을 때, 기존 구조 대비 약 2 배 이상의 휘도 및 발광효율 향상 효과가 나타남을 확인하였다.
도 7은 본 발명의 PDP에 적용되는 본 발명의 다른 실시 예에 따른 구동 방법을 나타낸 도면이다. 도 7에 도시된 구동 방법에 있어서, 리셋 및 어드레스 기간 동안에 각 전극에 공급되는 파형은 도 6의 구동 파형과 동일하다. 도 6의 구동 파형과 대비하였을 때의 다른 점은 서스테인 기간 중에 전극들에 공급되는 파형인데, 도 7에 도시된 구동 방법에서는 제 1 트리거 전극(Ty)에 저전압 펄스(Vt)를 공급할 때 이에 동기시켜 제 2 방전유지전극(Sz)에 고전압 펄스(Vsus)를 인가하고, 제 2 트리거 전극(Tz)에 저전압 펄스(Vt)를 공급할 때 이에 동기시켜 제 1 방전유지전극(Sy)에 고전압 펄스(Vsus)를 인가한다. 이와 같은 펄스 공급 방법으로 도 6의 구동 방법에 비해 트리거 전극들(Ty,Tz) 사이의 방전을 약하게 하여 트리거 전극들(Ty,Tz) 쪽에 축적되는 벽전하량을 최소화시킬 수 있는 장점이 있다. 이로써 도 6의 구동 방법에 비해 효율 측면에서 좀 더 유리한 특성을 얻어낼 수 있게 된다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널 및 그 구동방법에서는 방전셀의 중앙부에 서스테인 방전을 개시하기 위한 제 1 및 제 2 트리거 전극을 좁은 간격으로 형성시키고, 그 외곽에 장거리 방전을 일으키기 위한 제 1 및 제 2 방전유지전극을 분리하여 형성시킨다. 먼저 제 1 및 제 2 트리거 전극에 저전압 펄스를 공급하여 서스테인 방전을 개시하고, 이와 동시에 제 1 및 제 2 방전유지전극에는 고전압의 펄스를 공급하여 외곽부의 제 1 및 제 2 방전유지전극 간의 서스테인 방전을 유지시킨다. 이로써 서스테인 방전의 방전 개시 전압을 낮추면서도 장거리 방전을 효율적으로 일으킬 수 있어 휘도 및 발광효율을 향상시킬 수 있게 된다. 또한 본 발명에서는 종래에 하나의 전극이 차지하고 있던 영역에 두 전극을 분리하여 형성함으로써 전극 면적이 줄어들어 서스테인 방전시 방전 전류량을 줄이면서도 휘도를 향상시킬 수 있는 장점이 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (11)

  1. 패널의 화소 단위를 이루는 각 방전셀 별로 동일한 기판 상에 형성된 방전 전극 쌍에 교류 펄스를 교번적으로 인가하여 서스테인 방전을 일으키는 플라즈마 디스플레이 패널에 있어서,
    동일 기판 상에서 상기 방전셀 별로 중앙부에 좁은 간격으로 형성되어 교번적으로 인가되는 저전압의 교류 펄스에 의해 상기 서스테인 방전을 개시하는 제 1 트리거 전극 및 제 2 트리거 전극과,
    상기 동일 기판 상에서 상기 제 1 및 제 2 트리거 전극과 분리되어 상기 방전셀의 외곽부에 형성되어 교번적으로 인가되는 고전압의 교류 펄스에 의해 상기 서스테인 방전을 유지시키는 제 1 방전유지전극과 제 2 방전유지전극을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  2. 제 1 항에 있어서,
    상기 제 1 방전유지전극과 상기 제 2 방전유지전극 각각은 인접한 두 방전셀이 공유하게끔 두 방전셀 사이의 경계부에 형성된 것을 특징으로 하는 플라즈마 디스플레이 패널.
  3. 제 1 항에 있어서,
    상기 방전셀의 중앙부에 형성된 상기 제 1 및 제 2 트리거 전극의 선폭이 상기 방전셀의 외곽부에 형성된 상기 제 1 및 제 2 방전유지전극의 선폭에 비해 좁게 형성된 것을 특징으로 하는 플라즈마 디스플레이 패널.
  4. 제 1 항에 있어서,
    상기 제 1 및 제 2 방전유지전극은 투명전극으로 형성됨과 아울러 그 위의 중앙부에 상기 펄스 신호의 전송을 위한 금속 버스 전극이 형성된 것을 특징으로 하는 플라즈마 디스플레이 패널.
  5. 제 1 항에 있어서,
    상기 제 1 및 제 2 트리거 전극은 투명전극으로 형성됨과 아울러 그 위에 상기 펄스 신호의 전송을 위한 금속 버스 전극이 형성된 것을 특징으로 하는 플라즈마 디스플레이 패널.
  6. 제 1 항에 있어서,
    상기 제 1 및 제 2 트리거 전극이 금속 전극으로 형성된 것을 특징으로 하는 플라즈마 디스플레이 패널.
  7. 제 1 항에 있어서,
    상기 제 1 및 제 2 트리거 전극과 상기 제 1 및 제 2 방전유지전극이 형성된 상기 기판 상에 25㎛ 이상의 두께로 형성된 유전층을 추가로 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  8. 제 1 항에 있어서,
    상기 제 1 및 제 2 트리거 전극과 상기 제 1 및 제 2 방전유지전극이 형성된 상기 기판에 대면되는 다른 기판 상에 상기 방전셀들 간의 간섭을 차단하기 위하여 격자 형태로 형성된 격벽을 추가로 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  9. 켜질 방전셀을 선택하기 위하여 어드레스 방전을 일으키는 단계와,
    상기 어드레스 방전에 의해 선택된 방전셀들의 방전을 유지시키는 서스테인 방전 단계를 포함하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    동일 기판 상에서 상기 방전셀의 중앙부에 좁은 간격으로 형성된 제 1 트리거 전극과 제 2 트리거 전극에 저전압의 교류 펄스를 교번적으로 인가하여 상기 서스테인 방전을 개시하는 단계와,
    상기 제 1 및 제 2 트리거 전극에 상기 저전압 펄스를 공급함과 동시에 상기 동일 기판 상에서 상기 방전셀 별로 상기 제 1 트리거 전극의 외측에 분리되어 형성된 제 1 방전유지전극과 상기 제 2 트리거 전극의 외측에 분리되어 형성된 제 2 방전유지전극에 고전압의 교류 펄스를 교번적으로 인가하여 상기 서스테인 방전을 유지하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제 9 항에 있어서,
    상기 제 1 트리거 전극에 상기 저전압 펄스를 인가할 때 상기 제 1 방전유지전극에 상기 고전압 펄스를 인가하고, 상기 제 2 트리거 전극에 상기 저전압 펄스를 인가할 때 상기 제 2 방전유지전극에 상기 고전압 펄스를 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  11. 제 9 항에 있어서,
    상기 제 1 트리거 전극에 상기 저전압 펄스를 인가할 때 상기 제 2 방전유지전극에 상기 고전압 펄스를 인가하고, 상기 제 2 트리거 전극에 상기 저전압 펄스를 인가할 때 상기 제 1 방전유지전극에 상기 고전압 펄스를 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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