JPS6344775Y2 - - Google Patents
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- Publication number
- JPS6344775Y2 JPS6344775Y2 JP19335181U JP19335181U JPS6344775Y2 JP S6344775 Y2 JPS6344775 Y2 JP S6344775Y2 JP 19335181 U JP19335181 U JP 19335181U JP 19335181 U JP19335181 U JP 19335181U JP S6344775 Y2 JPS6344775 Y2 JP S6344775Y2
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- JP
- Japan
- Prior art keywords
- output
- analog switch
- capacitor
- level
- rectifier
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Landscapes
- Measurement Of Velocity Or Position Using Acoustic Or Ultrasonic Waves (AREA)
- Control Of Amplification And Gain Control (AREA)
Description
【考案の詳細な説明】
この考案は、水中探知装置例えば音響測深機、
魚群探知機など音波利用の探知機、或は電波利用
の探知機に用いる受信装置に係り、とくに自動利
得制御装置に関するものである。[Detailed description of the invention] This invention is suitable for underwater detection devices such as acoustic sounders,
The present invention relates to a receiving device used in a detector using sound waves such as a fish finder or a detector using radio waves, and particularly relates to an automatic gain control device.
便宜上超音波を用いて水中物体を探知する場合
に就て述べると、海底及び魚群などからの反響信
号のレベルは、ピツチングやローリングの影響を
受けると大きく変動する。 For the sake of convenience, in the case of detecting underwater objects using ultrasonic waves, the level of echo signals from the seabed, fish schools, etc. fluctuates greatly when affected by pitting and rolling.
海底の追尾を行う場合、反響信号のレベルが小
さいと、追尾できないことがあるから、できるだ
けレベルが安定していることが必要である。 When tracking the seabed, if the level of the echo signal is low, tracking may not be possible, so it is necessary to keep the level as stable as possible.
一般にレベルを安定にする手段として、受信器
の自動利得制御(AGCと略称)を行つているが、
水中探知装置のようにパルス変調波の反響信号を
取扱う場合には、AGCは非常に難かしい。すな
わち波形の変動に対して急速な追従を行うと、ノ
イズもAGCの影響を受け、その結果S/Nが悪
くなる。 Generally, receiver automatic gain control (abbreviated as AGC) is used to stabilize the level.
AGC is extremely difficult when dealing with echo signals of pulse modulated waves, such as in underwater detection equipment. That is, when rapid tracking is performed for waveform fluctuations, noise is also affected by AGC, resulting in poor S/N ratio.
そこでAGCの時定数を長くすると、S/Nは
良いけれど、その反面、急速な変動に対して追従
しなくなる。 Therefore, if the AGC time constant is made long, the S/N ratio will be good, but on the other hand, it will not be able to follow rapid fluctuations.
この考案は、上記のような相反する状態を克服
し、中間の程良い作動領域でAGCを行い、S/
Nの低下をおさえると共に急速な変動に対しても
よく追従するようにしたものである。 This idea overcomes the conflicting conditions mentioned above, performs AGC in an intermediate operating range, and improves S/
This suppresses the decrease in N and also tracks rapid fluctuations well.
次に実施例に基づいて説明する。第1図は実施
例のブロツクダイヤグラム、第2図は作動説明図
で、第1図の各部に記入した符号に対応してそれ
ぞれの波形を示してある。 Next, an explanation will be given based on an example. FIG. 1 is a block diagram of the embodiment, and FIG. 2 is an explanatory diagram of the operation, and the respective waveforms are shown in correspondence with the symbols written in each part in FIG.
受信信号Pは、受信増巾器1で増巾されて整流
器2で整流されると、出力は第2図イに示す通り
になり、比較器3と4及びアナログスイツチ7に
送られると共に、ダイオード10に印加される。 When the received signal P is amplified by the receive amplifier 1 and rectified by the rectifier 2, the output becomes as shown in Fig. 2A, and is sent to the comparators 3 and 4 and the analog switch 7, as well as the diode. 10 is applied.
ここに比較器3は適宜に定めた高いレベルA、
そして比較器4はAより低いレベルBに設定され
ている(第2図イ参照)から、比較器3の出力側
には時間t2とt3の間だけ出力が現れ(第2図ロ参
照)る、また比較器4の出力側には時間t1とt4の
間とt5とt6の間に出力が現れる。 Here, the comparator 3 is set to a suitably high level A,
Since comparator 4 is set to level B, which is lower than A (see Figure 2 A), an output appears on the output side of comparator 3 only between times t 2 and t 3 (see Figure 2 B). ), and an output appears on the output side of the comparator 4 between times t 1 and t 4 and between t 5 and t 6 .
次に2つの比較器の出力は、それぞれエクスク
ルーシブ・オア回路5に印加される、この場合、
比較器3の出力が(0)で、比較器4の出力が(1)
のときだけエクスクルーシブ・オア回路5の出力
は(1)となるから、出力は第2図ニにみる通りの短
い時間となつて、アナログスイツチ6に印加され
る。 Next, the outputs of the two comparators are respectively applied to the exclusive OR circuit 5. In this case,
The output of comparator 3 is (0) and the output of comparator 4 is (1)
Since the output of the exclusive OR circuit 5 becomes (1) only when , the output is applied to the analog switch 6 for a short period of time as shown in FIG. 2D.
次にONとOFFのスイツチ作用をするアナログ
スイツチ7には、前記整流器2の出力と前記比較
器3の出力とが印加され、比較器3の出力が印加
されたときアナログスイツチ7が作動して、高い
レベルA以上の範囲t2〜t3の間に含まれる整流器
2の出力は、ダイオード8と抵抗R1を通しコン
デンサC1に充電される。ここでR1とC1の値に時
定数を小さく選び急速に充電されるように設定し
てある。 Next, the output of the rectifier 2 and the output of the comparator 3 are applied to the analog switch 7 which acts as an ON/OFF switch, and when the output of the comparator 3 is applied, the analog switch 7 is activated. , the output of the rectifier 2 included in the range t 2 to t 3 above the high level A is charged to the capacitor C 1 through the diode 8 and the resistor R 1 . Here, the values of R 1 and C 1 are set to have small time constants so that they are charged quickly.
C1の端電圧はアナログスイツチ11に印加さ
れるが、一方において前記アナログスイツチ6が
作動してONとなる時間、すなわち前記エクスク
ルーシブ・オア回路5に出力が生じている間だけ
スイツチが作動し、C1の端電圧はダイオード9
と抵抗R2及びコンデンサC1の回路により短い時
定数で、アナログスイツチ6の外部に挿入された
抵抗Rを通して放電される。 The terminal voltage of C1 is applied to the analog switch 11, but on the other hand, the switch is activated only while the analog switch 6 is activated and turned ON, that is, while the exclusive OR circuit 5 is producing an output. The terminal voltage of C1 is diode 9
It is discharged through the resistor R inserted outside the analog switch 6 with a short time constant by the circuit consisting of the resistor R2 and the capacitor C1 .
一方、前記整流器2の出力(第2図イの信号)
は、ダイオード10と長い時定数の抵抗R0,R3
及びコンデンサC0とからなる充電回路に印加さ
れ、コンデンサC0は刻々充電される。 On the other hand, the output of the rectifier 2 (signal in Fig. 2 A)
are the diode 10 and the long time constant resistors R 0 , R 3
and a capacitor C 0 , and the capacitor C 0 is charged every moment.
この充電電圧は切換作用を行うアナログスイツ
チ11に印加され、ここを介して受信増巾器1の
AGC電圧として帰還されている。 This charging voltage is applied to the analog switch 11 that performs the switching action, and is passed through the analog switch 11 to the receiving amplifier 1.
It is fed back as AGC voltage.
そしてアナログスイツチ11に前記比較器4の
出力が印加されると、これによつてアナログスイ
ツチ11が切換えられ、前記のコンデンサC1の
端電圧が受信増巾器1のAGC電圧として供給さ
れることになり、AGC電圧は第2図ホに示すよ
うに制御され、したがつて受信信号に対し略々一
定のAGC電圧が得られる。 When the output of the comparator 4 is applied to the analog switch 11, the analog switch 11 is thereby switched, and the terminal voltage of the capacitor C1 is supplied as the AGC voltage of the receiving amplifier 1. The AGC voltage is controlled as shown in FIG.
かくしてパルス受信々号のレベルが変動する場
合に於いて、その変動にかゝわらず受信レベルを
略一定に制御できる。 In this way, even when the level of the received pulse signal fluctuates, the received level can be controlled to be substantially constant regardless of the fluctuation.
なお比較器の高低2つのレベル設定は、高いレ
ベルに就ては捕促目標に定めた必要レベルを目安
とすればよい。そして低いレベルはノイズを勘安
して、ノイズレベルより高い値にすればよく、高
低両レベルを、適宜に選択できるように何段階に
も切換えできる設計しておけば一層好適である。 Note that when setting the high and low levels of the comparator, the high level may be set based on the required level determined as the capture target. The low level may be set to a value higher than the noise level, taking noise into consideration, and it is more suitable if the design is such that the high and low levels can be switched in multiple stages so that both high and low levels can be selected as appropriate.
第1図は実施例のブロツクダイヤグラム。第2
図は作動説明図。
1……受信増巾器、2……整流器、3,4……
比較器、5……エクスクルーシブ・オア回路、
6,7……アナログスイツチ、8,9,10……
ダイオード、11……アナログスイツチ。
FIG. 1 is a block diagram of the embodiment. Second
The figure is an explanatory diagram of the operation. 1... Receive amplifier, 2... Rectifier, 3, 4...
Comparator, 5... exclusive OR circuit,
6, 7...Analog switch, 8, 9, 10...
Diode, 11...Analog switch.
Claims (1)
たパルス状の受信信号のレベルを、それぞれ高低
2つのレベルに設定した比較器3と4のレベルと
比較するように構成され、該比較器3と4の出力
はエクスクルーシブ・オア回路5に印加され、該
回路5の出力はアナログスイツチ6に印加され、
そして前記整流器2の出力と高いレベルの比較器
3の出力はアナログスイツチ7に印加され、該ス
イツチ7が制御され、該スイツチ7に印加された
前記整流器2の出力が通され、該スイツチ7の後
段にダイオード8と抵抗R1を通して結ばれたコ
ンデンサC1が充電され、該コンデンサC1の端電
圧は、アナログスイツチ11に印加されると共
に、前記のエクスクルーシブ・オア回路5の出力
がアナログスイツチ6に印加されたとき抵抗R2
とダイオード9および該アナログスイツチ6を通
して放電されるように構成されるものであり、前
記の整流器2の出力をダイオード10と抵抗R0,
R3およびコンデンサC0からなる充電回路を通し
てコンデンサC0に充電した端電圧と、前記のコ
ンデンサC1の端電圧の両者は、アナログスイツ
チ11を介して増巾器1のAGC電圧として帰還
され、アナログスイツチ11に印加された前記の
低いレベルの比較器4の出力でAGC電圧が制御
されるように構成されたことを特徴とするパルス
受信信号用AGC装置。 The level of the pulsed reception signal amplified by the reception amplifier 1 and rectified by the rectifier 2 is compared with the level of the comparators 3 and 4, which are set to two levels, high and low, respectively. The outputs of the circuits 3 and 4 are applied to an exclusive OR circuit 5, and the output of the circuit 5 is applied to an analog switch 6.
The output of the rectifier 2 and the output of the comparator 3 at a high level are applied to an analog switch 7, and the switch 7 is controlled, and the output of the rectifier 2 applied to the switch 7 is passed. A capacitor C 1 connected through a diode 8 and a resistor R 1 in the latter stage is charged, and the terminal voltage of the capacitor C 1 is applied to an analog switch 11, and the output of the exclusive OR circuit 5 is applied to an analog switch 6. resistance R 2 when applied to
The output of the rectifier 2 is connected to the diode 10 and the resistor R0 ,
Both the terminal voltage charged to the capacitor C 0 through the charging circuit consisting of R 3 and the capacitor C 0 and the terminal voltage of the capacitor C 1 are fed back as the AGC voltage of the amplifier 1 via the analog switch 11. An AGC device for pulse reception signals, characterized in that the AGC voltage is controlled by the low level output of the comparator 4 applied to the analog switch 11.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19335181U JPS58101523U (en) | 1981-12-28 | 1981-12-28 | AGC device for pulse reception signals |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19335181U JPS58101523U (en) | 1981-12-28 | 1981-12-28 | AGC device for pulse reception signals |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS58101523U JPS58101523U (en) | 1983-07-11 |
JPS6344775Y2 true JPS6344775Y2 (en) | 1988-11-21 |
Family
ID=30106715
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19335181U Granted JPS58101523U (en) | 1981-12-28 | 1981-12-28 | AGC device for pulse reception signals |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58101523U (en) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH07104411B2 (en) * | 1987-02-18 | 1995-11-13 | 日本無線株式会社 | Automatic sensitivity adjustment method for fish finder |
-
1981
- 1981-12-28 JP JP19335181U patent/JPS58101523U/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS58101523U (en) | 1983-07-11 |
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