JPS63293798A - Information storage carrier - Google Patents
Information storage carrierInfo
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- JPS63293798A JPS63293798A JP12816187A JP12816187A JPS63293798A JP S63293798 A JPS63293798 A JP S63293798A JP 12816187 A JP12816187 A JP 12816187A JP 12816187 A JP12816187 A JP 12816187A JP S63293798 A JPS63293798 A JP S63293798A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、消去可能プログラマブル・リードオンリメモ
リ(EP−ROM)に係り、特に高密度大谷量化に好適
なレーザ畳込み、電気読み出しのり−ドオンリメモリに
関する。DETAILED DESCRIPTION OF THE INVENTION [Industrial Application Field] The present invention relates to an erasable programmable read-only memory (EP-ROM), and in particular to a laser convolution, electric readout glue-only memory suitable for high-density storage. Regarding.
情報の記憶の最重要課題のひとつは大容量化であり、他
のひとつはアクセスタイムの高速化である。One of the most important issues in information storage is increasing capacity, and another is increasing access time.
高速アクセスメモリとしては半導体メモリがあり、アク
セスタイム数100nsecと高速であるが、記憶容量
は高々1Mビットである。Semiconductor memories are examples of high-speed access memories, which have a high-speed access time of 100 nsec, but have a storage capacity of 1 Mbit at most.
−万、大容量メモリとしcは元ディスクメモリがあり、
記憶容量は数100M〜1Gバイトと大容量であるが、
アクセスタイムは数100m5ec と低速である。- 10,000, large capacity memory, c has original disk memory,
The storage capacity is large, ranging from several 100MB to 1GB,
The access time is slow at several 100 m5ec.
前者は半導体素子メモリ回路が太ぎく、高密度にできな
いことにより大容量化に限界があり、後者はレーザビー
ムスポット径筐での高密度化が可能であるが、ディスク
のレーザ元絖出しにより、アクセスタイムに限界がある
。The former has a limit to increasing capacity because the semiconductor element memory circuit is too thick and cannot be made high density, while the latter can achieve high density due to the laser beam spot diameter of the casing, but due to the laser source of the disk, Access time is limited.
〔発明が鱗決しよ5とする問題点〕
上記従来技術は、高速アクセスと大容量化の両立が困難
である問題があった。[Problems addressed by the invention] The above-mentioned conventional technology has a problem in that it is difficult to achieve both high-speed access and large capacity.
本発明の目的は、高速アクセス可能な大容量の消去可能
プログラツプルリードオンリーメモリを提供することに
ある。An object of the present invention is to provide a large capacity erasable programmable read-only memory that can be accessed at high speed.
上記目的は、メモリ層に1オンを有し分極可能な物質を
用い、構成とし又は、i板上に共通電極。The above purpose is achieved by using a polarizable material with one layer in the memory layer, or by using a common electrode on the i-plate.
第1のメモリ看、マトリクス電極のX方向パターン、第
2のメモリ層、マトリクス電極のY方向パターンの順に
形成し、共通電極と電気的アドレス部を備えたマトリク
ス電極の片方に電圧を印加し、該電極と交差するもう一
万のマドI)クス電極パターンに沿りC設けた光学的ト
ラッキング部および光学的アドレス部?用いることによ
り、所望のポイントにレーザビームスポットを移動させ
加熱することにより達成される。forming a first memory layer, an X-direction pattern of matrix electrodes, a second memory layer, and a Y-direction pattern of matrix electrodes in this order, and applying a voltage to one of the matrix electrodes having a common electrode and an electrical address section; An optical tracking section and an optical addressing section are provided along the electrode pattern to intersect with the electrode. This is accomplished by moving a laser beam spot to a desired point and heating it.
共通電極にプラス電圧、マトリクスを極にマイナス電圧
を印加しながら、マトリクス電極の所望のクロスポイン
トを狙ってレーザビームスポットを照射しその部位を加
熱すると、メモリ層に用いた例えはガラス中の金属イオ
ン例えばN、等が高温のため移動可能となり、電界に従
ってマトリクス電極部子なわち、第2のメモIJ hr
K移動析出する。While applying a positive voltage to the common electrode and a negative voltage to the matrix electrode, a laser beam spot is irradiated aiming at the desired cross point of the matrix electrode and that area is heated. Ions, such as N, become movable due to the high temperature, and according to the electric field, the matrix electrode parts, ie, the second memo IJ hr
K moves and precipitates.
レーザビームスポットに照射されない部位は室温下にあ
りイオンの移動は生じなく、その析出もない。以上によ
り誉込み動作が終了する。★込み時に、レーザビームス
ポットをマトリクス電極の所望のクロスポイントに照射
するためには、光学的アドレスおよび光学的トラッキン
グ部、電気的アドレスを使用する。丁なゎち、マトリク
ス電極のY方向パターンと共通電極間に電圧を印加した
場合、X;5向パターンに沿り℃レーザビームをトラツ
中ングするための例えば光学的位相?持った案内溝を設
けるとともに、X方向パターン1列ずつ例えば凸凹の位
相ビットにより光学的アドレスを設け、さらにY方向パ
ターンには電気的アドレスを設ける。ここで該電気的ア
ドレスにはダイオードマトリクス、TFTアレイ等を用
いることができる。レーザビームの位置検出には案内溝
に沿っ℃レーザビームスポットを走査しながら、光学的
アドレスを読み取り、Y方向の位置を検出し、さらに、
マ) IJクス電極の交差点での反射率及化叫を検出す
ることにより、X方向の位置を検出して行なう。データ
畳込みはX方向の光学的アドレスによりX方向の電極を
選択して、X方向にレーザスポットを走査し、Y方向の
電極Yt電気的アドレスて選択し電圧を印加し、レーザ
スポットの走査中に上記の方法でX方向の位置を検出し
ながら、上記電圧印加電極位置と一致した時に、レーザ
ビームのパワーを誉込みパワーにすること−より、咳ポ
イントを加熱することにより行なう。The area that is not irradiated with the laser beam spot is at room temperature and no movement of ions occurs and no precipitation occurs. With the above steps, the honoring operation is completed. ★In order to irradiate the laser beam spot to a desired cross point of the matrix electrode during insertion, an optical address, an optical tracking unit, and an electrical address are used. If a voltage is applied between the Y-direction pattern of the matrix electrode and the common electrode, for example, the optical phase for tracking the laser beam along the X; 5-direction pattern. In addition, optical addresses are provided for each row of the X-direction pattern using, for example, uneven phase bits, and electrical addresses are provided for the Y-direction pattern. Here, a diode matrix, a TFT array, etc. can be used for the electrical address. To detect the position of the laser beam, the optical address is read while scanning the °C laser beam spot along the guide groove, and the position in the Y direction is detected.
M) The position in the X direction is detected by detecting the reflectance and noise at the intersection of the IJ electrodes. Data convolution selects an electrode in the X direction using an optical address in the X direction, scans the laser spot in the X direction, selects an electrode in the Y direction by using an electrical address Yt, applies a voltage, and scans the laser spot while scanning the laser spot. While detecting the position in the X direction using the method described above, when the position coincides with the voltage application electrode position, the power of the laser beam is changed to the power of the laser beam, thereby heating the cough point.
部分消去には電界を逆にして上記力云と同様にレーザビ
ームスポットを照射すれは良い。また全面消去には必す
しもレーザビームを用いる必要はなく、電界を逆にし℃
情報記憶担体を加熱槽に入れ全面加熱することiCより
達成できる。For partial erasing, it is good to reverse the electric field and irradiate the laser beam spot in the same way as in the above-mentioned method. In addition, it is not necessary to use a laser beam to erase the entire surface; instead, it is possible to erase the entire surface by reversing the electric field.
This can be achieved by iC by placing the information storage carrier in a heating tank and heating the entire surface.
読み出しには、電気的アドレスYX′)5同電極パター
ン、Y方向電極パターンに設けることにより、マトリク
スを電気的に走査し、イオン析出によるX方向電極とY
方向電極間の導通の有無によりデータの°0°、°1”
を判別する。For reading, the matrix is electrically scanned by providing an electrical address YX')5 in the same electrode pattern and in the Y direction electrode pattern, and
Depending on the presence or absence of conduction between the direction electrodes, the data changes to °0° and °1”.
Determine.
実施例1
以下、本発明の一実施例な第1図および第2図により説
明する。Embodiment 1 An embodiment of the present invention will be described below with reference to FIGS. 1 and 2.
第1図は概略平面図、第2図は第1図の部分断面図お工
びレーザ曹込み状態を模式的に示した図である。凹凸の
位相ピットよりなる光学的アドレス13 、15’およ
び案内溝14を有するガラス基板1の上に、41を蒸看
し共通電極2を形成した。さらに金属イオンを含有する
ソーダライムガラスをスパッタリング薄展形奴して第1
のメモリ層5を薄膜形成した。メモリ層3の一端は共通
電極2が露出するようにイオンビームエツチングにより
除去した。FIG. 1 is a schematic plan view, and FIG. 2 is a partial sectional view schematically showing the state of machining and laser shaving shown in FIG. 1. A common electrode 2 was formed by steaming 41 on a glass substrate 1 having optical addresses 13 and 15' consisting of uneven phase pits and a guide groove 14. Furthermore, soda lime glass containing metal ions was sputtered and shaped into a thin film.
The memory layer 5 was formed into a thin film. One end of the memory layer 3 was removed by ion beam etching so that the common electrode 2 was exposed.
メモリ層5の上にメモリセル99”k形成するためのX
方向のマトリクス電極5をA福1およびフォトリゾグラ
フィク技術により形成した。次に、マトリクスを極5の
上に第2のメモリ層(ソーダライムガラス)4をスパッ
タリング薄膜形成し、−B、> ヲマトリクスを極5が
門出するよ5にリフトオフ除去し一〇メモリ層4の上に
Y方向のマトリクス電極y A1蒸着および7オトリゾ
グラフイツク技術により形成した。10#10′は夕′
イオードマトリクスを用いた電気的アドレスであり、メ
モリセル用マトリクスを極5#7の上に7オトリゾグラ
フイツク技術を用いて、絶縁層形成、スルホール形成。X for forming memory cell 99''k on memory layer 5
The matrix electrode 5 in the direction was formed using A-Fuku 1 and photolithographic technology. Next, a second memory layer (soda lime glass) 4 is formed as a thin film by sputtering on the matrix pole 5, and the matrix is lifted off and removed until the pole 5 exits. A matrix electrode in the Y direction was formed on the substrate by evaporation of A1 and 7 otolithographic techniques. 10#10' is evening'
This is an electrical address using an iode matrix, and an insulating layer and through holes are formed using the 7 otolithography technique on the memory cell matrix on top of the 5th and 7th poles.
アモルファスSL層形成、スノトホール形成、アドレス
パターン形成を行なった。it、11’が素子の電気的
アドレス入力端子である。、!気的アドレスにはダイオ
ードマトリクスの他TPTアレイであっても艮い。An amorphous SL layer, a slot hole, and an address pattern were formed. it, 11' is the electrical address input terminal of the element. ,! In addition to a diode matrix, TPT arrays can also be used for physical addressing.
j基板に設げに光学的アドレス15.13’joiまひ
案内#Iはガラス基板を用いフォトリゾグラフインク技
術により直接形成したが、カラス原盤−スタンパ−射出
成形等の元ディスクプロセスによりアクリル等の樹脂基
板上に光学的アドレスだよび案内溝を形成することもで
きる。The optical address 15.13'joi paralysis guide #I was formed directly on the glass substrate using photolithographic ink technology, but it was formed using a resin such as acrylic using an original disk process such as glass master disk-stamper injection molding. Optical address guides and guide grooves can also be formed on the substrate.
共通X極2とマ) IJクス電極7の間に電圧E12を
印加しながら、半導体レーザ15から拡大レンズ16、
ハーフミラ−17,対物レンズ18を通し℃、レーザ元
を集光させメモリセル部に照射する。メモリセルSは加
熱され高温となり、メモリl@5,4甲のイオンは高温
のため移動可能となり、マ) IJクス電極5とマトリ
クス電極7の間に移動し、導を帯21Y形成する。レー
ザ加熱されない部位はイオン移動がないため、導−性は
ないままである。While applying the voltage E12 between the common X pole 2 and the IJ electrode 7,
The laser source is focused through a half mirror 17 and an objective lens 18 at a temperature of 0.degree. C., and is irradiated onto the memory cell section. The memory cell S is heated to a high temperature, and the ions in the memory l@5, 4A become movable due to the high temperature, and move between the matrix electrode 5 and the matrix electrode 7, forming a conductive band 21Y. Since there is no ion movement in the area that is not heated by the laser, it remains non-conductive.
消去は電界を逆に印加してレーザ加熱丁れは、イオンは
マトリクス電極5と共通′に極2の間に移動し、マトリ
クス電極5と7の間の導通はなくなる。For erasing, an electric field is applied in the opposite direction and the ions are moved between the matrix electrode 5 and the common electrode 2, and the conduction between the matrix electrodes 5 and 7 is eliminated.
レーザ元を正確にメモリセル部に照射し、データを膏込
むためには、メモリセル部の位a’t ft、 学的に
検知し、マ) I)クス電他の畳込11L気信号とし一
ザ加熱信号を同期させる必要がある。本実施例において
は、X方向のマトリクス電極5に沿って光学的アドレス
15と案内溝14を配電する。半導体レーザ15よりの
レーザビームを、拡大レンズ16゜ハーフミラ−17,
対物レンズ18′lt通し、記憶担体に照射し、この反
射光音対物レンズ1B、/−−7ミラー17.集光レン
ズ19′lt通し℃検出素子20例えはフォトダイオー
ドにより′″CC検出検出素子の信号によりレーザビー
ムの7オーカシングおよび上記案内溝へのトラッキング
、さらに光学的アドレスの跣み取りt行なう(対物レン
ズアクチュエータおよびレーザビーム走査動me構は図
示せず)。In order to accurately irradiate the laser beam onto the memory cell section and inject data into it, the position of the memory cell section must be detected scientifically, and the convolution 11L signal of It is necessary to synchronize the heating signals. In this embodiment, the optical address 15 and the guide groove 14 are distributed along the matrix electrode 5 in the X direction. The laser beam from the semiconductor laser 15 is transmitted through a magnifying lens 16° half mirror 17,
Through the objective lens 18'lt, the storage carrier is irradiated, and the reflected light is reflected by the objective lens 1B, /--7 mirror 17. The focusing lens 19'lt passes through the °C detection element 20, for example, a photodiode, and the signal from the CC detection detection element performs laser beam focusing and tracking to the guide groove, as well as optical addressing (objective). The lens actuator and laser beam scanning mechanism are not shown).
例えは、X方向マトリクス電極5について、上記方法に
℃第1囚におい℃左から右にレーザビームを走査した場
合の検出素子の検出信号を第5図に示す。光学的アドレ
ス信号の検出によりY方向の位置を検出し、Y方向のマ
トリクスを横切る毎にマトリクス横切信号が検出できる
ことから、横切信号をカウントすることにより、X方向
の位置を検出する。したがって、データ書込み時には、
光学的アドレスによりX方向マトリクスの電極を検出し
、X方向にレーザビームを走査しながらマトリクス横切
信号によりY方向のマトリクス電極を検出し、所望の書
込みメモリセル部に達した時、Y方向のマトリクス電極
に電圧を印加すると同時に一イビームのパワーを書込パ
ワーに設定することにより、データ書込みが行なわれる
。For example, for the X-direction matrix electrode 5, FIG. 5 shows the detection signal of the detection element when the laser beam is scanned from left to right in the above method at the first temperature. The position in the Y direction is detected by detecting the optical address signal, and since a matrix crossing signal can be detected each time the matrix is crossed in the Y direction, the position in the X direction is detected by counting the crossing signals. Therefore, when writing data,
The electrodes of the matrix in the X direction are detected by the optical address, and the matrix electrodes in the Y direction are detected by the matrix crossing signal while scanning the laser beam in the X direction. Data writing is performed by applying a voltage to the matrix electrode and simultaneously setting the power of one beam as the writing power.
メモリセル全体にわたり書込みを行なうには。To write across the entire memory cell.
X方向マトリクス電極に沿ってレーザビーム?走査し、
該電極の終端に達した時にはトラックジャンプを行ない
、隣りのX′;5同マトリクスにレーザビームを移動さ
せ、逆方向にレーザビームを走査させることにより達成
する。Laser beam along the X-direction matrix electrode? scan,
This is achieved by performing a track jump when reaching the end of the electrode, moving the laser beam to the adjacent X';5 matrix, and scanning the laser beam in the opposite direction.
実施例2
上記実施例においては、マ) IJクス電極を高反射率
材料である。415用いているため、マトリクス横切信
号は検出光量の大きい万に検出されるC第3図に示すよ
うに、この場合、光学的アドレスとマトリクス横切信号
は同方向の検出レベルとなり。Example 2 In the above example, the IJ electrode is made of a high reflectance material. 415 is used, the matrix crossing signal is detected when the amount of detected light is large. As shown in FIG. 3, in this case, the optical address and the matrix crossing signal have detection levels in the same direction.
光学的アドレスとマトリクス検切イ6号の分離が煩雑と
なる。また、高反射率であるム一め、レーザビームの加
熱効果が少なくなるため、メモリセル部はできるだけ反
射率は低い万が望ましい。本発明の他の実施例を第4図
に示す。本実施例においては、Y方向のマド17クス電
極7を透過率の比較的太さなr=薄膜とし、メモリ層4
の光学的膜厚d1ヲλ
曹込みレーザ元に対して−×九とすることによワ、元の
干渉効果l利用し、メモリセル部の反射率を減少させた
。七の他の構成は実施力1と同様である。ここでλは畳
込レーザ元の波長、九は整数である。本東施例の検出1
1!r号レベルを第5図に示す。光学的アドレスとマト
リクス横切信号は図のように反対方向となり、信号の分
離が容易となった。さらに好適な来週例として、X方向
のマトリクス電極5′ftITO等の透明導通膜として
光学的λ
膜厚d、を−x?Lとすることにより1元の干渉効果を
利用しメモリセル部の反射率を減少させるばかりでなく
、ff ) IJクス電極5を光学的に透明なものとす
ることに工り、薔込し−ザ元がメモリ層4と6に効果的
に作用し、書込感度をさらに向よすることができる。Separation of the optical address and matrix inspection No. 6 becomes complicated. Furthermore, since a high reflectance reduces the heating effect of the laser beam, it is desirable that the reflectance of the memory cell portion be as low as possible. Another embodiment of the invention is shown in FIG. In this embodiment, the mask electrode 7 in the Y direction is made of a thin film with a relatively thick transmittance r, and the memory layer 4
By setting the optical film thickness d1 to λ to −×9 with respect to the laser source, the original interference effect l is utilized to reduce the reflectance of the memory cell portion. The other configurations of 7 are the same as 1. Here, λ is the wavelength of the convolution laser source, and 9 is an integer. Honto Example Detection 1
1! Figure 5 shows the r level. The optical address and matrix crossing signal are in opposite directions as shown in the figure, making it easy to separate the signals. As a more suitable example for next week, the optical λ film thickness d, -x? By setting L, not only the reflectance of the memory cell part is reduced by utilizing the interference effect of one element, but also the IJ electrode 5 is made to be optically transparent, and the The source effectively acts on the memory layers 4 and 6, and the writing sensitivity can be further improved.
上記実施例において、マ) IJクス電極7の材料とし
て、TLの他にT4.HL、 56. S4.Pljr
、In、(、b等を用いることができる。In the above embodiment, in addition to TL, T4. H.L., 56. S4. Pljr
, In, (, b, etc.) can be used.
実施例6
上記実施例2vcおい℃は、マトリクス電極7に光透過
性と光反射性を持たせるために、膜厚を50〜数百nm
と薄(形成する必要があり、情報の電気的読み出し時に
おい℃抵抗値が太さくなる恐れがあった。そこで、マト
リクス電極7の上部にI’l’0等の透明導通膜20を
形成し、電極の低抗値ケ少なりシ、読み出しエラー馨減
少させた(第6図)。Example 6 In the above Example 2vc, the film thickness was 50 to several hundred nm in order to give the matrix electrode 7 light transmittance and light reflectivity.
Therefore, a transparent conductive film 20 such as I'l'0 was formed on the top of the matrix electrode 7. As a result, the resistance value of the electrode was reduced, and readout errors were reduced (Figure 6).
実施例4
光学的アドレスの他の実施力を第7図を用いて説明する
。X方向のマトリクス電極の@を図のようにアドレス信
号に応じて変化させた。元手的アドレス21から効果的
な検出信号ケ得るためvcは電極の暢の変化量を大きく
とり、反射率の変化を大きくとることが必要であるが、
マトリクス電極は。Embodiment 4 Another implementation of optical addressing will be explained using FIG. 7. The @ of the matrix electrode in the X direction was changed according to the address signal as shown in the figure. In order to obtain an effective detection signal from the primary address 21, it is necessary for the VC to have a large change in electrode width and a large change in reflectance.
matrix electrode.
電気的読み出しに使用するため、十分な導電性を確保す
る必要があり1両者を満足するためには第7図のような
光学的アドレス構成をとるのが良い。Since it is used for electrical readout, it is necessary to ensure sufficient conductivity, and in order to satisfy both requirements, it is preferable to adopt an optical address configuration as shown in FIG.
また、より4を性を上げるために、該光学的アドレス上
にITO等の透明導電層を設けることも有効である。Furthermore, in order to further improve the properties of 4, it is also effective to provide a transparent conductive layer such as ITO on the optical address.
最後に、本発明による情報記憶担体の再生時の動作説明
を第8図を用いて説明する。無8図は、8 X 8 =
6ビツトメモリの例で示したパターン図である。この
囚にSいて、光学的アドレスおよび案内溝は省略した。Finally, the operation of the information storage carrier according to the present invention during reproduction will be explained with reference to FIG. No 8 figure is 8 x 8 =
FIG. 3 is a pattern diagram showing an example of a 6-bit memory. In this case, the optical address and guide groove were omitted.
9が8×8のメモリセル部であり目印がレーザ書込みさ
れたビットを示す。10゜10′はダイオードマトリク
スを用いた電気的アドレスであり、○印がダイオード接
続点である。アドレスビットA。〜A、 Kよりマトリ
クス電極2の中から1本が指定され、またh@ ”−A
Iにエリマトリクス電極7の中から1本が指定される。9 is an 8×8 memory cell portion, and marks indicate bits written by laser. 10°10' is an electrical address using a diode matrix, and the circle mark is a diode connection point. Address bit A. ~A and K specify one of the matrix electrodes 2, and h@ ”-A
One of the eli matrix electrodes 7 is designated as I.
端子8は+Vレベルすなわち、”1”レベルに接続し℃
お(とレーザ書込されたメモリセルが指定された場合の
みにり、十、端子6が+Vレベル°1”となりメ ′モ
リの胱出しができる。Terminal 8 is connected to +V level, that is, "1" level.
Only when a laser-written memory cell is specified, terminal 6 becomes +V level 1" and the memory can be removed.
以上のように、メモリ寸法はレーザスポット径まで小さ
くでき、メモリセルの構成も簡単であり、高密度大容量
の消去可能プログラマブルROMができる効果がある。As described above, the memory size can be reduced to the diameter of the laser spot, the structure of the memory cell is simple, and a high-density, large-capacity erasable programmable ROM can be produced.
メモリ層にはガラスの他、金属イオンを含有させたナイ
ロン、ポリイミドあるいは銅フタロシアニン等の中レー
トが使える。For the memory layer, in addition to glass, medium-rate materials such as nylon containing metal ions, polyimide, or copper phthalocyanine can be used.
本発明によれば簡単な構成で高@度な消去可能メモリセ
ルを構成できるので、レーザ畳込み、電気読み出しの大
容量高速アクセスの消去可能プログラマブルROMを提
供できる。According to the present invention, a high-performance erasable memory cell can be constructed with a simple configuration, so that a large-capacity, high-speed access erasable programmable ROM using laser convolution and electrical readout can be provided.
第1図は本発明の一実施例の概略平面図、第2図は第1
図の部分断面図およびレーザ書込状!F1i、を示す模
式図、第5図は検出信号の特性図、第4図は本発明の他
の実施例を示す部分断面図、第5図は検出信号の特性図
、第6図は本発明の他の実施例の部分断面図、第7図は
本発明の他の実施力の部分平面図、第8図はマ) l)
タスパターン因テア1・・・基板、 2・・
・共通電極、5.4・・・メモリ層、 10・・・
鬼気的アドレス、16・・・光学的アドレス。FIG. 1 is a schematic plan view of one embodiment of the present invention, and FIG. 2 is a schematic plan view of an embodiment of the present invention.
Partial cross-sectional view and laser-written letter! F1i, FIG. 5 is a characteristic diagram of the detection signal, FIG. 4 is a partial sectional view showing another embodiment of the present invention, FIG. 5 is a characteristic diagram of the detection signal, and FIG. 6 is a characteristic diagram of the present invention. 7 is a partial plan view of another embodiment of the present invention, and FIG. 8 is a partial sectional view of another embodiment of the present invention.
Tas pattern factor 1... board, 2...
・Common electrode, 5.4...Memory layer, 10...
Demonic address, 16...optical address.
Claims (1)
を再生する情報記憶担体において、情報記憶部が3つの
電極と該電極間に設けられたメモリ膜とから成り、該メ
モリ膜はイオンを有しかつ分極可能な物質であり、情報
記憶部をレーザ光等の光照射により加熱しながら3つの
電極の両端に電界を与えて該メモリ膜中のイオンを中間
の電極と一端の電極間に集めて、該両電極間の導通をな
らしめて、電気的および光学的に情報を記憶させ、該両
極間の導通の有無により情報を電気的に再生し、電界を
逆にして加熱しイオンを中間電極と他端電極に偏位移動
せしめて情報を消去できるように上記情報記憶部を構成
し、情報記憶時に上記加熱記憶部を選択するための、光
学的アドレス部および、加熱記憶部を走査するための光
学的トラッキング部を備え、さらに、電気的に情報を再
生するための電気的アドレス部を備えたことを特徴とす
る情報記憶担体。1. In an information storage carrier that electrically and optically stores information and electrically reproduces information, the information storage section is composed of three electrodes and a memory film provided between the electrodes, and the memory film is It is a polarizable substance that contains ions, and while the information storage section is heated by light irradiation such as a laser beam, an electric field is applied to both ends of the three electrodes to polarize the ions in the memory film to the middle electrode and one end electrode. ions are collected between the two electrodes, smoothed the conduction between the two electrodes, memorized the information electrically and optically, electrically reproduced the information depending on the presence or absence of the conduction between the two electrodes, and heated the ions by reversing the electric field. The information storage section is configured such that information can be erased by shifting the information between the intermediate electrode and the other end electrode, and an optical address section and a heating storage section are configured to select the heating storage section when storing information. An information storage carrier comprising an optical tracking section for scanning and an electrical addressing section for electrically reproducing information.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12816187A JPS63293798A (en) | 1987-05-27 | 1987-05-27 | Information storage carrier |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12816187A JPS63293798A (en) | 1987-05-27 | 1987-05-27 | Information storage carrier |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63293798A true JPS63293798A (en) | 1988-11-30 |
Family
ID=14977897
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12816187A Pending JPS63293798A (en) | 1987-05-27 | 1987-05-27 | Information storage carrier |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63293798A (en) |
-
1987
- 1987-05-27 JP JP12816187A patent/JPS63293798A/en active Pending
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