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JPS63126762A - ｎ×ｎビツトドツトマトリツクス９０゜回転回路 - Google Patents

ｎ×ｎビツトドツトマトリツクス９０゜回転回路

Info

Publication number
JPS63126762A
JPS63126762A JP61271983A JP27198386A JPS63126762A JP S63126762 A JPS63126762 A JP S63126762A JP 61271983 A JP61271983 A JP 61271983A JP 27198386 A JP27198386 A JP 27198386A JP S63126762 A JPS63126762 A JP S63126762A
Authority
JP
Japan
Prior art keywords
data
circuit
cpu
output
matrix
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP61271983A
Other languages
English (en)
Other versions
JPH0773920B2 (ja
Inventor
Hidejiro Ueyama
植山　秀二郎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP61271983A priority Critical patent/JPH0773920B2/ja
Priority to US07/121,832 priority patent/US4776026A/en
Publication of JPS63126762A publication Critical patent/JPS63126762A/ja
Publication of JPH0773920B2 publication Critical patent/JPH0773920B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06T—IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
    • G06T3/00—Geometric image transformations in the plane of the image
    • G06T3/60—Rotation of whole images or parts thereof

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  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Dot-Matrix Printers And Others (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)
  • Controls And Circuits For Display Device (AREA)
  • Image Processing (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は縦ｎピット横ｎビットのマトリックス状ドツト
データを９０°回転させるｎ×ｎビットドットマトリッ
クス９０°回転回路に関する。
〔従来の技術〕
この種のｎ×ｎビットドツトマトリックス９０’回転回
路は、ドツトマトリックスで構成された文字を、印字又
は表示する装置における９文字の回転が必要となる装置
、たとえば、ドツトマトリックスプリンタの漢字文字の
縦横変換装置に適用され、る。
従来９文字の回転方法として、たとえば２４×２４ドツ
トで構成された漢字フォントを横書きから縦書きに変換
する場合、８ビツトデータをソフトウェアにおいてはア
キーームレータを介し、又はハードウェアにおいてはシ
フトレジスタを介して、１ビツトづつシフトする事によ
シ縦横の変換を行っていた。第３図にその手順を示す。
〔発明が解決しようとする間頂点〕
上述した従来技術の文字の回転方法によれば。
第３図で示す様に、８×８ドツトの印字フォントを９０
°回転させる場合に、少なくとも、８×８回のピットシ
フトを行なわなければならない。したがって１回転処理
に要する時間は、かなシ大きくなる。
例を言えば、ドツトマトリックスで作られたキャラクタ
ゼネレータのデータを、印字又は１表示する場合９通常
プリンタにおいては、そのデータはカラムスキャン方式
で作られ、　ＣＲＴにおいてはロースキャン方式で作ら
れている為９文字の縦又は横の変換を行った場合、交換
を行わない場合の処理時間の差が大きく、特にプリンタ
においては。
この差によシ縦書き、横書きによる印字効率の大幅な相
違が発生する。
本発明の目的は、縦ｎビット横ｎピットのマトリックス
状ドツトデータの９０°回転処理に要する時間を短縮で
きるｎ×ｎピットドットマトリックス９０°回転回路を
提供することにある〇〔問題点を解決するための手段〕 本発明によれば、縦ｎビット横ｎピットのマトリックス
状ドツトデータを９０°回転させるｎ×ｎピットドツト
マトリックス９０’回転回路において。
前記マトリックス状ドツトデータにおける縦方向のｎピ
ットからなる列データを各々ラッチするためのｎ個のラ
ッチ回路（４ンと、前記マトリックス状ドツトデータに
おける横方向のｎビットからなる行データを各々出力で
きるように、前記ｎ個のラッチ回路の出力に入力を接続
されたｎ個の出力バッファ回路（５）とを備え、該ｎ個
の出力バッファ回路の出力を、前記マトリックス状ドツ
トデータの９０°回転データとして用いることを特徴と
するｎ×ｎピットドットマトリックス９０°回転回路が
得られる。
本発明の特別な実施例では、前記ｎ個のラッチ回路と、
前記ｎ個の出力バッファ回路とは、デコーダ（１）及び
ｆ−）を回路（２及び３）を含む選択回路によシ選択さ
れる。即ち、該選択回路によシＣＰＵからのデータのラ
ッチ回路（４）への書き込みと。
出力バッファ回路（すからの読み出しとのタイミングを
制御される。
〔実施例〕
次に本発明の実施例について図面を参照して説明する。
第１図を参照すると１本発明の一実施例は、８ビツト×
８ピツトドツトマトリツクスの９０００回転路を示す。
第１図において、デコーダ１は３ビツトのアドレス入力
と１ビツトのＣＥ大入力より８回路までアクセスできる
。ダート回路２は、入力ラッチ回路４の８つの内１つを
ＣＰＵからラッチ回路４ヘアドレスを変更しながら書き
込む。
８つのラッチ回路４の出力端子は、それにラッチされた
データＤ　〜ＤＤ−Ｄ、・・・・・・、Ｄ８１〜Ｄ８Ｂ
が（Ｄ８１・Ｄ７１・Ｄ６１・Ｄ５１・Ｄ４１・Ｄ３１
・Ｄ２１・Ｄｌｌ）・°°°・（Ｄ８８．Ｄ７８．Ｄ６
８．Ｄ５８．Ｄ４８．Ｄ３８．Ｄ２８．Ｄ１８）の配列
（９００回転させた時の配列）となるように、８つのト
ライステート出力パッファ５の入力端子に接続される。
又、トライステート出力パツファ５は、　ＣＰＵからの
読み出し信号ＲＤと、デコーダ１の出力とのダート回路
３によシ８つの内１つが選択され、データを出力する。
以上の方法にょシ、第２図（ａ）で示す８×８ドツトマ
トリツクスの入力データが９０°回転し、第２図（ｂ）
で示す結果として出力される。
入力ラッチ回路と出力バッファ間の結線を変更する事に
よシ、容易にｎ×ｎドツトのマトリックスを９０’回転
させる回路が構成できる。
〔発明の効果〕
以上説明したように本発明は、縦ｎビット横ｎビットの
マトリックス状ドツトデータを、　ＣＰＵからラッチ回
路への書き込みと、出力バッファ回路からのｎ回の読み
出しによシ、９０°回転させる事ができる為２文字を回
転させる為に必要なＣＰＵの処理時間を大幅に短縮でき
る効果がある。
【図面の簡単な説明】
第１図は９本発明の一実施例のブロック図であリ、１は
デコーダで、２はデコーダ１の出力をｉ信号により許可
又は禁止する為のダート回路、３はデコーダ１の出力を
ＲＤ倍信号より許可又は禁止する為のダート回路を示す
。又、４は８ピツトの入力データをラッチする為のラッ
チ回路を示し。 ５はトライステート出力８２７７回路である。 第２図は第１図の実施例の動作を説明するための図で、
（ａ）は８×８ドツトマトリツクス入力データの配列を
示し、（ｂ）はその入力データを９０°回転した結果の
データの配列を示している。 第３図は、従来技術におけるビットシフトによる９０°
回転した結果を出力する為の手順を説明するための図で
あり　、　（ａ）は８×８ドツトマトリツクス入力デー
タの配列を示し、（ｂ）はビットシフトによシ９０°回
転した出力データの配列を示している。 第１図 第２図 （Ｑ）　　ｓｘｓドツトマトリックス入力データ（１）
）　　　ｓｘｓドットマトリンクス出力データ第３図

Claims (1)

    【特許請求の範囲】
  1. １、縦ｎビット横ｎビットのマトリックス状ドットデー
    タを９０°回転させるｎ×ｎビットドットマトリックス
    ９０°回転回路において、前記マトリックス状ドットデ
    ータにおける縦方向のｎビットからなる列データを各々
    ラッチするためのｎ個のラッチ回路と、前記マトリック
    ス状ドットデータにおける横方向のｎビットからなる行
    データを各々出力できるように、前記ｎ個のラッチ回路
    の出力に入力を接続されたｎ個の出力バッファ回路とを
    備え、該ｎ個の出力バッファ回路の出力を、前記マトリ
    ックス状ドットデータの９０°回転データとして用いる
    ことを特徴とするｎ×ｎビットドットマトリックス９０
    °回転回路。
JP61271983A 1986-11-17 1986-11-17 ｎ×ｎビットドットマトリックス９０゜回転回路 Expired - Fee Related JPH0773920B2 (ja)

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JP61271983A JPH0773920B2 (ja) 1986-11-17 1986-11-17 ｎ×ｎビットドットマトリックス９０゜回転回路
US07/121,832 US4776026A (en) 1986-11-17 1987-11-17 Apparatus for rotating a dot matrix pattern by 90 degrees

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