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JPS6285527A - Transmission control system - Google Patents

Transmission control system

Info

Publication number
JPS6285527A
JPS6285527A JP22467585A JP22467585A JPS6285527A JP S6285527 A JPS6285527 A JP S6285527A JP 22467585 A JP22467585 A JP 22467585A JP 22467585 A JP22467585 A JP 22467585A JP S6285527 A JPS6285527 A JP S6285527A
Authority
JP
Japan
Prior art keywords
signal
circuit
signal frame
response
transmitting
Prior art date
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Granted
Application number
JP22467585A
Other languages
Japanese (ja)
Other versions
JPH0612899B2 (en
Inventor
Nobuaki Fujii
伸朗 藤井
Tetsuo Nakamura
徹雄 中村
Hiromi Ueda
裕巳 上田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nippon Telegraph and Telephone Corp
Original Assignee
Nippon Telegraph and Telephone Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Telegraph and Telephone Corp filed Critical Nippon Telegraph and Telephone Corp
Priority to JP22467585A priority Critical patent/JPH0612899B2/en
Publication of JPS6285527A publication Critical patent/JPS6285527A/en
Publication of JPH0612899B2 publication Critical patent/JPH0612899B2/en
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Abstract

PURPOSE:To improve the transmission efficiency of each communication by providing an identifier into a signal frame to decide the transmitting method of an answer between a main transmitting circuit and plural secondary receiving circuits to perform the communication. CONSTITUTION:A signal frame is sent to a signal line 2 from a primary transmitting circuit 1 in accordance with the constitution of the descending signal frame and received by the secondary receiving circuits 3-5. When it is confirmed that the addresses are coincident with the discriminating information on the circuits 3-5, these information are fetched and processed at a processing part 11. While the circuits 3-5 set the answer transmission control signals 12-14 under a state where the transmission is impossible for the answer expressed by the signal of level '0' as soon as the signal frame is received. At the same time, these signals 12-14 are set under a state where the answer can be transmitted by the state of the identifier for the answer transmitting method. Then the signals 12-14 are turned into the pulse signals that decide the level '1' or the timing to decide no answer transmitting timing according to '0' or '1' of the identifier. The secondary transmitting circuits 8-10 transmit the signal frames according to the constitution of the ascending signal frame via a signal line 7 and according to the signals 12-14.

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は主従関係がある多点間の通信における伝送制御
方式に関する。
DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a transmission control system in communication between multiple points having a master-slave relationship.

(従来の技術) 第5図はマルチドロップ接続による主従関係を持つ通信
システムの構成例である。1は主送信回路、2は信号線
、3は従受信回路1.4は従受信回路2.5はその他の
従受信回路、6は主受信回路、7は信号線、8は従送信
回路1.9は従送信回路2.10はその他の従送信回路
、11は処理回路である。本構成例では次のような順序
で信号送信が行なわれる。1の主送信回路が信号フレー
ムを2の信号線」二に送信する。、該信号フレームには
宛先となる従受信回路の識別情報(以下、アドレス)が
含まれる。3,4および5の各従受信回路は該信号フレ
ームのアドレス部分を一斉に受信し、該アドレスが該従
受信回路に付与されているものと一致していれば信号フ
レームをすべて取り込む。
(Prior Art) FIG. 5 shows a configuration example of a communication system having a master-slave relationship based on multi-drop connections. 1 is the main transmitting circuit, 2 is the signal line, 3 is the sub receiving circuit 1.4 is the sub receiving circuit 2.5 is the other sub receiving circuit, 6 is the main receiving circuit, 7 is the signal line, 8 is the sub transmitting circuit 1 .9 is a sub-transmission circuit 2; 10 is another sub-transmission circuit; and 11 is a processing circuit. In this configuration example, signal transmission is performed in the following order. The main transmitter circuit of 1 transmits the signal frame to the signal line of 2. , the signal frame includes identification information (hereinafter referred to as address) of the destination sub-receiving circuit. Each of the sub-receiving circuits 3, 4 and 5 receives the address portion of the signal frame all at once, and if the address matches the address given to the sub-receiving circuit, all the signal frames are taken in.

一致していない場合には信号フレームを該従受信回路内
で破棄する。6の主受信回路では1の主送信回路が信号
フレームを送信したのち受信待ちの状態となり、7の信
号線上の信号が受信できる状態にある。8,9および1
0の従送信回路の内、先の信号フレームを受信したもの
は11の処理回路で信号フレームの内容に従った制御等
の処理をしたのち、応答としての信号フレームを7の信
号線上に送信する。他は送信駆動回路を非作用状態にし
て該信号フレームの送信を妨げない。以上のようにして
主送信回路、従受信回路、従送信回路そして主受信回路
と通信が行なわれる。
If they do not match, the signal frame is discarded within the corresponding slave receiving circuit. The main receiving circuit 6 waits for reception after the main transmitting circuit 1 transmits the signal frame, and is ready to receive the signal on the signal line 7. 8, 9 and 1
Among the slave transmitting circuits 0, those that received the previous signal frame perform processing such as control according to the contents of the signal frame in the processing circuit 11, and then transmit the signal frame as a response onto the signal line 7. . Otherwise, the transmission drive circuit is inactive and does not interfere with the transmission of the signal frame. Communication is performed with the main transmitting circuit, the sub-receiving circuit, the sub-transmitting circuit, and the main receiving circuit as described above.

(発明が解決しようとする問題点) 従来、第5図のような機構をもった主従関係のある多点
間の通信には主従2点間で伝送制御手順を確立した後に
信号を送受する(例えば、HDLC主従局主従上モード
またはホーリングセレフティング手法により、複雑な伝
送制御手順を用いずに主局となる回路からの信号フレー
ムにアドレスを付け、これに応答させるかたちで逐次従
局となる回路を変えながら信号を送受していた。前者で
は全二重モードの通信が可能である主従開側々で伝送効
率は高いが従局となる回路の数が増加した場合、手順確
立がオーバヘッドとなり頻繁に従局を変えて通信すると
伝送効率が低下する欠点がある。一方、後者は伝送手順
確立といった手続を必要としないが、従局となる回路の
応答時間がまちまちであることを考慮すると伝送媒体は
主局となる回路からの信号フレームに対する応答として
の従局としての回路からの信号フレームが衝突しないよ
う半二重で通信が行なわれる必要が有り、個々の通信で
伝送効率が向上しないという欠点を有している。何れの
場合も主従となる回路には同等の性能が要求されるため
、従局となる回路を通(ま頻度相応のものとし、主局と
なる回路の信号の送受に関する処理能力を高め全体とし
て通信能力を効率よく高めようとする系においては不向
きである。尚、多点間で効率よく通信を行なう技術とし
ては、LANに見られるようなバスを用いた通信方式(
たとえば、C3MAを用いるネットワーク)があるがこ
れらは送受信回路がマルチドロップ型の回路接続と比べ
て複雑となり、通信目的によっては回路規模、信頼度2
回路価格の面で適合しない場合がある。
(Problems to be Solved by the Invention) Conventionally, in communication between multiple points in a master-slave relationship with the mechanism shown in Fig. 5, signals are sent and received after establishing a transmission control procedure between the two master-slave points ( For example, by using the HDLC master/slave station master/slave mode or the hauling selective method, a circuit that becomes a slave station can be created by attaching an address to a signal frame from a circuit that will become a master station and responding to the signal frame without using complicated transmission control procedures. In the former, full-duplex mode communication is possible, and the transmission efficiency is high on both the master and slave sides, but when the number of circuits that become slave stations increases, establishing procedures becomes an overhead and the slave station is frequently used. The disadvantage is that transmission efficiency decreases when communicating by changing the transmission medium.On the other hand, the latter does not require procedures such as establishing a transmission procedure, but considering that the response times of the slave station circuits vary, it is difficult to use the transmission medium as the master station. It is necessary to perform half-duplex communication to avoid collision of signal frames from circuits serving as slave stations in response to signal frames from other circuits, which has the disadvantage that transmission efficiency cannot be improved in individual communications. In either case, the master and slave circuits are required to have equivalent performance, so the circuits that will be the slave station should be connected to each other (or should be of a frequency commensurate with the frequency), and the processing capacity for signal transmission and reception of the circuit that will be the master station will be increased and the overall performance will be improved. It is unsuitable for systems that aim to increase communication capacity efficiently.In addition, as a technology for efficiently communicating between multiple points, communication methods using buses such as those found in LAN (
For example, there are networks that use C3MA), but the transmitting and receiving circuits in these are more complex than multi-drop circuit connections, and depending on the communication purpose, the circuit size and reliability may be 2.
It may not be suitable in terms of circuit price.

本発明は、主従関係のある多点間の通信で主局となる回
路と従局となる回路が伝送媒体を共有してマルチドロッ
プ型に接続した場合、従来の技術では十分に伝送効率を
高めることができないという欠点を除去することを目的
とする。
The present invention is capable of sufficiently increasing transmission efficiency using conventional technology when a circuit serving as a master station and a circuit serving as a slave station share a transmission medium and are connected in a multi-drop type in communication between multiple points in a master-slave relationship. The purpose is to eliminate the drawback of not being able to

(問題点を解決するための手段) 面記目的を達成するための本発明の特徴は、1つの主受
信回路と伝送媒体を共有してマルチドロップ型に接続さ
れる複数の従送信回路から構成される主従局型の通信系
において、信号を受信する受信回路の識別子と、信号フ
レームを受信し該信号フレームに対応する応答としての
信号フレームの送信を次の信号フレームの受信時に行な
うこと、または応答のための信号フレームが作成された
時点に送信することを支持する応答の発出方法の制御子
とを有する信号フレームを用い、連続的に複数の従受信
回路に対して信号を送信できる送信バッファを有する主
送信回路、複数の信号フレームを蓄えられる受信バッフ
ァと応答の発出方法の識別子により応答発出制御信号を
発生する応答制御回路を有する軸受イ3回路、複数の信
号フレームを蓄えることができ応答発出制御信号をトリ
ガとして送信バッファ内の信号フレームを1つ送信する
従信号送信回路、及び連続的に複数の信号フレームを受
信する受信バッファを有する主受信回路から構成される
機構により、主送信回路が送信する信号フレームの応答
の発出方法の識別子により信号フレームごとに従送信回
路が応答信号の送信方法を動的に変化させる伝送制御方
式にある。
(Means for Solving the Problems) The feature of the present invention for achieving the stated purpose is that it is composed of one main receiving circuit and a plurality of slave transmitting circuits that share a transmission medium and are connected in a multi-drop configuration. In a master/slave station type communication system, the identifier of a receiving circuit that receives a signal and a signal frame are received as a response to the signal frame, and the signal frame is transmitted when the next signal frame is received, or A transmission buffer capable of continuously transmitting signals to a plurality of sub-receiving circuits using a signal frame having a response generation method controller that supports transmitting a response signal frame at the time when it is created. A main transmission circuit that has a main transmitter circuit, a reception buffer that can store multiple signal frames, and a response control circuit that generates a response generation control signal based on the identifier of the response generation method.3 circuits that can store multiple signal frames and respond The main transmitting circuit is configured by a mechanism consisting of a secondary signal transmitting circuit that transmits one signal frame in the transmitting buffer triggered by an emission control signal, and a main receiving circuit that has a receiving buffer that continuously receives multiple signal frames. The transmission control method is such that the slave transmitting circuit dynamically changes the response signal transmission method for each signal frame based on the response generation method identifier of the signal frame transmitted by the signal frame.

(作用) 本発明は信号フレーム内に応答方法の識別子を導入し、
主送信回路からの信号フレームに対して、受信した信号
フレームの指示に従って従送信回路が共有している伝送
媒体を効率よく使用して応答のための信号フレームを送
信する。
(Operation) The present invention introduces a response method identifier into the signal frame,
In response to the signal frame from the main transmission circuit, the slave transmission circuit transmits a response signal frame by efficiently using the shared transmission medium according to the instructions of the received signal frame.

(実施例) 第1図は本発明の実施例であって、1は主送信回路、2
は信号線、3は従受信回路1,4は従受信回路2.5は
その他の従受信回路、6は主受信回路、7は信号線、8
は従送信回路1.9は従送信回路2,10はその他の従
送信回路、11は処理回路、12.13および14は応
答発出制御信号である。
(Embodiment) FIG. 1 shows an embodiment of the present invention, in which 1 is the main transmitting circuit, 2
is a signal line, 3 is a sub-receiving circuit 1, 4 is a sub-receiving circuit 2.5 is another sub-receiving circuit, 6 is a main receiving circuit, 7 is a signal line, 8
9 is a slave transmitting circuit 1, 9 is a slave transmitting circuit 2, 10 is another slave transmitting circuit, 11 is a processing circuit, and 12, 13 and 14 are response generation control signals.

第2図は本発明の実施例(第1図)において2および7
の信号線上で使用する信号フレームの構成例であって、
2をながれる下り信号フレームは受信回路の識別子(宛
先アドレス)、情報、応答の発出方法の識別子、フレー
ム構成信号(フレーム信号、誤り検出信号等)からなり
、3をながれる上り信号フレームは受信回路の識別子(
発信元アドレス)、情報、応答の発出方法の識別子、フ
レーム構成信号(フレーl、信号、誤り検出信号等)か
らなる。該応答の発出方法の識別子は 11 Q II
のとき信号フレームを受信した後、任意のタイミングで
応答の為の信号フレームを送信して良いことを示し、I
I I P+のとき信号フレームを受信したと同時に送
信回路内に予め用意されていた応答の為の信号フレーム
を1つだけ送信していいことを示す。
FIG. 2 shows 2 and 7 in the embodiment of the present invention (FIG. 1).
An example of the configuration of a signal frame used on a signal line,
The downstream signal frame flowing through 2 consists of the receiving circuit identifier (destination address), information, an identifier of the response issuing method, and frame configuration signals (frame signal, error detection signal, etc.), and the upstream signal frame flowing through 3 consists of the receiving circuit identifier(
It consists of a source address), information, an identifier for the response issuing method, and frame configuration signals (frame I, signal, error detection signal, etc.). The identifier of the response issuing method is 11 Q II
Indicates that a signal frame for response may be transmitted at any timing after receiving a signal frame, and I
IIP+ indicates that at the same time as a signal frame is received, only one signal frame for a response prepared in advance in the transmitting circuit may be transmitted.

即ち 111 IIのときには受信した信号フレームの
処理結果は応答として処理をした直後には送信してはい
けないことをも示す。
In other words, 111 II also indicates that the processing result of the received signal frame should not be transmitted immediately after processing as a response.

第3図は本発明の実施例(第1図)において連続的に2
及び7の信号線上を流れる信号フレームの状態を示すも
のである。各線の上のブロックはフレームを示し、該ブ
ロック内の英字は宛先および発信元のアドレスを示す。
FIG. 3 shows that in the embodiment of the present invention (FIG. 1) two
This shows the state of the signal frame flowing on the signal lines 7 and 7. The blocks above each line indicate frames, and the alphabetic characters within the blocks indicate destination and source addresses.

また、数字は応答発出方法の識別子の状態を示す。該ブ
ロック上に示したカナはフレームの対応関係を区別する
ためのものである。
Further, the number indicates the status of the response issuing method identifier. The kana characters shown on the block are for distinguishing the correspondence between frames.

本実施例は以下のように動作する。This embodiment operates as follows.

1の主送信回路から2の信号線に第2図の下り信号フレ
ームの構成に従った信号フレームが送信される。該信号
フレームのFlにはフレームの先頭を示す情報、宛先ア
ドレスには受信すべき従受信回路の識別情報、情報部分
には送信したいデータ、F2には応答のための信号フレ
ームの送信方法、さらにはF3にフレームの終りを示す
情報が設定される。該信号フレームは3,4および5の
総ての従受信回路で受信される6該軸受信回路では受信
した該信号フレームが正常に受信された事を確認した後
、宛先アドレスが該従受信回路の識別情報と一致してい
るか確認し、一致していれば情報を取り込み11の処理
部分で処理を実施する。
A signal frame according to the configuration of the downlink signal frame shown in FIG. 2 is transmitted from the main transmitting circuit 1 to the signal line 2. Fl of the signal frame contains information indicating the beginning of the frame, the destination address contains identification information of the sub-receiving circuit to be received, the information part contains the data to be transmitted, F2 contains the method of transmitting the signal frame for response, and Information indicating the end of the frame is set in F3. The signal frame is received by all the sub-receiving circuits 3, 4, and 5. After the 6-axis receiving circuit confirms that the received signal frame has been received normally, the destination address is determined by the sub-receiving circuit. It is confirmed whether the identification information matches the identification information of , and if it matches, the information is fetched and processed in the processing section 11.

また総ての従受信回路は予め信号フレームの受信と同時
に12.13および14の総ての応答発出制御信号をレ
ベルOの信号で表せられる応答が発出できない状態に設
定しておく。該信号フレームの宛先に合致した従受信回
路では信号フレーム内の応答発出方法の識別子の状態に
より、該従受信回路の該応答制御信号を応答が発出でき
る状態に設定する。該応答制御信号は該応答発出方法識
別子が11011のときは応答の発出タイミングを指定
しないレベル1の信号となり、該応答発出方法識別子が
LL I IIのときは応答の発出タイミングを定める
パルス信号となる。8,9および10の従送信回路では
12,13および14の該応答制御信号に従い、第2図
の上り信号フレームの構成に従ったイホ号フレームが信
号線7を介して送信される。信号フレームの送受の模様
を以下第3図を用いて説明する。
In addition, all the sub-receiving circuits are set in advance to a state in which all response generation control signals 12, 13 and 14 cannot be generated at the same time as the signal frame is received. In the secondary receiving circuit that matches the destination of the signal frame, the response control signal of the secondary receiving circuit is set to a state in which a response can be issued, depending on the state of the response issuing method identifier in the signal frame. When the response generation method identifier is 11011, the response control signal becomes a level 1 signal that does not specify the response generation timing, and when the response generation method identifier is LL I II, it becomes a pulse signal that determines the response generation timing. . In accordance with the response control signals 12, 13 and 14, the slave transmitting circuits 8, 9 and 10 transmit Iho frames according to the configuration of the upstream signal frame shown in FIG. 2 via the signal line 7. The manner in which signal frames are transmitted and received will be explained below with reference to FIG.

第3図は、1の主送信回路から2の下り信号線に対して
、信号フレームが“イロハニホヘトチ″と逐次送イ3さ
れ、7の上り信号線を介して、応答としての信号フレー
ムが傘】串20ハイニホヘ″と6の主受信回路で受信さ
れている状態を示している。3の従受信回路1および8
の従送信回路2のアドレスをA、4の従受信回路2およ
び9の従送信回路2のアドレスをB、その他の従受信回
路および従受信回路および従送信回路のアドレスをCす
る。
Fig. 3 shows that signal frames are sequentially sent from the main transmitter circuit 1 to the down signal line 2 in a sequence of ``Irohanihohetochi'', and a signal frame as a response is transmitted via the upstream signal line 7. 】Skewer 20 High Nihohe'' and 6 main receiving circuits are receiving signals. 3 sub-receiving circuits 1 and 8
The address of the secondary transmitting circuit 2 of No. 4 is A, the address of the secondary receiving circuit 2 of No. 4 and the secondary transmitting circuit 2 of No. 9 is B, and the address of the other secondary receiving circuits, secondary receiving circuits, and secondary transmitting circuits is C.

(1)”イ″の信号フレームはアドレス11 A II
(1) “A” signal frame is at address 11 A II
.

応答発出方法LL I IIが指定されており、従受信
回路1が該信号フレームを受信すると直ちに送信バッフ
ァ内にあった応答の為の信号フレーム傘1を該上り信号
線に送信する。該信号フレーム内のアドレス“A”は信
号フレームが従送信回路1から送られたことを示し、応
答発出方法111 Itは該信号フレーム送信と関連す
る信号フレームの受信において応答発出方法がit 1
 toに指定されていたことを示す。
The response issuing method LL I II is specified, and as soon as the secondary receiving circuit 1 receives the signal frame, it transmits the signal frame umbrella 1 for the response that was in the transmission buffer to the upstream signal line. The address "A" in the signal frame indicates that the signal frame was sent from the slave transmission circuit 1, and the response issuing method 111 It indicates that the response issuing method is it 1 in receiving the signal frame related to the signal frame transmission.
Indicates that it was specified as to.

(2)”口′″の信号フレームも同様に従受信回路2で
受信され、7の該下り信号線に11 、21Fの信号フ
レームを送信する。2の信号線上のフレーム″イI+ 
、 ’LL口″に対応する応答のための信号フレームは
各処理部(11)の処理の後、従送信回路1、従送信回
路2の送信バッファに設定される。
(2) The signal frame of "mouth" is similarly received by the slave receiving circuit 2, and the signal frames of 11 and 21F are transmitted to the downstream signal line of 7. Frame ``I+'' on the signal line of 2
, the signal frame for the response corresponding to the 'LL mouth' is set in the transmission buffers of the sub-transmission circuit 1 and the sub-transmission circuit 2 after being processed by each processing section (11).

(3)”ハ″の信号フレームは従受信回路24″一対し
てのものであり、応答発出方法は“Ottの任意タイミ
ングと指定している。該従受信回路2は該信号フレーム
を受信すると直ちに従送信回路2に蓄えられている既に
受信した信号フレーム1′口”に対応するフレームを7
の信号線に対して送信する。
(3) The signal frame "C" is for a pair of slave receiving circuits 24", and the response generation method is designated as "Ott's arbitrary timing". Immediately upon receiving the signal frame, the slave receiving circuit 2 transmits the frame 7 corresponding to the already received signal frame 1' stored in the slave transmitting circuit 2.
Transmit to the signal line.

次に、゛ハ″の信号フレームに対する応答の為の信号フ
レーlいができると該信号フレームを送信する。1の主
送信回路は応答発出方法を110 IIとしたフレーム
″ハ″を送信したため、該信号フレームパハ″に対応す
る応答のための信号フレームを6の主受信回路が受信す
るまで次の信号フレームを送信しない。
Next, when a signal frame 1 is created in response to the signal frame ``c'', the signal frame is transmitted.Since the main transmitter circuit 1 transmitted the frame ``c'' with the response generation method set to 110 II, The next signal frame is not transmitted until the main receiving circuit 6 receives a signal frame for response corresponding to the signal frame Pach''.

(4)”二″の信号フレームは″ハ″の信号フレームと
同等の条件で従受信回路1に対して送信されたものであ
り、これに対応して信号フレーム″ハ″の場合と同等に
従送信回路】から応答のための信号フレーム″イn、u
二″が送信される。
(4) The "second" signal frame is transmitted to the secondary receiving circuit 1 under the same conditions as the "c" signal frame, and correspondingly, the signal frame "c" is transmitted under the same conditions as the signal frame "c". Signal frame for response from slave transmitter circuit ``in, u
2″ is sent.

(5)”ホ″の信号フレームは他の従受信回路に対する
ものであり、応答発出方法を1”としている。この場合
、該従受信回路に対応する従送信回路内の送信バッファ
内に送信フレームが設定されていなかったため、7の信
号線上には信号フレームが送信されない。応答の為の信
号フレームは作成後、該従送信回路の送信バッファで送
信待ちの状態となる。
(5) The signal frame "E" is for another slave receiving circuit, and the response generation method is set to "1".In this case, the transmission frame is stored in the transmission buffer in the slave transmitting circuit corresponding to the slave receiving circuit. is not set, the signal frame is not transmitted on the signal line 7. After the signal frame for the response is created, it waits for transmission in the transmission buffer of the slave transmission circuit.

(6)”八″の信号フレームは従受信回路1に対するも
のであり、応答発出方法を′1″としている。“二”の
信号フレームに対してすでに応答の為の信号フレームを
送信済みであるから、従送信回路1には送信すべき信号
フレームが存在せず、従って、7の上り信号線には信号
フレームが送信されない。
(6) The signal frame “8” is for the secondary receiving circuit 1, and the response generation method is set to “1”.The signal frame for the response has already been sent to the signal frame “2”. Therefore, there is no signal frame to be transmitted in the slave transmitting circuit 1, and therefore, no signal frame is transmitted to the upstream signal line 7.

(7)”ト”の信号フレームに対しては、受信した″ホ
″の信号フレームに対応する応答の為の信号フレーム″
ホ″が送信される。
(7) For the “G” signal frame, a response signal frame corresponding to the received “H” signal frame”
” is sent.

(8)“チ″の信号フレームに対しては、受信したパへ
′の信号フレームに対応する応答の為の信号フレーム″
へ″が送信される。
(8) For the signal frame “chi”, a signal frame for response corresponding to the received signal frame “p”
” is sent to.

第4図は本発明の実施例(第1図)で示した3゜4およ
び5の従受信回路、8,9および10の従送信回路、応
答制御信号線の構成例であり、2,7は信号線、12は
応答発出制御線、15は信号フレーム受信バッファ、1
6はフレーム受信判定回路、17は応答発出制御回路、
18は送信バッファ、19は送信タイミング回路、20
は送信タイミング制御、21は送信バッファ駆動回路で
ある。信号1はアドレス信号、信号2は信号フレーム受
信完了信号、信号3はフレーム受信判定信号、信号4は
応答方法識別信号、信号5は受信信号、信号6は応答発
出制御信号、信号7は送信要求信号、信号8は送信タイ
ミング信号、信号9は送信制御信号、信号10は送信バ
ッファ駆動信号、信号11は送信データ信号であり、タ
イミングチャートを示す。本構成例は以下の用に動作す
る。
FIG. 4 shows a configuration example of the 3°4 and 5 sub receiving circuits, the 8, 9 and 10 sub transmitting circuits, and the response control signal line shown in the embodiment of the present invention (Fig. 1). is a signal line, 12 is a response generation control line, 15 is a signal frame reception buffer, 1
6 is a frame reception determination circuit; 17 is a response generation control circuit;
18 is a transmission buffer, 19 is a transmission timing circuit, 20
21 is a transmission timing control circuit, and 21 is a transmission buffer drive circuit. Signal 1 is an address signal, Signal 2 is a signal frame reception completion signal, Signal 3 is a frame reception determination signal, Signal 4 is a response method identification signal, Signal 5 is a reception signal, Signal 6 is a response generation control signal, Signal 7 is a transmission request The timing chart shows the signals, signal 8 is a transmission timing signal, signal 9 is a transmission control signal, signal 10 is a transmission buffer drive signal, and signal 11 is a transmission data signal. This configuration example operates for the following purposes.

2の下り方向の信号線を通して15の信号フレーム受信
バッファに信号の入力が完了すると信号】−に宛先アド
レスと信号2にパルスが1つ送出される。該信号1と該
信号2は16の受信判定回路で評価されアドレスの一致
が判定されると信号3にパルスが1つ送出される。17
の応答発出制御回路には信号4のレベルII I TT
または110 IIの応答方法識別信号と該信号2およ
び該信号3が入力される。
When the input of the signal to the signal frame reception buffer 15 through the downstream signal line 2 is completed, the destination address is sent to the signal ]- and one pulse is sent to the signal 2. The signals 1 and 2 are evaluated by 16 reception determination circuits, and when it is determined that the addresses match, one pulse is sent to the signal 3. 17
The response generation control circuit has the level II I TT of the signal 4.
Alternatively, the response method identification signal of 110 II, the signal 2, and the signal 3 are input.

17の該応答発出制御回路では該信号2または該信号4
の立ち下がりを用いて信号6の応答発出制御信号をリセ
ットする。該信号3の立上りで信号6はセットされ応答
発出制御信号として出力する。
In the response generation control circuit No. 17, the signal 2 or the signal 4
The response generation control signal of signal 6 is reset using the falling edge of the signal. At the rising edge of signal 3, signal 6 is set and output as a response generation control signal.

該信号3は15の受信バッファにも入力され、受信した
フレームを処理部分に取り込むト、リガとして用いられ
る。18の送信バッファでは信号11の送信データ信号
の設定が完了すると信号7送信要求信号にパルスを送出
し、19の送信タイミング回路にタイミングパルスの発
生を要求する。19の該送信タイミング回路では、該送
信要求信号の立ち上りでタイミングを連続発生させ、信
号8の送信タイミング信号として20の送信タイミング
制御回路に該信号を供給する。19の該送信タイミング
回路は信号9の送信制御信号の立ち上り点で解除される
The signal 3 is also input to the receiving buffer 15, and is used as a trigger for fetching the received frame into the processing section. When the transmission buffer 18 completes the setting of the transmission data signal signal 11, it sends a pulse to the transmission request signal signal 7, and requests the transmission timing circuit 19 to generate a timing pulse. The transmission timing circuit 19 continuously generates timing at the rising edge of the transmission request signal, and supplies this signal as the transmission timing signal of the signal 8 to the transmission timing control circuit 20. The transmission timing circuit 19 is released at the rising point of the transmission control signal signal 9.

20の該送信タイミング制御回路では信号6の該応答発
出制御信号と該信号8の論51!積をとり、信号9の該
送信制御信号を21の送信バッファ駆動回路に送る。2
1の該送信バッファ駆動回路では該送信制御信号の立ち
上りをトリガとして送信バッファ駆動信号を18の該送
信バッファに供給し、該送信バッファは該送信バッファ
駆動信号により該送信バッファ内の信号を7の下り信号
線に送信する。
In the transmission timing control circuit 20, the response generation control signal 6 and the signal 8 51! The product is multiplied and the transmission control signal of signal 9 is sent to the transmission buffer drive circuit 21. 2
The transmission buffer drive circuit No. 1 supplies a transmission buffer drive signal to the No. 18 transmission buffers using the rising edge of the transmission control signal as a trigger, and the transmission buffer converts the signal in the transmission buffer No. 7 by the transmission buffer drive signal. Transmit to the downlink signal line.

このような構成になっているから、主従関係のあるマル
チドロップ型に接続された通信システ11において、主
送信回路からの信号フレームの連続送信を行なっても、
各従送信回路から送信される応答のための信号フレーム
が相互に衝突することなしに通信を効率よく行なうこと
ができる。
With such a configuration, even if signal frames are continuously transmitted from the main transmission circuit in the communication system 11 connected in a multi-drop type with a master-slave relationship,
Communication can be performed efficiently without collision of signal frames for responses transmitted from each slave transmitting circuit.

なお、好ましくは従送信回路が送信する信号フレームと
他の従送信回路が送信する信号フレームとを伝送媒体上
で衝突させないため、主送信回路の送信する信号フレー
ムが従送信回路の送信する信号フレームより、伝送遅延
分以上長くする。
Preferably, in order to prevent the signal frame transmitted by the slave transmitter circuit from colliding with the signal frame transmitted by another slave transmitter circuit on the transmission medium, the signal frame transmitted by the main transmitter circuit is the same as the signal frame transmitted by the slave transmitter circuit. Therefore, the length is longer than the transmission delay.

(効果の説明) 以上説明したように、本構成では主送信回路と複数の従
受信回路の間で信号フレーム内に応答の発出方法を定め
る識別子を設けて通信を行なうことから次のような利点
がある。
(Explanation of Effects) As explained above, in this configuration, communication is performed between the main transmitting circuit and the plurality of sub-receiving circuits by providing an identifier that determines the method of issuing a response in the signal frame, which provides the following advantages. There is.

(a)マルチドロップ型の接続においても応答のための
信号フレームの衝突がおこらない。
(a) Collision of signal frames for responses does not occur even in multi-drop type connections.

(b)複数の従受信回路に対して一応に信号フレームを
送信することにより、信号線の多重利用効果を最大に高
めることができる。
(b) By transmitting signal frames to a plurality of sub-receiving circuits, the effect of multiple use of signal lines can be maximized.

(c)複数の従受信回路に対して一応に信号フレームを
送信することにより、従受信回路の負荷を軽減すること
ができる。
(c) The load on the secondary receiving circuits can be reduced by transmitting signal frames to a plurality of secondary receiving circuits.

(d)従受信回路の構造が簡素であるため、多くの従受
信回路、従送信回路を有する通信システムにおいて回路
規模を小型化できる。
(d) Since the structure of the secondary receiving circuit is simple, the circuit scale can be reduced in a communication system having many secondary receiving circuits and secondary transmitting circuits.

(e)応答発出方法の変更により、半二重、全二重通信
の選択ができ応答の受信状態に応じた信号フレームの送
信ができる。
(e) By changing the response issuing method, it is possible to select half-duplex or full-duplex communication, and it is possible to transmit a signal frame according to the reception state of the response.

従って、本発明は大量の順序関係のない情報を複数の装
置に対して、簡素なインタフェースをもちいて高速に転
送する必要がある1例えば、同期多重変換装置の回線設
定データの制御装置からの書換えに応用できる。
Therefore, the present invention requires a large amount of unordered information to be transferred to multiple devices at high speed using a simple interface.1 For example, rewriting line setting data of a synchronous multiplex converter from a control device. It can be applied to

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の実施例の構成図、第2図は第1図にお
いて2および7の信号線上で使用する信号フレームの構
成例、第3図は第1図において連続的に2および7の信
号線上を流れる信号フレームの状態図、第4図は第1図
で示した従受信回路、従送信回路、応答制御信号線の構
成例と動作タイムチャート、第5図は従来のマルチドロ
ップ接続による主従関係を持つ通信システムの構成図で
ある。 1・・・主送信回路、2・・・信号線、3・・・従受信
回路1.4・・・従量イ8回路2,5・・・その他の従
受信回路、6・・・主受信回路2.7・・・(i号線、
8・・従送信回路1.9・・・従送信回路2,10・・
・その他の従送信回路。 11・・・処理回路、12.13および14・・・応答
発出制御信号、15・・・信号フレーム受信バッファ、
■6・・・フレーム受信判定回路、17・・・応答発出
制御回路、18・・・送信バッファ、 19・・・送信
タイミング回路、20・・・送信タイミング制御、21
・・・送信バッファ駆動回路信号1・・・アドレス信号
、43号2・・・信号フレーム受信完了信号、信号3・
・・フレーム受信判定信号、信号4・・・応答方法識別
信号、信号5・・・受信信号、信号6・・・応答発出制
御信号、信号7・・・送信要求信号、信号8・・・送信
タイミング信号、信号9・・・送信制御信号、信号10
・・・送信バッファ駆動信号、信号11・・・送信デー
タ信号。
FIG. 1 is a configuration diagram of an embodiment of the present invention, FIG. 2 is an example of the configuration of a signal frame used on signal lines 2 and 7 in FIG. 1, and FIG. Fig. 4 is a configuration example and operation time chart of the sub-receiving circuit, sub-transmitting circuit, and response control signal line shown in Fig. 1, and Fig. 5 is a conventional multi-drop connection. 1 is a configuration diagram of a communication system having a master-slave relationship. DESCRIPTION OF SYMBOLS 1... Main transmitting circuit, 2... Signal line, 3... Sub-receiving circuit 1.4... Quantity I8 circuit 2, 5... Other sub-receiving circuits, 6... Main receiving Circuit 2.7... (line i,
8...Sub transmission circuit 1.9...Sub transmission circuit 2, 10...
・Other slave transmitter circuits. 11... Processing circuit, 12.13 and 14... Response issuing control signal, 15... Signal frame reception buffer,
■6... Frame reception determination circuit, 17... Response generation control circuit, 18... Transmission buffer, 19... Transmission timing circuit, 20... Transmission timing control, 21
...Transmission buffer drive circuit signal 1...Address signal, No. 43 2...Signal frame reception completion signal, signal 3.
...Frame reception determination signal, Signal 4...Response method identification signal, Signal 5...Reception signal, Signal 6...Response issue control signal, Signal 7...Transmission request signal, Signal 8...Transmission Timing signal, signal 9... Transmission control signal, signal 10
...Transmission buffer drive signal, signal 11...Transmission data signal.

Claims (1)

【特許請求の範囲】 1つの主受信回路と伝送媒体を共有してマルチドロップ
型に接続される複数の従送信回路から構成される主従局
型の通信系において、 信号を受信する受信回路の識別子と、信号フレームを受
信し該信号フレームに対応する応答としての信号フレー
ムの送信を次の信号フレームの受信時に行なうこと、ま
たは応答のための信号フレームが作成された時点に送信
することを支持する応答の発出方法の制御子とを有する
信号フレームを用い、 連続的に複数の従受信回路に対して信号を送信できる送
信バッファを有する主送信回路と、複数の信号フレーム
を蓄えられる受信バッファと応答の発出方法の識別子に
より応答発出制御信号を発生する応答制御回路を有する
従受信回路と、複数の信号フレームを蓄えることができ
応答発出制御信号をトリガとして送信バッファ内の信号
フレームを1つ送信する従信号送信回路と、及び連続的
に複数の信号フレームを受信する受信バッファを有する
主受信回路とを具備し、主送信回路が送信する信号フレ
ームの応答の発出方法の識別子により信号フレームごと
に従送信回路が応答信号の送信方法を動的に変化させる
事を特徴とする伝送制御方式。
[Claims] In a master-slave station type communication system consisting of one main receiving circuit and a plurality of slave transmitting circuits connected in a multi-drop manner sharing a transmission medium, an identifier of a receiving circuit that receives a signal. and supports receiving a signal frame and transmitting a signal frame as a response corresponding to the signal frame when the next signal frame is received, or at the time when a signal frame for response is created. A main transmitting circuit that has a transmitting buffer that can continuously transmit signals to multiple sub-receiving circuits using a signal frame that has a controller for how to issue a response, a receiving buffer that can store multiple signal frames, and a response. A sub-receiving circuit has a response control circuit that generates a response generation control signal based on the identifier of the generation method, and a secondary reception circuit that can store a plurality of signal frames and transmits one signal frame in the transmission buffer using the response generation control signal as a trigger. The main receiving circuit includes a secondary signal transmitting circuit and a receiving buffer that continuously receives a plurality of signal frames, and the main receiving circuit receives a plurality of signal frames according to each signal frame according to an identifier of a method of issuing a response to the signal frame transmitted by the main transmitting circuit. A transmission control method characterized by a transmitter circuit dynamically changing the method of transmitting response signals.
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