JPS622856Y2 - - Google Patents
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- JPS622856Y2 JPS622856Y2 JP8564182U JP8564182U JPS622856Y2 JP S622856 Y2 JPS622856 Y2 JP S622856Y2 JP 8564182 U JP8564182 U JP 8564182U JP 8564182 U JP8564182 U JP 8564182U JP S622856 Y2 JPS622856 Y2 JP S622856Y2
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- Japan
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- signal
- input
- switches
- output device
- control circuit
- Prior art date
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Description
【考案の詳細な説明】
本考案は、遠方監視制御装置の制御所側等に備
える監視操作パネルに関し、特にパネル上の表示
灯、スイツチ類とデータ処理部との信号入出力装
置に関する。[Detailed Description of the Invention] The present invention relates to a monitoring operation panel provided in a control center of a remote monitoring and control device, and particularly to a signal input/output device between indicator lights, switches, and a data processing section on the panel.
遠方監視制御装置は多数の外部機器を中央にて
監視操作するため、監視操作パネル上に外部機器
数に対応づけて個々にランプ、スイツチ類を備
え、ランプ表示で対応する機器の状態を表示し、
スイツチ操作で対応する機器のON,OFF指令等
を発する。 Since remote monitoring and control equipment centrally monitors and operates a large number of external devices, the monitoring operation panel is equipped with individual lamps and switches corresponding to the number of external devices, and the status of the corresponding devices is displayed on the lamp display. ,
Issues ON/OFF commands for the corresponding equipment by operating a switch.
第1図は従来の監視操作パネルとデータ処理部
との結合を示す。監視操作パネル1には外部機器
に対応づけて#1〜#Nまでの選択スイツチを備
え、#1〜#Nには夫々ランプL1,L2、スイツ
チS1を少なくとも1個備える。これらランプ、ス
イツチの信号入出力は個別に入出力装置2との接
続がなされ、入出力装置2にて信号の記憶、保持
等がなされてデータ処理部3との信号授受が選択
される。 FIG. 1 shows the combination of a conventional monitoring operation panel and a data processing section. The monitoring operation panel 1 is provided with selection switches #1 to #N in association with external devices, and each of #1 to #N is provided with at least one lamp L1 , L2 and at least one switch S1 . Signal inputs and outputs of these lamps and switches are individually connected to an input/output device 2, and the input/output device 2 stores, holds, etc. the signals, and selects the signal exchange with the data processing section 3.
従つて、パネル1と入出力装置2とはランプ、
スイツチ毎に接続がされるため、その配線数が膨
大になるし、パネル内の配線数も膨大になり、パ
ネル1、入出力装置2の製造、試験に多大の労力
を必要とした。 Therefore, the panel 1 and the input/output device 2 are lamps,
Since each switch is connected, the number of wires becomes enormous, and the number of wires within the panel also becomes enormous, requiring a great deal of effort to manufacture and test the panel 1 and the input/output device 2.
本考案の目的は、監視操作パネル内の配線の単
純化および入出力装置の簡単化を図ることができ
る信号入出力装置を提供するにある。 An object of the present invention is to provide a signal input/output device that can simplify wiring within a monitoring operation panel and simplify the input/output device.
第2図は本考案の一実施例を示すブロツク図で
ある。各選択スイツチ#1〜#Nにはランプ、ス
イツチ類の信号を時間的に分割したパルスとして
入出力制御をする制御回路C1〜CNを備え、各制
御回路と入出力装置4とは共通の信号線で結合さ
れ、その間の入出力信号も第3図に示す如く時間
的に区別する時分割方式にしている。このように
構成することで、各選択スイツチ#1〜#Nは制
御回路と一体的に構成され、パネル内配線を大幅
に低減できると共に配線数の低減で耐ノイズ性を
向上できる。また、入出力装置4のパネル側接続
を大幅に簡単化できる。なお第2図においては
#1〜#N迄のランプ数、スイツチ数を夫々同一
としてグループ分けしているが、これは同一数で
なくてもよく、例えば#2はランプ1個のみ或は
スイツチ1個のみでもよい。 FIG. 2 is a block diagram showing one embodiment of the present invention. Each selection switch #1 to #N is equipped with a control circuit C1 to CN that performs input/output control as pulses obtained by dividing lamp and switch signals in time, and each control circuit and the input/output device 4 are common. The input and output signals between the two signal lines are also connected in a time-division manner, as shown in FIG. With this configuration, each of the selection switches #1 to #N is integrated with the control circuit, and the wiring inside the panel can be significantly reduced, and the noise resistance can be improved by reducing the number of wirings. Furthermore, the connection of the input/output device 4 on the panel side can be greatly simplified. In Fig. 2, #1 to #N are grouped with the same number of lamps and switches, but these do not have to be the same number; for example, #2 has only one lamp or switch. It may be only one.
第4図は第2図における選択スイツチ#1〜
#Nと入出力装置2との間の信号伝送フオーマツ
トを示す。同期用のスタート信号はそのパルス幅
の大きさでデータとの区別がされ、スタート信号
に続いて各選択スイツチ#1〜#Nに対応づけた
順序で時間配分がなされ、スタート信号から#N
の信号区分までを1フレームとしている。#1〜
#Nまでの信号は4ビツト構成にされ、第1ビツ
トPL1がランプL1の点灯タイミング、第2ビツト
PL2がランプL2の点灯タイミング、第3ビツト
PL3がスイツチS1の操作タイミング、第4ビツト
PL4がスイツチS1のON操作確認タイミングにさ
れる。PL1からPL3まではそのパルス幅の大、小
でランプの点灯、消灯又はスイツチのON,OFF
が区別され、PL4はパルス幅の大、小でスイツチ
ONの確認と非確認とが区別され、さらに確認に
対してスイツチの状態が異なれば伝送異常として
パルス幅をさらに大きくした信号にされる。 Figure 4 shows selection switches #1 to 1 in Figure 2.
The signal transmission format between #N and the input/output device 2 is shown. The start signal for synchronization is distinguished from data by its pulse width, and following the start signal, time is allocated in the order corresponding to each selection switch #1 to #N, and from the start signal to #N.
One frame consists of signal divisions up to . #1~
The signals up to #N are composed of 4 bits, the first bit PL1 is the lighting timing of lamp L1 , and the second bit is
PL 2 is the lighting timing of lamp L 2 , 3rd bit
PL 3 is the operation timing of switch S 1 , the 4th bit
PL 4 is set as the ON operation confirmation timing for switch S 1 . From PL 1 to PL 3 , the lamp is turned on or off or the switch is turned on or off depending on the pulse width.
are distinguished, and PL 4 can be switched depending on the pulse width, large or small.
Confirmation and non-confirmation of ON are distinguished, and if the state of the switch is different from confirmation, a signal with a wider pulse width is generated as a transmission error.
第5図は第2図における制御回路Cの一実施例
を示し、入出力装置との結合を1線式で行なう場
合である。一点鎖線ブロツクで示す制御回路は結
合回路61,62で共通の信号線7と結合され、
結合回路61は信号線7からのデータの取込みを
し、結合回路62はデータを信号線に送出する。
結合回路61から取込まれたデータ(第4図)は
そのスタート信号がスタート検出回路8で検出さ
れ、計数器9のリセツト信号にされる。またデー
タの#1から#Nまでの各PL1〜PL4ビツトのパ
ルスはクロツク検出器10にてクロツクとして検
出され、クロツクは計数器9の計数入力にされ
る。また、データの長符号(パルス幅大)ビツト
は長符号検出器にて検出される。「計数器9は、
PL1〜PL4の4つのパルス計数で下位2桁からの
桁上げがあつて該下位2桁を除く上位桁の計数値
を選択スイツチ番号#1〜#Nに対応づけること
がでできるので、当該制御回路に割当てるスイツ
チ番号をアドレス設定器12に設定しておけば計
数器9の計数値とアドレス設定器12のアドレス
設定値との一致が一致検出回路13で検出されれ
ば当該制御回路のデータPL1〜PL4が下位2桁に
取込まれるタイミングとして得ることができる。
そして、一致回路13の一致出力は分配器14へ
の入力指令にされることで当該制御回路のデータ
PL1〜PL4のタイミングパルス(第4図のPL1〜
PL4)を分配器14の出力として得る。なお、ア
ドレス設定器12の設定値は制御回路に名付けら
れるアドレスから1減算した値に設定され、当該
アドレスのデータPL1〜PL4の計数時に予め分配
器14の入力指令を得るようにされる。入力指令
の与えられた分配器14は計数器9の下位2桁を
デコードし、PL1〜PL4のタイミング出力を得
る。そのうち、L1,L2は夫々ラツチ回路15,
16のクロツク入力される。ラツチ回路15,1
6はそのデータ入力を長符号検出器11の出力と
され、PL1に長符号があればデータ入力“1”を
ラツチ回路15に記憶し、PL2に長符号があれば
ラツチ回路16に記憶する。ラツチ回路15,1
6の“1”出力は結合回路17,18を介してラ
ンプL1,L2の点灯信号になる。従つて信号線7
から取込んだ第4図のデータのうち、選択スイツ
チ#1〜#Nとして指定されるアドレスのデータ
を抽出し、そのうちのPL1,PLB2のデータに応じ
てランプL1,L2の点灯、消灯の制御がなされ
る。 FIG. 5 shows an embodiment of the control circuit C shown in FIG. 2, in which connection with an input/output device is performed by a one-wire system. The control circuit indicated by the dash-dotted line block is connected to the common signal line 7 by the connection circuits 6 1 and 6 2 ,
The coupling circuit 61 takes in data from the signal line 7, and the coupling circuit 62 sends the data to the signal line.
The start signal of the data taken in from the coupling circuit 61 (FIG. 4) is detected by the start detection circuit 8 and is used as a reset signal for the counter 9. Further, the pulses of each of the PL 1 to PL 4 bits of data #1 to #N are detected as a clock by a clock detector 10, and the clock is input to the counter 9 for counting. Further, long code (large pulse width) bits of the data are detected by a long code detector. “Counter 9 is
There is a carry from the lower two digits in the four pulse counts of PL 1 to PL 4 , and the count value of the upper digits excluding the lower two digits can be associated with the selection switch numbers #1 to #N, so If the switch number to be assigned to the control circuit is set in the address setter 12, if the match detection circuit 13 detects a match between the count value of the counter 9 and the address setting value of the address setter 12, the switch number assigned to the control circuit will be set in the address setter 12. This can be obtained as the timing at which data PL 1 to PL 4 are taken into the lower two digits.
Then, the coincidence output of the coincidence circuit 13 is used as an input command to the distributor 14, so that the data of the control circuit is
Timing pulses of PL 1 to PL 4 (PL 1 to PL 4 in Figure 4)
PL 4 ) is obtained as the output of the distributor 14. Note that the set value of the address setter 12 is set to a value obtained by subtracting 1 from the address to be named to the control circuit, and the input command of the distributor 14 is obtained in advance when counting the data PL 1 to PL 4 of the address. . The distributor 14 to which the input command is given decodes the lower two digits of the counter 9 and obtains timing outputs PL 1 to PL 4 . Of these, L 1 and L 2 are latch circuits 15 and 15, respectively.
16 clocks are input. Latch circuit 15,1
6 takes the data input as the output of the long code detector 11, and if there is a long code in PL 1 , the data input "1" is stored in the latch circuit 15, and if there is a long code in PL 2 , it is stored in the latch circuit 16. do. Latch circuit 15,1
The "1" output of 6 becomes a lighting signal for lamps L 1 and L 2 via coupling circuits 17 and 18. Therefore, signal line 7
Of the data shown in Figure 4 imported from , the data at the addresses designated as selection switches #1 to #N is extracted, and lamps L 1 and L 2 are turned on according to the data of PL 1 and PLB 2 . , control is performed to turn off the light.
分配器14のPL3出力はスイツチS1のON,
OFF伝送タイミングにされるので、アンドゲー
ト19の入力とされ、アンドゲート19の他方の
入力にスイツチS1のON,OFF状態が結合回路2
0を通して与えられ、PL3のタイミングでスイツ
チS1の状態が検出される。その出力はオアゲート
21さらに結合回路62を通して信号線7に送出
される。 The PL 3 output of the distributor 14 is turned on when the switch S 1 is turned on.
Since the OFF transmission timing is set, the ON/OFF state of the switch S1 is input to the AND gate 19, and the ON/OFF state of the switch S1 is input to the other input of the AND gate 19.
0, and the state of switch S1 is detected at the timing of PL3 . The output is sent to the signal line 7 through the OR gate 21 and the coupling circuit 62 .
分配器14のPL4出力はスイツチS1のON確認
信号のタイミングにされるので、アンドゲート2
2に入力され、アンドゲート22の他の入力に長
符号検出器11の出力とスイツチS1のOFF条件
が入力とされ、スイツチS1がOFFにも拘らず長
符号(スイツチONの確認信号)が与えられたと
きに誤動作であることの検出がなされ、アンドゲ
ート22の出力“1”でタイマ回路23が起動さ
れてPL4の長符号に続く長符号の信号を信号線7
に送出する。 Since the PL 4 output of the distributor 14 is set at the timing of the switch S 1 ON confirmation signal, the AND gate 2
2, and the output of the long code detector 11 and the OFF condition of switch S 1 are input to the other inputs of AND gate 22, and the long code (confirmation signal of switch ON) is input even though switch S 1 is OFF. A malfunction is detected when PL4 is given, and the timer circuit 23 is activated by the output "1" of the AND gate 22, and the long code signal following the long code of PL4 is sent to the signal line 7.
Send to.
第6図に誤動作の場合のデータを示す。制御回
路からはPL3のタイミングでスイツチOFFの信号
を伝送したのに対し、入出力装置からはPL4のタ
イミングでスイツチONの確認信号を送出したと
き、タイマ回路23からはPL4の長符号に続く長
符号PL4の信号を送出する。これにより、入出力
装置はスイツチON指令が誤りであることを判断
できる。 FIG. 6 shows data in the case of malfunction. The control circuit transmitted a switch OFF signal at PL 3 timing, while the input/output device sent a switch ON confirmation signal at PL 4 timing, and the timer circuit 23 sent a long code of PL 4 . The signal with the long code PL 4 following is transmitted. This allows the input/output device to determine that the switch ON command is incorrect.
第7図は入出力装置4の一実施例を示し、信号
線7とは結合回路30を介して信号授受を行な
い、データ処理部3とは結合回路31を介して信
号授受を行ない、データの誤り判断、データ処理
部をCPU32で行なう。 FIG. 7 shows an embodiment of the input/output device 4, in which signals are exchanged with the signal line 7 via a coupling circuit 30, signals are exchanged with the data processing section 3 via a coupling circuit 31, and data is transferred. The CPU 32 performs error determination and data processing.
なお、実施例において、ランプ制御の誤動作防
止として、複数回の同じ制御信号を検出すること
でラツチ回路15,16をセツト又はリセツトす
る構成にすることもできる。 In the embodiment, in order to prevent lamp control malfunction, the latch circuits 15 and 16 may be set or reset by detecting the same control signal a plurality of times.
また、実施例においては一線式の入出力方式を
示したが、クロツク線を別にした二線式、さらに
スタート信号を別の線にした三線式にも適用でき
る。これらの場合、制御回路はクロツク検出器、
スタート検出器が不要になるし、データも幅の大
小でなく“1”,“0”のものにできる。また、信
号形式は4ビツト単位に限らず、例えば確認に対
する判定信号を5ビツト目に当てることもでき
る。また、選択スイツチがランプのみスイツチの
みなどで構成される場合は2ビツト構成又は1ビ
ツト構成のデータ制御にされる。 Furthermore, although a one-wire input/output system is shown in the embodiment, it can also be applied to a two-wire system in which the clock line is separate, or a three-wire system in which the start signal is separate from the line. In these cases, the control circuit consists of a clock detector,
There is no need for a start detector, and the data can be "1" or "0" instead of having a large or small width. Furthermore, the signal format is not limited to 4-bit units; for example, a determination signal for confirmation may be applied to the 5th bit. Further, when the selection switch is composed of only a lamp and only a switch, data control is performed using a 2-bit configuration or a 1-bit configuration.
以上説明した如く、本考案による信号入出力方
式は、監視操作パネルとデータ処理部との結合線
が大幅に低減でき、その製造、試験が簡単になる
効果がある。また、選択スイツチは表示灯制御と
スイツチの状態確認との両方の機能を有し、1つ
の選択スイツチ#1〜#Nにより夫々複数の制御
対象であるスイツチ、表示灯を選択制御できる
し、これら制御対象の違いにも1種類の選択スイ
ツチを用意してシステム構成ができる。 As explained above, the signal input/output method according to the present invention has the advantage that the number of coupling lines between the monitoring operation panel and the data processing section can be significantly reduced, and manufacturing and testing thereof can be simplified. In addition, the selection switch has the functions of both indicator light control and switch status confirmation, and one selection switch #1 to #N can selectively control multiple switches and indicator lights to be controlled, respectively. The system can be configured by providing one type of selection switch for different control objects.
第1図は従来の監視操作パネルの信号入出力方
式を示すブロツク図、第2図は本考案の一実施例
を示すブロツク図、第3図、第4図は第2図にお
ける信号伝送フオーマツトを示す図、第5図は第
2図における制御回路の一実施例を示す回路図、
第6図は第5図の動作を説明するための波形図、
第7図は第2図における入出力装置の一実施例を
示すブロツク図である。
1……監視操作パネル、3……データ処理部、
4……入出力装置、#1,#N……選択スイツ
チ、C1,CN……制御回路、61,62……結合
回路、7……信号線、8……スタート検出回路、
9……計数器、10……クロツク検出器、11…
…長符号検出器、12……アドレス設定器、13
……一致回路、14……分配器、15,16……
ラツチ回路、17,18……結合回路、19,2
2……アンドゲート、20……結合回路、21…
…オアゲート、23……タイマ回路、30,31
……結合回路、32……CPU。
Fig. 1 is a block diagram showing the signal input/output method of a conventional monitoring operation panel, Fig. 2 is a block diagram showing an embodiment of the present invention, and Figs. 3 and 4 show the signal transmission format in Fig. 2. FIG. 5 is a circuit diagram showing an embodiment of the control circuit in FIG.
FIG. 6 is a waveform diagram for explaining the operation of FIG. 5,
FIG. 7 is a block diagram showing an embodiment of the input/output device shown in FIG. 2. 1...Monitoring operation panel, 3...Data processing section,
4...Input/output device, #1, #N...Selection switch, C1 , C N ...Control circuit, 61 , 62 ...Coupling circuit, 7...Signal line, 8...Start detection circuit,
9... Counter, 10... Clock detector, 11...
...Long code detector, 12...Address setter, 13
... Matching circuit, 14 ... Distributor, 15, 16 ...
Latch circuit, 17, 18...coupling circuit, 19, 2
2...AND gate, 20...coupling circuit, 21...
...OR gate, 23...Timer circuit, 30, 31
...Combination circuit, 32...CPU.
Claims (1)
ネルとデータ処理部との間で該表示灯制御及びス
イツチ類操作状態判別・確認のための信号授受を
行なう信号入出力装置において、上記監視操作パ
ネルには上記表示灯、スイツチ類が関連する外部
機器に対応づけて振分けられる選択スイツチ群を
有し、このスイツチ群は夫々個別の制御回路を有
して該制御回路を介して上記データ処理部の入出
力装置と共通の信号線で結合し、上記信号線には
データ処理部からその入出力装置を介して表示灯
制御ビツト及びスイツチ類の操作状態判別・確認
ビツトで幅の大小を持つたパルス信号を選択スイ
ツチ群に対応づけて時間的に分割したパルス列信
号として該パルス列に共通のスタート信号も含め
て各制御回路に出力すると共に、上記制御回路は
入力された上記パルス列信号のパルス数計数を上
記スタート信号でリセツトされて開始する計数器
と、この計数器の上位桁内容を選択スイツチ群の
アドレスとして該選択スイツチ群個々に設定する
アドレスデータとの一致を検出する一致回路と、
上記計数器の下位桁内容を上記一致回路の一致出
力タイミングで取込んでデコードする分配器と、
この分配器に得る当該選択スイツチのデータタイ
ミング期間内で上記パルス列信号のうちの表示灯
制御ビツトパルスの符号検出信号をパルス幅の大
小で読込んで上記表示灯の駆動信号を得る駆動回
路手段と、上記分配器のデータタイミング出力期
間内で上記ビツトパルス列信号のうちのスイツチ
類操作状態及び確認制御パルスタイミングで上記
スイツチ類よりその状態及び確認の信号をパルス
幅の大小で取込み上記入出力装置に送出する駆動
回路手段とで制御回路を構成し、表示灯、スイツ
チ類の信号の入力信号を時間的に区別して対応す
る表示灯、スイツチ類を制御することを特徴とす
る監視操作パネルの信号入出力装置。 In a signal input/output device for transmitting and receiving signals between a monitoring operation panel including a large number of indicator lights and switches and a data processing unit for controlling the indicator lights and determining/confirming the operation status of the switches, the monitoring operation panel has a selection switch group in which the indicator lights and switches are distributed in correspondence with related external equipment, and each of the switch groups has an individual control circuit, and the input of the data processing section is controlled via the control circuit. It is connected to the output device through a common signal line, and the signal line receives pulse signals of varying widths from the data processing unit via the input/output device, including indicator light control bits and operation status determination/confirmation bits of switches. is associated with the selection switch group and outputted to each control circuit as a temporally divided pulse train signal including a common start signal for the pulse train, and the control circuit counts the number of pulses of the input pulse train signal as described above. a coincidence circuit that detects a match between a counter that is reset and started by a start signal and address data that sets the contents of the upper digits of this counter to each of the selection switch groups as the address of the selection switch group;
a distributor that captures and decodes the lower digit contents of the counter at the coincidence output timing of the coincidence circuit;
drive circuit means for obtaining a drive signal for the indicator lamp by reading the sign detection signal of the indicator lamp control bit pulse of the pulse train signal according to the pulse width within the data timing period of the selection switch obtained in the distributor; Within the data timing output period of the distributor, the state and confirmation signal of the switch operation state and confirmation control pulse timing of the bit pulse train signal is taken in from the switches in terms of pulse width and sent to the input/output device. A signal input/output device for a monitoring operation panel, characterized in that a control circuit is constituted by a drive circuit means, and the input signals of signals of indicator lights and switches are distinguished in time to control the corresponding indicator lights and switches. .
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8564182U JPS586484U (en) | 1982-06-09 | 1982-06-09 | Monitoring operation panel signal input/output device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8564182U JPS586484U (en) | 1982-06-09 | 1982-06-09 | Monitoring operation panel signal input/output device |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS586484U JPS586484U (en) | 1983-01-17 |
JPS622856Y2 true JPS622856Y2 (en) | 1987-01-22 |
Family
ID=29880922
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8564182U Granted JPS586484U (en) | 1982-06-09 | 1982-06-09 | Monitoring operation panel signal input/output device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS586484U (en) |
-
1982
- 1982-06-09 JP JP8564182U patent/JPS586484U/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS586484U (en) | 1983-01-17 |
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