JPS6141416B2 - - Google Patents
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- Publication number
- JPS6141416B2 JPS6141416B2 JP14471778A JP14471778A JPS6141416B2 JP S6141416 B2 JPS6141416 B2 JP S6141416B2 JP 14471778 A JP14471778 A JP 14471778A JP 14471778 A JP14471778 A JP 14471778A JP S6141416 B2 JPS6141416 B2 JP S6141416B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- output
- code signal
- decoder
- code
- Prior art date
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- Expired
Links
- 238000010586 diagram Methods 0.000 description 4
- 102100029469 WD repeat and HMG-box DNA-binding protein 1 Human genes 0.000 description 3
- 101710097421 WD repeat and HMG-box DNA-binding protein 1 Proteins 0.000 description 3
- 238000001514 detection method Methods 0.000 description 3
Landscapes
- Digital Computer Display Output (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
【発明の詳細な説明】
本発明は同一コードを用いて複数の互いに異る
表示を行なう表示装置に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a display device that displays a plurality of different displays using the same code.
従来、コードの種類を減少せしめるため、アル
フアベツトの大文字、小文字に同一コードを使用
し、大文字と小文字の区別をする為に特殊情報の
コードを1種類設け、1文字5ビツトのコードを
31種類揃え、全てのコードを作成するものがある
が、文章編集時に、原文を中途で区切つた際、原
文の後半部分の文頭が小文字になる場合があり、
当該文頭の小文字には特殊情報のコードが設けら
れていないため、文頭がそのまま小文字で表示さ
れるときがある。 Conventionally, in order to reduce the number of code types, the same code was used for uppercase and lowercase letters of the alphabet, one type of special information code was provided to distinguish between uppercase and lowercase letters, and each character was coded with 5 bits.
There are 31 types, and there is one that creates all the codes, but when editing the text, when the original text is separated in the middle, the beginning of the second half of the original text may be lowercase.
Since no special information code is provided for the lowercase letter at the beginning of the sentence, the beginning of the sentence may be displayed as it is in lowercase.
本発明は、上記の事情に鑑み、アルフアベツト
の大文字と小文字に同一コード信号を使用し、文
頭のアルフアベツト文字に対応するコード信号
は、自動的に大文字にデコードする構成にした表
示装置を提供する。 In view of the above circumstances, the present invention provides a display device configured to use the same code signal for uppercase and lowercase letters of the alphabet, and to automatically decode the code signal corresponding to the alphanumeric character at the beginning of a sentence into an uppercase letter.
以下、本発明の一実施例を図面を用いて詳細に
説明する。 Hereinafter, one embodiment of the present invention will be described in detail using the drawings.
第1図は本発明に係わる表示装置の一実施例の
回路ブロツク図、第2図は信号波形図である。 FIG. 1 is a circuit block diagram of an embodiment of a display device according to the present invention, and FIG. 2 is a signal waveform diagram.
第1図及び第2図において示される表示装置の
実施例は英文を表示する為のものであり、アルフ
アベツトの大文字と小文字のコードを同一コード
にて表わす。 The embodiment of the display device shown in FIGS. 1 and 2 is for displaying English text, and uppercase and lowercase letters of the alphabet are represented by the same code.
1は複数個の英文を記憶する記憶装置で、コー
ド化された文字あるいは記号と特殊情報のコード
が記憶される。2は記憶装置1よりキー操作等に
よつて出力される1個の英文を記憶する記憶装置
である。3は制御回路であつて、該回路からは上
記記憶装置2に記憶されるコード信号を1桁ずつ
出力させる信号S1、及び上記記憶装置2から最初
の文字が出力される際に発生する信号S2、上記記
憶装置2から1桁のコード信号が出力される毎に
フリツプフロツプ4をリセツトするための信号S3
が出力されるものである。上記フリツプフロツプ
4はJ−K形フリツプフロツプであり、5はイン
バータ、6は記憶装置2からのコード信号が特殊
情報(即ち次のコード信号を大文字で表示すべき
ことを示す情報)であつた場合に、次の文字コー
ドの出力時にフリツプフロツプ4をセツトする検
出回路である。7は文字コードを大文字で表示す
るデコーダ、8は文字コードを小文字で表示する
デコーダであり、9は表示体である。またOR1
とOR2はオアゲートでAND1とAND2はアンド
ゲートを示す。 Reference numeral 1 denotes a storage device for storing a plurality of English sentences, in which coded characters or symbols and special information codes are stored. Reference numeral 2 denotes a storage device that stores one English sentence outputted from the storage device 1 by a key operation or the like. 3 is a control circuit which outputs a signal S 1 for outputting the code signal stored in the storage device 2 one digit at a time, and a signal generated when the first character is output from the storage device 2. S 2 , a signal S 3 for resetting the flip-flop 4 every time a one-digit code signal is output from the storage device 2;
is what is output. The above-mentioned flip-flop 4 is a J-K type flip-flop, 5 is an inverter, and 6 is a flip-flop when the code signal from the storage device 2 is special information (that is, information indicating that the next code signal should be displayed in uppercase letters). , is a detection circuit that sets the flip-flop 4 when outputting the next character code. 7 is a decoder that displays character codes in uppercase letters, 8 is a decoder that displays character codes in lowercase letters, and 9 is a display body. Also OR1
and OR2 indicate an OR gate, and AND1 and AND2 indicate an AND gate.
次に動作を説明すれば、所定のキー操作を行な
うことにより記憶装置1から特定の文が選択され
記憶装置2に転送される。その後制御回路3より
信号S1が出力される為、記憶装置2より最初の一
文字分のコード信号が出力されるとともに上記制
御回路3から信号S1と同時に信号S2が出力される
のでアンドゲートAND2は開かずアンドゲート
AND1が開き、第1文字目のコード信号はデコ
ーダ7に入力され、大文字が表示される。 Next, the operation will be described. By performing a predetermined key operation, a specific sentence is selected from the storage device 1 and transferred to the storage device 2. After that, since the signal S 1 is output from the control circuit 3, the code signal for the first character is output from the storage device 2, and the signal S 2 is output from the control circuit 3 at the same time as the signal S 1 , so an AND gate is output. AND2 does not open and gate
AND1 is opened, the code signal for the first character is input to the decoder 7, and the uppercase character is displayed.
次に信号S1の2番目のパルスが記憶装置2に加
えられた時は、信号S2は出力されなく、かつ信号
S3によつてフリツプフロツプ4はリセツトされた
状態にあるのでオアゲートOR1から出力信号は
出力されず、インバータ5によつてアンドゲート
AND2が開き、アンドゲートAND1は閉じてい
るので記憶装置2から出力される文字コード信号
はデコーダ8により小文字となつて表示される。 Next, when the second pulse of signal S 1 is applied to storage device 2, signal S 2 is not output and signal
Since the flip-flop 4 is in the reset state by S3 , no output signal is output from the OR gate OR1, and the AND gate is output by the inverter 5.
Since AND2 is open and AND gate AND1 is closed, the character code signal output from storage device 2 is displayed as a lowercase letter by decoder 8.
次に信号S1の3番目のパルスが記憶装置2に加
えられた時、この記憶装置からは特殊情報が出力
されたものとする。この時デコーダ8は上記特殊
情報を文字としてデコードしないので、文字は表
示されない。また検出回路6が上記特殊情報を検
出して信号S1の4番目のパルスの時にフリツプフ
ロツプ4をセツトするべくセツト信号を出力す
る。従つて信号S1の4番目のパルスによつて記憶
装置より文字コードが出力される時は、オアゲー
トOR1より出力信号が発生する為上記文字コー
ドはデコーダ7に入力され結局大文字が表示され
る。 Next, when the third pulse of the signal S1 is applied to the memory device 2, it is assumed that special information is output from this memory device. At this time, the decoder 8 does not decode the special information as characters, so no characters are displayed. Further, the detection circuit 6 detects the special information and outputs a set signal to set the flip-flop 4 at the fourth pulse of the signal S1 . Therefore, when a character code is output from the storage device by the fourth pulse of the signal S1 , an output signal is generated from the OR gate OR1, so the character code is input to the decoder 7, and an uppercase letter is displayed.
そして制御回路3からは文字コードが出力され
る毎に信号S3が出力されるので、フリツプフロツ
プ4は信号S1の5番目のパルスが出力される時に
はリセツト状態にあり、結局信号S1の5番目のパ
ルス以後は小文字が表示される。 Since the control circuit 3 outputs the signal S3 every time a character code is output, the flip-flop 4 is in a reset state when the fifth pulse of the signal S1 is output, and eventually the fifth pulse of the signal S1 is output. After the th pulse, lowercase letters are displayed.
以上説明した如く、本発明によれば、文を構成
するアルフアベツト文字の表示情報のコード信号
を記憶する記憶手段と、該記憶手段より出力され
るコード信号を大文字及び小文字にデコードする
第1及び第2デコーダと、上記記憶手段に記憶さ
れる表示情報の同一コード信号を上記第1又は第
2デコーダのいずれかに導入する導入手段とを有
する表示装置において、上記記憶手段から、文頭
のアルフアベツト文字に対応するコード信号が出
力されたときに、当該コード信号を上記第1デコ
ーダに入力する制御手段を備えたから、文頭にあ
るアルフアベツト文字に対応するコード信号は、
大文字で表示すべきことを示す情報がなくても大
文字にデコードされ、文章の編集時に、原文を中
途で区切つた場合、原文の後半部分の文頭が小文
字であつたとしても、表示時には前記小文字が大
文字で出力されて、文章作成能率を向上できる。 As explained above, according to the present invention, there is provided a storage means for storing a code signal of display information of alphanumeric characters constituting a sentence, and a first and a first and a second decoder for decoding the code signal outputted from the storage means into uppercase and lowercase letters. 2 decoders and introduction means for introducing the same code signal of display information stored in the storage means into either the first or second decoder, Since the control means is provided for inputting the code signal to the first decoder when the corresponding code signal is output, the code signal corresponding to the alphanumeric character at the beginning of the sentence is
Even if there is no information indicating that it should be displayed in uppercase, it will be decoded into uppercase, and when editing the text, if the original sentence is separated in the middle, even if the beginning of the second half of the original sentence is a lowercase letter, the lowercase letter will be displayed when displayed. It is output in uppercase letters, which improves writing efficiency.
第1図は本発明に係わる表示装置の回路ブロツ
ク図、第2図は第1図の各部波形図を示す。
図中、1,2:記憶装置、3:制御回路、4:
フリツプフロツプ、5:インバータ、6:検出回
路、7,8:デコーダ、9:表示体。
FIG. 1 is a circuit block diagram of a display device according to the present invention, and FIG. 2 is a waveform diagram of each part of FIG. 1. In the figure, 1, 2: storage device, 3: control circuit, 4:
Flip-flop, 5: inverter, 6: detection circuit, 7, 8: decoder, 9: display.
Claims (1)
のコード信号を記憶する記憶手段と、該記憶手段
より出力されるコード信号を大文字及び小文字に
デコードする第1及び第2デコーダと、上記記憶
手段に記憶される表示情報の同一コード信号を上
記第1又は第2デコーダのいずれかに導入する導
入手段とを有する表示装置において、 上記記憶手段から、文頭のアルフアベツト文字
に対応するコード信号が出力されたときに、当該
コード信号を上記第1デコーダに入力する制御手
段を備えたことを特徴とする表示装置。[Scope of Claims] 1. Storage means for storing a code signal of display information of alphanumeric characters constituting a sentence; first and second decoders for decoding the code signal output from the storage means into uppercase and lowercase letters; and introduction means for introducing the same code signal of display information stored in the storage means into either the first or second decoder, wherein a code signal corresponding to an alphanumeric character at the beginning of a sentence is transmitted from the storage means to the first or second decoder. A display device comprising control means for inputting the code signal to the first decoder when the code signal is output.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14471778A JPS5570891A (en) | 1978-11-21 | 1978-11-21 | Display unit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14471778A JPS5570891A (en) | 1978-11-21 | 1978-11-21 | Display unit |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5570891A JPS5570891A (en) | 1980-05-28 |
JPS6141416B2 true JPS6141416B2 (en) | 1986-09-16 |
Family
ID=15368653
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP14471778A Granted JPS5570891A (en) | 1978-11-21 | 1978-11-21 | Display unit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5570891A (en) |
-
1978
- 1978-11-21 JP JP14471778A patent/JPS5570891A/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS5570891A (en) | 1980-05-28 |
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