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JPS6033035B2 - Trunk control method - Google Patents

Trunk control method

Info

Publication number
JPS6033035B2
JPS6033035B2 JP13467277A JP13467277A JPS6033035B2 JP S6033035 B2 JPS6033035 B2 JP S6033035B2 JP 13467277 A JP13467277 A JP 13467277A JP 13467277 A JP13467277 A JP 13467277A JP S6033035 B2 JPS6033035 B2 JP S6033035B2
Authority
JP
Japan
Prior art keywords
relay
trunk
address
memory
relays
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP13467277A
Other languages
Japanese (ja)
Other versions
JPS5468104A (en
Inventor
利彦 梅田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP13467277A priority Critical patent/JPS6033035B2/en
Publication of JPS5468104A publication Critical patent/JPS5468104A/en
Publication of JPS6033035B2 publication Critical patent/JPS6033035B2/en
Expired legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04QSELECTING
    • H04Q3/00Selecting arrangements
    • H04Q3/42Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker
    • H04Q3/54Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker in which the logic circuitry controlling the exchange is centralised

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Interface Circuits In Exchanges (AREA)
  • Exchange Systems With Centralized Control (AREA)

Description

【発明の詳細な説明】 本発明は、電話交換システム、データ伝送システム等に
おける、トランク回路の制御方式に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a control system for trunk circuits in telephone switching systems, data transmission systems, and the like.

第1図は、従来技術を説明する為の一例として、電子交
換機に使用されている自局内公衆電話機用トランク回路
を表わしたものである。同図においてFは謀金信号の雑
音を吸収する為のフィルターで、ROはフィルターF内
のコンデンサの電荷を放電させる抵抗である。
FIG. 1 shows, as an example for explaining the prior art, a trunk circuit for an in-office public telephone used in an electronic exchange. In the figure, F is a filter for absorbing the noise of the fraud signal, and RO is a resistor for discharging the charge of the capacitor in the filter F.

AおよびDは、それぞれ発呼および着信加入者の監視用
リレーであり、RIは謀金層号送出時、リレーAが復旧
しない様に保持する為の抵抗である。C0,CIは直流
カット用のコンデンサで、E川ま通話電流供給あるし、
は継電器A,Dを動作させる為の電源である。
A and D are relays for monitoring calling and terminating subscribers, respectively, and RI is a resistor for holding relay A so that it does not recover when sending out a security code. C0 and CI are DC cut capacitors, and the E river also supplies communication current.
is the power source for operating relays A and D.

PおよびQは、譲金信号送出の為の継電器であり、信号
分配装置SD内のフリツプフロツプFF0,FFIによ
って駆動制御される。
P and Q are relays for transmitting the transfer signal, and are driven and controlled by flip-flops FF0 and FFI in the signal distribution device SD.

EIは継電器PおよびQを駆動する為の電源である。EI is a power source for driving relays P and Q.

Sはトランク回路TRKのパターンを制御する為のパタ
ーン用磁気ラッチ型リレーで、リレー駆動装置RDによ
って駆動装置される。DOおよびDIは、それぞれリレ
ーSを動作および復旧させる為のドライバで、tは動作
、復旧の切分けを行うための接点である。
S is a pattern magnetic latch type relay for controlling the pattern of the trunk circuit TRK, and is driven by a relay drive device RD. DO and DI are drivers for operating and restoring the relay S, respectively, and t is a contact point for distinguishing between operation and restoration.

E2およびE3は、それぞれ談リレーSを動作および復
旧させる為の電源である。aおよびdは、それそれ継電
器AおよびDの接点での状態、即ち発呼および着信加入
者の状態を中央制御装置へ知らせる為の接点である。
E2 and E3 are power supplies for operating and restoring the relay S, respectively. a and d are contacts for informing the central control unit of the status at the contacts of relays A and D respectively, ie the status of the calling and terminating subscriber.

公知の電子交換機によれば、ダイヤルパルスの数字分析
の結果、本トランクが捕捉され、着信側加入者が応答す
ると、本トランクのAリレー側が発信加入者へ、Dリレ
ー側が着信加入者へ、各々ネットワークを介して接続さ
れる。
According to the known electronic exchange, when the main trunk is captured as a result of the numerical analysis of the dial pulse and the called subscriber answers, the A relay side of the main trunk transfers to the calling subscriber, and the D relay side of the main trunk transfers to the called subscriber. connected via a network.

しかる後、リレー駆動装置RDを介してパターンリレー
Sが駆動され、A,Dリレーを通して両加入者へ通話電
流が供給され通話に入る。以後、本トランクより発呼者
側へ3分毎に、信号分配装置SDによって、継電器P,
Qを駆動することによって、謀金信号が送出される。
Thereafter, the pattern relay S is driven via the relay drive device RD, and communication current is supplied to both subscribers through the A and D relays to start a conversation. Thereafter, the signal distribution device SD sends relays P,
By driving Q, a fraud signal is sent out.

通話終了で発呼者がオンフツクすると、本トランクのA
リレーは復旧し、その情報は接点aを介して、中央制御
装置へ伝えられ、謀金信号送出を停止するとともに、リ
レー駆動装置RDを介してSリレーが復旧させられる。
When the caller goes on-hook at the end of the call, the main trunk's A
The relay is restored, and the information is transmitted to the central control unit via contact a, stopping the sending of the fraud signal, and the S relay is restored via relay drive device RD.

以上述べたように、従釆のトランク制御方式によれば、
中央制御装置は、トランクのどのリレーを駆動制御する
かのリレー指定情報を編集する必要があり、中央制御装
置の負担が増大すると共に、上記中央制御装置からのI
Jレー指定情報を受信し、指定されたりレーを駆動する
ために信号分配装置やりレー駆動装置を必要とし金物量
が増大する欠点があった。本発明は、上記従来の欠点を
解決することを目的とするもので、各トランク回路に一
連の呼処理動作を記憶できるメモリを設け、呼処理のパ
ターンごとにメモリにセットしておき、中央処理装置か
らは該メモリヘセット、リセット信号あるいはクロツク
信号などのタイミング信号を送出するだけで、各種のパ
ターン制御を行なわせることによって、継電器駆動装置
、信号分配装置を不要にし、さらにはトランク回路の種
類の統合を可能にするものである。
As mentioned above, according to the subordinate trunk control method,
The central control device must edit relay designation information to determine which relays in the trunk are to be driven and controlled, which increases the burden on the central control device and reduces the I/O from the central control device.
In order to receive the J-ray designation information, designate it, and drive the J-ray, a signal distribution device and a ray driving device are required, resulting in an increase in the amount of hardware required. SUMMARY OF THE INVENTION The present invention aims to solve the above-mentioned conventional drawbacks, and each trunk circuit is provided with a memory capable of storing a series of call processing operations, each call processing pattern is set in the memory, and a central processing By simply sending timing signals such as set, reset signals, or clock signals from the device to the memory, various pattern controls can be performed, eliminating the need for relay drive devices and signal distribution devices, and even changing the type of trunk circuit. It enables the integration of

以下本発明の実施例を第2図〜第4図に従って説明する
Embodiments of the present invention will be described below with reference to FIGS. 2 to 4.

第2図は、本発明のトランク回路の1実施例であり、第
3図は、第2図のトランク回路における各パターンリレ
ーの駆動タイムチャート、第4図は、第3図のタイムチ
ャートを実現する為のメモリの内容を表わしたものであ
る。第2図において第1図と同じ記号の部品は、同じ部
品を示す。ROMは一般に使用されている8ワードのア
ドレスと4ビットのデータエリアを持つメモリ、ARは
メモリのアドレスレジスタとタイミング回路であり、D
Rはデータレジスタである。○2〜D4はパターンリレ
ーS,P,Qを駆動する為のドライバである。第3図は
第2図のメモリROMの内容を示すもので、各々4ビッ
トからなる0〜7の8つの8ワード×4bitの容量を
持つメモリで、アドレスには、第4図のタイムチャート
に示されたパターンリレーP,S,Qの駆動制御を行な
うための情報が記憶されている。
Fig. 2 shows one embodiment of the trunk circuit of the present invention, Fig. 3 is a drive time chart of each pattern relay in the trunk circuit of Fig. 2, and Fig. 4 shows the realization of the time chart of Fig. 3. This shows the contents of memory for In FIG. 2, parts with the same symbols as in FIG. 1 indicate the same parts. ROM is a commonly used memory with an 8-word address and 4-bit data area, AR is the memory address register and timing circuit, and D
R is a data register. ○2 to D4 are drivers for driving pattern relays S, P, and Q. Figure 3 shows the contents of the memory ROM in Figure 2. It is a memory with a capacity of eight 8 words x 4 bits, 0 to 7 each consisting of 4 bits, and the address is as shown in the time chart in Figure 4. Information for controlling the drive of the indicated pattern relays P, S, and Q is stored.

すなわちアドレスレジスタを指定すると、データレジス
タDRに対応するアドレスのワード(4ビット)が読み
出される。データレジスタDRの0ビットはSリレー、
1ビットはPリレー、2ビットはQリレー、3ビットは
空の状態に対応しているので、読み出されたワードに従
って、パターンリレーS,P,Qが動作または復旧する
。以下、第2図、第3図、第4図を用いて、本発明方式
によるトランク回路の呼処理動作について説明する。
That is, when an address register is specified, the word (4 bits) of the address corresponding to the data register DR is read out. 0 bit of data register DR is S relay,
Since 1 bit corresponds to a P relay, 2 bits corresponds to a Q relay, and 3 bits corresponds to an empty state, pattern relays S, P, and Q are operated or restored according to the read word. The call processing operation of the trunk circuit according to the method of the present invention will be described below with reference to FIGS. 2, 3, and 4.

尚、第4図におけるタイミングT,〜Lは、中央制御装
置によって作られる。まずダイヤルパルス数字分析の結
果、本トランクがネットワークを介して、発呼および着
信加入者へ接続され、着信加入者が応答すると中央制御
装置からセットパルスとクロックが来て、第2図アドレ
スレジスタARによつて、メモリROMの1番地が指定
されると、第4図のメモリROMの内容からデータレジ
スタDRに“1,0,0,0”が読み出され、対応する
Sリレーが動作する。
Note that the timings T and -L in FIG. 4 are created by the central controller. First, as a result of dial pulse digit analysis, this trunk is connected to the calling and terminating subscriber via the network, and when the terminating subscriber answers, a set pulse and clock are received from the central controller, and the address register AR shown in Figure 2 When address 1 of the memory ROM is specified, "1, 0, 0, 0" is read into the data register DR from the contents of the memory ROM shown in FIG. 4, and the corresponding S relay operates.

次にT,のタイミングでクロツクパルスが釆ると、アド
レスはカウントアップされ、アドレスレジスタARは2
番地を指定し、ROMの内容からデータレジスタには、
0ビット目から‘‘1,0,1,0”を読み出し対応す
るSリレーおよびQリレーのドライバD2,D3が駆動
され、Sリレーはそのまま動作状態を継続し、新たにQ
リレーが動作する。次にT2のタイミングでクロツクが
くると、同様にしてアドレスがカウントアップされ3番
地が指定されて、データレジスタは“1,1,1,0”
に変化し、Sリレー、QリレーそしてPリレーが駆動さ
れる。同様にして、T3〜T8のタイミングでクロック
が中央制御装置より出されることでアドレスがカウント
アッパれ無事渚卒渚軍癖弊溝牢溌史と州側Mのアドレス
カミ撤 され、該番地に対応する出力によって、該出力に対応す
るビットのドライバが駆動され、該ドライバに対応する
りレーが、第3図に示すタイムチャートに従って駆動さ
れる。
Next, when the clock pulse reaches timing T, the address is counted up and the address register AR is set to 2.
Specify the address and enter the data register from the contents of the ROM.
``1,0,1,0'' is read from the 0th bit, and the corresponding S relay and Q relay drivers D2 and D3 are driven, and the S relay continues its operating state and a new Q
Relay works. Next, when the clock comes at timing T2, the address is counted up in the same way, address 3 is specified, and the data register is "1, 1, 1, 0".
, and the S relay, Q relay, and P relay are driven. In the same way, the clock is output from the central control unit at the timing of T3 to T8, and the address counts up, and the addresses of M, the state side, and the Nagisa army are successfully removed, and the address corresponds to the address. The driver of the bit corresponding to the output is driven by the output, and the relay corresponding to the driver is driven according to the time chart shown in FIG.

尚、K以降はT5,T6,T7,公,T5・・・・・・
・・・のタイミングがくり返され、対応するアドレス6
番地,7番地,6番地,5番地が指定される。
In addition, after K, T5, T6, T7, public, T5...
The timing of ... is repeated, and the corresponding address 6
Address, address 7, address 6, and address 5 are specified.

自局内通話の場合は公が3分となる。通話終了で発呼者
がオンフツクすると、第2図においてAリレーが復旧し
、その接点aでその情報が中央制御装置へ伝えられ、中
央制御装置からはリセットパルスが送られ、メモリRO
Mのアドレスは0番地が指定されSIJレ−が復旧され
、初期状態となる。
For calls within your own office, the public call time is 3 minutes. When the caller goes on-hook at the end of the call, relay A is restored in Figure 2, and its contact a transmits the information to the central controller, which sends a reset pulse to the memory RO.
Address 0 is designated as the address of M, and the SIJ relay is restored to the initial state.

以上説明した如く本発明によれば、駆動器駆動装置や信
号分配装置等が不要となり、さらには呼処理が似たトラ
ンク回路は、メモリの内容を変えるだけでよく、トラン
ク回路の種類の統合にも寄与することになる。
As explained above, according to the present invention, there is no need for a driver drive device, a signal distribution device, etc., and furthermore, trunk circuits with similar call processing only need to change the contents of the memory, and it is possible to integrate the types of trunk circuits. will also contribute.

尚、本実施例では自局内公衆トランク回路について述べ
たが、同様に他のトランク回路、あるいは伝送システム
ユニット回路についても使用可能である。
In this embodiment, a public trunk circuit within the local office has been described, but other trunk circuits or transmission system unit circuits can be used as well.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来のトランク回路の一例を示す回路図、第2
図は本発明のトランク回路の一実施例を示す回路図、第
3図はそのうちのメモリの内容を示す図、第4図は実施
例の動作を示すタイムチャートである。 TRK…トランク回路、S,P,Q…パターンリレー、
ROM…メモリ、D2〜D4・・・ドライバ、T,〜T
8・・・タイミング信号。 才‘図 才3図 才2図 矛4図
Figure 1 is a circuit diagram showing an example of a conventional trunk circuit; Figure 2 is a circuit diagram showing an example of a conventional trunk circuit;
3 is a circuit diagram showing an embodiment of the trunk circuit of the present invention, FIG. 3 is a diagram showing the contents of the memory, and FIG. 4 is a time chart showing the operation of the embodiment. TRK...Trunk circuit, S, P, Q...Pattern relay,
ROM...Memory, D2-D4...Driver, T, ~T
8...Timing signal. Sai'zuzai3zuzai2zujako4zu

Claims (1)

【特許請求の範囲】[Claims] 1 中央制御装置からトランク回路内のパターンリレー
を制御するトランク制御方式において、トランク回路内
に複数個のパターンリレーを動作、復旧させるシーケン
スを書込んだメモリと、メモリの出力情報により制御さ
れる駆動回路とを設け、中央制御装置からのタイミング
信号によつてパターンの変更が行なわれるようにしたこ
とを特徴とするトランク制御方式。
1 In a trunk control method in which pattern relays in a trunk circuit are controlled from a central control device, a memory in which sequences for operating and restoring multiple pattern relays are written in the trunk circuit, and a drive controlled by the output information of the memory A trunk control method characterized in that a circuit is provided, and the pattern is changed by a timing signal from a central control device.
JP13467277A 1977-11-11 1977-11-11 Trunk control method Expired JPS6033035B2 (en)

Priority Applications (1)

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JPS5468104A JPS5468104A (en) 1979-06-01
JPS6033035B2 true JPS6033035B2 (en) 1985-07-31

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ID=15133859

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03105441U (en) * 1990-02-13 1991-10-31

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03105441U (en) * 1990-02-13 1991-10-31

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Publication number Publication date
JPS5468104A (en) 1979-06-01

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