JPS59220285A - Control device for welding current of arc welding machine - Google Patents
Control device for welding current of arc welding machineInfo
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Abstract
Description
【発明の詳細な説明】
本発明はアーク溶接機の溶接電流制御装置、特に帰還制
御によって溶接電流を一定に保持するものに関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a welding current control device for an arc welding machine, and particularly to one that maintains a constant welding current by feedback control.
一般に、直流アーク溶接機は交流アーク溶接機に比較し
てアークの安定度が良いので多用されている。従来、こ
の直流アーク溶接機の電流制御装置として第1図に示す
整流形のものが公知である。In general, DC arc welding machines are widely used because they have better arc stability than AC arc welding machines. Conventionally, a rectifier type device shown in FIG. 1 is known as a current control device for this DC arc welding machine.
同図において、<la)、 (lb)、 (Ic>
は50または6011zの3相ライン入力(1)の入力
端子、(2)はY−△形の3相トランス、(3)は例え
ばダイオードをブリッジ接続して成る第1の整流回路、
(4)はスイッチングパワートランジスタ(以下S、P
、TRと呼ぶ)、(5)はフィルタリアクトル、(6)
は電極、(7)は母材、(8)は上記S、P、TR(4
)がオフ時にフィルタリアクトル(5)に連続して電流
を流すフライホイールダイオード、(9)は溶接電流に
相当する信号Vaを検出するシャント等の電流検出器、
(10)は上記s、p、TR(4)をオンオフ制御する
比較器、(12)は平滑コンデンサである。In the same figure, <la), (lb), (Ic>
is the input terminal of the 3-phase line input (1) of 50 or 6011z, (2) is the Y-Δ type 3-phase transformer, (3) is the first rectifier circuit formed by bridge-connecting diodes, for example,
(4) is a switching power transistor (hereinafter S, P
, TR), (5) is a filter reactor, (6)
is the electrode, (7) is the base material, and (8) is the above S, P, TR (4
) is a flywheel diode that continuously passes current to the filter reactor (5) when it is off, (9) is a current detector such as a shunt that detects a signal Va corresponding to the welding current,
(10) is a comparator that controls on/off the above s, p, and TR (4), and (12) is a smoothing capacitor.
なお、上記比較器(10)の出力は上記検出信号vaが
設定値■ρfより高いきとO1低いときlとなる。The output of the comparator (10) becomes 1 when the detection signal va is higher than the set value ρf and when O1 is lower.
このような構成のアーク溶接機の電流制御装置の動作に
ついて以下説明する。3相ライン入力(1)は、3相ト
ランス(2)で低い電圧に変換された後、第1の整流回
路(3〉及び平滑コンデンサ(12)によって直流に変
換される。変換された直流は、上記S、P、TR(4)
でチコソピングされ、フィルタリアクトル(5)を介し
て電極(6)及び母材(7)からなる負荷に直流出力を
供給する。上記S、P、TR(4)のオン、オフを決定
する比較器(10)の出力は上記電流検出器(9)から
の検出信号vaが設定値14.Zよりも高ければ0とな
ってS、P、TRをオフさせ、検出信号Vaが設定値V
pr(よりも低ければ1となってS、P、TRをオンさ
せる。よって、比較器(10)にヒステリシスを持た一
Uることにより、電極(6)及び母材(7)からなる冷
接負荷にある一定のリップルを持った直流の溶接電流を
供給することができ、しかもこの溶接電流を設定値に相
持できる。The operation of the current control device for the arc welding machine having such a configuration will be explained below. The three-phase line input (1) is converted to a low voltage by the three-phase transformer (2), and then converted to direct current by the first rectifier circuit (3) and the smoothing capacitor (12).The converted direct current is , above S, P, TR (4)
The filter reactor (5) supplies a DC output to a load consisting of an electrode (6) and a base material (7). The output of the comparator (10) that determines whether the S, P, and TR (4) are on or off is determined by the detection signal va from the current detector (9) set to 14. If it is higher than Z, it becomes 0, turns off S, P, and TR, and the detection signal Va becomes the set value V.
pr (if it is lower than 1, it becomes 1 and turns on S, P, and TR. Therefore, by providing 1U with hysteresis in the comparator (10), the cold welding consisting of the electrode (6) and the base material (7) A DC welding current with a certain ripple can be supplied to the load, and this welding current can be maintained at the set value.
しかしながら、従来の装置は以上のように3相トランス
(2)の入力の周波数が50または6011zと低周波
であることから、3相トランス(2)の重量がかなり大
きくなるという欠点を有していた。However, as mentioned above, the conventional device has the disadvantage that the input frequency of the three-phase transformer (2) is low at 50 or 6011z, and the weight of the three-phase transformer (2) is considerably large. Ta.
本発明はこのような従来の欠点を除去するためになされ
たもので、トランスの入力として3相ライン入力を整流
し、直流に変換した後、インバータで高周波に変換した
パルス電圧を供給することによってトランスの軽量化を
図るようにしたものである。しかもトランスに入力され
るパルス電圧の正極パルスと負極パルスの数を一致させ
て偏磁を防止し、さらに負荷によって出方電圧のパルス
幅を変化させ、低リップルの溶接電流をiqることがで
きるアーク溶接機の電流制御装置を提供するものであり
、以下実施例を用いて本発明の詳細な説明する。The present invention was made in order to eliminate such conventional drawbacks.The present invention was made to rectify the three-phase line input as the input of the transformer, convert it to direct current, and then supply pulse voltage converted to high frequency by an inverter. This is intended to reduce the weight of the transformer. Moreover, by matching the number of positive and negative pulses of the pulse voltage input to the transformer, biased magnetization can be prevented, and by changing the pulse width of the output voltage depending on the load, it is possible to generate a low-ripple welding current. The present invention provides a current control device for an arc welding machine, and the present invention will be described in detail below using examples.
第2図は本発明によるアーク溶接機の溶接電流制御装置
の一実施例を示す回路図であり、同図において(13a
)、 (13b)、 (13c)。FIG. 2 is a circuit diagram showing an embodiment of the welding current control device for an arc welding machine according to the present invention, and in the same figure (13a
), (13b), (13c).
(13d)はブリ・7ジ接続されてフルブリッジインバ
ータを構成するS、P、TR1(14)は上記インバー
タ(13)の出力パルス電圧を低電圧に変換する高周波
トランス、(15)はダイオード(15a)、 (1
5b)で構成されて高周波トランス(]4)の出力を整
流する第2の整流回路、(16a)、 (16b)、
(16c)、 (16d)は上記S、P、TR(
13a)、 (13b)。(13d) is a bridge-connected S, P, TR1 which constitutes a full bridge inverter (14) is a high frequency transformer that converts the output pulse voltage of the inverter (13) into a low voltage, (15) is a diode ( 15a), (1
5b), a second rectifier circuit that rectifies the output of the high frequency transformer (]4), (16a), (16b),
(16c), (16d) are the above S, P, TR (
13a), (13b).
(13c)、 (13d)が全てオフの時に高周波ト
ランス(14)の漏れインダクタンス(17)が持つ電
磁エネルギーを平滑用コンテンツ(12)に帰還する帰
還ダイオード、(18)は上記S。A feedback diode (18) returns the electromagnetic energy of the leakage inductance (17) of the high frequency transformer (14) to the smoothing content (12) when all of (13c) and (13d) are off.
P、TR(13a)、 (13b)、 (13c)
。P, TR (13a), (13b), (13c)
.
(13d)を駆動するベース回路、(19)は帰還制御
回路である。上記帰還制御回路(19)は比較器(10
)から成る検出信号判定回路20と、基本パルス幅決定
回路(21)は、この基本パルス幅決定回路(21)か
らの出力信号V1に基づいてパルス幅を設定するパルス
幅変調回路(22)と、上記比較器(10)からの出力
信号V5に基づき、後述する溶接パルス電圧Voの時間
T x 。(13d) is a base circuit that drives the circuit, and (19) is a feedback control circuit. The feedback control circuit (19) includes a comparator (10
) and a basic pulse width determining circuit (21), a pulse width modulating circuit (22) that sets the pulse width based on the output signal V1 from the basic pulse width determining circuit (21). , the time T x of the welding pulse voltage Vo, which will be described later, based on the output signal V5 from the comparator (10).
′Fyを調整し、かつトランス(14)の入力電圧v9
の正極パルスと負極パルスの数を一致させるようにイン
バータ(13)を制御するインバータ制御回路(23)
とから構成される。'Fy and the input voltage v9 of the transformer (14)
an inverter control circuit (23) that controls the inverter (13) to match the number of positive pulses and negative pulses;
It consists of
まず、本発明のアーク溶接機の溶接電流制御装置の基本
的動作につき、第3図ta+〜((])に示すタイムチ
ャートを用いて説明する。First, the basic operation of the welding current control device for an arc welder according to the present invention will be explained using the time chart shown in FIG.
本発明では、溶接電圧V。とじて第3図+II)に示す
ようなパルス電圧を供給し、かつこのパルス電圧ヅ0に
おいて、パルス列の発生される時間(インバータの駆動
時間)Txと、パルス列の除去された時間(インバータ
の停止時間)Tyとを交互に設ける。このようなパルス
電圧Voによれば、溶接電流i。は第3図(blに示す
ようにパルス列の発生時間Txで立上り、パルス列除去
時間゛ryで下降するように変動することになる。従っ
て、本発明は第3図(alに示すパルス電圧V。におけ
る時間Txと時間Tyとの比を変えるようにして、溶接
電流ioの平均電流I。を変えて、設定値に保持するも
のである。この場合、上記パルス電圧ヅθを形成するた
め、インバータ制御回路(23)が比較器(10)の出
力信号V5に基づきインバータ(13)を制御すること
により、第3図telに示すように正極と負極からなる
パルス電圧V9を発生し、この電圧v9を高周波トラン
ス(14)の−次側に供給する。そして具体的には上記
電圧v9のパルスを制御するようにして上記時間Tx。In the present invention, the welding voltage V. Then, a pulse voltage as shown in Fig. 3 time) Ty are provided alternately. According to such a pulse voltage Vo, the welding current i. As shown in FIG. 3 (bl), the pulse voltage V rises at the pulse train generation time Tx and falls at the pulse train removal time ry. By changing the ratio between time Tx and time Ty in By controlling the inverter (13) based on the output signal V5 of the comparator (10), the control circuit (23) generates a pulse voltage V9 consisting of a positive pole and a negative pole as shown in FIG. is supplied to the negative side of the high-frequency transformer (14).Specifically, the pulse of the voltage v9 is controlled to control the pulse of the voltage v9 for the above-mentioned time Tx.
1゛yを制御することにより平均電流1oを調整するも
のである。さらに、本発明においては高周波トランス(
14)の偏磁を防止するために、インバータ制御回路(
23)が高周波トランス(15)の−次側に加わる電圧
v9の正、負の電圧時間稍を一致させるように動作する
。すなわち第3図tc+に示すようにパルス電圧v9の
正、負の各パルスの数を一致させるのである。The average current 1o is adjusted by controlling 1゛y. Furthermore, in the present invention, a high frequency transformer (
14) In order to prevent biased magnetization, the inverter control circuit (
23) operates to match the positive and negative voltage time dimensions of the voltage v9 applied to the negative side of the high frequency transformer (15). That is, as shown in FIG. 3 tc+, the numbers of positive and negative pulses of the pulse voltage v9 are made equal.
」二記インバータ制御回路(23)は例えば第4図に示
すように上記時間TxとTyを制御する駆動時間制御回
路(24)と、正極パルスと負極パルスの数を一致させ
るパルス数制御回路(25)と、信号v6とv7のパル
スを交互に出力して、第5図に示ずベース回路(18)
を駆動する出力回路(26)とから構成される。The inverter control circuit (23) includes, for example, as shown in FIG. 25) and the pulses of signals v6 and v7 are output alternately, and the base circuit (18) not shown in FIG.
and an output circuit (26) that drives the.
上記駆動時間制御回路(24)はフリップフロップ(2
7)の出力端子Qの出力信号Vf5がlのときゲートが
開かれて、パルス幅変調回路(22)からのパルス信号
V2を出力し、上記信号杯、が0のときゲートが閉じら
れるアンド回路(28)と、比較器(10)からの出力
信号v5と、上記パルス信号V2を微分回路(30)で
微分して得られるトリガパルス信号とのアンドをとるア
ンド回路(31)と、このアンド回路(31)の出力信
号的sでセットされ、アンド回路(32)からの出力信
号的≠でリセットされる上記フリップフロップ回路(2
7)と、このフリップフロップ(27)の反転出力信号
V4Iでリセットされ、上記信号v5を反転回路(33
)で反転した後、微分回路(34)で微分することによ
りiqられるトリガパルス信号VりAでセットされ、出
力信号VDを上記アンド回V&(32)に供給するフリ
ップフロップ(35)と、出力信号v6でセットされ、
出力信号V7を反転回路(36)で反転し、微分回路(
37)で微分することにより得られるトリガパルス信号
1htでリセットされるフリップフロップ(38)とか
ら構成される装
上記パルス数制御回路(25)は上記微分回路(37)
の出力信号vr−lでリセットされ、出力信号V6を反
転回路(39)で反転し、微分回路(40)で微分する
ことにより得られるトリガパルス信% T/、、でセッ
トされるフリップフロップ(41)から構成される。な
お、このフリップフロップ(41)の出力体1子Qの信
号’lhIは出力回路(26)のアンド回路(42)の
一方の入力側に供給され、出力端子6の信号私γはアン
ド回路(43)の一方の入力側に(Jj給される。上記
アンド回路(42)、 (43)の他方の入力側に上
記アンド回路(28)の出力信号Vチtが供給される。The driving time control circuit (24) is a flip-flop (2
7) an AND circuit in which the gate is opened when the output signal Vf5 of the output terminal Q is 1, and outputs the pulse signal V2 from the pulse width modulation circuit (22), and the gate is closed when the signal output terminal Q is 0; (28), an AND circuit (31) that ANDs the output signal v5 from the comparator (10), and a trigger pulse signal obtained by differentiating the pulse signal V2 with a differentiating circuit (30); The flip-flop circuit (2) is set by the output signal s of the circuit (31) and reset by the output signal ≠ from the AND circuit (32).
7) and is reset by the inverted output signal V4I of this flip-flop (27), and the signal v5 is sent to the inverting circuit (33).
) and then differentiated by a differentiating circuit (34) to set the trigger pulse signal V to A and supply the output signal VD to the AND circuit V & (32), and the output set by signal v6,
The output signal V7 is inverted by the inverting circuit (36), and the differentiating circuit (
The above-mentioned pulse number control circuit (25) is composed of a flip-flop (38) which is reset by a trigger pulse signal 1ht obtained by differentiating with 37).
The flip-flop ( 41). Note that the signal 'lhI of the output element 1 Q of this flip-flop (41) is supplied to one input side of the AND circuit (42) of the output circuit (26), and the signal 'lhI of the output terminal 6 is supplied to the AND circuit ( (Jj) is supplied to one input side of the AND circuit (43). The output signal Vchit of the AND circuit (28) is supplied to the other input side of the AND circuit (42) and (43).
なお、出力回路(26)からの出力信号76は第5図に
示すように上記ベース回路(18)を構成する駆動回路
(18a)、 (18b)に供給され、このとき駆動
回路(18a)、 (18b)より信号’Ihb、1
/lc−が出力されて、インパーク(13)のS、 P
、 TR(13b) 、 (13c)がオンし、これ
で正極、負極いずれか一方のiiルスが得られる。また
、出力信号V、は駆動回路(18c、)、 (18d
)に供給され、このとき駆動回路(18C)、 (1
8(1)J’り信号%A−?’y+1が出力されてイン
バータ(13)のS、P、TR(13a)、 (13
d)がオンし、上記パルスとは反対のパルスが得られる
。このように信p、116とv7のそれぞれで、インバ
ータ(13)から第3図tc+に示すように正極と負極
のパルスが発生される。Note that the output signal 76 from the output circuit (26) is supplied to the drive circuits (18a) and (18b) forming the base circuit (18) as shown in FIG. From (18b), the signal 'Ihb, 1
/lc- is output, S, P of impark (13)
, TR(13b), and (13c) are turned on, and the ii pulse of either the positive electrode or the negative electrode is obtained. In addition, the output signal V is the drive circuit (18c,), (18d
), at this time the drive circuit (18C), (1
8(1) J'ri signal %A-? 'y+1 is output and the inverter (13) S, P, TR (13a), (13
d) is turned on and a pulse opposite to the above pulse is obtained. In this way, positive and negative pulses are generated from the inverter (13) at each of the signals p, 116 and v7, as shown in FIG. 3 tc+.
次に、第6図(31〜(plに示すタイムチー?−)を
用いて第4図に示すインバータ制御回路(23)の動作
を以下説明する。Next, the operation of the inverter control circuit (23) shown in FIG. 4 will be explained below using FIG.
駆動時間制御回路(24)のアン1′回路(28)は、
フリップフロップ(27)の出力信l;8vPが1のと
きゲートが開かれるので、この間第6図(nlに示すよ
うなパルス幅変調回路(22)から出力されるパルス信
号v2がこのアント回路(28)を介して出力される。The A1' circuit (28) of the drive time control circuit (24) is
Since the gate is opened when the output signal l; 8vP of the flip-flop (27) is 1, the pulse signal v2 outputted from the pulse width modulation circuit (22) as shown in FIG. 28).
一方、フリップフロップ(27)の出力信号7flrが
00ときケ−1・が閉じられるのでアンド回路(28)
からはパルス信号V2は出力されなくなる。従って、ア
ン(−回路(28)の出力信号vyi は第6図(01
に示すように信号kが1の時間Txに渡ってパルス列が
形成された部分と、信号1krが1の時間Tyに渡って
パルス列の除去された部分とから成る信号となる。On the other hand, when the output signal 7flr of the flip-flop (27) is 00, case 1 is closed, so the AND circuit (28)
From then on, the pulse signal V2 is no longer output. Therefore, the output signal vyi of the un(- circuit (28) is
As shown in FIG. 2, the signal consists of a portion in which a pulse train is formed over time Tx when signal k is 1, and a portion where the pulse train is removed over time Ty when signal 1kr is 1.
なお、フリップフロップ(27)の出力信号Verは信
号v2の立」ニリと、信号V5の1とが重なったときに
1となる。すなわち信号V2がOから1に立上り、かつ
信号V5が1となることによりアンド回路(31)の出
力信号V0が1となり、フリップフロップ(27)がセ
ットされてその出力端子Qから1の信号力5が出力され
る。また、上記信号1krは信号V5がOになった後信
号″V7の最初の立下りで0となる。すなわち、信号V
、が0となると、信号v4zが1となり、フリップフロ
ップ(35)がセットされ、その出力信号1kjが1と
なる。一方、信号V7の立下りで、微分回路(37)か
ら1の出力信号性、が出力され、これでフリップフロッ
プ(38)がリセットされ、このフリップフロップ(3
8)の出力端子dから1の信号Vrrが出力される。従
って、アンド回路(32)の出力信号?7nが1となっ
てフリップフロップ(27)はリセットされ、その出力
醪11了Qの出力信号Vgは0となる。なお、フリソゾ
フ1!ツブ(38)は信号V6の立上りで七ソ]・され
るので、その出力端子Qは0となる。上記信号7krの
1となる時間Txにお&Jる信号11y6の偶数IAI
のパルスは後述する出力回路(26)の動作で信号V6
とV7として交互に出力されるので、前述したベース回
路(18)の動作によってインバータ(13)からは第
3図に示すパルス電圧V9が出力されることになる。す
なわち時間7 xでインバータ(13)は駆動されて正
極、負極のパルス電圧を出力し、信号的5のOとなる時
間’r yで17止されパルス電圧を発生せず(fss
図(C1参照)、これで第3図(alに示す波形の溶接
電圧V。が胃られる。この場合、出力信号V5の1とな
る時間′1゛xに対応して信号Vチよの1となる時間’
7’ xが設定されるので、結局出力信号v5 に基づ
き時間T xとTyとの比が調整される。Note that the output signal Ver of the flip-flop (27) becomes 1 when the rising edge of the signal v2 and the 1 of the signal V5 overlap. That is, the signal V2 rises from O to 1, and the signal V5 becomes 1, so that the output signal V0 of the AND circuit (31) becomes 1, the flip-flop (27) is set, and a signal output of 1 is output from its output terminal Q. 5 is output. Further, the signal 1kr becomes 0 at the first fall of the signal "V7 after the signal V5 becomes 0. In other words, the signal 1kr becomes 0 at the first fall of the signal "V7.
, becomes 0, the signal v4z becomes 1, the flip-flop (35) is set, and its output signal 1kj becomes 1. On the other hand, at the falling edge of the signal V7, an output signal of 1 is output from the differentiating circuit (37), which resets the flip-flop (38), and this flip-flop (3
A signal Vrr of 1 is output from the output terminal d of 8). Therefore, the output signal of the AND circuit (32)? 7n becomes 1, the flip-flop (27) is reset, and the output signal Vg of its output 11Q becomes 0. In addition, Frisozov 1! Since the knob (38) is turned on at the rising edge of the signal V6, its output terminal Q becomes 0. The even number IAI of the signal 11y6 at the time Tx when the above signal 7kr becomes 1
The pulse is generated as a signal V6 by the operation of the output circuit (26), which will be described later.
and V7 are alternately output, so that the inverter (13) outputs the pulse voltage V9 shown in FIG. 3 by the operation of the base circuit (18) described above. That is, at time 7 x, the inverter (13) is driven and outputs positive and negative pulse voltages, and at time 'ry when the signal becomes O of 5, it stops and does not generate a pulse voltage (fss
(see C1), the welding voltage V of the waveform shown in FIG. The time when
Since 7'x is set, the ratio between time Tx and Ty is adjusted based on the output signal v5.
パルス数制御回路(25)につき説明する点、いま初期
設定で、フリップフロップ(41)の出力信号1ktが
1で、出力信号力δがOとすれば、アンド回路(43)
のゲートが開かれ、アンド回路(43)から信号?7+
6のパルスが1個出力されて、出力信号v6となる。な
お、アンド回路(42)のゲートは閉じられている。こ
のとき、−上記1個のパルスの立下り時点で微分回路(
40)からパルス信号?hが出力され、フリップフロッ
プ(41)は反転し、出力信号h7がO1出力信号1/
”42が1に反転し、アンド回路(43)のゲートがと
じられ、アンド回路(42)のゲートが開かれるので、
信号V46の次のパルスはアンド回路(42)から出力
されて、出力信号r7となる。Regarding the pulse number control circuit (25), if the output signal 1kt of the flip-flop (41) is 1 and the output signal strength δ is O in the initial settings, then the AND circuit (43)
The gate of is opened and the signal ? from the AND circuit (43). 7+
One pulse of 6 is output, resulting in an output signal v6. Note that the gate of the AND circuit (42) is closed. At this time, - at the falling edge of the above one pulse, the differentiating circuit (
Pulse signal from 40)? h is output, the flip-flop (41) is inverted, and the output signal h7 becomes the O1 output signal 1/
``42 is inverted to 1, the gate of the AND circuit (43) is closed, and the gate of the AND circuit (42) is opened, so
The next pulse of signal V46 is output from the AND circuit (42) and becomes output signal r7.
このようにパルス数制御回路(25)はアンド回17&
(2B)の出力信号V4&のパルスを交互にアンド回路
(43)と(42)に振り分けるように動作する。従っ
て、出力信号V 6. v7は第6図(h)。In this way, the pulse number control circuit (25) operates in the AND circuit 17&
It operates to alternately distribute the pulses of the output signal V4& of (2B) to the AND circuits (43) and (42). Therefore, the output signal V6. v7 is shown in Figure 6 (h).
(11に示すように信号″rJ″6のパルスから始まっ
て、信号′V7のパルスで終わり、交互に出力される互
いに数の等しいパルスとなる。上記実施例では信号V=
tsが1のときに出力される信号v6と信号V7のパル
スの数を一致させるように制御しているが、任意同期で
全体としての正負のパルス数を一致させるために信号V
6と信号・r7をいかなる場合でも交互に出力するよう
にしてもよい。(As shown in 11, it starts with the pulse of the signal "rJ"6 and ends with the pulse of the signal 'V7, resulting in equal number of pulses that are output alternately. In the above embodiment, the signal V=
The number of pulses of the signal v6 and the signal V7 that are output when ts is 1 is controlled to match, but in order to match the overall number of positive and negative pulses with arbitrary synchronization, the signal V
6 and signal r7 may be output alternately in any case.
次に、基本パルス幅決定回路(21)とパルス幅変調回
路(22)の動作につき述べる。」−述したように信号
V6及び信号v7のパルス数を一致させると、偏磁が生
じなくなる。ところが第7図(alに示すように設定電
圧〃。lを検出信号ブa (溶接電流ioに比例)が越
しても時間和だけ検出信号νaが上昇するので、時間的
なむだが発生ずる。すなわち第7図1blにおいて、パ
ルス’l1ghが発生されたとき、1oの時刻において
設定電圧f/pelを検出信号Faが越しても比較器(
10)の出力′7/″5がこの時第3図fclに示すよ
うに0となったとする。しかしパルス数制御回路(25
)の作用でパルス1/”4aとは反対のパルスジ97が
必ず出力されるので検出信号Vaずなわち溶接電流i。Next, the operations of the basic pulse width determining circuit (21) and the pulse width modulating circuit (22) will be described. - As described above, if the number of pulses of the signal V6 and the signal v7 are made equal, biased magnetization will not occur. However, as shown in FIG. 7 (al), even if the detection signal νa (proportional to the welding current io) exceeds the set voltage .l, the detection signal νa increases by the time sum, resulting in time wastage. In FIG. 7 1bl, when the pulse 'l1gh is generated, even if the detection signal Fa exceeds the set voltage f/pel at time 1o, the comparator (
Suppose that the output '7/''5 of the pulse number control circuit (25) becomes 0 as shown in Fig. 3 fcl.
), the pulse 97 opposite to the pulse 1/''4a is always output, so the detection signal Va, that is, the welding current i.
はさらに上昇し、時間7M経過した後にやっと下降し始
める。ここで、この行き過ぎ量すなわち(’fSV図(
alに示す上昇■、を小さくするには、基本パルスv2
の周波数を上げるか、第7図(alに示すような溶接電
流の立上り特性曲線Aの傾きを小さくすればよい。基本
パルスV2の周波数はスイッチング素子の特性から限界
があるため、上記特性曲線Aの傾きを下げることが有効
である。この特性曲線Aの傾きを小さくするには、第2
図に示すフィルタリアクトル(5)のインダクタンスを
増すか、第3図(a)に示すパルス列発生時間Txにお
ける電圧″V″0の平均値を下げればよい。前者はフィ
ルクリアク1−ル(5)の重量が増す不具合がある。第
3図(alにおいて時間Txの期間における電圧F。continues to rise, and finally begins to fall after 7M has elapsed. Here, this amount of overshoot, that is ('fSV diagram (
To reduce the rise ■ shown in al, the basic pulse v2
Either increase the frequency of the welding current, or decrease the slope of the welding current rise characteristic curve A as shown in FIG. It is effective to reduce the slope of the characteristic curve A.In order to reduce the slope of this characteristic curve A, the second
The inductance of the filter reactor (5) shown in the figure may be increased, or the average value of the voltage "V"0 at the pulse train generation time Tx shown in FIG. 3(a) may be reduced. The former has the disadvantage that the weight of the fill acrylic 1-1 (5) increases. FIG. 3 (voltage F during a period of time Tx in al).
の平均値を下げるには、第3図(alに示すパルス発生
周期T oとパルス幅T。Nの比を変えればよい。In order to lower the average value of , the ratio of the pulse generation period T and the pulse width T.N shown in FIG. 3 (al) may be changed.
これを実現するのが第8図に具体的に示した前記基本パ
ルス幅決定回路(21)である。第8図において、設定
値V/le(を増幅器(21a)で増幅し、所定値v5
゜を加算器(2l b)で加えて出力電圧171を発生
させる。パルス幅変調回路(22)はこの出力電圧V1
の大きさ番こ相当するパルス幅のパルスを信号V2とし
て出力するので、上記第3図fatに示す電圧V。の時
間T6.を調整できる。なお、溶接アーク電圧の大きさ
は溶接アーク電流ioが把握できれば予想できるから、
第3図fa)に示すTxの期間におりる電圧V。の平均
値と/8接アーク電圧の差があまり大きくならないよう
に増幅器(218)と所定値Vsetを予め設定すれば
、第7図(alに示すむだな」二昇分VLを小さくでき
、結果として溶接アーク電流ioのリップルを干げろこ
とができる。上記基本パルス幅決定回路(21)の効果
を具体的に示したのが第9図(a)。This is realized by the basic pulse width determining circuit (21) specifically shown in FIG. In FIG. 8, the set value V/le (is amplified by an amplifier (21a), and a predetermined value v5
An adder (2lb) adds the output voltage 171 to generate the output voltage 171. The pulse width modulation circuit (22) uses this output voltage V1
Since a pulse with a pulse width corresponding to the magnitude number is output as the signal V2, the voltage V shown in FIG. Time T6. can be adjusted. Note that the magnitude of the welding arc voltage can be predicted if the welding arc current io is known.
The voltage V falling during the Tx period shown in FIG. 3 fa). If the amplifier (218) and the predetermined value Vset are set in advance so that the difference between the average value of The ripple of the welding arc current io can be reduced as follows.The effect of the basic pulse width determining circuit (21) is specifically shown in FIG. 9(a).
(b)と第10図(al、 (blである。第9図は基
本パルス幅決定回路(21)を用いることなく第3図(
メ1)に示す時間T6Nを常に一定とした場合の動作特
性、第10図は基本パルス幅決定回路(17)を用いて
設定値VPefを小さくした時のto以降で、」二記時
間T09を短くした場合の動作特性である。このように
溶接電流立上り特性曲線の領きを小さくすることにより
、溶接電圧V。のパルス幅T、Nが小さくなり、その平
均値が小さくなるので前述のむだな上昇分VL を小
さくできる。(b) and Fig. 10 (al, (bl). Fig. 9 shows Fig. 3 (Fig.
Figure 10 shows the operating characteristics when the time T6N shown in 1) is always constant. This is the operating characteristic when the length is shortened. By reducing the area of the welding current rise characteristic curve in this way, the welding voltage V can be increased. Since the pulse widths T and N of the pulse widths T and N become smaller and their average value becomes smaller, the above-mentioned wasteful increase VL can be reduced.
なお、上記実施例ではインバータにフルブリッジ型を用
いているが、ハーフブリッジ型、センタタップ型等のイ
ンバータを用いてもよい。また、」1記実施例ではイン
バータを構成するスイッチング素子としてトランジスタ
を用いているが、GTO,FET、SIT等を用いても
よい。In the above embodiment, a full bridge type inverter is used, but a half bridge type, center tap type, or other type inverter may be used. Further, although transistors are used as switching elements constituting the inverter in the first embodiment, GTOs, FETs, SITs, etc. may also be used.
また、パルス数制御回路は第4図に示す回路に限定され
ず、要は第3図(e)に示す電圧v9の電圧パルスの正
、負の数を一致させる回路であればいかなる回路でもよ
い。また、第3図(81に示す時間Tx中において、電
圧v9の電圧パルスの正、負の数を一致させるのではな
く、第11図(alに示すように全体としてすなわち任
意時間周期に渡って上記電圧V9の電圧パルスの正、負
の数を一致さセるような回路であっても、第11図(b
lに示すように検出信号Vaずなわち溶接電流i(1を
設定値に維持でき、かつ偏磁を防止できる。Further, the pulse number control circuit is not limited to the circuit shown in FIG. 4, but any circuit may be used as long as it is a circuit that matches the positive and negative numbers of voltage pulses of voltage v9 shown in FIG. 3(e). . In addition, instead of making the positive and negative numbers of voltage pulses of the voltage v9 match during the time Tx shown in FIG. 3 (81), as a whole as shown in FIG. Even if the circuit matches the positive and negative numbers of the voltage pulses of the voltage V9, as shown in FIG.
As shown in 1, the detection signal Va, that is, the welding current i (1) can be maintained at the set value, and biased magnetization can be prevented.
以上述べたように、本発明によるアーク溶接機の溶接電
流制御装置によれば、絶縁トランスの一次側周波数をイ
ンバータで上げるようにしたので、絶縁トランスの大き
さ、重量が大幅に小さくなり、しかもトランスに入力す
るパルス電圧の正と負の数を一致さセたのでトランスの
偏磁を防止でき、さらに溶接電圧のパルス幅を制御する
ようにしたので溶接電流リップルを極力小さくすること
ができるという効果がある。As described above, according to the welding current control device for an arc welder according to the present invention, the primary frequency of the insulation transformer is increased by an inverter, so the size and weight of the insulation transformer can be significantly reduced. By setting the positive and negative numbers of the pulse voltage input to the transformer to be the same, it is possible to prevent biased magnetization of the transformer, and by controlling the pulse width of the welding voltage, it is possible to minimize welding current ripple. effective.
第1図は従来のアーク溶接機の溶接電流制御装置の一例
を示す回路図、第2図は本発明によるアーク溶接機の溶
接電流制御装置の一実施例を示す回路構成図、第3図+
a)〜(C1は本発明の電流制御の動作原理を説明する
ためのタイムチャート、第4図は第2図に示すパルス制
御回路の一例を詳細に示す回路図、第5図は第2図に示
すベース回路の詳細を示す回路図、第6図は第4図に示
すパルス制御回路の動作を説明するためのタイムチャー
ト、第7図は本発明によるアーク溶接機の溶接電流制御
装置の一実施例における電流リップルの発生原理を示す
電圧波形の図、第8図は第2図に示す基本パルス幅決定
回路の具体例を示す図、第9図及び第10図は第2図に
示す基本パルス幅決定回路がない場合とある場合との違
いを示す電圧波形の図、第11図(a)、 (blは第
2図に示すパルス制御回路を他の方法で実施した場合の
各部の電圧状態を示すための図である。
(1)・・・3相ライン入カ、(3)・・・第1の整流
回路、(5)・・・フィルタリアクトル、(6)・・・
電極、(7)・・・母材、(8)・・・フライホイール
ダイオード、(9)・・・電流検出器、(10)・・・
比較器、VPef・・・電圧の設定値、(12)・・・
平滑コンデンサ、(13)・・・インバータ、(14)
・・・高周波トランス、(15)・・・第2の整流回路
、(18)・・・ベース回路、(19) ・・・イン
バータ制御回路、(2o)・・・検出信号判定回路、(
21)・・・基本パルス幅決定回路、(22)・・・パ
ルス幅変稠回路、(23)・・・パルス制御回路、(2
4)・・・パルス列制御回路、(25)・・・パルス切
換回路、(26)・・・出力回路。
各図中の同一符号は同一または相当部分を示す。
代理人 大 岩 増 雄 (外2名)特許庁長
官殿
1.事件の表示 特願昭58−962492、発明
の名称
アーク溶接機の溶接電流制御装置
;3.補正をする者
事件との関係 特許出願人
代表者片由仁へ部
4、代理人
(連::’+5’+:・す(、゛犀1・’、′11++
:i″1部)5、補正の対象
発明の詳細な説明の欄
6、補正の内容
+11明細書第4頁第15行目「高いきと」とあるのを
「高いとき」と補正する。
以上Fig. 1 is a circuit diagram showing an example of a conventional welding current control device for an arc welding machine, Fig. 2 is a circuit diagram showing an embodiment of a welding current control device for an arc welding machine according to the present invention, and Fig. 3 +
a) to (C1 is a time chart for explaining the operating principle of current control of the present invention, FIG. 4 is a circuit diagram showing in detail an example of the pulse control circuit shown in FIG. 2, and FIG. 5 is a circuit diagram shown in FIG. 2. 6 is a time chart for explaining the operation of the pulse control circuit shown in FIG. 4, and FIG. 7 is a circuit diagram showing the details of the base circuit shown in FIG. Figure 8 is a diagram showing a specific example of the basic pulse width determining circuit shown in Figure 2. Figures 9 and 10 are diagrams showing the basic pulse width determination circuit shown in Figure 2. Figure 11 (a) is a voltage waveform diagram showing the difference between the case without and the case with the pulse width determining circuit, (bl is the voltage at each part when the pulse control circuit shown in Figure 2 is implemented using another method) It is a diagram for showing the state. (1)...3-phase line input, (3)...first rectifier circuit, (5)...filter reactor, (6)...
Electrode, (7)...Base material, (8)...Flywheel diode, (9)...Current detector, (10)...
Comparator, VPef... Voltage setting value, (12)...
Smoothing capacitor, (13)...Inverter, (14)
... High frequency transformer, (15) ... Second rectifier circuit, (18) ... Base circuit, (19) ... Inverter control circuit, (2o) ... Detection signal judgment circuit, (
21) Basic pulse width determination circuit, (22) Pulse width variation circuit, (23) Pulse control circuit, (2
4)... Pulse train control circuit, (25)... Pulse switching circuit, (26)... Output circuit. The same reference numerals in each figure indicate the same or corresponding parts. Agent Masuo Oiwa (2 others) Commissioner of the Japan Patent Office 1. Indication of the case: Japanese Patent Application No. 58-962492, title of invention: Welding current control device for arc welding machine; 3. Relationship with the case of the person making the amendment To the representative of the patent applicant, Kata Yuhito, Part 4, Agent (ren::'+5'+:・su(,゛犀1・','11++
:i'' 1 copy) 5, Column 6 for detailed description of the invention subject to amendment, Contents of amendment + 11 In the specification, page 4, line 15, the phrase "at high times" is amended to read "at high times."that's all
Claims (3)
定した値に維持されるように帰還制御するアーク溶接板
の溶接電流制御装置において、交流入力を整流する第1
の整流回路と、整流された直流電圧を高周波交流電圧に
変換するインバータと、上記インバータから出力される
高周波交流電圧を所定の低い電圧に変換する高周波トラ
ンスと、上記高周波トランスから出力される電圧を整流
する第2の整流回路と、」二記インバータを制御する帰
還制御回路とから成り、上記帰還制御回路は、溶接電流
と設定値とを比較するやJ定回路と、上記インバータを
時間T’ xに渡って駆動してインバータより高周波交
流電圧を発生させ、インバータを時間Tyに渡って停止
し、このような駆動と停止とを交互に繰返すようにイン
ハークを制御するとともに、」二記判定回路からの出力
信号に基づき上記インバータの、随動の時間Txとf宇
土の時間Tyとの比を制御する駆動時間制御回路とを備
えたことを特徴とするア−り溶接板の溶接電流制御装置
。(1) In a welding current control device for an arc welding plate that compares the welding current with a set value and performs feedback control so that the welding current is maintained at the set value, the first controller rectifies the AC input.
a rectifier circuit, an inverter that converts the rectified DC voltage into a high-frequency AC voltage, a high-frequency transformer that converts the high-frequency AC voltage output from the inverter into a predetermined low voltage, and a high-frequency transformer that converts the voltage output from the high-frequency transformer into a predetermined low voltage. It consists of a second rectifier circuit that performs rectification, and a feedback control circuit that controls the inverter. The inverter is driven for a period of time Ty to generate a high-frequency AC voltage from the inverter, the inverter is stopped for a time Ty, and the inverter is controlled to alternately repeat such driving and stopping, and A welding current control device for arc welding plates, comprising: a drive time control circuit that controls the ratio of the dependent time Tx and the fUto time Ty of the inverter based on an output signal from the inverter. .
定した値に維持されるように帰j■制御するアーク溶接
板の溶接電流制御装置において、交流入力を整流する第
1の整流回路と、整流された直流電圧を高周波交流電圧
に変換するインバータと、」二記インバータから出力さ
れる高周波交流電圧を所定の低い電圧に変換する高周波
トランスと、上記高周波1−ランスから出力される電圧
を整流する第2の整流回路と、上記インバータを制御す
る帰還制御回路とから成り、上記帰還制御回路は、溶接
電流と設定値とを比較する判定回路と、上記インバータ
を時間Txに渡って駆動してインバータより正負のパル
ス電圧を発生させ、インバータを時間Tyに渡って停止
し、このような駆動と停止を交互に繰返すようにインバ
ータを制御するとともに、上記判定回路からの出力信号
に基づき上記インバータの駆動の時間1゛xと停止の時
間Tyとの比を制御する駆動時間制御回路と、上記イン
バータから出力される正負のパルス電圧の発生タイミン
グを制御して正のパルス電圧と負のパルス電圧の数を一
致させるパルス数制御回路とを備えたことを特徴とする
アーク溶接機の溶接電流制御装置。(2) In a welding current control device for an arc welding plate that compares the welding current with a set value and controls the welding current so that the welding current is maintained at the set value, the first rectifier that rectifies the AC input a circuit, an inverter that converts the rectified DC voltage into a high-frequency AC voltage, and a high-frequency transformer that converts the high-frequency AC voltage output from the inverter into a predetermined low voltage, and the high-frequency voltage output from the lance. The feedback control circuit includes a second rectifier circuit that rectifies the voltage, and a feedback control circuit that controls the inverter. The inverter is driven to generate positive and negative pulse voltages from the inverter, the inverter is stopped for a time Ty, and the inverter is controlled so as to alternately repeat such driving and stopping, and based on the output signal from the determination circuit. A drive time control circuit that controls the ratio between the drive time 1x and the stop time Ty of the inverter, and a drive time control circuit that controls the generation timing of the positive and negative pulse voltages output from the inverter to control the positive pulse voltage and negative pulse voltage. A welding current control device for an arc welding machine, comprising a pulse number control circuit that matches the number of pulse voltages.
交流電圧が正負のパルス電圧となるようにインバータを
制御するとともに、上記パルス電圧のパルス幅を制御し
て溶接電流の立上り特性を調整する基本パルス幅決定回
路を含む特許請求の範囲第2項記載のアーク溶接機の溶
接電流制御装置。(3) The feedback control circuit controls the inverter so that the high-frequency AC voltage output from the inverter becomes a positive and negative pulse voltage, and also controls the pulse width of the pulse voltage to adjust the rise characteristics of the welding current. A welding current control device for an arc welding machine according to claim 2, which includes a width determining circuit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9624983A JPS59220285A (en) | 1983-05-31 | 1983-05-31 | Control device for welding current of arc welding machine |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9624983A JPS59220285A (en) | 1983-05-31 | 1983-05-31 | Control device for welding current of arc welding machine |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS59220285A true JPS59220285A (en) | 1984-12-11 |
JPS6345913B2 JPS6345913B2 (en) | 1988-09-12 |
Family
ID=14159940
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP9624983A Granted JPS59220285A (en) | 1983-05-31 | 1983-05-31 | Control device for welding current of arc welding machine |
Country Status (1)
Country | Link |
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JP (1) | JPS59220285A (en) |
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- 1983-05-31 JP JP9624983A patent/JPS59220285A/en active Granted
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JPS6345913B2 (en) | 1988-09-12 |
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