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JPS59144931U - ラツチドコンパレ−タ - Google Patents

ラツチドコンパレ−タ

Info

Publication number
JPS59144931U
JPS59144931U JP3897783U JP3897783U JPS59144931U JP S59144931 U JPS59144931 U JP S59144931U JP 3897783 U JP3897783 U JP 3897783U JP 3897783 U JP3897783 U JP 3897783U JP S59144931 U JPS59144931 U JP S59144931U
Authority
JP
Japan
Prior art keywords
circuit
latched comparator
voltage
voltage comparison
latch
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP3897783U
Other languages
English (en)
Other versions
JPH036032Y2 (ja
Inventor
六浦　芳道
関野　武男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sony Corp
Original Assignee
Sony Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sony Corp filed Critical Sony Corp
Priority to JP3897783U priority Critical patent/JPS59144931U/ja
Publication of JPS59144931U publication Critical patent/JPS59144931U/ja
Application granted granted Critical
Publication of JPH036032Y2 publication Critical patent/JPH036032Y2/ja
Granted legal-status Critical Current

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  • Manipulation Of Pulses (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のラッチドコンパレータの一例ヲ示す接続
図、第２図はその動作説明に供する波形図、第３図はこ
の考案に係わるラッチドコンパレータの一例を示す接続
図、第４図はその動作説明に供する波形図である。 １０Ａは電圧比較回路、ＩＯＢはラッチ回路、１２は第
１の電流スイッチ回路、１６は第２の電流スイッチ回路
、１５はプリセット回路、■１Ｎは入力電圧、■８は基
準電圧、ＣＬＫ、　ＣＬＫ’はクロックである。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電圧比較回路と、その電圧比較出力をラッチするラッチ
    回路と、上記電圧比較回路の一対の出力端子の間の電位
    を等電位にするプリセット回路とを有し、このプリセッ
    ト回路はラッチ動作後、電圧比較動作に移る前の所定の
    期間だけ動作するようになされたラッチドコンパレータ
    。
JP3897783U 1983-03-17 1983-03-17 ラツチドコンパレ−タ Granted JPS59144931U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3897783U JPS59144931U (ja) 1983-03-17 1983-03-17 ラツチドコンパレ−タ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP3897783U JPS59144931U (ja) 1983-03-17 1983-03-17 ラツチドコンパレ−タ

Publications (2)

Publication Number Publication Date
JPS59144931U true JPS59144931U (ja) 1984-09-27
JPH036032Y2 JPH036032Y2 (ja) 1991-02-15

Family

ID=30169636

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3897783U Granted JPS59144931U (ja) 1983-03-17 1983-03-17 ラツチドコンパレ−タ

Country Status (1)

Country Link
JP (1) JPS59144931U (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01194610A (ja) * 1987-12-15 1989-08-04 Deutsche Itt Ind Gmbh サンプル及び保持ステージと並列ａ／ｄコンバータにおけるその使用方法
WO2014038173A1 (ja) * 2012-09-07 2014-03-13 パナソニック株式会社 Ａｄ変換器及び受信装置

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS54136267A (en) * 1978-04-14 1979-10-23 Nippon Telegr & Teleph Corp <Ntt> Data input circuit

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS54136267A (en) * 1978-04-14 1979-10-23 Nippon Telegr & Teleph Corp <Ntt> Data input circuit

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01194610A (ja) * 1987-12-15 1989-08-04 Deutsche Itt Ind Gmbh サンプル及び保持ステージと並列ａ／ｄコンバータにおけるその使用方法
WO2014038173A1 (ja) * 2012-09-07 2014-03-13 パナソニック株式会社 Ａｄ変換器及び受信装置

Also Published As

Publication number Publication date
JPH036032Y2 (ja) 1991-02-15

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