JPS59118007U - 出力回路 - Google Patents
出力回路Info
- Publication number
- JPS59118007U JPS59118007U JP850883U JP850883U JPS59118007U JP S59118007 U JPS59118007 U JP S59118007U JP 850883 U JP850883 U JP 850883U JP 850883 U JP850883 U JP 850883U JP S59118007 U JPS59118007 U JP S59118007U
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- JP
- Japan
- Prior art keywords
- output
- output circuit
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- target
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Control By Computers (AREA)
- Programmable Controllers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は本考案の一実施例の出力回路図、第２図のデー
タとレディ相互間のタイミング関係を示すタイムチャー
ト図、第３図は第２図の拡張例を示すタイムチャート図
である。 １・・・マイクロコンピュータ、２・・・出力回路、３
・・・出力対象装置、２５・・・インバータ。
タとレディ相互間のタイミング関係を示すタイムチャー
ト図、第３図は第２図の拡張例を示すタイムチャート図
である。 １・・・マイクロコンピュータ、２・・・出力回路、３
・・・出力対象装置、２５・・・インバータ。
Claims (1)
- ソフトウェアプログラムによって出力データが出力対象
に出力されるマイクロコンピュータ制御の装置において
、出力データを出力対象に出力するに際し、出力データ
と出力データ確立信号間のタイミングをプログラマブル
タイマーにより可変とすることを特徴とした出力回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP850883U JPS59118007U (ja) | 1983-01-26 | 1983-01-26 | 出力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP850883U JPS59118007U (ja) | 1983-01-26 | 1983-01-26 | 出力回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59118007U true JPS59118007U (ja) | 1984-08-09 |
Family
ID=30139996
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP850883U Pending JPS59118007U (ja) | 1983-01-26 | 1983-01-26 | 出力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59118007U (ja) |
-
1983
- 1983-01-26 JP JP850883U patent/JPS59118007U/ja active Pending
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