JPS5910842Y2 - television receiver - Google Patents
television receiverInfo
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- JPS5910842Y2 JPS5910842Y2 JP1975141377U JP14137775U JPS5910842Y2 JP S5910842 Y2 JPS5910842 Y2 JP S5910842Y2 JP 1975141377 U JP1975141377 U JP 1975141377U JP 14137775 U JP14137775 U JP 14137775U JP S5910842 Y2 JPS5910842 Y2 JP S5910842Y2
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Description
【考案の詳細な説明】
本考案はテレビジョン受像機の電源回路に関するもので
あり、消費電力の低減を図ろうとするものである。[Detailed Description of the Invention] The present invention relates to a power supply circuit for a television receiver, and is intended to reduce power consumption.
従来例による回路構戊の一例を第3図に示す。An example of a conventional circuit structure is shown in FIG.
この回路は第1図に示される並列方式のスイッチングレ
ギュレー夕と第2図に示される水平偏向回路を一体化し
たものであり、いずれも公知のものである。This circuit integrates the parallel type switching regulator shown in FIG. 1 and the horizontal deflection circuit shown in FIG. 2, both of which are well known.
第1図のスイッチングレギュレー夕には入力としてVi
なる直流電圧が加えられる。The switching regulator in Figure 1 has Vi as an input.
A DC voltage of
これは脈流であってもよい。This may be a pulsating flow.
これはコンバータトランス1の一次巻線2とスイッチン
グ素子としてのトランジスタ3との直列接続の両端に加
えられる。This is applied to both ends of the series connection between the primary winding 2 of the converter transformer 1 and the transistor 3 as a switching element.
コンバータートランスの2次側は2次巻線4、フライホ
イールダイオード5及び平滑容量6で構或され、負荷7
に接続され、出力としてV1なる直流電圧を生じる。The secondary side of the converter transformer consists of a secondary winding 4, a flywheel diode 5, and a smoothing capacitor 6, and a load 7.
, and produces a DC voltage V1 as an output.
トランジスタ3のベースには図示の如き矩形波が加えら
れ、スイッチング動作を行う。A rectangular wave as shown in the figure is applied to the base of the transistor 3 to perform a switching operation.
即ちオン時一次巻線2にエネルギーが蓄えられオフ時そ
のエネルギーは2次巻線4よりダイオード5を介して負
荷7に供給される。That is, energy is stored in the primary winding 2 when it is on, and that energy is supplied to the load 7 from the secondary winding 4 via the diode 5 when it is off.
ここで電源変動あるいは負荷変動に対し、ベースに加゛
える波形を適当に変化させデューテイを変える事により
、出力■1は完全に安定化することが可能である。Here, by appropriately changing the waveform applied to the base and changing the duty in response to power supply fluctuations or load fluctuations, it is possible to completely stabilize the output (1).
第2図の水平偏向回路は入力としてViが加えられ偏向
ヨーク8に所定の偏向電流を流すべく動作をする。The horizontal deflection circuit shown in FIG. 2 receives Vi as an input and operates to cause a predetermined deflection current to flow through the deflection yoke 8.
この動作は極めて一般的であるのでここでは省略する。Since this operation is extremely common, it will be omitted here.
尚、12は出力トランジスタ、13はダンパーダイオー
ド、14は共振コンデンサ、8は偏向コイル、15はS
字補正コンデンサである。In addition, 12 is an output transistor, 13 is a damper diode, 14 is a resonant capacitor, 8 is a deflection coil, and 15 is S
This is a correction capacitor.
一方CRTのアノード電圧としての高圧はフライバック
トランス9の2次巻線10より与えられ、これはフライ
バックパルス、即ち帰線期間のパルスを整流することに
よって得られる。On the other hand, a high voltage as the anode voltage of the CRT is provided from the secondary winding 10 of the flyback transformer 9, and is obtained by rectifying the flyback pulse, that is, the pulse during the retrace period.
又一次巻線11はACカットのチョークトランスとして
動作する。Further, the primary winding 11 operates as an AC cut choke transformer.
第3図に示した回路に於いて入力は非安定のVi即ち、
これは第1図で説明したViと同様の電圧がコンバータ
ートランス16に加えられる。In the circuit shown in Figure 3, the input is unstable Vi, that is,
A voltage similar to Vi explained in FIG. 1 is applied to the converter transformer 16.
スイッチング素子としてのトランジスタ17のベースに
矩形波が加えられ、オン時にはViによってコンバータ
ートランス16の一次巻線18にエネルギーが蓄えられ
、オフ時に二次巻線19より偏向回路にダイオード30
を介して供給される。A rectangular wave is applied to the base of a transistor 17 as a switching element, and when it is on, energy is stored in the primary winding 18 of the converter transformer 16 by Vi, and when it is off, energy is stored in the primary winding 18 of the converter transformer 16 from the secondary winding 19 to a diode 30 in the deflection circuit.
Supplied via.
水平偏向回路は第2図と同様の動作をする。The horizontal deflection circuit operates similarly to FIG.
ダイオード21は偏向電流の後半をトランジスタ17に
流してやるものである。The diode 21 allows the latter half of the deflection current to flow to the transistor 17.
この結果コンバータートランスの巻線には第4図aの如
き波形が生じる。As a result, a waveform as shown in FIG. 4a is generated in the winding of the converter transformer.
定常状態で25なる波形がコンバータートランス18に
生じているとして、Viが増大した場合波形は26の如
くなり、又減少した場合は27の如くなる。Assuming that a waveform 25 occurs in the converter transformer 18 in a steady state, the waveform becomes 26 when Vi increases, and 27 when Vi decreases.
この動作はトランジスタ17のベース入力により制御さ
れる。This operation is controlled by the base input of transistor 17.
このことは負荷側に関しても同様であり、適当なフィー
ドバックをベースに加えることにより実現される。This also applies to the load side, and is achieved by adding appropriate feedback to the base.
この時水平偏向回路に生じる第4図bに示すフライバッ
クパルス28は常に一定に保たれる。At this time, the flyback pulse 28 shown in FIG. 4b generated in the horizontal deflection circuit is always kept constant.
即ち水平偏向回路の動作電圧は一定である。偏向ヨーク
8と並列にフライバックトランス9が接続され、電圧巻
線10により高圧が得られ、別の2次巻線22により逆
パルスを発生させ、これの走査期間をダイオード23に
より整流し、内部インピーダンスの低い直流電圧を得て
いる。That is, the operating voltage of the horizontal deflection circuit is constant. A flyback transformer 9 is connected in parallel with the deflection yoke 8, a high voltage is obtained by a voltage winding 10, a reverse pulse is generated by another secondary winding 22, and the scanning period of this is rectified by a diode 23, and the internal A DC voltage with low impedance is obtained.
この第3図の回路を水平発振回路と組合せて第5図の回
路を作ることができる。The circuit shown in FIG. 5 can be made by combining the circuit shown in FIG. 3 with a horizontal oscillation circuit.
第5図において31. 32は交流電源電圧印加端子、
33はこの交流電源電圧を整流平滑する整流平滑回路、
34は第3図のスイッチングレギュレータ回路、35は
水平発振回路であり、36は水平発振器である。In Figure 5, 31. 32 is an AC power supply voltage application terminal;
33 is a rectifying and smoothing circuit that rectifies and smoothes this AC power supply voltage;
34 is the switching regulator circuit shown in FIG. 3, 35 is a horizontal oscillation circuit, and 36 is a horizontal oscillator.
水平発振回路35の出力は水平ドライブトランジスタ3
7のベースに加えられている。The output of the horizontal oscillation circuit 35 is the horizontal drive transistor 3
It has been added to the base of 7.
この水平ドライブトランジスタ37のエミツタは接地さ
れ、コレクタはドライブトランス38の1次巻線39を
介して整流平滑回路33の出力端子に2次巻線40は水
平出力トランジスタ17のベースに接続されている。The emitter of the horizontal drive transistor 37 is grounded, the collector is connected to the output terminal of the rectifying and smoothing circuit 33 via the primary winding 39 of the drive transformer 38, and the secondary winding 40 is connected to the base of the horizontal output transistor 17. .
水平発振回路35内の発振器36およびその他のパルス
幅を制御するための回路の直流電源電圧vbは整流平滑
回路33の出力電圧Vi (約130ボルト)を抵抗4
1で電圧降下させてl2〜20ボルトにしたものである
。The DC power supply voltage vb of the oscillator 36 and other circuits for controlling the pulse width in the horizontal oscillation circuit 35 is the output voltage Vi (approximately 130 volts) of the rectifying and smoothing circuit 33, which is connected to the resistor 4.
1 to lower the voltage to 12 to 20 volts.
ところが、この回路では抵抗41で3〜4ワットの電力
を消費する欠点がある。However, this circuit has the disadvantage that the resistor 41 consumes 3 to 4 watts of power.
本考案は消費電力を少なくしようとするものであり、以
下本考案の一実施例について図面とともに説明する。The present invention aims to reduce power consumption, and one embodiment of the present invention will be described below with reference to the drawings.
第6図はその一実施例であり、第5図と同一部分は同一
番号を付して説明は省略する。FIG. 6 shows one embodiment of the present invention, and the same parts as those in FIG. 5 are given the same numbers and the explanation thereof will be omitted.
第6図の回路の特徴は水平発振回路35の内部の回路を
すべてシャーシアースとして大地アースより浮かし、フ
ライバックトランス9に設けた巻線42のパルスをダイ
オード43で整流し、整流電圧をコンデンサ44で平滑
して直流電圧Vcを得、これを上記シャーシに印加する
。The circuit shown in FIG. 6 is characterized by having all the internal circuits of the horizontal oscillation circuit 35 floating above the earth ground as a chassis ground, rectifying the pulses of the winding 42 provided in the flyback transformer 9 with a diode 43, and passing the rectified voltage through the capacitor 44. is smoothed to obtain a DC voltage Vc, which is applied to the chassis.
従ってこの水平発振回路35は完全に絶縁状態にしてお
く。Therefore, this horizontal oscillation circuit 35 is kept completely insulated.
上記Vcは交流電源電圧が正常値より低下しても常にV
i > Vc + Vbを満足するように設定する。The above Vc is always V even if the AC power supply voltage drops below the normal value.
Set so that i > Vc + Vb is satisfied.
トランス16の一次巻線と2次巻線の巻数比が1以上の
場合、即ち、2次巻線を巻き上げた場合、AC電源電圧
が低下するとVi < Vcとなる場合があるがVcの
電圧を選ぶことにより巻数比に関係なく常にVi>Vc
を満足させることができる。When the turns ratio between the primary winding and the secondary winding of the transformer 16 is 1 or more, that is, when the secondary winding is wound up, when the AC power supply voltage decreases, Vi < Vc may occur; By selecting Vi > Vc regardless of the turns ratio.
can be satisfied.
このように構或すると抵抗41の電圧降下はViとVc
十Vbの差だけでよ< 10〜15ボルトに設定する
ことができ、電力消費を1ワット以下にすることができ
る。With this configuration, the voltage drop across the resistor 41 is Vi and Vc.
With only a difference of 10 Vb, it can be set to <10-15 volts and the power consumption can be less than 1 watt.
また、第7図に示すように水平発振回路35のアース端
子に加えて電圧をフライバックトランス9の1次巻線1
1とアース間に挿入された直流阻止コンデンサ24から
取出してもよいものである。In addition, as shown in FIG.
It may also be taken out from the DC blocking capacitor 24 inserted between 1 and ground.
以上のように本考案は直流電源電圧を水平偏向回路に加
えるとともに、上記直流電源電圧を電圧降下用の抵抗を
介して水平発振回路の電源端子に加え、この水平発振回
路のアースを他のアースと絶縁するとともにこの水平発
振回路のアース端子に、上記水平偏向回路に得られる直
流電圧を印加したテレビジョン受像機であり、電圧降下
用抵抗の両端に加わる電圧を小さくすることができるの
で電圧降下用抵抗での消費電力は少なくてすむものであ
る。As described above, the present invention applies a DC power supply voltage to the horizontal deflection circuit, and also applies the DC power supply voltage to the power supply terminal of the horizontal oscillation circuit via a voltage drop resistor, and connects the ground of this horizontal oscillation circuit to another ground. This is a television receiver in which the DC voltage obtained in the horizontal deflection circuit is applied to the ground terminal of this horizontal oscillation circuit, and the voltage applied to both ends of the voltage drop resistor can be reduced, reducing the voltage drop. The power consumption of the resistor is small.
第1図、第2図は従来のテレビジョン受像機の一部分の
回路図、第3図は第1図と第2図の回路を組合せた従来
のテレビジョン受像機の一部分の回路図、第4図a,
l)は同回路説明のための波形図、第5図は従来のテ
レビジョン受像機の回路図、第6図は本考案の一実施例
におけるテレビジョン受像機の回路図、第7図は同他の
実施例におけるテレビジョン受像機の回路図である。
33・・・・・・整流平滑回路、41・・・・・・抵抗
、34・・・・・・水平偏向回路、35・・・・・・水
平発振回路、42・・・・・・巻線、43・・・・・・
ダイオード、44・・・・・・コンデンサ、24・・・
・・・コンデンサ。Figures 1 and 2 are circuit diagrams of a portion of a conventional television receiver, Figure 3 is a circuit diagram of a portion of a conventional television receiver that combines the circuits of Figures 1 and 2, and Figure 4 is a circuit diagram of a portion of a conventional television receiver. Figure a,
1) is a waveform diagram for explaining the circuit, FIG. 5 is a circuit diagram of a conventional television receiver, FIG. 6 is a circuit diagram of a television receiver according to an embodiment of the present invention, and FIG. 7 is a circuit diagram of a conventional television receiver. FIG. 7 is a circuit diagram of a television receiver in another embodiment. 33... Rectifier smoothing circuit, 41... Resistor, 34... Horizontal deflection circuit, 35... Horizontal oscillation circuit, 42... Vol. Line, 43...
Diode, 44... Capacitor, 24...
...Capacitor.
Claims (1)
電源電圧を電圧降下用の抵抗を介して水平発振回路の電
源端子に加え、この水平発振回路のアースを他のアース
と絶縁するとともにこの水平発振回路のアース端子に、
上記水平偏向回路に得られる直流電圧を印加したテレビ
ジョン受像機。A DC power supply voltage is applied to the horizontal deflection circuit, and the DC power supply voltage is applied to the power supply terminal of the horizontal oscillation circuit via a voltage drop resistor, and the ground of this horizontal oscillation circuit is insulated from other grounds, and this horizontal oscillation circuit to the ground terminal of
A television receiver in which the obtained DC voltage is applied to the horizontal deflection circuit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1975141377U JPS5910842Y2 (en) | 1975-10-16 | 1975-10-16 | television receiver |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1975141377U JPS5910842Y2 (en) | 1975-10-16 | 1975-10-16 | television receiver |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5255123U JPS5255123U (en) | 1977-04-21 |
JPS5910842Y2 true JPS5910842Y2 (en) | 1984-04-04 |
Family
ID=28621200
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1975141377U Expired JPS5910842Y2 (en) | 1975-10-16 | 1975-10-16 | television receiver |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5910842Y2 (en) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS56144900U (en) * | 1980-03-31 | 1981-10-31 |
-
1975
- 1975-10-16 JP JP1975141377U patent/JPS5910842Y2/en not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS5255123U (en) | 1977-04-21 |
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