JPS584963B2 - display device - Google Patents
display deviceInfo
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- JPS584963B2 JPS584963B2 JP52098274A JP9827477A JPS584963B2 JP S584963 B2 JPS584963 B2 JP S584963B2 JP 52098274 A JP52098274 A JP 52098274A JP 9827477 A JP9827477 A JP 9827477A JP S584963 B2 JPS584963 B2 JP S584963B2
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Description
【発明の詳細な説明】
この発明は、プラズマ表示器を用いてアナログ入力信号
の大きさを棒グラフ的に表示する表示装置に関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a display device that uses a plasma display to display the magnitude of an analog input signal in the form of a bar graph.
この種の表示装置に使用するプラズマ表示器はアノード
とカソードとを放電ガス中に密封し、両電極間に電圧を
加えればその間に放電を起してカソードが点灯すること
を利用するもので、表示器のフロントガラス内面に形成
した透明導電膜のアノードに対して表示器のバックシー
ト面に多数のカソードを表示目盛相当位置に対向配列し
、アノードにはアナログ信号レベルに比例した時間幅の
パルス電圧を加え、カソード群には最下位のカソードか
ら最上位のカソードまで時分割的にローレベル(低い電
圧)を加えることによって点灯するカソードの数をアノ
ード信号の時間幅に比例させ、アナログ入力信号の大き
さを棒グラフ的に表示するものである。The plasma display used in this type of display device uses an anode and a cathode sealed in a discharge gas, and when a voltage is applied between the two electrodes, a discharge is generated between the two electrodes and the cathode lights up. A large number of cathodes are arranged on the back sheet surface of the display device at positions corresponding to the display scale, facing each other to the anode of a transparent conductive film formed on the inner surface of the windshield of the display device, and a pulse with a time width proportional to the analog signal level is applied to the anode. The analog input signal The size of the image is displayed in a bar graph.
第3図はこのようなプラズマ表示器を備えた従来の表示
装置のブロック図である(Electronics、1
974年3月7日号、89頁〜93頁参照)。FIG. 3 is a block diagram of a conventional display device equipped with such a plasma display (Electronics, 1
(See March 7, 1974 issue, pages 89-93).
アナログ入力信号Eとランプ電圧発生器RAからの基準
ランプ電圧とをコンパレータCOMで比較することによ
り、入力信号Eの大きさに比例した時間幅の電圧パルス
を得て、この時間だけアノードドライバDAを介してプ
ラズマ表示器DPのアノード電圧を高くする。By comparing the analog input signal E and the reference lamp voltage from the lamp voltage generator RA using the comparator COM, a voltage pulse with a time width proportional to the magnitude of the input signal E is obtained, and the anode driver DA is activated for this period. The anode voltage of the plasma display DP is increased through the DP.
一方、クロック発生器CLKからのクロックを入力とす
る変換器Fはプラズマ表示器DPのカソードの数に応じ
てN相のクロック信号を得、この信号をカソードドライ
バDKを通してカソードを時分割的に駆動する。On the other hand, the converter F which receives the clock from the clock generator CLK obtains an N-phase clock signal according to the number of cathodes of the plasma display DP, and drives the cathodes in a time-divisional manner by passing this signal through the cathode driver DK. do.
これによりアナログ入力信号の大きさを棒グラフ的に表
示させる。This allows the magnitude of the analog input signal to be displayed in the form of a bar graph.
なお、カウンタCはクロックをカソードの数だけ計数す
ることで所定時間毎にスイッチ回路SWをトリガし、ス
イッチ回路SWはそのパルス出力でランプ電圧発生器R
Aを所定時間毎に駆動する。Note that the counter C triggers the switch circuit SW at predetermined time intervals by counting clocks by the number of cathodes, and the switch circuit SW uses the pulse output to trigger the lamp voltage generator R.
A is driven at predetermined time intervals.
このようなプラズマ表示器は、通常の指針式メータと同
様に入力量の概略値を直感的に認識できるアナログ表示
の特徴を持ち、さらにカソード数を増すことで指示精度
を上げうるデジタル表示の特徴を持つものである。This type of plasma display has the characteristic of an analog display that allows the approximate value of the input amount to be recognized intuitively, just like a normal pointer-type meter, and the characteristic of a digital display that can increase the accuracy of indication by increasing the number of cathodes. It is something that has.
しかし、指示精度を上げるために、カソードのピッチを
こまがくすると読み取りにくくなるし、同じピッチで表
示寸法を長くすると表示器が大型化し、プラズマ表示器
による高精度(例えば0.1%)指示は難しかった。However, if the pitch of the cathodes is made narrower in order to increase the accuracy of indication, it becomes difficult to read, and if the display size is made longer with the same pitch, the display becomes larger, and high accuracy (for example, 0.1%) indication by a plasma display becomes difficult. was difficult.
そこで、アナログ入力信号をデジタル値に変換しこのデ
ジタル値を数字表示器に表示させ、この数字表示器をプ
ラズマ表示器に並設するようにすることが考えられる。Therefore, it is conceivable to convert the analog input signal into a digital value, display this digital value on a numeric display, and arrange this numeric display in parallel with the plasma display.
第2図はこのような考えに基づいて構成された表示装置
の試作例の一例である。FIG. 2 shows an example of a prototype display device constructed based on this idea.
この表示装置においては、アナログ入力信号Eはアナロ
グ−デジタル変換器ADに与えられてデジタル値に変換
される。In this display device, an analog input signal E is applied to an analog-to-digital converter AD and converted into a digital value.
このアナログ−デジタル変換器ADの出力端子Dout
から得られるデジタル値はレジスタRに記憶される。The output terminal Dout of this analog-digital converter AD
The digital value obtained from is stored in register R.
このタイミングはアナログ−デジタル変換器ADの端子
Busyからの変換終了信号が使用される。For this timing, a conversion end signal from the terminal Busy of the analog-to-digital converter AD is used.
レジスタRの内容はデコーダDG1.DG2.DG3.
DG4に与えられ、このデコーダの出力信号は数字表示
体LDI、LD2.LD3.LD4に与えられる。The contents of register R are stored in decoder DG1. DG2. DG3.
DG4, and the output signal of this decoder is applied to numeric display units LDI, LD2 . LD3. Given to LD4.
デコーダと数字表示体とで数字表示器が構成される。The decoder and the number display constitute a number display.
一方、アナログ入力信号Eは、第1図と同様にコンパレ
ータCOMにも供給されてラング電圧発生器RAからの
基準ランプ電圧と比較され、アノードドライバDAを介
してプラズマ表示器DPに与えられる。On the other hand, the analog input signal E is also supplied to the comparator COM as in FIG. 1, compared with the reference lamp voltage from the rung voltage generator RA, and is applied to the plasma display DP via the anode driver DA.
このようにすることにより、第2図に示した表示装置に
おいては、棒グラフ表示および数字表示を行なうことが
できる。By doing so, the display device shown in FIG. 2 can display bar graphs and numbers.
しかしながら、この表示装置においては、棒グラフ表示
を行なうための回路構成と数字表示を行なうための回路
構成とが全く独立して設けられるために、表示装置の全
回路構成が複雑化すると共に部品点数が多く必要とされ
、製作上にも好ましくない。However, in this display device, the circuit configuration for displaying bar graphs and the circuit configuration for displaying numbers are provided completely independently, so the overall circuit configuration of the display device becomes complex and the number of parts increases. This is not preferable in terms of production since it requires a large number of steps.
本発明は、このような点に鑑みてなされ、全体の回路構
成を簡単化でき従って部品点数を少なくすることのでき
る表示装置を提供することを目的とする。The present invention has been made in view of these points, and an object of the present invention is to provide a display device whose overall circuit configuration can be simplified and the number of parts can be reduced.
本発明者等は第4図に示した試作例をさらに発展させる
べく種々の研究と実験を繰り返し行なった結果、アナロ
グ−デジタル変換器によって得られるデジタル値をプロ
グラムカウンタのプログラム値として与え、このプログ
ラムカウンタにてそのデジタル値に対応する時間幅のパ
ルス信号に変換し、アノードドライバを介してプラズマ
表示器のアノードに供給することによって、所期の目的
を達成し得ることを見出した。As a result of repeated various research and experiments in order to further develop the prototype example shown in Fig. 4, the inventors of the present invention gave the digital value obtained by the analog-to-digital converter as the program value of the program counter, and this program It has been found that the intended purpose can be achieved by converting the digital value into a pulse signal with a time width corresponding to the digital value using a counter and supplying the pulse signal to the anode of the plasma display via an anode driver.
すなわち、このようにすることによって、数字表示を行
なうための回路構成と棒グラフ表示を行なうための回路
構成とを一部共通化することができ、その結果、後述す
るように、本来棒グラフ表示を行なうために必要であっ
たランプ電圧発生器、このランプ電圧発生器を駆動する
ためのスイッチ回路および入力信号と基準ランプ電圧と
を比較するためのコンパレータを不要とすることができ
る。In other words, by doing this, it is possible to partially share the circuit configuration for displaying numbers and the circuit configuration for displaying bar graphs, and as a result, as will be described later, the circuit configuration for displaying numbers and bar graphs can be partially shared. It is possible to eliminate the need for a lamp voltage generator, a switch circuit for driving the lamp voltage generator, and a comparator for comparing the input signal with the reference lamp voltage, which were necessary for the above-mentioned operation.
次に本発明の一実施例を図面に基づいて詳細に説明する
。Next, one embodiment of the present invention will be described in detail based on the drawings.
第1図はこの発明の一実施例を示すブロック図である。FIG. 1 is a block diagram showing one embodiment of the present invention.
アナログ入力信号Eはアナログ−デジタル変換器ADに
加えてデジタル値に変換する。The analog input signal E is applied to an analog-to-digital converter AD for conversion into a digital value.
アナログ−デジタル変換器ADの出力端子Doutから
得られるデジタル値はレジスタRに記憶させる。The digital value obtained from the output terminal Dout of the analog-to-digital converter AD is stored in a register R.
このタイミングはアナログ−デジタル変換器ADの端子
Busyからの変換終了信号を使用する。This timing uses the conversion end signal from the terminal Busy of the analog-to-digital converter AD.
なお、レジスタRは通常のアナログ−デジタル変換器に
ラッチ回路として備えている。Note that the register R is provided as a latch circuit in an ordinary analog-to-digital converter.
プログラムカウンタPはレジスタRの内容をプログラム
値とし、クロックの計数でプログラム値に比例した時間
幅のパルスを得る。The program counter P uses the contents of the register R as a program value, and obtains a pulse having a time width proportional to the program value by counting clocks.
リセット用カウンタCRはアナログーテジタル変換器A
Dの変換終了信号を同期入力にし、クロックの所定数(
プラズマ表示器DPのカソード数N)計数毎にプログラ
ムカウンタPに計数動作を開始させる。Reset counter CR is analog-to-digital converter A
The conversion end signal of D is made into a synchronous input, and the predetermined number of clocks (
Each time the number of cathodes of the plasma display device DP (N) is counted, the program counter P is caused to start counting operation.
アノードドライバDAはプログラムカウンタPからのパ
ルス信号を電圧増幅してプラズマ表示器り、のアノード
に印加する。The anode driver DA amplifies the voltage of the pulse signal from the program counter P and applies it to the anode of the plasma display.
分周器Tはクロック発生器CLKのクロックパルスを分
周する。Frequency divider T divides the clock pulses of clock generator CLK.
選択スイッチSW1は分周器Tからの複数の分周出力又
はクロック発生器CLKのクロックから1つを選択した
クロックをリセット用カウンタCR及び変換器Fにその
クロックとして与える。The selection switch SW1 supplies a clock selected from a plurality of divided outputs from the frequency divider T or a clock from the clock generator CLK to the reset counter CR and the converter F as the clock.
変換器Fはプラズマ表示器DPのカソード数Nに応じて
N相のクロックに変換し、カソードドライバDKを通し
てカソード群にその点灯のために必要な電圧を順次与え
る。The converter F converts the clock into an N-phase clock according to the number N of cathodes of the plasma display DP, and sequentially applies voltages necessary for lighting the cathodes to the cathode group through the cathode driver DK.
数字表示体LD、〜LD4は総数で4桁の数字表示をし
、第2図に例示する如く、プラズマ表示器DPの近傍に
配置する。The number display bodies LD, to LD4 display a total of four digits, and are arranged near the plasma display DP as illustrated in FIG. 2.
デコーダDG、〜DG、は夫々数字表示体LD、〜LD
4との組合せで数字表示器を構成し、レジスタRの内容
を桁毎にデコードして数字表示体LD、〜LD4の駆動
に必要な信号を得る。Decoders DG and ~DG are number display units LD and ~LD, respectively.
4 constitutes a numeric display, and the contents of the register R are decoded digit by digit to obtain signals necessary for driving the numeric displays LD, -LD4.
例えば、数字表示体LD1〜LD4がセグメントタイプ
の発光ダイオード表示体のものであれば、レジスタRの
内容に応じた数字表示に必要なセグメント及び小数点表
示用ドツトを駆動する。For example, if the number displays LD1 to LD4 are segment type light emitting diode displays, the segments and decimal point display dots necessary for displaying numbers according to the contents of the register R are driven.
上記構成により、アナログ入力信号Eはアナログ−デジ
タル変換器ADにてデジタル値に変換しその変換終了で
レジスタRに記憶させる。With the above configuration, the analog input signal E is converted into a digital value by the analog-to-digital converter AD, and is stored in the register R upon completion of the conversion.
レジスタRの内容はデコーダDG1〜DG4を通して数
字表示体LD、〜LD4上にデジタル表示する。The contents of register R are digitally displayed on numerical displays LD, -LD4 through decoders DG1-DG4.
又、レジスタRの内容はプログラムカウンタPのプログ
ラム値になり、プログラムカウンタPにて対応する時間
幅のパルス信号に変換し、アノードドライバDAを通し
てプラズマ表示器DPのアノードを駆動する。Further, the contents of the register R become the program value of the program counter P, which converts it into a pulse signal with a corresponding time width, and drives the anode of the plasma display DP through the anode driver DA.
一方、分周器Tを通したプログラムカウンタPのクロッ
クパルス1/nクロツクを変換器Fに供給し、変換器F
からのN相のクロックでプラズマ表示器DPのカソード
を順次駆動する。On the other hand, the clock pulse 1/n clock of the program counter P passed through the frequency divider T is supplied to the converter F.
The cathodes of the plasma display device DP are sequentially driven by the N-phase clock from .
これにより、プラズマ表示器DPアナログ入力信号の大
きさに比例した棒グラフ表示をする。As a result, the plasma display DP displays a bar graph proportional to the magnitude of the analog input signal.
ここで、プラズマ表示器DPのアノードに加えるパルス
の時間幅に対して1/nのクロックを変換器Fのクロッ
クとすれば、プラズマ表示器DPで点灯するカソードの
数はデジタル表示値に対して1/nとなる。Here, if the clock of the converter F is 1/n of the time width of the pulse applied to the anode of the plasma display DP, then the number of cathodes lit on the plasma display DP will be relative to the digital display value. It becomes 1/n.
従って、変換器Fに与えるクロックパルスをスイッチS
W1で選択すれば、デジタル表示値に対するプラズマ表
示器の表示値を任意に変えることができる。Therefore, the clock pulse given to converter F is changed to switch S.
If W1 is selected, the displayed value on the plasma display can be arbitrarily changed relative to the digital displayed value.
この発明によれは、数字表示器によるデジタル表示と、
プラズマ表示器によるアナログ表示を同時にでき、プラ
ズマ表示器によるアナログ表示の下位桁分をデジタル表
示で読み取ることができる。According to the invention, a digital display using a numeric display;
The analog display can be displayed simultaneously on the plasma display, and the lower digits of the analog display on the plasma display can be read on the digital display.
また、構成としては従来のプラズマ表示器を用いた表示
装置に数字表示器を付加するのみの簡単な構成でできる
。Moreover, the structure can be made simply by adding a numeric display to a display device using a conventional plasma display.
そして、数字表示体をプラズマ表示体として表示器DP
と一体に構成すれば、付加する回路はデコーダのみにな
る。Then, a display device DP with the number display body as a plasma display body
If it is configured integrally with the decoder, the only circuit to be added is the decoder.
また、デジタル表示とアナログ表示のスケールファクタ
を任意に変えることができるので、プラズマ表示器にて
入力信号全体をアナログ表示し、アナログ表示では正確
に読み取りできない下位桁をデジタル表示することも可
能である。In addition, since the scale factor of the digital display and analog display can be changed arbitrarily, it is possible to display the entire input signal in analog on a plasma display, and also to display digitally the lower digits that cannot be read accurately with analog display. .
さらに、本発明によれは、数字表示するために設けられ
たレジスタRの内容がプログラムカウンタPのプログラ
ム値として与えられ、このプログラムカウンタPがクロ
ック発生器CLKから発生されたクロックを計数するこ
とによりそのプログラムに比例した時間幅のパルスを得
て、このパルスを棒グラフ表示するだめのプラズマ表示
器DPに供給するようにしたので、特にランプ電圧発生
器およびこれを駆動するためのスイッチ回路を不要とす
ることができる。Further, according to the present invention, the contents of the register R provided for displaying numbers are given as the program value of the program counter P, and the program counter P counts the clocks generated from the clock generator CLK. Since a pulse with a time width proportional to the program is obtained and this pulse is supplied to the plasma display DP that displays the bar graph, there is no need for a lamp voltage generator and a switch circuit to drive it. can do.
その結果、表示装置の全体回路を単純化することができ
、しかも部品点数を少なくすることができるという効果
が奏される。As a result, the overall circuit of the display device can be simplified and the number of parts can be reduced.
第1図はこの発明による表示装置の一実施例を示すブロ
ック図、第2図はこの発明における表示部の一実施例を
示す構成図、第3図は従来のこの種の表示装置のブロッ
ク図、第4図は第3図に示した表示装置に数字表示を行
なうための回路を組込んだ試作例のブロック図である。
AD:アナログ−デジタル変換器、R:レジスタ、Pニ
ブログラムカウンタ、CR:リセット用カウンタ、DG
、〜DG4:デコーダ、LD、〜LD4:数字表示体、
CLK:クロック発生器、T:分周器、SW、:スイッ
チ、F:変換器、DP:プラズマ表示器、DAニアノー
ドドライバ、DK:カソードドライバ。FIG. 1 is a block diagram showing an embodiment of a display device according to the present invention, FIG. 2 is a block diagram showing an embodiment of the display section in the present invention, and FIG. 3 is a block diagram of a conventional display device of this type. , FIG. 4 is a block diagram of a prototype example in which a circuit for displaying numbers is incorporated into the display device shown in FIG. 3. AD: Analog-to-digital converter, R: Register, P Niprogram counter, CR: Reset counter, DG
, ~DG4: Decoder, LD, ~LD4: Number display body,
CLK: clock generator, T: frequency divider, SW: switch, F: converter, DP: plasma display, DA near node driver, DK: cathode driver.
Claims (1)
置に配列し、アノードにはアナログ入力信号に比例した
時間幅のパルス電圧を加え、カソード群には下位のカソ
ードから上位のカソードまでその点灯のための電圧を順
次印加することでアナログ入力信号の大きさを棒グラフ
的に表示できるプラズマ表示器と、アナログ入力信号を
デジタル値に変換するアナログ−デジタル変換器と、上
記プラズマ表示器の近傍に配置され上記デジタル値を数
字表示する数字表示器と、上記デジタル値をプログラム
値としクロックの計数で上記プラズマ表示器のアノード
に加えるパルス電圧信号を得るプログラムカウンタと、
このプログラムカウンタの計数に同期したクロックを入
力とし上記プラズマ表示器のカソードに加える多相の信
号を得る変換器とを備えたことを特徴とする表示装置。 2、特許請求の範囲第1項記載の表示装置において、上
記プログラムカウンタに与えるクロックに対して上記変
換器に与えるクロックを分周する分周器を備えたことを
特徴とする表示装置。[Claims] 1. A large number of cathodes are arranged at positions corresponding to the display scale, and a pulse voltage with a time width proportional to the analog input signal is applied to the anode. A plasma display device that can display the magnitude of an analog input signal in a bar graph by sequentially applying a voltage for lighting up to the cathode, an analog-to-digital converter that converts the analog input signal into a digital value, and the plasma display device described above. a numeric display disposed near the plasma display device and displaying the digital value numerically; a program counter that uses the digital value as a program value and obtains a pulse voltage signal to be applied to the anode of the plasma display device by counting a clock;
A display device comprising: a converter that receives a clock synchronized with the count of the program counter and obtains a multiphase signal to be applied to the cathode of the plasma display device. 2. The display device according to claim 1, further comprising a frequency divider that divides the clock applied to the converter with respect to the clock applied to the program counter.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP52098274A JPS584963B2 (en) | 1977-08-18 | 1977-08-18 | display device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP52098274A JPS584963B2 (en) | 1977-08-18 | 1977-08-18 | display device |
Publications (2)
Publication Number | Publication Date |
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JPS5433055A JPS5433055A (en) | 1979-03-10 |
JPS584963B2 true JPS584963B2 (en) | 1983-01-28 |
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ID=14215351
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP52098274A Expired JPS584963B2 (en) | 1977-08-18 | 1977-08-18 | display device |
Country Status (1)
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JP (1) | JPS584963B2 (en) |
Families Citing this family (3)
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JPS551076A (en) * | 1979-03-19 | 1980-01-07 | Ngk Insulators Ltd | Positive characteristic porcelain for heater |
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Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5220848U (en) * | 1975-08-01 | 1977-02-15 |
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- 1977-08-18 JP JP52098274A patent/JPS584963B2/en not_active Expired
Also Published As
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