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JPH0773273B2 - 集合変復調装置制御回路 - Google Patents

集合変復調装置制御回路

Info

Publication number
JPH0773273B2
JPH0773273B2 JP1339700A JP33970089A JPH0773273B2 JP H0773273 B2 JPH0773273 B2 JP H0773273B2 JP 1339700 A JP1339700 A JP 1339700A JP 33970089 A JP33970089 A JP 33970089A JP H0773273 B2 JPH0773273 B2 JP H0773273B2
Authority
JP
Japan
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control unit
sub
level
notification line
control
Prior art date
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Application number
JP1339700A
Other languages
English (en)
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JPH03198447A (ja
Inventor
一成 新井
達哉 坂本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP1339700A priority Critical patent/JPH0773273B2/ja
Priority to US07/633,377 priority patent/US5157658A/en
Publication of JPH03198447A publication Critical patent/JPH03198447A/ja
Publication of JPH0773273B2 publication Critical patent/JPH0773273B2/ja
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Expired - Fee Related legal-status Critical Current

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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04M—TELEPHONIC COMMUNICATION
    • H04M11/00—Telephonic communication systems specially adapted for combination with other electrical systems
    • H04M11/06—Simultaneous speech and data transmission, e.g. telegraphic transmission over the same conductors

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Small-Scale Networks (AREA)
  • Data Exchanges In Wide-Area Networks (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は集合変復調装置制御回路に関する。
〔従来の技術〕
第２図は従来の集合変復調装置制御回路の一例を示すブ
ロック図である。第２図において、副制御部25はすべに
実装されている副制御部24に加えて新たに実装されたも
のとする。従来、主制御部21が各々の副制御部の実装の
状態を認識する方法としては、制御用シリアルバス（下
り信号線）22を用いて所定時間ごとに集合変復調装置と
して実装可能の副制御部の最大数分だけ順次アドレスを
変更してポーリングを行なう。各副制御部は各々アドレ
スを割り付けられており、自分のアドレスによるポーリ
ングを受けると、制御用シリアルバス（上り信号線）23
を用いて応答を行なう。主制御部21は、すでに実装され
ている副制御部24からの応答に加え新たに副制御部25か
ら応答を受けとり、これにより主制御部21は副制御部25
が新たに実装されたことを認識する。
〔発明が解決しようとする課題〕
上述した従来の集合変復調装置制御回路では、所定時間
ごとに実装可能な副制御部の最大数分だけのポーリング
を行ないそのつど応答を待つので、実装可能な副制御部
の最大数が大きければ大きいほど、装置として副制御部
の実装の管理のためだけに制御時間がかかってしまうと
いう欠点がある。
〔課題を解決するための手段〕
本発明の集合変復調装置制御回路は、変復調装置が接続
されポーリング用の制御バスに接続する複数の副制御部
と前記制御バスに接続し前記副制御部を制御する主制御
部とを有する集合変復調装置において、前記主制御部
と、前記副制御部とを結ぶ実装通知線と、前記副制御部
内にあって前記副制御部に新たに前記制御バスに接続さ
れたときに前記実装通知線の論理レベルを変えるレベル
制御部と、前記主制御部内にあって前記実装通知線の論
理レベルを検出するレベル検出部とを有する。
また、前記主制御部と、前記副制御部とを結ぶ実装通知
線と、前記副制御部内にあって前記副制御部が新たに前
記制御バスに接続された後、前記主制御部からの特定の
ポーリング信号を受信した場合に前記実装通知線の論理
レベルを変えるレベル制御部と、前記主制御部内にあっ
て前記実装通知線の論理レベルを検出するレベル検出部
とを有している。
〔実施例〕
次に、本発明について図面を参照して説明する。
第１図は本発明の第１と第２の実施例を示すブロック図
である。
第１図は、変復調装置が接続されポーリング用の制御バ
ス2,3に接続する複数の副制御部５と、制御バス2,3に接
続し副制御部５を制御する主制御部１と主制御部１と副
制御部５とを結ぶ実装通知線４と、変復調装置が接続さ
れる副制御部６内にあって実装通知線４の論理レベルを
変えるレベル制御部７と、主制御部１内にあって実装通
知線４からの論理レベルを検出するレベル検出部８と有
して構成される。
次に動作について説明する。第１図において、すでに実
装されている副制御部又は変復調装置５により実装通知
線４は、通常論理レベルの“H"（または“L"）に固定さ
れている。例えばここでは“H"レベルとする。ここに新
たに副制御部又は変復調装置６が実装されたものとす
る。
本発明の第１の実施例において、副制御部又は変復調装
置６のレベル制御部７は実装通知線４が通常の論理レベ
ルとは逆特性、この例でいえば“L"レベルになるように
制御する。主制御部１はレベル検出部８でこのレベル変
化を検出すると、制御用シリアルバス（下り信号線）２
を用いて、実装可能な副制御部又は変復調装置の最大数
分だけ、アドレスを順次変更してポーリングを行なう。
各副制御部又は変復調装置は自分のアドレスによるポー
リングを受けると、制御用シリアルバス（上り信号線）
３を用いて応答を行なう。主制御部１は、すでに実装さ
れている副制御部又は変復調装置５からの応答に加え、
新たに副制御部又は変復調装置６から応答を受けとり、
これにより主制御部１は副制御部又は変復調装置６が新
たに実装されたことを認識する。
本発明の第２の実施例において、主制御部１はある一定
時間ごとに、実装可能な全副制御部又は全変復調装置を
同時指定するアドレス（グローバルアドレス）よるポー
リングを行なう。これに対して新たに実装された副制御
部又は変復調装置６は、レベル制御部７を用いて実装通
知線４が通常の論理レベルとは逆特性、この例では“L"
レベルになるように制御する。又すでに実装されている
副制御部又は変復調装置５は何もしない。これによりレ
ベル検出部８によって主制御部１は新たに何れかの副制
御部又は変復調装置が実装されたことを知る。主制御部
１は、副制御部又は変復調装置を特定するために第１の
実施例と同様に実装可能な副制御部又は変復調装置の最
大数分だけアドレスを変更してポーリングを行なう。以
下第１の実施例と同じ手順により主制御部１は副制御部
又は変復調装置６が新たに実装されたことを認識する。
〔発明の効果〕
以上説明したように本発明は、新たに実装した副制御部
により論理レベルを制御される実装通知線とその実装通
知線の論理レベルを制御する回路を副制御部内に設け、
実装通知線の論理レベルを検出する回路を主制御部内に
設けたことにより、所定時間ごとに制御用シリアルバス
を用いて副制御部が実装可能な最大数分だけポーリング
を行ない応答を持つ必要がなくなり、装置として副制御
部の実装の管理のための時間を短縮できる効果がある。
【図面の簡単な説明】
第１図は、本発明の第１と第２の実施例のブロック図、
第２図は従来の集合編復調装置制御回路のブロック図で
ある。 １……主制御部、２……制御用シリアルバス（下り信号
線）、３……制御用シリアルバス（上り信号線）、5,6
……副制御部又は変復調装置、７……レベル制御部、８
……レベル検出部。

Claims (2)

    【特許請求の範囲】
  1. 【請求項１】変復調装置が接続されポーリング用の制御
    バスに接続する複数の副制御部と前記制御バスに接続し
    前記副制御部を制御する主制御部とを有する集合変復調
    装置において、前記主制御部と前記副制御部とを結ぶ実
    装通知線と、前記副制御部内にあって前記副制御部が新
    たに前記制御バスに接続されたときに前記実装通知線の
    論理レベルを変えるレベル制御部と、前記主制御部内に
    あって前記実装通知線の論理レベルを検出するレベル検
    出部とを有することを特徴とする集合変復調装置制御回
    路。
  2. 【請求項２】変復調装置が接続されポーリング用の制御
    バスに接続する複数の副制御部と前記制御バスに接続し
    前記副制御部を制御する主制御部とを有する集合変復調
    装置において、前記主制御部と前記副制御部とを結ぶ実
    装通知線と、前記副制御部内にあって前記副制御部が新
    たに前記制御バスに接続された後、前記主制御部からの
    特定のポーリング信号を受信した場合に前記実装通知線
    の論理レベルを変えるレベル制御部と、前記主制御部内
    にあって前記実装通知線の論理レベルを検出するレベル
    検出部とを有することを特徴とする集合変復調装置制御
    回路。
JP1339700A 1989-12-26 1989-12-26 集合変復調装置制御回路 Expired - Fee Related JPH0773273B2 (ja)

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JPH03198447A JPH03198447A (ja) 1991-08-29
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JPH03198447A (ja) 1991-08-29

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