JPH0758959B2 - Frame sync detector - Google Patents
Frame sync detectorInfo
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- JPH0758959B2 JPH0758959B2 JP61041774A JP4177486A JPH0758959B2 JP H0758959 B2 JPH0758959 B2 JP H0758959B2 JP 61041774 A JP61041774 A JP 61041774A JP 4177486 A JP4177486 A JP 4177486A JP H0758959 B2 JPH0758959 B2 JP H0758959B2
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- JP
- Japan
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- frame
- signal
- frame pattern
- bits
- mode
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- Time-Division Multiplex Systems (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は音声のデイジタル伝送におけるフレーム同期方
式に関するものである。TECHNICAL FIELD The present invention relates to a frame synchronization system in digital transmission of voice.
一般的にこの種のシステムにおけるフレーム同期方式
は、各フレームの先頭に一定のビツト数のフレームパル
ス（以後フレームパターンと呼ぶ）を挿入して送信し、
受信側では、このフレームパターンの位置を検出するこ
とにより、同期をとつている。In general, the frame synchronization method in this type of system inserts a fixed number of frame pulses (hereinafter referred to as a frame pattern) at the beginning of each frame and transmits the frame pulse.
The receiving side establishes synchronization by detecting the position of this frame pattern.
なお、この種の装置に関するものとして、日本特許、特
開昭57−30436,同57−162553等が挙げられる。Note that Japanese patents, JP-A-57-30436, and JP-A-57-162553 are examples of this type of device.
上記従来技術は、本質的に同期引込みに要する時間を短
縮しようとすると、フレームパターンのビツト数を増加
しフレーム内のビツト数が規定されているときは、その
分だけ本来の音声などの信号のためのビツト数を減少し
なければならず、音質の劣化を招くと言う問題を有す
る。The above-mentioned conventional technique essentially increases the number of bits of the frame pattern in order to reduce the time required for the synchronization pull-in, and when the number of bits in the frame is regulated, the signal of the original voice or the like is reduced accordingly. However, there is a problem that the sound quality is deteriorated.
本発明の目的は、上記問題点の改善、即ち音質の劣化を
招くことなく、同期引込み時間の短縮を計る。或は、同
期引込み時間の増加なしに、音質改善を計ることであ
る。An object of the present invention is to improve the above-mentioned problems, that is, to reduce the synchronization pull-in time without deteriorating the sound quality. Alternatively, it is to improve the sound quality without increasing the synchronization pull-in time.
次に、上記目的達成の手段を、第２図を用いて説明す
る。同図は、一般的フレーム同期方式における各種モー
ドの時間配列を示すものであり２はハンチングモードで
フレームパターンを検出する期間、３は後方保護モード
で、検出したフレームパターンが本物かどうかを確認す
る期間、４は引込みモードで同期がとれている期間、５
は前方保護モードでフレームパターンに何らかの誤りが
生じた場合、外部からの１時的妨害によるものか、継続
的同期はずれによるものかを判断する期間である。一般
に上記モード中正常な信号を受信出来る期間は、引込み
モード４及び前方保護モード５の期間であり、ハンチン
グモード２、後方保護モード３の期間は正常な信号の受
信が不可能である（以後前者を信号再生期間、後者を信
号非再生期間と呼ぶ）。ここで、同期引込みまでに要す
る時間を短縮するには、上記ハンチングモード２及び後
方保護モード３の期間を短縮すれば良いことが明らかで
あるが、一般にハンチングモード２の期間は、フレーム
パターンのビツト数によらず最大１フレーム期間を要し
一定であるのに対して、後方保護モード３の期間は、式
（１）に示される関係にある。ここでＭは後方保護モー
ド３に対応するフレーム段数、ｒはフレームパターンの
ビツト数、Pnは誤同期危険率、N0は１フレーム中の r:フレームパターンのビツト数 Pn:誤同期危険率 N0:フレーム長（ビツト数） M:後方保護モードのフレーム段数 総ビツト数を示す。式（１）からフレームパターンビツ
ト数ｒが１より十分大きい所では、後方保護モードのフ
レーム段数Ｍは前者に反比例することが確認されてい
る。したがつて前述の様に、後方保護モード３の短縮を
計るためにはフレームパターンのビツト数ｒを増加すれ
ば良いことが明らかである。本発明はこの点に着目し、
前記信号非再生期間は、フレームパターンのビツト数を
信号再生期間のそれよりも増加させることにより目的を
達成するものである。Next, the means for achieving the above object will be described with reference to FIG. This figure shows the time sequence of various modes in the general frame synchronization method. 2 is a period during which a frame pattern is detected in the hunting mode, 3 is a backward protection mode, and it is confirmed whether the detected frame pattern is genuine or not. Period 4 is a period during which synchronization is achieved in the pull-in mode, 5
Is a period in which, when some error occurs in the frame pattern in the forward protection mode, it is determined whether it is due to temporary external disturbance or due to continuous loss of synchronization. Generally, the period during which the normal signal can be received is the period of the pull-in mode 4 and the front protection mode 5, and the normal signal cannot be received during the hunting mode 2 and the rear protection mode 3 (hereinafter, the former Is called a signal reproduction period, and the latter is called a signal non-reproduction period). Here, it is clear that in order to shorten the time required for the synchronization pull-in, the periods of the hunting mode 2 and the rear protection mode 3 may be shortened. The maximum one frame period is required regardless of the number and is constant, whereas the period of the backward protection mode 3 has the relationship shown in the equation (1). Here, M is the number of frame stages corresponding to the backward protection mode 3, r is the number of bits of the frame pattern, P n is the false synchronization risk rate, and N 0 is one frame. r: Number of bits of frame pattern P n : Risk of incorrect synchronization N 0 : Frame length (number of bits) M: Number of frame steps in backward protection mode Indicates the total number of bits. From the equation (1), it has been confirmed that when the number of frame pattern bits r is sufficiently larger than 1, the number of frame steps M in the backward protection mode is inversely proportional to the former. Therefore, as described above, it is clear that in order to shorten the backward protection mode 3, it is sufficient to increase the bit number r of the frame pattern. The present invention focuses on this point,
The signal non-reproduction period achieves the object by increasing the number of bits of the frame pattern more than that of the signal reproduction period.
上記フレームパターンのビツト数切換による２種類の受
信データの様子を第１図により説明する。The state of two types of received data by switching the number of bits of the frame pattern will be described with reference to FIG.
同図に於て、前記信号再生期間に対応するデータ６は、
１フレーム期間７の先頭にフレームパターン８があり、
その後に信号９がある。同様に信号非再生期間に対応す
るデータ10に於ては、上記信号再生期間に対応するフレ
ームパターン８よりもビツト数の多いフレームパターン
12があり、その分だけビツト数が少ない信号13がある。
以上のごとく、正常な信号受信期間はフレームパターン
のビツト数を少なくし、音声信号のビツト数を多くして
良好な音質を維持し、同期はずれによる正常な信号受信
が不可能な期間は、フレームパターンのビツト数を多く
して、同期引込みまでに要する時間を短縮するものであ
る。In the figure, the data 6 corresponding to the signal reproduction period is
There is a frame pattern 8 at the beginning of one frame period 7,
After that there is a signal 9. Similarly, in the data 10 corresponding to the signal non-reproduction period, a frame pattern having a larger number of bits than the frame pattern 8 corresponding to the signal reproduction period.
There are 12 signals, and there are 13 signals with a correspondingly smaller number of bits.
As described above, the number of bits of the frame pattern is reduced during the normal signal reception period, the number of bits of the voice signal is increased to maintain good sound quality, and the period during which normal signal reception is not possible due to synchronization loss is The number of bits of the pattern is increased to shorten the time required for synchronization pull-in.
以下、本発明の一実施例を第３図により説明する。同図
は、シフトレジスタ回路16、フレームパルス除去回路1
7、パターン照合回路19、フレームパターン発生回路2
0、モードカウンタ回路21、制御回路22により構成され
ている。次に各部の動作を説明する。データ入力端子14
からフレームパルス及び音声信号を含むシリアルデータ
がシフトレジスタ回路16に入力され、データは８ビツト
のパラレルデータに変換されてパターン照合回路19に入
力される。一方、制御回路22の制御信号により、フレー
ムパターン発生回路20からは、その時の同期モードに対
応したフレームパターン（第１図８又は12）を発生し、
同様に８ビツトのパラレルデータの形でパターン照合回
路19に入力され、上記データのフレームパターンとの照
合が行なわれる。照合の結果はモードカウンタ回路21に
送られ、結果の内容に応じて、各同期モードが新しく決
定され、その情報は制御回路22に送られて、新しいモー
ドに対応した制御情報がフレームパターン発生回路20及
びフレームパターン除去回路17に出される。フレームパ
ターン除去回路17では必要な信号のデータのみ取出さ
れ、出力端子18に出力される。なお、制御部22の動作は
ソフトプログラムによりコントロールされるものであ
り、本発明の同期モードに対応したフレームパターンと
信号のビツト数の切換もこのソフトプログラムにより、
認意の選択が必要であるが、本実施例では、第１図に示
した、信号再生期間のフレームパルス８のビツト数は３
ビツトに、同じく信号非再生期間のフレームパルス12の
ビツト数は、８ビツトのマイコンの使用を前提に考えて
８ビツトとしている。この理由は８ビツトマイコンの場
合８ビツト単位でデータが転送されるため、８ビツトま
では処理時間が一定のためである。また、本実施例にお
ける効果を、信号のビツト数を一定とした場合の同期引
込み時間（後方保護モード３のフレーム段数）で比較し
てみると、式（１）より、最大フレーム数は従来方式
（フレームパターン:3ビツト一定の場合）が５に対し
て、本実施例は２であり、３フレーム分が短縮される。An embodiment of the present invention will be described below with reference to FIG. The figure shows a shift register circuit 16 and a frame pulse removal circuit 1.
7, pattern matching circuit 19, frame pattern generation circuit 2
0, a mode counter circuit 21, and a control circuit 22. Next, the operation of each part will be described. Data input terminal 14
The serial data including the frame pulse and the audio signal is input to the shift register circuit 16, the data is converted to 8-bit parallel data and input to the pattern matching circuit 19. On the other hand, by the control signal of the control circuit 22, the frame pattern generation circuit 20 generates a frame pattern (FIG. 1 or 8 in FIG. 1) corresponding to the synchronous mode at that time,
Similarly, it is inputted to the pattern matching circuit 19 in the form of 8-bit parallel data, and the data is matched with the frame pattern. The result of the collation is sent to the mode counter circuit 21, each synchronization mode is newly determined according to the content of the result, the information is sent to the control circuit 22, and the control information corresponding to the new mode is sent to the frame pattern generation circuit. 20 and the frame pattern removing circuit 17. The frame pattern removing circuit 17 extracts only the data of the necessary signal and outputs it to the output terminal 18. The operation of the control unit 22 is controlled by a software program, and the switching of the number of bits of the frame pattern and the signal corresponding to the synchronization mode of the present invention is also controlled by this software program.
Although it is necessary to arbitrarily select, in the present embodiment, the number of bits of the frame pulse 8 in the signal reproduction period shown in FIG. 1 is three.
Similarly, the number of bits of the frame pulse 12 in the signal non-reproduction period is 8 bits in consideration of the use of an 8-bit microcomputer. This is because in the case of an 8-bit microcomputer, data is transferred in 8-bit units, and the processing time is constant up to 8 bits. Further, comparing the effect of this embodiment with the synchronization pull-in time (the number of frame stages in the backward protection mode 3) when the number of signal bits is constant, the maximum number of frames can be determined by the conventional method from the equation (1). In the present embodiment, the number of frames is 5 (when the frame pattern is fixed at 3 bits), but the number is 2 in this embodiment, and 3 frames are shortened.
以上のごとく、本発明によれば、信号再生期間は、信号
のビツト数を可能なかぎり多くして良好な音質を維持
し、信号非再生期間は、フレーム同期のためのフレーム
パターンのビツト数を増加して、同期引込み時間の短縮
を行なうことが出来る。As described above, according to the present invention, in the signal reproduction period, the number of bits of the signal is increased as much as possible to maintain good sound quality, and in the signal non-reproduction period, the number of bits of the frame pattern for frame synchronization is set. It is possible to increase the number of times to shorten the synchronization pull-in time.
第１図は、本発明の原理説明の信号構成を表わす図、第
２図は、フレーム同期における各種モードの配列を示す
図、第３図は、本発明の一実施例の機能ブロツク図であ
る。 ２……ハンチングモード、３……後方保護モード、４…
…引込みモード、５……前方保護モード、８……信号再
生期間のフレームパターン、12……信号非再生期間のフ
レームパターン。FIG. 1 is a diagram showing a signal configuration for explaining the principle of the present invention, FIG. 2 is a diagram showing an array of various modes in frame synchronization, and FIG. 3 is a functional block diagram of an embodiment of the present invention. . 2 ... Hunting mode, 3 ... Back protection mode, 4 ...
… Pull-in mode, 5 …… Front protection mode, 8 …… Frame pattern during signal playback period, 12… Frame pattern during signal non-playback period.
フロントページの続き (72)発明者 宮本 宜則 東京都国分寺市東恋ヶ窪１丁目280番地 株式会社日立製作所中央研究所内 (72)発明者 近藤 和弘 東京都国分寺市東恋ヶ窪１丁目280番地 株式会社日立製作所中央研究所内 (72)発明者 鈴木 俊郎 東京都国分寺市東恋ヶ窪１丁目280番地 株式会社日立製作所中央研究所内 (56)参考文献 特開 昭60−212049（ＪＰ，Ａ) 特開 昭54−12616（ＪＰ，Ａ)Front page continuation (72) Inventor Yoshinori Miyamoto 1-280 Higashi Koigakubo, Kokubunji, Tokyo Inside Central Research Laboratory, Hitachi, Ltd. (72) Inventor Kazuhiro Kondo 1-280 Higashi Koigakubo, Kokubunji, Tokyo Hitachi Central Research Co., Ltd. (72) Inventor Toshiro Suzuki 1-280, Higashi Koigakubo, Kokubunji, Tokyo Inside Central Research Laboratory, Hitachi, Ltd. (56) Reference JP-A-60-212049 (JP, A) JP-A-54-12616 (JP, A) )
Claims (1)
検出に関し、入力信号をパラレル信号に変換する手段
と、あらかじめフレームパタンを保持するフレームパタ
ン発生手段と、上記パラレル信号と上記フレームパタン
とを入力して、両者を照合して一致又は不一致の結果を
出力する照合手段と、上記結果に基づいて上記パラレル
信号に含まれるフレームパタンのビット数を指示するモ
ードを出力する手段と、上記モードに応じて、上記フレ
ームパタン発生手段を強制する制御手段を備え、上記制
御手段の制御信号に応じて上記入力信号から必要な信号
のみを出力する手段とを有することを特徴とするフレー
ム同期検出装置。1. Regarding frame synchronization detection in a digital transmission device, means for converting an input signal into a parallel signal, frame pattern generation means for holding a frame pattern in advance, said parallel signal and said frame pattern are inputted, Collating means for collating the two and outputting a result of coincidence or disagreement, means for outputting a mode for instructing the number of bits of the frame pattern included in the parallel signal based on the result, and a means for outputting the mode according to the mode. A frame synchronization detecting apparatus comprising: a control unit for forcing a frame pattern generation unit, and a unit for outputting only a necessary signal from the input signal in response to a control signal of the control unit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61041774A JPH0758959B2 (en) | 1986-02-28 | 1986-02-28 | Frame sync detector |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61041774A JPH0758959B2 (en) | 1986-02-28 | 1986-02-28 | Frame sync detector |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62200837A JPS62200837A (en) | 1987-09-04 |
| JPH0758959B2 true JPH0758959B2 (en) | 1995-06-21 |
Family
ID=12617723
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61041774A Expired - Lifetime JPH0758959B2 (en) | 1986-02-28 | 1986-02-28 | Frame sync detector |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0758959B2 (en) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5412616A (en) * | 1977-06-30 | 1979-01-30 | Fujitsu Ltd | Synchronizing circuit |
| JPS60212049A (en) * | 1984-04-06 | 1985-10-24 | Nec Corp | Frame synchronization system |
-
1986
- 1986-02-28 JP JP61041774A patent/JPH0758959B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62200837A (en) | 1987-09-04 |
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