JPH07327176A - Ｂｓチューナ - Google Patents
ＢｓチューナInfo
- Publication number
- JPH07327176A JPH07327176A JP6141254A JP14125494A JPH07327176A JP H07327176 A JPH07327176 A JP H07327176A JP 6141254 A JP6141254 A JP 6141254A JP 14125494 A JP14125494 A JP 14125494A JP H07327176 A JPH07327176 A JP H07327176A
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- JP
- Japan
- Prior art keywords
- tuner
- block
- section
- video
- circuit board
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】
【目的】 １枚の回路基板に映像処理部までを搭載した
ものであって、チュナー部と映像処理部Ｅとの間の相互
干渉がないＢＳチューナ構造を得るにある。 【構成】 回路基板３の表面を一側の外部接続端子５の
配列方向に隣り合ったチューナブロックＸと映像信号ブ
ロックＹに分け、受信電波の同調部Ｄ、復調部Ｆ、検波
部Ｋを前記チューナブロックＸに配置し、前記検波部Ｋ
で検波された映像信号の増幅処理を行う映像処理部Ｅを
前記映像信号ブロックＹに配置すると共に、前記外部接
続端子５側の信号ライン９及び同信号ライン９と反対側
のアースライン１０で前記検波部Ｋと前記映像処理部Ｅ
とを接続したＢＳチューナ。
ものであって、チュナー部と映像処理部Ｅとの間の相互
干渉がないＢＳチューナ構造を得るにある。 【構成】 回路基板３の表面を一側の外部接続端子５の
配列方向に隣り合ったチューナブロックＸと映像信号ブ
ロックＹに分け、受信電波の同調部Ｄ、復調部Ｆ、検波
部Ｋを前記チューナブロックＸに配置し、前記検波部Ｋ
で検波された映像信号の増幅処理を行う映像処理部Ｅを
前記映像信号ブロックＹに配置すると共に、前記外部接
続端子５側の信号ライン９及び同信号ライン９と反対側
のアースライン１０で前記検波部Ｋと前記映像処理部Ｅ
とを接続したＢＳチューナ。
Description
【０００１】
【産業上の利用分野】本発明はテレビジョンセットやビ
デオテープレコーダ等のＡＶ機器に用いるＢＳチューナ
に関する。
デオテープレコーダ等のＡＶ機器に用いるＢＳチューナ
に関する。
【０００２】
【従来の技術】周知のように、静止衛星電波を受信する
テレビジョンセットやビデオテープレコーダ等のＡＶ機
器においては、静止衛星電波を検波して映像信号と音声
信号に分離するＢＳチューナが用いられるが、従来のＢ
Ｓチューナは図４及び図５に示すような構造と回路構成
にされている。
テレビジョンセットやビデオテープレコーダ等のＡＶ機
器においては、静止衛星電波を検波して映像信号と音声
信号に分離するＢＳチューナが用いられるが、従来のＢ
Ｓチューナは図４及び図５に示すような構造と回路構成
にされている。
【０００３】即ち、図４に示すように、従来のＢＳチュ
ーナはＢＳアンテナ及びテレビジョンセット等のＡＶ機
器にそれぞれ接続される一対のコネクタ１Ａ，２Ａを備
えるもので、その回路基板３Ａの表面には、図５に示す
ように、チューナ回路を構成する同調部Ｄ、復調部Ｆ、
検波部Ｋが配置される。そして、同回路基板３Ａ全体は
シールドケース本体４ａ、前面カバー４ｂ、裏面カバー
４ｃからなるシールドケース４Ａ中に収容され、このシ
ールドケース４Ａにより同調部Ｄ、復調部Ｆ、検波部Ｋ
の相互間と外部磁界との電・磁気的な分離が図られる。
ーナはＢＳアンテナ及びテレビジョンセット等のＡＶ機
器にそれぞれ接続される一対のコネクタ１Ａ，２Ａを備
えるもので、その回路基板３Ａの表面には、図５に示す
ように、チューナ回路を構成する同調部Ｄ、復調部Ｆ、
検波部Ｋが配置される。そして、同回路基板３Ａ全体は
シールドケース本体４ａ、前面カバー４ｂ、裏面カバー
４ｃからなるシールドケース４Ａ中に収容され、このシ
ールドケース４Ａにより同調部Ｄ、復調部Ｆ、検波部Ｋ
の相互間と外部磁界との電・磁気的な分離が図られる。
【０００４】また、前記回路基板の一側には複数の外部
接続用端子５Ａが配列され、これらの外部接続用端子５
Ａを介してＡＶ機器の映像処理部Ｅ及び音声処理部Ｏに
映像信号及び音声信号が出力される。
接続用端子５Ａが配列され、これらの外部接続用端子５
Ａを介してＡＶ機器の映像処理部Ｅ及び音声処理部Ｏに
映像信号及び音声信号が出力される。
【０００５】
【発明が解決しようとする課題】ところで、前述したよ
うな構造のＢＳチューナにおいては、最近の新機能ＡＶ
機器の発展に伴って、従来では、ＡＶ機器の一部を構成
していた映像信号アンプ部を含む映像処理部Ｅをも、Ｂ
Ｓチューナの回路基板３Ａに搭載することが要請される
ことが多くなっているが、このような要求を満足させた
ＢＳチューナにあっては、１枚の回路基板３Ａに映像処
理部Ｅまでを搭載することになるので、微妙なチューナ
部と映像処理部Ｅとの間の相互干渉が起き易く、信頼性
の高いＢＳチューナを得ることが困難であった。また、
映像処理部Ｅまでを搭載したＢＳチューナを新たに設計
すると、比較的製造原価の高いシールドケース本体４
ａ、前面カバー４ｂ、裏面カバー４ｃの金型を改めて製
作しなければならず、製品原価が非常に割高なものとな
ってしまう問題がある。
うな構造のＢＳチューナにおいては、最近の新機能ＡＶ
機器の発展に伴って、従来では、ＡＶ機器の一部を構成
していた映像信号アンプ部を含む映像処理部Ｅをも、Ｂ
Ｓチューナの回路基板３Ａに搭載することが要請される
ことが多くなっているが、このような要求を満足させた
ＢＳチューナにあっては、１枚の回路基板３Ａに映像処
理部Ｅまでを搭載することになるので、微妙なチューナ
部と映像処理部Ｅとの間の相互干渉が起き易く、信頼性
の高いＢＳチューナを得ることが困難であった。また、
映像処理部Ｅまでを搭載したＢＳチューナを新たに設計
すると、比較的製造原価の高いシールドケース本体４
ａ、前面カバー４ｂ、裏面カバー４ｃの金型を改めて製
作しなければならず、製品原価が非常に割高なものとな
ってしまう問題がある。
【０００６】本発明の第１の目的は、前述したような従
来のＢＳチューナの問題に鑑み、１枚の回路基板に映像
処理部までを搭載したものであって、チュナー部と映像
処理部Ｅとの間の相互干渉がないＢＳチューナ構造を得
るにある。また、本発明の第２の目的は、前記第１の目
的を達成できるＢＳチューナであって、従来用いていた
シールドケースを併用できる映像処理部付ＢＳチューナ
を得るにある。
来のＢＳチューナの問題に鑑み、１枚の回路基板に映像
処理部までを搭載したものであって、チュナー部と映像
処理部Ｅとの間の相互干渉がないＢＳチューナ構造を得
るにある。また、本発明の第２の目的は、前記第１の目
的を達成できるＢＳチューナであって、従来用いていた
シールドケースを併用できる映像処理部付ＢＳチューナ
を得るにある。
【０００７】
【課題を解決するための手段】本発明によれば、前記第
１の目的は、回路基板の表面を一側の外部接続端子の配
列方向に隣り合ったチューナブロックと映像信号ブロッ
クに分け、受信電波の同調部、復調部、検波部を前記チ
ューナブロックに配置し、前記検波部で検波された映像
信号の増幅処理を行う映像処理部を前記映像信号ブロッ
クに配置すると共に、前記外部接続端子側の信号ライン
及び同信号ラインと反対側のアースラインで前記検波部
と前記映像処理部とを接続したＢＳチューナにより達成
される。また、前記第２の目的は、前記第１の目的を達
成できるＢＳチューナであって、前記回路基板のチュー
ナブロックと前記映像信号ブロックの境界部に形成され
たスロットと、同スロットにより区画された前記回路基
板のチューナブロック全体を包囲するシールドケースと
を備えるＢＳチューナにより達成される。
１の目的は、回路基板の表面を一側の外部接続端子の配
列方向に隣り合ったチューナブロックと映像信号ブロッ
クに分け、受信電波の同調部、復調部、検波部を前記チ
ューナブロックに配置し、前記検波部で検波された映像
信号の増幅処理を行う映像処理部を前記映像信号ブロッ
クに配置すると共に、前記外部接続端子側の信号ライン
及び同信号ラインと反対側のアースラインで前記検波部
と前記映像処理部とを接続したＢＳチューナにより達成
される。また、前記第２の目的は、前記第１の目的を達
成できるＢＳチューナであって、前記回路基板のチュー
ナブロックと前記映像信号ブロックの境界部に形成され
たスロットと、同スロットにより区画された前記回路基
板のチューナブロック全体を包囲するシールドケースと
を備えるＢＳチューナにより達成される。
【０００８】
【実施例】以下、図１から図３について本発明の実施例
の詳細を説明する。図１から理解されるように、本発明
のＢＳチューナは、ＢＳアンテナ及びテレビジョンセッ
ト等のＡＶ機器にそれぞれ接続される一対のコネクタ
１，２を備えるもので、その回路基板３の表面は、外部
接続端子５の整列方向に隣り合ったチューナブロックＸ
及び映像信号ブロックＹに分割される。即ち、図３に示
すように、回路基板３の表面には前記チューナブロック
Ｘと回路基板３を分離させる立て向きのスロット７が形
成され、前記チューナブロックＸにはＢＳアンテナから
の受信信号を入力される同調部Ｄ、同同調部Ｄで同調さ
れた周波数の受信波を処理可能な周波数に復調させる復
調部Ｆ、復調波から映像信号及び音声信号を取り出す検
波部Ｋが配置かつ搭載される。
の詳細を説明する。図１から理解されるように、本発明
のＢＳチューナは、ＢＳアンテナ及びテレビジョンセッ
ト等のＡＶ機器にそれぞれ接続される一対のコネクタ
１，２を備えるもので、その回路基板３の表面は、外部
接続端子５の整列方向に隣り合ったチューナブロックＸ
及び映像信号ブロックＹに分割される。即ち、図３に示
すように、回路基板３の表面には前記チューナブロック
Ｘと回路基板３を分離させる立て向きのスロット７が形
成され、前記チューナブロックＸにはＢＳアンテナから
の受信信号を入力される同調部Ｄ、同同調部Ｄで同調さ
れた周波数の受信波を処理可能な周波数に復調させる復
調部Ｆ、復調波から映像信号及び音声信号を取り出す検
波部Ｋが配置かつ搭載される。
【０００９】また、回路基板３の映像信号ブロックＹに
は、図示は省略するけれども、同期信号とビデオの分離
及び増幅を行うビデオアンプを含む映像処理部Ｅが配置
され、同映像処理部Ｅのビデオ出力は前記外部接続端子
５と同側に配列されたビデオ端子８に出力される。な
お、前記検波部Ｋで分離された音声出力は、前記外部接
続端子５の一部からＶ機器の音声処理部Ｏに出力される
ことになる。
は、図示は省略するけれども、同期信号とビデオの分離
及び増幅を行うビデオアンプを含む映像処理部Ｅが配置
され、同映像処理部Ｅのビデオ出力は前記外部接続端子
５と同側に配列されたビデオ端子８に出力される。な
お、前記検波部Ｋで分離された音声出力は、前記外部接
続端子５の一部からＶ機器の音声処理部Ｏに出力される
ことになる。
【００１０】図３から理解されるように、前記チューナ
ブロックＸと映像信号ブロックＹとの間は、前記外部接
続端子５及びビデオ端子８と同側に形成される信号ライ
ン９、及び、前記スロット７で信号ライン９から離間さ
れたアースライン１０で結合される。
ブロックＸと映像信号ブロックＹとの間は、前記外部接
続端子５及びビデオ端子８と同側に形成される信号ライ
ン９、及び、前記スロット７で信号ライン９から離間さ
れたアースライン１０で結合される。
【００１１】そして、図示実施例のＢＳチューナの回路
基板３の一部即ちチューナブロックＸは、従来と同一の
シールドケース４により包囲され、このシールドケース
４により微妙な同調部Ｄ、復調部Ｆ、検波部Ｋの完全な
シールドが行われる。つまり、矩形枠状に製作されるシ
ールドケース本体４ａには、前記回路基板３の信号ライ
ン対応部及びアースライン対応部を通過できる切り開き
１１が形成され、同シールドケース本体４ａの表面及び
裏面が、従来と同様の前面カバー４ｂ及び裏面カバー４
ｃで覆われる。なお、取り扱う周波数が比較的小さな映
像信号ブロックＹは、回路基板３の裏面に全体にアース
電極層（図示せず）を形成するだけで、外乱信号の入力
を防止できる。
基板３の一部即ちチューナブロックＸは、従来と同一の
シールドケース４により包囲され、このシールドケース
４により微妙な同調部Ｄ、復調部Ｆ、検波部Ｋの完全な
シールドが行われる。つまり、矩形枠状に製作されるシ
ールドケース本体４ａには、前記回路基板３の信号ライ
ン対応部及びアースライン対応部を通過できる切り開き
１１が形成され、同シールドケース本体４ａの表面及び
裏面が、従来と同様の前面カバー４ｂ及び裏面カバー４
ｃで覆われる。なお、取り扱う周波数が比較的小さな映
像信号ブロックＹは、回路基板３の裏面に全体にアース
電極層（図示せず）を形成するだけで、外乱信号の入力
を防止できる。
【００１２】図示実施例によるＢＳチューナは、以上の
ような構造であるから、回路基板３の表面に同調部Ｄ、
復調部Ｆ、検波部Ｋ、映像処理部Ｅを構成する電気部品
を搭載し、同回路基板３のチューナブロックＸをシール
ドケース４で覆うことにより完成できる。この完成状態
では、信号ライン９及びアースライン１０のみがシール
ドケース４外に引き出されるから、微妙なチューナブロ
ックＸ全体をシールドケース４で完全にシールドでき
る。また、回路基板３のチューナブロックＸは、従来の
ＢＳチューナの回路基板と等大等形状であるから、従来
のシールドケース本体４ａ、前面カバー４ｂ、裏面カバ
ー４ｃを流用できるため、仕様変更により高価な金型を
新たに製作する必要はなくなる。
ような構造であるから、回路基板３の表面に同調部Ｄ、
復調部Ｆ、検波部Ｋ、映像処理部Ｅを構成する電気部品
を搭載し、同回路基板３のチューナブロックＸをシール
ドケース４で覆うことにより完成できる。この完成状態
では、信号ライン９及びアースライン１０のみがシール
ドケース４外に引き出されるから、微妙なチューナブロ
ックＸ全体をシールドケース４で完全にシールドでき
る。また、回路基板３のチューナブロックＸは、従来の
ＢＳチューナの回路基板と等大等形状であるから、従来
のシールドケース本体４ａ、前面カバー４ｂ、裏面カバ
ー４ｃを流用できるため、仕様変更により高価な金型を
新たに製作する必要はなくなる。
【００１３】
【発明の効果】以上の説明から明らかなように、本発明
によれば、回路基板の外部接続端子側に信号ラインを、
反対側にアースラインを形成するため、微妙なチューナ
部と映像処理部との相互干渉を防止でき、従来のシール
ドケースを併用できるから、映像処理部までをも搭載し
たＢＳチューナの仕様変更に安価に対応できる効果があ
る。
によれば、回路基板の外部接続端子側に信号ラインを、
反対側にアースラインを形成するため、微妙なチューナ
部と映像処理部との相互干渉を防止でき、従来のシール
ドケースを併用できるから、映像処理部までをも搭載し
たＢＳチューナの仕様変更に安価に対応できる効果があ
る。
【図１】一部を切欠いて示す本発明のＢＳチューナの全
体斜視図である。
体斜視図である。
【図２】同ＢＳチューナのブロック線図である。
【図３】同ＢＳチューナに用いる回路基板の平面図であ
る。
る。
【図４】一部を切欠いて示す従来のＢＳチューナの全体
斜視図である。
斜視図である。
【図５】同ＢＳチューナのブロック線図である。
３ 回路基板 ４ シールドケース ５ 外部接続端子 ７ スロット ９ 信号ライン １０ アースライン Ｅ 映像処理部 Ｄ 同調部 Ｆ 復調部 Ｋ 検波部 Ｘ チューナブロック Ｙ 映像信号ブロック
Claims (2)
- 【請求項１】 回路基板の表面を一側の外部接続端子の
配列方向に隣り合ったチューナブロックと映像信号ブロ
ックに分け、受信電波の同調部、復調部、検波部を前記
チューナブロックに配置し、前記検波部で検波された映
像信号の増幅処理を行う映像処理部を前記映像信号ブロ
ックに配置すると共に、前記外部接続端子側の信号ライ
ン及び同信号ラインと反対側のアースラインで前記検波
部と前記映像処理部とを接続したことを特徴とするＢＳ
チューナ。 - 【請求項２】 前記回路基板のチューナブロックと前記
映像信号ブロックの境界部に形成されたスロットと、同
スロットにより区画された前記回路基板のチューナブロ
ック全体を包囲するシールドケースとを備えることを特
徴とする請求項１記載のＢＳチューナ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6141254A JPH07327176A (ja) | 1994-05-31 | 1994-05-31 | Ｂｓチューナ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6141254A JPH07327176A (ja) | 1994-05-31 | 1994-05-31 | Ｂｓチューナ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07327176A true JPH07327176A (ja) | 1995-12-12 |
Family
ID=15287648
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6141254A Pending JPH07327176A (ja) | 1994-05-31 | 1994-05-31 | Ｂｓチューナ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07327176A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7880817B2 (en) | 2005-08-24 | 2011-02-01 | Sharp Kabushiki Kaisha | Receiver apparatus for outputting digital video and audio signals and receiver system incorporating the receiver apparatus |
| US7907218B2 (en) | 2005-11-07 | 2011-03-15 | Sharp Kabushiki Kaisha | Receiver apparatus and receiver system |
| US7932957B2 (en) | 2005-09-09 | 2011-04-26 | Sharp Kabushiki Kaisha | Receiver apparatus and receiver system |
-
1994
- 1994-05-31 JP JP6141254A patent/JPH07327176A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7880817B2 (en) | 2005-08-24 | 2011-02-01 | Sharp Kabushiki Kaisha | Receiver apparatus for outputting digital video and audio signals and receiver system incorporating the receiver apparatus |
| US7932957B2 (en) | 2005-09-09 | 2011-04-26 | Sharp Kabushiki Kaisha | Receiver apparatus and receiver system |
| US7907218B2 (en) | 2005-11-07 | 2011-03-15 | Sharp Kabushiki Kaisha | Receiver apparatus and receiver system |
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