JPH0666745B2 - Frame synchronization method - Google Patents
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明はフレーム同期方式に関し，特にデジタル無線伝
送におけるマルチキャリア伝送のフレーム同期方式に関
する。The present invention relates to a frame synchronization system, and more particularly to a frame synchronization system for multicarrier transmission in digital wireless transmission.
従来，デジタル無線伝送回線の途中の中継区間をマルチ
キャリア伝送とする場合，次の２つの方式がある。一つ
はマルチキャリア伝送区間を他の通常伝送区間と分けて
１つの送受端局区間とする方式である。他方は通常伝送
区間の変調信号をさらに速度変換して，マルチキャリア
伝送区間独自のフレーム同期ビットを付加する方式であ
る。Conventionally, there are the following two methods when multicarrier transmission is performed in a relay section in the middle of a digital wireless transmission line. One is a method in which the multi-carrier transmission section is separated from other normal transmission sections to form one transmitting / receiving terminal station section. The other is a method in which the modulated signal in the normal transmission section is further subjected to speed conversion and a frame synchronization bit unique to the multicarrier transmission section is added.
その一例を第４図を参照して説明する。One example thereof will be described with reference to FIG.
この例ではマルチキャリア伝送区間のフレーム同期のた
めに，マルチキャリア伝送区間の送端でその区間のため
にフレーム同期ビットを付加するようにしている。ここ
で,1-2変換によりフレームフォーマットが変わってしま
うため，マルチキャリア伝送区間ではビット付加回路４
および５によりフレーム同期ビットの付加を行う。マル
チキャリア伝送区間受端のフレーム同期回路６および７
では，このマルチキャリア信号にさらに付加した伝送信
号D5,D6に対してフレーム同期が行われる。更に，ビッ
ト除去回路8,9によりビット付加回路4,5で付加されたフ
レーム同期ビットを除去して，マルチキャリア信号D9,D
10をマルチキャリア逆変換回路10へ出力する。In this example, for frame synchronization of the multi-carrier transmission section, a frame synchronization bit is added for the section at the sending end of the multi-carrier transmission section. Since the frame format changes due to the 1-2 conversion, the bit addition circuit 4 is used in the multi-carrier transmission section.
The frame synchronization bit is added by the steps 5 and 5. Frame synchronization circuits 6 and 7 at the receiving end of the multicarrier transmission section
Then, frame synchronization is performed on the transmission signals D5 and D6 added to this multicarrier signal. Furthermore, the frame removing bits added by the bit adding circuits 4 and 5 are removed by the bit removing circuits 8 and 9, and the multi-carrier signals D9 and D
10 is output to the multicarrier inverse conversion circuit 10.
従来のマルチキャリア伝送区間を１つの送受端局区間と
する場合，マルチキャリア伝送区間が回線切替区間とな
り，回線切替区間が不必要に増加し，より複雑なシステ
ムになるという欠点がある。When the conventional multi-carrier transmission section is used as one transmitting / receiving terminal station section, there is a drawback that the multi-carrier transmission section becomes a line switching section, the line switching section unnecessarily increases, and the system becomes more complicated.
また，通常区間の変調信号をさらに速度変換してフレー
ム同期ビットを付加する場合，速度変換により変調速度
が上り，マルチキャリ伝送の効果を下げるとともに，速
度変換等の回路を付加することにより，複雑な構成とな
ってしまう欠点がある。Further, in the case where the modulation signal in the normal section is further speed-converted and the frame synchronization bit is added, the modulation speed increases due to the speed conversion, the effect of the multi-carrier transmission is reduced, and the circuit for speed conversion is added to make it complicated. There is a drawback that it becomes a different configuration.
本発明の技術的課題は，通常区間の途中にマルチキャリ
ア伝送区間を入れても，回線切替区間を増加させること
なく，またマルチキャリア伝送区間独自のフレーム同期
ビットの付加を行うことなく，マルチキャリア区間のフ
レーム同期を行うことのできるフレーム同期方式を提供
することにある。A technical problem of the present invention is that even if a multi-carrier transmission section is inserted in the middle of a normal section, the multi-carrier transmission section is not increased and a frame synchronization bit unique to the multi-carrier transmission section is not added. An object is to provide a frame synchronization method capable of performing frame synchronization for a section.
本発明のフレーム同期方式は，送端に通常区間及びマル
チキャリア区間のフレーム同期をとるためのフレーム同
期ビットを付加するフレーム同期ビット付加回路を備
え，通常区間からマルチキャリア区間への中継部にフレ
ーム同期回路及び変調信号を分割して変調速度を下げる
マルチキャリア変換回路を備え，マルチキャリア区間か
ら通常区間への中継部にマルチキャリア区間用フレーム
同期回路及びマルチキャリア逆変換回路を備え，更に通
常ルートの受端にはフレーム同期回路及びフレーム同期
ビットの除去回路を備えて構成される。The frame synchronization system of the present invention includes a frame synchronization bit addition circuit for adding a frame synchronization bit for frame synchronization between a normal section and a multi-carrier section at a transmission end, and a frame is provided in a relay section from the normal section to the multi-carrier section. A synchronization circuit and a multi-carrier conversion circuit that divides the modulation signal to reduce the modulation speed are provided, and a multi-carrier section frame synchronization circuit and a multi-carrier inverse conversion circuit are provided in the relay section from the multi-carrier section to the normal section, and the normal route is further provided. The receiving end of is provided with a frame synchronization circuit and a frame synchronization bit removal circuit.
以下，実施例を示す図面を参照して本発明について詳細
に説明する。Hereinafter, the present invention will be described in detail with reference to the drawings illustrating embodiments.
第１図及び第２図は本発明のフレーム同期方式の一実施
例の示すフレームフォーマット図である。1 and 2 are frame format diagrams showing an embodiment of the frame synchronization system of the present invention.
第１図に示す実施例は４相PSKの通常区間のフレームフ
ォーマットであり,S1は付加ビット,1〜62はデータビッ
トをそれぞれ示す。データ１とデータ２は各データ列の
付加ビットのみを抜き出したものであり、Fa,Fbはフレ
ーム同期ビット,Ia,Ibはその他の付加ビットである。The embodiment shown in FIG. 1 is a frame format for a normal section of four-phase PSK, S1 indicates additional bits, and 1 to 62 indicate data bits. Data 1 and data 2 are obtained by extracting only the additional bits of each data string, Fa and Fb are frame synchronization bits, and Ia and Ib are other additional bits.
一方，第２図に示す実施例は通常区間の２系列のデータ
列をそれぞれ２データ列に変換したマルチキャリア変換
後のフレームフォーマットであり,S1及び１〜62は第１
図の通常区間フレームのビットと同一である。マルチキ
ャリアMC1のデータ１とデータ２は通常区間のデータ１
を1-2変換したもので，マルチキャリアMC2のデータ１と
データ２は通常区間のデータ２を1-2変換したものであ
り，両方とも付加ビットのみ抜き出したものである。On the other hand, the embodiment shown in FIG. 2 is a frame format after multicarrier conversion in which two series data strings in a normal section are each converted into two data strings, and S1 and 1 to 62 are the first.
It is the same as the bit of the normal section frame in the figure. Data 1 and data 2 of multi-carrier MC1 are data 1 of normal section
Is converted to 1-2, and data 1 and data 2 of the multi-carrier MC2 are 1-2 converted from data 2 in the normal section, and both are extracted only from additional bits.
通常区間でのフレーム同期は，第１図のフレーム同期ビ
ットFa,Fbをデータ1,データ２のスロットごとに監視す
る。また，マルチキャリア区間では，マルチキャリアMC
1,マルチキャリアMC2それぞれについて独立にフレーム
同期を行う。マルチキャリアMC1ではフレーム同期ビッ
トFaをデータ１の列のみ監視することにより，マルチキ
ャリアMC2ではクレーム同期ビットFbをデータ１の列の
み監視することによる。For frame synchronization in the normal section, the frame synchronization bits Fa and Fb in FIG. 1 are monitored for each slot of data 1 and data 2. In the multi-carrier section, multi-carrier MC
1, Frame synchronization is performed independently for each of the multi-carrier MC2. This is because the multi-carrier MC1 monitors the frame synchronization bit Fa only for the column of data 1, and the multi-carrier MC2 monitors the claim synchronization bit Fb for only the column of data 1.
このようにマルチキャリア変換によりフレームが変形し
た後も，通常区間の送端で付加したフレーム同期ビット
を用いてフレーム同期を行うことができる。Even after the frame is transformed by the multicarrier conversion in this way, the frame synchronization can be performed using the frame synchronization bit added at the sending end of the normal section.
本発明のフレーム同期方式を用いた一実施例を第３図に
示す。An embodiment using the frame synchronization system of the present invention is shown in FIG.
第３図のブロック図は通常伝送区間の間にマルチキャリ
ア伝送区間のある実施例である。この実施例では，伝送
信号C1を入力してフレーム同期ビット等がビット付加さ
れた伝送信号D1を出力するビット付加回路１と，ビット
付加された伝送信号D1を入力してフレーム同期を行うフ
レーム同期回路２と，ビット付加された伝送信号D2を入
力して1-2変換を行い，マルチキャリア信号D3,D4を出力
するマルチキャリア変換回路３と，マルチキャリア信号
D3またはD4を入力し，それぞれフレーム同期を行うフレ
ーム同期回路4,5と，マルチキャリア信号D5とD6を入力
して2-1変換し、ビット付加された伝送信号D1と同じビ
ット付加された伝送信号D7を出力するマルチキャリア逆
変換回路と，フレーム同期回路７と，フレーム同期回路
７の出力であるビット付加された伝送信号D8を入力し付
加ビットを除去し,C1と同じ伝送信号C2を出力するビッ
ト除去回転とを備えて構成されている。The block diagram of FIG. 3 shows an embodiment in which a multi-carrier transmission section is provided between normal transmission sections. In this embodiment, a bit addition circuit 1 that inputs a transmission signal C1 and outputs a transmission signal D1 to which a frame synchronization bit or the like is added, and a frame synchronization that inputs the transmission signal D1 to which a bit is added and performs frame synchronization Circuit 2 and multi-carrier conversion circuit 3 that inputs bit-added transmission signal D2, performs 1-2 conversion, and outputs multi-carrier signals D3 and D4, and multi-carrier signal
D3 or D4 is input, frame synchronization circuits 4,5 for frame synchronization, respectively, and multicarrier signals D5 and D6 are input, 2-1 conversion is performed, and bit added transmission signal D1 same bit added transmission The multi-carrier inverse conversion circuit that outputs the signal D7, the frame synchronization circuit 7, and the bit-added transmission signal D8 that is the output of the frame synchronization circuit 7 are input, the additional bits are removed, and the same transmission signal C2 as C1 is output. And bit removal rotation.
ビット付加回路１で付加されたフレーム同期ビットによ
り通常伝送区間受端のフレーム同期回路２でフレーム同
期が行われ，次のマルチキャリア伝送区間のためにマル
チキャリア変換回路３で２つのマルチキャリア信号D3,D
4に変換される。マルチキャリア伝送区間の受端のフレ
ーム同期回路4,5は第２図で示したフレームフォーマッ
トに従い，それぞれのマルチキャリア信号中のフレーム
同期ビットによりフレーム同期を行い，マルチキャリア
逆変換回路６へ信号を送る。マルチキャリア逆変換回路
ではマルチキャリア信号を2-1変換し再びD1と同じ信号
にもどす。フレーム同期回路７ではフレーム同期回路２
と同様にフレーム同期を行い，ビット除去回路８へ信号
を送る。最後にビット除去回路８ではビット付加回路１
で付加されたフレーム同期ビット等の付加ビットを除去
する。Frame synchronization is performed by the frame synchronization circuit 2 at the normal transmission section receiving end by the frame synchronization bit added by the bit addition circuit 1, and two multicarrier signals D3 are generated by the multicarrier conversion circuit 3 for the next multicarrier transmission section. , D
Converted to 4. The frame synchronization circuits 4 and 5 at the receiving end of the multicarrier transmission section perform frame synchronization according to the frame synchronization bit in each multicarrier signal according to the frame format shown in FIG. send. In the multi-carrier inverse conversion circuit, the multi-carrier signal is 2-1 converted and returned to the same signal as D1. In the frame synchronization circuit 7, the frame synchronization circuit 2
Similarly to the above, frame synchronization is performed and a signal is sent to the bit removing circuit 8. Finally, in the bit removing circuit 8, the bit adding circuit 1
The additional bits such as the frame synchronization bit added in step 1 are removed.
本発明の実施例にあげた第１図，第２図のフレームフォ
ーマットは４相PSK変調の場合であるが，これはさらに
データ列の多い多値直交振幅変調等でも適用可能であ
る。また，第３図で通常伝送区間をシングルキャリア，
マルチキャリア伝送区間を２マルチキャリアとしたが，
通常伝送区間を４マルチキャリア，マルチキャリア伝送
区間を８マルチキャリアなどとしてもよい。Although the frame formats shown in FIGS. 1 and 2 in the embodiment of the present invention are for 4-phase PSK modulation, this is also applicable to multi-level quadrature amplitude modulation with more data strings. Also, in FIG. 3, the normal transmission section is a single carrier,
The multi-carrier transmission section is 2 multi-carrier,
The normal transmission section may be 4 multicarriers and the multicarrier transmission section may be 8 multicarriers.
以上詳細に説明したように本発明のフレーム同期方式
は，通常伝送区間の送端で付加したフレーム同期ビット
により，マルチキャリア伝送区間の受端においても変化
したフレームフォーマットに対応したフレーム同期を行
うことにより，従来の２重にビット付加する方法のよう
に変調速度を上げることなく、また、マルチキャリア伝
送区間を送受端局区間とする必要もないため、非常に簡
単にシステムを構成できる効果がある。As described above in detail, in the frame synchronization method of the present invention, the frame synchronization bit added at the transmission end of the normal transmission section is used to perform frame synchronization corresponding to the changed frame format even at the reception end of the multicarrier transmission section. As a result, unlike the conventional method of adding bits to double, there is no need to increase the modulation speed and it is not necessary to set the multi-carrier transmission section as the transmission / reception terminal section. Therefore, there is an effect that the system can be configured very easily. .
第１図は通常伝送区間のフレームフォーマットの一実施
例，第２図はマルチキャリア伝送区間のフレームフォー
マットの一実施例であり，第３図は本発明のフレーム同
期方式を用いて構成した一実施例を示すブロック図，第
４図は従来のフレーム同期により構成した場合のブロッ
ク図である。 S1,S2……付加ビット、１〜62……DATAビット、Fa,Fb…
…フレーム同期ビット、Ia,Ib……その他の付加ビッ
ト。FIG. 1 shows an embodiment of a frame format of a normal transmission section, FIG. 2 shows an embodiment of a frame format of a multi-carrier transmission section, and FIG. 3 shows an embodiment constructed by using the frame synchronization system of the present invention. FIG. 4 is a block diagram showing an example, and FIG. 4 is a block diagram in the case of being configured by conventional frame synchronization. S1, S2 ... Additional bits, 1-62 ... DATA bits, Fa, Fb ...
… Frame sync bits, Ia, Ib… Other additional bits.
Claims (1)
調速度を下げるマルチキャリア伝送方式において，マル
チキャリア伝送区間でない送端で付加したフレーム同期
ビットをマルチキャリア伝送区間に対して一定の規則で
分配する手段と，分配されたそれぞれのフレーム同期ビ
ットによりマルチキャリア伝送区間の受端にてフレーム
同期を確立する手段と，フレーム同期後のデータ列をも
とのデータ列に変換する手段とを備えることを特徴とす
るフレーム同期方式。1. In a multi-carrier transmission system in which a modulation rate is reduced in a partial relay section of a digital wireless transmission line, a frame synchronization bit added at a sending end which is not the multi-carrier transmission section is fixed according to a fixed rule for the multi-carrier transmission section. It is provided with means for distributing, means for establishing frame synchronization at the receiving end of the multi-carrier transmission section by each distributed frame synchronization bit, and means for converting the data sequence after frame synchronization into the original data sequence. A frame synchronization method characterized in that
Priority Applications (1)
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| JP63083071A JPH0666745B2 (en) | 1988-04-06 | 1988-04-06 | Frame synchronization method |
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| JPH01256236A JPH01256236A (en) | 1989-10-12 |
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|---|---|
| JP (1) | JPH0666745B2 (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5627863A (en) * | 1994-07-15 | 1997-05-06 | Amati Communications Corporation | Frame synchronization in multicarrier transmission systems |
-
1988
- 1988-04-06 JP JP63083071A patent/JPH0666745B2/en not_active Expired - Fee Related
Also Published As
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|---|---|
| JPH01256236A (en) | 1989-10-12 |
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