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JPH0549254A - Switching power supply circuit - Google Patents

Switching power supply circuit

Info

Publication number
JPH0549254A
JPH0549254A JP21918191A JP21918191A JPH0549254A JP H0549254 A JPH0549254 A JP H0549254A JP 21918191 A JP21918191 A JP 21918191A JP 21918191 A JP21918191 A JP 21918191A JP H0549254 A JPH0549254 A JP H0549254A
Authority
JP
Japan
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inductance
voltage
power supply
delay
switching power
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JP21918191A
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Japanese (ja)
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JP2515640B2 (en
Inventor
Shigeru Kondo
茂 近藤
Hitoshi Yoshioka
均 吉岡
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Yutaka Electric Mfg Co Ltd
Original Assignee
Yutaka Electric Mfg Co Ltd
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Publication date
Application filed by Yutaka Electric Mfg Co Ltd filed Critical Yutaka Electric Mfg Co Ltd
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Abstract

PURPOSE:To suppress noise or deterioration of conversion efficiency due to non-zero-cross operation at the time of forward rectification of a voltage resonance converter, through simple circuitry, by a constitution wherein a reset circuit resets a delay inductance element every switching cycle. CONSTITUTION:A delay inductance(resonancer) 25 made of Co base amorphous magnetic alloy, for example, is connected between the output side of an inverter transformer 16 and a rectifying diode 22 in order to promote voltage resonance. A series circuit of a diode 26 and a resistor 27, i.e., a reset circuit, is connected between the output side of the delay inductance 25 and the inverter transformer 16. The reset circuit resets the inductance 25 every switching cycle and causes resonance operation positively. In other words, transition loss of the switching element 11 can be reduced using the secondary reverse voltage being induced in the inverter transformer 16 upon turn OFF of the switching element 11 which does not output power.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、電圧共振型コンバータ
で発生する非ゼロ・クロス動作の改善に関するものであ
る。さらに詳しくは、電圧共振型コンバータをフォワー
ド整流したときの非ゼロ・クロス動作による変換効率の
低下やノイズの発生を抑制するための遅延インダクタン
スのリセット回路を具備したスイッチング電源回路に関
するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to improvement of non-zero cross operation which occurs in a voltage resonant converter. More specifically, the present invention relates to a switching power supply circuit including a delay inductance reset circuit for suppressing conversion efficiency deterioration and noise generation due to non-zero cross operation when forward rectifying a voltage resonance converter.

【0002】[0002]

【従来の技術】スイッチング素子の電圧波形が矩形波モ
ードのスイッチング電源回路において、スイッチング素
子のターン・オンとターン・オフのスイッチング・ロス
(遷移損)は、スイッチング周波数の高周波化に対して
比例的に増加し、スイッチング電源の小型化を妨げるも
のである。これら遷移損を原理的に削減する方式とし
て、スイッチング素子の電圧と電流波形がゼロ・クロス
する共振型コンバータが提案され、実用化されている。
図5は、この電圧共振型コンバータの基本回路とスイッ
チング素子の動作を示し、20、21は入力端子、11
はMOSFETからなるスイッチング素子、12、13
はコンデンサ、14はスイッチング素子11のボディー
・ダイオード、15はVFM信号入力端子、16はイン
バータ・トランス、17、18は出力端子である。
2. Description of the Related Art In a switching power supply circuit in which the voltage waveform of a switching element is a rectangular wave mode, the switching loss (transition loss) between turn-on and turn-off of the switching element is proportional to the switching frequency. This is an obstacle to the miniaturization of switching power supplies. As a method of reducing these transition losses in principle, a resonant converter in which the voltage and current waveforms of switching elements cross zero has been proposed and put into practical use.
FIG. 5 shows the operation of the basic circuit and the switching element of this voltage resonance type converter.
Is a switching element composed of MOSFETs 12, 13
Is a capacitor, 14 is a body diode of the switching element 11, 15 is a VFM signal input terminal, 16 is an inverter transformer, and 17 and 18 are output terminals.

【0003】この図5に示す電圧共振型コンバータにお
いて、スイッチング素子11がオフのときの電圧波形
は、図6に示すように、共振容量Crと共振インダクタ
ンスLrによって正弦波状になり、オフ時間Toffは
入力電圧Vinにおいては共振周波数f0で固定され
る。このため共振インダクタンスLrにインバータ・ト
ランス16のリーケージ・インダクタンスを利用して、
フライバック整流方式でコンデンサ・インプット型の平
滑回路とした出力回路とするのが合理的である。しか
し、フライバック整流方式では、コンデンサのリップル
電流が多くなることや、出力のリップル電圧が多くなる
ため、図7のように、あえてフォワード整流方式でチョ
ーク・インプット型の平滑回路とした出力回路を用いて
いる。
In the voltage resonance type converter shown in FIG. 5, the voltage waveform when the switching element 11 is off becomes sinusoidal due to the resonance capacitance Cr and the resonance inductance Lr as shown in FIG. 6, and the off time Toff is reduced. The input voltage Vin is fixed at the resonance frequency f 0 . Therefore, the leakage inductance of the inverter transformer 16 is used as the resonance inductance Lr,
It is rational to use an output circuit that is a capacitor input type smoothing circuit using the flyback rectification method. However, in the flyback rectification method, the ripple current of the capacitor increases and the ripple voltage of the output increases, so as shown in FIG. I am using.

【0004】図7のフォワード整流方式において、スイ
ッチング素子11の電圧共振は、入力電圧Vinを中心
に共振するため、スイッチング素子11のオフ時のフラ
イバック電圧が入力電圧以下に低下すると出力側に電力
供給する。このため電圧共振型コンバータからみた出力
インピーダンスが低下し、図8のようにスイッチング素
子11のオン直前にスイッチング素子11の電圧波形が
正弦波モードから矩形波モードになり、スイッチング素
子11の電流は正から流れ出してゼロ・クロス・オンと
はならない。このため、遷移損が発生し、変換効率の低
下とノイズの増加によりスイッチング電源の信頼性を著
しく低下している。この場合のターン・オン時のスイッ
チング・ロス(遷移損)は以下の式で算出される。 ターン・オン・ロス=1/2・C・V2・f 〔W〕 但し、C=共振コンデンサの容量 V=オン直前のスイッチング素子11の電圧 f=スイッチング周波数である。
In the forward rectification method of FIG. 7, the voltage resonance of the switching element 11 resonates around the input voltage Vin, so that when the flyback voltage when the switching element 11 is off falls below the input voltage, power is output to the output side. Supply. Therefore, the output impedance seen from the voltage resonance type converter is lowered, and the voltage waveform of the switching element 11 is changed from the sine wave mode to the rectangular wave mode immediately before the switching element 11 is turned on as shown in FIG. 8, and the current of the switching element 11 is positive. It doesn't flow out from the zero cross on. For this reason, transition loss occurs, and the reliability of the switching power supply is significantly reduced due to the reduction of conversion efficiency and the increase of noise. In this case, the switching loss (transition loss) at turn-on is calculated by the following formula. Turn-on loss = 1/2 · C · V 2 · f [W] where C = capacitance of the resonance capacitor V = voltage of the switching element 11 immediately before turning on f = switching frequency.

【0005】そこで、電圧共振型コンバータにおいて、
フォワード整流した場合の非ゼロ・クロス・オンを避け
るため、図9のようにインバータ・トランス16の出力
と整流ダイオード22の間に遅延インダクタンス(レゾ
ナンサー)25を直列に挿入した回路が知られている
(例えば、特開平3−135367号公報)。このとき
のインバータ・トランス16の他方の出力端子と遅延イ
ンダクタンス25との間の電圧Vlsと、スイッチング
素子11の電流Iq1と、スイッチング素子11間の電
圧Vq1は、図10に示され、出力インピーダンスの低
下を遅延させることによってフォワード整流時の電圧共
振動作を継続させ、ゼロ・クロス・オンを達成してい
る。
Therefore, in the voltage resonance type converter,
In order to avoid non-zero cross-on in the case of forward rectification, there is known a circuit in which a delay inductance (resonancer) 25 is inserted in series between the output of the inverter transformer 16 and the rectification diode 22 as shown in FIG. (For example, JP-A-3-135367). The voltage Vls between the other output terminal of the inverter / transformer 16 and the delay inductance 25, the current Iq 1 of the switching element 11, and the voltage Vq 1 between the switching elements 11 at this time are shown in FIG. By delaying the drop in impedance, voltage resonance operation during forward rectification is continued, and zero cross-on is achieved.

【0006】[0006]

【発明が解決しようとする課題】しかし、遅延インダク
タンス(レゾナンサー)25のリセットは整流ダイオー
ド22の逆回復時間に頼っており、また、Co基アモル
ファス磁性合金の残留磁束密度(Br)が高いため、図
11のB−Hカーブに示すように、毎サイクルにおいて
確実なリセットがなされていない。このため、インバー
タ・トランス16の2次タップ電圧と遅延時間の積に対
して、遅延インダクタンス(レゾナンサー)25のコア
・ボリュームを十分大きくしても電圧共振動作が継続さ
れず、変換効率の向上とノイズの低減ができないという
問題があった。本発明は、電圧共振型コンバータをフォ
ワード整流したときの非ゼロ・クロス動作による変換効
率の低下やノイズの発生を、簡単な回路構成により抑制
することを目的とするものである。
However, the resetting of the delay inductance (resonancer) 25 depends on the reverse recovery time of the rectifying diode 22, and the residual magnetic flux density (Br) of the Co-based amorphous magnetic alloy is high. As shown in the BH curve of FIG. 11, a reliable reset is not performed in each cycle. Therefore, the voltage resonance operation is not continued even if the core volume of the delay inductance (resonancer) 25 is sufficiently large with respect to the product of the secondary tap voltage of the inverter transformer 16 and the delay time, and the conversion efficiency is improved. There was a problem that noise could not be reduced. It is an object of the present invention to suppress a decrease in conversion efficiency and generation of noise due to non-zero cross operation when forward rectifying a voltage resonance converter with a simple circuit configuration.

【0007】[0007]

【課題を解決するための手段】本発明は、インバータ・
トランスの出力側と整流ダイオードの間に、Co基アモ
ルファス磁性合金で作られた遅延インダクタンスを直列
に挿入してなる電圧共振動作を用いたスイッチング電源
において、電圧共振を助長するための前記遅延インダク
タンス素子をスイッチング・サイクル毎にリセットし
て、その作用により電圧共振動作を確実にするリセット
回路を具備してなることを特徴とするスイッチング電源
回路である。
SUMMARY OF THE INVENTION The present invention is an inverter
In a switching power supply using a voltage resonance operation in which a delay inductance made of a Co-based amorphous magnetic alloy is inserted in series between an output side of a transformer and a rectifying diode, the delay inductance element for promoting voltage resonance. Is provided for each switching cycle, and a reset circuit that ensures the voltage resonance operation by its action is provided.

【0008】[0008]

【作用】出力に電力を供給しないスイッチング素子のオ
フ時のインバータ・トランスの2次逆電圧を利用するこ
とで、遅延インダクタンス(レゾナンサー)をスイッチ
ング・サイクル毎に確実にリセットすることが可能とな
り、スイッチング素子の遷移損増加を削減できる。
By using the secondary reverse voltage of the inverter transformer when the switching element that does not supply power to the output is off, the delay inductance (resonancer) can be reliably reset at each switching cycle, and switching The increase in transition loss of the device can be reduced.

【0009】[0009]

【実施例】以下、本発明の実施例を図面に基づき説明す
る。図1は、本発明の基本的な回路を示すもので、この
図1は、前記図9における遅延インダクタンス(レゾナ
ンサー)25の出力側に、ダイオード26のカソード側
を接続し、かつ、このダイオード26のアノード側に抵
抗27を直列に接続し、この抵抗27の他端を、インバ
ータ・トランス16の他端に接続したものである。この
ような回路構成において、スイッチング素子11のオフ
時に、ダイオード26と抵抗27とによって遅延インダ
クタンス(レゾナンサー)25にリセット電流Il≒V
ns÷R〔A〕を流すものである。このとき、 最大リセット電流≒(Vt−VF)÷R 〔A〕 となる。 但し、Vt=トランス16のタップ電圧 VF=ダイオード26の順方向電圧降下 R=抵抗27の抵抗値である。
Embodiments of the present invention will be described below with reference to the drawings. FIG. 1 shows a basic circuit of the present invention. In this FIG. 1, the cathode side of a diode 26 is connected to the output side of the delay inductance (resonancer) 25 shown in FIG. A resistor 27 is connected in series to the anode side of the, and the other end of the resistor 27 is connected to the other end of the inverter / transformer 16. In such a circuit configuration, when the switching element 11 is turned off, the reset current Il≈V is applied to the delay inductance (resonancer) 25 by the diode 26 and the resistor 27.
ns / R [A] is flown. At this time, the maximum reset current≈ (Vt−VF) ÷ R [A]. However, Vt = tap voltage of the transformer 16 VF = forward voltage drop of the diode 26 R = resistance value of the resistor 27.

【0010】遅延インダクタンスが必要とするリセット
電流は、安定した遅延時間を得るために、遅延インダク
タンスに用いる磁芯の保磁力(Hc)以上を流す必要が
ある。具体的なリセット電流は、磁芯の材料や形状によ
るが、以下の式で算出される。 リセット電流=Hc×Le÷N 〔A〕 但し、Hc=磁芯の保磁力 Le=磁芯の磁路長 N=コイルの巻数である。
The reset current required by the delay inductance needs to flow more than the coercive force (Hc) of the magnetic core used for the delay inductance in order to obtain a stable delay time. The specific reset current depends on the material and shape of the magnetic core, but is calculated by the following formula. Reset current = Hc × Le ÷ N [A] where Hc = coercive force of magnetic core Le = magnetic path length of magnetic core N = number of windings of coil.

【0011】この図1の回路では、インバータ・トラン
ス16の2次電圧Vnsと直列抵抗27の抵抗値Rによ
って、遅延インダクタンス(レゾナンサー)25のリセ
ット電流を決定し、リセット時間はスイッチング素子1
1のオフ時間となり、特に出力電圧が高い場合には、遅
延インダクタンス(レゾナンサー)25のリセット電流
を一定とするために抵抗27のロスが多くなってしま
う。そこで、リセット電流による制御電力を少なくする
方法としては、図2のように、遅延インダクタンス(レ
ゾナンサー)25の2次側に制御コイル28を設け、こ
の制御コイル28に、ダイオード26、抵抗27の直列
回路を接続し、インバータ・トランス16の2次側に接
続する。
In the circuit of FIG. 1, the reset current of the delay inductance (resonancer) 25 is determined by the secondary voltage Vns of the inverter / transformer 16 and the resistance value R of the series resistor 27, and the reset time is the switching element 1
When the output voltage is high, the loss of the resistor 27 increases because the reset current of the delay inductance (resonancer) 25 is constant. Therefore, as a method of reducing the control power by the reset current, as shown in FIG. 2, a control coil 28 is provided on the secondary side of the delay inductance (resonancer) 25, and a diode 26 and a resistor 27 are connected in series to the control coil 28. The circuit is connected to the secondary side of the inverter / transformer 16.

【0012】このような回路構成とすることによって、
リセット電流は、遅延インダクタンス(レゾナンサー)
25と制御コイル28の巻き数比と抵抗27によって決
定することができ、図1の回路の抵抗のロスが減少でき
る。このとき、 最大リセット電流≒{(Vt−VF)÷R}×(NLs
s÷NLsp) 〔A〕となる。 但し、NLss=遅延インダクタンス25の主巻線数 NLsp=遅延インダクタンス25の制御コイル28の
巻線数である。
With such a circuit configuration,
The reset current is the delay inductance (resonance)
25 and the winding number ratio of the control coil 28 and the resistance 27, the resistance loss of the circuit of FIG. 1 can be reduced. At this time, the maximum reset current≈ {(Vt−VF) ÷ R} × (NLs
s ÷ NLsp) [A]. Here, NLss = the number of main windings of the delay inductance 25, and NLsp = the number of windings of the control coil 28 of the delay inductance 25.

【0013】リセット電流とリセット時間を少なくする
方法としては、また、遅延インダクタンス(レゾナンサ
ー)25に制御コイル28を使用しない方法で、同等の
機能を有する簡便な回路構成として、図1の回路の抵抗
27にコンデンサ29を並列接続して図3のような回路
構成とし、このコンデンサ29の充電時定数を利用して
リセットする回路も可能である。このとき、 最大リセット電流≒(Vt−VF)×C÷t 〔A〕 となる。
A method for reducing the reset current and the reset time is a method in which the control coil 28 is not used for the delay inductance (resonancer) 25. As a simple circuit configuration having the same function, the resistance of the circuit of FIG. A circuit in which a capacitor 29 is connected to 27 in parallel to form a circuit configuration as shown in FIG. 3 and the charge time constant of the capacitor 29 is used for resetting is also possible. At this time, the maximum reset current≈ (Vt−VF) × C ÷ t [A].

【0014】一方、遅延インダクタンスの側からリセッ
ト電流を低減する手段としては、磁芯中に磁場中焼き鈍
した角型比の高いCo基アモルファス合金を用いること
が効果的である。例えば、若干量のFeを含有するCo
−Fe−Si−Bアモルファス合金は、磁歪が略零であ
り、保磁力(Hc)が極めて小さいため、少ない電流で
リセットが可能である。さらに、磁芯の発熱を抑えるた
め、アモルファス合金の飽和磁化(Bs)が小さな組成
を選択することが好ましい。飽和磁化(Bs)を下げる
ための具体的な方法としては、Co,Feの比を磁歪零
に保ったまま、Co+Feの総量を低減する方法、また
はMo,Nb,Ta,W,Cr,Vなどを5原子%以下
の少量添加する方法がある。さらに加えてSn,Siを
1原子%以下の微量添加したものは、アニール条件の適
正範囲が広がり、磁芯加工プロセス上好ましい結果をも
たらす。
On the other hand, as a means for reducing the reset current from the delay inductance side, it is effective to use a Co-based amorphous alloy having a high squareness ratio annealed in the magnetic field in the magnetic core. For example, Co containing a small amount of Fe
Since the -Fe-Si-B amorphous alloy has a magnetostriction of almost zero and a coercive force (Hc) that is extremely small, it can be reset with a small current. Further, in order to suppress heat generation of the magnetic core, it is preferable to select a composition having a small saturation magnetization (Bs) of the amorphous alloy. As a specific method for lowering the saturation magnetization (Bs), a method of reducing the total amount of Co + Fe while keeping the ratio of Co and Fe at zero magnetostriction, Mo, Nb, Ta, W, Cr, V, etc. There is a method of adding a small amount of 5 atomic% or less. In addition, the addition of Sn and Si in a small amount of 1 atomic% or less expands the appropriate range of annealing conditions and brings about favorable results in the magnetic core processing process.

【0015】遅延インダクタンス用の磁芯として最適な
仕様は、以下のとおりである。 角型比:0.98, Bs:0.3T, Hc:0.0
06Oe 組 成:Co−Fe−Si−B−Mo−Snのアモルフ
ァス合金
The optimum specifications for the magnetic core for delay inductance are as follows. Squareness ratio: 0.98, Bs: 0.3T, Hc: 0.0
06Oe Composition: Co-Fe-Si-B-Mo-Sn amorphous alloy

【0016】[0016]

【発明の効果】本発明は、上述のように構成したので、
遅延インダクタンス(レゾナンサー)のリセット回路
は、電圧共振型コンバータにおけるフォワード出力時の
遅延インダクタンス(レゾナンサー)素子をスイッチン
グ・サイクル毎にリセットすることができ、スイッチン
グ素子の確実なゼロ・クロスにより電源回路の高効率化
とノイズ発生を低減でき、安定動作な信頼性の高いスイ
ッチング電源回路を提供するものである。
Since the present invention is constructed as described above,
The delay inductance (resonance) reset circuit can reset the delay inductance (resonancer) element at the time of forward output in the voltage resonance type converter at every switching cycle, and the reliable zero crossing of the switching element allows the high-power of the power supply circuit. It is intended to provide a stable and highly reliable switching power supply circuit capable of improving efficiency and reducing noise generation.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明によるスイッチング電源回路の第1実施
例の電気回路図である。
FIG. 1 is an electric circuit diagram of a first embodiment of a switching power supply circuit according to the present invention.

【図2】本発明によるスイッチング電源回路の第2実施
例の電気回路図である。
FIG. 2 is an electric circuit diagram of a second embodiment of a switching power supply circuit according to the present invention.

【図3】本発明によるスイッチング電源回路の第3実施
例の電気回路図である。
FIG. 3 is an electric circuit diagram of a third embodiment of a switching power supply circuit according to the present invention.

【図4】リセット回路を具備した遅延インダクタンスの
B−Hカーブである。
FIG. 4 is a BH curve of a delay inductance including a reset circuit.

【図5】電圧共振型コンバータの基本回路図である。FIG. 5 is a basic circuit diagram of a voltage resonance converter.

【図6】電圧共振型コンバータの基本動作波形図であ
る。
FIG. 6 is a basic operation waveform diagram of the voltage resonance type converter.

【図7】電圧共振型コンバータのフォワード方式の回路
図である。
FIG. 7 is a circuit diagram of a forward method of a voltage resonance type converter.

【図8】図7における波形図である。FIG. 8 is a waveform diagram in FIG. 7.

【図9】遅延インダクタンスを具備した電圧共振型コン
バータの回路図である。
FIG. 9 is a circuit diagram of a voltage resonance type converter having a delay inductance.

【図10】図9における波形図である。FIG. 10 is a waveform diagram in FIG.

【図11】リセット回路を具備しない遅延インダクタン
スのB−Hカーブである。
FIG. 11 is a BH curve of delay inductance without a reset circuit.

【符号の説明】[Explanation of symbols]

11…スイッチング素子、12…コンデンサ、13…コ
ンデンサ、14…スイッチング素子11のボディー・ダ
イオード、15…VFM信号入力端子、16…インバー
タ・トランス、17…出力端子、18…出力端子、19
…インダクタンス、20…入力端子、21…入力端子、
22…ダイオード、23…ダイオード、24…コンデン
サ、25…遅延インダクタンス、26…ダイオード、2
7…抵抗、28…制御コイル、29…コンデンサ。
11 ... Switching element, 12 ... Capacitor, 13 ... Capacitor, 14 ... Body diode of switching element 11, 15 ... VFM signal input terminal, 16 ... Inverter transformer, 17 ... Output terminal, 18 ... Output terminal, 19
... Inductance, 20 ... Input terminal, 21 ... Input terminal,
22 ... Diode, 23 ... Diode, 24 ... Capacitor, 25 ... Delay inductance, 26 ... Diode, 2
7 ... Resistor, 28 ... Control coil, 29 ... Capacitor.

Claims (4)

【特許請求の範囲】[Claims] 【請求項1】 インバータ・トランスの出力側と整流ダ
イオードの間に、Co基アモルファス磁性合金で作られ
た遅延インダクタンスを直列に挿入してなる電圧共振動
作を用いたスイッチング電源において、電圧共振を助長
するための前記遅延インダクタンス素子をスイッチング
・サイクル毎にリセットして、その作用により電圧共振
動作を確実にするリセット回路を具備してなることを特
徴とするスイッチング電源回路。
1. A switching power supply using a voltage resonance operation in which a delay inductance made of a Co-based amorphous magnetic alloy is inserted in series between an output side of an inverter / transformer and a rectifying diode, thereby promoting voltage resonance. A switching power supply circuit comprising: a reset circuit that resets the delay inductance element for each switching cycle to ensure a voltage resonance operation by its action.
【請求項2】 リセット回路は、遅延インダクタンスの
出力側とインバータ・トランスの他端との間に、ダイオ
ードと抵抗の直列回路を挿入してなる請求項1記載のス
イッチング電源回路。
2. The switching power supply circuit according to claim 1, wherein the reset circuit has a series circuit of a diode and a resistor inserted between the output side of the delay inductance and the other end of the inverter transformer.
【請求項3】 リセット回路は、遅延インダクタンスの
2次側の制御コイルとダイオードと抵抗との直列回路
を、インバータ・トランスの出力側の両端間に挿入して
なる請求項1記載のスイッチング電源回路。
3. The switching power supply circuit according to claim 1, wherein the reset circuit is formed by inserting a series circuit of a control coil on the secondary side of the delay inductance, a diode, and a resistor between both ends on the output side of the inverter / transformer. ..
【請求項4】 リセット回路は、抵抗に、さらにコンデ
ンサを並列接続した請求項2記載のスイッチング電源回
路。
4. The switching power supply circuit according to claim 2, wherein the reset circuit further comprises a resistor and a capacitor connected in parallel.
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Cited By (1)

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Publication number Priority date Publication date Assignee Title
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