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JPH0239215U - - Google Patents

Info

Publication number
JPH0239215U
JPH0239215U JP11736888U JP11736888U JPH0239215U JP H0239215 U JPH0239215 U JP H0239215U JP 11736888 U JP11736888 U JP 11736888U JP 11736888 U JP11736888 U JP 11736888U JP H0239215 U JPH0239215 U JP H0239215U
Authority
JP
Japan
Prior art keywords
data line
thin film
large number
data
pixel electrode
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP11736888U
Other languages
English (en)
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed filed Critical
Priority to JP11736888U priority Critical patent/JPH0239215U/ja
Publication of JPH0239215U publication Critical patent/JPH0239215U/ja
Pending legal-status Critical Current

Links

Landscapes

  • Liquid Crystal (AREA)
  • Devices For Indicating Variable Information By Combining Individual Elements (AREA)
  • Thin Film Transistor (AREA)

Description

【図面の簡単な説明】
第1図は本考案の一実施例を示すTFTパネル
の平面図、第2図は第1図の一部分の拡大図、第
3図は従来のTFTパネルの平面図である。 1……基板、GL……ゲートライン、GLa…
…ゲートライン端子、DL……データライン、
DL……第2データライン、DLa……データ
ライン端子、2a……第1画素電極、2b……第
2画素電極、3a……第1トランジスタ、3b…
…第2トランジスタ、3c……第3トランジスタ

Claims (1)

    【実用新案登録請求の範囲】
  1. 透明基板面に、多数本のゲートラインと、この
    ゲートラインと直交する多数本のデータラインと
    を形成するとともに、前記各ゲートラインおよび
    各データラインに沿わせて、多数の透明画素電極
    と、この各画素電極を駆動する多数の薄膜トラン
    ジスタとを縦横に配列形成したTFTパネルにお
    いて、前記各データライン間にそれぞれ第2のデ
    ータラインを形成し、この各第2データラインの
    端部をこの第2データラインの一側のデータライ
    ンに接続するとともに、前記各データラインと各
    第2データラインとに沿わせてそれぞれ1列に画
    素電極を配列し、かつ前記データラインに沿う第
    1の画素電極にそれぞれ対応させて第1の薄膜ト
    ランジスタを設けて、この第1の薄膜トランジス
    タのソース電極を前記第1の画素電極に接続し、
    前記第2データラインに沿う第2の画素電極にそ
    れぞれ対応させて第2と第3の一対の薄膜トラン
    ジスタを設けて、この第2と第3の薄膜トランジ
    スタのソース電極同士を接続して前記第2の画素
    電極に接続し、前記第1、第2、第3の薄膜トラ
    ンジスタのゲート電極を同じゲートラインに接続
    するとともに、前記第1の薄膜トランジスタのド
    レイン電極は前記データラインに接続し、前記第
    2の薄膜トランジスタのドレイン電極は前記第2
    データラインに接続し、前記第3の薄膜トランジ
    スタのドレイン電極は前記第2データラインの他
    側のデータラインに接続したことを特徴とするT
    FTパネル。
JP11736888U 1988-09-08 1988-09-08 Pending JPH0239215U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP11736888U JPH0239215U (ja) 1988-09-08 1988-09-08

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP11736888U JPH0239215U (ja) 1988-09-08 1988-09-08

Publications (1)

Publication Number Publication Date
JPH0239215U true JPH0239215U (ja) 1990-03-15

Family

ID=31360769

Family Applications (1)

Application Number Title Priority Date Filing Date
JP11736888U Pending JPH0239215U (ja) 1988-09-08 1988-09-08

Country Status (1)

Country Link
JP (1) JPH0239215U (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015057674A (ja) * 2014-12-22 2015-03-26 株式会社半導体エネルギー研究所 表示装置
US11300841B2 (en) 2007-05-18 2022-04-12 Semiconductor Energy Laboratory Co., Ltd. Liquid crystal display device

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US11300841B2 (en) 2007-05-18 2022-04-12 Semiconductor Energy Laboratory Co., Ltd. Liquid crystal display device
JP2015057674A (ja) * 2014-12-22 2015-03-26 株式会社半導体エネルギー研究所 表示装置

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